CN104464817B - 液晶显示装置及其移位寄存器 - Google Patents

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Abstract

本发明提供一种液晶显示装置及其移位寄存器。该移位寄存器的每一移位寄存单元包括接收并暂时存储前级讯号的存储电路、电位控制电路以及为扫描线充电和放电的反相电路，电位控制电路和反相电路之间具有第一节点，存储电路和电位控制电路之间具有第二节点，存储电路用于选择性将接收的电平信号反相后输出至第二节点，电位控制电路用于为第一节点提供低电平信号，反相电路用于选择性将电位控制电路提供的低电平信号反相后输出。通过上述方式，本发明有利于液晶显示面板的窄边框或无边框设计，并提升制程良率。

Description

液晶显示装置及其移位寄存器
技术领域
本发明涉及液晶显示驱动技术领域，具体而言涉及一种液晶显示装置及其移位寄存器。
背景技术
液晶显示装置需要具有适当的驱动电路，驱动电路一般包括数据驱动电路和扫描驱动电路。其中，扫描驱动电路常应用移位寄存器作为核心电路元件。
通常，移位寄存器由多个移位寄存单元串联而成，并且上一级移位寄存单元的输出信号作为后一级移位寄存单元的输入信号。然而，当前多数单个移位寄存单元的结构较为复杂，多个移位寄存单元串联后所占区域较大，不利于液晶显示面板的窄边框或无边框设计，并且复杂的结构极易降低液晶显示面板的制程良率。
发明内容
有鉴于此，本发明实施例所要解决的技术问题是提供一种液晶显示装置及其移位寄存器，有利于液晶显示面板的窄边框或无边框设计，并提升液晶显示面板的制程良率。
为解决上述技术问题，本发明采用的一个技术方案是：提供一种移位寄存器，具有多个移位寄存单元，每一移位寄存单元包括接收并暂时存储前级讯号的存储电路、电位控制电路和为液晶显示面板的扫描线充电和放电的反相电路，电位控制电路和反相电路之间具有第一节点，存储电路和电位控制电路之间具有第二节点，存储电路用于在第一时序信号的控制下选择性将接收的电平信号反相后输出至第二节点，电位控制电路用于为第一节点提供低电平信号，反相电路用于在第二时序信号的控制下选择性将电位控制电路提供的低电平信号反相后输出。
其中，存储电路包括输入端、第一开关管、第二开关管、第一反相器和第二反相器，第一开关管和第一反相器之间具有第三节点，第一开关管的控制端连接外部电路以接收第一时序信号，第一开关管的第一端连接输入端以接收上一级移位寄存单元的输出信号，第一开关管的第二端连接第三节点，第二开关管的控制端连接外部电路以接收第一时序信号，第二开关管的第一端连接第二反相器，第二开关管的第二端连接第三节点。
其中，第一开关管为N型MOS管，第一开关管的控制端、第一端和第二端分别为N型MOS管的栅极、源极和漏极，第二开关管为P型MOS管，第二开关管的控制端、第一端和第二端分别为P型MOS管的栅极、源极和漏极。
其中，第一反相器包括第三开关管和第四开关管，第二反相器包括第五开关管和第六开关管，第三开关管的控制端连接第三节点，第三开关管的第一端连接外部电路以接收高电平信号，第三开关管的第二端连接第二节点，第四开关管的控制端连接第三节点，第四开关管的第一端连接外部电路以接收低电平信号，第四开关管的第二端连接第二节点，第五开关管的控制端连接第二节点，第五开关管的第一端连接外部电路以接收高电平信号，第五开关管的第二端连接第二开关管的第一端，第六开关管的控制端连接第二节点，第六开关管的第一端连接外部电路以接收低电平信号，第六开关管的第二端连接第二开关管的第一端。
其中，第三开关管为P型MOS管，第三开关管的控制端、第一端和第二端分别为P型MOS管的栅极、源极和漏极，第四开关管为N型MOS管，第四开关管的控制端、第一端和第二端分别为N型MOS管的栅极、源极和漏极，第五开关管为P型MOS管，第五开关管的控制端、第一端和第二端分别为P型MOS管的栅极、源极和漏极，第六开关管为N型MOS管，第六开关管的控制端、第一端和第二端分别为N型MOS管的栅极、源极和漏极。
其中，电位控制电路包括第七开关管、第八开关管和第九开关管，第七开关管的控制端连接第二节点，第七开关管的第一端连接第二节点，第七开关管的第二端连接第一节点，第八开关管的控制端连接外部电路以接收第二时序信号，第八开关管的第一端连接第二节点，第八开关管的第二端连接第一节点，第九开关管的控制端连接外部电路以接收第二时序信号，第九开关管的第一端连接外部电路以接收高电平信号，第九开关管的第二端连接第一节点。
其中，第七开关管为N型MOS管或P型MOS管，第七开关管的控制端、第一端和第二端分别为N型MOS管或P型MOS管的栅极、源极和漏极，第八开关管为N型MOS管，第八开关管的控制端、第一端和第二端分别为N型MOS管的栅极、源极和漏极，第九开关管为P型MOS管，第九开关管的控制端、第一端和第二端分别为P型MOS管的栅极、源极和漏极。
其中，反相电路包括第十开关管、第十一开关管和输出端，第十开关管的控制端连接第一节点，第十开关管的第一端连接外部电路以接收高电平信号，第十开关管的第二端连接输出端，第十一开关管的控制端连接第一节点，第十一开关管的第一端连接外部电路以接收低电平信号，第十一开关管的第二端连接输出端。
其中，第十开关管为P型MOS管，第十开关管的控制端、第一端和第二端分别为P型MOS管的栅极、源极和漏极，第十一开关管为N型MOS管，第十一开关管的控制端、第一端和第二端分别为N型MOS管的栅极、源极和漏极。
为解决上述技术问题，本发明采用的另一个技术方案是：提供一种液晶显示装置，包括液晶显示面板、为液晶显示面板提供数据信号的数据驱动电路以及为液晶显示面板提供扫描信号的扫描驱动电路，数据驱动电路和扫描驱动电路分别包括上述移位寄存器，以控制数据信号和扫描信号的输出时序。
通过上述技术方案，本发明实施例所产生的有益效果是：本发明实施例通过设计每一移位寄存单元仅包括存储电路、电位控制电路和反相电路，其中电位控制电路和反相电路之间具有第一节点，存储电路和电位控制电路之间具有第二节点，存储电路用于在第一时序信号的控制下选择性将接收的电平信号反相后输出至第二节点，电位控制电路用于为第一节点提供低电平信号，反相电路用于在第二时序信号的控制下选择性将电位控制电路提供的低电平信号反相后输出，由于单个移位寄存单元的结构较为简单，使得多个移位寄存单元串联后形成的移位寄存器所占区域较大，因此有利于液晶显示面板的窄边框或无边框设计，并且简答的结构比较容易确保液晶显示面板的制程良率。
附图说明
图1是本发明优选实施例的液晶显示装置的结构示意图；
图2是本发明第一实施例的移位寄存单元的电路示意图；
图3是本发明第二实施例的移位寄存单元的电路示意图；
图4是图2所示移位寄存单元一优选实施例的连接示意图；
图5是施加于图4所示移位寄存单元的一实施例的讯号时序图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，本发明以下所描述的实施例仅仅是本发明的一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其它实施例，都属于本发明保护的范围。
图1是本发明优选实施例的液晶显示装置的结构示意图，如图1所示，液晶显示装置10包括液晶显示面板11、为液晶显示面板11提供数据信号的数据驱动电路12以及为液晶显示面板11提供扫描信号的扫描驱动电路13，液晶显示装置10采用GOA(Gate Driver onArray)技术制得数据驱动电路12和扫描驱动电路13分别对应通过多根数据线和多根扫描线与液晶显示面板11连接。
扫描驱动电路13包括移位寄存器，并通过移位寄存器控制数据信号和扫描信号的输出时序。其中，扫描驱动电路13在移位寄存器的控制下依序输出高电平信号至多根扫描线，以逐列控制呈矩阵排布的薄膜晶体管的导通与关闭，从而实现显示画面。
移位寄存器具有多个结构相同且串联的移位寄存单元20，请参阅图2所示，每一移位寄存单元20包括接收并暂时存储前级讯号的存储电路31、电位控制电路32以及为液晶显示面板11的扫描线充电和放电的反相电路33。存储电路31和电位控制电路32之间具有第二节点P2，电位控制电路32和反相电路33之间具有第一节点P1，存储电路31用于在第一时序信号CK1的控制下选择性将接收的电平信号反相后输出至第二节点P2，电位控制电路32用于为第一节点P1提供低电平信号VGL，反相电路33用于在第二时序信号CK2的控制下选择性将电位控制电路32提供的低电平信号VGL反相后输出。在本实施例中：
存储电路31包括输入端V1N1、第一开关管T1、第二开关管T2、第一反相器311和第二反相器312。第一开关管T1和第一反相器311之间具有第三节点P3，第一开关管T1的控制端G1连接外部电路以接收第一时序信号CK1，第一开关管T1的第一端S1连接输入端V1N1以接收上一级移位寄存单元20的输出信号，第一开关管T1的第二端D1连接第三节点P3，第二开关管T2的控制端G2连接外部电路以接收第一时序信号CK1，第二开关管T2的第一端S2连接第二反相器312，第二开关管T2的第二端D2连接第三节点P3。其中，第一开关管T1的控制端G1和第二开关管T2的控制端G2连接同一或不同的外部电路。
其中，第一开关管T1为N型MOS管，第一开关管T1的控制端G1、第一端S1和第二端D1分别为N型MOS管的栅极、源极和漏极，第二开关管T2为P型MOS管，第二开关管T2的控制端G2、第一端S2和第二端D2分别为P型MOS管的栅极、源极和漏极。
本实施例优选第一反相器311由第三开关管T3和第四开关管T4构成，第二反相器312由第五开关管T5和第六开关管T6构成。其中：
第三开关管T3的控制端G3连接第三节点P3，第三开关管T3的第一端S3连接外部电路以接收高电平信号VGH，第三开关管T3的第二端D3连接第二节点P2。第四开关管T4的控制端G4连接第三节点P3，第四开关管T4的第一端S4连接外部电路以接收低电平信号VGL，第四开关管T4的第二端D4连接第二节点P2。第五开关管T5的控制端G5连接第二节点P2，第五开关管T5的第一端S5连接外部电路以接收高电平信号VGH，第五开关管T5的第二端D5连接第二开关管T2的第一端S2。第六开关管T6的控制端G6连接第二节点P2，第六开关管T6的第一端S6连接外部电路以接收低电平信号VGL，第六开关管T6的第二端D6连接第二开关管T2的第一端S2。
本实施例优选地，第三开关管T3为P型MOS管，第三开关管T3的控制端G3、第一端S3和第二端D3分别为P型MOS管的栅极、源极和漏极，第四开关管T4为N型MOS管，第四开关管T4的控制端G4、第一端S4和第二端D4分别为N型MOS管的栅极、源极和漏极，第五开关管T5为P型MOS管，第五开关管T5的控制端G5、第一端S5和第二端D5分别为P型MOS管的栅极、源极和漏极，第六开关管T6为N型MOS管，第六开关管T6的控制端G6、第一端S6和第二端D6分别为N型MOS管的栅极、源极和漏极。
并且，第三开关管T3的第一端S3、第四开关管T4的第一端S4、第五开关管T5的第一端S5和第六开关管T6的第一端S6可以对应连接不同的外部电路，也可以组合连接不同的外部电路。
电位控制电路32包括第七开关管T7、第八开关管T8和第九开关管T9。第七开关管T7的控制端G7连接第二节点P2，第七开关管T7的第一端S7连接第二节点P2，第七开关管T7的第二端D7连接第一节点P1，第八开关管T8的控制端G8连接外部电路以接收第二时序信号CK2，第八开关管T8的第一端S8连接第二节点P2，第八开关管T8的第二端D8连接第一节点P1，第九开关管T9的控制端G9连接外部电路以接收第二时序信号CK2，第九开关管T9的第一端S9连接外部电路以接收高电平信号VGH，第九开关管T9的第二端D9连接第一节点P1。
本实施例优选地，第七开关管T7为N型MOS管，第七开关管T7的控制端G7、第一端S7和第二端D7分别为N型MOS管的栅极、源极和漏极，第八开关管T8为N型MOS管，第八开关管T8的控制端G8、第一端S8和第二端D8分别为N型MOS管的栅极、源极和漏极，第九开关管T9为P型MOS管，第九开关管T9的控制端G9、第一端S9和第二端D9分别为P型MOS管的栅极、源极和漏极。
反相电路33包括第十开关管T10、第十一开关管T11和输出端VOUT，第十开关管T10的控制端G10连接第一节点P1，第十开关管T10的第一端S10连接外部电路以接收高电平信号VGH，第十开关管T10的第二端D10连接输出端VOUT，第十一开关管T11的控制端G11连接第一节点P1，第十一开关管T11的第一端S11连接外部电路以接收低电平信号VGL，第十一开关管T11的第二端D11连接输出端VOUT。
本实施例优选地，第十开关管T10为P型MOS管，第十开关管T10的控制端G10、第一端S10和第二端D10分别为P型MOS管的栅极、源极和漏极，第十一开关管T11为N型MOS管，第十一开关管T11的控制端G11、第一端S11和第二端D11分别为N型MOS管的栅极、源极和漏极。
在本实施例中，第十开关管T10和第十一开关管T11配合构成反相器，用于给液晶显示面板11的扫描线充电和放电，存储电路31用于暂时接收并存储自输入端V1N1接入的电量。第一时序信号CK1为高电位时第一开关管T1导通而第二开关管T2关闭，自输入端V1N1接入的高电位可以传至第三节点P3。第三节点P3为高电位后，由第三开关管T3和第四开关管T4构成的第一反相器311可将第二节点P2拉至低电位。当第一时序信号CK1由高电位变为低电位后，第二开关管T2导通而第一开关管T1关闭，由第三开关管T3、第四开关管T4、第五开关管T5、第六开关管T6、第二开关管T2组成的闭合回路可稳定维持第三节点P3的高电位和第二节点P2的低电位。
对于电位控制电路32，第二时序信号CK2为高电位时第八开关管T8导通而第九开关管T9关闭，第一节点P1可被第二节点P2拉低至低电位，第一节点P1经第十开关管T10和第十一开关管T11构成的反相器的反相作用后输出高电位至与移位寄存单元20连接的扫描线。第二时序信号CK2变为低电位后，第八开关管T8关闭而第九开关管T9导通，第一节点P1被高电平信号VGH拉高电位，输出低电位至与移位寄存单元20连接的扫描线。在非充电期间，第二节点P2处于高电位，第七开关管T7导通，第一节点P1连接第二节点P2而稳定处于高电位，可稳定输出低电位至与移位寄存单元20连接的扫描线。在充电期间，第二节点P2处于低电位，第七开关管T7断开，不影响第一节点P1的电位以及与移位寄存单元20连接的扫描线的充电。
需要说明的是，在本发明的其它实施例中，第七开关管T7还可以为图3所示的P型MOS管，此时第七开关管T7的控制端G7、第一端S7和第二端D7分别为P型MOS管的栅极、源极和漏极。与图2所示实施例的不同之处在于，在非充电期间，第三节点P3处于低电位而第二节点P2处于高电位，第七开关管T7导通，可确保在非充电期间第一节点P1连接第二节点P2而处于高电位，从而可稳定输出低电位至与移位寄存单元20连接的扫描线。在充电期间，第三节点P3处于高电位，第七开关管T7关闭，不影响充电。
图4是图2所示移位寄存单元20一优选实施例的连接示意图。如图3所示，与第1,3,5…,n-1条等奇数项的扫描线连接的移位寄存单元20分布于液晶显示面板11的左侧，与第2,4,6…,n条等偶数项的扫描线连接的移位寄存单元20分布于液晶显示面板11的右侧。每一移位寄存单元20控制一条水平扫描线的电位，例如与第n条扫描线Gn连接的移位寄存单元20控制扫描线Gn的电位。液晶显示面板11两侧的移位寄存单元20与位于液晶显示面板11下部的驱动IC连接，以获得驱动讯号，相邻两个移位寄存单元20之间也通过讯号线连接，从而保证各个移位寄存单元20能逐列控制扫描线的充电和放电。
图5是施加于图4所示移位寄存单元的一实施例的讯号时序图。如图5所示，接通直流高电压源获得高电平信号VGH，接通直流低电压源获得低电平信号VGL，CK1_L和CK2_L为驱动液晶显示面板11左侧移位寄存单元20的时钟信号，CK1_R和CK2_R为液晶显示面板11右侧移位寄存单元20的时钟信号。
结合图2、图4和图5所示，t1～t3为第n-2条扫描线Gn-2在充电前的准备时间，t3～t4为扫描线Gn-2的充电时间，t3～t5为第n条扫描线Gn在充电前的准备时间，t5～t6为扫描线Gn的充电时间。t1时刻，CK2_L和扫描线Gn-4的电位开始提升，与扫描线Gn-2连接的移位寄存单元20的第三节点P3被充至高电位，第二节点P2被拉至低电位。t2时刻，CK2_L和扫描线Gn-4的电位下降，但移位寄存单元20中存储电路31存储的电量可使得扫描线Gn-2连接的移位寄存单元20的第三节点P3和第二节点P2的电位可暂时保存直至下一次CK2_L的电位抬升。t3时刻，CK1_L的电位抬升，与扫描线Gn-2连接的移位寄存单元20的第八开关管T8导通且第九开关管T9关闭，此时该移位寄存单元20的第一节点P1被第二节点P2至低电位，经第十开关管T10和第十一开关管T11的反相后从输出端VOUT输出高电位至扫描线Gn-2。t4时刻，CK1_L的电位降低，与扫描线Gn-2连接的移位寄存单元20的第八开关管T8关闭且第九开关管T9导通，此时，该移位寄存单元20的第一节点P1被拉至高电位，扫描线Gn-4被拉至低电位。t5时刻，CK2_L的电位开始提升，但此时扫描线Gn-4已为低电位，与扫描线Gn-2连接的移位寄存单元20的第三节点P3被拉至低电位，其第二节点P2被拉至高电位。
同理，如图5所示，t3时刻，CK1_L和扫描线Gn-4的电位开始提升，与扫描线Gn连接的移位寄存单元20的第三节点P3被拉至高电位，其第二节点P2被拉至低电位。t5时刻，CK2_L的电位抬升，与扫描线Gn连接的移位寄存单元20的第八开关管T8导通且第九开关管T9关闭，该移位寄存单元20的第一节点P1被第二节点P2拉至低电位，经第十开关管T10和第十一开关管T11的反相后从输出端VOUT输出高电位至扫描线Gn-2。t6时刻，CK2_L的电位降低，与扫描线Gn连接的移位寄存单元20的第八开关管T8关闭且第九开关管T9导通，该移位寄存单元20的第一节点P1被拉至高电位，扫描线Gn被拉至低电位。
依据上述原理，与扫描线G1,G2,…Gn-1,Gn对应连接的各个移位寄存单元20可在时钟信号的适当驱动下逐列为扫描线G1,G2,…Gn-1,Gn充电和放电，使得液晶显示面板11正常显示画面。
综上所述，本发明实施例通过设计每一移位寄存单元仅包括接收并暂时存储前级讯号的存储电路、电位控制电路以及为液晶显示面板的扫描线充电和放电的反相电路，其中电位控制电路和反相电路之间具有第一节点，存储电路和电位控制电路之间具有第二节点，存储电路用于在第一时序信号的控制下选择性将接收的电平信号反相后输出至第二节点，电位控制电路用于为第一节点提供低电平信号，反相电路用于在第二时序信号的控制下选择性将电位控制电路提供的低电平信号反相后输出，由于单个移位寄存单元的结构较为简单，使得多个移位寄存单元串联后形成的移位寄存器所占区域较大，因此有利于液晶显示面板的窄边框或无边框设计，并且简答的结构比较容易确保液晶显示面板的制程良率。
再次说明，以上所述仅为本发明的实施例，并非因此限制本发明的专利范围，凡是利用本发明说明书及附图内容所作的等效结构或等效流程变换，例如各实施例之间技术特征的相互结合，或直接或间接运用在其他相关的技术领域，均同理包括在本发明的专利保护范围内。

Claims (7)

1.一种移位寄存器，具有多个移位寄存单元，其特征在于，每一所述移位寄存单元包括接收并暂时存储前级讯号的存储电路、电位控制电路以及为液晶显示面板的扫描线充电和放电的反相电路，所述电位控制电路和所述反相电路之间具有第一节点，所述存储电路和所述电位控制电路之间具有第二节点，所述存储电路用于在第一时序信号的控制下选择性将接收的电平信号反相后输出至所述第二节点，所述电位控制电路用于为所述第一节点提供低电平信号，所述反相电路用于在第二时序信号的控制下选择性将所述电位控制电路提供的低电平信号反相后输出；
其中，所述存储电路包括输入端、第一开关管、第二开关管、第一反相器和第二反相器，所述第一开关管和所述第一反相器之间具有第三节点，所述第一开关管的控制端连接外部电路以接收所述第一时序信号，所述第一开关管的第一端连接所述输入端以接收上一级移位寄存单元的输出信号，所述第一开关管的第二端连接所述第三节点，所述第二开关管的控制端连接所述外部电路以接收所述第一时序信号，所述第二开关管的第一端连接所述第二反相器，所述第二开关管的第二端连接所述第三节点；
所述电位控制电路包括第七开关管、第八开关管和第九开关管，所述第七开关管的控制端连接所述第二节点，所述第七开关管的第一端连接所述第二节点，所述第七开关管的第二端连接所述第一节点，所述第八开关管的控制端连接外部电路以接收所述第二时序信号，所述第八开关管的第一端连接所述第二节点，所述第八开关管的第二端连接所述第一节点，所述第九开关管的控制端连接所述外部电路以接收所述第二时序信号，所述第九开关管的第一端连接所述外部电路以接收高电平信号，所述第九开关管的第二端连接所述第一节点；
所述反相电路包括第十开关管、第十一开关管和输出端，所述第十开关管的控制端连接所述第一节点，所述第十开关管的第一端连接外部电路以接收高电平信号，所述第十开关管的第二端连接所述输出端，所述第十一开关管的控制端连接所述第一节点，所述第十一开关管的第一端连接外部电路以接收低电平信号，所述第十一开关管的第二端连接所述输出端。
2.根据权利要求1所述的移位寄存器，其特征在于，所述第一开关管为N型MOS管，所述第一开关管的控制端、第一端和第二端分别为所述N型MOS管的栅极、源极和漏极，所述第二开关管为P型MOS管，所述第二开关管的控制端、第一端和第二端分别为所述P型MOS管的栅极、源极和漏极。
3.根据权利要求1所述的移位寄存器，其特征在于，所述第一反相器包括第三开关管和第四开关管，所述第二反相器包括第五开关管和第六开关管，所述第三开关管的控制端连接所述第三节点，所述第三开关管的第一端连接外部电路以接收高电平信号，所述第三开关管的第二端连接所述第二节点，所述第四开关管的控制端连接所述第三节点，所述第四开关管的第一端连接外部电路以接收低电平信号，所述第四开关管的第二端连接所述第二节点，所述第五开关管的控制端连接所述第二节点，所述第五开关管的第一端连接外部电路以接收高电平信号，所述第五开关管的第二端连接所述第二开关管的第一端，所述第六开关管的控制端连接所述第二节点，所述第六开关管的第一端连接外部电路以接收低电平信号，所述第六开关管的第二端连接所述第二开关管的第一端。
4.根据权利要求3所述的移位寄存器，其特征在于，所述第三开关管为P型MOS管，所述第三开关管的控制端、第一端和第二端分别为所述P型MOS管的栅极、源极和漏极，所述第四开关管为N型MOS管，所述第四开关管的控制端、第一端和第二端分别为所述N型MOS管的栅极、源极和漏极，所述第五开关管为P型MOS管，所述第五开关管的控制端、第一端和第二端分别为所述P型MOS管的栅极、源极和漏极，所述第六开关管为N型MOS管，所述第六开关管的控制端、第一端和第二端分别为所述N型MOS管的栅极、源极和漏极。
5.根据权利要求1所述的移位寄存器，其特征在于，所述第七开关管为N型MOS管或P型MOS管，所述第七开关管的控制端、第一端和第二端分别为所述N型MOS管或所述P型MOS管的栅极、源极和漏极，所述第八开关管为N型MOS管，所述第八开关管的控制端、第一端和第二端分别为所述N型MOS管的栅极、源极和漏极，所述第九开关管为P型MOS管，所述第九开关管的控制端、第一端和第二端分别为所述P型MOS管的栅极、源极和漏极。
6.根据权利要求1所述的移位寄存器，其特征在于，所述第十开关管为P型MOS管，所述第十开关管的控制端、第一端和第二端分别为所述P型MOS管的栅极、源极和漏极，所述第十一开关管为N型MOS管，所述第十一开关管的控制端、第一端和第二端分别为所述N型MOS管的栅极、源极和漏极。
7.一种液晶显示装置，包括液晶显示面板、为所述液晶显示面板提供数据信号的数据驱动电路以及为所述液晶显示面板提供扫描信号的扫描驱动电路，其特征在于，所述数据驱动电路和所述扫描驱动电路分别包括权利要求1～6任一项所述的移位寄存器，以控制所述数据信号和所述扫描信号的输出时序。
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