WO2014071674A1 - 直流隔离降压变换器及其母线电压检测电路 - Google Patents

直流隔离降压变换器及其母线电压检测电路 Download PDF

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WO2014071674A1
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resistor
node
bus voltage
diode
capacitor
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张�林
付登萌
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联合汽车电子有限公司
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    • G01—MEASURING; TESTING
    • G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R19/00—Arrangements for measuring currents or voltages or for indicating presence or sign thereof
    • G01R19/25—Arrangements for measuring currents or voltages or for indicating presence or sign thereof using digital measurement techniques
    • G01R19/2503—Arrangements for measuring currents or voltages or for indicating presence or sign thereof using digital measurement techniques for measuring voltage only, e.g. digital volt meters (DVM's)
    • H—ELECTRICITY
    • H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
    • H02M3/00—Conversion of dc power input into dc power output
    • H02M3/22—Conversion of dc power input into dc power output with intermediate conversion into ac
    • H02M3/24—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters
    • H02M3/28—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac
    • H02M3/325—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal
    • H02M3/335—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only

Definitions

  • the invention relates to a DC power supply technology, in particular to a DC isolated buck converter and a bus voltage detecting circuit thereof.
  • the switching type DC/DC isolation conversion circuit adjusts the output voltage or maintains the output voltage constant by periodically controlling the on-off time or on-off frequency of the switching device (power semiconductor device), and converts the fixed DC voltage into a controlled DC. Voltage output.
  • the common switching DC/DC (DC to DC) isolation conversion circuit is shown in Figure 1. It includes a voltage conversion circuit, an isolated inverter circuit, and a rectified output circuit. The input terminal of the voltage conversion circuit is connected to a DC voltage source Ud for control.
  • the half-bridge isolated inverter circuit is shown in FIG. 2, and the DC voltage Ui is input.
  • the first capacitor C1 and the second capacitor C2 have the same capacity and a large enough capacity, so that the potential of the two capacitor connections is half of the input DC voltage Ui.
  • the voltage across the capacitor is maintained as Ui/2
  • the driving control signal u g3 of the third switching device VT3 controls the on and off of the third switching device VT3
  • the driving control signal u g4 of the fourth switching device VT4 is controlled.
  • the on/off rule of the fourth switching device VT4, the third switching device VT3, and the fourth switching device VT4 are: each switching cycle For Ts, the first switching cycle is only for the third switching device VT3, and the fourth switching device VT4 is kept off.
  • the push-pull isolation inverter circuit is shown in FIG. 4, and similar to the half-bridge isolated inverter circuit, only the third switching device VT3 and the fourth switching device VT4 are two switching devices, and the third switching device VT3 is driven and controlled.
  • G3 controls the on/off of the third switching device VT3, and the driving control signal u g4 of the fourth switching device VT4 controls the on and off of the fourth switching device VT4, the third switching device VT3, and the fourth switching device VT4 (the two switching devices in the figure are
  • a vehicle DC/DC converter converts the voltage of a high-voltage battery (such as 250V to 430V) into a voltage of a low-voltage battery (such as 10V to 16V), and supplies power to a low-voltage load, such as a car air conditioner, an audio system, Electric windows, etc.
  • the DC/DC converter for vehicles above 1.2kW usually adopts a full-bridge isolation topology, and the secondary side is full-wave rectification. As shown in Fig. 5, the positive end of the high-voltage battery is connected to the first switch tube through the high-voltage bus.
  • the third switch tube Q3, the negative end of the high voltage battery is connected to the second switch tube Q2 and the fourth switch tube Q4 through the ground line, the bus capacitor C is connected between the high voltage bus and the ground line, and the primary winding of the isolation transformer T is connected to the first switch tube.
  • Q1 between the junction of the second switching transistor Q2 and the junction of the third switching transistor Q3 and the fourth switching transistor Q4, the second switching transistor Q2 in each cycle
  • the third switch tube Q3 is alternately turned on with the first switch tube Q1 and the fourth switch tube Q4, and the conduction time is adjustable.
  • the voltage applied to the primary winding of the isolation transformer is an alternating square wave whose amplitude is the high voltage Ui of the high voltage battery.
  • the two ends of the secondary winding of the isolation transformer are connected to the ground respectively.
  • the fifth rectifier switch tube Q5 and the sixth rectifier switch tube Q6, the middle tap of the secondary winding of the isolation transformer is connected to the ground through the first inductor L1 and the first capacitor C1, and the connection end of the first inductor L1 and the first capacitor C1 is connected to the positive end of the low voltage battery, and the negative terminal of the low voltage battery is grounded.
  • the connection end of a capacitor C1 and the first inductor L1 serves as a low-voltage output terminal of the full-bridge isolated DC converter, and outputs a low-voltage Uo to the low-voltage battery.
  • the control circuit of each switch tube in the circuit is supplied with a working voltage by a low-voltage small-power auxiliary power source.
  • the power of the low-voltage small-power auxiliary power source is generally several watts to several tens of watts, and the circuit topology can be forward, flyback, and the like.
  • the bus voltage detection mode of the common DC isolated buck converter is obtained directly by the resistor divider on the high voltage side. Since the control circuit chip works on the low voltage side, high voltage and low voltage isolation must be performed from the perspective of vehicle safety, in order to ensure high voltage. Isolated from the low voltage, the bus voltage detection signal obtained by the resistor divider on the high voltage side needs to be transmitted to the low voltage side control chip through the AD (analog to digital conversion) chip and the isolation chip, and the power supply for the AD chip and the isolation chip needs to be increased. , The bus voltage detection method of the common DC isolated buck converter has high cost and complicated circuit.
  • the present invention provides a DC isolated buck converter including an isolation transformer, a rectifier circuit, and a bus voltage detection circuit;
  • the bus voltage detecting circuit includes a first resistor, a second resistor, a first diode, a second diode, a third resistor, a first capacitor, a first input end, and a second input end;
  • the first input end and the second input end are respectively connected to upper and lower ends of the secondary winding of the isolation transformer of the DC isolation buck converter;
  • the second resistor and the second diode are connected in series between the second input end and the first node; the negative end of the second diode is on the first node side, and the positive end is in the first Two input side;
  • the first node is used by the digital control circuit to detect the bus voltage of the DC isolated buck converter.
  • the third diode is positively terminated to the first node, and the negative terminal is connected to the second node;
  • the second capacitor and the fourth resistor are connected in parallel between the second node and the ground of the bus voltage detecting circuit;
  • the ninth resistor is connected to the gate of the second NMOS switch tube
  • the tenth resistor is connected to the second node at the other end;
  • the fifth Zener diode is connected in series with the second resistor and the second diode between the second input terminal and the first node, and the positive terminal of the fifth Zener diode is on the first node side, negative The end is on the second input side.
  • the fourth capacitor is connected to the ground of the bus voltage detecting circuit
  • the rectifier circuit includes a fifth NMOS rectifier switch tube and a sixth NMOS rectifier switch tube;
  • the drains of the first NMOS switch tube and the third NMOS switch tube are connected to the high voltage side bus bar;
  • the present invention provides a bus voltage detecting circuit for a DC isolated buck converter, which includes a first resistor, a second resistor, a first diode, a second diode, a third resistor, and a first Capacitor, first input end, second input end;
  • the first resistor and the first diode are connected in series between the first input end and the first node; the negative end of the first diode is on the first node side, and the positive end is in the first An input side;
  • the second resistor and the second diode are connected in series between the second input end and the first node; the negative end of the second diode is on the first node side, and the positive end is in the first Two input side;
  • the ground of the bus voltage detecting circuit is used for connecting the negative terminal of the DC voltage output of the DC isolation buck converter
  • the first node is used by the digital control circuit to detect the bus voltage of the DC isolated buck converter.
  • the bus voltage detecting circuit further includes a third diode, a second capacitor, a third capacitor, a first comparator, a first transistor, a second NMOS switch, a fourth resistor, and a fifth resistor. a sixth resistor, a seventh resistor, an eighth resistor, a ninth resistor, and a tenth resistor;
  • the second capacitor and the fourth resistor are connected in parallel between the second node and the ground of the bus voltage detecting circuit;
  • the fifth resistor is connected between the second node and the negative input of the first comparator
  • the sixth resistor is connected between the first node and the positive input of the first comparator
  • the seventh resistor is connected between the first comparator output and the first pole of the first transistor
  • the third capacitor is connected to the ground of the bus voltage detecting circuit at the other end;
  • the ninth resistor is connected to the gate of the second NMOS switch tube
  • the second NMOS switch tube has a source connected to the ground of the bus voltage detecting circuit and a drain connected to one end of the tenth resistor;
  • the second node is used for an analog control circuit or a digital control circuit to detect a bus voltage of a DC isolated buck converter.
  • the bus voltage detecting circuit further includes a fourth Zener diode and a fifth Zener diode;
  • the fourth Zener diode is connected in series with the first resistor and the first diode between the first input terminal and the first node, and the positive terminal of the fourth Zener diode is on the first node side, negative The end is on the first input end side;
  • the fifth Zener diode is connected in series with the second resistor and the second diode between the second input terminal and the first node, and the positive terminal of the fifth Zener diode is on the first node side, negative The end is on the second input side.
  • the bus voltage detecting circuit further includes an eleventh resistor and a fourth capacitor;
  • the eleventh resistor has one end connected to the second node and the other end connected to one end of the fourth capacitor;
  • Figure 4 is a diagram of a common push-pull isolated inverter circuit
  • FIG. 7 is a schematic view showing a first embodiment of a bus voltage detecting circuit of the DC isolated buck converter of the present invention.
  • the isolation transformer T, the upper and lower ends of the secondary winding are respectively connected to the two input ends of the rectifier circuit, and the intermediate tap of the secondary winding is used for connecting the positive terminal of the DC voltage output of the DC isolation buck converter;
  • the rectifier circuit has an output end for receiving a negative terminal of a DC voltage output of the DC isolation buck converter
  • the third resistor R3 and the first capacitor C1 are connected in parallel between the first node 13 and the ground of the bus voltage detecting circuit;
  • the ground of the bus voltage detecting circuit is used for connecting the negative terminal of the DC voltage output of the DC isolation buck converter
  • the DC-isolated buck converter of the first embodiment the PWM of the secondary side of the transformer is modulated by resistor divider and diode rectification (pulse width modulation) The positive and negative AC signals of the wave signal are converted into one-way PWM pulse signals.
  • the first resistor R1 and the first diode D1 are connected in series between the first input terminal 11 and the first node 13 , and the negative terminal of the first diode D1 is on the first node 13 side.
  • the positive end is on the side of the first input end 11;
  • the seventh resistor R7 is connected between the output end of the first comparator A1 and the first pole of the first transistor (the base of the NPN transistor or the gate of the NMOS switch);
  • the second node is used for an analog control circuit or a digital control circuit to detect a high voltage side bus voltage of the DC isolated buck converter.
  • the voltage of the third capacitor is low (by adjusting the values of the eighth resistor R8 and the third capacitor C3, the voltage across the third capacitor C3 is lower than 0.5V), so the second NMOS switch in the discharge loop
  • the voltage of the second node 14 rises following the peak voltage of the first node 13 rises; when the first comparator A1 outputs a low level, it indicates that the positive terminal peak voltage of the third diode D3 is subtracted from the third pole
  • the forward voltage drop of the tube D3 is less than the negative terminal voltage.
  • the first transistor is turned off, and the voltage across the third capacitor C3 is charged to the high level by the working power source (such as 5V) through the eighth resistor R8, and the first in the discharge loop
  • the two NMOS switch tubes are turned on, and the voltage of the second node 14 follows the first node. 13
  • the peak voltage is lowered and lowered, and the voltage of the negative terminal of the third diode D3 is followed by the peak value of the positive terminal voltage in real time, so that it can be applied to the DC isolation buck converter of the digital control circuit through a specific sampling strategy.
  • the fourth capacitor C4 is connected to the ground of the bus voltage detecting circuit at the other end;
  • two voltage-stabilizing tubes are respectively connected in series at the two input ends of the bus voltage detecting circuit of the DC-isolated buck converter for reducing the quiescent current flowing through the bus voltage detecting circuit of the low-voltage battery.
  • the rectifier circuit includes a fifth NMOS rectifier switch Q5 and a sixth NMOS rectifier switch Q6;
  • the busbar capacitor is connected between the high voltage side busbar and the high voltage side ground;
  • the drains of the first NMOS switch transistor Q1 and the third NMOS switch transistor Q3 are connected to the high voltage side bus bar;
  • connection point of the first NMOS switch tube Q1 and the second NMOS switch tube Q2 is connected to a lower end of the primary winding of the isolation transformer T;
  • the fifth NMOS rectifier switch Q5 has a drain connected to a lower end of the secondary winding of the isolation transformer T, and a source connected to a negative terminal of a DC voltage output of the DC isolation buck converter;
  • the sixth NMOS rectifier switch tube Q6 The drain is connected to the upper end of the secondary winding of the isolation transformer T, and the source is connected to the negative terminal of the DC voltage output of the DC isolation buck converter;
  • the second switch tube Q2 and the third switch tube Q3 are alternately turned on with the first switch tube Q1 and the fourth switch tube Q4, and the on-time is adjustable;
  • a diode is respectively connected between the source and the drain of the first NMOS switch transistor Q1, the second NMOS switch transistor Q2, the third NMOS switch transistor Q3, and the fourth NMOS switch transistor Q4, and the positive terminal of the diode is connected to the source of the NMOS switch transistor. , the negative terminal is connected to the drain of the NMOS switch tube;
  • the middle tap of the secondary winding of the isolation transformer is connected to the ground through an inductor and a capacitor.
  • the connection end of the inductor and the capacitor serves as the positive terminal of the DC voltage output of the DC isolated buck converter, and outputs a low voltage DC voltage to the low voltage battery.
  • the control circuit of each switch tube in the circuit is supplied with a working voltage by a low voltage small power auxiliary working power source.

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Abstract

一种直流隔离降压变换器及其母线电压检测电路。该检测电路通过检测隔离变压器的副边电压实现直流隔离降压变换器母线电压的检测，不需要额外的隔离芯片即可实现高压和低压的隔离，电路简单、成本低。该检测电路还可以通过硬件电路实现只提取PWM波形信号的峰值点电压为模拟信号，实现既可以通过数字式控制电路检测直流隔离降压变换高压侧母线电压，也可以通过模拟式控制电路检测直流隔离降压变换器高压侧母线电压。

Description

直流隔离降压变换器及其母线电压检测电路 技术领域
本发明涉及直流电源技术，特别涉及一种直流隔离降压变换器及其母线电压检测电路。
背景技术
将一个不受控制的输入直流电压变换成为另一个受控的输出直流电压称之为DC/DC变换。在电动汽车驱动及再生制动***中,DC/DC变换器和电机驱动器是***能量流动的重要环节，DC/DC变换器是将电池、直流电机等直流电压源固定的直流电压变换成受控制的直流电压输出 。
开关型DC/DC隔离变换电路是通过周期性的控制开关器件（功率半导体器件）的通断时间或通断频率来调整输出电压或维持输出电压恒定，将固定的直流电压变换成受控制的直流电压输出。常见的开关型DC/DC（直流到直流）隔离变换电路如图1所示，包括电压变换电路、隔离逆变电路、整流输出电路；电压变换电路输入端接直流电压源Ud，用于通过控制其中的开关器件导通与关断来控制输出到隔离逆变电路的直流电压Ui的大小，从而控制开关型直流变换（DC/DC）电路的输出直流电压Uo的大小；隔离逆变电路的输入端接电压变换电路的输出直流电压Ui，用于将电压变换电路的输出直流电压Ui变为高频交流电压输出到整流输出电路；整流输出电路用于将隔离逆变电路输出的高频交流电压整流，输出直流电压Uo；电压变换电路通常有升压变换电路（Boost）、降压变换电路(Buck)、升降压变换电路（Buck-Boost）、库克变换电路（Cuk）等；常用的隔离逆变电路有全桥式、半桥式、推挽式。从控制的角度分，采用模拟式控制电路的直流变换器为模拟式直流变换器，采用数字式控制电路的直流变换器为数字式直流变换器。
半桥式隔离逆变电路如图2所示，输入直流电压Ui,第一电容C1、第二电容C2容量相等且容量足够大，使得两个电容连接处的电位为输入直流电压Ui的一半，并且在电路工作时各该电容两端的电压保持为Ui/2，第三开关器件VT3的驱动控制信号ug3控制第三开关器件VT3的通断，第四开关器件VT4的驱动控制信号ug4控制第四开关器件VT4的通断，第三开关器件VT3、第四开关器件VT4(图中两开关器件为场效应管，也可采用其它功率半导体开关器件)的通断规律为：每个开关周期为Ts,第一开关周期仅为第三开关器件VT3工作，第四开关器件VT4保持截止状态，第一开关周期中第三开关器件VT3的导通持续时间为Ton,关断时间为Toff，Ton＋Toff＝Ts；第二开关周期仅为第四开关器件VT4工作，第三开关器件VT3保持截止状态，第二开关周期中第四开关器件VT4的导通持续时间为Ton,关断时间为Toff，第三开关器件VT3、第四开关器件VT4两个开关器件交替工作，第三开关器件VT3导通时变压器初级绕组的电压为－Ui/2，第四开关器件VT4导通时变压器初级绕组的电压为Ui/2。
全桥式隔离逆变电路如图3所示，是将半桥式隔离逆变电路中的第一电容C1、第二电容C2替换为第一开关器件VT1、第二开关器件VT2，并配以驱动控制信号，第一开关器件VT1的驱动控制信号ug1、第二开关器件VT2的驱动控制信号ug2、第三开关器件VT3的驱动控制信号ug3、第四开关器件VT4的驱动控制信号ug4分别控制相应开关器件的通断，该四开关器件 (图中该四开关器件为场效应管，也可采用其它功率半导体开关器件)的通断规律为：每个开关周期为Ts,第一开关周期仅为第三开关器件VT3、第二开关器件VT2工作，第四开关器件VT4、第一开关器件VT1保持截止状态，第一开关周期中第三开关器件VT3、第二开关器件VT2的导通持续时间为Ton,关断时间为Toff，Ton＋Toff＝Ts；第二开关周期仅为第四开关器件VT4、第一开关器件VT1工作，第三开关器件VT3、第二开关器件VT2保持截止状态，第二开关周期中第四开关器件VT4、第一开关器件VT1的导通持续时间为Ton,关断时间为Toff，第三开关器件VT3和第二开关器件VT2、第四开关器件VT4和第一开关器件VT1两组开关器件交替工作，第三开关器件VT3和第二开关器件VT2导通时变压器初级绕组的电压为－Ui，第四开关器件VT4和第一开关器件VT1导通时变压器初级绕组的电压为Ui。
推挽式隔离逆变电路如图4所示，与半桥式隔离逆变电路相似也是只有第三开关器件VT3、第四开关器件VT4两个开关器件，第三开关器件VT3的驱动控制信号ug3控制第三开关器件VT3的通断，第四开关器件VT4的驱动控制信号ug4控制第四开关器件VT4的通断，第三开关器件VT3、第四开关器件VT4(图中两开关器件为场效应管，也可采用其它功率半导体开关器件)的通断规律为：每个开关周期为Ts,第一开关周期仅为第三开关器件VT3工作，第四开关器件VT4保持截止状态，第一开关周期中第三开关器件VT3的导通持续时间为Ton,关断时间为Toff，Ton＋Toff＝Ts；第二开关周期仅为第四开关器件VT4工作，第三开关器件VT3保持截止状态，第二开关周期中第四开关器件VT4的导通持续时间为Ton,关断时间为Toff，第三开关器件VT3、第四开关器件VT4两个开关器件交替工作，第三开关器件VT3导通时，电流从直流电源正流入变压器初级绕组的上端，从变压器初级绕组中心抽头流出；第三开关器件VT3导通时，电流从直流电源正流入变压器初级绕组的下端，从变压器初级绕组中心抽头流出。
在电动/混合动力汽车中，车用DC/DC变换器将高压电池的电压（如250V～430V）转换成低压电池的电压（如10V～16V），给低压负载供电，如车载空调、音响、电动车窗等。1.2kW以上车用DC/DC变换器通常采用全桥隔离拓扑结构，副边为全波整流，如图5所示，高压电池正端通过高压母线接第一开关管Q1、 第三开关管Q3，高压电池负端通过地线接第二开关管Q2、第四开关管Q4，高压母线同地线之间接有母线电容C,隔离变压器T原边绕组接在第一开关管Q1、第二开关管Q2的接点与第三开关管Q3、第四开关管Q4的接点之间，在每个周期内第二开关管Q2、 第三开关管Q3与 第一开关管Q1 、 第四开关管Q4交替导通，导通时间可调，加到隔离变压器原边绕组的电压是幅值为高压电池高压Ui的交变方波。 隔离变压器副边绕组的两端与地之间分别接 第 五整流开关管 Q5、第 六整流开关管 Q6，隔离变压器副边绕组的中间抽头经第一电感L1、第一电容C1串接到地，第一电感L1同第一电容C1的连接端接低压电池正端，低压电池负端接地，第一电容C1同第一电感L1的连接端作为全桥隔离直流变换器的低压输出端，输出低压Uo到低压电池。电路中各开关管的控制电路由低压小功率辅助电源提供工作电压，低压小功率辅助电源的功率一般为几瓦到几十瓦，电路拓扑可以是正激、反激等。
直流隔离降压变换器，需要对高压侧的母线电压进行检测，以用于直流隔离降压变换器的控制电路芯片对直流隔离降压变换器的工作状态进行调整。
常见的直流隔离降压变换器的母线电压检测方式，是直接在高压侧通过电阻分压得到，由于控制电路芯片工作于低压侧，从整车安全角度出发必须进行高压与低压隔离，为了保证高压与低压的隔离，在高压侧通过电阻分压得到的母线电压检测信号需要通过AD（模数转换）芯片、隔离芯片传输到低压侧的控制芯片，并需要增加给AD芯片和隔离芯片供电的电源， 常见的直流隔离降压变换器的母线电压检测方式，成本较高，电路复杂。而且，由于要将高压（如300V以上）通过电阻分压得到AD芯片可以采集的电压（通常0～5V），需要较大的分压电阻，且电阻的分压比较大，导致检测精度降低，响应时间过长。
 技术问题
本发明要解决的技术问题是提供一种直流隔离降压变换器及其母线电压检测电路，电路简单，成本低。
技术解决方案
为解决上述技术问题，本发明提供的直流隔离降压变换器，其包括隔离变压器、整流电路、母线电压检测电路；
所述隔离变压器，副边绕组的上、下两端分别接所述整流电路的两输入端，副边绕组的中间抽头用于接直流隔离降压变换器的直流电压输出的正端；
所述整流电路，输出端用于接直流隔离降压变换器的直流电压输出的负端；
所述母线电压检测电路，包括第一电阻、第二电阻、第一二极管、第二二极管、第三电阻、第一电容、第一输入端、第二输入端；
所述第一输入端、第二输入端，用于分别接直流隔离降压变换器的隔离变压器的副边绕组的上、下两端；
所述第一电阻、第一二极管，串接在所述第一输入端到第一节点之间；所述第一二极管的负端在第一节点侧，正端在所述第一输入端侧；
所述第二电阻、第二二极管，串接在所述第二输入端到第一节点之间；所述第二二极管的负端在第一节点侧，正端在所述第二输入端侧；
所述第三电阻、第一电容，并联在所述第一节点到所述母线电压检测电路的地之间；
所述母线电压检测电路的地，用于接直流隔离降压变换器的直流电压输出的负端；
所述第一节点，用于数字式控制电路检出直流隔离降压变换器的母线电压。
较佳的，所述母线电压检测电路，还包括第三二极管、第二电容、第三电容、第一比较器、第一晶体管、第二NMOS开关管、第四电阻、第五电阻、第六电阻、第七电阻、第八电阻、第九电阻、第十电阻；
所述第三二极管，正端接第一节点，负端接第二节点；
所述第二电容、第四电阻，并联在所述第二节点到所述母线电压检测电路的地之间；
所述第五电阻，接在所述第二节点到所述第一比较器负输入端之间；
所述第六电阻，接在所述第一节点到所述第一比较器正输入端之间；
所述第七电阻，接在所述第一比较器输出端到所述第一晶体管的第一极之间；
所述第一晶体管的第二极接所述第八电阻的一端、所述第九电阻的一端及所述第三电容的一端，所述第一晶体管的第三极接所述母线电压检测电路的地；
所述第一晶体管为NPN三极管或NMOS开关管；所述第一极为NPN三极管的基极或NMOS开关管栅极；所述第二极为NPN三极管的集电极或NMOS开关管的漏极；所述第三极为NPN三极管的发射极或NMOS开关管的源极；
所述第三电容，另一端接所述母线电压检测电路的地；
所述第八电阻，另一端接辅助工作电源；
所述第九电阻，另一端接所述第二NMOS开关管的栅极；
所述第二NMOS开关管，源极接所述母线电压检测电路的地，漏极接所述第十电阻的一端；
所述第十电阻，另一端接第二节点；
所述第二节点，用于模拟式控制电路或者数字式控制电路检出直流隔离降压变换器的母线电压。
较佳的，所述母线电压检测电路，还包括第四稳压二极管、第五稳压二极管；
所述第四稳压二极管同第一电阻、第一二极管串接在所述第一输入端到第一节点之间，所述第四稳压二极管的正端在第一节点侧，负端在所述第一输入端侧；
所述第五稳压二极管同第二电阻、第二二极管串接在所述第二输入端到第一节点之间，所述第五稳压二极管的正端在第一节点侧，负端在所述第二输入端侧。
较佳的，所述母线电压检测电路，还包括第十一电阻、第四电容；
所述第十一电阻，一端接所述第二节点，另一端接所述第四电容一端；
所述第四电容，另一端接所述母线电压检测电路的地；
所述第十一电阻同第四电容的连接点，用于模拟式控制电路或者数字式控制电路检出直流隔离降压变换器的母线电压。
较佳的，直流隔离降压变换器，还包括母线电容、第一NMOS开关管 、第二NMOS开关管、第三NMOS开关管、第四NMOS开关管；
所述整流电路，包括第 五NMOS整流开关管 、第 六NMOS整流开关管；
所述母线电容，接在高压侧母线同高压侧地之间；
所述 第一NMOS开关管 、 第三NMOS开关管的漏极接高压侧母线；
所述 第二NMOS开关管 、 第四NMOS开关管的源极接高压侧地；
所述第一NMOS开关管同第二NMOS开关管的连接点接所述隔离变压器原边绕组的下端；
所述第三NMOS开关管同第四NMOS开关管的连接点接所述隔离变压器原边绕组的上端；
所述第 五NMOS整流开关管 ，漏极接所述隔离变压器副边绕组的下端， 源极接直流隔离降压变换器的直流电压输出的负端；
所述第六NMOS整流开关管 ，漏极接所述隔离变压器副边绕组的上端， 源极接直流隔离降压变换器的直流电压输出的负端；
第一NMOS开关管 、第二NMOS开关管、第三NMOS开关管、第四NMOS开关管、第 五NMOS整流开关管及第六NMOS整流开关管的栅极分别接各自的驱动控制信号；
在每个周期内，第二开关管 、第三开关管与第一开关管 、第四开关管交替导通 。
较佳的，第一NMOS开关管、第二NMOS开关管、第三NMOS开关管、第四NMOS开关管的源、漏之间分别接有一二极管，该二极管的正端接NMOS开关管的源极，负端接NMOS开关管的漏极；
为解决上述技术问题，本发明提供的直流隔离降压变换器的母线电压检测电路，其包括第一电阻、第二电阻、第一二极管、第二二极管、第三电阻、第一电容、第一输入端、第二输入端；
所述第一输入端、第二输入端，用于分别接直流隔离降压变换器的隔离变压器的副边绕组的两端；
所述第一电阻、第一二极管，串接在所述第一输入端到第一节点之间；所述第一二极管的负端在第一节点侧，正端在所述第一输入端侧；
所述第二电阻、第二二极管，串接在所述第二输入端到第一节点之间；所述第二二极管的负端在第一节点侧，正端在所述第二输入端侧；
所述第三电阻、第一电容并联在所述第一节点到所述母线电压检测电路的地之间；
所述母线电压检测电路的地，用于接直流隔离降压变换器的直流电压输出的负端；
所述第一节点，用于数字式控制电路检出直流隔离降压变换器的母线电压。
较佳的，所述母线电压检测电路，还包括第三二极管、第二电容、第三电容、第一比较器、第一晶体管、第二NMOS开关管、第四电阻、第五电阻、第六电阻、第七电阻、第八电阻、第九电阻、第十电阻；
所述第三二极管，正端接第一节点，负端接第二节点；
所述第二电容、第四电阻，并联在所述第二节点到所述母线电压检测电路的地之间；
所述第五电阻，接在所述第二节点到所述第一比较器负输入端之间；
所述第六电阻，接在所述第一节点到所述第一比较器正输入端之间；
所述第七电阻，接在所述第一比较器输出端到所述第一晶体管的第一极之间；
所述第一晶体管的第一极接所述第八电阻的一端、所述第九电阻的一端及所述第三电容的一端，所述第一晶体管的第二极接所述母线电压检测电路的地；
所述第三电容，另一端接所述母线电压检测电路的地；
所述第八电阻，另一端接辅助工作电源；
所述第九电阻，另一端接所述第二NMOS开关管的栅极；
所述第二NMOS开关管，源极接所述母线电压检测电路的地，漏极接所述第十电阻的一端；
所述第十电阻，另一端接第二节点；
所述第二节点，用于模拟式控制电路或者数字式控制电路检出直流隔离降压变换器的母线电压。
较佳的，所述母线电压检测电路，还包括第四稳压二极管、第五稳压二极管；
所述第四稳压二极管同第一电阻、第一二极管串接在所述第一输入端到第一节点之间，所述第四稳压二极管的正端在第一节点侧，负端在所述第一输入端侧；
所述第五稳压二极管同第二电阻、第二二极管串接在所述第二输入端到第一节点之间，所述第五稳压二极管的正端在第一节点侧，负端在所述第二输入端侧。
较佳的，所述母线电压检测电路，还包括第十一电阻、第四电容；
所述第十一电阻，一端接所述第二节点，另一端接所述第四电容一端；
所述第四电容，另一端接所述母线电压检测电路的地；
所述第十一电阻同第四电容的连接点，用于模拟式控制电路或者数字式控制电路检出直流隔离降压变换器的母线电压。
 有益效果
本发明的直流隔离降压变换器，其母线电压检测电路通过检测隔离变压器的副边电压实现 隔离变压器原边电压的检测，即直流隔离降压变换器母线电压的检测，并且不需要额外的隔离芯片即可实现高压和低压的隔离，电路简单，成本低。本发明的直流隔离降压变换器，其母线电压检测电路还可以通过硬件电路实现只提取PWM波形信号的峰值点电压为模拟信号，实现既可以通过数字式控制电路进行直流隔离降压变换器高压侧母线电压的检测，也可以通过模拟式控制电路进行直流隔离降压变换器高压侧母线电压的检测。
附图说明
为了更清楚地说明本发明的技术方案，下面对本发明所需要使用的附图作简单的介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是 常见的开关型DC/DC隔离变换电示意图；
图2是 常见的半桥式隔离逆变电路图；
图3是 常见的全桥式隔离逆变电路图；
图4是 常见的推挽式隔离逆变电路图；
图5是 常见的车用DC/DC变换器电路图；
图6是本发明的直流隔离降压变换器一实施例示意图；
图7是本发明的直流隔离降压变换器的母线电压检测电路第一实施例示意图；
图8是本发明的直流隔离降压变换器的母线电压检测电路第二实施例示意图；
图9是本发明的直流隔离降压变换器的母线电压检测电路第二实施例示意图。
 本发明的最佳实施方式
下面将结合附图，对本发明中的技术方案进行清楚、完整的描述，显然，所描述的实施例是本发明的一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动的前提下所获得的所有其它实施例，都属于本发明保护的范围。
实施例一
直流隔离降压变换器，如图6所示，包括隔离变压器T、整流电路、母线电压检测电路；
所述隔离变压器T，副边绕组的上、下两端分别接所述整流电路的两输入端，副边绕组的中间抽头用于接直流隔离降压变换器的直流电压输出的正端；
所述整流电路，输出端用于接直流隔离降压变换器的直流电压输出的负端；
所述母线电压检测电路，如图7所示，包括第一电阻R1、第二电阻R2、第一二极管D1、第二二极管D2、第三电阻R3、第一电容C1、第一输入端11、第二输入端12；
所述第一输入端11、第二输入端12，用于分别接直流隔离降压变换器的隔离变压器T的副边绕组的上、下两端；
所述第一电阻R1、第一二极管D1，串接在所述第一输入端11到第一节点13之间，所述第一二极管D1的负端在第一节点13侧，正端在所述第一输入端11侧；
所述第二电阻R2、第二二极管D2，串接在所述第二输入端12到第一节点13之间，所述第二二极管D2的负端在第一节点13侧，正端在所述第二输入端12侧；
所述第三电阻R3、第一电容C1，并联在第一节点13到所述母线电压检测电路的地之间；
所述母线电压检测电路的地，用于接直流隔离降压变换器的直流电压输出的负端；
所述第一节点13，用于数字式控制电路检出直流隔离降压变换器电路高压侧母线电压。
实施例一的直流隔离降压变换器，通过电阻分压和二极管整流将变压器副边的PWM（ 脉冲宽度调制 ）波信号的正负交流信号转化为单向PWM脉冲信号，由于直流隔离降压变换器的高压侧的母线电压约等于隔离变压器T的变压原边上、下两端电压的峰值，而变压副边上、下两端对地的电压的峰值为原边峰值除以变压器匝数比的2倍（变压器原副边变比系数为k:1:1），所以通过数字式控制电路从第一节点13提取变压器副边对地信号的PWM波的峰值电压可以实现直流隔离降压变换器的高压侧的母线电压的检测，不需要额外的隔离芯片即可实现高压和低压的隔离，电路简单，成本低。
实施例二
基于实施例一，直流隔离降压变换器的母线电压检测电路，如图8所示，包括第一电阻R1、第二电阻R2、第一二极管D1、第二二极管D2、第三电阻R3、第一电容C1；还包括第三二极管D3、第二电容C2、第三电容C3、第一比较器A1、第一晶体管（NPN三极管或NMOS开关管）、第二NMOS开关管、第四电阻R4、第五电阻R5、第六电阻R6、第七电阻R7、第八电阻R8、第九电阻R9、第十电阻R10；
所述第一电阻R1、第一二极管D1，串接在所述第一输入端11到第一节点13之间，所述第一二极管D1的负端在第一节点13侧，正端在所述第一输入端11侧；
所述第二电阻R2、第二二极管D2，串接在所述第二输入端12到第一节点13之间，所述第二二极管D2的负端在第一节点13侧，正端在所述第二输入端12侧；
所述第三电阻R3、第一电容C1，并联在第一节点13到所述母线电压检测电路的地之间；
所述第三二极管D3，正端接第一节点13，负端接第二节点14；
所述第二电容C2、第四电阻R4，并联在所述第二节点14到所述母线电压检测电路的地之间；
所述第五电阻R5，接在所述第二节点14到所述第一比较器A1负输入端之间；
所述第六电阻R6，接在所述第一节点13到所述第一比较器A1正输入端之间；
所述第七电阻R7，接在所述第一比较器A1输出端到所述第一晶体管的第一极（NPN三极管的基极或NMOS开关管的栅极）之间；
所述第一晶体管的第二极（NPN三极管的集电极或NMOS开关管的漏极）接所述第八电阻R8的一端、所述第九电阻R9的一端及所述第三电容C3的一端，发射极接所述母线电压检测电路的地；
所述第三电容C3，另一端接所述母线电压检测电路的地；
所述第八电阻R8，另一端接辅助工作电源Vcc(如5V)；
所述第九电阻R9，另一端接所述第二NMOS开关管的栅极；
所述第二NMOS开关管，源极接所述母线电压检测电路的地，漏极接所述第十电阻R10的一端；
所述第十电阻R10，另一端接第二节点14；
所述第二节点，用于模拟式控制电路或者数字式控制电路检出直流隔离降压变换器的高压侧母线电压。
由于隔离变压器T副边的两端对地的电压为相位差为180度、占空比小于50%的PWM波形信号，直接检测该信号对采样要求较高，通过模拟式控制电路无法检测。实施例二的直流隔离降压变换器的母线电压检测电路，通过硬件电路实现了只提取PWM波形信号的峰值点电压的方法，从而实现了既可以通过数字式控制电路检出直流隔离降压变换器的高压侧母线电压，也可以通过模拟式控制电路检出直流隔离降压变换器的高压侧母线电压。
为了提取整流后的PWM波的峰值电压，实施例二的直流隔离降压变换器的母线电压检测电路，通过第三二极管D3单向给第二电容C2充电，第三二极管D3正端的信号为一定占空比的PWM信号，负端为直流信号，该直流信号等于第三二极管D3正端的峰值电压与第三二极管D3的正向压降之差，在PWM波的正周期给第二电容C2充电，而在负周期内利用二极管的反相截止特性，保证第二电容C2的电荷不被释放。为了在直流隔离降压变换器的母线电压下降时，将第二电容C2的电荷进行释放，第九电阻R9、第十电阻R10和第二NMOS开关管组成放电回路，当DC/DC母线下降时，该回路将第二电容C2的电荷进行释放，当第二电容C2一端所接的第二节点14的电压与第三二极管D3的压降之和等于第一电容C1一端所接的第一节点13的峰值电压时，该放电回路被关闭，第二节点14的电压跟随第三二极管D3的第一节点13电压的峰值电压变化。为了检测直流隔离降压变换器的母线电压的上升和下降，第一比较器A1、第五电阻R5及第六电阻R6组成母线电压升降检测电路，该电路通过实时检测第三二极管D3两端的电压来实现，当母线电压升高时，第三二极管D3正端峰值电压减去第三二极管D3的正向压降大于等于负端电压，第一比较器A1输出和第三二极管D3正端相同开关频率和占空比的PWM波，其幅值由VCC决定（如5V），当母线电压下降时，第三二极管D3正端峰值电压减去第三二极管D3的正向压降小于负端电压，第一比较器A1输出低电平0。第七电阻R7、第八电阻R8、第三电容C3及第一NPN二极管组成PWM检测电路，第一比较器A1输出和第三二极管D3正端相同开关频率和占空比的PWM波时，即表明第三二极管D3的正端峰值电压减去第三二极管D3的正向压降大于等于负端电压，此时第一晶体管处于开关状态，由于第三电容C3放电远快于充电，第三电容的电压为低电平（通过调整第八电阻R8、第三电容C3的值可以保证第三电容C3两端电压低于0.5V），因此放电回路中的第二NMOS开关管关闭，第二节点14电压跟随第一节点13峰值电压升高而升高；当第一比较器A1输出低电平时，表明第三二极管D3的正端峰值电压减去第三二极管D3的正向压降小于负端电压，此时第一晶体管截止，第三电容C3两端电压通过第八电阻R8被工作电源（如5V）充电为高电平，将放电回路中的第二NMOS开关管打开，第二节点14电压跟随第一节点13峰值电压降低而降低，实现第三二极管D3负端电压实时跟随正端电压的峰值变化，从而既可以应用在数字式控制电路的直流隔离降压变换器中通过特定的采样策略从第一节点13实现直流隔离降压变换器高压侧的母线电压的检测，也可以应用在模拟式控制电路的直流隔离降压变换器中通过模拟电路从所述第二节点14实现直流隔离降压变换器高压侧的母线电压的检测，不需要额外的隔离芯片即可实现了高压和低压的隔离，电路简单，成本低。
实施例三，基于实施例二，直流隔离降压变换器的母线电压检测电路，如图9所示，在图8所示的基础上，增加第四稳压二极管D4、第五稳压二极管D5、第十一电阻R11、第四电容C4；
所述第四稳压二极管D4同第一电阻R1、第一二极管D1串接在所述第一输入端11到第一节点13之间，所述第一二极管D1的负端在第一节点13侧，正端在所述第一输入端11侧；所述第四稳压二极管D4的正端在第一节点13侧，负端在所述第一输入端11侧；
所述第五稳压二极管D5、第二电阻R2、第二二极管D2串接在所述第二输入端12到第一节点13之间，所述第二二极管D2的负端在第一节点13侧，正端在所述第二输入端12侧；所述第五稳压二极管D5的正端在第一节点13侧，负端在所述第一输入端12侧；
所述第十一电阻R11，一端接第二节点14，另一端接所述第四电容C4的一端；
所述第四电容C4，另一端接所述母线电压检测电路的地；
所述第十一电阻R11同所述第四电容C4的连接点，用于模拟式控制电路或数字式控制电路检出直流隔离降压变换器的高压侧母线电压。
实施例三中，通过在直流隔离降压变换器的母线电压检测电路的两个输入端分别串联两个稳压管，用于减小低压电池流经母线电压检测电路的静态电流。
实施例四，基于实施例一、二或三，直流隔离降压变换器，如图6所示，包括隔离变压器T、整流电路、母线电压检测电路，还包括母线电容C、第一NMOS开关管Q1、 第二NMOS开关管Q2、第三NMOS开关管Q3、第四NMOS开关管Q4；
所述整流电路，包括第五NMOS整流开关管Q5 、第六NMOS整流开关管Q6；
所述母线电容，接在高压侧母线同高压侧地之间；
所述第一NMOS开关管Q1 、第三NMOS开关管Q3的漏极接高压侧母线；
所述第二NMOS开关管Q2 、第四NMOS开关管Q4的源极接高压侧地；
所述第一NMOS开关管Q1同第二NMOS开关管Q2的连接点接所述隔离变压器T原边绕组的下端；
所述第三NMOS开关管Q3同第四NMOS开关管Q4的连接点接所述隔离变压器T原边绕组的上端；
所述第五NMOS整流开关管Q5，漏极接所述隔离变压器T副边绕组的下端，源极接直流隔离降压变换器的直流电压输出的负端；
所述第六NMOS整流开关管Q6 ，漏极接所述隔离变压器T副边绕组的上端，源极接直流隔离降压变换器的直流电压输出的负端；
第一NMOS开关管Q1、第二NMOS开关管Q2、第三NMOS开关管Q3、第四NMOS开关管Q4、第 五NMOS整流开关管Q5及第六NMOS整流开关管Q6的栅极分别接各自的驱动控制信号；
在每个周期内，第二开关管Q2、第三开关管Q3与第一开关管Q1、第四开关管Q4交替导通，导通时间可调；
第一NMOS开关管Q1、第二NMOS开关管Q2、第三NMOS开关管Q3、第四NMOS开关管Q4的源、漏之间分别接有一二极管，该二极管的正端接NMOS开关管的源极，负端接NMOS开关管的漏极；
第一NMOS开关管Q1、第二NMOS开关管Q2、第三NMOS开关管Q3、第四NMOS开关管Q4、第 五NMOS整流开关管Q5及第六NMOS整流开关管Q6各自的源端同体端短接。
隔离变压器副边绕组的中间抽头经一电感、一电容串接到地，该电感同该电容的连接端作为该直流隔离降压变换器的直流电压输出的正端，输出低压直流电压到低压电池。电路中各开关管的控制电路由低压小功率辅助工作电源提供工作电压。
本发明的直流隔离降压变换器，其母线电压检测电路通过检测隔离变压器的副边电压实现 隔离变压器原边电压的检测，即直流隔离降压变换器母线电压的检测，并且不需要额外的隔离芯片即可实现高压和低压的隔离，电路简单，成本低。本发明的直流隔离降压变换器，其母线电压检测电路还可以通过硬件电路实现只提取PWM波形信号的峰值点电压为模拟信号，实现既可以通过数字式控制电路进行直流隔离降压变换器高压侧母线电压的检测，也可以通过模拟式控制电路进行直流隔离降压变换器高压侧母线电压的检测。
以上所述仅为本发明的较佳实施例而已，并不用以限制本发明，凡在本发明的精神和原则之内，所做的任何修改、等同替换、改进等，均应包含在本发明保护的范围之内。

Claims (10)

  1. 一种直流隔离降压变换器，包括隔离变压器、整流电路、母线电压检测电路；
    所述隔离变压器，副边绕组的上、下两端分别接所述整流电路的两输入端，副边绕组的中间抽头用于接直流隔离降压变换器的直流电压输出的正端；
    所述整流电路，输出端用于接直流隔离降压变换器的直流电压输出的负端；其特征在于，
    所述母线电压检测电路，包括第一电阻、第二电阻、第一二极管、第二二极管、第三电阻、第一电容、第一输入端、第二输入端；
    所述第一输入端、第二输入端，用于分别接直流隔离降压变换器的隔离变压器的副边绕组的上、下两端；
    所述第一电阻、第一二极管，串接在所述第一输入端到第一节点之间；所述第一二极管的负端在第一节点侧，正端在所述第一输入端侧；
    所述第二电阻、第二二极管，串接在所述第二输入端到第一节点之间；所述第二二极管的负端在第一节点侧，正端在所述第二输入端侧；
    所述第三电阻、第一电容，并联在所述第一节点到所述母线电压检测电路的地之间；
    所述母线电压检测电路的地，用于接直流隔离降压变换器的直流电压输出的负端；
    所述第一节点，用于数字式控制电路检出直流隔离降压变换器的母线电压。
  2. 根据权利要求1所述的直流隔离降压变换器，其特征在于，
    所述母线电压检测电路，还包括第三二极管、第二电容、第三电容、第一比较器、第一晶体管、第二NMOS开关管、第四电阻、第五电阻、第六电阻、第七电阻、第八电阻、第九电阻、第十电阻；
    所述第三二极管，正端接第一节点，负端接第二节点；
    所述第二电容、第四电阻，并联在所述第二节点到所述母线电压检测电路的地之间；
    所述第五电阻，接在所述第二节点到所述第一比较器负输入端之间；
    所述第六电阻，接在所述第一节点到所述第一比较器正输入端之间；
    所述第七电阻，接在所述第一比较器输出端到所述第一晶体管的第一极之间；
    所述第一晶体管的第二极接所述第八电阻的一端、所述第九电阻的一端及所述第三电容的一端，所述第一晶体管的第三极接所述母线电压检测电路的地；
    所述第一晶体管为NPN三极管或NMOS开关管；所述第一极为NPN三极管的基极或NMOS开关管栅极；所述第二极为NPN三极管的集电极或NMOS开关管的漏极；所述第三极为NPN三极管的发射极或NMOS开关管的源极；
    所述第三电容，另一端接所述母线电压检测电路的地；
    所述第八电阻，另一端接辅助工作电源；
    所述第九电阻，另一端接所述第二NMOS开关管的栅极；
    所述第二NMOS开关管，源极接所述母线电压检测电路的地，漏极接所述第十电阻的一端；
    所述第十电阻，另一端接第二节点；
    所述第二节点，用于模拟式控制电路或者数字式控制电路检出直流隔离降压变换器的母线电压。
  3. 根据权利要求2所述的直流隔离降压变换器，其特征在于，
    所述母线电压检测电路，还包括第四稳压二极管、第五稳压二极管；
    所述第四稳压二极管同第一电阻、第一二极管串接在所述第一输入端到第一节点之间，所述第四稳压二极管的正端在第一节点侧，负端在所述第一输入端侧；
    所述第五稳压二极管同第二电阻、第二二极管串接在所述第二输入端到第一节点之间，所述第五稳压二极管的正端在第一节点侧，负端在所述第二输入端侧。
  4. 根据权利要求3所述的直流隔离降压变换器，其特征在于，
    所述母线电压检测电路，还包括第十一电阻、第四电容；
    所述第十一电阻，一端接所述第二节点，另一端接所述第四电容一端；
    所述第四电容，另一端接所述母线电压检测电路的地；
    所述第十一电阻同第四电容的连接点，用于模拟式控制电路或者数字式控制电路检出直流隔离降压变换器的母线电压。
  5. 根据权利要求1到4任一项所述的直流隔离降压变换器，其特征在于，
    直流隔离降压变换器，还包括母线电容、第一NMOS开关管 、 第二NMOS开关管、第三NMOS开关管、第四NMOS开关管；
    所述整流电路，包括第五NMOS整流开关管 、第六NMOS整流开关管；
    所述母线电容，接在高压侧母线同高压侧地之间；
    所述第一NMOS开关管 、第三NMOS开关管的漏极接高压侧母线；
    所述第二NMOS开关管 、第四NMOS开关管的源极接高压侧地；
    所述第一NMOS开关管同第二NMOS开关管的连接点接所述隔离变压器原边绕组的下端；
    所述第三NMOS开关管同第四NMOS开关管的连接点接所述隔离变压器原边绕组的上端；
    所述第五NMOS整流开关管 ，漏极接所述隔离变压器副边绕组的下端， 源极接直流隔离降压变换器的直流电压输出的负端；
    所述第六NMOS整流开关管 ，漏极接所述隔离变压器副边绕组的上端， 源极接直流隔离降压变换器的直流电压输出的负端；
    第一NMOS开关管 、第二NMOS开关管、第三NMOS开关管、第四NMOS开关管、第 五NMOS整流开关管及第六NMOS整流开关管的栅极分别接各自的驱动控制信号；
    在每个周期内，第二开关管 、第三开关管与第一开关管、第四开关管交替导通 。
  6. 根据权利要求5所述的直流隔离降压变换器，其特征在于，
    第一NMOS开关管 、第二NMOS开关管、第三NMOS开关管、第四NMOS开关管的源、漏之间分别接有一二极管，该二极管的正端接NMOS开关管的源极，负端接NMOS开关管的漏极。
  7. 一种直流隔离降压变换器的母线电压检测电路，其特征在于，
    所述母线电压检测电路，包括第一电阻、第二电阻、第一二极管、第二二极管、第三电阻、第一电容、第一输入端、第二输入端；
    所述第一输入端、第二输入端，用于分别接直流隔离降压变换器的隔离变压器的副边绕组的两端；
    所述第一电阻、第一二极管，串接在所述第一输入端到第一节点之间；所述第一二极管的负端在第一节点侧，正端在所述第一输入端侧；
    所述第二电阻、第二二极管，串接在所述第二输入端到第一节点之间；所述第二二极管的负端在第一节点侧，正端在所述第二输入端侧；
    所述第三电阻、第一电容并联在所述第一节点到所述母线电压检测电路的地之间；
    所述母线电压检测电路的地，用于接直流隔离降压变换器的直流电压输出的负端；
    所述第一节点，用于数字式控制电路检出直流隔离降压变换器的母线电压。
  8. 根据权利要求7所述的直流隔离降压变换器的母线电压检测电路，其特征在于，
    所述母线电压检测电路，还包括第三二极管、第二电容、第三电容、第一比较器、第一晶体管、第二NMOS开关管、第四电阻、第五电阻、第六电阻、第七电阻、第八电阻、第九电阻、第十电阻；
    所述第三二极管，正端接第一节点，负端接第二节点；
    所述第二电容、第四电阻，并联在所述第二节点到所述母线电压检测电路的地之间；
    所述第五电阻，接在所述第二节点到所述第一比较器负输入端之间；
    所述第六电阻，接在所述第一节点到所述第一比较器正输入端之间；
    所述第七电阻，接在所述第一比较器输出端到所述第一晶体管的第一极之间；
    所述第一晶体管的第一极接所述第八电阻的一端、所述第九电阻的一端及所述第三电容的一端，所述第一晶体管的第二极接所述母线电压检测电路的地；
    所述第三电容，另一端接所述母线电压检测电路的地；
    所述第八电阻，另一端接辅助工作电源；
    所述第九电阻，另一端接所述第二NMOS开关管的栅极；
    所述第二NMOS开关管，源极接所述母线电压检测电路的地，漏极接所述第十电阻的一端；
    所述第十电阻，另一端接第二节点；
    所述第二节点，用于模拟式控制电路或者数字式控制电路检出直流隔离降压变换器的母线电压。
  9. 根据权利要求8所述的直流隔离降压变换器的母线电压检测电路，其特征在于，
    所述母线电压检测电路，还包括第四稳压二极管、第五稳压二极管；
    所述第四稳压二极管同第一电阻、第一二极管串接在所述第一输入端到第一节点之间，所述第四稳压二极管的正端在第一节点侧，负端在所述第一输入端侧；
    所述第五稳压二极管同第二电阻、第二二极管串接在所述第二输入端到第一节点之间，所述第五稳压二极管的正端在第一节点侧，负端在所述第二输入端侧。
  10. 根据权利要求9所述的直流隔离降压变换器的母线电压检测电路，其特征在于，
    所述母线电压检测电路，还包括第十一电阻、第四电容；
    所述第十一电阻，一端接所述第二节点，另一端接所述第四电容一端；
    所述第四电容，另一端接所述母线电压检测电路的地；
    所述第十一电阻同第四电容的连接点，用于模拟式控制电路或者数字式控制电路检出直流隔离降压变换器的母线电压。
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