WO2008107934A1 - マルチプロセッサシステム - Google Patents

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WO2008107934A1
WO2008107934A1 PCT/JP2007/000178 JP2007000178W WO2008107934A1 WO 2008107934 A1 WO2008107934 A1 WO 2008107934A1 JP 2007000178 W JP2007000178 W JP 2007000178W WO 2008107934 A1 WO2008107934 A1 WO 2008107934A1
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PCT/JP2007/000178
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Hiromasa Takahashi
Takashi Chiba
Shunsuke Kamijo
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Fujitsu Limited
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    • G06F11/00Error detection; Error correction; Monitoring
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    • G06F11/16Error detection or correction of the data by redundancy in hardware
    • G06F11/20Error detection or correction of the data by redundancy in hardware using active fault-masking, e.g. by switching out faulty elements or by switching in spare elements
    • G06F11/202Error detection or correction of the data by redundancy in hardware using active fault-masking, e.g. by switching out faulty elements or by switching in spare elements where processing functionality is redundant
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Abstract

 複数のプロセッサエレメント(PE)を備えるマルチプロセッサシステムにおいて、各PEは、 制御対象装置を制御するための制御データを生成する複数のアプリケーションと、他のPEにおいて対応するアプリケーションにより生成される制御データを監視する複数の出力モニタを備え、複数のアプリケーションを複数のPEに割り当てる第1の割当て手段と、前記複数のアプリケーションの割当てに基づいて、複数の出力モニタを複数のPEに割り当てる第2の割当て手段と、前記生成された制御データを一時的に格納するメモリとを備え、複数の出力モニタはメモリに格納されている対応するアプリケーションにより生成された制御データが正常であるか否かをチェックし、複数のPEと複数のアプリケーションとの対応関係の変化に応じて、複数のPEと複数の出力モニタとの対応関係を変更する再配置手段を備える。
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