TWI655748B - 具有熱敏單元的垂直雙擴散金氧半功率元件 - Google Patents

具有熱敏單元的垂直雙擴散金氧半功率元件 Download PDF

Info

Publication number
TWI655748B
TWI655748B TW106141552A TW106141552A TWI655748B TW I655748 B TWI655748 B TW I655748B TW 106141552 A TW106141552 A TW 106141552A TW 106141552 A TW106141552 A TW 106141552A TW I655748 B TWI655748 B TW I655748B
Authority
TW
Taiwan
Prior art keywords
layer
vertical double
doped
oxide
diffused metal
Prior art date
Application number
TW106141552A
Other languages
English (en)
Other versions
TW201839954A (zh
Inventor
葉人豪
周烱峰
Original Assignee
通嘉科技股份有限公司
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 通嘉科技股份有限公司 filed Critical 通嘉科技股份有限公司
Publication of TW201839954A publication Critical patent/TW201839954A/zh
Application granted granted Critical
Publication of TWI655748B publication Critical patent/TWI655748B/zh

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/0203Particular design considerations for integrated circuits
    • H01L27/0248Particular design considerations for integrated circuits for electrical or thermal protection, e.g. electrostatic discharge [ESD] protection
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/7801DMOS transistors, i.e. MISFETs with a channel accommodating body or base region adjoining a drain drift region
    • H01L29/7802Vertical DMOS transistors, i.e. VDMOS transistors
    • H01L29/7803Vertical DMOS transistors, i.e. VDMOS transistors structurally associated with at least one other device
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/26Bombardment with radiation
    • H01L21/263Bombardment with radiation with high-energy radiation
    • H01L21/265Bombardment with radiation with high-energy radiation producing ion implantation
    • H01L21/26506Bombardment with radiation with high-energy radiation producing ion implantation in group IV semiconductors
    • H01L21/26513Bombardment with radiation with high-energy radiation producing ion implantation in group IV semiconductors of electrically active species
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/76Making of isolation regions between components
    • H01L21/762Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers
    • H01L21/76202Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using a local oxidation of silicon, e.g. LOCOS, SWAMI, SILO
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L22/00Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
    • H01L22/30Structural arrangements specially adapted for testing or measuring during manufacture or treatment, or specially adapted for reliability measurements
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/34Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/0203Particular design considerations for integrated circuits
    • H01L27/0248Particular design considerations for integrated circuits for electrical or thermal protection, e.g. electrostatic discharge [ESD] protection
    • H01L27/0251Particular design considerations for integrated circuits for electrical or thermal protection, e.g. electrostatic discharge [ESD] protection for MOS devices
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • H01L29/0603Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions
    • H01L29/0642Isolation within the component, i.e. internal isolation
    • H01L29/0649Dielectric regions, e.g. SiO2 regions, air gaps
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/7801DMOS transistors, i.e. MISFETs with a channel accommodating body or base region adjoining a drain drift region
    • H01L29/7802Vertical DMOS transistors, i.e. VDMOS transistors
    • H01L29/7803Vertical DMOS transistors, i.e. VDMOS transistors structurally associated with at least one other device
    • H01L29/7804Vertical DMOS transistors, i.e. VDMOS transistors structurally associated with at least one other device the other device being a pn-junction diode
    • H01L29/7805Vertical DMOS transistors, i.e. VDMOS transistors structurally associated with at least one other device the other device being a pn-junction diode in antiparallel, e.g. freewheel diode
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/7801DMOS transistors, i.e. MISFETs with a channel accommodating body or base region adjoining a drain drift region
    • H01L29/7802Vertical DMOS transistors, i.e. VDMOS transistors
    • H01L29/7811Vertical DMOS transistors, i.e. VDMOS transistors with an edge termination structure
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/06Structure, shape, material or disposition of the bonding areas prior to the connecting process of a plurality of bonding areas
    • H01L2224/0601Structure
    • H01L2224/0603Bonding areas having different sizes, e.g. different heights or widths
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • H01L29/0603Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions
    • H01L29/0607Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration
    • H01L29/0611Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse biased devices
    • H01L29/0615Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse biased devices by the doping profile or the shape or the arrangement of the PN junction, or with supplementary regions, e.g. junction termination extension [JTE]

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Ceramic Engineering (AREA)
  • Manufacturing & Machinery (AREA)
  • High Energy & Nuclear Physics (AREA)
  • Health & Medical Sciences (AREA)
  • Toxicology (AREA)
  • Semiconductor Integrated Circuits (AREA)
  • Metal-Oxide And Bipolar Metal-Oxide Semiconductor Integrated Circuits (AREA)
  • Insulated Gate Type Field-Effect Transistor (AREA)

Abstract

具有熱敏單元的垂直雙擴散金氧半功率元件包含一垂直雙擴散金氧半功率電晶體和至少一熱敏單元。該垂直雙擴散金氧半功率電晶體包含一第一金屬層、一基底層、一磊晶層、一第二金屬層和複數條第一多晶矽層,其中該複數條第一多晶矽層的每一第一多晶矽層對應一第一氧化層、具有一第二導電類型的第一摻雜井和第二摻雜井、具有一第一導電類型的第一摻雜區和第二摻雜區和一第二氧化層。該至少一熱敏單元是用以偵測該垂直雙擴散金氧半功率電晶體在操作時的溫度,且該垂直雙擴散金氧半功率電晶體和該至少一熱敏單元是共用一相同製程。

Description

具有熱敏單元的垂直雙擴散金氧半功率元件
本發明是有關於一種垂直雙擴散金氧半功率元件,尤指一種具有熱敏單元的垂直雙擴散金氧半功率元件。
當一積體電路操作時,現有技術是利用和該積體電路共同封裝的一溫度感測元件量測該積體電路的溫度。然後該溫度感測元件將該溫度傳送至該積體電路,以及該積體電路根據該溫度和一參考溫度,判斷是否啟動該積體電路內的一過溫度保護。雖然該溫度感測元件和該積體電路共同封裝在一起,但因為該溫度感測元件並未整合至該積體電路內,所以當該積體電路根據該溫度和該參考溫度,啟動該積體電路內的過溫度保護時,該積體電路內的實際溫度可能遠大於該參考溫度,也就是說在現有技術中,該積體電路有可能在尚未啟動該積體電路內的過溫度保護時就被燒毀。因此,對於該積體電路而言,現有技術並非一個較佳的技術解決方案。
本發明的一實施例提供一種具有熱敏單元的垂直雙擴散金氧半(vertical double diffused metal-oxide-semiconductor,VDMOS)功率元件。該垂直雙 擴散金氧半功率元件包含一垂直雙擴散金氧半功率電晶體和至少一熱敏單元。該垂直雙擴散金氧半功率電晶體包含一第一金屬層、一具有一第一導電類型的基底層、一具有該第一導電類型的磊晶層、一第二金屬層和複數條第一多晶矽層。該基底層形成於該第一金屬層之上。該磊晶層形成於該基底層之上。該複數條第一多晶矽層的每一第一多晶矽層對應一第一氧化層、具有一第二導電類型的第一摻雜井和第二摻雜井、具有該第一導電類型的第一摻雜區和第二摻雜區和一第二氧化層,其中該第一氧化層形成於該磊晶層之上,該第一摻雜井和該第二摻雜井形成於該磊晶層之中,該第一摻雜區和該第二摻雜區分別形成於該第一摻雜井和該第二摻雜井之中,該每一第一多晶矽層形成於該第一氧化層之上,該第二氧化層包覆該每一第一多晶矽層,以及該第二金屬層形成於該第一摻雜井、該第二摻雜井、該第一摻雜區、該第二摻雜區和該第二氧化層之上。該至少一熱敏單元形成於該磊晶層之上,是用以偵測該垂直雙擴散金氧半功率電晶體在操作時的溫度,且該垂直雙擴散金氧半功率電晶體和該至少一熱敏單元是共用一相同製程。
本發明提供一種垂直雙擴散金氧半功率元件。該垂直雙擴散金氧半功率元件是利用一相同製程整合一垂直雙擴散金氧半功率電晶體和至少一熱敏單元。因為該至少一熱敏單元是形成在該垂直雙擴散金氧半功率電晶體的旁邊,所以該至少一熱敏單元的等效順向偏壓將快速地隨該垂直雙擴散金氧半功率電晶體的操作溫度反向變化。也就是說該垂直雙擴散金氧半功率元件的控制器即可根據該至少一熱敏單元的等效順向偏壓的變化和一過溫度保護參考溫度,快速地判斷是否啟動該垂直雙擴散金氧半功率元件內的過溫度保護。因此,相較於現有技術,因為該垂直雙擴散金氧半功率元件的控制器可快速地判斷是否啟動該垂直雙擴散金氧半功率元件內的過溫度保護,所以本發明並不會有現 有技術太慢啟動過溫度保護的缺點。
100、500、600、700‧‧‧垂直雙擴散金氧半功率元件
102‧‧‧垂直雙擴散金氧半功率電晶體
104、106、502‧‧‧熱敏單元
108‧‧‧連接部
110‧‧‧第一電極
112‧‧‧第二電極
1022‧‧‧第一金屬層
1024‧‧‧基底層
1026‧‧‧磊晶層
1028‧‧‧第二金屬層
1030‧‧‧第一多晶矽層
1032‧‧‧第一氧化層
1034‧‧‧第一摻雜井
1036‧‧‧第二摻雜井
1038‧‧‧第一摻雜區
1040‧‧‧第二摻雜區
1041‧‧‧第二多晶矽層
1042‧‧‧第二氧化層
1043、1064‧‧‧摻雜區
1044‧‧‧電流
1045‧‧‧第三氧化層
1046、1048‧‧‧通道
1047、704‧‧‧深摻雜井
1050‧‧‧第一接觸
1052‧‧‧第四氧化層
1054‧‧‧摻雜井
1062‧‧‧多晶矽層
1066‧‧‧第二接觸
200‧‧‧耐壓區
202‧‧‧密封環
204、206‧‧‧襯墊
402‧‧‧熱源
702‧‧‧場氧化層
AA’‧‧‧直線
第1圖是本發明的第一實施例所公開的一種具有熱敏單元的垂直雙擴散金氧半功率元件的橫截面的示意圖。
第2圖是說明對應第1圖的上視示意圖。
第3圖是說明垂直雙擴散金氧半功率元件的上視示意圖。
第4圖是說明該熱敏元件偵測垂直雙擴散金氧半功率電晶體在操作時的溫度的示意圖。
第5圖是本發明的第二實施例所公開的一種具有熱敏單元的垂直雙擴散金氧半功率元件的上視示意圖。
第6圖是本發明的第三實施例所公開的一種具有熱敏單元的垂直雙擴散金氧半功率元件的上視示意圖。
第7圖是本發明的第四實施例所公開的一種具有熱敏單元的垂直雙擴散金氧半功率元件的橫截面的示意圖。
請參照第1圖,第1圖是本發明的第一實施例所公開的一種具有熱敏單元的垂直雙擴散金氧半(vertical double diffused metal-oxide-semiconductor,VDMOS)功率元件100的橫截面的示意圖。如第1圖所示,垂直雙擴散金氧半功率元件100包含一垂直雙擴散金氧半功率電晶體102和二熱敏單元104、106。但本發明並不受限於垂直雙擴散金氧半功率元件100包含一個垂直雙擴散金氧半功率電晶體和二個熱敏單元,也就是說垂直雙擴散金氧半功率元件100可包含一 個以上的垂直雙擴散金氧半功率電晶體和一個以上的熱敏單元。如第1圖所示,垂直雙擴散金氧半功率電晶體102包含一第一金屬層1022、一具有一第一導電類型的基底層1024、一具有該第一導電類型的磊晶層1026、一第二金屬層1028和複數條第一多晶矽層中的一第一多晶矽層1030。如第1圖所示,基底層1024形成於第一金屬層1022之上。磊晶層1026形成於基底層1024之上。第一多晶矽層1030對應一第一氧化層1032、具有一第二導電類型的第一摻雜井1034和第二摻雜井1036、具有該第一導電類型的第一摻雜區1038和第二摻雜區1040和一第二氧化層1042,其中第一氧化層1032形成於磊晶層1026之上,第一摻雜井1034和第二摻雜井1036形成於磊晶層1026之中,第一摻雜區1038和第二摻雜區1040分別形成於第一摻雜井1034和第二摻雜井1036之中,第一多晶矽層1030形成於第一氧化層1032之上,第二氧化層1042包覆第一多晶矽層1030,以及第二金屬層1028形成於第一摻雜井1034、第二摻雜井1036、第一摻雜區1038、第二摻雜區1040和第二氧化層1042之上。另外,該第一導電類型是N型和該第二導電類型是P型,以及基底層1024的離子濃度大於磊晶層1026的離子濃度。另外,第一摻雜井1034和第二摻雜井1036是根據第一多晶矽層1030以一自我對齊(self-align)和一離子佈植的方式形成。也就是說當第一多晶矽層1030形成之後,第一摻雜井1034和第二摻雜井1036不需要一額外的光罩即可通過第一多晶矽層1030阻擋(也就是自我對齊)和該離子佈植的方式而形成。
如第1圖所示,第一金屬層1022是垂直雙擴散金氧半功率電晶體102的汲極,該複數條第一多晶矽層是垂直雙擴散金氧半功率電晶體102的閘極,以及第二金屬層1028是垂直雙擴散金氧半功率電晶體102的源極。因此,當垂直雙擴散金氧半功率電晶體102開啟時,電流1044將從第一金屬層1022(垂直雙擴散金氧半功率電晶體102的汲極)由下往上通過基底層1024、磊晶層1026、通道1046、 1048、第一摻雜區1038和第二摻雜區1040流到第二金屬層1028(垂直雙擴散金氧半功率電晶體102的源極)。另外,垂直雙擴散金氧半功率電晶體102是利用第一摻雜井1034和磊晶層1026之間的PN接面所形成的空乏區,以及第二摻雜井1036和磊晶層1026之間的PN接面所形成的空乏區(未繪示於第1圖)來承受垂直雙擴散金氧半功率電晶體102的汲極和源極之間的電壓。在本發明的一實施例中,第一多晶矽層1030的寬度必須可使第一摻雜井1034和磊晶層1026之間的PN接面所形成的空乏區和第二摻雜井1036和磊晶層1026之間的PN接面所形成的空乏區融合在一起,也就是說第一多晶矽層1030的寬度不能大於一臨界寬度,其中如果第一多晶矽層1030的寬度大於該臨界寬度,則第一多晶矽層1030的寬度將無法使第一摻雜井1034和磊晶層1026之間的PN接面所形成的空乏區和第二摻雜井1036和磊晶層1026之間的PN接面所形成的空乏區融合在一起。
如第1圖所示,熱敏單元104包含一第二多晶矽層1041和一摻雜區1043,其中摻雜區1043形成於第二多晶矽層1041之中,第二多晶矽層1041形成於一第三氧化層1045之上,第三氧化層1045形成於一具有該第二導電類型的深摻雜井1047之上,以及深摻雜井1047形成於磊晶層1026之中。如第1圖所示,熱敏單元104是一二極體(也就是一PN接面),其中熱敏單元104的順向偏壓是隨溫度反向變化(也就是熱敏單元104的順向偏壓是隨溫度增加而降低)。另外,如第1圖所示,熱敏單元106的結構和熱敏單元104的結構相同,在此不再贅述。如第1圖所示,熱敏單元104是通過摻雜區1043和一連接部108電連接熱敏單元106的多晶矽層1062,也就是說熱敏單元104串聯熱敏單元106形成一熱敏元件,其中第二多晶矽層1041通過一第一接觸1050電連接一第一電極(陽極)110以及熱敏單元106的摻雜區1064通過一第二接觸1066電連接一第二電極(陰極)112,該熱敏元件的等效順向偏壓是熱敏單元104的順向偏壓與熱敏單元106的順向偏壓的總和, 以及第一接觸1050和第二接觸1066是形成於一第四氧化層1052中。另外,基底層1024、磊晶層1026、第一摻雜井1034、第二摻雜井1036、第一摻雜區1038、第二摻雜區1040、深摻雜井1047和摻雜區1043、1064是通過該離子佈植的方式形成。另外,深摻雜井1047的功能是用以使第二摻雜井1036和磊晶層1026之間的PN接面所形成的空乏區和一摻雜井1054和磊晶層1026之間的PN接面所形成的空乏區融合在一起。另外,如第1圖所示,該熱敏元件和垂直雙擴散金氧半功率電晶體102並沒有電連接。另外,垂直雙擴散金氧半功率元件100另包含一保護層(未繪示於第1圖)形成於第二金屬層1028、第一電極110、第二電極112和連接部108之上。
另外,第2圖是說明對應第1圖的上視示意圖,以及第3圖是說明垂直雙擴散金氧半功率元件100的上視示意圖,其中第1圖是對應第3圖的直線AA’。如第3圖所示,垂直雙擴散金氧半功率元件100另包含一耐壓區200,用以圍住第1圖所示的垂直雙擴散金氧半功率電晶體102和該熱敏元件。另外,如第3圖所示,一密封環202圍繞耐壓區200,其中密封環202具有電磁干擾(electromagnetic interference,EMI)的屏蔽效果以及具有隔離外界雜訊的功能。另外,第3圖還顯示出對應垂直雙擴散金氧半功率電晶體102的源極的襯墊204以及對應垂直雙擴散金氧半功率電晶體102的閘極的襯墊206。
請參照第4圖,第4圖是說明該熱敏元件偵測垂直雙擴散金氧半功率電晶體102在操作時的溫度的示意圖。如第4圖所示,當垂直雙擴散金氧半功率電晶體102在操作時,電流1044所流經的路徑上會產生一熱源402。因為該熱敏元件是形成在垂直雙擴散金氧半功率電晶體102的旁邊,且用以構成磊晶層1026、第二摻雜井1036和深摻雜井1047的材料矽導熱快,所以該熱敏元件的等 效順向偏壓將快速地隨垂直雙擴散金氧半功率電晶體102的操作溫度反向變化。因此,垂直雙擴散金氧半功率元件100的控制器(未繪示於第4圖)即可根據該熱敏元件的等效順向偏壓的變化和一過溫度保護參考溫度,快速地判斷是否啟動垂直雙擴散金氧半功率元件100內的一過溫度保護,其中該控制器根據該熱敏元件的等效順向偏壓的變化,判斷垂直雙擴散金氧半功率元件100內的溫度是本發明領域具有通知技藝者所熟知的技巧,在此不再贅述。
另外,如第1圖所示,雖然垂直雙擴散金氧半功率元件100整合垂直雙擴散金氧半功率電晶體102和熱敏單元104、106,但垂直雙擴散金氧半功率電晶體102和熱敏單元104、106是共用一相同製程。例如該共同製程包括一對應主動區(active region)的光罩、一對應深摻雜井的光罩、一對應多晶矽層的光罩、一對應摻雜區的光罩、一對應接觸(contact)的光罩、一對應第二金屬層的光罩和和一對應保護層的光罩。該對應主動區的光罩是用以定義第一摻雜區1038和第二摻雜區1040;該對應深摻雜井的光罩是用以定義深摻雜井1047和耐壓區200;該對應多晶矽層的光罩是用以定義第一多晶矽層1030、第二多晶矽層1041和多晶矽層1062;該對應摻雜區的光罩是用以定義摻雜區1043、1064;該對應接觸的光罩是用以定義第一接觸1050和第二接觸1066;該對應第二金屬層的光罩是用以定義第二金屬層1028、第一電極110、第二電極112和連接部108;該對應保護層的光罩是用以定義該保護層。
請參照第5、6圖,第5圖是本發明的第二實施例所公開的一種具有熱敏單元的垂直雙擴散金氧半功率元件500的上視示意圖,以及第6圖是本發明的第三實施例所公開的一種具有熱敏單元的垂直雙擴散金氧半功率元件600的上視示意圖。如第5圖所示,垂直雙擴散金氧半功率元件500和垂直雙擴散金氧半 功率元件100的差別在於垂直雙擴散金氧半功率元件500的熱敏元件是由三個熱敏單元502串聯而成,所以垂直雙擴散金氧半功率元件500的熱敏元件等效順向偏壓是三個熱敏單元502的順向偏壓的總和。另外,如第6圖所示,垂直雙擴散金氧半功率元件600和垂直雙擴散金氧半功率元件100的差別在於垂直雙擴散金氧半功率元件600的熱敏元件是由三個垂直雙擴散金氧半功率元件100的熱敏元件並聯而成,所以垂直雙擴散金氧半功率元件600的熱敏元件等效順向偏壓是垂直雙擴散金氧半功率元件100的熱敏元件的等效順向偏壓的三分之一。
另外,本發明並不受限於垂直雙擴散金氧半功率元件100、500、600的熱敏元件,也就是說只要在垂直雙擴散金氧半功率元件100、500、600內利用該相同製程整合垂直雙擴散金氧半功率電晶體102和至少一熱敏單元都落入本發明之範疇。
請參照第7圖,第7圖是本發明的第四實施例所公開的一種具有熱敏單元的垂直雙擴散金氧半功率元件700的橫截面的示意圖。如第7圖所示,垂直雙擴散金氧半功率元件700和垂直雙擴散金氧半功率元件100的差別在於第二多晶矽層1041和多晶矽層1062是直接形成在一場氧化層702之上,場氧化層702形成於一深摻雜井704之上,以及深摻雜井704形成於磊晶層1026之中,其中場氧化層702是通過一區域矽氧化法(Local Oxidation of Silicon,LOCOS)的方式形成。另外,垂直雙擴散金氧半功率元件700的上視圖可參照第2、3圖。另外,垂直雙擴散金氧半功率元件700的操作原理都和垂直雙擴散金氧半功率元件100相同,在此不再贅述。
綜上所述,本發明所提供的垂直雙擴散金氧半功率元件是利用該相 同製程整合該垂直雙擴散金氧半功率電晶體和至少一熱敏單元。因為該至少一熱敏單元是形成在該垂直雙擴散金氧半功率電晶體的旁邊,所以該至少一熱敏單元的等效順向偏壓將快速地隨該垂直雙擴散金氧半功率電晶體的操作溫度反向變化。也就是說該垂直雙擴散金氧半功率元件的控制器即可根據該至少一熱敏單元的等效順向偏壓的變化和該過溫度保護參考溫度,快速地判斷是否啟動該垂直雙擴散金氧半功率元件內的過溫度保護。因此,相較於現有技術,因為該垂直雙擴散金氧半功率元件的控制器可快速地判斷是否啟動該垂直雙擴散金氧半功率元件內的過溫度保護,所以本發明並不會有現有技術太慢啟動過溫度保護的缺點。
以上所述僅為本發明之較佳實施例,凡依本發明申請專利範圍所做之均等變化與修飾,皆應屬本發明之涵蓋範圍。

Claims (9)

  1. 一種具有熱敏單元的垂直雙擴散金氧半(vertical double diffused metal-oxide-semiconductor,VDMOS)功率元件,包含:一垂直雙擴散金氧半功率電晶體,包含:一第一金屬層;一具有一第一導電類型的基底層,形成於該第一金屬層之上;一具有該第一導電類型的磊晶層,形成於該基底層之上;一第二金屬層;及複數條第一多晶矽層,該複數條第一多晶矽層的每一第一多晶矽層對應一第一氧化層、具有一第二導電類型的第一摻雜井和第二摻雜井、具有該第一導電類型的第一摻雜區和第二摻雜區和一第二氧化層,其中該第一氧化層形成於該磊晶層之上,該第一摻雜井和該第二摻雜井形成於該磊晶層之中,該第一摻雜區和該第二摻雜區分別形成於該第一摻雜井和該第二摻雜井之中,該每一第一多晶矽層形成於該第一氧化層之上,該第二氧化層包覆該每一第一多晶矽層,以及該第二金屬層形成於該第一摻雜井、該第二摻雜井、該第一摻雜區、該第二摻雜區和該第二氧化層之上;及至少一熱敏單元,形成於該磊晶層之上,其中該至少一熱敏單元是用以偵測該垂直雙擴散金氧半功率電晶體在操作時的溫度,且該垂直雙擴散金氧半功率電晶體和該至少一熱敏單元是共用一相同製程,其中該至少一熱敏單元中的每一熱敏單元包含:一第二多晶矽層,形成於一第三氧化層之上;及一摻雜區,形成於該第二多晶矽層之中;其中該第三氧化層形成於一具有該第二導電類型的深摻雜井之上,以及該深摻雜井形成於該磊晶層之中。
  2. 如請求項1所述的垂直雙擴散金氧半功率元件,另包含:一耐壓區,其中該深摻雜井和該耐壓區共用一光罩。
  3. 如請求項1所述的垂直雙擴散金氧半功率元件,其中該第一金屬層是該垂直雙擴散金氧半功率電晶體的汲極,該複數條第一多晶矽層是該垂直雙擴散金氧半功率電晶體的閘極,以及該第二金屬層是該垂直雙擴散金氧半功率電晶體的源極。
  4. 如請求項1所述的垂直雙擴散金氧半功率元件,其中該第一導電類型是N型,且該第二導電類型是P型。
  5. 如請求項1所述的垂直雙擴散金氧半功率元件,其中該基底層的離子濃度大於該磊晶層的離子濃度。
  6. 一種具有熱敏單元的垂直雙擴散金氧半(vertical double diffused metal-oxide-semiconductor,VDMOS)功率元件,包含:一垂直雙擴散金氧半功率電晶體,包含:一第一金屬層;一具有一第一導電類型的基底層,形成於該第一金屬層之上;一具有該第一導電類型的磊晶層,形成於該基底層之上;一第二金屬層;及複數條第一多晶矽層,該複數條第一多晶矽層的每一第一多晶矽層對應一第一氧化層、具有一第二導電類型的第一摻雜井和第二摻雜井、具有該第一導電類型的第一摻雜區和第二摻雜區和一第二氧化層,其中該第一氧化層形成於該磊晶層之上,該第一摻雜井和該第二摻雜井形成於該磊晶層之中,該第一摻雜區和該第二摻雜區分別形成於該第一摻雜井和該第二摻雜井之中,該每一第一多晶矽層形成於該第一氧化層之上,該第二氧化層包覆該每一第一多晶矽層,以及該第二金屬層形成於該第一摻雜井、該第二摻雜井、該第一摻雜區、該第二摻雜區和該第二氧化層之上;及至少一熱敏單元,形成於該磊晶層之上,其中該至少一熱敏單元是用以偵測該垂直雙擴散金氧半功率電晶體在操作時的溫度,且該垂直雙擴散金氧半功率電晶體和該至少一熱敏單元是共用一相同製程,其中該至少一熱敏單元中的每一熱敏單元包含:一第二多晶矽層,形成於一場氧化層之上;及一摻雜區,形成於該第二多晶矽層之中;其中該場氧化層形成於一具有該第二導電類型的深摻雜井之上,以及該深摻雜井形成於該磊晶層之中。
  7. 如請求項6所述的垂直雙擴散金氧半功率元件,其中該場氧化層是通過一區域矽氧化法(Local Oxidation of Silicon,LOCOS)的方式形成。
  8. 如請求項1或6所述的垂直雙擴散金氧半功率元件,其中該基底層、該磊晶層、該第一摻雜井、該第二摻雜井、該第一摻雜區、該第二摻雜區、該深摻雜井和該摻雜區是通過一離子佈植的方式形成。
  9. 一種具有熱敏單元的垂直雙擴散金氧半(vertical double diffused metal-oxide-semiconductor,VDMOS)功率元件,包含:一垂直雙擴散金氧半功率電晶體,包含:一第一金屬層;一具有一第一導電類型的基底層,形成於該第一金屬層之上;一具有該第一導電類型的磊晶層,形成於該基底層之上;一第二金屬層;及複數條第一多晶矽層,該複數條第一多晶矽層的每一第一多晶矽層對應一第一氧化層、具有一第二導電類型的第一摻雜井和第二摻雜井、具有該第一導電類型的第一摻雜區和第二摻雜區和一第二氧化層,其中該第一氧化層形成於該磊晶層之上,該第一摻雜井和該第二摻雜井形成於該磊晶層之中,該第一摻雜區和該第二摻雜區分別形成於該第一摻雜井和該第二摻雜井之中,該每一第一多晶矽層形成於該第一氧化層之上,該第二氧化層包覆該每一第一多晶矽層,以及該第二金屬層形成於該第一摻雜井、該第二摻雜井、該第一摻雜區、該第二摻雜區和該第二氧化層之上,其中該第一摻雜井和該第二摻雜井是根據該每一第一多晶矽層以一自我對齊(self-align)的方式形成;及至少一熱敏單元,形成於該磊晶層之上,其中該至少一熱敏單元是用以偵測該垂直雙擴散金氧半功率電晶體在操作時的溫度,且該垂直雙擴散金氧半功率電晶體和該至少一熱敏單元是共用一相同製程。
TW106141552A 2016-12-16 2017-11-29 具有熱敏單元的垂直雙擴散金氧半功率元件 TWI655748B (zh)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US201662435085P 2016-12-16 2016-12-16
US62/435,085 2016-12-16

Publications (2)

Publication Number Publication Date
TW201839954A TW201839954A (zh) 2018-11-01
TWI655748B true TWI655748B (zh) 2019-04-01

Family

ID=62556406

Family Applications (1)

Application Number Title Priority Date Filing Date
TW106141552A TWI655748B (zh) 2016-12-16 2017-11-29 具有熱敏單元的垂直雙擴散金氧半功率元件

Country Status (3)

Country Link
US (1) US10204896B2 (zh)
CN (1) CN108231741A (zh)
TW (1) TWI655748B (zh)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2021159177A1 (en) * 2020-02-14 2021-08-19 Macquarie University Transistor array or power amplifier with inbuilt thermal sensor

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20040075103A1 (en) * 2001-10-09 2004-04-22 Rainer Topp Semiconductor circuit, especially for ignition purposes, and the use of the same
TW201112419A (en) * 2009-09-30 2011-04-01 Ptek Technology Co Ltd Trench-typed power MOS transistor and manufacturing process thereof
TW201721832A (zh) * 2015-12-10 2017-06-16 力智電子股份有限公司 具熱感測功能的功率金氧半電晶體晶粒以及積體電路

Family Cites Families (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0693485B2 (ja) * 1985-11-29 1994-11-16 日本電装株式会社 半導体装置
CN102394237A (zh) * 2011-12-06 2012-03-28 电子科技大学 一种具有温度采样和过温保护功能的复合vdmos器件
US9780012B2 (en) * 2013-12-12 2017-10-03 Fuji Electric Co., Ltd. Semiconductor device and method for manufacturing the same
KR102089048B1 (ko) * 2014-02-10 2020-03-13 한국전자통신연구원 반도체 소자 및 그 제조 방법
JP6503202B2 (ja) * 2015-03-12 2019-04-17 エイブリック株式会社 半導体装置
CN105762172B (zh) * 2016-05-16 2019-03-15 京东方科技集团股份有限公司 一种阵列基板及其制备方法、显示面板及其驱动方法

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20040075103A1 (en) * 2001-10-09 2004-04-22 Rainer Topp Semiconductor circuit, especially for ignition purposes, and the use of the same
TW201112419A (en) * 2009-09-30 2011-04-01 Ptek Technology Co Ltd Trench-typed power MOS transistor and manufacturing process thereof
TW201721832A (zh) * 2015-12-10 2017-06-16 力智電子股份有限公司 具熱感測功能的功率金氧半電晶體晶粒以及積體電路

Also Published As

Publication number Publication date
TW201839954A (zh) 2018-11-01
US20180175019A1 (en) 2018-06-21
US10204896B2 (en) 2019-02-12
CN108231741A (zh) 2018-06-29

Similar Documents

Publication Publication Date Title
US9502496B2 (en) Semiconductor device and method of manufacturing the same
US7385250B2 (en) Semiconductor device
US5723890A (en) MOS type semiconductor device
US5757046A (en) MOS type semiconductor device
JP5147203B2 (ja) 絶縁ゲート型半導体装置
US10157911B2 (en) Semiconductor device
JP6130857B2 (ja) 半導体装置
US9741843B2 (en) Semiconductor device
JPH11266016A (ja) 半導体装置およびその製造方法
JP3173268B2 (ja) Mis電界効果トランジスタを備えた半導体装置
KR102432745B1 (ko) 반도체 장치
JP2009188178A (ja) 半導体装置
TWI655748B (zh) 具有熱敏單元的垂直雙擴散金氧半功率元件
JP2009239096A (ja) 半導体装置
JP7127389B2 (ja) 炭化珪素半導体装置
JP2010287786A (ja) 半導体装置
CN105977297B (zh) 半导体装置
TWI636573B (zh) 具有高壓啟動單元的垂直雙擴散金氧半功率元件
JP2005026279A (ja) 半導体装置
JP6448704B2 (ja) 半導体装置
CN113302732B (zh) 半导体装置
JPH0397269A (ja) 電流制限回路を内蔵する伝導度変調型mosfet
US20050242371A1 (en) High current MOS device with avalanche protection and method of operation
JPH05335583A (ja) 縦型mos電界効果トランジスタ
US11710734B2 (en) Cascode-connected JFET-MOSFET semiconductor device