TWI451388B - 發光控制線驅動器及使用其之有機發光顯示器 - Google Patents

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Description

發光控制線驅動器及使用其之有機發光顯示器
相關申請案之交互參考
本申請案主張2011年1月6日在韓國智慧財產局所提申之韓國專利申請案第10-2011-0001419號之優先權及利益，在此將其全部內容一併整合參考之。
根據本發明實施例之觀點係關於一種發光控制線驅動器及使用其之有機發光顯示器。
近來，已發展出較陰極射線管(CRT)顯示器之重量及體積減少之各種平面顯示器(FPD)。該些平面顯示器包含液晶顯示器(LCD)、場發射顯示器(FED)、電漿平面顯示(PDP)及有機發光顯示器。
在該些平面型顯示器中，該有機發光顯示器使用有機發光二極體(OLED)來顯示一影像，該些二極體藉由電子及電洞之重新結合來產生光。該有機發光顯示器具有一快速反應速度並由低功率消耗所驅動。一典型有機發光顯示器使用形成於像素中之電晶體來提供對應於資料訊號之電流至該些有機發光二極體。
該典型有機發光顯示器包含用於提供該些資料訊號至資料線之資料驅動器、用於依序提供掃描訊號至掃描線之掃描驅動器、用於提供發光控制訊號至發光控制線之發光控制線驅動器及包含耦接至該些資料線、該些掃描線和該 些發光控制線之多個像素之顯示單元。
當該些掃描訊號被提供至該些掃描線時，選擇包含於該顯示單元之像素以接收來自該些資料線之資料。接收該些資料訊號之像素產生具有對應於該些資料訊號之亮度(例如，預定亮度)之光並顯示一預定影像。在此，該些像素之發光時間係受到提供自該些發光控制線之發光控制訊號所控制。大體上，提供該發光控制訊號以重疊該些掃描訊號，其係提供至一掃描線或二掃描線以將提供該些資料訊號至其上之像素設定為一未發光狀態。
因此，該發光控制線驅動器包含耦接至該些發光控制線之各階段。該些階段接收至少四時脈訊號並輸出高或低電壓至輸出線。
然而，既然該典型發光控制線驅動器所包含之階段係由至少四時脈訊號所驅動，大量電晶體被納入。因此，製造成本增加且難以確保該驅動可靠性。此外，當該發光控制線驅動器係由一P型金屬氧化物半導體電晶體所構成時，一低位準輸出係不穩定的。
尤其，當一低位準訊號被提供至一發光控制線時，輸出該低位準訊號之電晶體閘極係維持於一較低位準訊號低之電壓。然而，該電晶體閘極之電壓因為漏電而增加，該低位準訊號之輸出並不穩定。
有鑑於此，本發明實施例係導向一種能夠確保一輸出 穩定性並能夠隨意控制發光控制訊號之寬度之發光控制線驅動器，及使用其之有機發光顯示器。
根據本發明一實施例，提供一種包含多個階段之發光控制線驅動器。該些階段中之每一個包含一第一電晶體，耦接於一第一輸出端及一第一電源之間，該第一電晶體被架構以對應於耦接至該第一電晶體閘極之第一節點所施加之電壓來導通或關閉；一第二電晶體，耦接於該第一輸出端及一第二電源之間，該第二電源輸出較該第一電源低之電壓，該第二電晶體被架構以對應於耦接至該第二電晶體閘極之第二節點所施加之電壓來導通或關閉；一第三電晶體，耦接於一第四輸入端及該第一節點之間並具有耦接至一第一輸入端之一閘極；一第四電晶體，耦接於該第一電源及該第二節點之間並具有耦接至該第一節點之一閘極；一第一控制器，耦接於該第一輸入端及一第二輸入端，以提供一取樣訊號至一第二輸出端；一第二控制器，耦接於該第一輸入端及一第三輸入端，以控制該第二節點之電壓；以及一第一電容器，耦接於該第二輸入端及該第二節點之間。
該發光控制線驅動器可進一步包含耦接於該第一節點及該第一電源之間之一第二電容器。該第一輸入端可被架構以接收一第一時脈訊號。該第二輸入端可被架構以接收一第二時脈訊號。該第三輸入端可被架構以接收一第三時脈訊號。該第四輸入端可被架構以接收一啟動訊號或前一階段之一取樣訊號。該第一時脈訊號、該第二時脈訊號及 該第三時脈訊彼此間並不重疊。可於i(i係一自然數)個水平週期之期間內設定該第一時脈訊號及該第二時脈訊號中之每一個。可於i/2個水平週期之期間內設定該第三時脈訊號。在一水平期間內提供該第一時脈訊號或該第二時脈訊號之後，在該水平期間內提供該第三時脈訊號。
該第一控制器可包含一第五電晶體，耦接於該第四輸入端及一第三節點之間並具有耦接至該第一輸入端之一閘極；一第六電晶體，耦接於一第六節點及該第二輸入端之間並具有耦接至該第三節點之一閘極；一第七電晶體，耦接於該第六節點及該第一電源之間並具有耦接至該第一輸出端之一閘極；一第三電容器，耦接於該第三節點及該第六節點之間；以及一第四電容器，耦接於該第一輸出端及該第一電源之間。該第二輸出端可電性耦接至該第六節點。
該第二控制器可包含一第八電晶體，耦接於該第一輸入端及一第四節點之間並具有耦接至該第一節點之一閘極；一第九電晶體，耦接於該第四節點及該第二電源之間並具有耦接至該第一輸入端之一閘極；一第十電晶體，耦接於該第二節點及一第五節點之間並具有耦接至該第三輸入端之一閘極；一第十一電晶體，耦接於該第五節點及該第三輸入端之間並具有耦接至該第四節點之一閘極；以及一第五電容器，耦接於該第四節點及該第五節點之間。
該發光控制線驅動器可進一步包含一第十二電晶體，耦接於該第四輸入端及該第三電晶體之間，該第十二電晶體被架構以導通於一第一控制訊號提供至該第十二電晶體 閘極之時；以及一第十三電晶體，耦接於一第五輸入端及該第一控制器之間，該第十三電晶體被架構以導通於一第二控制訊號提供至該第十三電晶體閘極之時。該第一控制訊號及該第二控制訊號彼此間並不重疊。該發光控制線驅動器可進一步包含一第十四電晶體，耦接於該第一節點及該第二電源之間，該第十四電晶體被架構以導通於一重置訊號提供至該第十四電晶體閘極之時。該重置訊號可共同地提供至所有該些階段。
根據一實施例，一種有機發光顯示器包含用於依序提供掃描訊號至掃描線之一掃描驅動器、用於提供資料訊號至資料線之一資料驅動器、用於提供發光控制訊號至發光控制線之一發光控制線驅動器、及位在該些掃描線、該些資料線和該些發光控制線之相交區域之像素。該發光控制線驅動器包含分別耦接至該些發光控制線之各階段。該些階段中之每一個包含一第一電晶體，耦接於一第一輸出端及一第一電源之間，該第一電晶體被架構以對應於耦接至該第一電晶體閘極之第一節點所施加之電壓來導通或關閉；一第二電晶體，耦接於該第一輸出端及一第二電源之間，該第二電源輸出較該第一電源低之電壓，該第二電晶體被架構以對應於耦接至該第二電晶體閘極之第二節點所施加之電壓來導通或關閉；一第三電晶體，耦接於一第四輸入端及該第一節點之間並具有耦接至一第一輸入端之一閘極；一第四電晶體，耦接於該第一電源及該第二節點之間並具有耦接至該第一節點之一閘極；一第一控制器，耦 接於該第一輸入端及一第二輸入端之間以提供一取樣訊號至一第二輸出端；一第二控制器，耦接於該第一輸入端及一第三輸入端之間以控制該第二節點之電壓；以及一第一電容器，耦接於該第二輸入端及該第二節點之間。
根據本發明實施例所示之發光控制線驅動器及使用其之有機發光顯示器，輸出該低位準訊號之電晶體閘極之電壓係使用該時脈訊號來定期降低之，使得一輸出穩定性可被確保。此外，根據本發明實施例，該發光控制訊號之寬度可受到控制以對應於該啟動訊號之寬度。更進一步，根據本發明實施例，既然該些階段接收三時脈訊號，一電路結構可被簡化。
此後，根據本發明之某些示範性實施例將參考該些附圖來說明。在此，當一第一構件被描述成耦接至一第二構件時，該第一構件可為直接耦接至該第二構件或透過一或更多第三構件而間接耦接至該第二構件。進一步，對於完全了解本發明不是主要構件中之部分係基於清晰目的而被省略。同時，從頭到尾之類似參考符號參考至類似構件。
此後，將參考圖1至圖6來詳述本發明示範性實施例，那些熟知此項技術之人士可據以執行本發明。
圖1係根據本發明一實施例說明一有機發光顯示器之方塊圖。
參考至圖1，根據本發明一實施例之有機發光顯示器包 含一顯示單元40，其包含位在掃描線S1至Sn、資料線D1至Dm及發光控制線E1至En之相交區域之像素；一掃描驅動器10，用於驅動該些掃描線S1至Sn；一資料驅動器20，用於驅動該些資料線D1至Dm；一發光控制線驅動器30，用於驅動該些發光控制線E1至En；以及一時序控制器60，用於控制該些驅動器10、20及30。
該掃描驅動器10依序提供掃描訊號至該些掃描線S1至Sn。當該些掃描訊號被提供至該些掃描線S1至Sn時，該些像素50係以水平線為單位(例如，一條線接著一條線)來選取之。
該資料驅動器20以同步於該些掃描訊號之方式來提供資料訊號至該些資料線D1至Dm。提供至該些資料線D1至Dm之資料訊號係提供至該些掃描訊號所選取之像素50中。
該發光控制線驅動器30依序提供發光控制訊號至該些發光控制線E1至En。在此，該發光控制線驅動器30提供該些發光控制訊號以在對應於該些資料訊號之電壓充電期間使該些像素50被設定成一未發光狀態。因此，提供至第i條(i為一自然數)發光控制線Ei之發光控制訊號重疊提供至第i條掃描線Si之掃描訊號。另一方面，該發光控制訊號之寬度可適當地進行設定以對應至該像素50之結構及欲實現之亮度。
圖2係示意地說明圖1發光控制線驅動器各階段之方塊圖。
參考至圖2，根據本發明一實施例之發光控制線驅動器30包含n個階段321至32n，用以提供發光控制訊號至該n條發光控制線E1至En。該些階段321至32n係分別耦接至該些發光控制線E1至En並由三個時脈訊號CLK1、CLK2及CLK3所驅動。
該些階段321至32n中每一個包含一第一輸入端33、一第二輸入端34、一第三輸入端35及一第四輸入端36。
第k個(k為一奇數或偶數)階段32k之第一輸入端33接收該第一時脈訊號CLK1，且第二輸入端34接收該第二時脈訊號CLK2。第(k+1)個階段32k+1之第一輸入端33接收該第二時脈訊號CLK2，且第二輸入端34接收該第一時脈訊號CLK1。該第三時脈訊號CLK3係提供至該些階段321至32n中每一個之第三輸入端35，且一啟動訊號FLM或前一階段之取樣訊號係提供至該第四輸入端36。
該些階段321至32n可由相同電路構成並產生具有對應於該啟動訊號FLM而改變之寬度之發光控制訊號。
圖3係說明圖2階段中之一之第一實施例電路圖。在圖3中，基於方便起見，該第一階段321會被說明。
參考至圖3，根據本發明第一實施例，該階段321包含一第一電晶體M1、一第二電晶體M2、一第三電晶體M3、一第四電晶體M4、一第一電容器C1、一第二電容器C2、一第一控制器100及一第二控制器102。
該第一電晶體M1係耦接於一第一輸出端37及一第一電源VDD之間。該第一電晶體M1之閘極係耦接至一第一 節點N1。該第一電晶體M1控制該第一輸出端37之電壓以對應於提供至該第一節點N1之電壓。在此，當該第一電晶體M1導通時，該第一電源VDD(例如，一高電壓)係提供至該第一輸出端37。既然該第一輸出端37係耦接至該發光控制線E1，提供至該第一輸出端37之高電壓係充當一發光控制訊號來使用。
該第二電晶體M2係耦接於該第一輸出端37及一第二電源VSS之間。該第二電晶體M2之閘極係耦接至一第二節點N2。該第二電晶體M2控制該第一輸出端37之電壓以對應於提供至該第二節點N2之電壓。在此，當該第二電晶體M2導通時，該第二電源VSS(例如，一低電壓)係提供至該第一輸出端37。
該第三電晶體M3係耦接於該第四輸入端36及該第一節點N1之間。該第三電晶體M3之閘極係耦接至該第一輸入端33。該第三電晶體M3係對應於提供至該第一輸入端33之第一時脈訊號CLK1來導通或關閉。當該第三電晶體M3導通時，該第四輸入端36及該第一節點N1彼此間係電性耦接。當該啟動訊號FLM(或一前階段取樣訊號)被提供至該第四輸入端36時，該第一電晶體M1導通。
該第四電晶體M4係耦接於該第一電源VDD及該第二節點N2之間。該第四電晶體M4之閘極係耦接至該第一節點N1。該第四電晶體M4係對應於提供至該第一節點N1之電壓來導通或關閉，用以控制該第二節點N2之電壓。也就是，在施加一低電壓至該第一節點N1以提供該第一電源 VDD之電壓至該第二節點N2時，導通該第四電晶體M4。當該低電壓係提供至該第一節點N1時，該第一電源VDD之高電壓係提供至該第二節點N2，使得該第一電晶體M1及該第二電晶體M2係在不同時間導通或關閉。
該第一電容器C1係耦接於該第二輸入端34及該第二節點N2之間。該第一電容器C1控制該第二節點N2之電壓以對應於提供至該第二輸入端34之第二時脈訊號CLK2。該第一電容器C1之操作程序將更詳加說明於後。
該第二電容器C2係耦接於該第一節點N1及該第一電源VDD之間。該第二電容器C2係利用對應至該第一電晶體M1導通或關閉之電壓來充電之。
一第一控制器100提供一取樣訊號至一第二輸出端38以對應至該第一時脈訊號CLK1及該第二時脈訊號CLK2。因此，該第一控制器100包含一第五電晶體M5、一第六電晶體M6、一第七電晶體M7、一第三電容器C3及一第四電容器C4。
該第五電晶體M5係耦接於該第四輸入端36及一第三節點N3之間。該第五電晶體M5之閘極係耦接至該第一輸入端33。該第五電晶體M5係對應於提供至該第一輸入端33之第一時脈訊號CLK1來導通或關閉，用以控制該第三節點N3之電壓。
該第六電晶體M6係耦接於一第六節點N6及該第二輸入端34之間。該第六電晶體M6之閘極係耦接至該第三節點N3。該第六電晶體M6控制該第六節點N6之電壓以對應 於提供至該第三節點N3之電壓。
該第七電晶體M7係耦接於該第一電源VDD及該第六節點N6之間。該第七電晶體M7之閘極係耦接至該第一輸出端37。該第七電晶體M7係對應於提供至該第一輸出端37之電壓來導通或關閉，用以控制該第六節點N6之電壓。
該第三電容器C3係耦接於該第三節點N3及該第六節點N6之間。該第三電容器C3係利用對應至該第六電晶體M6導通或關閉之電壓來充電之。
該第四電容器C4係耦接於該第一電源VDD及該第一輸出端37之間。該第四電容器C4係利用對應至該第七電晶體M7導通或關閉之電壓來充電之。
在圖3中，該第二輸出端38係耦接至該第六節點N6。該第二輸出端38提供施加至該第六節點N6之電壓做為施加至下一階段322之取樣訊號。
該第二控制器102控制該第二節點N2之電壓以對應至該第一時脈訊號CLK1及該第三時脈訊號CLK3。在此，在該發光控制訊號未被提供至該第一輸出端37時期，該第二控制器102維持該第二節點N2之電壓於一低電壓。在圖3中，該第二控制器102包含一第八電晶體M8、一第九電晶體M9、一第十電晶體M10、一第十一電晶體M11及一第五電容器C5。
該第八電晶體M8係耦接於該第一輸入端33及該第四節點N4之間。該第八電晶體M8之閘極係耦接至該第一節點N1。該第八電晶體M8係對應於施加至該第一節點N1 之電壓來導通或關閉，用以控制該第四節點N4之電壓。
該第九電晶體M9係耦接於該第四節點N4及該第二電源VSS之間。該第九電晶體M9之閘極係耦接至該第一輸入端33。該第九電晶體M9係對應於提供至該第一輸入端33之第一時脈訊號CLK1來導通或關閉，用以控制該第四節點N4之電壓。
該第十電晶體M10係耦接於該第二節點N2及一第五節點N5之間。該第十電晶體M10之閘極係耦接至一第三輸入端35。該第十電晶體M10係對應於提供至該第三輸入端35之第三時脈訊號CLK3來導通或關閉，用以控制該第二節點N2之電壓。
該第十一電晶體M11係耦接於該第五節點N5及該第三輸入端35之間。該第十一電晶體M11之閘極係耦接至該第四節點N4。該第十一電晶體M11係對應於施加至該第四節點N4之電壓來導通或關閉，用以控制該第五節點N5之電壓。
該第五電容器C5係耦接於該第四節點N4及該第五節點N5之間。該第五電容器C5係利用對應至該第十一電晶體M11導通或關閉之電壓來充電之。
圖4係說明圖3中該階段之操作程序波形圖。
參考至圖4，於該iH(i係一自然數，例如，一水平期間)期間內提供該第一時脈訊號CLK1及該第二時脈訊號CLK2，並於該i/2H期間內提供該第三時脈訊號CLK3。在圖4中，基於方便起見，於該2H期間內設定該第一時脈訊 號CLK1及該第二時脈訊號CLK2，並於該1H期間內設定該第三時脈訊號CLK3。
在圖4中，該第一時脈訊號CLK1及該第二時脈訊號CLK2係提供於不同水平期間H內，且該第三時脈訊號CLK3係提供於每個水平期間H，使得該第一時脈訊號CLK1不會重疊該第三時脈訊號CLK3。接著，在該水平期間H內，提供該第一時脈訊號CLK1或該第二時脈訊號CLK2之後，該第三時脈訊號CLK3被提供。也就是，在一示範性水平期間內，該第三時脈訊號CLK3係在提供該第一時脈訊號CLK1之後才被提供。在下一水平期間內，該第三時脈訊號CLK3係在提供該第二時脈訊號CLK2之後才被提供。
將更詳加說明操作程序於後。第一，該啟動訊號FLM(例如，該低位準訊號)係提供至該第四輸入端36。在提供該啟動訊號FLM至該第四輸入端36之後，該第一時脈訊號CLK1被提供至該第一輸入端33。在提供該第一時脈訊號CLK1時，該第三電晶體M3、該第五電晶體M5及該第九電晶體M9被導通。
當該第三電晶體M3被導通時，該啟動訊號FLM係供應至該第一節點N1。當該啟動訊號FLM係供應至該第一節點N1時，該第一電晶體M1、該第四電晶體M4及該第八電晶體M8被導通。當該第一電晶體M1被導通時，對應至該第一電晶體M1之導通之電壓係充電該第二電容器C2。
當該第一電晶體M1被導通時，該第一電源VDD之電壓係供應至該第一輸出端37。在本例中，該發光控制訊號 係供應至該發光控制線E1。
當該第四電晶體M4被導通時，該第一電源VDD係供應至該第二節點N2。當該第一電源VDD係供應至該第二節點N2時，該第二電晶體M2被關閉。當該第二電晶體M2係關閉時，該第一電源VDD可穩定地被提供至該第一輸出端37。
當該第八電晶體M8被導通時，該第四節點N4及該第一輸入端33彼此間係電性耦接。在此，既然該第一時脈訊號CLK1係提供至該第一輸入端33，該第四節點N4接收一低電壓。
當該第五電晶體M5被導通時，該啟動訊號係提供至該第三節點N3。當該啟動訊號係提供至該第三節點N3時，該第六電晶體M6被導通。當該第六電晶體M6係導通時，該第六節點N6及該第二輸入端34彼此間係電性耦接。在此，既然該第二時脈訊號CLK2未被提供至該第二輸入端34，該第六節點N6維持一高電壓，使得一取樣訊號未被提供至該第二輸出端38。另一方面，既然該第六電晶體M6係導通，對應至該第六電晶體M6導通之電壓係充電該第三電容器C3。
當該第九電晶體M9被導通時，該第二電源VSS之電壓被提供至該第四節點N4。當該第二電源VSS係提供至該第四節點N4時，該第十一電晶體M11被導通。當該第十一電晶體M11係導通時，該第一節點N5及該第三輸入端35彼此間係電性耦接。在此，既然該第三時脈訊號CLK3 未被提供至該第三輸入端35，該第五節點N5維持一高電壓。另一方面，既然該第十一電晶體M11係導通，對應至該第十一電晶體M11導通之電壓係充電該第五電容器C5。
接著，停止提供該第一時脈訊號CLK1至該第一輸入端33。當停止提供該第一時脈訊號CLK1時，該第三電晶體M3、該第五電晶體M5及該第九電晶體M9被關閉。
當該第三電晶體M3係關閉時，該第四輸入端36及該第一節點N1彼此間係電性隔離。在此，該第一節點N1係藉由該第二電容器C2來維持於一低電壓。因此，該第一電晶體維持於一導通狀態，使得該第一電源VDD之電壓係輸出至該第一輸出端37。既然該第四電晶體M4藉由該第二電容器C2之電壓來維持於一導通狀態，該第二電晶體M2穩定地維持於一關閉狀態。
當該第五電晶體M5係關閉時，該第四輸入端36及該第三節點N3彼此間係電性隔離。在此，該第六電晶體M6維持於一導通狀態以對應於該第三電容器C3之充電電壓，使得該第二輸出端38維持於前一電壓。
當該第九電晶體M9係關閉時，該第四節點N4及該第二電源VSS彼此間係電性隔離。在此，既然該第八電晶體M8維持於一導通狀態以對應於施加至該第一節點N1之電壓，該第四節點N4及該第一輸入端33彼此間係電性耦接。因此，該第四節點N4之電壓增加至提供至該第一輸入端33(例如，一高位準訊號之電壓)之電壓。當該第四節點N4接收該高位準訊號之電壓時，該第十一電晶體M11被關 閉。在此，該第五電容器C5係利用對應於該第十一電晶體M11關閉之電壓來充電之。
接著，該第三時脈訊號CLK3被提供至該第三輸入端35。當提供該第三時脈訊號CLK3時，該第十電晶體M10被導通。當該第十電晶體M10係導通時，該第二節點N2及該第五節點N5彼此間係電性耦接。此時，既然該第四電晶體M4維持於一導通狀態且該第十一電晶體M11維持於一關閉狀態，該第二節點N2維持於該第一電源VDD之電壓。
在提供該第三時脈訊號CLK3後，該第二時脈訊號CLK2係於下一水平期間內提供至該第二輸入端34。在此，既然該第六電晶M6係設定為一導通狀態，該第二時脈訊號CLK2被提供至該第六節點N6。提供至該第六節點N6以做為一取樣訊號之第二時脈訊號CLK2係透過該第二輸出端38來提供至下一階段。另一方面，當該第二時脈訊號CLK2係提供至該第六節點N6時，該第三節點N3之電壓係藉由該第三電容器C3之耦合來降低之。
此外，提供至該第二輸入端34之第二時脈訊號CLK2係藉由該第一電容器C1之耦合來傳送至該第二節點N2。在此，既然該第二節點N2接收該第一電源VDD，該第一電源VDD之電壓被維持而無電壓變化。
接著，該第三時脈訊號CLK3被提供至該第三輸入端35。當提供該第三時脈訊號CLK3時，該第十電晶體M10被導通。當該第十電晶體M10係導通時，該第二節點N2 及該第五節點N5彼此間係電性耦接。在此，既然該第四電晶體M4維持於一導通狀態且該第十一電晶體M11維持於一關閉狀態，該第二節點N2維持於該第一電源VDD之電壓。
在提供該第三時脈訊號CLK3後，該啟動訊號FLM之提供係於下一水平期間內停止(例如，一高電壓)，且該第一時脈訊號CLK1被提供至該第一輸入端33。
當提供該第一時脈訊號CLK1時，該第三電晶體M3、該第五電晶體M5及該第九電晶體M9被導通。
當該第三電晶體M3係導通時，該第一節點N1及該第四輸入端36彼此間係電性耦接。在此，既然一高電壓係提供至該第一節點N1，該第一電晶體M1、該第四電晶體M4及該第八電晶體M8被關閉。當該第一電晶體M1係關閉時，該第一輸出端37係設定為一浮接狀態。在本例中，該第一輸出端37維持於該高電壓，其係前一期間之輸出訊號。
既然提供至該發光控制線E1之發光控制訊號係提供至該些像素50，藉由該些像素之電容器來執行充電。因此，儘管該第一輸出端37係設定為一浮接狀態，前一期間之輸出電壓係藉由該些像素50之寄生電容器及該發光控制線所維持。
當該第五電晶體M5係導通時，一高電壓被提供至該第三節點N3，使得該第六電晶體M6被關閉。當該第六電晶體M6係關閉時，該第六節點N6及該第二輸入端34彼此間係電性隔離。在此，該第三電容器C3係利用對應於該第 六電晶體M6關閉之電壓來充電之。
當該第九電晶體M9係導通時，該第四節點N4及該第二電源VSS彼此間係電性耦接。在此，既然該第四節點N4接收該第二電源VSS之電壓，使得該第十一電晶體M11被導通。當該第十一電晶體M11係導通時，該第五節點N5及該第三輸入端35彼此間係電性耦接。另一方面，對應於該第十一電晶體M11導通之電壓係儲存於該第五電容器C5。
接著，該第三時脈訊號CLK3被提供至該第三輸入端35。當提供該第三時脈訊號CLK3時，該第十電晶體M10被導通。當該第十電晶體M10係導通時，該第二節點N2及該第五節點N5彼此間係透過該第五節點N5來電性耦接。在此，該第三時脈訊號CLK3(例如，一低電壓)係提供至該第二節點N2。當該低電壓被提供至該第二節點N2時，該第二電晶體M2被導通，使得該第二電源VSS之電壓係輸出至該第一輸出端37。在本例中，停止提供該發光控制訊號至該發光控制線E1。當該第二電源VSS係提供至該該第一輸出端37時，該第七電晶體M7被導通。當該第七電晶體M7係導通時，該第一電源VDD之電壓被提供至該第六節點N6。
根據本發明一實施例，該第三時脈訊號CLK3可被設定為較該第二電源VSS低之電壓，使得該第二電晶體M2可穩定地導通。接著，該階段321輸出該第一電源VDD之電壓至該第一輸出端37，直到下一啟動訊號FLM被提供為止。
此外，根據本發明一實施例，每當該第二時脈訊號CLK2被提供時，該第二節點N2之電壓係藉由該第一電容器C1之耦合來降低之。因此，該第二節點N2之電壓穩定地維持於一低電壓，使得該第二電源VSS之電壓可穩定地輸出至該第一輸出端37。
另一方面，一取樣訊號係同步於該第二時脈訊號CLK2(在下一階段中，該第二時脈訊號CLK2被提供至該第一輸入端)來提供至該下一階段。在本例中，該下一階段使用該取樣訊號來穩定地輸出該發光控制訊號。
此外，在圖4中，說明產生一取樣訊號以對應於該啟動訊號FLM。然而，本發明不限於上述。例如，當該啟動訊號FLM重疊二個第一時脈訊號CLK1，二個取樣訊號被提供至該下一階段。因此，根據本發明實施例，控制該啟動訊號FLM之寬度而可隨意地控制該發光控制訊號之寬度。
圖5係說明圖2階段之第二實施例電路圖。在圖5中，相同於圖3那些之構件係以相同參考號表示之，且其詳細說明將被省略。
參考至圖5，根據本發明第二實施例，該階段321進一步包含用於雙向驅動之第十二電晶體M12及第十三電晶體M13。
該第十二電晶體M12係耦接於該第四輸入端36及該第三電晶體M3之間。該第十二電晶體M12之閘極接收一第一控制訊號CS1。當提供該第一控制訊號CS1時，該第十 二電晶體M12被導通。
該第十三電晶體M13係耦接於一第五輸入端39及該第五電晶體M5(或一第一控制器100)之間。接著，該第十三電晶體M13之閘極接收一第二控制訊號CS2。當提供該第二控制訊號CS2時，該第十三電晶體M13被導通。該第五輸入端39接收該啟動訊號或該下一階段之取樣訊號。
在此，該第一控制訊號CS1及該第二控制訊號CS2係於不同時間(例如，彼此間不重疊)提供之。例如，當該些發光控制訊號係提供於一第一方向(從一面板頭到尾)時，提供該第一控制訊號CS1，使得該第十二電晶體M12導通，並使得該第十三電晶體M13維持於一關閉狀態。當該些發光控制訊號係提供於一第二方向(從該面板尾到頭)時，提供該第一控制訊號CS1，使得該第十三電晶體M13導通，並使得該第十二電晶體M12維持於一關閉狀態。
根據本發明第二實施例，該階段321進一步包含用於雙向驅動之第十二電晶體M12及第十三電晶體M13，且該些操作程序實際上係相同於圖3所示之第一實施例。
圖6係說明圖2階段之第三實施例電路圖。在圖6中，相同於圖3那些之構件係以相同參考號表示之，且其詳細說明將被省略。
參考至圖6，根據本發明第三實施例，該階段321進一步包含耦接於該第一節點N1及該第二電源VSS之間之第十四電晶體M14。當一重置訊號(Reset)係提供至該第十四電晶體M14之閘極時，該第十四電晶體M14被導通以提供該 第二電源VSS之電壓至該第一節點N1。當該第二電源VSS係提供至該第一節點N1時，該第一電晶體M1被導通，使得該第一電源VDD之電壓被提供至該第一輸出端37。
在此，當一電源係導通及/或關閉時，該重置訊號(Reset)被共同地提供至所有該些階段321至32n。如上所述，當提供該重置訊號(Reset)並導通及/或關閉該電源時，該些發光控制訊號被提供至該些發光控制線E1至En，使得該些像素50係設定為一無發光狀態。也就是，根據本發明第三實施例，當使用該重置訊號導通及/或關閉該電源時，阻止過電流流動或不需要光之產生係可行。
此外，在圖2中，該第三時脈訊號CLK3被提供至所有該些階段321至32n。然而，本發明不限於上述。例如，該第三時脈訊號CLK3可透過不同線來提供至偶數及奇數階段。接著，極小化或降低該第三時脈訊號CLK3之負載，使得驅動該些階段之穩定性可被改善。
本發明已結合某些示範性實施例進行說明，要了解到本發明不限於所揭示實施例，反之，想要涵蓋包含於所附申請專例範圍之精神及範圍內之各種修改及等效安排及其等效例。
10‧‧‧掃描驅動器
20‧‧‧資料驅動器
30‧‧‧發光控制線驅動器
33‧‧‧第一輸入端
34‧‧‧第二輸入端
35‧‧‧第三輸入端
36‧‧‧第四輸入端
37‧‧‧第一輸出端
38‧‧‧第二輸出端
39‧‧‧第五輸入端
40‧‧‧顯示單元
50‧‧‧像素
60‧‧‧時序控制器
100‧‧‧第一控制器
102‧‧‧第二控制器
321-32n、32k‧‧‧階段
C1‧‧‧第一電容器
C2‧‧‧第二電容器
C3‧‧‧第三電容器
C4‧‧‧第四電容器
C5‧‧‧第五電容器
CLK1、CLK2、CLK3‧‧‧時脈訊號
CS1‧‧‧第一控制訊號
CS2‧‧‧第二控制訊號
D1-Dm‧‧‧資料線
E1-En、Ei‧‧‧發光控制線
FLM‧‧‧啟動訊號
M1‧‧‧第一電晶體
M2‧‧‧第二電晶體
M3‧‧‧第三電晶體
M4‧‧‧第四電晶體
M5‧‧‧第五電晶體
M6‧‧‧第六電晶體
M7‧‧‧第七電晶體
M8‧‧‧第八電晶體
M9‧‧‧第九電晶體
M10‧‧‧第十電晶體
M11‧‧‧第十一電晶體
M12‧‧‧第十二電晶體
M13‧‧‧第十三電晶體
M14‧‧‧第十四電晶體
N1‧‧‧第一節點
N2‧‧‧第二節點
N3‧‧‧第三節點
N4‧‧‧第四節點
N5‧‧‧第五節點
N6‧‧‧第六節點
Reset‧‧‧重置訊號
S1-Sn、Si‧‧‧掃描線
SR‧‧‧第二輸出端
VDD‧‧‧第一電源
VSS‧‧‧第二電源
該些附圖連同本說明書一起說明本發明示範性實施例，並連同說明一起用於說明本發明原理。
圖1係根據本發明一實施例說明一有機發光顯示器之 方塊圖。
圖2係示意地說明圖1發光控制線驅動器各階段之方塊圖。
圖3係說明圖2階段中之一之第一實施例電路圖。
圖4係說明圖3階段中之一之操作程序波形圖。
圖5係說明圖2階段中之一之第二實施例電路圖。
圖6係說明圖2階段中之一之第三實施例電路圖。
33‧‧‧第一輸入端
34‧‧‧第二輸入端
35‧‧‧第三輸入端
36‧‧‧第四輸入端
37‧‧‧第一輸出端
38‧‧‧第二輸出端
100‧‧‧第一控制器
102‧‧‧第二控制器
321‧‧‧階段
C1‧‧‧第一電容器
C2‧‧‧第二電容器
C3‧‧‧第三電容器
C4‧‧‧第四電容器
C5‧‧‧第五電容器
CLK1、CLK2、CLK3‧‧‧時脈訊號
E1‧‧‧發光控制線
FLM‧‧‧啟動訊號
M1‧‧‧第一電晶體
M2‧‧‧第二電晶體
M3‧‧‧第三電晶體
M4‧‧‧第四電晶體
M5‧‧‧第五電晶體
M6‧‧‧第六電晶體
M7‧‧‧第七電晶體
M8‧‧‧第八電晶體
M9‧‧‧第九電晶體
M10‧‧‧第十電晶體
M11‧‧‧第十一電晶體
N1‧‧‧第一節點
N2‧‧‧第二節點
N3‧‧‧第三節點
N4‧‧‧第四節點
N5‧‧‧第五節點
N6‧‧‧第六節點
SR‧‧‧第二輸出端
VDD‧‧‧第一電源
VSS‧‧‧第二電源

Claims (26)

  1. 一種包括多個階段之發光控制線驅動器，其中，該些階段中之每一個包括：一第一電晶體，耦接於一第一輸出端及一第一電源之間，該第一電晶體被架構以對應於耦接至該第一電晶體閘極之第一節點所施加之電壓來導通或關閉；一第二電晶體，耦接於該第一輸出端及一第二電源之間，該第二電源輸出較該第一電源低之電壓，該第二電晶體被架構以對應於耦接至該第二電晶體閘極之第二節點所施加之電壓來導通或關閉；一第三電晶體，耦接於一第四輸入端及該第一節點之間，並具有耦接至一第一輸入端之一閘極；一第四電晶體，耦接於該第一電源及該第二節點之間，並具有耦接至該第一節點之一閘極；一第一控制器，耦接於該第一輸入端及一第二輸入端，以提供一取樣訊號至一第二輸出端；一第二控制器，耦接於該第一輸入端及一第三輸入端，以控制該第二節點之電壓；以及一第一電容器，耦接於該第二輸入端及該第二節點之間。
  2. 如申請專利範圍第1項之發光控制線驅動器，進一步包括一第二電容器，耦接於該第一節點及該第一電源之間。
  3. 如申請專利範圍第1項之發光控制線驅動器，其中，該第一輸入端係架構來接收一第一時脈訊號， 該第二輸入端係架構來接收一第二時脈訊號，該第三輸入端係架構來接收一第三時脈訊號，及。該第四輸入端係架構來接收一啟動訊號或前一階段之一取樣訊號。
  4. 如申請專利範圍第3項之發光控制線驅動器，其中，該第一時脈訊號、該第二時脈訊號及該第三時脈訊彼此間並不重疊。
  5. 如申請專利範圍第3項之發光控制線驅動器，其中，該第一時脈訊號及該第二時脈訊號中之每一個係設定於i個水平週期之期間內，且該第三時脈訊號係設定於i/2個水平週期之期間內，且i係一自然數。
  6. 如申請專利範圍第5項之發光控制線驅動器，其中，在一水平期間內提供該第一時脈訊號或該第二時脈訊號之後，在該水平期間內提供該第三時脈訊號。
  7. 如申請專利範圍第1項之發光控制線驅動器，其中，該第一控制器包括：一第五電晶體，耦接於該第四輸入端及一第三節點之間，並具有耦接至該第一輸入端之一閘極；一第六電晶體，耦接於一第六節點及該第二輸入端之間，並具有耦接至該第三節點之一閘極；一第七電晶體，耦接於該第六節點及該第一電源之間，並具有耦接至該第一輸出端之一閘極；一第三電容器，耦接於該第三節點及該第六節點之 間；以及一第四電容器，耦接於該第一輸出端及該第一電源之間。
  8. 如申請專利範圍第7項之發光控制線驅動器，其中，該第二輸出端係電性耦接至該第六節點。
  9. 如申請專利範圍第1項之發光控制線驅動器，其中，該第二控制器包括：一第八電晶體，耦接於該第一輸入端及一第四節點之間，並具有耦接至該第一節點之一閘極；一第九電晶體，耦接於該第四節點及該第二電源之間，並具有耦接至該第一輸入端之一閘極；一第十電晶體，耦接於該第二節點及一第五節點之間，並具有耦接至該第三輸入端之一閘極；一第十一電晶體，耦接於該第五節點及該第三輸入端之間，並具有耦接至該第四節點之一閘極；以及一第五電容器，耦接於該第四節點及該第五節點之間。
  10. 如申請專利範圍第1項之發光控制線驅動器，進一步包括：一第十二電晶體，耦接於該第四輸入端及該第三電晶體之間，該第十二電晶體被架構以導通於一第一控制訊號提供至該第十二電晶體閘極之時；以及一第十三電晶體，耦接於一第五輸入端及該第一控制器之間，該第十三電晶體被架構以導通於一第二控制訊號提供至該第十三電晶體閘極之時。
  11. 如申請專利範圍第10項之發光控制線驅動器，其中，該第一控制訊號及該第二控制訊號彼此間並不重疊。
  12. 如申請專利範圍第10項之發光控制線驅動器，其中，該第五輸入端係架構來接收一啟動訊號或下一階段之取樣訊號。
  13. 如申請專利範圍第1項之發光控制線驅動器，進一步包括一第十四電晶體，耦接於該第一節點及該第二電源之間，該第十四電晶體被架構以導通於一重置訊號提供至該第十四電晶體的閘極之時。
  14. 如申請專利範圍第13項之發光控制線驅動器，其中，該重置訊號係共同地提供至所有該些階段。
  15. 一種有機發光顯示器，包括：一掃描驅動器，用於依序提供掃描訊號至掃描線；一資料驅動器，用於提供資料訊號至資料線；一發光控制線驅動器，用於提供發光控制訊號至發光控制線；以及像素，位在該些掃描線、該些資料線和該些發光控制線之相交區域，其中，該發光控制線驅動器包括分別耦接至該些發光控制線之各階段，且其中，該些階段中之每一個包括：一第一電晶體，耦接於一第一輸出端及一第一電源之間，該第一電晶體被架構以對應於耦接至該第一電晶體閘極之第一節點所施加之電壓來導通或關閉； 一第二電晶體，耦接於該第一輸出端及一第二電源之間，該第二電源輸出較該第一電源低之電壓，該第二電晶體被架構以對應於耦接至該第二電晶體閘極之第二節點所施加之電壓來導通或關閉；一第三電晶體，耦接於一第四輸入端及該第一節點之間，並具有耦接至一第一輸入端之一閘極；一第四電晶體，耦接於該第一電源及該第二節點之間，並具有耦接至該第一節點之一閘極；一第一控制器，耦接於該第一輸入端及一第二輸入端，以提供一取樣訊號至一第二輸出端；一第二控制器，耦接於該第一輸入端及一第三輸入端，以控制該第二節點之電壓；以及一第一電容器，耦接於該第二輸入端及該第二節點之間。
  16. 如申請專利範圍第15項之有機發光顯示器，進一步包括一第二電容器，耦接於該第一節點及該第一電源之間。
  17. 如申請專利範圍第15項之有機發光顯示器，其中，該些階段中之第i階段之第一輸入端係架構來接收一第一時脈訊號，該些階段中之第i階段之第二輸入端係架構來接收一第二時脈訊號，該些階段中之第i階段之第三輸入端係架構來接收一第三時脈訊號，且該些階段中之第i階段之第四輸入端係架構來接收一 啟動訊號或前一階段之取樣訊號，且i係一自然數。
  18. 如申請專利範圍第17項之有機發光顯示器，其中，該些階段中之第(i+1)階段之第一輸入端係架構來接收該第二時脈訊號，該些階段中之第(i+1)階段之第二輸入端係架構來接收該第一時脈訊號，該些階段中之第(i+1)階段之第三輸入端係架構來接收該第三時脈訊號，且該些階段中之第(i+1)階段之第四輸入端係架構來接收該啟動訊號或前一階段之取樣訊號。
  19. 如申請專利範圍第18項之有機發光顯示器，其中，該第一時脈訊號及該第二時脈訊號中之每一個係設定於i個水平週期之期間內，且該第三時脈訊號係設定於i/2個水平週期之期間內。
  20. 如申請專利範圍第18項之有機發光顯示器，其中，在一水平期間內提供該第一時脈訊號或該第二時脈訊號之後，在該水平期間內提供該第三時脈訊號。
  21. 如申請專利範圍第18項之有機發光顯示器，其中，提供至該第i階段及該第(i+1)階段之第三時脈訊號係透過不同傳輸線來提供。
  22. 如申請專利範圍第15項之有機發光顯示器，其中，該第一控制器包括：一第五電晶體，耦接於該第四輸入端及一第三節點之間，並具有耦接至該第一輸入端之一閘極； 一第六電晶體，耦接於一第六節點及該第二輸入端之間，並具有耦接至該第三節點之一閘極；一第七電晶體，耦接於該第六節點及該第一電源之間，並具有耦接至該第一輸出端之一閘極；一第三電容器，耦接於該第三節點及該第六節點之間；以及一第四電容器，耦接於該第一輸出端及該第一電源之間。
  23. 如申請專利範圍第22項之有機發光顯示器，其中，該第二輸出端係電性耦接至該第六節點。
  24. 如申請專利範圍第15項之有機發光顯示器，其中，該第二控制器包括：一第八電晶體，耦接於該第一輸入端及一第四節點之間，並具有耦接至該第一節點之一閘極；一第九電晶體，耦接於該第四節點及該第二電源之間，並具有耦接至該第一輸入端之一閘極；一第十電晶體，耦接於該第二節點及一第五節點之間，並具有耦接至該第三輸入端之一閘極；一第十一電晶體，耦接於該第五節點及該第三輸入端之間，並具有耦接至該第四節點之一閘極；以及一第五電容器，耦接於該第四節點及該第五節點之間。
  25. 如申請專利範圍第15項之有機發光顯示器，進一步包括：一第十二電晶體，耦接於該第四輸入端及該第三電晶 體之間，該第十二電晶體被架構以導通於一第一控制訊號提供至該第十二電晶體閘極之時；以及一第十三電晶體，耦接於一第五輸入端及該第一控制器之間，該第十三電晶體被架構以導通於一第二控制訊號提供至該第十三電晶體閘極之時。
  26. 如申請專利範圍第15項之有機發光顯示器，進一步包括一第十四電晶體，耦接於該第一節點及該第二電源之間，該第十四電晶體被架構以導通於一重置訊號被提供之時。
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