SU1410274A1 - Integrating a-d converter - Google Patents
Integrating a-d converter Download PDFInfo
- Publication number
- SU1410274A1 SU1410274A1 SU864081622A SU4081622A SU1410274A1 SU 1410274 A1 SU1410274 A1 SU 1410274A1 SU 864081622 A SU864081622 A SU 864081622A SU 4081622 A SU4081622 A SU 4081622A SU 1410274 A1 SU1410274 A1 SU 1410274A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- output
- resistor
- inverting
- trigger
- Prior art date
Links
Landscapes
- Analogue/Digital Conversion (AREA)
Abstract
Изобретение относитс к измерительной технике и может быть использовано в электроизмерительньк приборах и приборах дл научных исследований . Целью изобретени вл етс уменьшение погрешности преобразовани . Отличие преобразовател состоит в том, что он дополнительно содержит входные резисторы, так что число входных резисторов равно числу входных зажимов. операционный усилитель (ОУ), добавочные ключи и три резистора, причем каждый входной резистор соединен одним выводом с входным зажимом, а другим выводом - с сигнальным входом одного из входных ключей. Сигнальный вход каждого добавочного ключа соединен с сигнальным входом из входных ключей, а управл ющий вход каждого добавочного ключа соединен с управл ющим входом соответствующего входного ключа. Сигнальные выходы добавочных ключей соединены с инвертирующим входом добавочного ОУ, выход которого св зан с неинвертирующим входом ОУ и через первый резистор с инвертирую-, щим входом компаратора, неинвертирующий вход которого соединен с выходом ОУ. Инвертирующий вход ОУ соединен с сигнальными выходами входных ключей . через второй резистор, инвертирующий вход компаратора соединен с его выходом через третий резистор, а неинвертирующий вход добавочного ОУ соединен с общей шиной. 1 з.п.ф-лы, 2 ил. (/; сThe invention relates to measurement technology and can be used in electrical instruments and devices for scientific research. The aim of the invention is to reduce the conversion error. The difference between the converter is that it additionally contains input resistors, so that the number of input resistors is equal to the number of input terminals. an operational amplifier (op-amp), additional switches and three resistors, with each input resistor connected by one output to the input terminal and the other output to the signal input of one of the input switches. The signal input of each additional key is connected to the signal input of the input keys, and the control input of each additional key is connected to the control input of the corresponding input key. The signal outputs of the additional switches are connected to the inverting input of the additional OU, the output of which is connected to the non-inverting input of the op-amp and through the first resistor with the inverting input of the comparator, the non-inverting input of which is connected to the output of the op-amp. The inverting input of the op-amp is connected to the signal outputs of the input keys. through the second resistor, the inverting input of the comparator is connected to its output through the third resistor, and the non-inverting input of the additional OA is connected to the common bus. 1 hp ff, 2 ill. (/; with
Description
(ii (ii
11eleven
Изобретение, относитс к электроизмерительной технике и может быть использовано в электроизмерительных приборах и приборах дл научных исслдований , This invention relates to electrical measuring technology and can be used in electrical measuring instruments and scientific research instruments.
Целью изобретени вл етс уменьшение погрешности преобразовани .The aim of the invention is to reduce the conversion error.
На фиг,1 приведена принцпиальна электрическа схема интегрирующего А1Щ на .фиг.2 - пример выполнени устройства управлени .Fig. 1 shows the principle electrical circuit of the integrating A1SC in Fig. 2, an example of the execution of the control device.
А1Щ содержит интегратор, выполнен ньм на первом операционном усилителе (ОУ) 1, конденсаторе 2 и резисторе 3 компаратор 4, резисторы 5-7, блоки 8 и 9 ключей, второй операционный усилитель 10, устройство управлени 11 и резисторы 12 и 13,A1SC contains an integrator, made on the first operational amplifier (OS) 1, the capacitor 2 and the resistor 3, the comparator 4, resistors 5-7, blocks 8 and 9 of the keys, the second operational amplifier 10, the control device 11 and the resistors 12 and 13,
Устройство управлени содержит ге нератор импульсов 14, элементы И 15- 19, триггеры 20-22, элемент задержки .23, инвертор 24, формирователь импульсов 25, 26 и счетчики 27 и 28.The control unit includes a pulse generator 14, elements AND 15-19, triggers 20-22, a delay element .23, an inverter 24, a pulse shaper 25, 26, and counters 27 and 28.
АЦП работает следующим образом. ADC works as follows.
В начальный момент времени конденсатор 2 разр жен (Ug 0). Б первом такте интегрировани замыкаютс ключи из блоков 8 и 9, соединенные с резистором 5. При этом ток от источ- ника напр жени Ug через входной зажим, резистор 5, ключ и резистор поступает на вход ОУ 1. Конденсатор |2 зар жаетс , интегриру поступающийAt the initial time, capacitor 2 is discharged (Ug 0). In the first integration cycle, the keys from blocks 8 and 9 connected to the resistor 5 are closed. At the same time, the current from the voltage source Ug through the input terminal, resistor 5, key and resistor is fed to the input of the OU 1. The capacitor | 2 is charged, integrating incoming
ток In. Через ключ из блока 9, соединенный с резистором 5, напр жение с правого (по схеме) вывода резистора 5 поступает на инвертирующий вход ОУ 10. Так неинвертирующий вход ОУ 10 соединен с общей точкой, а его выход с неинвертирующим входом ОУ 1, то по цепи обратной св зи, включающей ОУ 1, конденсатор 2, резистор 3 и замкнутые ключи, потенциал правого вывода резистора 5 поддерживаетс равным нулю за врем Т„ - интегрировани входного напр жени U g. Так как обратна св зь должна быть отрицательной , то, поскольку выход, ОУ 10 может быть соединен лишь с неинвертирующим входом ОУ 1, требуетс , чтобы к резистору 5 через ключ из блока 9 подключилс инвертирующий вход ОУ 10. При этом ток зар да конденсатора 2 определ етс по формуле 1 , где R - сопротивление резистора 5, независимо от сопротивлени г,, замкнутого ключа из блока В и сопротивлени резистора 3, конденсатор 2 зар жаетс линейно. Так как напр жение на правом выводе резистора 5 поддерживаетс равным нулю, то протекающий ток зар да создает на замкнутом ключе блока 8 и резисторе 3 падение напр жени такое, что пол рность напр жени на входе ОУ 1 оказываетс противоположной пол рности иcurrent In. Through the key from block 9 connected to resistor 5, the voltage from the right (according to the diagram) output of resistor 5 is fed to the inverting input of the op-amp 10. So the non-inverting input of the shelter 10 is connected to a common point, and its output with the non-inverting input of the shelter 1, then a feedback circuit including an op-amp 1, a capacitor 2, a resistor 3 and closed switches, the potential of the right terminal of the resistor 5 is maintained equal to zero during the time T „- integration of the input voltage U g. Since the feedback must be negative, since the output of the op-amp 10 can only be connected to the non-inverting input of the op-amp 1, it is required that the inverting input of the op-amp 10 be connected to the resistor 5 via a switch from block 9. is determined by the formula 1, where R is the resistance of the resistor 5, regardless of the resistance r, of the closed key from the block B and the resistance of the resistor 3, the capacitor 2 is linearly charged. Since the voltage on the right side of the resistor 5 is kept equal to zero, the flowing charge current creates a voltage drop on the closed key of the block 8 and resistor 3 such that the polarity of the voltage at the input of the shelter 1 turns out to be the opposite polarity and
ВХ BX
а его величина определ етс and its value is determined by
по формулеaccording to the formula
г g
- б - b
RR
где г where r
- сопротивление замкнутого- resistance of the closed
f ключа,f key,
R - сопротивление резистора 3.R is the resistance of the resistor 3.
Линейный зар д конденсатора 2 начинаетс -от напр жени Ug относительно общей точки. Б то же врем относительно неинвертирующего входа ОУ 1 и выхода ОУ 10, он начиналс от нул . При этом напр жение на конденсаторе 2 определ етс по формулеThe linear charge of the capacitor 2 starts from -the voltage Ug relative to the common point. At the same time, with respect to the non-inverting input of the OA 1 and the output of the OA 10, it started from zero. In this case, the voltage on the capacitor 2 is determined by the formula
i-« t i- “t
1 one
где t - с врем от начала зар да, емкость конденсатора 2. В конце первого такта интегрировани длительностью Т конденсатор 2 оказываетс зар женным до напр жени where t is the time from the beginning of the charge, the capacitance of the capacitor 2. At the end of the first integration cycle of duration T, the capacitor 2 is charged before the voltage
и,and,
IbXrp IbXrp
- ---1- ---one
UBX т С7 R ,c, UBX t C7 R, c,
00
5five
00
По окончании первого такта интегрировани ключи блоков В и 9, сигнальные входы которых были соединены с резистором 5, размыкаютс устройством управлени 11. Устройство управлени , в зависимости от пол рности входного напр жени , замыкает в блоках В и 9 либо те ключи, сигнальные входы которых соединены с резистором 6, либо те, которые,соединены с резистором 7. При этом от входных зажимов через резистор 6 или 7, соответствующий ключ блока 8 и резистор 3 на вход ОУ 1 поступает ток, направление которого противоположно направлению тока в первом такте интегрировани . Величина этого тока равнаAt the end of the first integration cycle, the keys of blocks B and 9, the signal inputs of which were connected to resistor 5, are disconnected by control device 11. The control device, depending on the polarity of the input voltage, closes in blocks B and 9 or those keys whose signal inputs connected to the resistor 6, or those that are connected to the resistor 7. At the same time from the input terminals through the resistor 6 or 7, the corresponding key of the block 8 and the resistor 3 to the input of the shelter 1 receives a current, the direction of which is opposite to the direction of the current in the first those integration. The magnitude of this current is equal to
patippatip
EOI --- илиEOI --- or
1one
II
ра ipra ip
Eol REol r
77
где R/j - сопротивление резистора 6, Rj - сопротивление резистора 7.where R / j is the resistance of resistor 6, Rj is the resistance of resistor 7.
При этом напр жение на инвертирующем и неинвертирующем входах ОУ 1 равноThe voltage at the inverting and non-inverting inputs of the OU 1 is equal to
-Е-E
00
R4 R-, R4 R-,
или Е;, -Eo,or E ;, -Eo,
Хот напр жение на входах ОУ 1 в момент переключени ключей измен етс с и р на Е или , напр жение зар да конденсатора 2 U с, не мен етс . Так как направление тока на входе ОУ 1 изменилось на противоположное , начинаетс линейный разр д конденсатора 2 до нул . Врем разр да определ етс вьфажением:Although the voltage at the inputs of the OA 1 at the time of switching the keys changes from and p to E or, the voltage of the charge of the capacitor 2 U c does not change. Since the direction of the current at the input of the op-amp 1 has been reversed, the linear discharge of the capacitor 2 to zero begins. The discharge time is determined by the pressure:
Т/ с х с ,T / s x s,
Р хэр P har
т.е.those.
т t
X X
RI RI
1 one
ИЛИ т Or T
T,.UpT, .Up
R:R:
,R, Таким образом, врем разр да конденсатора 2 пропорционально входному напр жению, т.е. осуществл етс преобразование входного напр жени в интервал времени., R, Thus, the discharge time of capacitor 2 is proportional to the input voltage, i.e. the input voltage is converted to a time interval.
Дп завершени процесса преобразовани компаратор 4 в момент равенства нулю напр жени на конденсаторе 2 должен изменить состо ние подава на устройство управлени 11 сигнал об окончании второго такта интегрировани (момент времени Ту), Дл этого один из входов компаратора 4 соединен с выходом ОУ 1. Если второй вход компаратора 4 будет при этом подключен, например, к нулевой точке, то компаратор 4 изменит состо ние не в момент времени, когда напр жение на конденсаторе 2 равно нулю, а в момент времени, когда сумма - напр жение на конденсаторе In completing the conversion process, the comparator 4, at the instant when the voltage on the capacitor 2 is zero, should change the state of the second signal to the control device 11 when the second integration cycle (time Tu) ends. For this, one of the inputs of the comparator 4 is connected to the output of the OA 1. If the second input of the comparator 4 will be connected, for example, to the zero point, then the comparator 4 will change the state not at the time when the voltage on the capacitor 2 is zero, but at the time when the sum is the voltage on the capacitor
и Е Q, или Еand E Q, or E
0101
равна нулю. Нельз equals zero. Nelz
также подключить второй вход компаратора к точке с напр жением, равным EQ, или Ед, так как пол рность этих напр жений зависит от пол рности входного напр жени , а величина - от напр жени Е, , Е j и сопротивлени резисторов 6 и 7. Таким образом, второй вход компаратора должен быть соединен с неинвертирующим входом ОУ 1 или, с выходом ОУ 10. Так как напр жение между входами операционного усилител (без учета напр жени смещени ) равно нулю, такое соединение эквивалентно подключению входов компаратора 4 параллельно конденсатору 2, что и требуетс .also connect the second input of the comparator to a point with a voltage equal to EQ, or Un, since the polarity of these voltages depends on the polarity of the input voltage, and the magnitude depends on the voltage E,, E j and the resistance of resistors 6 and 7. Thus, the second input of the comparator must be connected to the non-inverting input of the OU 1 or, to the output of the OU 10. Since the voltage between the inputs of the operational amplifier (without taking into account the bias voltage) is zero, this connection is equivalent to connecting the inputs of the comparator 4 in parallel with the capacitor 2, as required.
Напр жение на выходе компаратора 4 определ етс выражениемThe voltage at the output of the comparator 4 is determined by the expression
иand
ьих- (UB - Ugx,ih- (UB - Ugx,
Ж + иF + and
ex.ex.
где Up - напр жение на неинвертирующем входе компаратора} и Bj - напр жение на инвертирующем входе компаратора.where Up is the voltage at the non-inverting input of the comparator} and Bj is the voltage at the inverting input of the comparator.
2020
2525
30thirty
3535
15 К --т15 K - t
R5 R6 R5 R6
Р5 - сопротивление резистора 13 i Р6 - сопротивление резистора 12.Р5 - resistance of resistor 13 i Р6 - resistance of resistor 12.
Выкодное напр жение компаратора складываетс из двух составл ющих - напр жени , вызванного напр51жением на конденсаторе 2, и напр жени противоположной пол рности, вызванного входным синфазным сигналом.The output voltage of the comparator is made up of two components - the voltage caused by the voltage across the capacitor 2, and the voltage of opposite polarity caused by the input common-mode signal.
При и с, О напр жени на входах компаратора 4 равны (Е, или Ед). следовательно, такое же напр жение и на выходе компаратора, т.е. коэффициент передачи компаратора по синфазному сигналу равен единице. Выбира Ед, , Е О равным напр жению сраба- тьшани логических элементов устройства 11, устран ем дополнитель- ную погрешность, вызванную инерционностью компаратора 4. Требуема величина напр жений ЕWhen and c, O, the voltages at the inputs of the comparator 4 are equal (E, or Ed). therefore, the same voltage at the output of the comparator, i.e. the comparator transmission coefficient of the common mode signal is one. Choosing EU, E O equal to the voltage to operate the logic elements of the device 11, eliminate the additional error caused by the inertia of the comparator 4. The required voltage value E
0101
Е д можетE d can
быть подобрана изменением сопротивлени резистора.be matched by changing the resistance of the resistor.
Claims (2)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864081622A SU1410274A1 (en) | 1986-04-07 | 1986-04-07 | Integrating a-d converter |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864081622A SU1410274A1 (en) | 1986-04-07 | 1986-04-07 | Integrating a-d converter |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1410274A1 true SU1410274A1 (en) | 1988-07-15 |
Family
ID=21242950
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU864081622A SU1410274A1 (en) | 1986-04-07 | 1986-04-07 | Integrating a-d converter |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1410274A1 (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2802872C1 (en) * | 2023-03-22 | 2023-09-05 | Федеральное государственное бюджетное образовательное учреждение высшего образования "Московский авиационный институт (национальный исследовательский университет)" | Integrating analog-to-digital converter |
-
1986
- 1986-04-07 SU SU864081622A patent/SU1410274A1/en active
Non-Patent Citations (1)
Title |
---|
Патент Cl IA 4033364, кл. Н 03 К 13/02, 1978. Electronic Design, 1968, № 26, с. 64, рис. 7. * |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2802872C1 (en) * | 2023-03-22 | 2023-09-05 | Федеральное государственное бюджетное образовательное учреждение высшего образования "Московский авиационный институт (национальный исследовательский университет)" | Integrating analog-to-digital converter |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
EP0163333B1 (en) | Filter arrangement | |
SU1410274A1 (en) | Integrating a-d converter | |
JPH04345321A (en) | Dual slope integrating a/d converter | |
SU1364999A1 (en) | Device for measuring parameters of sub x c sub x two-terminal networks incorporated in tri-pole closed electric circuit | |
JPH06209244A (en) | Linear converter | |
SU1167735A1 (en) | Voltage-to-pulse rate converter | |
SU1167529A1 (en) | Digital ohmmeter | |
SU1323985A1 (en) | Digital meter of four-pole network gain factor | |
SU1316008A1 (en) | Hybrid integrating device | |
SU1046930A2 (en) | Integrating voltage-to-time-interval converter | |
SU1501269A1 (en) | Electric signal coder | |
SU1697265A1 (en) | Analog-to-digital converter | |
SU1620957A2 (en) | Resistance-to-frequency converter | |
SU1571623A1 (en) | Device for signal integration | |
SU1259521A1 (en) | Device for restoring d.c. component | |
SU1290526A1 (en) | Integrating two-step analog-to-digital converter | |
SU1267441A2 (en) | Device for integrating signal | |
SU1580281A1 (en) | Meter of phase difference | |
SU1334360A1 (en) | Amplifier | |
JPS6230104Y2 (en) | ||
SU1580404A1 (en) | Linear extrapolator | |
SU1095369A1 (en) | Sawtooth-parabolic signal former | |
SU1161963A1 (en) | Inegrator | |
SU1108369A1 (en) | Analog-digital converter of resistance | |
SU822346A1 (en) | Analogue-digital converter |