SU1325700A1 - Displacement-to-code converter - Google Patents
Displacement-to-code converter Download PDFInfo
- Publication number
- SU1325700A1 SU1325700A1 SU853984949A SU3984949A SU1325700A1 SU 1325700 A1 SU1325700 A1 SU 1325700A1 SU 853984949 A SU853984949 A SU 853984949A SU 3984949 A SU3984949 A SU 3984949A SU 1325700 A1 SU1325700 A1 SU 1325700A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- adder
- inputs
- code
- output
- register
- Prior art date
Links
Landscapes
- Analogue/Digital Conversion (AREA)
Abstract
Изобретение относитс к автоматике и вычислительной технике и может быть использовано дл св зи аналоговых источников информации с цифровым вычислительным устройством. С целью упрощени в преобразователе, содержащем формирователь 1 импульсов точно06 го отсчета (ТО), регистр 2, блок 3 сравнени и сумматор 4, один выход формировател 1 подключен к С-входу регистра 2 и управл ющему входу блока 3 сравнени , сумматор 4 выполнен в виде реверсивного счетчика, а блок 3 сравнени содержит сумматор 5 и элементы И 5 и 7. В конце каждого цикла преобразовани на одном выходе формировател 1 вьфабатываетс импульс . В сумматоре 5 происходит вычитание кода предыдущего цикла из кода текущего цикла. Если между соседними циклами преобразовани произошел переход через границу диапазона ТО в сторону увеличени перемещени , то инверсные выходы старщего разр да суммы и переполнени сумматора 5 будут в единичном состо нии и в сумматор 4 запишетс +1. При переходе через границу диапазона ТО в сторону уменьшени перемещени в сумматор 4 запишетс -1. 1 з.п. ф-лы, 1 ил. I (Л с со ls ел The invention relates to automation and computing and can be used to connect analog information sources with a digital computing device. In order to simplify, in the converter containing the driver 1 pulses of exactly 06 counting (TO), register 2, comparison block 3 and adder 4, one output of driver 1 is connected to the C input of register 2 and the control input of comparison block 3, the adder 4 is as a reversible counter, and the comparison unit 3 contains an adder 5 and elements AND 5 and 7. At the end of each conversion cycle, a pulse is output at one output of the former 1. In adder 5, the code of the previous cycle is subtracted from the code of the current cycle. If a transition across the boundary of the TO range in the direction of increasing displacement occurred between adjacent conversion cycles, then the high-level inverted outputs of the sum and overflow of the adder 5 will be in one state and write to +1 in the adder 4. When passing through the boundary of the TO range in the direction of decreasing movement, adder 4 will write -1. 1 hp f-ly, 1 ill. I (l with co ls ate
Description
1one
1325700213257002
Изобретение относитс к автоматике мерени ми элементы И 6 и 7 закрытыThe invention relates to automation of measurement elements And 6 and 7 are closed.
по одному из входов и импульсы на вход реверсивного счетчика не поступают . В результате в конце каждого цикла преобразовани на выходе форьш- ровател 1 формируетс - текущее значение кода ТО, а на выходе реверсивного счетчика 4 - текущее значение кода на схема преобразовател перемещени IQ грубого отсчета, в код.Максимально допустимое перемещениеone of the inputs and pulses to the input of the reversible counter are not received. As a result, at the end of each conversion cycle, the output of forger 1 forms the current value of the maintenance code, and the output of the reversible counter 4 indicates the current value of the code for the IQ coarse reference transducer circuit, into the code. Maximum allowable movement
Преобразователь содержит формирователь 1 кода точного отсчета (ТО), регистр. 2, блок 3 сравнени , сумматорThe converter contains shaper 1 of the code of the exact reference (TO), register. 2, block 3 comparison, adder
и вычислительной техники и может быть использовано дл св зи аналоговых источников информации с цифровым вычислительным устройством.and computing technology and can be used to connect analog information sources with a digital computing device.
Целью изобретени вл етс упрощение преобразовател .The aim of the invention is to simplify the converter.
На чертеже представлена структурмежду соседними циклами преобразовани в сторону увеличени перемещени составл ет 0,5 (где диапа4 , выполненный в виде реверсивного счетчика. Блок J сравнени содержит сумматор 5 и элементы И 6 и 7. Формирователь 1 кода ТО содержит блок преобразовани перемещени в код и регистр .The drawing shows the structure between adjacent conversion cycles in the direction of increasing motion is 0.5 (where the range is 4, made in the form of a reversible counter. Comparison unit J contains an adder 5 and elements AND 6 and 7. Former 1 of the maintenance code contains a unit for converting movement into a code and register
Преобразователь работает следующим образом.The Converter operates as follows.
В конце каждого i-цикла преобразоAt the end of each i-cycle transform
вани на одном выходе формировател 1 .вырабатываетс импульс окончани цикла преобразовани , а на группе выходов формировател 1 вьграбатываетс код ТО. В сумматоре 5 происходит суммирование кодов ТО текущего i-цикла с выходов формировател 1 и предыдущего (1-1)-цикла с инверсных выходов регистра 2. .Если между соседними циклами формировани кодов ТО происходит переход через границу диапазона ТО в сторону увеличени перемещени , то после суммировани инверсные выходы старшего разр да суммы и переполнени сумматора 5 оказываютс в единичном состо нии. Выходной импульс формировател 1 проходит через открытий элемент И 7 на вход суммировани реверсивного счетчика 4. Задним фронтом этого импульса код ТО текущего i-цикла заноситс в регистр 2. Если между соседними циклами формировани кодов ТО происходит переход через границу диапазона ТО в сторону уменьшени перемещени , то после суммировани в единичном состо нии пр мые вы- A single impulse of the end of the conversion cycle is generated at one output of the former 1. A TO code is drawn on the output group of the former 1. In the adder 5, the maintenance codes of the current i-cycle are summed up from the outputs of the imaging unit 1 and the previous (1-1) cycle from the inverse outputs of the register 2. If there is a transition through the boundary of the TO range in the direction of increasing displacement between adjacent cycles of generating the maintenance codes, after summation, the inverse outputs of the most significant bit of the sum and the overflow of the adder 5 are in a single state. The output pulse of the imaging unit 1 passes through the element I 7 to the input of the summation of the reversible counter 4. The leading edge of this pulse is the TO code of the current i-cycle entered into register 2. If between adjacent cycles of the formation of the TO code, a transition occurs through the edge of the TO range to decrease the movement then, after summation in a single state, the direct highscores
ходы старшего разр да суммы и переполнени сумматора 5. Выходной импульс формировател 1 проходит через открытьш элемент И 6 на вход вычитани реверсивного счетчика 4. high bit moves of the sum and overflow of the adder 5. The output pulse of the driver 1 passes through the open element AND 6 to the input of the subtraction of the reversible counter 4.
При отсутствии перехода через границу диапазона ТО между соседними измежду соседними циклами преобразовани в сторону увеличени перемещени составл ет 0,5 (где диапазон перемещени в ТО), а в сторонуIn the absence of a transition across the border of the TO range between adjacent ones between adjacent conversion cycles, the upward movement direction is 0.5 (where the upstream movement range is TO) and, in the direction
уменьшени перемещени оreducing movement
(0,5 - )t(0.5 -) t
-го , где п - число разр дов кода ТО на выходе формировател t (регистра 2)..th, where n is the number of bits of the TO code at the output of the former t (register 2) ..
Claims (2)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU853984949A SU1325700A1 (en) | 1985-12-02 | 1985-12-02 | Displacement-to-code converter |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU853984949A SU1325700A1 (en) | 1985-12-02 | 1985-12-02 | Displacement-to-code converter |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1325700A1 true SU1325700A1 (en) | 1987-07-23 |
Family
ID=21208220
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU853984949A SU1325700A1 (en) | 1985-12-02 | 1985-12-02 | Displacement-to-code converter |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1325700A1 (en) |
-
1985
- 1985-12-02 SU SU853984949A patent/SU1325700A1/en active
Non-Patent Citations (1)
Title |
---|
Электромеханические преобразователи угла с электрической редукцией; /Под ред. А. Ахметжанова.-М.: Энерги , 1978, с. 201, рис. 6-9. Авторское свидетельство СССР К 746657, кл. G 08 С 9/04, 1978. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU1325700A1 (en) | Displacement-to-code converter | |
SU1075255A1 (en) | Parallel binary code/unit-counting code translator | |
SU1185361A1 (en) | Device for searching information | |
SU1725399A1 (en) | Binary decimal-to-decimal code converter | |
SU1091347A1 (en) | Reversible pulse counter | |
SU1244786A1 (en) | Digital filter | |
SU1129732A1 (en) | Delta modulator | |
SU1767492A1 (en) | "gold" proportion code weight sequence generator | |
SU1474629A1 (en) | Quadratic function computing device | |
RU2144725C1 (en) | Relay for modulo comparison of two electric quantities | |
SU1183962A1 (en) | Analog-digital differentiator | |
SU993245A1 (en) | Series binary code-to-unit counting code converter | |
SU1001114A1 (en) | Computing device | |
SU541189A1 (en) | Motion to code converter | |
RU1780090C (en) | Multiplying pulse-width modulator | |
SU742911A1 (en) | Function generator | |
SU1120322A1 (en) | Digital function generator | |
SU941926A1 (en) | Digital servo drive | |
SU1272329A1 (en) | Calculating device | |
SU1249510A1 (en) | Device for determining absolute value and argument of vector | |
SU1264170A1 (en) | Differentiating device | |
SU834889A1 (en) | Code-to-frequency converter | |
SU1658391A1 (en) | Serial-to-parallel code converter | |
SU1198536A1 (en) | Digital extrapolator | |
SU1246091A1 (en) | Device for extracting square root |