RU2213390C2 - Полупроводниковая интегральная схема с защитным покрытием поверхности - Google Patents
Полупроводниковая интегральная схема с защитным покрытием поверхностиInfo
- Publication number
- RU2213390C2 RU2213390C2 RU2001107134/28A RU2001107134A RU2213390C2 RU 2213390 C2 RU2213390 C2 RU 2213390C2 RU 2001107134/28 A RU2001107134/28 A RU 2001107134/28A RU 2001107134 A RU2001107134 A RU 2001107134A RU 2213390 C2 RU2213390 C2 RU 2213390C2
- Authority
- RU
- Russia
- Prior art keywords
- semiconductor integrated
- integrated circuit
- circuits
- layer
- protection sensor
- Prior art date
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/57—Protection from inspection, reverse engineering or tampering
- H01L23/576—Protection from inspection, reverse engineering or tampering using active circuits
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Semiconductor Integrated Circuits (AREA)
- Non-Volatile Memory (AREA)
- Semiconductor Memories (AREA)
- Storage Device Security (AREA)
- Formation Of Insulating Films (AREA)
Abstract
Изобретение относится к полупроводниковым интегральным схемам. Предложена полупроводниковая интегральная схема, содержащая схемы, реализованные по меньшей мере в одном слое полупроводниковой подложки и упорядоченные по меньшей мере в одной группе, и по меньшей мере один проводящий защитный слой (SL), размещенный по меньшей мере над одной из таких групп схем и электрически соединенный по меньшей мере с одной из схем (1, 2). Подложка полупроводниковой интегральной схемы имеет по меньшей мере один датчик защиты (SS), который выполнен с возможностью сохранения некоторого состояния энергонезависимым образом, при этом датчик защиты (SS) своим выводом обнаружения связан с проводящим защитным слоем (SL) или по меньшей мере с одним из проводящих защитных слоев. При этом выходной вывод датчика защиты (SS) соединен по меньшей мере с одной из схем (2) таким образом, что функционирование схемы в соответствии с ее назначением невозможно, если на выходе датчика защиты приложен определенный энергонезависимый уровень. В результате схема защищена от несанкционированного анализа с применением метода фокусированного потока ионов. 5 з.п.ф-лы, 4 ил.
Description
Изобретение относится к полупроводниковой интегральной схеме с электронными схемами, реализованными по меньшей мере в одном слое полупроводниковой подложки, упорядоченными по меньшей мере в одну группу, и по меньшей мере с одним проводящим защитным слоем, расположенным по меньшей мере над одной такой группой схем и электрически соединенным по меньшей мере с одной из упомянутых схем.
Подобная полупроводниковая интегральная схема известна из ЕР 0378306 А2. В этой полупроводниковой интегральной схеме первая группа схем размещена в защищенной области, а вторая группа схем размещена в незащищенной области. Защита первой области в известной полупроводниковой интегральной схеме осуществлена с помощью проводящего слоя, который размещен над плоскостью монтажа первой группы схем. Этот проводящий слой электрически соединен с группой схем, причем функционирование этой группы схем в соответствии с их назначением реализуется только при кондиционном состоянии указанного слоя.
Первая группа схем включает в себя микропроцессор, а также относящиеся к нему периферийные схемы, такие как блоки памяти и логическая схема переноса. В блоках памяти может содержаться, в частности, защищенная информация. Кроме того, микропроцессор может иметь специальную структуру, которая особенно хорошо приспособлена для выполнения функций защиты. Посредством проводящего слоя, целостность которого постоянно контролируется, исключается возможность неправомерного доступа и получения информации в процессе работы схемы, например, с помощью растрового электронного микроскопа.
Однако, как и раньше, можно удалить защитный слой и сформировать заменяющие проводники, которые находятся не над критичными с точки зрения защиты областями. Таким путем все равно можно провести исследование схем в процессе работы, хотя и в условиях, связанных с большими затратами.
В ЕР 0169941 А1 описана полупроводниковая интегральная схема с пассивирующим слоем, который экранирует лежащие под ним участки схемы в качестве эквипотенциальной поверхности. Этот пассивирующий слой включен в качестве проводящей дорожки в логические схемы защиты, так что его устранение нарушает функционирование микросхемы и приводит к невозможности динамического анализа. Если, однако, удастся вместо накрывающего защитного пассивирующего слоя проложить некоторого рода шунтирующий проводник, который правда не выполняет проводящую функцию пассивирующего слоя, однако экранирующая функция в этой известной схеме защиты вновь активизирует полупроводниковую интегральную схему.
В ЕР 0300864 А2 предусмотрен проводящий защитный слой, который состоит из двух частичных слоев, емкость которых оценивается. Замена одного или обоих частичных слоев другими проводящими структурами, хотя и не без труда, возможна; во всяком случае имитация емкости другими структурами, которые по меньшей мере частично открывают схемы, позволила бы преодолеть предусмотренные в конструкции интегральной схемы меры защиты. Во всяком случае факт удаления слоев и последующего повторного нанесения с целью проведения по меньшей мере статистического исследования полупроводниковой интегральной схемы позже установить невозможно.
Одним из методов удаления слоев, а также нанесения новых слоев, как, например, шунтирующих проводников, является метод, использующий фокусированный поток ионов. Этот метод, правда, был разработан в первую очередь для устранения ошибок и реструктурирования, однако представляет серьезную опасность для полупроводниковых интегральных схем, критичных с точки зрения обеспечения защищенности.
Поэтому задачей изобретения является создание полупроводниковой интегральной схемы, которая защищена от несанкционированного анализа с применением метода фокусированного потока ионов.
Указанная задача в соответствии с пунктом 1 формулы изобретения решается тем, что подложка полупроводниковой интегральной схемы имеет по меньшей мере один датчик защиты, который выполнен таким образом, что он может сохранять некоторое состояние энергонезависимым образом (с сохранением информации при выключении питания), при этом датчик защиты своим выводом обнаружения связан с проводящим защитным слоем или по меньшей мере с одним из проводящих защитных слоев, а выходной вывод датчика защиты соединен по меньшей мере с одной из схем таким образом, что функционирование схемы в соответствии с ее назначением невозможно, если на выходе датчика защиты приложен определенный энергонезависимый уровень.
Датчик защиты может предпочтительным образом представлять собой транзистор с очень тонким слоем подзатворного оксида по сравнению с соответствующим слоем в транзисторах схем. Но могут применяться и другие конструктивные элементы, действующие в качестве "предохранителей", например диоды. Существенным для такого конструктивного элемента, выполняющего функцию предохранителя, является то, что он под воздействием напряжения может изменяться энергонезависимым образом.
Под "энергонезависимым" изменением в этой связи понимается то, что запомненное состояние сохраняется не только после отключения и повторного приложения напряжения питания, но и что удаление и повторное нанесение проводящего слоя, создающего соединение, обнаруживается и фиксируется. Таким образом, и при целостном слое можно установить, был ли он перед этим удален или производились попытки его удаления.
Было показано, что структуры, обрабатываемые с помощью фокусированного потока ионов, заряжаются электрически. Вырабатываемое при этом напряжение обнаруживается датчиками защиты и оценивается компонентами схемы (схем). Если датчик защиты представляет собой транзистор с очень тонким слоем подзатворного оксида по сравнению с соответствующим слоем других транзисторов, то этот подзатворный оксид разрушается под действием напряжения, обусловленного пучком ионов. Это может быть оценено без особых затруднений.
Датчики защиты могут, с одной стороны, быть распределены по всей поверхности в пределах полупроводниковой интегральной схемы, но, с другой стороны, достаточным является использование незначительного количества датчиков.
Особое преимущество изобретения состоит в том, что удаление защитного слоя с последующим нанесением шунтирующего проводника для случая, когда проверяется наличие защитного слоя, не приведет к успеху, так как датчик защиты обнаруживает удаление защитного слоя энергонезависимым образом и схема после этого не будет функционировать, т.е. не сможет быть приведена в действие ни при наличии защитного слоя, ни при его отсутствии. Существенным при этом является то, что манипулирование защитным слоем фиксируется энергонезависимым образом, что, например, может быть осуществлено путем разрушения подзатворного оксида.
В другом варианте осуществления изобретения датчик защиты выполнен в виде энергонезависимой ячейки памяти, которая образована диффузионными областями стока и истока, образованными по обе стороны канальной области в полупроводниковой подложке, а также электродом затвора, полностью изолированным, размещенным по меньшей мере частично выше канальной области, и двумя управляющими электродами затвора, размещенными над изолированным электродом затвора, причем один из управляющих электродов затвора образует вывод обнаружения, а другой управляющий электрод затвора и диффузионные области соединены со схемой оценки.
При использовании этой новой энергонезависимой ячейки памяти напряжение, обусловленное пучком ионов, приводит к изменению заряда на изолированном затворе, который не может стекать. С помощью второго вывода управляющего затвора, а также выводов диффузионных областей можно в любой момент считать измененное состояние ячейки памяти и тем самым обнаружить его.
Предпочтительным образом изолированный затвор имеет предварительный заряд, причем при наличии множества датчиков защиты предварительный заряд создается с разной полярностью, чтобы обеспечить надежное обнаружение факта манипулирования интегральной схемой.
Изобретение поясняется ниже на примерах его осуществления, иллюстрируемых чертежами, на которых представлено следующее:
фиг.1- возможный вариант выполнения защитного слоя;
фиг.2 - принципиальная схема возможного варианта выполнения схемы оценки в датчике защиты, соответствующем изобретению;
фиг.3 - вид сверху датчика защиты, выполненного в соответствии с изобретением в виде энергонезависимой ячейки памяти;
фиг. 4 - схематичное представление схемы оценки, связанной с энергонезависимой ячейкой памяти.
фиг.1- возможный вариант выполнения защитного слоя;
фиг.2 - принципиальная схема возможного варианта выполнения схемы оценки в датчике защиты, соответствующем изобретению;
фиг.3 - вид сверху датчика защиты, выполненного в соответствии с изобретением в виде энергонезависимой ячейки памяти;
фиг. 4 - схематичное представление схемы оценки, связанной с энергонезависимой ячейкой памяти.
На фиг.1 представлено защитное покрытие в форме меандрового проводника с двумя выводами А, В, которое предпочтительным образом реализуется в самом верхнем слое металлизации в обычном процессе изготовления полупроводниковой интегральной схемы. Выводы А, В имеют сквозные контакты на схемном уровне. Они могут быть связаны там со схемой, показанной на фиг.2.
Генератор сигналов GEN, выполненный в передающем устройстве 1 в полупроводниковой интегральной схеме, вырабатывает сигнал, который в показанном примере через усилители V1, V2 подается к защитному проводнику SL, показанному на фиг.1, и к опорному проводнику RL. Вывод В защитного проводника соединен выводами затворов двух транзисторов T1, T2, включенных по схеме КМОП-инвертора, с тонким слоем подзатворного оксида, действующего в качестве датчика защиты SS. Выход датчика защиты SS, так же как второй вывод опорного проводника RL, соединен с одним из входов компаратора КОМ, выходной сигнал которого показывает, находится ли датчик защиты SS в исправном состоянии. Датчик защиты SS и компаратор КОМ образуют при этом приемную схему 2.
Если датчик защиты SS находится в исправном состоянии, на его выходе вырабатывается такой же сигнал, как и в опорном проводнике RL. Если же датчик защиты под воздействием высокого напряжения, обусловленного неправомерным доступом с использованием пучка ионов, разрушается, то на его выходе вырабатывается постоянное значение - логическая "1" или логический "0", что распознается компаратором КОМ. Выходной сигнал компаратора обуславливает то, что электронная схема, реализованная на интегральной схеме, больше не сможет выполнять предназначенную для нее функцию.
На фиг. 3 представлен вид сверху соответствующей изобретению энергонезависимой ячейки памяти с двумя управляющими электродами затвора. Между двумя диффузионными областями 10, 11, которые функционируют в качестве стока и истока полевого транзистора, выполнена известным способом канальная область, детально не показанная на чертеже, частично покрытая областью изолированного электрода затвора 12, так называемого плавающего затвора. Изолированный слой между канальной областью и областью истока - и соответственно областью стока 11, с одной стороны, и изолированным электродом затвора 12, с другой стороны, в некоторой малой области особенно тонок и образует там туннельное окно 13. Над первой областью изолированного электрода затвора 12 размещен первый управляющий электрод 14 затвора, а над второй областью - второй управляющий электрод 15 затвора. Диффузионная область 10, 11 и управляющие электроды 14, 15 затвора имеют выводы А, А', В, В' и соответственно С.
Новая ячейка памяти может предпочтительным образом применяться вместо транзисторов с тонким слоем подзатворного оксида согласно фиг.2. При этом вывод С ячейки памяти необходимо соединить с выводом В защитного проводника SL. Вывод В ячейки памяти и выводы диффузионных областей А, А' ячейки памяти применяются, с одной стороны, для подачи предварительного заряда на изолированный электрод затвора, а с другой стороны, для оценки состояния заряда изолированного электрода затвора соединяются со схемой оценки AWS, как показано на фиг.4.
Предварительный заряд в предпочтительном варианте осуществления изобретения подается на изолированный электрод затвора перед выпуском полупроводниковых интегральных схем на этапе испытаний путем приложения высокого запрограммированного напряжения величиной примерно 16 В между одним из выводов В или В' первого управляющего электрода 14 затвора и выводом А диффузионной области 11. С помощью этого заряда устанавливается определенное рабочее напряжение транзисторов памяти. Это рабочее напряжение является мерой заряда на изолированном электроде затвора. Если теперь будет иметь место несанкционированный доступ с использованием сфокусированного потока ионов, то между вторым управляющим электродом 15 затвора и канальной областью возникает напряжение. Это напряжение приводит к туннельному току через туннельное окно 13 и тем самым к изменению заряда на изолированном электроде затвора 12. Это изменение заряда может быть обнаружено с помощью схемы оценки AWS за счет определения рабочего напряжения путем приложения изменяющегося напряжения считывания к первому управляющему электроду 14 затвора. Измененное рабочее напряжение указывает на то, что заряд на изолированном электроде затвора был изменен.
Если таким путем энергонезависимым способом был установлен факт несанкционированной попытки доступа с использованием сфокусированного потока ионов, то при последующем вводе в действие полупроводниковой интегральной схемы может быть активизирован соответствующий механизм защиты.
На изолированный электрод затвора 12 в качестве предварительного заряда может быть подан как положительный, так и отрицательный заряд, а для различных датчиков защиты могут быть использованы заряды различной величины и полярности, чтобы повысить надежность обнаружения несанкционированной попытки доступа с использованием сфокусированного потока ионов.
Особое преимущество соответствующего изобретению использования защитного слоя во взаимосвязи с датчиком защиты состоит в том, что датчик защиты энергонезависимым способом регистрирует факт анализа защитного слоя ионным пучком, в результате чего последующее восстановление защитного слоя или соответствующие шунтирующие проводники не могут обеспечить выполнение функций полупроводниковой интегральной схемы в соответствии с ее назначением.
Claims (6)
1. Полупроводниковая интегральная схема, содержащая схемы, реализованные по меньшей мере в одном слое полупроводниковой подложки и упорядоченные по меньшей мере в одной группе, и по меньшей мере один проводящий защитный слой (SL), размещенный по меньшей мере над одной из таких групп схем и электрически соединенный по меньшей мере с одной из схем (1, 2), отличающаяся тем, что подложка полупроводниковой интегральной схемы имеет по меньшей мере один датчик защиты (SS), который выполнен с возможностью сохранения некоторого состояния энергонезависимым образом, при этом датчик защиты (SS) своим выводом обнаружения связан с проводящим защитным слоем (SL) или по меньшей мере с одним из проводящих защитных слоев, а выходной вывод датчика защиты (SS) соединен по меньшей мере с одной из схем (2) таким образом, что функционирование схемы в соответствии с ее назначением невозможно, если на выходе датчика защиты приложен определенный энергонезависимый уровень.
2. Полупроводниковая интегральная схема по п. 1, отличающаяся тем, что датчик защиты (SS) соединен по меньшей мере с одним транзистором (T1, T2), выполненным с очень тонким слоем подзатворного оксида по сравнению с соответствующими слоями транзисторов схем, причем вывод затвора упомянутого транзистора (Т1, Т2) соединен с проводящим слоем (SL).
3. Полупроводниковая интегральная схема по п. 1, отличающаяся тем, что датчик защиты (SS) выполнен в виде энергонезависимой ячейки памяти, которая образована диффузионными областями истока и стока (10, И), образованными по обе стороны канальной области в полупроводниковой подложке, а также электродом затвора (12), полностью изолированным, размещенным по меньшей мере частично выше канальной области, и двумя управляющими электродами (14, 15) затвора, размещенными над изолированным электродом затвора (12), причем один из управляющих электродов затвора образует вывод обнаружения (15), а другой управляющий электрод (14) затвора и диффузионные области (10, 11) соединены со схемой уценки (AWS).
4. Полупроводниковая интегральная схема по п. 3, отличающаяся тем, что изолированный электрод затвора (12) предварительно заряжен положительным или отрицательным зарядом.
5. Полупроводниковая интегральная схема по п. 4, отличающаяся тем, что при использовании множества датчиков защиты различные изолированные электроды затвора (12) предварительно заряжены различными зарядами.
6. Полупроводниковая интегральная схема по любому из пп. 1-5, отличающаяся тем, что по меньшей мере одна из схем содержит по меньшей мере одну схему обнаружения (КОМ), которая соединена с выходным выводом датчика защиты (SS).
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
EP98115550.0 | 1998-08-18 | ||
EP98115550 | 1998-08-18 |
Publications (2)
Publication Number | Publication Date |
---|---|
RU2001107134A RU2001107134A (ru) | 2003-05-20 |
RU2213390C2 true RU2213390C2 (ru) | 2003-09-27 |
Family
ID=8232478
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
RU2001107134/28A RU2213390C2 (ru) | 1998-08-18 | 1999-08-18 | Полупроводниковая интегральная схема с защитным покрытием поверхности |
Country Status (11)
Country | Link |
---|---|
US (1) | US6452283B2 (ru) |
EP (1) | EP1114460B1 (ru) |
JP (1) | JP2002523901A (ru) |
KR (1) | KR100396064B1 (ru) |
CN (1) | CN1158706C (ru) |
AT (1) | ATE376255T1 (ru) |
BR (1) | BR9913054A (ru) |
DE (1) | DE59914529D1 (ru) |
RU (1) | RU2213390C2 (ru) |
UA (1) | UA55555C2 (ru) |
WO (1) | WO2000011719A1 (ru) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2481652C1 (ru) * | 2009-02-13 | 2013-05-10 | Эппл Инк. | Интегральная схема с многопортовой суперячейкой памяти и схемой коммутации маршрута передачи данных |
Families Citing this family (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE10058078C1 (de) * | 2000-11-23 | 2002-04-11 | Infineon Technologies Ag | Integrierte Schaltungsanordnung mit Analysierschutz und Verfahren zur Herstellung der Anordnung |
DE10060652C1 (de) * | 2000-12-06 | 2002-06-20 | Infineon Technologies Ag | Schaltungsanordnung für die Anzeige eines Angriffes auf ein elektronisches Bauelement bzw. eine elektronische Schaltung durch Unbefugte |
DE10101281C1 (de) * | 2001-01-12 | 2002-06-06 | Infineon Technologies Ag | Schutzschaltung gegen die Möglichkeit des Ausspionierens von Daten bzw. Informationen |
DE10111027C1 (de) * | 2001-03-07 | 2002-08-08 | Infineon Technologies Ag | Schaltung für FIB-Sensor |
US6459629B1 (en) * | 2001-05-03 | 2002-10-01 | Hrl Laboratories, Llc | Memory with a bit line block and/or a word line block for preventing reverse engineering |
KR20050084333A (ko) * | 2002-12-18 | 2005-08-26 | 코닌클리즈케 필립스 일렉트로닉스 엔.브이. | 자기 메모리 셀의 어레이, 집적 회로 및 외부 자기장 노출여부 표시 방법 |
JP2006228910A (ja) * | 2005-02-16 | 2006-08-31 | Matsushita Electric Ind Co Ltd | 半導体装置 |
FR2888975B1 (fr) * | 2005-07-21 | 2007-09-07 | Atmel Corp | Procede de securisation pour la protection de donnees |
US7923830B2 (en) * | 2007-04-13 | 2011-04-12 | Maxim Integrated Products, Inc. | Package-on-package secure module having anti-tamper mesh in the substrate of the upper package |
DE102007051788A1 (de) | 2007-10-30 | 2009-05-14 | Giesecke & Devrient Gmbh | Halbleiterchip mit einer Schutzschicht und Verfahren zum Betrieb eines Halbleiterchip |
DE102012200168A1 (de) * | 2012-01-06 | 2013-07-11 | Technische Universität Berlin | Ladungsmesseinrichtung |
CN105891651B (zh) * | 2015-01-16 | 2019-12-10 | 恩智浦美国有限公司 | 低功率开路检测*** |
Family Cites Families (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3480247D1 (en) * | 1984-07-31 | 1989-11-23 | Siemens Ag | Monolithic integrated semiconductor circuit |
US4593384A (en) * | 1984-12-21 | 1986-06-03 | Ncr Corporation | Security device for the secure storage of sensitive data |
FR2617979B1 (fr) * | 1987-07-10 | 1989-11-10 | Thomson Semiconducteurs | Dispositif de detection de la depassivation d'un circuit integre |
US4933898A (en) * | 1989-01-12 | 1990-06-12 | General Instrument Corporation | Secure integrated circuit chip with conductive shield |
DE4018688C2 (de) * | 1990-06-11 | 1998-07-02 | Siemens Ag | Verfahren zum Schutz einer integrierten Schaltung gegen das Auslesen sensitiver Daten |
US6782479B1 (en) * | 1991-04-26 | 2004-08-24 | Raytheon Company | Apparatus and method for inhibiting analysis of a secure circuit |
US5389738A (en) * | 1992-05-04 | 1995-02-14 | Motorola, Inc. | Tamperproof arrangement for an integrated circuit device |
GB2288048A (en) * | 1994-03-29 | 1995-10-04 | Winbond Electronics Corp | Intergrated circuit |
FR2740553B1 (fr) * | 1995-10-26 | 1997-12-05 | Sgs Thomson Microelectronics | Procede de detection de presence de passivation dans un circuit integre |
DE19639033C1 (de) * | 1996-09-23 | 1997-08-07 | Siemens Ag | Analysierschutz für einen Halbleiterchip |
KR100278661B1 (ko) * | 1998-11-13 | 2001-02-01 | 윤종용 | 비휘발성 메모리소자 및 그 제조방법 |
-
1999
- 1999-08-18 DE DE59914529T patent/DE59914529D1/de not_active Expired - Lifetime
- 1999-08-18 CN CNB998097942A patent/CN1158706C/zh not_active Expired - Lifetime
- 1999-08-18 WO PCT/EP1999/006077 patent/WO2000011719A1/de active IP Right Grant
- 1999-08-18 RU RU2001107134/28A patent/RU2213390C2/ru not_active IP Right Cessation
- 1999-08-18 UA UA2001021130A patent/UA55555C2/ru unknown
- 1999-08-18 BR BR9913054-8A patent/BR9913054A/pt not_active IP Right Cessation
- 1999-08-18 AT AT99944441T patent/ATE376255T1/de not_active IP Right Cessation
- 1999-08-18 KR KR10-2001-7002064A patent/KR100396064B1/ko not_active IP Right Cessation
- 1999-08-18 EP EP99944441A patent/EP1114460B1/de not_active Expired - Lifetime
- 1999-08-18 JP JP2000566890A patent/JP2002523901A/ja active Pending
-
2001
- 2001-02-20 US US09/789,990 patent/US6452283B2/en not_active Expired - Fee Related
Non-Patent Citations (1)
Title |
---|
МЕЙЗДА Ф. ИНТЕГРАЛЬНЫЕ СХЕМЫ ТЕХНОЛОГИЯ И ПРИМЕНЕНИЯ. - М.: МИР, 1981. * |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2481652C1 (ru) * | 2009-02-13 | 2013-05-10 | Эппл Инк. | Интегральная схема с многопортовой суперячейкой памяти и схемой коммутации маршрута передачи данных |
Also Published As
Publication number | Publication date |
---|---|
BR9913054A (pt) | 2001-05-08 |
JP2002523901A (ja) | 2002-07-30 |
CN1158706C (zh) | 2004-07-21 |
US6452283B2 (en) | 2002-09-17 |
EP1114460B1 (de) | 2007-10-17 |
UA55555C2 (ru) | 2003-04-15 |
WO2000011719A1 (de) | 2000-03-02 |
US20010028094A1 (en) | 2001-10-11 |
EP1114460A1 (de) | 2001-07-11 |
ATE376255T1 (de) | 2007-11-15 |
DE59914529D1 (de) | 2007-11-29 |
KR20010072743A (ko) | 2001-07-31 |
CN1314005A (zh) | 2001-09-19 |
KR100396064B1 (ko) | 2003-08-27 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
RU2213390C2 (ru) | Полупроводниковая интегральная схема с защитным покрытием поверхности | |
KR910008103B1 (ko) | 박막 산화물 퓨우즈 | |
US5442589A (en) | Fuse circuitry having physical fuse and non-volatile memory cell coupled to a detector | |
CN1799130A (zh) | 熔丝及其形成方法 | |
KR100866960B1 (ko) | 반도체 집적 회로 | |
NL8800846A (nl) | Geintegreerde schakeling met een programmeerbare cel. | |
US5109257A (en) | Testing circuit for semiconductor memory array | |
US20120199943A1 (en) | Semiconductor device including antifuse element | |
JP3001454B2 (ja) | 半導体装置 | |
EP0874401B1 (en) | Semiconductor device having a protective wiring layer | |
US6964378B2 (en) | Circuit for a focused ion beam (FIB) sensor | |
JP3868906B2 (ja) | 半導体素子を用いた時間検出装置および時間検出方法 | |
JPH11306786A (ja) | 自己破壊型半導体装置 | |
US6391665B1 (en) | Method of monitoring a source contact in a flash memory | |
EP0890956B1 (en) | Semiconductor device having a security circuit for preventing illegal access | |
US11329011B2 (en) | Method for protecting an integrated circuit, and corresponding device | |
US11387194B2 (en) | Method for detecting an attempt to breach the integrity of a semiconductor substrate of an integrated circuit from its back face, and corresponding integrated circuit | |
JP3728389B2 (ja) | 表面カバーを備えた半導体チップ | |
MXPA01001738A (en) | Semiconductor chip with surface coating | |
US5233563A (en) | Memory security device | |
KR100226492B1 (ko) | 메모리 반도체의 리페어용 퓨즈 및 그에 따른 장치 | |
KR100317497B1 (ko) | 플래쉬 메모리 소자의 테스트 패턴 및 테스트 방법 | |
US20040027877A1 (en) | Method for setting the threshold voltage of a field-effect transistor, field-effect transistor and integrated circuit | |
KR100206718B1 (ko) | 단일 다결정 실리콘으로 형성된 불휘발성 반도체 메모리 쎌 | |
US20090250737A1 (en) | Secure memory device of the one-time programmable type |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
MM4A | The patent is invalid due to non-payment of fees |
Effective date: 20130819 |