KR960026450A - 반도체 소자의 mosfet 제조 방법 - Google Patents

반도체 소자의 mosfet 제조 방법 Download PDF

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Abstract

본 발명은 반도체 기판위에 서로 식각선택성이 있는 제1패턴과 제2패턴을 순차적으로 형성시키고, 제2패턴과 제1패턴의 소정부분을 식각하여 트랜치를 형성시킬 반도체 기판을 일부 노출시킨 후, 식각된 제2패턴과 제1패턴을 마스크로 반도체 기판을 식각하여 경사가 완만한 트랜치를 형성시키면서, 이온주입을 실시하여 반도체 기판 내부의 트랜치 하부에 기판과 동일도전형이 고농도 이온층을 형성시키고, 제2패턴과 상기 제1패턴을 순차적으로 제거한 후, 트랜치에 게이트 산화막과 게이트를 형성시킨 다음, 게이트 양측에 소스드레인영역을 형성시켜서 반도체 소자의 MOSFET를 제조함을 요지로 한다. 이렇게 형성시킨 MOSFET는 게이트의 면적에 비하여 긴채널을 형성시키므로서, 게이트의 트랜치 형태가 완만한 경사를 가지도록 하여 종래 트랜치 트랜지스터에서 발생한 게이트 모서리에서의 과도한 필드를 감소시켜 트랜지스터의 신뢰도를 향상시키면서, 전체 칩에서 장채널 트랜지스터가 차지하는 면적을 줄일 수 있는 것이 특징이다.

Description

반도체 소자의 MOSFET 제조 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 반도체 소자의 MOSFET 제조 방법의 각 단계를 설명한 도면.

Claims (3)

  1. 반도체 소자의 MOSFET 제조방법에 있어서, 1) 반도체 기판위에 반도체 기판과 제2물질층에 대하여식각선택성이 있는 물질로 제1물질층을 형성시키고, 상기 제1물질층에 대하여 식각선택성이 있는 물질로 제2물질층을 형성시키는 단계와, 2) 상기 반도체 기판에 형성시킨 상기 제2물질층의 소정부분을 제거하여 상기 제1물질층의 일부를 노출시키는 제2패턴을 형성한 후, 상기 제2패턴을 마스크로 상기 제1물질층을 등방성 식각하여 반도체 기판을 일부 노출시키는 제1패턴을 형성시킨 단계와, 3) 상기 제2패턴과 제1패턴을 마스크로 하여 반도체 기판을 등방성 식각하여 경사가 완만한 트랜치를 형성시키는 단계와, 4) 상기 제1패턴과 제2패턴을 마스크로 상기 반도체 기판 전면에 이온주입을 실시하여 상기 반도체 기판 내부의 상기 트랜치 하부에 기판과 동일도전형의 고농도 이온층을 형성시키는 단계와, 5) 상기 기판 상에 형성시킨 제2패턴과 상기 제1패턴을 순차적으로 제거한 후, 상기 트랜치에 게이트 산화막과 게이트를 형성시키는 단계와, 6) 상기 게이트의 양측에 소스드레인영역을 형성시키는 단계를 포함하여 이루어지는 반도체 소자의 MOSFET 제조 방법.
  2. 제1항에 있어서, 상기 1) 단계의 제1물질층과 제2물질층을 각각 산화막과 질화막으로 형성시키는 것을 특징으로 하는 반도체 소자의 MOSFET 제조 방법.
  3. 제1항에 있어서, 상기 2) 단계의 상기 제2패턴을 마스크로 상기 제1물질층을 식각함에 있어서, 상기 트랜치의 경사도를 조절하기 위하여 상기 제2패턴 하부로 측면식각하여 소정 측면깊이까지 제1물질층을 식각시켜 제1패턴을 형성시키는 것을 특징으로 하는 반도체 소자의 MOSFET 제조 방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940034295A 1994-12-15 1994-12-15 반도체소자의mosfet제조방법 KR100312940B1 (ko)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100372638B1 (ko) * 1999-11-22 2003-02-17 주식회사 하이닉스반도체 전계효과 트랜지스터 제조방법
KR100487633B1 (ko) * 1997-11-28 2005-07-07 주식회사 하이닉스반도체 반도체소자의 제조방법

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