KR950004467A - 반도체장치 및 그 제조방법 - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 75
- 238000004519 manufacturing process Methods 0.000 title claims abstract 18
- 239000012790 adhesive layer Substances 0.000 claims abstract 11
- 239000002184 metal Substances 0.000 claims description 17
- 238000007789 sealing Methods 0.000 claims description 8
- 239000011347 resin Substances 0.000 claims 6
- 229920005989 resin Polymers 0.000 claims 6
- 239000011888 foil Substances 0.000 claims 4
- 238000000034 method Methods 0.000 claims 2
- 238000000465 moulding Methods 0.000 claims 2
- 238000009413 insulation Methods 0.000 claims 1
- 239000010410 layer Substances 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
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- H—ELECTRICITY
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- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
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- H01L21/60—Attaching or detaching leads or other conductive members, to be used for carrying current to or from the device in operation
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/50—Tape automated bonding [TAB] connectors, i.e. film carriers; Manufacturing methods related thereto
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- H—ELECTRICITY
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/86—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using tape automated bonding [TAB]
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01004—Beryllium [Be]
-
- H—ELECTRICITY
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01005—Boron [B]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01006—Carbon [C]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01029—Copper [Cu]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01033—Arsenic [As]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01078—Platinum [Pt]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01079—Gold [Au]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01082—Lead [Pb]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/14—Integrated circuits
-
- H—ELECTRICITY
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/181—Encapsulation
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
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- Y10T29/00—Metal working
- Y10T29/49—Method of mechanical manufacture
- Y10T29/49002—Electrical device making
- Y10T29/49117—Conductor or circuit manufacturing
- Y10T29/49121—Beam lead frame or beam lead device
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- General Physics & Mathematics (AREA)
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Abstract
본 발명은 TCP방식의 반도체장치 및 그 제조방법에 있어서, 캐리어 테이프의 평탄성을 유지할 수 있고, 프린트회로기판상으로의 실장을 안정화할 수 있도록 하는 것을 가장 중요한 특징으로 한다.
예컨대, 반도체칩(10)상의 각 전극패드(11)와, 캐리어 테이프(20)의 각 리드(22)의 내부리드부(22a)를 접속전극(30)을 매개로 접합한다. 이 후, 캐리어 테이프(20)의 절연필름(21)을 접착층(40)을 매개로 반도체칩(10)의 표면에 접착한다. 이와 같이 접합의 안정화를 도모함과 더불어 반도체칩(10)의 표면의 평탄도를 이용해서 캐리어 테이프(20)의 평탄성을 확보함으로써 외부리드부(2B)의 평탄성이 손상되는 것을 경감하여 일괄 리플로우 실장에 있어서 실장성의 향상을 도모하는 구성으로 되어 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 1실시예에 따른 TCP방식의 반도체장치를 개략적으로 나타낸 구성도, 제2도는 마찬가지로 제1도에 나타낸 제1실시예 장치에서 이용되는 캐리어 테이프의 평면도, 제3도는 마찬가지로 제1도에 나타낸 제1실시예 장치에 금속체를 설치한 경우를 예로 나타낸 구성도, 제4도는 마찬가지로 제1도에 나타낸 제1실시예 장치의 다른 밀봉예를 나타낸 구성도, 제5도는 마찬가지로 제1도에 나타낸 제1실시예 장치의 다른 ILB의 처리예를 나타낸 구성도.
Claims (40)
- 반도체칩이 탑재되는 리드프레임의 칩전극과의 비접속부를 상기 반도체칩의 표면에 고착하여 이루어진 것을 특징으로 하는 반도체장치.
- 표면에 전극이 설치된 반도체칩과, 리드프레임, 이 리드프레임과 상기 반도체칩의 전극을 전기적으로 접속하는 접속부재 및, 상기 리드프레임의 상기 반도체침과의 비접속부를 상기 반도체칩의 표면에 고착하는 고착부재를 구비하여 이루어진 것을 특징으로 하는 반도체장치.
- 제2항에 있어서, 상기 리드프레임이 절연필름과 이 절연필름상에 접착층을 매개로 설치된 금속박에 의해 형성된 배선패턴으로 이루어진 것을 특징으로 하는 반도체장치.
- 제3항에 있어서, 상기 절연필름이 상기 비접속부로서 상기 고착부재에 의해 상기 반도체칩의 표면에 고착되는 것을 특징으로 하는 반도체장치.
- 제3항에 있어서, 상기 배선패턴이 상기 비접속부로서 상기 고착부재에 의해 상기 반도체칩의 표면에 고착되는 것을 특징으로 하는 반도체장치.
- 제2항에 있어서, 상기 리드프레임이 금속박에 의해 형성된 배선패턴으로 이루어진 것을 특징으로 하는 반도체장치.
- 표면의 중앙부에 전극이 설치된 반도체칩과, 이 반도체칩 보다도 작은 개구를 갖춘 절연필름, 이 절연필름의 상면 또는 아래면의 한쪽에 형성되면서 상기 반도체칩의 전극과 접속되는 내부리드부 및 이 내부리드부로부터 연장된 외부리드부를 갖춘 리드로 형성되는 배선패턴, 이 배선패턴의 상기 리드의 내부리드부와 상기 반도체칩의 전극을 상기 절연필름의 개구내에서 전기적으로 접속하는 접속전극 및, 상기 절연필름 또는 상기 배선패턴의 상기 절연필름의 아래면에 형성된 리드를 상기 반도체칩의 표면에 접착하는 접착제층을 구비하여 이루어진 것을 특징으로 하는 반도체장치.
- 제7항에 있어서, 상기 반도체칩의 상면에는 다시 절연 밀봉체가 설치되는 것을 특징으로 하는 반도체장치.
- 제8항에 있어서, 상기 절연밀봉체가 수지로 이루어지고, 상기 절연필름의 개구를 덮도록 설치되는 것을 특징으로 하는 반도체장치.
- 제7항에 있어서, 상기 절연밀봉체가 수지이고, 상기 절연필름의 개구내에만 설치되는 것을 특징으로 하는 반도체장치.
- 제7항에 있어서, 상기 배선패턴의 상기 절연필름의 아래면에 형성된 리드가 상기 접착제층중에 매설되는 것을 특징으로 하는 반도체장치.
- 제7항에 있어서, 상기 절연필름의 형성된 상기 배선패턴의 리드에는 다시 금속체가 설치되는 것을 특징으로 하는 반도체장치.
- 제12항에 있어서, 상기 금속체가 상기 절연필름의 상면에 형성된 상기 배선패턴의 리드상에 설치되는 것을 특징으로 하는 반도체장치.
- 제13항에 있어서, 상기 절연필름의 상면에 형성된 상기 배선패턴의 리드상에 설치되는 상기 금속체가 상기 반도체칩과 동일한 크기이면서 중앙부가 4각으로 파여진 틀상으로 형성된 것을 특징으로 하는 반도체 장치.
- 제12항에 있어서, 상기 금속체가 상기 절연필름의 아래면에 형성된 상기 배선패턴의 리드 아래에 설치되는 것을 특징으로 하는 반도체장치.
- 제15항에 있어서, 상기 절연필름의 아래면에 형성된 상기 배선패턴의 리드 아래에 설치되는 상기 금속체는 그 두께가 상기 배선패턴의 리드의 성형후의 외부리드부의 길이내로 수납되는 것을 특징으로 하는 반도체장치.
- 제15항에 있어서, 상기 절연필름의 아래면에 형성된 상기 배선패턴의 리드 아래에 설치되는 상기 금속체는 그 두께가 상기 반도체칩의 두께와 동일한 것을 특징으로 하는 반도체장치.
- 표면에 전극이 설치된 반도체칩과, 이 반도체칩의 전극과 접속되는 내부리드부 및 이 내부리드부로부터 연장된 외부리드부를 갖춘 리드로 형성되는 배선패턴, 이 배선패턴의 상기 리드의 내부리드부와 상기 반도체칩의 전극을 전기적으로 접속하는 접속전극 및, 상기 배선패턴의 리드를 상기 반도체칩의 표면에 접착하는 접착제층을 구비하여 이루어진 것을 특징으로 하는 반도체장치.
- 제18항에 있어서, 상기 반도체칩의 상면에는 수지로 이루어진 절연밀봉체가 더 설치되는 것을 특징으로 하는 반도체장치.
- 제18항에 있어서, 상기 배선패턴의 리드가 상기 접착제층중에 매설되는 것을 특징으로 하는 반도체장치.
- 반도체칩이 탑재된 리드프레임의 칩전극과의 비접속부를 상기 반도체칩의 표면에 고착하도록 하여 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 반도체칩의 전극과 리드프레임을 접속부재를 매개로 전기적으로 접속하고, 이 후 상기 리드프레임의 상기 반도체칩의 전극과의 비접속부를 상기 반도체칩의 표면에 고착부재에 의해 고착하도록 하여 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제22항에 있어서, 상기 리드프레임이 절연필름과 이 절연필름상에 접착층을 매개로 설치된 금속박에 의해 형성된 배선패턴으로 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제23항에 있어서, 상기 절연필름이 상기 비접속부로서의 상기 고착부재에 의해 상기 반도체칩의 표면에 고착되어 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제23항에 있어서, 상기 배선패턴이 상기 비접속부로서의 상기 고착부재에 의해 상기 반도체칩의 표면에 고착되어 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제22항에 있어서, 상기 리드프레임이 금속박에 의해 형성된 배선패턴으로 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 반도체칩의 표면의 중앙부에 설치된 전극과, 절연필름의 상면 또는 아래면에 형성되면서 내부리드부 및 외부리드부를 갖춘 리드로 형성되는 배선패턴의 상기 내부리드부를 접속전극을 매개로 열압착에 의해 전기적으로 접속하고, 이 후 상기 절연필름 또는 상기 배선패턴의 상기 절연필름의 아래면에 형성된 리드를 상기 반도체칩의 표면에 접착체층에 의해 접착하도록 하여 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제27항에 있어서, 상기 반도체칩의 상면에는 다시 절연밀봉체가 설치되어 있는 것을 특징으로 하는 반도체장치의 제조방법.
- 제28항에 있어서, 상기 절연밀봉체가 수지로 이루어지고, 상기 절연필름의 개구를 덮도록 하여 설치되어 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제28항에 있어서, 상기 절연밀봉체가 수지로 이루어지고, 상기 절연필름의 개구내에만 설치되어 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제27항에 있어서, 상기 배선패턴의 상기 절연필름의 아래면에 형성된 리드가 상기 접착제층중에 매설되어 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제27항에 있어서, 상기 절연필름에 형성된 상기 배선패턴의 리드에는 다시 금속체가 설치되어 있는 것을 특징으로 하는 반도체장치의 제조방법.
- 제32항에 있어서, 상기 금속체가 상기 절연필름의 상면에 형성된 상기 배선패턴의 리드상에 설치되어 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제33항에 있어서, 상기 절연필름의 상면에 형성된 상기 배선패턴의 리드상에 설치되는 상기 금속체가 상기 반도체칩과 동일한 크기이면서 중앙부가 4각으로 파여진 틀상으로 형성되어 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제32항에 있어서, 상기 금속체가 상기 절연필름의 아래면에 형성된 상기 배선패턴의 리드 아래에 설치되어 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제35항에 있어서, 상기 절연필름의 아래면에 형성된 상기 배선패턴의 리드 아래에 설치되는 상기 금속체는 그 두께가 상기 배선패턴의 리드의 성형후의 외부리드부의 길이내에 수납되는 것을 특징으로 하는 반도체장치의 제조방법.
- 제35항에 있어서, 상기 절연필름의 아래면에 형성된 상기 배선패턴의 리드 아래에 설치되는 상기 금속체는 그 두께가 상기 반도체칩의 두께와 동일한 것을 특징으로 하는 반도체장치의 제조방법.
- 반도체칩의 표면에 설치된 전극과, 내부리드부 및 외부리드부를 갖춘 리드로 형성되는 배선패턴의 상기 내부리드부를 접속전극을 매개로 열압착에 의해 전기적으로 접속하고, 이후 상기 배선패턴의 리드를 상기 반도체칩의 표면에 접착제층에 의해 접착하도록 하여 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제38항에 있어서, 상기 반도체칩의 상면에는 수지로 이루어진 절연밀봉체가 더 설치되어 이루어진 것을 특징으로 하는 반도체장치의 제조방법.
- 제38항에 있어서, 상기 배선패턴의 리드가 상기 접착제층중에 매설되는 것을 특징으로 하는 반도체장치의 제조방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18798193 | 1993-07-29 | ||
JP93-187981 | 1993-07-29 | ||
JP14035294A JP3238004B2 (ja) | 1993-07-29 | 1994-06-22 | 半導体装置の製造方法 |
JP94-140352 | 1994-06-22 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR950004467A true KR950004467A (ko) | 1995-02-18 |
KR0169274B1 KR0169274B1 (ko) | 1999-02-01 |
Family
ID=26472896
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019940018446A KR0169274B1 (ko) | 1993-07-29 | 1994-07-28 | 반도체장치 및 그 제조방법 |
Country Status (3)
Country | Link |
---|---|
US (1) | US5612259A (ko) |
JP (1) | JP3238004B2 (ko) |
KR (1) | KR0169274B1 (ko) |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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-
1994
- 1994-06-22 JP JP14035294A patent/JP3238004B2/ja not_active Expired - Fee Related
- 1994-07-28 KR KR1019940018446A patent/KR0169274B1/ko not_active IP Right Cessation
-
1995
- 1995-07-16 US US08/500,066 patent/US5612259A/en not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
US5612259A (en) | 1997-03-18 |
KR0169274B1 (ko) | 1999-02-01 |
JP3238004B2 (ja) | 2001-12-10 |
JPH0794553A (ja) | 1995-04-07 |
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Legal Events
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GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
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