KR910016202A - 디지탈 신호처리 장치 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 1실시예에 의한 디지탈 신호처리 장치의 구성을 도시한 블럭도, 제3도는 본 발명의 1실시예에 의한 화상부호화 시스템을 도시한 블럭도.
Claims (5)
- 내장된 마이크로 프로그램의 페치, 디코드, 상기 마이크로 프로그램의 내용에 따른 데이타의 리드, 연산 및 연산결과 데이타의 라이트를 기본동작으로 하는 디지탈 신호처리장치에 있어서, 상기 연산결과 데이타를 직접입력하고, 상기 연산 결과 데이타를 상기 마이크로 프로그램에 의해 임의로 지정된 유효비트수로 리미트 처리하는 리미트 처리부(8)을 구비한 것을 특징으로 하는 디지탈 신호처리 장치.
- 입력데이타의 전체 화소를 대상으로 하는 부호화 처리를 담당하고, 처리량에 맞추어서 병렬방향으로 확장 가능한 여러개의 프로세서(12)를 마련하고, 블럭 데이타에 유효, 무효 블럭정보 및 프레임내의 위치정보를 부가하는 기능을 갖는 전단 멀티프로세서(15), 상기 입력 데이타의 유효블럭만 부호화 대상으로 하는 처리를 담당하고, 처리량에 맞추어서 병렬방향으로 확장가능한 여러개의 프로세서(12)를 마련하고, 상기 블럭데이타에 부가된 상기 유효, 무효 블럭정보에 의해 유효블럭을 식별하는 기능 및 상기 블럭데이타에 부가된 상기 위치정보에 따라서 프레임을 재구성하는 기능을 갖는 후단 멀티프로세서(16), 상기 전단 멀티 프로세서와 상기 후단 멀티 프로세서 사이에 있고, 상기 전단 멀티 프로세서에서 출력되는 부호화 데이타르 기억함과 동시에 상기 전단 멀티프로세서와 상기 후단 멀티프로세서의 처리시간차를 완충하는 버퍼(17), 상기 전단 멀티프로세서의 상기 부호화 테이타의 발생량을 제어하는 임계값을 조정해서 상기 전단 멀티 프로세서의 부호화 데이타 발생량을 일정하게 제한함과 동시에 상기 버퍼의 데이타 측적량에 따라서 상기 유효블럭수를 변화시켜서 상기 후단 멀티프로세서의 처리량을 일장하게 유지하는 출력제어부(18)을 구비한 부호화 시스템.
- 시계열적으로 순차 입력되는 여러개의 프레임으로 되는 디지탈 화상 데이타의 현재의 입력 프레임을 여러개의 블럭으로 부할하고, 또 현재의 입력 프레임의 화상데이타의 각 블럭에 대하여 전회의 입력 프레임의 부호화 재생데이타중의 블럭과의 사이에서 패턴간의 근사를 계산함과 동시에 최소왜곡을 부여하는 블럭과 움직임 백터를 검출하는 움직임 보상부(35)를 구비하고, 상기 움직임 보상부에 의해 구해진 최소 왜곡블럭을 예측신호(36)으로 해서 부호와 전송처리를 실행하는 프레임간 부호화장치에서의 움직임 보상방식에 있어서, 상기 재생데이타를 상기 입력블럭을 균등하게 분할할 수 있는 크기의 작은 블럭으로 분할하고, 상기 작은 블럭내의 화소의 평균값 또는 특정위치의 화소값을 샘플로서 추출하는 샘플링회로, 상기 샘플링회로가 추출하는 샘플값을 적어도 1프레임분 기억하는 샘플데이타 메모리를 구비하고, 상기 움직임 보상부(35)는 상기 샘플링회로와 마찬가지로 상기 입력 블럭에 대하여 각 작은 블럭마다의 평균값 또는 특정 화소값으로 되는 샘플데이타 패턴을 구하고, 상기 움직임 벡터를 검출할 때 상기 프레임 데이타중에 상기 입력블럭과 동일한 위치를 중심으로 해서 상기 작은 블럭의 크기의 배수로 되는 위치에 제1의 탐색움직임 백터군을 배치하고, 이들의 움직임 벡터를 나타내는 위치의 블럭내의 샘플데이타 패턴을 상기 샘플데이타 메모리에서 리드해서 상기 입력블럭의 샘플데이타 패턴과의 사이에서 패턴유사도를 나타내는 왜곡량을 산출하고, 상기 왜곡량중에서 최소왜곡을 부여하는 제1의 탐색움직임 벡터를 검출하고, 상기 제1의 탐색움직임 벡터를 중심으로 해서 높은 밀도로 제2의 탐색움직임 벡터군을 배치하고, 제2의 탐색움직임 벡터군에 따라서 상기 재생프레임중의 블럭내의 화소패턴과 상기 입력블럭내의 화소패턴 사이에서 상기 왜곡량을 산출하고, 상기 왜곡량중에서 최소왜곡을 부여하는 블럭 및 그 움직임 벡터를 검출하고, 상기의 결과를 최종적임 예측신호 및 움직임 벡터로서 출력하는 것을 특징으로 하는 프레임간 부호화 장치에서의 움직임 보상방식.
- 화상데이타를 부호화하는 n개의 부호화처리부(69)를 병렬로 배치한 화상부호화 장치에 있어서, 화상데이타(66)을 1프레임마다 n개로 서브샘플해서 얻어진 데이타에 의해, 또 순차로 헤더를 부가해서 전송되는 서브샘플화상 데이타를 1프레임분 입력하고, 상기 입력된 n개의 서브샘플 화상 데이타를 상기 n개 부호화 처리부(69)에서 각각 부호화하고, m개의 부호화 처리부를 병렬로 배치한 수신측 장치의 해상데이타를 합성하고, 상기 합성된 부호화 상태데이타(72)의 전부 또는 적당하게 선택한 부호화 화상데이타를 합성하고, 상기 합성된 부호화 화상데이타를 다시m개로 서브샘플하고 순차로 헤더를 부가해서 전송하는 화상 부호화 전송장치.
- 타게트 기계의 프로세서를 탑재한 디버그 모듈을 거쳐서 계산기 시스템의 지시에 의해 상기 타게트 기계를 기동, 정지시키고, 상기 타게트 기계에 관한 정보를 상기 디버그 모듈에서 상기 계산기 시스템으로 전송하고, 상기 정보를 상기 계산기 시스템의 표시장치에 표시시켜서 상기 타게트 기계의 디버그를 제어하는 디버그 장치의 제어방법에 있어서, 1개 또는 여러개의 상기 타게트 기계(93∼95)를 상기 디버그 모듈(83∼85)를 거쳐서 상기 계산기 시스템(79)에 접속하고, 상기 타게트 기계의 구동 및 응용 프로그램의 처리를 상기 계산기 시스템에 의해 동시에 제어하고, 상기 1개 또는 여러개의 타게트 기계에 관한 정보에 대응한 1개 또는 여러개의 소화면(75∼77)및 상기 응용 프로그램의 처리에 대응한 1개 또는 여러개(78)의 소화면을 동시에 상기 계산기 시스템의 표시장치(80)의 표시화면(201)에 표시하고, 상기 표시되어 있는 소화면을 사용해서 동시에, 또는 개별적으로 상기 정보를 검사해서 디버그를 제어하는 것을 특징으로 하는 디버그장치의 제어방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (9)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1-45632 | 1989-02-27 | ||
JP1045632A JPH02224468A (ja) | 1989-02-27 | 1989-02-27 | 画像符号化システム |
JP1-50101 | 1989-03-03 | ||
JP1-81851 | 1989-03-31 | ||
JP8185189A JP3046313B2 (ja) | 1989-03-31 | 1989-03-31 | フレーム間符号化装置における動き補償方式 |
JP1-132646 | 1989-05-29 | ||
JP1132648A JPH02312415A (ja) | 1989-05-29 | 1989-05-29 | 簡易フェージング発生器 |
JP1268406A JPH03129522A (ja) | 1989-10-16 | 1989-10-16 | ディジタル信号処理装置 |
JP1-268406 | 1989-10-16 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR910016202A true KR910016202A (ko) | 1991-09-30 |
KR920010514B1 KR920010514B1 (ko) | 1992-11-30 |
Family
ID=27461746
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019900002425A KR920010514B1 (ko) | 1989-02-27 | 1990-02-26 | 디지탈 신호처리장치 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR920010514B1 (ko) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100467375B1 (ko) * | 1995-08-30 | 2005-06-08 | 소니 가부시끼 가이샤 | 화상신호처리장치및기록/재생장치 |
KR100694078B1 (ko) * | 2004-12-29 | 2007-03-12 | 삼성전자주식회사 | 메모리 장치 및 그 데이터 전송 방법 |
-
1990
- 1990-02-26 KR KR1019900002425A patent/KR920010514B1/ko not_active IP Right Cessation
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100467375B1 (ko) * | 1995-08-30 | 2005-06-08 | 소니 가부시끼 가이샤 | 화상신호처리장치및기록/재생장치 |
KR100694078B1 (ko) * | 2004-12-29 | 2007-03-12 | 삼성전자주식회사 | 메모리 장치 및 그 데이터 전송 방법 |
Also Published As
Publication number | Publication date |
---|---|
KR920010514B1 (ko) | 1992-11-30 |
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