KR900015474A - 디지탈 데이타 팽창 방법 및 데이타 팽창 회로 - Google Patents

디지탈 데이타 팽창 방법 및 데이타 팽창 회로 Download PDF

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KR900015474A
KR900015474A KR1019900002606A KR900002606A KR900015474A KR 900015474 A KR900015474 A KR 900015474A KR 1019900002606 A KR1019900002606 A KR 1019900002606A KR 900002606 A KR900002606 A KR 900002606A KR 900015474 A KR900015474 A KR 900015474A
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KR1019900002606A
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Inventor
다니엘 소나드 진
Original Assignee
에이취.이봇슨
모토로라 인코포레이티드
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Publication date
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M7/00—Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M7/00—Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
    • H03M7/30—Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
    • H03M7/50—Conversion to or from non-linear codes, e.g. companding

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  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Compression, Expansion, Code Conversion, And Decoders (AREA)
  • Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)

Abstract

내용 없음.

Description

디지털 데이타 팽창 방법 및 데이타 팽창 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 제1도의 인터페이스 회로의 데이타 팽창 회로를 나타낸 도식도.

Claims (10)

  1. 사인 비트, n비트에 의해 한정된 세그먼트 및 m비트에 의해 한정된 간격을 포함하고 있는 데이타를 수신하는 단계와; 세그먼트 디코더 수단에서 상기의 세그먼트를 디코딩함으로써 그에 의존하여 신호를 발생시키는 단계와; 세그먼트 디코더로부터 상기 신호에 따라 종속되고 데이타 팽창 법칙에 따른 제1비트 위치에서 m간격비트를 포함하고 있는 팽창된 데이타 시퀀스를 발생시키는 단계와; 팽창된 데이타 사퀀스가 네가티브인지의 여부를 결정하고, 상기 결정에 응답하여 상기 팽창된 데이타 시퀀스의 역수를 발생시키는 단계와; 팽창된 데이타 시퀀스를 출력시키는 단계를 포함하고 있는 디지털 데이타 팽창 방법에 있어서, 상기 사인 비트의 역수를 발생시키는 단계와; 상기 제1비트 위치보다 하위인 제2비트 위치에서의 반전된 사인 비트를 도입시킴으로써 결과로 팽창된 데이타 시퀀스를 발생시키는 단계에 의해 특징지어지는 디지털 데이타 팽창 방법.
  2. 제1항에 있어서, 제2비트 위치보다 하위인 하나 이상의 제3비트 위치에 사인 비트를 도입시키는 것을 특징으로 하는 디지털 데이타 팽창 방법.
  3. 제1항에 있어서, 상기의 데이타 팽창 법칙이 A법칙인 디지털 데이타 팽창 방법.
  4. 제1항에 있어서, 상기의 데이타 팽창 법칙이 Mu법칙이고, 상기의 방법이 파생되는 팽창되어진 데이타 시쿼스로부터 33을 감산하는 추가 단계를 보유하고 있는 디지털 데이타 팽창 방법.
  5. 제3항과 제4항에 있어서, 상기의 방법이 세그먼트를 디코드시키는 단계전에 상기 데이타 팽창 법칙중 하나의 데이타 팽창 법칙을 선택하는 추가 단계를 보유하고 있는 디지털 데이타 팽창 방법.
  6. 사인 비트, n비트에 의해 한정된 세그먼트와 m비트에 의해 한정된 간격을 포함하고 있는 데이타를 팽창시키기 위한 데이타 팽창 회로로서, 상기 회로가 상기 데이타를 수신하기 위한 입력수단과; 상기 세그먼트를 디코드시켜서 종속적으로 신호를 발생시키는 세그먼트 디코더 수단과; 데이타 팽창법칙과 세그먼트 디코더로부터 상기신호에 종속하여 제1비트 위치에서 m간격 비트를 포함하고 있는 팽창된 데이타 시쿼스를 발생시키기 위한 논리어레이 수단과; 상기의 팽창된 데이타가 네가티브 인지의 여부를 결정하기 위한 결정 수단과; 네가티브 팽창된 데이타의 역수를 발생시키기 위한 데이타 반전 수단과; 상기의 팽창된 데이타 시퀀스를 출력시키기 위한 출력 수단을 포함하고 있으며, 또한 상기의 회로가 상기 사인 비트의 역수를 발생시키기 위한 반전수단과; 상기 제1비트 위치보다 하위인 제2비트 위치에서의 반전된 사인 비트를 도입시킴으로써 그 결과로 팽창된 데이타 시퀀스를 발생시키는 수단을 포함하고 있는 상기의 논리 어레이 수단에 의해 특정지어지는 테이타 팽창 회로.
  7. 제6항에 있어서, 도입 수단이 또한 제2비트 위치보다 하위인 하나 이상의 제3비트 위치에 사인 비트를 도입시키는 데이타 팽창 회로.
  8. 제6항에 있어서, 상기의 데이타 팽창 법칙이 A법칙인 데이타 팽창 회로.
  9. 제6항에 있어서, 상기의 데이타 팽창 법칙이 Mu법칙이고, 그림으로써 상기의 데이타 팽창회로가 또한 상기의 파생되어 팽창된 데이타 시퀀스로부터 33을 감산하기 위해 상기의 논리 어레이 수단을 결합된 감산 수단을 포함하고 있는 데이타 팽창 회로.
  10. 제8항과 제9항에 있어서, 상기의 데이타 팽창 회로가 또한 상기 데이타 팽창 법칙중 하나의 데이타 팽창 법칙을 선택하기 위해 스위칭 수단을 포함하고 있는 데이타 팽창 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019900002606A 1989-03-03 1990-02-28 디지탈 데이타 팽창 방법 및 데이타 팽창 회로 KR900015474A (ko)

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GB2233126A (en) 1991-01-02
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