KR900007168A - 선형 이득 증폭기 장치 - Google Patents

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KR900007168A
KR900007168A KR1019890015176A KR890015176A KR900007168A KR 900007168 A KR900007168 A KR 900007168A KR 1019890015176 A KR1019890015176 A KR 1019890015176A KR 890015176 A KR890015176 A KR 890015176A KR 900007168 A KR900007168 A KR 900007168A
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KR
South Korea
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amplifier device
gain
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current
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Application number
KR1019890015176A
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English (en)
Inventor
안토니우스 마리아 클룸페링크 에릭
세빙크 에베르트
Original Assignee
에프.제이.스미트
엔.브이.필립스 글로아이람펜파브리켄
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    • H03—ELECTRONIC CIRCUITRY
    • H03F—AMPLIFIERS
    • H03F1/00—Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
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Abstract

내용 없음

Description

선형 이득 증폭기 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1a도 및 제1b도는 이득이 직류전압에 의해서 제어될 수 있음을 본 발명에 따라 증폭기 장치의 기본 다이어그램으로 도시한 도면.
제2도는 이득이 직류전류에 의해서 제어틸 수 있음을 본 발명에 따라 중폭기 장치의 기본 다이어그램으로 도시한 도면.
제3도는 제1a도 맺 제1b도와 제2도에 도시된 장치에서 사용하기 위한 종래 기술의 전압-전류 변환기의 기본 다이어그램을 도시한 도면.

Claims (11)

  1. 제1 및 제 2전류 미러 회로를 포함하고 있는 전류 증폭셀을 포함하고, 이러한 제1 및 제 2전류 미러 회로는 각각 최소한 제1 및 제 2미분쌍을 구성하는 입력 트랜지스터와 출력 트랜지스터률 포함하고 있으며, 증폭기 장치의 이득을 제어하는 전류 증폭셀에 결합된 수단을 포함하는 선형 이득 증폭기 장치에서, 트랜지스터 모두는 전계 효과형이고, 포화영역에서 동작하도록 바이어스 되며, 입력 트랜지스터는 자승 함수에 의해 상기의 입력 전압과 관련된 차전류를 공급하도록 인가될 입력 전압에 응답하는 전압 전류 변환기에 정 속되는 것을 특징으로 하는 선형 이득 증폭기 장치.
  2. 제1항에 있어서, 입력 및 출력 트랜지스터의 소스 전극은 각각 제1 및 제 2소스 단말기를 구성하도록 공유되고, 증폭기 장치의 이득을 한정하기 위한 수단은 상기의 단말기 사이에서 직류 전압을 인가시키는 제1 및 제 2소스 단말기에 접속된 수단을 포함하는 것을 특징으로 하는 선형 이득 증폭기 장치.
  3. 제2항에 있어서, 제2소스 단말기는 증폭기 장치의 신호 정지에 직접 접속되고, 제 1소스 단말기는 이득을 한정하기 위한 수단을 경유하여 상기의 신호 접지에 접속되는 것을 특징으로 하는 선형 이득 증폭기 장치.
  4. 제1항에 있어서, 입력 및 출력 트랜지스터의 소스 전극은 전력 공급 단말기에 접속되고, 증폭기 장치의 이득을 한정하기 위한 수단은 상기의 게이트 사이에 직류 전압을 인가시키기 위혜 각각 제1 및 제2전류 미러의 출력 트랜지스터의 게이트와 입력 트렌지스터의 게이트 사이에 접속된 수단을 포함하는 것을 특징으로 하는 선형 이득 증폭기 장치.
  5. 제2, 3 또는 4항에 있어서, 증폭기 장치의 이득을 한정하기 위한 수단이 가변 직류 전압을 공급하도록 조정되는 것을 특징으로 하는 선형 이득 증폭기 장치.
  6. 제2, 3, 4 또는 5항에 있어서, 입력 및 출력 트랜지스터가 직류 전압을 인가시키기 위한 수단에 의해 바이어스되며, 이러한 수단이 증폭기 장치의 이득을 한정하기 위한 직류 전압을 인가시키기 위한 수단과 비교할만한 온도 의존 성질과 조립공정을 가지는 것을 특징으로 하는 선형 이득 증폭기 장치.
  7. 제1항에 있어서, 입력 및 출력 트랜지스터의 소스 전극이 각각 제1 및 제2소스 단말기에 공유되고, 제1 및 제2소스 단말기에서 서로 같은 전류를 만들기 위해 제공된 수단과, 직류 전류를 공급하기 위해 소스 단말기에 접속된 수단을 포함하고 있는 증폭기 장치의 이득을 한정하기 위한 수단을 포함하는 것을 특징으로 하는 선형 이득 증폭기 장치.
  8. 제7항에 있어서,제1 및 제2소스 단말기에서 서로 같은 전류를 만들기 위한 수단이 제 1소스 단말 기에 접속된 입력과 제2소스 단말기에 접속된 출력을 가지고 있는 전류 미러 회로와, 증폭기 장치의 이득 을 한정하기 위해 직류 전류를 공급하는 제2소스 단말기에 접속된 전류 기준 회로를 포함하는 것을 특징으로 하는 선형 이득 증폭기 장치.
  9. 제7항 또는 제8항에 있어서, 증폭기 장치의 이득을 한정하기 위한 수단이 가변 직류 전류를 공급하도록 조정되는 것을올 특징으로 하는 선형 이득 증폭기 장치.
  10. 제7,8 또는 9항에 있어서, 트랜지스터는 직류 전류를 인가시키기 위한 수단에 의해 바이어스 되고, 이러한 수단이 증폭기 장치의 이득을 한정하기 위해 직류 전류를 인가시키기 위한 수단과 비교할만한 조립공정 및 온도 의존도 성질을 가지는 것을 특징으로 하는 선형 이득 증폭기 장치.
  11. 선행항중 어느 한 항에 있어서, 트랜지스터가 모두 절연된-게이트형이고,중폭기 장치는 집적 반도체 회로로서 구성되는 것을 특징으로 하는 선형 이득 증폭기 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019890015176A 1988-10-26 1989-10-23 선형 이득 증폭기 장치 KR900007168A (ko)

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US5006815A (en) 1991-04-09
EP0367330B1 (en) 1996-08-14
JP3081210B2 (ja) 2000-08-28
EP0367330A1 (en) 1990-05-09
JPH02166814A (ja) 1990-06-27
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