KR20080093589A - 플라즈마 디스플레이 장치 - Google Patents

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Abstract

본 발명의 일실시예는 플라즈마 디스플레이 장치에 관한 것으로, 소정 계조에서의 서스테인 신호의 개수가 변경될 때, 리셋 기간 또는 서스테인 기간의 길이를 연동하여 조절한다.
본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 서로 나란한 스캔 전극과 서스테인 전극을 포함하는 플라즈마 디스플레이 패널과, 적어도 하나의 영상 프레임(Image Frame)의 서브필드(Subfield)의 서스테인 기간에서 스캔 전극 또는 서스테인 전극 중 적어도 하나로 서스테인 신호를 공급하는 구동부를 포함하고, 영상 프레임은 제 1, 2, 3 영상 프레임을 포함하고, 제 1, 2, 3 영상 프레임은 각각 리셋 기간, 어드레스 기간, 서스테인 기간을 포함하고, 제 2 영상 프레임의 한 서브필드의 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이는 제 2 영상 프레임보다 시간적으로 앞선 제 1 영상 프레임의 동일 서브필드 보다 짧고, 제 2 영상 프레임보다 시간적으로 늦는 제 3 영상 프레임의 동일 서브필드의 리셋 기간과 어드레스 기간의 길이는 제 2 영상 프레임과 실질적으로 동일하고, 서스테인 신호의 개수는 제 2 영상 프레임보다 더 많다.

Description

플라즈마 디스플레이 장치{Plasma Display Apparatus}
도 1은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 구성에 대해 설명하기 위한 도면.
도 2는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널의 구조에 대해 설명하기 위한 도면.
도 3은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 영상 프레임(Frame)에 대해 설명하기 위한 도면.
도 4는 서브필드에서의 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 동작의 일례를 설명하기 위한 도면.
도 5a 내지 도 5b는 소정 계조에서의 서스테인 신호의 개수 변화에 대해 설명하기 위한 도면.
도 6은 서스테인 신호의 개수가 증가하는 방향의 일례를 설명하기 위한 도면.
도 7은 서스테인 신호의 개수가 증가하는 방향에서 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 서스테인 신호의 개수보다 먼저 감소시키는 이유에 대해 설명하기 위한 도면.
도 8a 내지 도 8e는 리셋 또는 어드레스 기간의 길이를 조절하는 방법에 대 해 설명하기 위한 도면.
도 9는 서스테인 신호의 개수가 증가하는 방향의 다른 예를 설명하기 위한 도면.
도 10은 서스테인 신호의 개수가 증가하는 방향의 또 다른 예를 설명하기 위한 도면.
도 11은 서스테인 신호의 개수가 감소하는 방향의 일예를 설명하기 위한 도면.
<도면의 주요 부분에 대한 부호의 설명>
100 : 플라즈마 디스플레이 패널 110 : 구동부
본 발명은 플라즈마 디스플레이 장치에 관한 것이다.
플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널을 포함한다.
일반적으로, 플라즈마 디스플레이 패널에는 격벽으로 구획된 방전 셀(Cell) 내에 형광체 층이 형성되고, 아울러 복수의 전극(Electrode)이 형성된다.
이러한, 전극을 통해 방전 셀로 구동 신호가 공급된다.
그러면, 방전 셀 내에서는 공급되는 구동 신호에 의해 방전이 발생한다. 여기서, 방전 셀 내에서 구동 신호에 의해 방전이 될 때, 방전 셀 내에 충진 되어 있는 방전 가스가 진공자외선(Vacuum Ultraviolet rays)을 발생하고, 이러한 진공 자 외선이 방전 셀 내에 형성된 형광체를 발광시켜 가시 광을 발생시킨다. 이러한 가시 광에 의해 플라즈마 디스플레이 패널의 화면상에 영상이 표시된다.
본 발명의 일실시예는 서스테인 기간에서 공급되는 서스테인 신호의 개수를 조절하고, 서스테인 신호의 개수를 조절할 때, 리셋 기간 또는 어드레스 기간의 길이를 조절하는 플라즈마 디스플레이 장치에 관한 것이다.
본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 서로 나란한 스캔 전극과 서스테인 전극을 포함하는 플라즈마 디스플레이 패널과, 적어도 하나의 영상 프레임(Image Frame)의 서브필드(Subfield)의 서스테인 기간에서 스캔 전극 또는 서스테인 전극 중 적어도 하나로 서스테인 신호를 공급하는 구동부를 포함하고, 영상 프레임은 제 1, 2, 3 영상 프레임을 포함하고, 제 1, 2, 3 영상 프레임은 각각 리셋 기간, 어드레스 기간, 서스테인 기간을 포함하고, 제 2 영상 프레임의 한 서브필드의 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이는 제 2 영상 프레임보다 시간적으로 앞선 제 1 영상 프레임의 동일 서브필드 보다 짧고, 제 2 영상 프레임보다 시간적으로 늦는 제 3 영상 프레임의 동일 서브필드의 리셋 기간과 어드레스 기간의 길이는 제 2 영상 프레임과 실질적으로 동일하고, 서스테인 신호의 개수는 제 2 영상 프레임보다 더 많다.
또한, 제 1 영상 프레임에서의 플라즈마 디스플레이 패널의 온도와 제 2 영상 프레임에서의 플라즈마 디스플레이 패널의 온도는 다를 수 있다.
또한, 제 2 영상 프레임의 동일 서브필드의 서스테인 기간에서 스캔 전극 또는 서스테인 전극으로 공급되는 서스테인 신호의 개수는 제 1 영상 프레임과 실질적으로 동일할 수 있다.
또한, 본 발명의 다른 실시예에 따른 플라즈마 디스플레이 장치는 서로 나란한 스캔 전극과 서스테인 전극을 포함하는 플라즈마 디스플레이 패널과, 적어도 하나의 영상 프레임(Image Frame)의 서브필드(Subfield)의 서스테인 기간에서 스캔 전극 또는 서스테인 전극 중 적어도 하나로 서스테인 신호를 공급하는 구동부를 포함하고, 영상 프레임은 제 4, 5, 6 영상 프레임을 포함하고, 제 4, 5, 6 영상 프레임은 각각 리셋 기간, 어드레스 기간, 서스테인 기간을 포함하고, 제 5 영상 프레임의 한 서브필드의 서스테인 기간에서 스캔 전극 또는 서스테인 전극 중 적어도 하나로 공급되는 서스테인 신호의 개수는 제 5 영상 프레임보다 시간적으로 앞선 제 4 영상 프레임의 동일 서브필드 보다 더 적고, 리셋 기간과 어드레스 기간의 길이는 제 4 영상 프레임과 실질적으로 동일하고, 제 5 영상 프레임보다 시간적으로 늦는 제 6 영상 프레임의 동일 서브필드의 리셋 기간 또는 어드레스 기간의 길이는 제 5 영상 프레임 보다 더 길다.
또한, 제 4 영상 프레임에서의 플라즈마 디스플레이 패널의 온도와 제 5 영상 프레임에서의 플라즈마 디스플레이 패널의 온도는 다를 수 있다.
또한, 제 5 영상 프레임의 동일 서브필드의 서스테인 기간에서 스캔 전극 또는 서스테인 전극으로 공급되는 서스테인 신호의 개수는 제 6 영상 프레임과 실질적으로 동일할 수 있다.
또한, 본 발명의 또 다른 실시예에 따른 플라즈마 디스플레이 장치는 서로 나란한 스캔 전극과 서스테인 전극을 포함하는 플라즈마 디스플레이 패널과, 적어도 하나의 영상 프레임(Image Frame)으로 플라즈마 디스플레이 패널에 영상을 구현하는 구동부를 포함하고, 영상 프레임은 각각 리셋 기간, 어드레스 기간, 서스테인 기간을 포함하고, 구동부는 서스테인 신호의 개수가 증가하는 방향에서는 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 먼저 감소시킨 이후에 서스테인 신호의 개수를 증가시키고, 서스테인 신호의 개수가 감소하는 방향에서는 서스테인 신호의 개수를 먼저 감소시킨 이후에 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 증가시킨다.
이하, 첨부된 도면을 참조하여 본 발명의 플라즈마 디스플레이 장치의 실시예를 상세히 설명하기로 한다.
도 1은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 구성에 대해 설명하기 위한 도면이다.
도 1을 살펴보면, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널(100)과 구동부(110)를 포함한다.
플라즈마 디스플레이 패널(100)은 서로 나란한 스캔 전극(Y1~Yn)과 서스테인 전극(Z1~Zn)을 포함하고, 아울러 스캔 전극 및 서스테인 전극과 교차하는 어드레스 전극(X1~Xm)을 포함한다.
구동부(110)는 적어도 하나의 영상 프레임(Image Frame)으로 플라즈마 디스플레이 패널(100)에 영상을 구현한다. 예를 들면, 적어도 하나의 영상 프레 임(Image Frame)의 한 서브필드(Subfield)의 서스테인 기간에서 스캔 전극 또는 서스테인 전극 중 적어도 하나로 서스테인 신호를 공급함으로써, 플라즈마 디스플레이 패널(100)에 영상을 구현할 수 있다.
여기, 도 1에서는 구동부(110)가 하나의 보드(Board) 형태로 이루어지는 경우만 도시하고 있지만, 본 발명에서 구동부(110)는 플라즈마 디스플레이 패널(100)에 형성된 전극에 따라 복수개의 보드 형태로 나누어지는 것도 가능하다.
예를 들면, 구동부(110)는 플라즈마 디스플레이 패널(100)의 스캔 전극을 구동시키는 제 1 구동부(미도시)와, 서스테인 전극을 구동시키는 제 2 구동부와, 어드레스 전극을 구동시키는 제 3 구동부(미도시)로 나누어질 수 있는 것이다.
이러한 본 발명의 플라즈마 디스플레이 장치의 구동부(110)에 대해서는 이후의 설명을 통해 보다 명확히 하도록 한다.
다음, 도 2는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널의 구조에 대해 설명하기 위한 도면이다.
도 2를 살펴보면, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널은 서로 나란한 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 형성되는 전면 기판(201)과, 전술한 스캔 전극(202, Y) 및 서스테인 전극(203, Z)과 교차하는 어드레스 전극(213, X)이 형성되는 후면 기판(211)이 합착되어 이루어질 수 있다.
스캔 전극(202, Y)과 서스테인 전극(203, Z)이 형성된 전면 기판(201)에는 스캔 전극(202, Y)과 서스테인 전극(203, Z)을 덮도록 유전체 층, 예컨대 상부 유 전체 층(204)이 배치될 수 있다.
상부 유전체 층(204)은 스캔 전극(202, Y) 및 서스테인 전극(203, Z)의 방전 전류를 제한하며 스캔 전극(202, Y)과 서스테인 전극(203, Z) 간을 절연시킬 수 있다.
상부 유전체 층(204)이 형성된 전면 기판(201)에는 방전 조건을 용이하게 하기 위한 보호 층(205)이 형성될 수 있다. 이러한 보호 층(205)은 2차 전자 방출 계수가 높은 재질, 예컨대 산화마그네슘(MgO) 재질을 포함할 수 있다.
한편, 후면 기판(211) 상에는 전극, 예컨대 어드레스 전극(213, X)이 형성되고, 이러한 어드레스 전극(213, X)이 형성된 후면 기판(211)의 상부에는 어드레스 전극(213, X)을 덮도록 유전체 층, 예컨대 하부 유전체 층(215)이 형성될 수 있다.
이러한, 하부 유전체 층(215)은 어드레스 전극(213, X)을 절연시킬 수 있다.
이러한 하부 유전체 층(215)의 상부에는 방전 공간 즉, 방전 셀을 구획하기 위한 스트라이프 타입(Stripe Type), 웰 타입(Well Type), 델타 타입(Delta Type), 벌집 타입 등의 격벽(212)이 형성될 수 있다. 이에 따라, 전면 기판(201)과 후면 기판(211)의 사이에서 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 방전 셀 등이 형성될 수 있다.
또한, 적색(R), 녹색(G), 청색(B) 방전 셀 이외에 백색(White : W) 또는 황색(Yellow : Y) 방전 셀이 더 형성되는 것도 가능하다.
한편, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 적용될 수 있는 플라즈마 디스플레이 패널에서의 적색(R), 녹색(G) 및 청색(B) 방전 셀의 폭은 실질적으로 동일할 수도 있지만, 적색(R), 녹색(G) 및 청색(B) 방전 셀 중 적어도 하나의 폭이 다른 방전 셀의 폭과 다르게 할 수도 있다.
예컨대, 적색(R) 방전 셀의 폭이 가장 작고, 녹색(G) 및 청색(B) 방전 셀의 폭을 적색(R) 방전 셀의 폭보다 크게 할 수 있다.
여기서, 녹색(G) 방전 셀의 폭은 청색(B) 방전 셀의 폭과 실질적으로 동일하거나 상이할 수 있다.
이와 같이, 형성하게 되면 방전 셀 내에 형성되는 후술될 형광체 층(214)의 폭도 방전 셀의 폭에 관련하여 변경된다. 예를 들면, 청색(B) 방전 셀에 형성되는 청색(B) 형광체 층의 폭이 적색(R) 방전 셀 내에 형성되는 적색(R) 형광체 층의 폭보다 넓고, 아울러 녹색(G) 방전 셀에 형성되는 녹색(G) 형광체 층의 폭이 적색(R) 방전 셀 내에 형성되는 적색(R) 형광체 층의 폭보다 넓을 수 있다.
그러면, 구현되는 영상의 색온도 특성이 향상될 수 있다.
또한, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 적용될 수 있는 플라즈마 디스플레이 패널은 도 2에 도시된 격벽(212)의 구조뿐만 아니라, 다양한 형상의 격벽의 구조도 가능할 것이다. 예컨대, 격벽(212)은 제 1 격벽(212b)과 제 2 격벽(212a)을 포함하고, 여기서, 제 1 격벽(212b)의 높이와 제 2 격벽(212a)의 높이가 서로 다른 차등형 격벽 구조, 제 1 격벽(212b) 또는 제 2 격벽(212a) 중 하나 이상에 배기 통로로 사용 가능한 채널(Channel)이 형성된 채널형 격벽 구조, 제 1 격벽(212b) 또는 제 2 격벽(212a) 중 하나 이상에 홈(Hollow)이 형성된 홈형 격벽 구조 등이 가능할 것이다.
여기서, 차등형 격벽 구조인 경우에는 제 1 격벽(212b)의 높이가 제 2 격벽(212a)의 높이보다 더 낮을 수 있다. 아울러, 채널형 격벽 구조인 경우에는 제 1 격벽(212b)에 채널이 형성될 수 있다.
또한, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 적용될 수 있는 플라즈마 디스플레이 패널에서는 적색(R), 녹색(G) 및 청색(B) 방전 셀 각각이 동일한 선상에 배열되는 것으로 도시 및 설명되고 있지만, 다른 형상으로 배열되는 것도 가능할 것이다. 예컨대, 적색(R), 녹색(G) 및 청색(B) 방전 셀이 삼각형 형상으로 배열되는 델타(Delta) 타입의 배열도 가능할 것이다. 또한, 방전 셀의 형상도 사각형상뿐만 아니라 오각형, 육각형 등의 다양한 다각 형상도 가능할 것이다.
또한, 여기 도 2에서는 후면 기판(211)에 격벽(212)이 형성된 경우만을 도시하고 있지만, 격벽(212)은 전면 기판(201) 또는 후면 기판(211) 중 적어도 어느 하나에 형성될 수 있다.
여기서, 격벽(212)에 의해 구획된 방전 셀 내에는 소정의 방전 가스가 채워질 수 있다.
아울러, 격벽(212)에 의해 구획된 방전 셀 내에는 어드레스 방전 시 화상표시를 위한 가시 광을 방출하는 형광체 층(214)이 형성될 수 있다. 예를 들면, 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 형광체 층이 형성될 수 있다.
또한, 적색(R), 녹색(G), 청색(B) 형광체 이외에 백색(White : W) 및/또는 황색(Yellow : Y) 형광체 층이 더 형성되는 것도 가능하다.
또한, 적색(R), 녹색(G) 및 청색(B) 방전 셀 중 적어도 어느 하나의 방전 셀 에서의 형광체 층(214)의 두께가 다른 방전 셀과 상이할 수 있다. 예를 들면, 녹색(G) 방전 셀의 형광체 층, 즉 녹색(G) 형광체 층 또는 청색(B) 방전 셀에서의 형광체 층, 즉 청색(B) 형광체 층의 두께가 적색(R) 방전 셀에서의 형광체 층, 즉 적색(R) 형광체 층의 두께보다 더 두꺼울 수 있다. 여기서, 녹색(G) 형광체 층의 두께는 청색(B) 형광체 층의 두께와 실질적으로 동일하거나 상이할 수 있다.
한편, 이상에서는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 적용될 수 있는 플라즈마 디스플레이 패널의 일례만을 도시하고 설명한 것으로써, 본 발명이 이상에서 설명한 구조의 플라즈마 디스플레이 패널에 한정되는 것은 아님을 밝혀둔다. 예를 들면, 여기 이상의 설명에서는 번호 204의 상부 유전체 층 및 번호 215의 하부 유전체 층이 각각 하나의 층(Layer)인 경우만을 도시하고 있지만, 이러한 상부 유전체 층 및 하부 유전체 층 중 하나 이상은 복수의 층으로 이루지는 것도 가능한 것이다.
아울러, 번호 212의 격벽으로 인한 외부 광의 반사를 방지하기 위해 격벽(212)의 상부에 외부 광을 흡수할 수 있는 블랙 층(미도시)을 더 배치하는 것도 가능하다.
또한, 격벽(212)과 대응되는 전면 기판(201) 상의 특정 위치에 또 다른 블랙 층(미도시)이 더 형성되는 것도 가능하다.
또한, 후면 기판(211) 상에 형성되는 어드레스 전극(213)은 폭이나 두께가 실질적으로 일정할 수도 있지만, 방전 셀 내부에서의 폭이나 두께가 방전 셀 외부에서의 폭이나 두께와 다를 수도 있을 것이다. 예컨대, 방전 셀 내부에서의 폭이나 두께가 방전 셀 외부에서의 그것보다 더 넓거나 두꺼울 수 있을 것이다.
다음, 도 3은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 영상 프레임(Frame)에 대해 설명하기 위한 도면이다.
도 3을 살펴보면 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에서 영상의 계조(Gray Level)를 구현하기 위한 영상 프레임은 발광횟수가 다른 복수의 서브필드로 나누어질 수 있다.
아울러, 도시하지는 않았지만 복수의 서브필드 중 하나 이상의 서브필드는 다시 방전 셀을 초기화시키기 위한 리셋 기간(Reset Period), 방전될 방전 셀을 선택하기 위한 어드레스 기간(Address Period) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(Sustain Period)으로 나누어 질 수 있다.
예를 들어, 256 계조로 영상을 표시하고자 하는 경우에 예컨대 하나의 영상 프레임은, 도 3과 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어질 수 있다.
한편, 서스테인 기간에 공급되는 서스테인 신호의 개수를 조절하여 해당 서브필드의 계조 가중치를 설정할 수 있다. 즉, 서스테인 기간을 이용하여 각각의 서브필드에 소정의 계조 가중치를 부여할 수 있다. 예를 들면, 제 1 서브필드의 계조 가중치를 20 으로 설정하고, 제 2 서브필드의 계조 가중치를 21 으로 설정하는 방법으로 각 서브필드의 계조 가중치가 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가되도록 각 서브필드의 계조 가중치를 결정할 수 있다. 이와 같이 각 서브필드에서 계조 가중치에 따라 각 서브필드의 서스테인 기간에서 공급되는 서스테인 신호의 개수를 조절함으로써, 다양한 영상의 계조를 구현하게 된다.
본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 영상을 구현하기 위해, 예컨대 1초의 영상을 표시하기 위해 복수의 영상 프레임을 사용한다. 예를 들면, 1초의 영상을 표시하기 위해 60개의 영상 프레임을 사용하는 것이다. 이러한 경우에 하나의 영상 프레임의 길이(T)는 1/60 초, 즉 16.67ms일 수 있다.
여기, 도 3에서는 하나의 영상 프레임이 8개의 서브필드로 이루어진 경우만으로 도시하고 설명하였지만, 이와는 다르게 하나의 영상 프레임을 이루는 서브필드의 개수는 다양하게 변경될 수 있다. 예를 들면, 제 1 서브필드부터 제 12 서브필드까지의 12개의 서브필드로 하나의 영상 프레임을 구성할 수도 있고, 10개의 서브필드로 하나의 영상 프레임을 구성할 수도 있는 것이다.
또한, 여기 도 3에서는 하나의 영상 프레임에서 계조 가중치의 크기가 증가하는 순서에 따라 서브필드들이 배열되었지만, 이와는 다르게 하나의 영상 프레임에서 서브필드들이 계조 가중치가 감소하는 순서에 따라 배열될 수도 있고, 또는 계조 가중치에 관계없이 서브필드들이 배열될 수도 있는 것이다.
다음, 도 4는 서브필드에서의 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 동작의 일례를 설명하기 위한 도면이다. 이하에서 설명될 구동 신호들은 앞선 도 1의 번호 110의 구동부가 공급하는 것이다.
도 4를 살펴보면, 초기화를 위한 리셋 기간에서는 스캔 전극으로 리셋 신호 가 공급될 수 있다. 리셋 신호는 상승 램프(Ramp-Up) 신호와 하강 램프(Ramp-Down) 신호를 포함할 수 있다.
예를 들어, 셋업(Set-Up) 기간에서는 스캔 전극으로 제 1 전압(V1)부터 제 2 전압(V2)까지 급격히 상승한 이후 제 2 전압(V2)부터 제 3 전압(V3)까지 전압이 점진적으로 상승하는 상승 램프 신호가 공급될 수 있다. 여기서, 제 1 전압(V1)은 그라운드 레벨(GND)의 전압일 수 있다.
이러한 셋업 기간에서는 상승 램프 신호에 의해 방전 셀 내에는 약한 암방전(Dark Discharge), 즉 셋업 방전이 일어난다. 이 셋업 방전에 의해 방전 셀 내에는 어느 정도의 벽 전하(Wall Charge)가 쌓일 수 있다.
셋업 기간 이후의 셋다운(Set-Down) 기간에서는 상승 램프 신호 이후에 이러한 상승 램프 신호와 반대 극성 방향의 하강 램프 신호가 스캔 전극에 공급될 수 있다.
여기서, 하강 램프 신호는 상승 램프 신호의 피크(Peak) 전압, 즉 제 3 전압(V3)보다 낮은 제 4 전압(V4)부터 제 5 전압(V5)까지 점진적으로 하강할 수 있다.
이러한 하강 램프 신호가 공급됨에 따라, 방전 셀 내에서 미약한 소거 방전(Erase Discharge), 즉 셋다운 방전이 발생한다. 이 셋다운 방전에 의해 방전 셀 내에는 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 균일하게 잔류된다.
리셋 기간 이후의 어드레스 기간에서는 하강 램프 신호의 최저 전압, 즉 제 5 전압(V5)보다는 높은 전압, 예컨대 제 6 전압(V6)을 실질적으로 유지하는 스캔 바이어스 신호가 스캔 전극에 공급된다.
아울러, 스캔 바이어스 신호로부터 하강하는 스캔 신호가 스캔 전극에 공급될 수 있다.
한편, 적어도 하나의 서브필드의 어드레스 기간에서 스캔 전극으로 공급되는 스캔 신호의 펄스폭은 다른 서브필드의 스캔 신호의 펄스폭과 다를 수 있다. 예컨대, 시간상 뒤에 위치하는 서브필드에서의 스캔 신호의 폭이 앞에 위치하는 서브필드에서의 스캔 신호의 폭보다 작을 수 있다. 또한, 서브필드의 배열 순서에 따른 스캔 신호 폭의 감소는 2.6㎲(마이크로초), 2.3㎲, 2.1㎲, 1.9㎲ 등과 같이 점진적으로 이루어질 수 있거나 2.6㎲, 2.3㎲, 2.3㎲, 2.1㎲......1.9㎲, 1.9㎲ 등과 같이 이루어질 수도 있다.
이와 같이, 스캔 신호가 스캔 전극으로 공급될 때, 스캔 신호에 대응되게 어드레스 전극에 데이터 신호가 공급될 수 있다.
이러한 스캔 신호와 데이터 신호가 공급되면, 스캔 신호와 데이터 신호 간의 전압 차와 리셋 기간에 생성된 벽 전하들에 의한 벽 전압이 더해지면서 데이터 신호가 공급되는 방전 셀 내에는 어드레스 방전이 발생될 수 있다.
여기서, 어드레스 기간에서 서스테인 전극의 간섭에 의해 어드레스 방전이 불안정해지는 것을 방지하기 위해 서스테인 전극에 서스테인 바이어스 신호가 공급될 수 있다.
서스테인 바이어스 신호는 서스테인 기간에서 공급되는 서스테인 신호의 전 압보다는 작고 그라운드 레벨(GND)의 전압보다는 큰 서스테인 바이어스 전압(Vz)을 실질적으로 일정하게 유지할 수 있다.
이후, 영상 표시를 위한 서스테인 기간에서는 스캔 전극 또는 서스테인 전극 중 적어도 하나에 서스테인 신호가 공급될 수 있다. 예를 들면, 스캔 전극과 서스테인 전극에 교번적으로 서스테인 신호가 공급될 수 있다.
이러한 서스테인 신호가 공급되면, 어드레스 방전에 의해 선택된 방전 셀은 방전 셀 내의 벽 전압과 서스테인 신호의 서스테인 전압(Vs)이 더해지면서 서스테인 신호가 공급될 때 스캔 전극과 서스테인 전극 사이에 서스테인 방전 즉, 표시방전이 발생될 수 있다.
한편, 적어도 하나의 서브필드에서는 서스테인 기간에서 복수의 서스테인 신호가 공급되고, 복수의 서스테인 신호 중 적어도 하나의 서스테인 신호의 펄스폭은 다른 서스테인 신호의 펄스폭과 다를 수 있다. 예를 들면, 복수의 서스테인 신호 중 가장 먼저 공급되는 서스테인 신호의 펄스폭이 다른 서스테인 신호의 펄스폭보다 클 수 있다. 그러면, 서스테인 방전이 더욱 안정될 수 있다.
이상에서 설명한 서스테인 신호의 개수에 따라 구현되는 영상의 계조가 결정될 수 있다.
또한, 소정 계조에서의 서스테인 신호의 개수는 다양하게 변경될 수 있다. 이에 대해 첨부된 도 5a 내지 도 5b를 결부하여 살펴보면 다음과 같다.
도 5a 내지 도 5b는 소정 계조에서의 서스테인 신호의 개수 변화에 대해 설명하기 위한 도면이다.
먼저, 도 5a를 살펴보면 플라즈마 디스플레이 패널의 온도가 A℃이상으로 상승하는 경우에는 소정 계조에서의 서스테인 신호의 개수를 점진적으로 증가시킬 수 있다.
예를 들어, A℃미만에서는 계조 100의 영상신호에 대응하여 10개의 서스테인 신호를 사용하였다고 가정하면, A℃이상에서는 10개보다 많은 서스테인 신호를 이용하여 계조 100의 영상신호에 대응하는 것이다.
이와 같이, 특정 온도이상에서 소정 계조에서의 서스테인 신호의 개수를 증가시키는 경우는, 플라즈마 디스플레이 패널의 특성이 온도가 상승할수록 방전 셀 내에서의 방전이 약해져서 구현되는 영상의 휘도가 저하될 수 있는 경우이다.
이러한 경우에, 특정 온도이상에서 소정 계조에서의 서스테인 신호의 개수를 증가시키게 되면, 플라즈마 디스플레이 패널의 온도가 급격히 상승하더라도 방전 셀 내에서의 방전을 안정시키고, 구현되는 영상의 휘도가 저하되는 것을 억제할 수 있다.
다음, 도 5b를 살펴보면 플라즈마 디스플레이 패널의 온도가 특정 온도 범위를 벗어나는 경우에 소정 계조에서의 서스테인 신호의 개수를 감소시킬 수 있다.
예를 들면, B℃이상 C℃이하에서는 계조 100의 영상신호에 대응하여 12개의 서스테인 신호를 사용하였다고 가정하면, B℃미만에서는 12개보다 더 적은 서스테인 신호를 이용하여 계조 100의 영상신호에 대응하고, 또한 C℃초과에서도 12개보다 더 적은 서스테인 신호를 이용하여 계조 100의 영상신호에 대응하는 것이다.
이와 같이, 특정 온도범위를 벗어날 때 소정 계조에서의 서스테인 신호의 개 수를 감소시키는 경우는, 플라즈마 디스플레이 패널의 특성이 패널의 온도가 특정 온도 범위, 예컨대 10℃이상 60℃이하의 범위를 벗어날 때 방전 셀 내에서의 방전의 세기가 과도하게 강해질 수 있는 경우이다.
이러한 경우에, 패널의 온도가 특정 온도 범위를 벗어날 때, 소정 계조에서의 서스테인 신호의 개수를 감소시키게 되면, 플라즈마 디스플레이 패널의 온도가 특정 온도 범위를 벗어나더라도 방전 셀 내에서의 방전을 안정시킬 수 있다.
이상에서는 플라즈마 디스플레이 패널의 온도에 따라 소정 계조에서의 서스테인 신호의 개수를 변경하는 경우만을 설명하고 있지만, 플라즈마 디스플레이 패널의 내부 압력, 온(On) 되는 방전 셀의 개수 등에 따라 소정 계조에서의 서스테인 신호의 개수를 변경하는 것도 가능한 것이다.
이상에서 상세히 설명한 바와 같이, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 다양한 방법으로 소정 계조에서의 서스테인 신호의 개수를 변경할 수 있는 것이다.
다음, 도 6은 서스테인 신호의 개수가 증가하는 방향의 일례를 설명하기 위한 도면이다.
도 6과 같이, 영상 프레임이 제 1, 2, 3 영상 프레임(Frame 1, 2, 3)을 포함한다고 가정하자. 여기서, 제 1 영상 프레임(Frame 1)은 제 2 영상 프레임(Frame 2)보다 시간적으로 앞서고, 제 2 영상 프레임은 제 3 영상 프레임(Frame 3)보다 시간적으로 앞선다.
또한, 도 6에 도시된 모든 서브필드들은 모두 동일한 서브필드이다. 예를 들 면, 제 1, 2, 3 영상 프레임이 각각 12개의 서브필드(SF1 ~ SF12)를 포함하는 경우에 도 6에 도시된 서브필드들은 세 번째 배치된 서브필드, 즉 제 3 서브필드(SF3)일 수 있다. 이에 따라, 도 6에 도시된 모든 서브필드들은 계조 가중치가 동일할 수 있다.
도 6을 살펴보면, 제 2 영상 프레임의 한 서브필드의 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이는 제 2 영상 프레임보다 시간적으로 앞선 제 1 영상 프레임의 동일 서브필드 보다 짧다.
예를 들면, 제 2 영상 프레임의 제 3 서브필드(SF3)의 리셋 기간의 길이가 제 1 영상 프레임의 제 3 서브필드(SF3)의 리셋 기간의 길이보다 더 짧을 수 있고, 또는 제 2 영상 프레임의 제 3 서브필드(SF3)의 어드레스 기간의 길이가 제 1 영상 프레임의 제 3 서브필드(SF3)의 어드레스 기간의 길이보다 더 짧을 수 있고, 또는 제 2 영상 프레임의 제 3 서브필드(SF3)의 리셋 기간과 어드레스 기간의 길이가 제 1 영상 프레임의 제 3 서브필드(SF3)의 리셋 기간과 어드레스 기간의 길이보다 각각 더 짧을 수 있다.
여기서, 제 1 영상 프레임의 한 서브필드의 서스테인 기간에서 공급되는 서스테인 신호의 개수는 제 2 영상 프레임의 동일 서브필드에서 공급되는 서스테인 신호의 개수와 동일할 수 있다.
또한, 제 2 영상 프레임보다 시간적으로 늦는 제 3 영상 프레임의 동일 서브필드의 리셋 기간과 어드레스 기간의 길이는 제 2 영상 프레임과 실질적으로 동일하고, 서스테인 신호의 개수는 제 2 영상 프레임보다 더 많다.
예를 들면, 제 2 영상 프레임의 제 3 서브필드(SF3)의 리셋 기간과 어드레스 기간의 길이는 제 3 영상 프레임의 제 3 서브필드(SF3)의 리셋 기간과 서스테인 기간의 길이와 각각 동일하고, 제 3 영상 프레임의 제 3 서브필드(SF3)의 서스테인 기간에서 공급되는 서스테인 신호의 개수는 제 2 영상 프레임의 제 3 서브필드(SF3)의 서스테인 기간에서 공급되는 서스테인 신호의 개수보다 더 많을 수 있다.
또한, 앞선 도 5a 내지 도 5b에서 설명한 온도에 따라 소정 계조에서의 서스테인 신호의 개수가 변경되는 경우를 고려하면, 제 1 영상 프레임에서의 플라즈마 디스플레이 패널의 온도는 제 2 영상 프레임에서의 플라즈마 디스플레이 패널의 온도와 다를 수 있다.
예를 들면, 도 5a의 경우를 고려하면, 제 1 영상 프레임에서는 플라즈마 디스플레이 패널의 온도가 A℃ 미만이고, 제 2 영상 프레임에서의 온도는 A℃ 초과일 수 있다.
이상의 도 6의 경우는, 서스테인 신호의 개수가 증가하는 방향에서는 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 먼저 감소시킨 이후에 서스테인 신호의 개수를 증가시키는 것으로 볼 수 있다.
다음, 도 7은 서스테인 신호의 개수가 증가하는 방향에서 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 서스테인 신호의 개수보다 먼저 감소시키는 이유에 대해 설명하기 위한 도면이다.
도 7을 살펴보면, 제 1 영상 프레임(Frame 1)과 제 2 영상 프레임(Frame 2) 이 도시되어 있다.
여기서, 도 7에 도시된 제 1 영상 프레임의 한 서브필드의 총 길이는 S이고, 이러한 S가 한 서브필드가 차지할 수 있는 최대 길이라고 가정하자.
이때, 플라즈마 디스플레이 패널의 온도가 변하여 소정 계조의 서스테인 신호의 개수를 증가시켜야 하는 경우에, 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이 변경 없이 서스테인 신호의 개수를 증가시키게 되면, 변경된 제 2 영상 프레임에서의 동일 서브필드의 길이는 S보다 ㅿS만큼 더 긴 S1이 된다.
앞의 가정에서 S가 한 서브필드가 차지할 수 있는 최대 길이라고 하였기 때문에 S1은 최대 길이를 벗어나는 길이다. 예를 들어, 하나의 영상 프레임의 길이를 16.67ms라고 가정하면, 제 2 영상 프레임의 길이는 16.67ms를 초과하는 것이다.
이러한 경우에는, 영상 프레임의 길이가 정해진 규격을 벗어나게 됨으로써 구동부의 오작동이 발생할 수 있고, 또는 구동부가 전기적 손상을 입을 수 있다.
반면에, 앞서 도 6의 경우와 같이 소정 계조의 서스테인 신호의 개수를 증가시켜는 경우에, 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 먼저 감소시킨 이후에, 서스테인 신호의 개수를 증가시키게 되면 도 7에서와 같이 영상 프레임의 길이가 정해진 규격을 벗어나 과도하게 길어지는 것을 방지함으로써, 구동부의 오동작 및 구동부의 전기적 손상을 방지할 수 있다.
다음, 도 8a 내지 도 8e는 리셋 또는 어드레스 기간의 길이를 조절하는 방법에 대해 설명하기 위한 도면이다.
먼저, 도 8a를 살펴보면 리셋 기간에서 공급되는 상승 램프 신호의 최대 전 압이 제 3 전압(V3)인 경우에는 리셋 기간의 길이가 T이고, 상승 램프 신호의 최대 전압이 제 3 전압(V3)보다 낮은 제 3′ 전압(V3′)인 경우에는 리셋 기간의 길이가 T1로서, T보다 T1′만큼 짧아진다.
즉, 하강 램프 신호의 최저 전압 및 기울기 등은 고정시킨 상태에서, 리셋 기간에서 공급되는 상승 램프 신호의 최대 전압을 제 3 전압(V3)에서 제 3′ 전압(V3′)으로 낮추는 방법으로 리셋 기간의 길이를 줄일 수 있고, 또한 반대의 경우 상승 램프 신호의 최대 전압을 제 3′ 전압(V3′)에서 제 3 전압(V3)으로 높이는 방법으로 리셋 기간의 길이를 증가시킬 수 있다.
다음, 도 8b를 살펴보면 리셋 기간에서 공급되는 상승 램프 신호의 기울기가 상대적으로 완만한 경우에는 리셋 기간의 길이가 T이고, 상승 램프 신호의 기울기가 상대적으로 가파른 경우에는 리셋 기간의 길이가 T2로서, T보다 T2′만큼 짧아진다.
즉, 하강 램프 신호의 최저 전압 및 기울기 등은 고정시킨 상태에서, 리셋 기간에서 공급되는 상승 램프 신호의 기울기를 가파르게 하는 방법으로 리셋 기간의 길이를 줄일 수 있고, 또한 반대의 경우 상승 램프 신호의 기울기를 완만하게 하는 방법으로 리셋 기간의 길이를 증가시킬 수 있다.
여기서, 제 3″ 전압(V3″)은 제 3 전압(V3)과 실질적으로 동일한 전압일 수 있다.
다음, 도 8c를 살펴보면 리셋 기간에서 공급되는 하강 램프 신호의 최저 전압이 제 5 전압(V5)인 경우에는 리셋 기간의 길이가 T이고, 하강 램프 신호의 최저 전압이 제 5 전압(V5)보다 높은 제 5′ 전압(V5′)인 경우에는 리셋 기간의 길이가 T3로서, T보다 T3′만큼 짧아진다.
즉, 상승 램프 신호의 최대 전압 및 기울기 등은 고정시킨 상태에서, 리셋 기간에서 공급되는 하강 램프 신호의 최저 전압을 제 5 전압(V5)에서 제 5′ 전압(V5′)으로 높이는 방법으로 리셋 기간의 길이를 줄일 수 있고, 또한 반대의 경우 하강 램프 신호의 최저 전압을 제 5′ 전압(V5′)에서 제 5 전압(V5)으로 낮추는 방법으로 리셋 기간의 길이를 증가시킬 수 있다.
다음, 도 8d를 살펴보면 리셋 기간에서 공급되는 하강 램프 신호의 기울기가 상대적으로 완만한 경우에는 리셋 기간의 길이가 T이고, 하강 램프 신호의 기울기가 상대적으로 가파른 경우에는 리셋 기간의 길이가 T4로서, T보다 T4′만큼 짧아진다.
즉, 상승 램프 신호의 전압 및 기울기 등은 고정시킨 상태에서, 리셋 기간에서 공급되는 하강 램프 신호의 기울기를 가파르게 하는 방법으로 리셋 기간의 길이를 줄일 수 있고, 또한 반대의 경우 하강 램프 신호의 기울기를 완만하게 하는 방법으로 리셋 기간의 길이를 증가시킬 수 있다.
여기서, 제 5″ 전압(V5″)은 제 5 전압(V5)과 실질적으로 동일한 전압일 수 있다.
다음, 도 8e를 살펴보면 어드레스 기간에서 스캔 전극으로 공급되는 스캔 신호의 폭을 W에서 W1로 W1′만큼 줄임으로써, 어드레스 기간의 길이를 줄일 수 있다.
다음, 도 9는 서스테인 신호의 개수가 증가하는 방향의 다른 예를 설명하기 위한 도면이다. 여기, 도 9에서는 앞서 상세히 설명한 내용에 대해서는 그 설명을 생략하기로 한다.
도 9를 살펴보면, 제 2 영상 프레임의 한 서브필드의 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이는 제 2 영상 프레임보다 시간적으로 앞선 제 1 영상 프레임의 동일 서브필드 보다 짧다.
또한, 제 2 영상 프레임의 한 서브필드의 서스테인 기간에서 공급되는 서스테인 신호의 개수는 제 1 영상 프레임의 동일 서브필드에서 공급되는 서스테인 신호의 개수보다 더 많다.
또한, 제 2 영상 프레임보다 시간적으로 늦는 제 3 영상 프레임의 동일 서브필드의 리셋 기간과 어드레스 기간의 길이는 제 2 영상 프레임과 실질적으로 동일하고, 서스테인 신호의 개수는 제 2 영상 프레임보다 더 많다.
이상의 도 9의 경우는, 서스테인 신호의 개수가 증가하는 방향에서는 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 감소시키면서 서스테인 신호의 개수를 함께 증가시키고, 이후에는 서스테인 신호의 개수만을 증가시키는 것으로 볼 수 있다.
여기서, 제 1 영상 프레임의 한 서브필드의 길이는 S10이고, 제 2 영상 프레임의 동일 서브필드의 길이는 S10보다 짧은 S20이고, 제 3 영상 프레임의 동일 서브필드의 길이는 S10보다 짧거나 같은 S30일 수 있다.
이상에서와 같이, 제 2 영상 프레임에서 서스테인 신호의 개수를 제 1 영상 프레임보다 더 많게 하더라도, 제 2 영상 프레임의 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이가 감소하였기 때문에 제 2 영상 프레임의 길이가 정해진 규격을 벗어나서 과도하게 증가하지는 않는다.
이에 따라, 소정 계조의 서스테인 신호의 개수가 변경되는 경우에 구동부의 오동작 및 구동부의 전기적 손상을 방지할 수 있다.
다음, 도 10은 서스테인 신호의 개수가 증가하는 방향의 또 다른 예를 설명하기 위한 도면이다. 여기, 도 10에서는 앞서 상세히 설명한 내용에 대해서는 그 설명을 생략하기로 한다.
도 10을 살펴보면, 복수의 단계에 걸쳐 서스테인 신호의 개수를 증가시키는 방법의 일례가 나타나 있다.
이에 대해 예를 들어 살펴보면 다음과 같다.
플라즈마 디스플레이 패널의 온도가 20℃이하에서는 (a)와 같다. (a)의 경우의 한 서브필드의 길이는 Sa이다.
이후, 플라즈마 디스플레이 패널의 온도가 20℃를 넘어서는 경우에는 (b)와 같이 제 1 단계에서 앞선 도 8a 내지 도 8e와 같은 방법을 통해 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 감소시킬 수 있다.
여기서, (a)의 경우와 (b)의 제 1 단계의 서스테인 기간의 길이는 서로 동일할 수도 있다. 즉, (a)와 (b)의 경우의 서스테인 신호의 개수가 실질적으로 동일할 수 있는 것이다.
또는, (b)의 제 1 단계의 서스테인 기간의 길이는 (a)의 경우의 서스테인 기 간의 길이 보다 더 길 수 있다. 즉, (b)의 경우의 서스테인 신호의 개수가 (a)의 경우의 서스테인 신호의 개수보다 더 많을 수 있는 것이다.
(b)의 경우의 한 서브필드의 길이는 Sa보다 짧은 Sb일 수 있다.
(b)의 제 1 단계 이후의 (c)의 제 2 단계에서는 리셋 기간과 어드레스 기간의 길이는 (b)의 제 1 단계와 동일하고, 서스테인 신호의 개수는 (b)의 제 1 단계보다 더 많다.
(c)의 경우의 한 서브필드의 길이는 Sa보다 짧고 Sb보다 긴 Sc일 수 있다.
(c)의 제 2 단계 이후의 (d)의 제 3 단계에서는 리셋 기간과 어드레스 기간의 길이는 (c)의 제 2 단계와 동일하고, 서스테인 신호의 개수는 (c)의 제 2 단계보다 더 많다.
(d)의 경우의 한 서브필드의 길이는 Sa보다 짧고 Sc보다 긴 Sd일 수 있다.
(d)의 제 3 단계 이후의 (e)의 제 4 단계에서는 리셋 기간과 어드레스 기간의 길이는 (d)의 제 3 단계와 동일하고, 서스테인 신호의 개수는 (d)의 제 3 단계보다 더 많다.
(e)의 경우의 한 서브필드의 길이는 Sd보다 긴 Se일 수 있다. 또한, Se는 (a)의 Sa와 같거나 짧을 수 있다.
이상에서와 같이, 플라즈마 디스플레이 패널의 온도 변화 등의 원인으로 인해, 소정 계소에서의 서스테인 신호의 개수가 증가할 때, 복수의 단계를 거쳐 점진적으로 증가할 수 있다.
이와 같이, 복수의 단계를 거쳐 점진적으로 증가하게 되면, 영상의 휘도가 급격히 변하는 것을 방지함으로써, 구현되는 영상의 화질이 악화되는 것을 방지할 수 있다.
다음, 도 11은 서스테인 신호의 개수가 감소하는 방향의 일예를 설명하기 위한 도면이다. 여기, 도 11에서는 이상에서 상세히 설명한 내용에 대해서는 그 설명을 생략하기로 한다.
도 11을 살펴보면, 영상 프레임이 제 4, 5, 6 영상 프레임(Frame 4, 5, 6)을 포함한다고 가정하자. 여기서, 제 4 영상 프레임(Frame 4)은 제 5 영상 프레임(Frame 5)보다 시간적으로 앞서고, 제 5 영상 프레임은 제 6 영상 프레임(Frame 6)보다 시간적으로 앞선다.
또한, 도 11에 도시된 모든 서브필드들은 모두 동일한 서브필드이다.
도 11을 살펴보면, 제 5 영상 프레임의 한 서브필드의 서스테인 기간에서 스캔 전극 또는 서스테인 전극 중 적어도 하나로 공급되는 서스테인 신호의 개수는 제 5 영상 프레임보다 시간적으로 앞선 제 4 영상 프레임의 동일 서브필드 보다 더 적다. 이때, 제 5 영상 프레임의 한 서브필드의 리셋 기간과 어드레스 기간의 길이는 제 4 영상 프레임과 실질적으로 동일하다.
또한, 제 5 영상 프레임보다 시간적으로 늦는 제 6 영상 프레임의 동일 서브필드의 리셋 기간 또는 어드레스 기간의 길이는 제 5 영상 프레임 보다 더 길다.
이때, 제 5 영상 프레임의 동일 서브필드의 서스테인 기간에서 스캔 전극 또는 서스테인 전극으로 공급되는 서스테인 신호의 개수는 제 6 영상 프레임과 실질적으로 동일할 수 있다.
또한, 앞선 도 5a 내지 도 5b에서 설명한 온도에 따라 소정 계조에서의 서스테인 신호의 개수가 변경되는 경우를 고려하면, 제 4 영상 프레임에서의 플라즈마 디스플레이 패널의 온도는 제 5 영상 프레임에서의 플라즈마 디스플레이 패널의 온도와 다를 수 있다.
예를 들면, 도 5a의 경우를 고려하면, 제 4 영상 프레임에서는 플라즈마 디스플레이 패널의 온도가 A℃ 초과이고, 제 5 영상 프레임에서의 온도는 A℃ 미만일 수 있다.
이상의 도 11의 경우는, 서스테인 신호의 개수가 감소하는 방향에서는 서스테인 신호의 개수를 먼저 감소시킨 이후에 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 증가시키는 것으로 볼 수 있다.
이와 같이, 서스테인 신호의 개수가 감소하는 방향에서 서스테인 신호의 개수를 리셋 기간 또는 어드레스 기간의 길이를 증가시키기 이전에 먼저 감소시키는 이유는, 도 10이전에서 상세히 설명한 바와 같이 서스테인 신호의 개수가 증가하는 방향에서 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 먼저 감소시킨 이후에 서스테인 신호의 개수를 증가시켰기 때문이다.
보다 상세히 설명하면, 서스테인 신호의 개수가 증가하는 방향에서 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 먼저 감소시킨 이후에 서스테인 신호의 개수를 증가시켰기 때문에, 이때 서스테인 신호의 개수가 감소하는 경우에는 거꾸로 서스테인 신호의 개수를 먼저 감소시킨 이후에 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 증가시켜야만 영상 프레임의 길이가 정해진 규격을 벗어나서 과도하게 증가하는 것을 방지하여 구동부의 오동작 및 구동부의 전기적 손상을 방지할 수 있다.
한편, 도 11에서는 제 6 영상 프레임에서의 서스테인 신호의 개수가 제 5 영상 프레임에서의 서스테인 신호의 개수와 동일한 것만을 설명하고 있지만, 제 6 영상 프레임에서의 서스테인 신호의 개수가 제 5 영상 프레임에서의 서스테인 신호의 개수 보다 더 적은 것도 가능하다.
또한, 앞선 도 10의 경우와 유사하게 복수의 단계에 걸쳐 소정 계조에서의 서스테인 신호의 개수를 감소시키는 것도 가능한 것이다.
이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.
그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
본 발명의 실시예에 따라 플라즈마 디스플레이 장치는 소정 계조에서의 서스테인 신호의 개수가 변경될 때, 리셋 기간 또는 서스테인 기간의 길이를 연동하여 조절함으로써 구동부의 오동작 및 구동부의 전기적 손상을 방지하는 효과가 있다.

Claims (7)

  1. 서로 나란한 스캔 전극과 서스테인 전극을 포함하는 플라즈마 디스플레이 패널과,
    적어도 하나의 영상 프레임(Image Frame)의 서브필드(Subfield)의 서스테인 기간에서 상기 스캔 전극 또는 서스테인 전극 중 적어도 하나로 서스테인 신호를 공급하는 구동부
    를 포함하고,
    상기 영상 프레임은 제 1, 2, 3 영상 프레임을 포함하고,
    상기 제 1, 2, 3 영상 프레임은 각각 리셋 기간, 어드레스 기간, 서스테인 기간을 포함하고,
    상기 제 2 영상 프레임의 한 서브필드의 상기 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이는 상기 제 2 영상 프레임보다 시간적으로 앞선 제 1 영상 프레임의 동일 서브필드 보다 짧고,
    상기 제 2 영상 프레임보다 시간적으로 늦는 상기 제 3 영상 프레임의 동일 서브필드의 상기 리셋 기간과 어드레스 기간의 길이는 상기 제 2 영상 프레임과 실질적으로 동일하고, 서스테인 신호의 개수는 상기 제 2 영상 프레임보다 더 많은 플라즈마 디스플레이 장치.
  2. 제 1 항에 있어서,
    상기 제 1 영상 프레임에서의 상기 플라즈마 디스플레이 패널의 온도와 상기 제 2 영상 프레임에서의 상기 플라즈마 디스플레이 패널의 온도는 다른 플라즈마 디스플레이 장치.
  3. 제 1 항에 있어서,
    상기 제 2 영상 프레임의 상기 동일 서브필드의 서스테인 기간에서 상기 스캔 전극 또는 서스테인 전극으로 공급되는 서스테인 신호의 개수는 상기 제 1 영상 프레임과 실질적으로 동일한 플라즈마 디스플레이 장치.
  4. 서로 나란한 스캔 전극과 서스테인 전극을 포함하는 플라즈마 디스플레이 패널과,
    적어도 하나의 영상 프레임(Image Frame)의 서브필드(Subfield)의 서스테인 기간에서 상기 스캔 전극 또는 서스테인 전극 중 적어도 하나로 서스테인 신호를 공급하는 구동부
    를 포함하고,
    상기 영상 프레임은 제 4, 5, 6 영상 프레임을 포함하고,
    상기 제 4, 5, 6 영상 프레임은 각각 리셋 기간, 어드레스 기간, 서스테인 기간을 포함하고,
    상기 제 5 영상 프레임의 한 서브필드의 서스테인 기간에서 상기 스캔 전극 또는 서스테인 전극 중 적어도 하나로 공급되는 서스테인 신호의 개수는 상기 제 5 영상 프레임보다 시간적으로 앞선 제 4 영상 프레임의 동일 서브필드 보다 더 적고, 상기 리셋 기간과 어드레스 기간의 길이는 상기 제 4 영상 프레임과 실질적으로 동일하고,
    상기 제 5 영상 프레임보다 시간적으로 늦는 상기 제 6 영상 프레임의 동일 서브필드의 상기 리셋 기간 또는 어드레스 기간의 길이는 상기 제 5 영상 프레임 보다 더 긴 플라즈마 디스플레이 장치.
  5. 제 4 항에 있어서,
    상기 제 4 영상 프레임에서의 상기 플라즈마 디스플레이 패널의 온도와 상기 제 5 영상 프레임에서의 상기 플라즈마 디스플레이 패널의 온도는 다른 플라즈마 디스플레이 장치.
  6. 제 4 항에 있어서,
    상기 제 5 영상 프레임의 상기 동일 서브필드의 서스테인 기간에서 상기 스캔 전극 또는 서스테인 전극으로 공급되는 서스테인 신호의 개수는 상기 제 6 영상 프레임과 실질적으로 동일한 플라즈마 디스플레이 장치.
  7. 서로 나란한 스캔 전극과 서스테인 전극을 포함하는 플라즈마 디스플레이 패널과,
    적어도 하나의 영상 프레임(Image Frame)으로 상기 플라즈마 디스플레이 패 널에 영상을 구현하는 구동부
    를 포함하고,
    상기 영상 프레임은 각각 리셋 기간, 어드레스 기간, 서스테인 기간을 포함하고,
    상기 구동부는
    상기 서스테인 신호의 개수가 증가하는 방향에서는 상기 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 먼저 감소시킨 이후에 상기 서스테인 신호의 개수를 증가시키고,
    상기 서스테인 신호의 개수가 감소하는 방향에서는 상기 서스테인 신호의 개수를 먼저 감소시킨 이후에 상기 리셋 기간 또는 어드레스 기간 중 적어도 하나의 길이를 증가시키는 플라즈마 디스플레이 장치.
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