KR20060020074A - 표시장치 - Google Patents

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강문식
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Abstract

표시장치에서, 표시부는 구동신호에 응답하여 영상을 표시하고, 구동부는 제어신호에 응답하여 표시부에 구동신호를 출력한다. 제어부는 구동부에 제어신호를 출력하는 다수의 회로로 이루어지고, 제어부의 회로들은 회로들 사이의 데이터 통신을 위한 인터페이스에 접속된다. 따라서, 회로들은 인터페이스에 접속된 마스터 회로에 의해서 제어됨으로써 유동적인 데이터를 생성할 수 있다.

Description

표시장치{DISPLAY APPARATUS}
도 1은 본 발명의 일 실시예에 따른 액정표시장치의 블록도이다.
도 2는 도 1에 도시된 제어부를 구체적으로 나타낸 블록도이다.
도 3은 도 2에 도시된 시리얼 데이터 라인과 시리얼 클락 라인의 파형도를 나타낸 도면이다.
도 4는 디지털 직렬 인터페이스를 나타낸 도면이다.
도 5는 디지털 병렬 인터페이스를 나타낸 도면이다.
도 6은 도 1에 도시된 타이밍 제어회로를 구체적으로 나타낸 블록도이다.
도 7은 도 6에 도시된 데이터 블록을 구체적으로 나타낸 도면이다.
도 8은 도 1에 도시된 공통전압 발생회로를 나타낸 도면이다.
도 9는 도 1에 도시된 전원전압 발생회로를 나타낸 도면이다.
도 10은 본 발명의 다른 실시예에 따른 액정표시장치의 블록도이다.
도 11은 도 10에 도시된 인버터 제어회로와 휘도감지회로를 구체적으로 나타낸 도면이다.
*도면의 주요 부분에 대한 부호의 설명*
100 : 액정표시패널 210 : 게이트 구동회로
220 : 데이터 구동회로 230 : 인버터
231 ~ 234 : 제1 내지 제4 램프 300 : 제어부
310 : 타이밍 제어회로 311 : 데이터 블록
312 : 제어신호 블록 313 : 인터페이스 블록
320 : 비휘발성 메모리 330 : 감마전압 발생회로
340 : 공통전압 발생회로 341 : 변환부
342 : 디지털 가변 저항부 350 : 전원전압 발생회로
351 : 제1 전압발생부 352 : 제2 전압발생부
353 : 인터페이스부 360 : 온도감지회로
370 : 휘도감지회로 380 : 인버터 제어회로
390 :프레임 메모리 400 : 외부 인터페이스
450 : 내부 인터페이스 500 : 액정표시장치
본 발명은 표시장치에 관한 것으로, 더욱 상세하게는 생산성을 향상시킬 수 있는 표시장치에 관한 것이다.
일반적으로 액정표시장치는 데이터 신호와 게이트 신호에 응답하여 영상을 표시하는 액정표시패널, 데이터 신호와 게이트 신호를 각각 출력하는 데이터 구동부와 게이트 구동부를 포함한다. 액정표시장치는 데이터 구동부와 게이트 구동부를 구동시키는 타이밍 컨트롤러, 비휘발성 메모리 및 DC/DC 컨버터를 더 구비한다.
타이밍 컨트롤러는 외부장치로부터 영상 데이터와 각종 외부 제어신호를 입력받고, 데이터 구동부와 게이트 구동부에 내부 제어신호를 제공한다. DC/DC 컨버터는 외부로부터의 전원전압을 데이터 구동부와 게이트 구동부를 동작시키기 위한 구동전압으로 변환하여 출력한다.
그 이외에도 액정표시장치는 액정표시패널에 공통전압을 제공하는 공통전압 발생부와 데이터 구동부에 감마전압을 제공하는 감마전압 발생부를 더 포함한다.
상술한, 타이밍 컨트롤러, 비휘발성 메모리, DC/DC 컨버터, 공통전압 발생부 및 감마전압 발생부와 같은 부품들은 미리 액정표시패널의 사양에 맞게 제조된 것이다. 따라서, 액정표시패널의 사양이 변경되면 상기한 부품들을 기계적인 조작으로 사양에 맞게 변경시키거나 사양에 맞게 부품 자체를 교체하여야 한다. 이와 같은 기계적인 조작이나 교체는 액정표시장치의 생산성을 저하시킨다.
따라서, 본 발명의 목적은 생산성을 향상시키기 위한 표시장치를 제공하는 것이다.
본 발명의 일 특징에 따른 표시장치에서 표시부는 구동신호에 응답하여 영상을 표시하고, 구동부는 제어신호에 응답하여 상기 표시부에 상기 구동신호를 출력한다. 제어부는 상기 구동부에 상기 제어신호를 출력하는 다수의 회로로 이루어지고, 상기 제어부의 상기 회로들은 상기 회로들 사이의 데이터 통신을 위한 디지털 인터페이스에 접속된다.
본 발명의 다른 특징에 따른 표시장치는 표시패널, 데이터 구동회로, 게이트 구동회로, 공통전압 발생회로, 감마전압 발생회로, 타이밍 제어회로 및 인터페이스를 포함한다.
상기 표시패널은 데이터 신호를 입력받는 데이터 라인과 게이트 신호를 입력받는 게이트 라인이 구비되고, 상기 데이터 신호와 게이트 신호에 응답하여 영상을 표시한다. 상기 데이터 구동회로는 상기 데이터 라인에 상기 데이터 신호를 출력하고, 상기 게이트 구동회로는 상기 게이트 라인에 상기 게이트 신호를 출력한다.
상기 공통전압 발생회로는 제1 디지털 제어신호에 응답하여 공통전압의 전압레벨을 변경시켜 상기 표시패널로 제공하고, 상기 감마전압 발생회로는 감마 데이터를 아날로그 형태의 감마전압으로 변환하여 상기 데이터 구동회로로 제공한다. 상기 타이밍 제어회로는 외부신호에 응답하여 상기 영상 데이터와 제어 신호를 상기 구동부로 제공하고, 상기 제1 디지털 제어신호 및 상기 감마 데이터를 출력한다. 상기 인터페이스는 상기 공통전압 발생회로, 감마전원 발생회로 및 타이밍 제어회로에 접속되어 상기 회로들 사이의 데이터 통신을 수행한다.
이러한 표시장치에 따르면, 제어부의 회로들은 회로들 사이의 데이터 통신을 위한 디지털 인터페이스에 접속됨으로써, 회로들은 디지털 인터페이스에 접속된 마스터 회로에 의해서 제어되어 유동적인 데이터를 생성할 수 있고, 그 결과 표시장치의 생산성이 향상된다.
이하, 첨부한 도면들을 참조하여, 본 발명의 바람직한 실시예를 보다 상세하게 설명하고자 한다.
도 1은 본 발명의 일 실시예에 따른 액정표시장치의 블록도이다.
도 1을 참조하면, 본 발명의 일 실시예에 따른 액정표시장치(500)는 액정표시패널(100), 게이트 구동회로(210), 데이터 구동회로(220), 제어부(300), 외부 인터페이스(400) 및 내부 인터페이스(450)로 이루어진다.
상기 액정표시패널(100)에 서로 교차하는 다수의 게이트 라인(GL1 ~ GLn)과 다수의 데이터 라인(DL1 ~ DLm)이 구비되고, 상기 게이트 라인들(GL1 ~ GLn)과 데이터 라인들(DL1 ~ DLm)에 의해서 정의된 다수의 화소영역에는 영상을 표시하는 최소 단위인 다수의 화소가 각각 구비된다. 상기 화소들 각각은 박막 트랜지스터(Tr)와 액정 커패시터(Clc)로 이루어진다. 예를 들어, 제1 화소영역에서 상기 박막 트랜지스터(Tr)의 게이트 전극은 제1 게이트 라인(GL1)에 연결되고, 소오스 전극은 제1 데이터 라인(DL1)에 연결되며, 드레인 전극은 상기 액정 커패시터(Clc)의 일단에 결합된다.
상기 게이트 구동회로(210)는 칩 형태로 이루어져 상기 다수의 게이트 라인(GL1 ~ GLn)에 전기적으로 연결된다. 상기 게이트 구동회로(210)는 제1 동기신호(SYNC1), 제1 및 제2 클락(CKV, CKVB), 제1 및 제2 구동전압(VON, VOFF)에 응답하여 게이트 신호를 상기 게이트 라인들(GL1 ~ GLn)로 순차적으로 출력한다. 상기 데이터 구동회로(220)는 칩 형태로 이루어져 상기 다수의 데이터 라인(DL1 ~ DLm)에 전기적으로 연결된다. 상기 데이터 구동회로(220)는 제2 동기신호(SYNC2), 아날로그 감마전압(VGMMA) 및 제3 구동전압(AVDD)에 응답하여 데이터 신호를 상기 다수의 데이터 라인(DL1 ~ DLm)으로 출력한다.
한편, 상기 제어부(300)는 상기 외부 인터페이스(400)를 통해 외부 장치(미도시)와 연결된다. 상기 외부 인터페이스(400)는 상기 외부 장치로부터 제공된 각종 신호를 상기 액정표시장치(500)에 적절한 신호로 변환한 후 상기 제어부(300)로 제공한다. 상기 제어부(300)는 타이밍 제어회로(310), 비휘발성 메모리(320), 감마전압 발생회로(330), 공통전압 발생회로(340) 및 전원전압 발생회로(350)를 포함한다.
상기 내부 인터페이스(450)는 디지털 직렬 인터페이스로써, 상기 디바이스들(타이밍 제어회로(310), 비휘발성 메모리(320), 감마전압 발생회로(330), 공통전압 발생회로(340) 및 전원전압 발생회로(350))은 상기 내부 인터페이스(450)를 통해 서로 데이터 통신을 한다.
상기 타이밍 제어회로(310)는 칩 형태로 이루어져 외부 인터페이스(400)로부터 영상 데이터(I-DATA)와 외부 제어신호(SYNC, MCLK, DE)를 입력받는다. 상기 타이밍 제어회로(310)는 상기 영상 데이터(I-DATA)를 1 프레임 단위로 상기 프레임 메모리(미도시)에 저장한 후 1 라인 단위로 읽어들여 상기 데이터 구동회로(220)로 제공한다. 또한, 타이밍 제어회로(310)는 상기 외부 동기신호(SYNC, MCLK, DE)를 상기 제1 및 제2 동기신호(SYNC1, SYNC2), 제1 및 제2 클락(CKV, CKVB)으로 변환하여 출력한다.
상기 비휘발성 메모리(320)는 이이피롬(EEPROM)이다. 상기 비휘발성 메모리(320)에는 상기 내부 인터페이스(450)를 통해 입력된 상기 액정표시패널(100)에 관한 정보, 예를 들어 해상도와 패널 사이즈 등으로 이루어진 초기 데이터가 저장된 다. 상기 비휘발성 메모리(320)에는 상기 액정표시패널(100)에 표시된 화면의 평균 휘도에 따라 다른 계조값을 갖는 감마 데이터가 저장된다. 상기 화면의 평균 휘도가 기준 휘도보다 높으면 상기 감마 데이터는 기준 감마보다 높은 계조를 갖고, 상기 평균 휘도가 상기 기준 휘도보다 낮으면 상기 감마 데이터는 상기 기준 감마보다 낮은 계조를 갖는다.
상기 타이밍 제어회로(310)는 상기 비휘발성 메모리(320)에 저장된 디지털 형태의 상기 감마 데이터를 동기신호와 함께 상기 내부 인터페이스(450)를 통해 상기 감마전압 발생회로(330)로 전송한다. 상기 감마전압 발생회로(330)는 상기 동기신호에 응답하여 상기 감마 데이터를 아날로그 형태의 감마전압(VGMMA)으로 변환한다. 상기 감마전압 발생회로(330)로부터 출력된 상기 감마전압(VGMMA)은 상기 데이터 구동회로(220)로 전송된다.
상기 타이밍 제어회로(310)는 상기 비휘발성 메모리(320)에 저장된 상기 초기 데이터를 근거로하여 제1 디지털 데이터를 생성하고, 상기 제1 디지털 데이터와 동기신호를 상기 내부 인터페이스(450)를 통해 상기 전원전압 발생회로(350)로 전송한다. 상기 전원전압 발생회로(350)는 상기 동기신호와 상기 제1 디지털 데이터에 응답하여 외부전압(Vp)을 상기 액정표시패널(100)에 적절한 제1 내지 제3 구동전압(VON, VOFF, AVDD), 로직전압(미도시)으로 변환하여 출력한다. 여기서, 상기 로직전압은 상기 공통전압 발생회로(340), 타이밍 제어회로(310) 및 감마전압 발생회로(330)를 구동시키기 위한 전압이다.
상기 타이밍 제어회로(310)는 상기 비휘발성 메모리(320)에 저장된 상기 초 기 데이터를 근거로하여 제2 디지털 데이터를 생성하고, 상기 제2 디지털 데이터와 동기신호를 상기 내부 인터페이스(450)를 통해 상기 공통전압 발생회로(340)로 전송한다. 상기 공통전압 발생회로(340)는 상기 제2 디지털 데이터와 동기신호에 응답하여 제3 구동전압(AVDD)을 상기 액정표시패널(100)에 적절한 공통전압(VCOM)으로 변환하여 출력한다.
도 2는 도 1에 도시된 제어부를 구체적으로 나타낸 블록도이고, 도 3은 도 2에 도시된 시리얼 데이터 라인과 시리얼 클락 라인의 파형도를 나타낸 도면이다.
도 2를 참조하면, 제어부(300)는 타이밍 제어회로(310), 메모리(320), 감마전압 발생회로(330), 공통전압 발생회로(340) 및 전원전압 발생회로(350)를 포함하고, 상기 회로들은 내부 인터페이스(400)를 통해 서로 데이터 통신을 한다. 상기 내부 인터페이스(400)는 디지털 직렬 인터페이스의 하나인 상기 아이스퀘어씨(Inter Integrated Circuit; 이하, I2C라 함) 인터페이스로 이루어진다.
상기 I2C 인터페이스는 양방향성 2-와이어 인터페이스로써, 데이터 통신을 위한 시리얼 데이터 라인(SDA)과 상기 회로들 사이의 데이터 통신을 제어 및 동기화하기 위한 시리얼 클락 라인(SCL)으로 이루어진다. 상기 I2C 인터페이스에 접속된 회로들은 고유의 어드레스에 의해서 식별되고, 회로들 각각은 데이터를 송신 또는 수신할 수 있다. 상기 회로들 사이에서 데이터 전달은 마스터-슬레이브 프로토콜 방식으로 이루어진다. 상기 마스터는 데이터 전송을 개시하고, 클락을 생성하고, 상기 마스터를 제외한 나머지 회로들은 상기 마스터와 데이터를 주고 받는 슬레이 브이다.
본 발명의 일 실시예에 따른 제어부(300)에서 마스터는 상기 타이밍 제어회로(310)이고, 슬레이브는 상기 비휘발성 메모리(320), 감마전압 발생회로(330), 공통전압 발생회로(340) 및 전원전압 발생회로(350)이다. 상기 I2C 인터페이스는 멀티 마스터를 가질 수 있다.
도 3에 도시된 바와 같이, 개시(S) 조건은 시리얼 클락 라인(SCL) 상의 신호가 하이 상태로 존재할 때, 시리얼 데이터 라인(SDA) 상의 신호가 하이 상태에서 로우 상태로 전이되는 것이다. 개시(S) 이후에, 상기 마스터는 7비트인 어드레스(ADR)를 전송하며, 상기 어드레스(ADR) 다음에 데이터 전달의 방향을 나타내는 판독/기록 표시자(R/W)가 따른다.
상기 어드레스(ADR)와 판독/기록 표시자(R/W)를 전달한 후, 상기 마스터는 상기 시리얼 데이터 라인(SDA)을 하이 상태로 전이시킨다. 슬레이브가 자신의 어드레스(ADR)를 인식한다면, 상기 슬레이브는 상기 I2C 인터페이스 상의 신호를 풀다운 시킴으로써, 긍정응답신호(Acknowledge signal; ACK)를 상기 마스터로 전송한다. 한편, 상기 어드레스(ADR)를 인식하지 않는 슬레이브는 로우 상태로 존재하지 않음으로써 부정응답신호(NAK)를 상기 마스터로 전송한다.
상기 마스터에 긍정응답신호(ACK)가 전송되면, 상기 마스터 또는 해당 슬레이브는 데이터(D)를 전송한다. 상기 데이터 전달의 방향이 판독(R) 방향이면, 해당 슬레이브가 마스터로 데이터(D)를 전송하고, 기록(W) 방향이면 마스터가 해당 슬레 이브로 데이터(D)를 전송한다. 데이터(D)를 전송하는 전송 디바이스(마스터 또는 슬레이브)에 긍정응답신호(ACK)가 수신되면, 상기 전송 디바이스는 데이터(D)를 수신하는 수신 디바이스(슬레이브 또는 마스터)에 추가 데이터를 전송한다.
이러한 과정은 상기 전송 디바이스에 부정응답신호(NAK)가 수신될 때까지 계속된다. 이어서, 상기 마스터는 데이터 통신을 다시 개시(S)하거나 종결(P)시킨다. 여기서, 상기 종결(P) 조건은 시리얼 클락 라인(SCL) 상의 신호가 하이 상태로 존재할 때, 시리얼 데이터 라인(SDA) 상의 신호가 로우 상태에서 하이 상태로 전이되는 것이다.
도 2에서는 상기 내부 인터페이스(450)가 2-와이어 버스인 상기 I2C 인터페이스로 이루어진 것을 도시하였지만, 상기 내부 인터페이스(450)는 3-와이어 버스인 시리얼 주변 인터페이스(Serial Peripheral Interface ; 이하, SPI라 함)로 이루어질 수도 있다. 도면에 도시하지는 않았지만, 상기 SPI는 데이터 전송을 위한 제1 시리얼 데이터 라인, 데이터 수신을 위한 제2 시리얼 데이터 라인 및 상기 디바이스들 사이의 데이터 통신을 제어 및 동기화하기 위한 시리얼 클락 라인으로 이루어진다.
도 4는 디지털 직렬 인터페이스를 나타낸 도면이고, 도 5는 디지털 병렬 인터페이스를 나타낸 도면이다.
도 4 및 도 5를 참조하면, 전송 디바이스(10)는 데이터를 전송하는 디바이스이고, 수신 디바이스(20)는 데이터를 수신하는 디바이스이다.
디지털 직렬 인터페이스 방식에서 상기 전송 디바이스(10)와 상기 수신 디바이스(10)는 하나의 데이터 라인(11)으로 연결된다. 따라서, 상기 전송 디바이스(10)에 저장된 8비트의 데이터는 상기 데이터 라인(11)을 통해 1비트씩 순차적으로 상기 수신 디바이스(20)로 전송된다. 한편, 디지털 병렬 인터페이스 방식에서 상기 전송 디바이스(10)와 상기 수신 디바이스(20)는 다수의 데이터 라인(12)으로 연결된다. 따라서, 상기 전송 디바이스(10)에 저장된 8비트의 데이터는 상기 8개의 데이터 라인(12)을 통해 1비트씩 동시에 상기 수신 디바이스(20)로 전송된다.
도 1 내지 도 3에서는 상기 내부 인터페이스(450)가 디지털 직렬 인터페이스로 한정하였지만, 상기 내부 인터페이스(450)는 디지털 병렬 인터페이스로 이루어질 수 있다.
도 6은 도 1에 도시된 타이밍 제어회로를 구체적으로 나타낸 블록도이고, 도 7은 도 6에 도시된 데이터 블록을 구체적으로 나타낸 도면이다.
도 6을 참조하면, 타이밍 제어회로(310)는 외부 인터페이스(400, 도 1에 도시됨)로부터 영상 데이터(I-DATA), 데이터 인에이블 신호(DE), 외부 동기신호(SYNC) 및 메인클락(MCLK)을 입력받는다. 상기 타이밍 제어회로(310)는 상기 영상 데이터(I-DATA)를 처리하는 데이터 블록(311) 및 상기 데이터 인에이블 신호(DE), 동기신호(SYNC) 및 메인클락(MCLK)을 이용하여 제1 및 제2 동기신호(SYNC1, SYNC2)를 생성하는 제어신호 블록(312)을 포함한다.
도 7에 도시된 바와 같이, 상기 데이터 블록(311)은 정밀한 컬러 획득(Accurate Color Capture; 이하, ACC) 블록(AB) 및 동적 용량 보상(Dynamic Capacitance Compensation; 이하, DCC) 블록(DB)으로 이루어진다. 상기 ACC 블록(AB)은 계조 확장기(311a)와 계조 축소기(311b)로 구성되고, 상기 DCC 블록(DB)은 룩업 테이블(311c)과 DCC 변환부(311d)로 구성된다.
상기 ACC 블록(AB)은 액정표시장치(500, 도 1에 도시됨)의 색 특성을 향상시키기 위해 마련된 것이다. 상기 영상 데이터(I-DATA)의 비트수는 화소에 인가될 전압을 결정한다. 즉, N 비트의 상기 영상 데이터(I-DATA)는 2N개의 계조로 표현된다. 결과적으로, 계조 수를 증가시키기 위해서는 상기 영상 데이터(I-DATA)의 비트수를 증가시켜야 하지만, 상기 영상 데이터(I-DATA)의 비트수를 증가시키면 시스템이 복잡해진다. 그러나, 상기 ACC 블록(AB)은 N비트의 상기 영상 데이터(I-DATA)를 이용하여 2N개 이상의 계조를 표현할 수 있다.
구체적으로, 상기 ACC 블록(AB)으로 입력된 N비트의 상기 영상 데이터(I-DATA)는 상기 계조 확장기(311a)를 통해 N+d 비트로 확장된다. 이후, 상기 데이터 구동회로(220, 도 1에 도시됨)가 처리 가능한 비트수로 변환하기 위하여 상기 N+d 비트의 상기 영상 데이터는 상기 계조 축소기(311b)를 통해 다시 N 비트로 축소된다. 상기 계조 축소기(311b)는 상기 영상 데이터(I-DATA)의 비트수를 축소시킴과 동시에, 연속하는 두 계조(A, A+1)를 1 프레임 단위로 교번적으로 발생시킨다. 따라서, 두 계조(A, A+1)의 평균 계조(2A+1/2)가 상기 액정표시장치(500)에 표시될 수 있다. 확장 비트수가 증가할수록 두 계조 사이를 더욱 정밀하게 분할할 수 있다.
이로써, 상기 영상 데이터(I-DATA)를 N비트로 고정시킨 상태에서 계조수를 확장시킴으로써 상기 액정표시장치(500)의 색 특성을 향상시킬 수 있다.
한편, 액정이 응답하는데에는 소정의 시간이 소요됨으로써, 상기 액정표시장치(500)에서 소정의 계조값을 표현하는데에는 시간 지연이 발생한다. 상기 DCC 블록(DB)은 이러한 시간 지연을 감소시키기 위해 마련된 것이다. 이전 프레임의 계조값(B)보다 현재 프레임의 계조값(B1)이 더 큰 경우, 상기 DCC 블록(DB)은 현재 프레임의 계조값(B1)을 더 큰 계조값(B2)으로 변환한다. 따라서, 상기 DCC 블록(DB)간 지연을 감소시킨다.
구체적으로, 상기 계조 축소기(311b) 출력된 상기 N 비트의 영상 데이터(I-DATA)는 상기 DCC 블록(DB)으로 전송되며, 상기 프레임 메모리(390)에는 상기 N 비트의 데이터 중에서 상위 n비트(여기서, n ≤N)의 데이터가 입력된다. 상기 프레임 메모리(390)에는 1 프레임 단위의 데이터가 저장된다.
상기 DCC 블록(DB)의 상기 룩업 테이블(311c)에는 상기 프레임 메모리(390)로부터 출력된 n비트의 이전 프레임 데이터와 상기 계조 축소기(311b)로부터 출력된 N비트의 현재 프레임 데이터 중에서 상위 m비트(여기서, m≤N)의 데이터가 입력된다. 상기 룩업 테이블(311c)에서는 상기 이전 프레임 데이터와 상기 현재 프레임 데이터를 어드레스로 하여 기 저장되어 있는 m비트의 보정 데이터를 출력한다. m비트의 보정 데이터는 상기 DCC 변환부(311d)로 제공된다. 상기 DCC 변환부(311d)는 상기 m비트의 보정 데이터를 근거로하여 N비트의 현재 프레임 데이터(C-DATA)를 출력한다. 이로써, 상기 액정표시장치(500)의 응답 속도를 향상시킬 수 있다.
다시 도 6을 참조하면, 상기 제어신호 블록(312)은 상기 데이터 인에이블 신호(DE), 외부 동기신호(SYNC) 및 메인클락(MCLK)을 이용하여 제1 및 제2 동기신호(SYNC1, SYNC2), 제1 및 제2 클락(CKV, CKVB)을 생성한다. 상기 제1 동기신호(SYNC1), 제1 및 제2 클락(CKV, CKVB)은 상기 게이트 구동회로(210)로 제공되고, 상기 제2 동기신호(SYNC2)는 상기 데이터 구동회로(220)로 제공된다.
상기 타이밍 제어회로(310)는 인터페이스 블록(313)을 더 포함한다. 상기 인터페이스 블록(313)은 상기 내부 인터페이스(450)의 시리얼 데이터 라인과 시리얼 클락 라인에 접속된다. 상기 인터페이스 블록(313)은 상기 시리얼 데이터 라인(SDA)으로부터 제공된 데이터를 적절한 신호로 변환하여 상기 타이밍 제어회로(310)의 데이터 블록(311) 또는 슬레이브 회로들(320, 330, 340, 350)로 각각 제공한다.
도 8은 도 1에 도시된 공통전압 발생회로를 나타낸 도면이다.
도 8을 참조하면, 공통전압 발생회로(340)는 변환부(341) 및 디지털 가변 저항부(342)로 이루어진다. 상기 변환부(341)는 전원전압 발생회로(330, 도 1에 도시됨)로부터 제공된 제3 구동전압(AVDD)을 상기 공통전압(VCOM)으로 변환한다. 상기 변환부(341)는 상기 제3 구동전압(AVDD)과 접지전압(VG)과의 사이에서 직렬 연결된 제1 및 제2 저항(R1, R2), 제1 노드(N1)에 접속되어 상기 제1 및 제2 저항(R1, R2)에 의해서 분압된 상기 공통전압(VCOM)을 출력하는 버퍼(341a)를 포함한다.
상기 디지털 가변 저항부(342)의 출력단자(OUT)는 상기 제1 노드(N1)에 결합되고, 셋단자(SET)는 리셋저항(Rreset)을 통해 접지전압단자에 연결된다. 상기 디 지털 가변 저항부(342)는 상기 내부 인터페이스(450)를 통해 상기 타이밍 제어회로(310)와 연결된다. 상기 디지털 가변 저항부(342)는 상기 제1 디지털 제어신호에 응답하여 상기 제1 노드(N1)에서의 전류를 제어함으로써 상기 공통전압(VCOM)의 전압레벨을 조절한다.
상기 타이밍 제어회로(310)는 상기 비휘발성 메모리(320, 도 1에 도시됨)에 저장된 상기 액정표시패널(100, 도 1에 도시됨)에 관한 정보로 이루어진 초기 데이터를 근거로하여 상기 제1 디지털 제어신호를 출력한다. 여기서, 상기 제1 디지털 제어신호는 상기 제1 노드(N1)의 전류를 조절할 수 있는 저항 데이터와 동기신호를 포함한다. 따라서, 상기 공통전압 발생회로(340)는 상기 액정표시패널(100)에 적절한 전압레벨을 갖는 상기 공통전압(VCOM)을 생성할 수 있다.
도면에 도시하지는 않았지만, 상기 공통전압 발생회로(340)의 내부에는 비휘발성 메모리(미도시)가 구비될 수 있다. 상기 공통전압 발생회로(340)는 상기 타이밍 제어회로(310)와의 데이터 통신을 통하지 않고도 비휘발성 메모리에 저장된 데이터를 근거로하여 상기 액정표시패널(100)에 적절한 전압레벨을 갖는 상기 공통전압(VCOM)을 자체적으로 생성할 수 있다.
도 9는 도 1에 도시된 전원전압 발생회로를 나타낸 도면이다.
도 9를 참조하면, 전원전압 발생회로(350)는 제1 전압발생부(351), 제2 전압발생부(352) 및 인터페이스부(353)를 포함한다.
상기 인터페이스부(353)는 상기 내부 인터페이스(450)를 통해 상기 타이밍 제어회로(310)와 연결된다. 상기 타이밍 제어회로(310)는 상기 비휘발성 메모리 (320, 도 1에 도시됨)에 저장된 상기 액정표시패널(100, 도 1에 도시됨)에 관한 정보로 이루어진 초기 데이터를 근거로하여 제2 디지털 제어신호를 출력한다. 상기 인터페이스부(353)는 상기 제2 디지털 제어신호를 상기 제1 및 제2 전압발생부(351, 352)에 적절한 제1 및 제2 전압제어신호(VCS1, VCS2)로 변환한다.
상기 제1 전압발생부(351)는 상기 제1 전압제어신호(VCS1)에 응답하여 외부전원(Vp)을 상기 액정표시장치(500)에 적절한 레벨을 갖는 제1, 제2 및 제3 구동전압(VON, VOFF, AVDD)으로 변환한다. 상기 제1 전압발생부(351)로부터 출력된 상기 제1 및 제2 구동전압(VON, VOFF)은 게이트 구동회로(210)로 제공되고, 상기 제3 구동전압(AVDD)은 상기 데이터 구동회로(220)로 제공된다. 한편, 상기 제2 전압발생부(352)는 상기 제2 전압제어신호(VCS2)에 응답하여 상기 외부전원(Vp)을 로직전압(Vlogic)으로 변환한다. 상기 로직전압(Vlogic)은 상기 제어부(300)에 포함된 회로들에 제공되어 상기 회로들을 구동시킨다.
이와 같이, 상기 디지털 신호를 이용하여 액정표시장치의 사양에 따라서 상기 제1 내지 제3 구동전압(VON, VOFF, AVDD)과 로직전압(Vlogic)의 전압레벨을 조절함으로써, 상기 게이트 구동부, 데이터 구동부 및 상기 회로들은 항상 최적의 전압레벨을 갖는 전압에 응답하여 동작할 수 있다.
도 10은 본 발명의 다른 실시예에 따른 액정표시장치의 블록도이다. 단, 도 10에서는 도 1에 도시된 구성요소와 동일한 구성요소에 대해서 동일한 참조부호를 병기하고, 그에 대한 구체적인 설명은 생략한다.
도 10을 참조하면, 본 발명의 다른 실시예에 따른 액정표시장치(501)에서 제 어부(300)는 온도감지회로(360), 휘도감지회로(370) 및 인버터 제어회로(380)를 더 포함한다. 상기 온도감지회로(360), 휘도감지회로(370) 및 인버터 제어회로(380)는 내부 인터페이스(450)에 접속된다. 여기서, 상기 인버터 제어회로(380)는 상기 타이밍 제어회로(310)를 대신하여 상기 내부 인터페이스(450)의 마스터로써 동작할 수 있다.
일반적으로, 액정은 온도에 따라 특성이 변화된다. 구체적으로, 온도에 따라 응답속도, 투과율 및 액정 용량 등이 변화된다. 상기 온도감지회로(360)는 액정표시장치(501)의 주변 온도를 감지하여, 감지된 온도를 디지털 온도 데이터로 변환하여 상기 내부 인터페이스(450)를 통해 타이밍 제어회로(310)로 제공한다. 상기 타이밍 제어회로(310)는 상기 온도 데이터에 따라서 상기 공통전압(VCOM)의 전압 레벨을 변경하도록 제1 디지털 제어신호를 상기 내부 인터페이스(450)를 통해 상기 공통전압 발생회로(340)로 제공한다.
이로써, 상기 액정표시장치(501)의 주변 온도가 변화되더라도 상기 액정표시장치(501)는 최적의 응답속도, 투과율 및 액정 용량을 가질 수 있다.
한편 도 7에 도시된 바와 같이, 상기 타이밍 제어회로(310)에 구비된 DCC 블록(DB)은 액정의 응답속도를 보상하기 위해 마련된 것이고, 상기 DCC 블록(DB)의 룩업 테이블(311c)에는 상온의 환경에 적절한 보상 데이터가 저장된다. 이때, 상기 타이밍 제어회로(310)는 상기 온도감지회로(360)로부터의 상기 온도 데이터에 따라서 상기 룩업 테이블(311c)에 저장된 보상 데이터를 변화시킬 수 있다. 따라서, 상기 액정표시장치(501)의 주변 온도가 변화되더라도 상기 액정표시장치(501)는 최적 의 응답속도를 가질 수 있다.
상기 휘도감지회로(370) 및 인버터 제어회로(380)는 이후 도 11을 참조하여 구체적으로 설명한다.
도 11은 도 10에 도시된 인버터 제어회로와 휘도감지회로를 구체적으로 나타낸 도면이다.
도 11을 참조하면, 액정표시장치(501)는 액정표시패널(100, 도 10에 도시됨)에 광을 제공하기 위한 제1, 제2, 제3 및 제4 램프(231, 232, 233, 234)를 포함한다. 상기 제1 내지 제4 램프(231 ~ 234) 각각은 제1 및 제2 램프 구동전압에 응답하여 상기 광을 발생한다. 인터버(230)는 상기 제1 및 제2 램프 구동전압을 상기 제1 내지 제4 램프(231 ~ 234)에 제공함으로써, 상기 제1 내지 제4 램프(231 ~ 234)를 구동시킨다.
상기 휘도감지회로(370)는 상기 제1 내지 제4 램프(231 ~ 234) 각각으로부터 발생된 광의 휘도를 감지하는 제1, 제2, 제3 및 제4 센서(371, 372, 373, 374)와 상기 제1 내지 제4 센서(371 ~ 374) 각각으로부터 감지된 휘도를 디지털 값으로 변환하는 프로세서(375)로 이루어진다. 상기 프로세서(375)에서 변환된 디지털 값은 상기 내부 인터페이스(450)를 통해 상기 타이밍 제어회로(310)로 제공된다.
상기 타이밍 제어회로(310)는 상기 디지털 값에 응답하여 상기 제1 내지 제4 램프(231 ~234)의 휘도를 기 설정된 기준 휘도와 비교한다. 상기 타이밍 제어회로(310)는 비교 결과에 따라서 상기 인버터(230)로부터 출력되는 상기 제1 및 제2 램프 구동전압의 전압레벨을 조절하도록 상기 인버터 제어회로(380)에 제3 디지털 제 어신호를 전송한다.
상기 제1 내지 제4 램프(231 ~ 234)의 휘도가 상기 기준 휘도보다 낮은 경우, 상기 제3 디지털 제어신호에 응답하여 상기 인버터 제어회로(380)는 상기 인버터(230)로부터 출력되는 상기 제1 및 제2 램프 구동전압의 전압차를 증가시킨다. 이로써, 상기 제1 내지 제4 램프(231 ~ 234)의 휘도를 상기 기준 휘도까지 증가시킬 수 있다. 한편, 상기 제1 내지 제4 램프(231 ~ 234)의 휘도가 상기 기준 휘도보다 높은 경우, 상기 제3 디지털 제어신호에 응답하여 상기 인버터 제어회로(380)는 상기 인버터(230)로부터 출력되는 상기 제1 및 제2 램프 구동전압의 전압차를 감소시킨다. 이로써, 상기 제1 내지 제4 램프(231 ~ 234)의 휘도를 상기 기준 휘도까지 감소시킬 수 있다.
이와 같은 과정에 의해서 상기 액정표시장치(501)의 휘도 균일성을 확보할 수 있고, 그 결과 상기 액정표시장치(501)의 표시 특성을 향상시킬 수 있다.
이와 같은 표시장치에 따르면, 제어부의 회로들은 회로들 사이의 데이터 통신을 위한 디지털 인터페이스에 접속됨으로써, 회로들은 디지털 인터페이스에 접속된 마스터 회로에 의해서 제어되어 유동적인 데이터를 생성할 수 있다. 따라서, 상기 회로들을 기계적으로 조작하거나 교체하는 과정이 불필요하고, 그로 인해 표시장치의 생산성이 향상될 수 있다.
이상 실시예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.

Claims (25)

  1. 구동신호에 응답하여 영상을 표시하는 표시부;
    제어신호에 응답하여 상기 표시부에 상기 구동신호를 출력하는 구동부;
    상기 제어신호를 출력하는 다수의 회로로 이루어진 제어부; 및
    상기 제어부의 상기 회로들 사이에 접속되어 상기 회로들 사이의 데이터 통신을 위한 인터페이스를 포함하는 것을 특징으로 하는 표시장치.
  2. 제1항에 있어서, 상기 인터페이스는 직렬 디지털 인터페이스인 것을 특징으로 하는 표시장치.
  3. 제2항에 있어서, 상기 인터페이스는 양방향성을 갖는 아이스퀘어씨(Inter Integrated Circuit; I2C) 인터페이스인 것을 특징으로 하는 표시장치.
  4. 제3항에 있어서, 상기 아이스퀘어씨 인터페이스는,
    데이터가 이동하는 시리얼 데이터 라인; 및
    상기 회로들 사이의 데이터 통신을 제어 및 동기화하기 위한 시리얼 클락 라인을 포함하는 것을 특징으로 하는 표시장치.
  5. 제1항에 있어서, 상기 인터페이스는 병렬 디지털 인터페이스인 것을 특징으로 하는 표시장치.
  6. 제1항에 있어서, 상기 제어부는,
    상기 인터페이스에 접속되고 제1 디지털 제어신호에 응답하여 공통전압의 전압레벨을 변경시켜 출력하는 공통전압 발생회로; 및
    외부신호에 응답하여 영상 데이터와 제어 신호를 상기 구동부로 제공하고, 상기 인터페이스에 접속된 타이밍 제어회로를 포함하는 것을 특징으로 하는 표시장치.
  7. 제6항에 있어서, 상기 타이밍 제어회로는 상기 인터페이스의 마스터로써 상기 제1 디지털 제어신호를 상기 인터페이스로 출력하고, 상기 공통전압 발생회로는 상기 인터페이스의 슬레이브로써 상기 제1 디지털 제어신호를 수신하는 것을 특징으로 하는 표시장치.
  8. 제7항에 있어서, 상기 타이밍 제어회로는,
    상기 영상 데이터를 처리하는 데이터 블록;
    외부 동기신호를 이용하여 상기 구동부로 제공되는 상기 제어신호를 생성하는 제어신호 블록; 및
    상기 인터페이스를 통해 입력된 데이터와 동기신호를 상기 제어부의 회로들 에 적절한 신호로 변환하여 상기 인터페이스로 출력하는 인터페이스 블록을 포함하는 것을 특징으로 하는 표시장치.
  9. 제8항에 있어서, 상기 구동부는,
    상기 영상 데이터와 상기 제어신호 중 데이터 제어신호에 응답하여 상기 구동신호 중 데이터 신호를 출력하는 데이터 구동부; 및
    상기 제어신호 중 게이트 제어신호에 응답하여 상기 구동신호 중 게이트 신호를 출력하는 게이트 구동부를 포함하는 것을 특징으로 하는 표시장치.
  10. 제8항에 있어서, 상기 데이터 블록은,
    상기 영상 데이터의 비트수를 확장시키는 ACC 블록; 및
    상기 영상 데이터의 계조 값을 변환하는 DCC 블록을 포함하는 것을 특징으로 하는 표시장치.
  11. 제6항에 있어서, 상기 제어부는 상기 표시부에 관한 정보를 포함하는 초기 데이터가 저장된 비휘발성 메모리를 더 포함하고,
    상기 타이밍 제어회로는 상기 공통전압 발생회로가 상기 표시부에 적절한 상기 공통전압을 출력하도록 상기 초기 데이터를 근거로한 상기 제1 디지털 제어신호를 생성하는 것을 특징으로 하는 표시장치.
  12. 제11항에 있어서, 상기 공통전압 발생회로는,
    상기 전원전압 발생회로로부터 제공된 전압을 상기 공통전압으로 변환하는 변환부; 및
    상기 제1 디지털 제어신호에 응답하여 상기 공통전압의 전압레벨을 조절하는 디지털 가변 저항부를 포함하는 것을 특징으로 하는 표시장치.
  13. 제12항에 있어서, 상기 변환부는,
    상기 전압과 접지전압과의 사이에서 직렬 연결된 제1 및 제2 저항; 및
    상기 제1 및 제2 저항에 의해서 분압된 상기 공통전압을 출력하는 버퍼로 이루어진 것을 특징으로 하는 표시장치.
  14. 제1항에 있어서, 상기 제어부는,
    상기 인터페이스에 접속되고 감마 데이터를 아날로그 형태의 감마전압으로 변환하는 감마전압 발생회로; 및
    외부신호에 응답하여 영상 데이터와 제어 신호를 상기 구동부로 제공하고, 상기 인터페이스에 접속된 타이밍 제어회로를 포함하는 것을 특징으로 하는 표시장치.
  15. 제14항에 있어서, 상기 제어부는,
    상기 인터페이스에 접속되고, 상기 표시부에 관한 정보를 포함하는 초기 데 이터 및 상기 감마 데이터가 저장된 비휘발성 메모리; 및
    상기 영상 데이터를 1 프레임 단위로 저장하는 프레임 메모리를 더 포함하는 것을 특징으로 하는 표시장치.
  16. 제15항에 있어서, 상기 타이밍 제어회로는 1 프레임 단위의 영상 데이터를 상기 프레임 메로리로부터 입력받아 상기 표시부의 1 프레임 단위의 평균 휘도를 계산하고, 상기 평균 휘도에 대응하는 상기 감마 데이터를 상기 비휘발성 메모리에서 판독하여 상기 감마전압 발생회로로 출력하는 것을 특징으로 하는 표시장치.
  17. 제14항에 있어서, 상기 제어부는,
    상기 인터페이스에 접속되고 제1 디지털 제어신호에 응답하여 공통전압의 전압레벨을 변경시켜 출력하는 공통전압 발생회로; 및
    상기 인터페이스에 접속되고 제2 디지털 제어신호에 응답하여 전원전압을 구동전압 및 로직전압으로 변환하여 출력하는 전원전압 발생회로를 더 포함하는 것을 특징으로 하는 표시장치.
  18. 제17항에 있어서, 상기 전원전압 발생회로는,
    상기 인터페이스에 접속되어 상기 타이밍 제어회로로부터의 상기 제2 디지털 제어신호를 제1 및 제2 제어신호로 변환하는 인터페이스부;
    상기 제1 제어신호에 응답하여 상기 외부전원을 상기 구동부를 구동시키기 위한 상기 구동전압으로 변환하는 구동전압 발생부; 및
    상기 제2 제어신호에 응답하여 상기 외부전원을 상기 회로들 각각을 구동시키기 위한 상기 로직전압으로 변환하는 로직전압 발생부를 포함하는 것을 특징으로 하는 표시장치.
  19. 제17항에 있어서, 상기 제어부는 상기 표시부의 주변 온도를 감지하고, 감지된 상기 주변 온도를 디지털 온도 데이터로 변환하여 상기 인터페이스를 통해 타이밍 제어회로로 제공하는 온도감지회로를 더 포함하는 것을 특징으로 하는 표시장치.
  20. 제19항에 있어서, 상기 타이밍 제어회로는 상기 디지털 온도 데이터에 응답하여 상기 공통전압의 전압레벨을 변경하도록 상기 제1 디지털 제어신호를 상기 인터페이스를 통해 상기 공통전압 발생회로로 제공하는 것을 특징으로 하는 표시장치.
  21. 제14항에 있어서, 제1 및 제2 램프 구동전압을 출력하는 인버터; 및
    상기 제1 및 제2 램프 구동전압에 응답하여 광을 발생하는 램프로 이루어지고, 상기 광을 상기 표시부로 제공하는 광 발생부를 더 포함하는 것을 특징으로 하는 표시장치.
  22. 제21항에 있어서, 상기 제어부는,
    상기 광 발생부로부터 출력된 상기 광의 휘도를 감지하고, 감지된 상기 휘도를 디지털 값으로 변환하여 상기 인터페이스를 통해 상기 타이밍 제어회로로 제공하는 휘도감지회로; 및
    상기 휘도의 디지털 값을 근거로하여 생성된 제3 디지털 제어신호를 상기 타이밍 제어회로로부터 입력받아 상기 인버터로부터 출력되는 상기 제1 및 제2 램프 구동전압의 전압레벨을 조절하는 인버터 제어회로를 더 포함하는 것을 특징으로 하는 표시장치.
  23. 제22항에 있어서, 감지된 상기 휘도가 기 설정된 기준 휘도보다 낮은 경우, 상기 인버터 제어회로는 상기 제1 및 제2 램프 구동전압의 전압차가 증가되도록 상기 인버터를 제어하고,
    감지된 상기 휘도가 기 설정된 기준 휘도보다 높은 경우, 상기 인버터 제어회로는 상기 제1 및 제2 램프 구동전압의 전압차가 감소되도록 상기 인버터를 제어하는 것을 특징으로 하는 표시장치.
  24. 데이터 신호를 입력받는 데이터 라인과 게이트 신호를 입력받는 게이트 라인이 구비되고, 상기 데이터 신호와 게이트 신호에 응답하여 영상을 표시하는 표시패널;
    상기 데이터 라인에 상기 데이터 신호를 출력하는 데이터 구동회로;
    상기 게이트 라인에 상기 게이트 신호를 출력하는 게이트 구동회로;
    제1 디지털 제어신호에 응답하여 공통전압의 전압레벨을 변경시켜 상기 표시패널로 제공하는 공통전압 발생회로;
    감마 데이터를 아날로그 형태의 감마전압으로 변환하여 상기 데이터 구동회로로 제공하는 감마전압 발생회로;
    외부신호에 응답하여 상기 영상 데이터와 제어 신호를 상기 구동부로 제공하고, 상기 제1 디지털 제어신호 및 상기 감마 데이터를 출력하는 타이밍 제어회로; 및
    상기 공통전압 발생회로, 감마전원 발생회로 및 타이밍 제어회로에 접속되어 상기 회로들 사이의 데이터 통신을 수행하는 인터페이스를 포함하는 것을 특징으로 하는 표시장치.
  25. 제24항에 있어서, 상기 표시패널에 관한 정보를 포함하는 초기 데이터, 감마 데이터가 저장되고, 상기 인터페이스에 접속되어 상기 타이밍 제어회로와 데이터 통신을 수행하는 비휘발성 메모리; 및
    상기 인터페이스에 접속되어 상기 타이밍 제어회로로부터 제2 디지털 제어신호을 수신하고, 상기 제2 디지털 제어신호에 응답하여 전원전압을 구동전압과 로직전압으로 변환하여 출력하는 전원전압 발생회로를 더 포함하는 것을 특징으로 하는 표시장치.
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