KR20040057873A - 패리티 비트를 재순환시키는 연속 코드 디코더 및 그 방법 - Google Patents
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Abstract
패리티 비트를 재순환시키는 연속 코드 디코더 및 그 방법이 개시된다. 상기 연속 코드 디코더는, 잡음이 많은 환경, 즉, 수신된 신호가 14.9dB 보다 작은 SNR을 가지는 환경에서도 안정적으로 디코딩 처리할 수 있다. 따라서, 이를 구비한 디지털 텔레비전 수신 장치로 VSB 신호를 안정적으로 수신하여 영상 처리함으로써, 디지털 텔레비전에서 왜곡 없이 깨끗한 영상이 디스플레이 될 수 있다.
Description
본 발명은 디지털 텔레비전(Digital Television)(이하 "DTV"라 약칭함) 수신 장치에 관한 것으로서, 특히 DTV 수신 장치의 디코더에 관한 것이다.
최근 DTV 분야에서는 강인한(robust) DTV 수신 장치나 디지털 셋 탑(set-top) 박스에 관한 연구가 많이 수행되고 있다. DTV 신호 송수신을 위한 잔류 측파대(Vestigial Side Band)(이하 "VSB"라 약칭함) 신호는 ATSC(Advanced Television Subcommittee)에서 규정하고 있다. 그런데, 하나의 캐리어(carrier)를 가지는 VSB 신호 형식의 지상파 방송 신호는 다중 경로(multipath) 채널 하에서 DTV 수신 장치에 의하여 수신되기 어렵다. 따라서, 잡음이 많은 다중 경로(multi-path) 채널 하에서 VSB 신호를 안정적으로 수신할 수 있는 강건한(robust) 수신 장치는 필수적이다. 여기서는 강건한(robust) 수신 장치를 위하여 사용되는 디코더에 대하여 언급한다.
특히, 디코더에서 디코딩될 연속 코드는 내부 코드와 외부 코드로 구성되는 이중 구조로 부호화된 형태의 코드이다. 내부 코드가 외부 코드를 부호화한다. 내부 코드는 통신 채널에서 유입되는 대부분의 에러를 정정하고, 일반적인 회선(convolution) 코드에 해당한다. 외부 코드는 최초 디코딩 시에 발생하는 대부분의 디코딩 에러를 정정한다. 리드 솔로몬(Reed-Solomon)(이하 "RS"라 약칭함) 코드는 주로 외부 코드로 사용된다.
도 1은 종래의 일반적인 연속 코드 디코더(100)의 블록도이다. 상기 디코더(100)는 외부 인코더(outer encoder)(102), 옵션(option)인 인터리버(interleaver)(104), 내부 인코더(inner encoder)(106), 변조기(modulator)(108), 통신 채널(channel)(110), 복조기(demodulator)(112), 내부 디코더(inner decoder)(114), 상기 인터리버(104)가 있는 경우에 존재하는 옵션인 디인터리버(de-interleaver)(116), 및 외부 디코더(outer decoder)(118)를 포함한다.
도 2는 종래의 연속 코드 반복 디코더(200)의 블록도이다. 도 2의 연속 코드 반복 디코더(200)는 ATSC(Advanced Television Standards Committee) 8-VSB(vestigal sidebands) 신호를 처리하는 디코더이다. 상기 디코더(200)는 제1 내부 TCM(Trellis Coded Modulation) 디코더(202), 심볼(symbol) 디인터리버(206)와 회선(convolutional) 디인터리버(208)로 구성된 옵션인 디인터리버(204), 제1 외부 RS(Reed Solomon) 디코더(210), 회선 인터리버(214)와 심볼 인터리버(216)로 구성된 옵션인 인터리버(212), 내부 TCM 인코더(218), 제 2 내부 TCM 디코더(220),상기 인터리버(212)가 있는 경우에 존재하고 심볼 디인터리버(224)와 회선 디인터리버(226)로 구성된 옵션인 제2 디인터리버(222), 및 제2 외부 RS 디코더(228)를 포함한다.
도 2를 참조하면, 상기 디코더(200)는 AWGN(additive white Gaussian noise) 채널 환경에서 동작하도록 설계된다. 8-VSB 신호 규격에 대한 ATSC 표준은, 14.9dB의 최소 Es/No(energy per symbol), 또는 SNR(signal to noise)에서 최대 SER(segment error rate)이 1.93E-4인 신호를 수신한 경우에도, 안정적으로 디코딩 처리할 수 있는 디코더를 요구한다.
상기 디코더(200)는 14.9dB 이상의 SNR을 가지는 신호를 디코딩하므로, 아직까지는 ATSC 표준을 만족시키지만, 좀더 잡음이 많은 환경, 즉, 수신된 신호가 14.9dB 보다 작은 SNR을 가지는 환경에서는 안정적으로 디코딩 처리할 수 없는 문제점이 있다.
또한, 만일 제1 외부 디코더(210)에서 디코딩되어 출력된 제1 외부 메시지 데이터에 에러가 있다면, 내부 TCM 인코더(218)에서 생성된 패리티 데이터(재 인코딩 된 데이터)에도 에러가 존재한다. 이때, 제2 내부 TCM 디코더(220)는 그러한 에러를 정정할 수 없다는 문제점이 있다.
따라서, 본 발명이 이루고자하는 기술적 과제는 종래 기술에 따른 부호화(encodation) 구조를 유지하면서, 잡음이 많은 환경, 즉, 수신된 신호가 14.9dB 보다 작은 SNR을 가지는 환경에서도 안정적으로 디코딩 처리할 수 있는 연속 코드 디코더, 및 그 방법을 제공하는데 있다.
본 발명의 상세한 설명에서 인용되는 도면을 보다 충분히 이해하기 위하여 각 도면의 간단한 설명이 제공된다.
도 1은 종래의 일반적인 연속 코드 디코더의 블록도이다.
도 2는 종래의 연속 코드 반복 디코더의 블록도이다.
도 3은 본 발명의 일실시예에 따른 연속 코드 디코더의 블록도이다.
도 4는 본 발명의 일실시예에 따른 연속 코드 반복 디코더의 블록도이다.
도 5는 본 발명의 일실시예에 따라 할당된 정보를 나타내는 표이다.
도 6은 본 발명의 일실시예에 따른 내부 디코더들을 위한 트렐리스(trellis) 도를 나타내는 일예이다.
도 7은 본 발명의 일실시예에 따른 브랜치 메트릭(branch metric) 값들을 나타내는 표이다.
도 8은 본 발명의 일실시예에 따른 파이프라인 형태의 연속 코드 반복 디코더의 블록도이다.
도 9a 및 도 9b는 본 발명의 일실시예에 따른 연속 코드 디코더의 각부와 그 동작 순서를 나타내는 흐름도이다.
도 10은 제2 내부 디코더를 좀더 구체적으로 나타낸 도면이다.
상기의 기술적 과제를 달성하기 위한 본 발명에 따른 연속 코드 디코더는, 제1 내부 디코더, 제1 외부 디코더, 제2 내부 디코더, 및 제2 외부 디코더를 구비한다.
상기 제1 내부 디코더는 연속 코드를 나타내는 데이터를 입력받아 디코딩하여 제1 내부 메시지 데이터와 패리티 데이터를 출력한다.
상기 제1 외부 디코더는 상기 제1 내부 메시지 데이터를 디코딩하여 신뢰성 정보와 제1 외부 메시지 데이터를 출력한다.
상기 제2 내부 디코더는 상기 제1 외부 디코더로부터의 상기 신뢰성 정보, 상기 제1 외부 메시지 데이터, 및 상기 제1 내부 디코더로부터의 상기 패리티 데이터를 처리하여, 상기 제1 외부 메시지 데이터를 디코딩한 제2 내부 메시지 데이터를 출력한다.
상기 제2 외부 디코더는 상기 제2 내부 메시지 데이터를 디코딩하여 출력한다.
상기 패리티 데이터는, 제1 패리티 데이터이고, 상기 제2 외부 디코더는 제2 외부 메시지 데이터 및 신뢰성 정보를 출력하고, 상기 제2 내부 디코더도 제2 패리티 데이터를 출력하며, 상기 연속 코드 디코더는, 제3 내부 디코더, 및 제3 외부 디코더를 더 구비할 수 있다.
상기 제3 내부 디코더는 상기 제2 외부 디코더로부터의 상기 신뢰성 정보, 상기 제2 외부 메시지 데이터, 및 상기 제2 내부 디코더로부터의 상기 제2 패리티 데이터를 처리하여, 상기 제2 외부 메시지 데이터를 디코딩한 제3 내부 메시지 데이터를 출력한다.
상기 제3 외부 디코더는 상기 제3 내부 메시지 데이터를 디코딩하여 출력한다.
상기 연속 코드 디코더는, 상기 제1 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제1 내부 메시지 데이터를 받아 동작할 수 있는 상기 제1 외부 디코더에 출력하는 디인터리버를 더 구비할 수 있다.
상기 연속 코드 디코더는, 인터리버 및 디인터리버를 더 구비할 수 있다. 상기 인터리버는 상기 제1 외부 메시지 데이터를 인터리빙하여, 상기 인터리빙 된 제1 외부 메시지 데이터를 받아 동작할 수 있는 상기 제2 내부 디코더에 출력하고, 상기 디인터리버는 상기 제2 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제2 내부 메시지 데이터를 받아 동작할 수 있는 상기 제2 외부 디코더에 출력한다.
상기 연속 코드 디코더는, 제1 딜레이부, 및 제2 딜레이부를 더 구비할 수 있다. 상기 제1 딜레이부는 상기 제2 내부 디코더가 상기 제1 패리티 데이터를 받아 동작하기 전에 상기 제1 패리티 데이터를 지연시키고, 상기 제2 딜레이부는 상기 제3 내부 디코더가 상기 제2 패리티 데이터를 받아 동작하기 전에 상기 제2 패리티 데이터를 지연시킨다.
상기 제1 내부 디코더는, TCM 디코더, 비터비 디코더, 및 리드 솔로몬 디코더 중 어느 하나이고, 상기 제1 외부 디코더는 리드 솔로몬 디코더인 것을 특징으로 한다.
상기 제2 내부 디코더는, 수신된 심볼에 대하여, 상기 수신 심볼을 포함하는 패킷이 정정될 수 없는 지 여부, 및 상기 수신 심볼을 포함하는 바이트가 상기 제1 외부 디코더에 의하여 정정되었는지 여부에 대한 정보에 근거하여 송신 신호의 부호화를 나타내는 트렐리스 도에서 모든 브랜치들에 대한 적절한 브랜치 메트릭값들을 결정하도록 동작하는 것을 특징으로 한다.
상기의 다른 기술적 과제를 달성하기 위한 본 발명에 따른 연속 코드의 디코딩 방법은, 다음과 같은 단계를 구비한다.
즉, 본 발명에 따른 연속 코드의 디코딩 방법에서는, 먼저, 연속 코드를 나타내는 데이터를 수신하고, 상기 수신 데이터를 디코딩하여 제1 내부 메시지 데이터와 패리티 데이터를 출력하는 제1 내부 디코딩 단계를 수행한다. 다음에, 상기 제1 내부 메시지 데이터를 디코딩하여 신뢰성 정보와 제1 외부 메시지 데이터를 출력하는 제1 외부 디코딩 단계를 수행하고, 상기 제1 외부 디코딩 단계로부터의 상기 신뢰성 정보, 상기 제1 외부 메시지 데이터, 및 상기 제1 내부 디코딩 단계로부터의 상기 패리티 데이터를 처리하여, 상기 제1 외부 메시지 데이터를 디코딩한 제2 내부 메시지 데이터를 출력하는 제2 내부 디코딩 단계를 수행한다. 이에 따라, 상기 제2 내부 메시지 데이터를 디코딩하여 출력하는 제2 외부 디코딩 단계를 수행한다.
상기 패리티 데이터는, 제1 패리티 데이터이고, 상기 제2 외부 디코딩 단계는 제2 외부 메시지 데이터 및 신뢰성 정보를 출력하고, 상기 제2 내부 디코딩 단계도 제2 패리티 데이터를 출력하며, 상기 연속 코드의 디코딩 방법은, 다음과 같은 단계를 더 구비할 수 있다. 즉, 상기 제2 외부 디코딩 단계로부터의 상기 신뢰성 정보, 상기 제2 외부 메시지 데이터, 및 상기 제2 내부 디코딩 단계로부터의 상기 제2 패리티 데이터를 처리하여, 상기 제2 외부 메시지 데이터를 디코딩한 제3내부 메시지 데이터를 출력하는 제3 내부 디코딩 단계, 및 상기 제3 내부 메시지 데이터를 디코딩하여 출력하는 제3 외부 디코딩 단계를 더 수행할 수 있다.
상기 연속 코드의 디코딩 방법은, 상기 제1 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제1 내부 메시지 데이터를 받아 동작할 수 있는 상기 제1 외부 디코딩 단계에 출력하는 디인터리빙 단계를 더 구비할 수 있다.
상기 연속 코드의 디코딩 방법은, 상기 제1 외부 메시지 데이터를 인터리빙하여, 상기 인터리빙된 제1 외부 메시지 데이터를 받아 동작할 수 있는 상기 제2 내부 디코딩 단계에 출력하는 인터리빙 단계, 및 상기 제2 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제2 내부 메시지 데이터를 받아 동작할 수 있는 상기 제2 외부 디코딩 단계에 출력하는 디인터리빙 단계를 더 구비할 수 있다.
상기 연속 코드의 디코딩 방법은, 다음과 같은 단계를 더 구비할 수 있다. 즉, 상기 제2 내부 디코딩 단계가 상기 제1 패리티 데이터를 받아 동작하기 전에 상기 제1 패리티 데이터를 지연시키는 제1 딜레이 단계, 및 상기 제3 내부 디코딩 단계가 상기 제2 패리티 데이터를 받아 동작하기 전에 상기 제2 패리티 데이터를 지연시키는 제2 딜레이 단계를 더 구비할 수 있다.
상기 제1 내부 디코딩 단계는, TCM 디코딩, 비터비 디코딩, 및 리드 솔로몬 디코딩 중 어느 하나이고, 상기 제1 외부 디코딩 단계는 리드 솔로몬 디코딩인 것을 특징으로 한다.
상기 제2 내부 디코딩 단계는, 수신된 심볼에 대하여, 상기 수신 심볼을 포함하는 패킷이 정정될 수 없는 지 여부, 및 상기 수신 심볼을 포함하는 바이트가상기 제1 외부 디코딩 단계에 의하여 정정되었는지 여부에 대한 정보에 근거하여 송신 신호의 부호화를 나타내는 트렐리스 도에서 모든 브랜치들에 대한 적절한 브랜치 메트릭값들을 결정하도록 동작하는 것을 특징으로 한다.
본 발명과 본 발명의 동작상의 이점 및 본 발명의 실시에 의하여 달성되는 목적을 충분히 이해하기 위해서는 본 발명의 바람직한 실시예를 예시하는 첨부 도면 및 도면에 기재된 내용을 참조하여야 한다.
이하, 첨부한 도면을 참조하여 본 발명의 바람직한 실시예를 설명함으로써, 본 발명을 상세히 설명한다. 각 도면에 제시된 동일한 참조부호는 동일한 부재를 나타낸다.
도 3은 본 발명의 일실시예에 따른 연속 코드 디코더(300)의 블록도이다. 상기 연속 코드 디코더(300)는 제1 내부 디코더(302)(예를 들어, TCM 디코더), 딜레이부(304), 옵션이고 제1 심볼 디인터리버(308) 및 제1 회선 디인터리버(310)를 포함하는 제1 디인터리버(306), 제1 외부 디코더(312)(예를 들어, RS 디코더), 옵션이고 제1 회선 인터리버(316) 및 제1 심볼 인터리버(318)를 포함하는 제1 인터리버(314), 옵션이고 제2 심볼 디인터리버(324) 및 제2 회선 디인터리버(326)를 포함하는 제2 디인터리버(322), 및 제2 외부 디코더(328)(예를 들어, RS 디코더)를 구비한다.
제1 내부 디코더(302)로부터의 패리티 데이터는 제거되지 않고, 딜레이부(304)로 입력된다. 적절한 지연 후에 딜레이부(304)는 패리티 데이터를 제2 내부 디코더(320)로 출력한다. 딜레이부(304)는 제1 외부 디코더(312)에서 출력되는 제1 외부 메시지 데이터에 동기 되도록 상기 패리티 데이터를 지연시킨다. 딜레이부(304)의 적절한 지연은 상기 RS 디코더(312)에서 생기는 지연을 보상하여, 상기 패리티 데이터와 상기 제1 외부 메시지 데이터간에 동기가 이루어지도록 한다.
제2 내부 디코더(320)는 제1 외부 디코더(312)로부터 신뢰성 정보를 수신한다. 상기 신뢰성 정보는 제1 내부 디코더(302)에서 출력되는 상기 패리티 데이터의 신뢰성, 및 제1 외부 디코더(312)에서 생성된 제1 외부 메시지 데이터의 신뢰성과 관련되어 있다. 즉, 상기 신뢰성 정보는 아래에서 기술할 도 5의 표에 기술된 것처럼, 로우(low), 미드(middle), 및 하이(high)와 같이 할당되어 데이터의 신뢰성에 대한 정성적인 평가 상태를 표시한다.
제1 외부 디코더(312)에서, 수신된 패킷의 에러 수가 상기 제1 외부 디코더(312)의 에러 정정 능력보다 커지면(예를 8-VSB에서 8개의 에러 이상), 상기 제1 외부 디코더(312)는 패킷에 포함된 에러를 정정하지 못한다. 상기 제1 외부 디코더(312)는 이때의 패킷이 정정될 수 없다는 것을 알리는 신호를 생성한다. 한편, 에러 수가 정정될 수 없을 정도로 아주 많지 않다면, 상기 제1 외부 디코더(312)는 에러 위치 다항식(error location polynomial)을 생성하여 정정된 심볼의 에러 위치를 알리는 신호를 생성한다.
본 발명의 일실시예에 따른 연속 코드 디코더(300)는 제1 외부 디코더(312)로부터의 제1 외부 메시지 데이터뿐만 아니라, 제1 내부 디코더(302)로부터의 패리티 데이터, 및 제1 외부 디코더(312)로부터의 신뢰성 정보를 이용함으로써, 종래기술에 비하여 성능이 개선된다. 14.9dB 이상의 SNR을 가지는 신호를 디코딩할 수 있는 종래 기술의 디코더(200)의 성능과 달리, 본 발명의 일실시예에 따른 연속 코드 디코더(300)는 최소 14.6dB SNR을 가지는 신호를 디코딩할 수 있다.
도 6은 본 발명의 일실시예에 따른 내부 디코더들(302, 320)에 대응하는 인코더의 알고리즘을 나타내는 트렐리스(trellis) 도(여기서는 인코더의 2개 레지스터들의 상태(state)가 4가지임)의 일예이다. 도 6은 부호화 알고리즘에 따른 인코더의 레지스터들의 상태들에 따라 전송된 데이터를 보여준다. 여러 가지 부호화 알고리즘이 있지만, 본 발명의 실시예에서는 이와 같은 트렐리스 도를 채택하였다. 특히, 도 6의 트렐리스 도(600)는 다음과 같은 특징을 가지지만, 이에 한정되는 것은 아니다.
부호 602는 제1 내부 디코더(302) 및 제2 내부 디코더(320)에 대응하는 인코더의 2개의 레지스터들의 시작 시의 상태를 가리킨다. 트렐리스 도(600)에 4가지 상태가 도시되어 있다. 부호 604는 인코더에서 새로운 입력 데이터를 수신하여 다른 논리 상태로 트랜지션하는 것을 나타낸다. 부호 608은 트랜지션 604의 결과로 나타나는 2개의 출력 값을 가리킨다. 예를 들어, 도 6의 예에서, 대응되어 있는 인코더(미도시)가 논리 상태 "00"에서 "10"으로 변할 때, "-3" 또는 "5"가 출력되어 전송된다.
디코더들(302, 320)에서의 디코딩은, 일반적으로, 수신 심볼에 대응하여 트렐리스 도(600)에 있는 여러 가지 가능한 브랜치들에 있는 다중 후보 브랜치 메트릭값들 중에서의 선택, ACS(Add-Compare-Select) 과정, 및 역추적(traceback) 과정을 수행한다. ACS 과정 및 역추적 과정은 잘 알려져 있다. 그러나, 이와 같은 다중 후보 브랜치 메트릭값들 중에서 선택하는 과정이 본 발명의 일실시예를 나타낸다. 이와 같은 다중 후보 브랜치 메트릭값들은, 소프트 데이터에서의 유클리드(Euclidean) 거리에 근거하여 계산된다.
제1 내부 디코더(302)에서 출력되는 패리티 데이터 및 제1 외부 메시지 데이터는, 0~255 레벨을 나타내는 8비트 데이터인 8비트 양자화(quantization)가 될 수 있다는 의미에서, 소프트(soft) 데이터로 볼 수 있다.
제2 내부 디코더(320)에서 트렐리스 도(600)에 있는 여러 가지 가능한 브랜치들에 있는 브랜치 메트릭값들은, 제1 외부 디코더(312)에서 출력되는 신뢰성 정보 및 제1 내부 디코더(302)에서 출력되는 패리티 데이터에 따라 가중치가 부여된다. 도 7은 그런 가중치 값들을 나타내는 표이다. "8-VSB level"로 표시된 첫 번째 컬럼에 있는 값들은, 수신 심볼이 가질 수 있는 값을 나타낸다. 이때, 수신 심볼이 가지는 값은 패리 비트 데이터(한 비트)와 메시지 데이터(두 비트)의 결합으로 되어있다.
브랜치 메트릭값들(branch metric value)이 표시된 4 그룹의 컬럼들 각각에는 16 진수(0h=010, ..., ffh=25510)로 표시한 값들이 나타나있다. 컬럼들 각각의 그룹은 4개의 전송 데이터 쌍{(-7,1), (-5,3), (-3,5), (-1,7)}중의 하나에 해당된다. 도 6의 트렐리스 도(600)의 예에 따라, 각각의 브랜치로 트랜지션이 일어날 때마다 2 가지의 출력 값이 발생할 수 있다. 컬럼들 각각의 그룹은 제1케이스(CASE 1), 제2 케이스(CASE 2), 및 제3 케이스(CASE 3)로 나누어져 있다. 각 케이스의 값들은 룩업 테이블(look-up table)(LUT)을 통하여 정해질 수 있는 데이터들이다.
도 7의 테이블에서 각 케이스의 값들은 다음과 같이 결정될 수 있다. 케이스들 각각에 8가지의 가능한 VSB 레벨이 있다. 8-VSB 레벨들 중 어느 하나에 대하여, 그 레벨에서 가능한 2개의 출력들 각각으로부터의 유클리드 거리가 결정되고, 두 거리들 중 작은 것이 선택되어 그에 대응하는 각 케이스의 컬럼에 있는 브랜치 메트릭값으로 저장된다.
도 7의 제1 케이스(CASE 1)의 컬럼에 있는 브랜치 메트릭값들은, 도 5에 도시된 바와 같이, 제1 외부 디코더(312)에서 출력되는 데이터의 신뢰성 정도가 미드(middle)이고, 제1 내부 디코더(302)에서 출력되는 패리티 데이터의 신뢰성 정도도 미드(middle)인 상태에 대응한다.
도 4는 본 발명의 일실시예에 따른 연속 코드 반복 디코더의 블록도이다. 도 4의 연속 코드 반복 디코더(400)는 제1 내부 디코더(402)(예를 들어, TCM 디코더), 딜레이부(404), 옵션이고 제1 심볼 디인터리버(408) 및 제1 회선 디인터리버(410)를 포함하는 제1 디인터리버(406), 제1 외부 디코더(412)(예를 들어, RS 디코더), 옵션이고 제1 회선 인터리버(416) 및 제1 심볼 인터리버(418)를 포함하는 제1 인터리버(414), 옵션이고 제2 심볼 디인터리버(424) 및 제2 회선 디인터리버(426)를 포함하는 제2 디인터리버(422), 및 제2 외부 디코더(428)(예를 들어, RS 디코더)를 구비한다.
도 4에서, 404 및 414 내지 428은 원하는 코딩 게인(gain)과 BER(bir error rate)가 성취될 수 있을 때까지 파이프라인 형태로 반복될 수 있는 반복 장치(430)이다. 다시 말하여, 430은 여러번 반복될 수 있는 반복 장치(430)이다. 이것은, 본 발명의 다른 실시예에 따른 연속 코드의 디코딩에 대한 반복 디코더(800)의 블록도를 나타내는 도 8에도 도시되어 있다. 연속 코드 반복 디코더(800)는 반복 장치(430) 및 이와 동일한 반복 장치(830)를 포함한다. 반복 장치(830)는 딜레이부(804), 옵션이고 제2 회선 인터리버(816) 및 제2 심볼 인터리버(818)를 포함하는 제2 인터리버(814), 제3 내부 디코더(820)(예를 들어, TCM 디코더), 옵션이고 제3 심볼 디인터리버(824) 및 제3 회선 디인터리버(826)를 포함하는 제3 디인터리버(822), 및 제3 외부 디코더(828)(예를 들어, RS 디코더)를 구비한다.
도 9a 및 도 9b는 본 발명의 일실시예에 따른 연속 코드 디코더의 각부와 그 동작 순서를 나타내는 흐름도이다. 도 9a 및 도 9b는 도 8에 도시된 연속 코드 반복 디코더(800)의 동작 설명에 이용된다.
도 9a에서, 연속 코드들은 연속 코드를 출력하는 각 소스에서 공급된다(S902). 예를 들어, 연속 코드를 출력하는 802는 통신 채널(110)을 통하여 신호를 수신하는 복조기(112)가 될 수 있다. 제1 내부 디코더(402)는 연속 코드를 받아 디코딩하여 제1 디인터리버(406)로 제1 내부 메시지 데이터를 출력한다(S904). 제1 내부 디코더(402)는 제1 딜레이부(404)에 패리티 데이터를 제공함으로써 패리티 데이터를 재순환 시킨다(S906). 제1 디인터리버(406)는 디인터리빙 된 제1 내부 메시지 데이터를 제1 외부 디코더(412)로 출력한다(S907).
또한, 연속 코드가 인터리빙되지 않도록 미리 정해져 있어서 제1 디인터리버(406)가 존재하지 않으면, 제1 내부 메시지 데이터는 제1 내부 디코더(402)에서 제1 외부 디코더(412)로 직접 출력된다.
제1 외부 디코더(412)는 디인터리빙 된 제1 내부 메시지 데이터를 디코딩하여 인터리버(414)에 제1 외부 메시지 데이터를 출력한다(S908). 제1 외부 디코더(412)는 신뢰성 정보도 생성하여 제2 내부 디코더(420)에 출력한다(S910). 제1 딜레이부(404)는 제1 패리티 데이터를 지연시켜 제2 내부 디코더(420)에 출력한다(S912). 인터리버(414)는 제1 외부 메시지 데이터를 인터리빙하여 제2 내부 디코더(420)에 출력한다(S914).
또한, 인터리버(414)는 제거될 수 있는 옵션 요소이다. 인터리버(414)가 없는 경우에는, 제1 외부 메시지 데이터는 제1 외부 디코더(412)에서 제2 내부 디코더(420)로 직접 출력될 수 있다.
제2 내부 디코더(420)는 신뢰성 정보와 제1 패리티 데이터에 따라 동작하여, 제1 외부 메시지 데이터를 디코딩하고 제2 내부 메시지 데이터를 생성하여 제2 디인터리버(422)로 출력한다(S916). 제2 내부 디코더(420)는 제2 패리티 데이터를 제2 딜레이부(804)에 출력시킴으로써 제2 패리티 데이터를 재순환시킨다(S918). 제2 디인터리버(422)는 디인터리빙 된 제2 내부 메시지 데이터를 제2 외부 디코더(428)에 출력한다(S920).
또한, 인터리버(414)가 존재하지 않아 디인터리버(422)가 없는 경우에, 제2 내부 메시지 데이터는 제2 내부 디코더(420)에서 직접 제2 외부 디코더(428)로 출력된다.
제2 외부 디코더(428)는 디인터리빙 된 제2 내부 메시지 데이터를 디코딩하여 제2 인터리버(814)로 제2 외부 메시지 데이터를 출력한다(S922). 제2 외부 디코더(428)는 신뢰성 정보를 생성하여 제3 내부 디코더(820)로 출력한다(S924). 도 9b에서, 제2 딜레이부(804)는 제2 패리티 데이터를 지연시켜 제3 내부 디코더(820)로 출력한다(S926). 제2 인터리버(814)는 제2 외부 메시지 데이터를 인터리빙하여 제3 내부 디코더(820)로 출력한다(S927).
또한, 인터리버(814)는 제거될 수 있고, 이때에는 제2 외부 메시지 데이터는 제2 외부 디코더(428)에서 직접 제3 내부 디코더(820)로 출력된다.
제3 내부 디코더(820)는 제2 외부 디코더(428)에서 출력된 신뢰성 정보와 제2 내부 디코더(420)에서 출력된 제2 패리티 데이터를 받아 동작하여, 제2 외부 디코더(428)에서 출력된 제2 외부 메시지 데이터를 디코딩하고 제3 디인터리버(822)로 제3 내부 메시지 데이터를 출력한다(S928). 만일 제3 반복 장치(미도시)가 있다면, 제3 내부 디코더(820)는 제3 딜레이부(미도시)에 제3 패리티 데이터를 출력시켜, 패리티 데이터를 재순환시킨다. 제3 디인터리버(822)는 제3 외부 디코더(828)에 디인터리빙 된 제3 내부 메시지 데이터를 출력한다(S930).
제3 외부 디코더(828)는 디인터리빙 된 제3 내부 메시지 데이터를 디코딩하여, 제3 외부 메시지 데이터를 출력한다. 만일, 제3 반복 장치(미도시)가 있다면, 다음과 같은 동작이 포함될 수 있다. 즉, 제3 외부 메시지 데이터는 옵션인 다른 인터리버(미도시)로 출력될 것이다(S932). 또한, 제3 외부 디코더(828)는 신뢰성 정보를 생성하여 제4 내부 디코더(미도시)로 출력할 것이다(S934).
도 10은 본 발명의 일실시예에 따른 제2 내부 디코더(예를 들어 420)를 좀더 구체적으로 나타낸 도면이다. RS 디코더는, 수신된 패킷이 충분히 작은 수의 에러를 가져서 정정될 수 있는 지 또는 정정될 수 없는 패킷인지의 정보를 담은 UP 신호를 생성하여 출력하는 로직부(1006), 및 수신된 패킷의 바이트(byte)가 에러 위치 다항식의 생성 등에 의하여 정정이 되었는지를 확인할 수 있는 정보를 담은 CS 신호를 생성하여 출력하는 로직부(1008)를 구비할 수 있다.
여기서, 디코더(420)는 상기 UP 신호 및 상기 CS 신호(도 5 참조)를 기반으로, 도 7과 같은 각 케이스의 브랜치 메트릭값들에 대한 룩업 테이블(LUT)로부터 하나의 LUT를 선택하는 로직부(1010), 도 6과 같은 트렐리스 도에서 수신된 VSB 레벨 신호에 대응하여 4개의 전송 데이터 쌍에 대한 브랜치 메트릭 값들을 얻기 위해서 상기 선택된 LUT에 색인(indexing)을 위한 인덱싱 로직부(1012), ACS(Add Compare Select)부(1014), 및 역추적부(traceback)(1016)를 구비한다.
상기 인덱싱 로직부(1012)에 의하여 얻어진 브랜치 메트릭값들은 ACS부(1014)에 의하여 이전까지 축적된 값에 합산되고, 합산된 값들은 서로 비교되어, 가장 작은 합산값이 선택되어 출력된다. ACS부(1014), 및 역추적부(1016)는 일반적으로 잘 알려져 있으므로, 더 이상의 설명은 생략한다.
위에서 기술한 바와 같이, 상기 내부 디코더들은 TCM 디코더들이고, 상기 외부 디코더들은 RS 디코더들이다. 이외에도, 내부 및 외부 디코더 각각으로, 회선 코드를 사용하는 비터비(Viterbi) 디코더 및 RS 디코더의 조합이 사용될 수 있고,내부와 외부 디코더 모두에 RS 디코더가 사용될 수 있다.
이상에서와 같이 도면과 명세서에서 최적 실시예가 개시되었다. 여기서 특정한 용어들이 사용되었으나, 이는 단지 본 발명을 설명하기 위한 목적에서 사용된 것이지 의미한정이나 특허청구범위에 기재된 본 발명의 범위를 제한하기 위하여 사용된 것은 아니다. 그러므로 본 기술분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호범위는 첨부된 특허청구범위의 기술적 사상에 의해 정해져야 할 것이다.
상술한 바와 같이 본 발명에 따른 연속 코드 디코더는, 잡음이 많은 환경, 즉, 수신된 신호가 14.9dB 보다 작은 SNR을 가지는 환경에서도 안정적으로 디코딩 처리할 수 있다. 따라서, 이를 구비한 디지털 텔레비전 수신 장치로 VSB 신호를 안정적으로 수신하여 영상 처리함으로써, 디지털 텔레비전에서 왜곡 없이 깨끗한 영상이 디스플레이 될 수 있다.
Claims (21)
- 연속 코드를 나타내는 데이터를 입력받아 디코딩하여 제1 내부 메시지 데이터와 패리티 데이터를 출력하는 제1 내부 디코더;상기 제1 내부 메시지 데이터를 디코딩하여 신뢰성 정보와 제1 외부 메시지 데이터를 출력하는 제1 외부 디코더;상기 제1 외부 디코더로부터의 상기 신뢰성 정보, 상기 제1 외부 메시지 데이터, 및 상기 제1 내부 디코더로부터의 상기 패리티 데이터를 처리하여, 상기 제1 외부 메시지 데이터를 디코딩한 제2 내부 메시지 데이터를 출력하는 제2 내부 디코더; 및상기 제2 내부 메시지 데이터를 디코딩하여 출력하는 제2 외부 디코더를 구비하는 것을 특징으로 하는 연속 코드 디코더.
- 제 1항에 있어서, 상기 패리티 데이터는,제1 패리티 데이터이고, 상기 제2 외부 디코더는 제2 외부 메시지 데이터 및 신뢰성 정보를 출력하고, 상기 제2 내부 디코더도 제2 패리티 데이터를 출력하며,상기 연속 코드 디코더는,상기 제2 외부 디코더로부터의 상기 신뢰성 정보, 상기 제2 외부 메시지 데이터, 및 상기 제2 내부 디코더로부터의 상기 제2 패리티 데이터를 처리하여, 상기 제2 외부 메시지 데이터를 디코딩한 제3 내부 메시지 데이터를 출력하는 제3 내부 디코더; 및상기 제3 내부 메시지 데이터를 디코딩하여 출력하는 제3 외부 디코더를 더 구비하는 것을 특징으로 하는 연속 코드 디코더.
- 제 2항에 있어서, 상기 연속 코드 디코더는,상기 제1 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제1 내부 메시지 데이터를 받아 동작할 수 있는 상기 제1 외부 디코더에 출력하는 디인터리버를 더 구비하는 것을 특징으로 하는 연속 코드 디코더.
- 제 2항에 있어서, 상기 연속 코드 디코더는,상기 제1 외부 메시지 데이터를 인터리빙하여, 상기 인터리빙된 제1 외부 메시지 데이터를 받아 동작할 수 있는 상기 제2 내부 디코더에 출력하는 인터리버; 및상기 제2 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제2 내부 메시지 데이터를 받아 동작할 수 있는 상기 제2 외부 디코더에 출력하는 디인터리버를 더 구비하는 것을 특징으로 하는 연속 코드 디코더.
- 제 2항에 있어서, 상기 연속 코드 디코더는,상기 제2 내부 디코더가 상기 제1 패리티 데이터를 받아 동작하기 전에 상기 제1 패리티 데이터를 지연시키는 제1 딜레이부; 및상기 제3 내부 디코더가 상기 제2 패리티 데이터를 받아 동작하기 전에 상기 제2 패리티 데이터를 지연시키는 제2 딜레이부를 더 구비하는 것을 특징으로 하는 연속 코드 디코더.
- 제 1항에 있어서, 상기 제1 내부 디코더는,TCM 디코더, 비터비 디코더, 및 리드 솔로몬 디코더 중 어느 하나이고, 상기제1 외부 디코더는 리드 솔로몬 디코더인 것을 특징으로 하는 연속 코드 디코더.
- 제 1항에 있어서, 상기 연속 코드 디코더는,상기 제1 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제1 내부 메시지 데이터를 받아 동작할 수 있는 상기 제1 외부 디코더에 출력하는 디인터리버를 더 구비하는 것을 특징으로 하는 연속 코드 디코더.
- 제 1항에 있어서, 상기 연속 코드 디코더는,상기 제1 외부 메시지 데이터를 인터리빙하여, 상기 인터리빙된 제1 외부 메시지 데이터를 받아 동작할 수 있는 상기 제2 내부 디코더에 출력하는 인터리버; 및상기 제2 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제2 내부 메시지 데이터를 받아 동작할 수 있는 상기 제2 외부 디코더에 출력하는 디인터리버를 더 구비하는 것을 특징으로 하는 연속 코드 디코더.
- 제 1항에 있어서, 상기 연속 코드 디코더는,상기 제2 내부 디코더가 상기 패리티 데이터를 받아 동작하기 전에 상기 패리티 데이터를 지연시키는 딜레이부를 더 구비하는 것을 특징으로 하는 연속 코드 디코더.
- 제 1항에 있어서, 상기 제2 내부 디코더는,수신된 심볼에 대하여, 상기 수신 심볼을 포함하는 패킷이 정정될 수 없는 지 여부, 및 상기 수신 심볼을 포함하는 바이트가 상기 제1 외부 디코더에 의하여 정정되었는지 여부에 대한 정보에 근거하여 송신 신호의 부호화를 나타내는 트렐리스 도에서 모든 브랜치들에 대한 적절한 브랜치 메트릭값들을 결정하도록 동작하는 것을 특징으로 하는 연속 코드 디코더.
- 연속 코드를 나타내는 데이터를 입력받아 디코딩하여 제1 내부 메시지 데이터와 패리티 데이터를 출력하는 제1 내부 수단;상기 제1 내부 메시지 데이터를 디코딩하여 신뢰성 정보와 제1 외부 메시지 데이터를 출력하는 제1 외부 수단;상기 제1 외부 수단으로부터의 상기 신뢰성 정보, 상기 제1 외부 메시지 데이터, 및 상기 제1 내부 수단으로부터의 상기 패리티 데이터를 처리하여, 상기 제1 외부 메시지 데이터를 디코딩한 제2 내부 메시지 데이터를 출력하는 제2 내부 수단; 및상기 제2 내부 메시지 데이터를 디코딩하여 출력하는 제2 외부 수단을 구비하는 것을 특징으로 하는 연속 코드 디코더.
- 연속 코드를 나타내는 데이터를 수신하는 단계;상기 수신 데이터를 디코딩하여 제1 내부 메시지 데이터와 패리티 데이터를출력하는 제1 내부 디코딩 단계;상기 제1 내부 메시지 데이터를 디코딩하여 신뢰성 정보와 제1 외부 메시지 데이터를 출력하는 제1 외부 디코딩 단계;상기 제1 외부 디코딩 단계로부터의 상기 신뢰성 정보, 상기 제1 외부 메시지 데이터, 및 상기 제1 내부 디코딩 단계로부터의 상기 패리티 데이터를 처리하여, 상기 제1 외부 메시지 데이터를 디코딩한 제2 내부 메시지 데이터를 출력하는 제2 내부 디코딩 단계; 및상기 제2 내부 메시지 데이터를 디코딩하여 출력하는 제2 외부 디코딩 단계를 구비하는 것을 특징으로 하는 연속 코드의 디코딩 방법.
- 제 12항에 있어서, 상기 패리티 데이터는,제1 패리티 데이터이고, 상기 제2 외부 디코딩 단계는 제2 외부 메시지 데이터 및 신뢰성 정보를 출력하고, 상기 제2 내부 디코딩 단계도 제2 패리티 데이터를 출력하며,상기 연속 코드의 디코딩 방법은,상기 제2 외부 디코딩 단계로부터의 상기 신뢰성 정보, 상기 제2 외부 메시지 데이터, 및 상기 제2 내부 디코딩 단계로부터의 상기 제2 패리티 데이터를 처리하여, 상기 제2 외부 메시지 데이터를 디코딩한 제3 내부 메시지 데이터를 출력하는 제3 내부 디코딩 단계; 및상기 제3 내부 메시지 데이터를 디코딩하여 출력하는 제3 외부 디코딩 단계를 더 구비하는 것을 특징으로 하는 연속 코드의 디코딩 방법.
- 제 13항에 있어서, 상기 연속 코드의 디코딩 방법은,상기 제1 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제1 내부 메시지 데이터를 받아 동작할 수 있는 상기 제1 외부 디코딩 단계에 출력하는 디인터리빙 단계를 더 구비하는 것을 특징으로 하는 연속 코드의 디코딩 방법.
- 제 13항에 있어서, 상기 연속 코드의 디코딩 방법은,상기 제1 외부 메시지 데이터를 인터리빙하여, 상기 인터리빙된 제1 외부 메시지 데이터를 받아 동작할 수 있는 상기 제2 내부 디코딩 단계에 출력하는 인터리빙 단계; 및상기 제2 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제2 내부 메시지 데이터를 받아 동작할 수 있는 상기 제2 외부 디코딩 단계에 출력하는 디인터리빙 단계를 더 구비하는 것을 특징으로 하는 연속 코드의 디코딩 방법.
- 제 13항에 있어서, 상기 연속 코드의 디코딩 방법은,상기 제2 내부 디코딩 단계가 상기 제1 패리티 데이터를 받아 동작하기 전에 상기 제1 패리티 데이터를 지연시키는 제1 딜레이 단계; 및상기 제3 내부 디코딩 단계가 상기 제2 패리티 데이터를 받아 동작하기 전에 상기 제2 패리티 데이터를 지연시키는 제2 딜레이 단계를 더 구비하는 것을 특징으로 하는 연속 코드의 디코딩 방법.
- 제 12항에 있어서, 상기 제1 내부 디코딩 단계는,TCM 디코딩, 비터비 디코딩, 및 리드 솔로몬 디코딩 중 어느 하나이고, 상기 제1 외부 디코딩 단계는 리드 솔로몬 디코딩인 것을 특징으로 하는 연속 코드의 디코딩 방법.
- 제 12항에 있어서, 상기 연속 코드의 디코딩 방법은,상기 제1 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제1 내부 메시지 데이터를 받아 동작할 수 있는 상기 제1 외부 디코딩 단계에 출력하는 디인터리빙 단계를 더 구비하는 것을 특징으로 하는 연속 코드의 디코딩 방법.
- 제 12항에 있어서, 상기 연속 코드의 디코딩 방법은,상기 제1 외부 메시지 데이터를 인터리빙하여, 상기 인터리빙된 제1 외부 메시지 데이터를 받아 동작할 수 있는 상기 제2 내부 디코딩 단계에 출력하는 인터리빙 단계; 및상기 제2 내부 메시지 데이터를 디인터리빙하여, 상기 디인터리빙 된 제2 내부 메시지 데이터를 받아 동작할 수 있는 상기 제2 외부 디코딩 단계에 출력하는 디인터리빙 단계를 더 구비하는 것을 특징으로 하는 연속 코드의 디코딩 방법.
- 제 12항에 있어서, 상기 연속 코드의 디코딩 방법은,상기 제2 내부 디코딩 단계가 상기 패리티 데이터를 받아 동작하기 전에 상기 패리티 데이터를 지연시키는 딜레이 단계를 더 구비하는 것을 특징으로 하는 연속 코드의 디코딩 방법.
- 제 12항에 있어서, 상기 제2 내부 디코딩 단계는,수신된 심볼에 대하여, 상기 수신 심볼을 포함하는 패킷이 정정될 수 없는 지 여부, 및 상기 수신 심볼을 포함하는 바이트가 상기 제1 외부 디코딩 단계에 의하여 정정되었는지 여부에 대한 정보에 근거하여 송신 신호의 부호화를 나타내는 트렐리스 도에서 모든 브랜치들에 대한 적절한 브랜치 메트릭 값들을 결정하도록 동작하는 것을 특징으로 하는 연속 코드의 디코딩 방법.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US10/325,833 | 2002-12-23 | ||
US10/325,833 US7047474B2 (en) | 2002-12-23 | 2002-12-23 | Decoding concatenated codes via parity bit recycling |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20040057873A true KR20040057873A (ko) | 2004-07-02 |
KR100524961B1 KR100524961B1 (ko) | 2005-11-01 |
Family
ID=32468977
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR10-2003-0028597A KR100524961B1 (ko) | 2002-12-23 | 2003-05-06 | 패리티 비트를 재순환시키는 연속 코드 디코더 및 그 방법 |
Country Status (6)
Country | Link |
---|---|
US (1) | US7047474B2 (ko) |
JP (1) | JP4284125B2 (ko) |
KR (1) | KR100524961B1 (ko) |
CN (1) | CN100428635C (ko) |
FR (1) | FR2849304B1 (ko) |
TW (1) | TWI262658B (ko) |
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- 2003-06-13 FR FR0307155A patent/FR2849304B1/fr not_active Expired - Fee Related
- 2003-08-13 JP JP2003207455A patent/JP4284125B2/ja not_active Expired - Fee Related
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---|---|
FR2849304B1 (fr) | 2014-09-12 |
US7047474B2 (en) | 2006-05-16 |
CN100428635C (zh) | 2008-10-22 |
FR2849304A1 (fr) | 2004-06-25 |
KR100524961B1 (ko) | 2005-11-01 |
US20040123217A1 (en) | 2004-06-24 |
TW200412034A (en) | 2004-07-01 |
JP2004208269A (ja) | 2004-07-22 |
TWI262658B (en) | 2006-09-21 |
CN1510842A (zh) | 2004-07-07 |
JP4284125B2 (ja) | 2009-06-24 |
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A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
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GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
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