KR102388795B1 - 반도체 소자 및 이를 포함하는 반도체 소자 제조방법 - Google Patents

반도체 소자 및 이를 포함하는 반도체 소자 제조방법 Download PDF

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Abstract

실시 예는, 제1 도전형 반도체층, 제2 도전형 반도체층, 상기 제1 도전형 반도체층과 상기 제2 도전형 반도체층 사이에 배치되는 활성층을 포함하고, 상기 제2 도전형 반도체층 및 상기 활성층을 관통하여 상기 제1 도전형 반도체층의 일부 영역까지 배치되는 복수 개의 리세스를 포함하는 반도체 구조물; 상기 복수 개의 리세스의 내부에 배치되어 상기 제1 도전형 반도체층과 전기적으로 연결되는 제1 전극; 상기 제2 도전형 반도체층과 전기적으로 연결되는 제2 전극; 및 상기 반도체 구조물의 가장자리에 배치되는 광흡수층을 포함하고, 상기 광흡수층은 상기 제2 전극보다 두꺼운 반도체 소자를 개시한다.

Description

반도체 소자 및 이를 포함하는 반도체 소자 제조방법{SEMICONDUCTOR DEVICE AND METHOD FOR MANUFACTURING SEMICONDUCTOR DEVICE}
실시 예는 반도체 소자 및 이를 포함하는 반도체 소자 제조방법에 관한 것이다.
GaN, AlGaN 등의 화합물을 포함하는 반도체 소자는 넓고 조정이 용이한 밴드 갭 에너지를 가지는 등의 많은 장점을 가져서 발광 소자, 수광 소자 및 각종 다이오드 등으로 다양하게 사용될 수 있다.
특히, 반도체의 3-5족 또는 2-6족 화합물 반도체 물질을 이용한 발광 다이오드(Light Emitting Diode)나 레이저 다이오드(Laser Diode)와 같은 발광소자는 박막 성장 기술 및 소자 재료의 개발로 적색, 녹색, 청색 및 자외선 등 다양한 색을 구현할 수 있으며, 형광 물질을 이용하거나 색을 조합함으로써 효율이 좋은 백색 광선도 구현이 가능하며, 형광등, 백열등 등 기존의 광원에 비해 저소비전력, 반영구적인 수명, 빠른 응답속도, 안전성, 환경 친화성의 장점을 가진다.
뿐만 아니라, 광검출기나 태양 전지와 같은 수광 소자도 반도체의 3-5족 또는 2-6족 화합물 반도체 물질을 이용하여 제작하는 경우 소자 재료의 개발로 다양한 파장 영역의 빛을 흡수하여 광 전류를 생성함으로써 감마선부터 라디오 파장 영역까지 다양한 파장 영역의 빛을 이용할 수 있다. 또한 빠른 응답속도, 안전성, 환경 친화성 및 소자 재료의 용이한 조절의 장점을 가져 전력 제어 또는 초고주파 회로나 통신용 모듈에도 용이하게 이용할 수 있다.
따라서, 반도체 소자는 광 통신 수단의 송신 모듈, LCD(Liquid Crystal Display) 표시 장치의 백라이트를 구성하는 냉음극관(CCFL: Cold Cathode Fluorescence Lamp)을 대체하는 발광 다이오드 백라이트, 형광등이나 백열 전구를 대체할 수 있는 백색 발광 다이오드 조명 장치, 자동차 헤드 라이트 및 신호등 및 Gas나 화재를 감지하는 센서 등에까지 응용이 확대되고 있다. 또한, 반도체 소자는 고주파 응용 회로나 기타 전력 제어 장치, 통신용 모듈에까지 응용이 확대될 수 있다.
특히, 자외선 파장 영역의 광을 방출하는 발광소자는 경화작용이나 살균 작용을 하여 경화용, 의료용, 및 살균용으로 사용될 수 있다.
최근 자외선 발광소자에 대한 연구가 활발하나, 아직까지 자외선 발광소자는 수직형으로 구현하기 어려운 문제가 있으며, 광 추출 효율이 상대적으로 떨어지는 문제가 있다.
실시 예는 수직형 자외선 발광소자를 제공한다.
실시 예는 LLO 공정이 용이한 자외선 발광소자 제조방법을 제공한다.
실시 예에서 해결하고자 하는 과제는 이에 한정되는 것은 아니며, 아래에서 설명하는 과제의 해결수단이나 실시 형태로부터 파악될 수 있는 목적이나 효과도 포함된다고 할 것이다.
본 발명의 일 실시 예에 따른 반도체 소자는, 제1 도전형 반도체층, 제2 도전형 반도체층, 상기 제1 도전형 반도체층과 상기 제2 도전형 반도체층 사이에 배치되는 활성층을 포함하고, 상기 제2 도전형 반도체층 및 상기 활성층을 관통하여 상기 제1 도전형 반도체층의 일부 영역까지 배치되는 복수 개의 리세스를 포함하는 반도체 구조물; 상기 복수 개의 리세스의 내부에 배치되어 상기 제1 도전형 반도체층과 전기적으로 연결되는 제1 전극; 상기 제2 도전형 반도체층과 전기적으로 연결되는 제2 전극; 및 상기 반도체 구조물의 가장자리에 배치되는 광흡수층을 포함하고, 상기 광흡수층은 상기 제2 전극보다 두껍다.
상기 광흡수층과 상기 제2 전극은 ITO를 포함할 수 있다.
상기 광흡수층의 폭은 상기 제1면의 최외측에서 상기 제2 전극까지의 최단 거리보다 짧을 수 있다.
상기 제1 전극과 전기적으로 연결되는 제1 도전층; 상기 제2 전극과 전기적으로 연결되는 제2 도전층; 및 상기 제1 도전층과 전기적으로 연결되는 전도성 기판을 포함할 수 있다.
상기 리세스의 내부에 배치되어 상기 제1 도전층을 상기 활성층 및 제2 도전형 반도체층과 절연시키는 제1 절연층, 및 상기 제1 도전층과 제2 도전층 사이에 배치되는 제2 절연층을 포함할 수 있다.
상기 광흡수층은 상기 제2 도전형 반도체층과 상기 제1 절연층 사이에 배치될 수 있다.
상기 활성층은 자외선 파장대의 광을 출사할 수 있다.
본 발명의 일 실시 예에 따른 반도체 소자 제조방법은, 기판상에 메인 흡수층, 제1 도전형 반도체층, 활성층, 및 제2 도전형 반도체층을 차례로 형성하여 반도체구조물을 형성하는 단계; 상기 반도체구조물을 복수 개의 칩 영역 사이에 배치되는 채널층상에 광흡수층을 형성하는 단계; 상기 복수 개의 칩 영역과 채널층상에 전극을 형성하는 단계; 및 상기 기판에 레이저를 조사하여 상기 기판을 분리하는 단계를 포함하고, 상기 메인 흡수층과 상기 광흡수층은 상기 레이저를 흡수한다.
상기 기판을 분리하는 단계 이후에 상기 채널층을 절단하여 상기 복수 개의 칩 영역을 분리하는 단계를 더 포함하고, 상기 분리된 칩 영역은 상기 광흡수층의 일부를 포함할 수 있다.
상기 광흡수층을 형성하는 단계는, 상기 채널층을 식각하여 리세스, 및 상기 리세스의 바닥면에서 돌출된 돌출부를 형성하고, 상기 돌출부는 상기 복수 개의 칩 영역을 둘러싸도록 배치될 수 있다.
실시 예에 따르면, 수직형 발광소자의 수율을 향상시킬 수 있다.
본 발명의 다양하면서도 유익한 장점과 효과는 상술한 내용에 한정되지 않으며, 본 발명의 구체적인 실시형태를 설명하는 과정에서 보다 쉽게 이해될 수 있을 것이다.
도 1은 본 발명의 일 실시 예에 따른 반도체 소자의 개념도이고,
도 2a는 도 1의 A 부분 확대도이고,
도 2ab는 본 발명의 일 실시 예에 따른 반도체 소자의 평면도이고,
도 3은 종래 구조에서 기판 제거시 발생하는 문제점을 설명하기 위한 도면이고,
도 4a 내지 도 4c는 기판 제거시 반도체 소자가 손상된 상태를 보여주는 도면이고,
도 5a 내지 도 5d는 본 발명의 일 실시 예에 따른 반도체 소자의 제조방법을 설명하기 위한 도면이고,
도 6은 반도체 구조물을 메사 식각하여 복수 개의 반도체 소자 사이에 채널을 형성하고, 광흡수층을 형성한 상태를 보여주는 도면이고,
도 7은 반도체 구조물에서 기판을 제거하는 상태를 보여주는 도면이고,
도 8은 도 6의 변형예이고,
도 9는 도 8의 구조에서 반도체 구조물에서 기판을 제거하는 상태를 보여주는 도면이다.
본 실시 예들은 다른 형태로 변형되거나 여러 실시 예가 서로 조합될 수 있으며, 본 발명의 범위가 이하 설명하는 각각의 실시 예로 한정되는 것은 아니다.
특정 실시 예에서 설명된 사항이 다른 실시 예에서 설명되어 있지 않더라도, 다른 실시 예에서 그 사항과 반대되거나 모순되는 설명이 없는 한, 다른 실시 예에 관련된 설명으로 이해될 수 있다.
예를 들어, 특정 실시 예에서 구성 A에 대한 특징을 설명하고 다른 실시 예에서 구성 B에 대한 특징을 설명하였다면, 구성 A와 구성 B가 결합된 실시 예가 명시적으로 기재되지 않더라도 반대되거나 모순되는 설명이 없는 한, 본 발명의 권리범위에 속하는 것으로 이해되어야 한다.
실시 예의 설명에 있어서, 어느 한 element가 다른 element의 "상(위) 또는 하(아래)(on or under)"에 형성되는 것으로 기재되는 경우에 있어, 상(위) 또는 하(아래)(on or under)는 두 개의 element가 서로 직접(directly)접촉되거나 하나 이상의 다른 element가 상기 두 element 사이에 배치되어(indirectly) 형성되는 것을 모두 포함한다. 또한 "상(위) 또는 하(아래)(on or under)"으로 표현되는 경우 하나의 element를 기준으로 위쪽 방향뿐만 아니라 아래쪽 방향의 의미도 포함할 수 있다.
이하에서는 첨부한 도면을 참고로 하여 본 발명의 실시 예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다.
도 1은 본 발명의 일 실시 예에 따른 반도체 소자의 개념도이고, 도 2a는 도 1의 A 부분 확대도이고, 도 2b는 본 발명의 일 실시 예에 따른 반도체 소자의 평면도이다.
도 1을 참조하면, 본 발명의 일 실시 예에 따른 반도체 소자는, 제1 도전형 반도체층(124), 활성층(126), 제2 도전형 반도체층(127)을 포함하는 반도체구조물(120), 제1 도전형 반도체층(124)과 전기적으로 연결되는 제1 전극(142), 및 제2 도전형 반도체층(127)과 전기적으로 연결되는 제2 전극(246)을 포함한다.
반도체구조물(120)은 자외선 파장대의 광을 출력할 수 있다. 예시적으로 반도체구조물(120)은 근자외선 파장대의 광(UV-A)을 출력할 수도 있고, 원자외선 파장대의 광(UV-B)을 출력할 수 도 있고, 심자외선 파장대의 광(UV-C)을 출력할 수 있다. 파장범위는 반도체구조물(120)의 Al의 조성비에 의해 결정될 수 있다.
예시적으로, 근자외선 파장대의 광(UV-A)는 320nm 내지 420nm 범위의 파장을 가질 수 있고, 원자외선 파장대의 광(UV-B)은 280nm 내지 320nm 범위의 파장을 가질 수 있으며, 심자외선 파장대의 광(UV-C)은 100nm 내지 280nm 범위의 파장을 가질 수 있다.
반도체구조물(120)은 제1 도전형 반도체층(124), 제2 도전형 반도체층(127), 및 제1 도전형 반도체층(124)과 제2 도전형 반도체층(127) 사이에 배치되는 활성층(126)을 포함한다.
제1 도전형 반도체층(124)은 Ⅲ-Ⅴ족, Ⅱ-Ⅵ족 등의 화합물 반도체로 구현될 수 있으며, 제1도펀트가 도핑될 수 있다. 제1 도전형 반도체층(124)은 Inx1Aly1Ga1 -x1-y1N(0≤x1≤1, 0≤y1≤1, 0≤x1+y1≤1)의 조성식을 갖는 반도체 재료, 예를 들어 GaN, AlGaN, InGaN, InAlGaN 등에서 선택될 수 있다. 그리고, 제1도펀트는 Si, Ge, Sn, Se, Te와 같은 n형 도펀트일 수 있다. 제1도펀트가 n형 도펀트인 경우, 제1도펀트가 도핑된 제1 도전형 반도체층(124)은 n형 반도체층일 수 있다.
활성층(126)은 제1 도전형 반도체층(124)과 제2 도전형 반도체층(127) 사이에 배치된다. 활성층(126)은 제1 도전형 반도체층(124)을 통해서 주입되는 전자(또는 정공)와 제2 도전형 반도체층(127)을 통해서 주입되는 정공(또는 전자)이 만나는 층이다. 활성층(126)은 전자와 정공이 재결합함에 따라 낮은 에너지 준위로 천이하며, 자외선 파장을 가지는 빛을 생성할 수 있다.
활성층(126)은 단일 우물 구조, 다중 우물 구조, 단일 양자 우물 구조, 다중 양자 우물(Multi Quant㎛ Well; MQW) 구조, 양자점 구조 또는 양자선 구조 중 어느 하나의 구조를 가질 수 있으며, 활성층(126)의 구조는 이에 한정하지 않는다.
제2 도전형 반도체층(127)은 Ⅲ-Ⅴ족, Ⅱ-Ⅵ족 등의 화합물 반도체로 구현될 수 있으며, 제2 도전형 반도체층(127)에 제2도펀트가 도핑될 수 있다. 제2 도전형 반도체층(127)은 Inx5Aly2Ga1 -x5- y2N (0≤x5≤1, 0≤y2≤1, 0≤x5+y2≤1)의 조성식을 갖는 반도체 물질 또는 AlInN, AlGaAs, GaP, GaAs, GaAsP, AlGaInP 중 선택된 물질로 형성될 수 있다. 제2도펀트가 Mg, Zn, Ca, Sr, Ba 등과 같은 p형 도펀트인 경우, 제2도펀트가 도핑된 제2 도전형 반도체층(127)은 p형 반도체층일 수 있다.
실시 예에 따른 반도체구조물(120)은 복수 개의 리세스(128)를 포함한다. 복수 개의 리세스(128)는 제2 도전형 반도체층(127)의 제1면(127G)에서 활성층(126)을 관통하여 제1 도전형 반도체층(124)의 일부 영역까지 배치될 수 있다.
제1 전극(142)은 리세스(128)의 내부에 배치되어 제1 도전형 반도체층(124)과 전기적으로 연결될 수 있다. 제1 도전층(165)은 복수 개의 리세스(128) 내에 배치되어 복수 개의 제1 전극(142)을 전기적으로 연결될 수 있다. 리세스(128)의 내부에는 제1 절연층(131)이 배치되어 제1 도전층(165)을 제2 도전형 반도체층(127) 및 활성층(126)과 전기적으로 절연시킬 수 있다.
반도체구조물(120)은 알루미늄 조성이 높아지면 반도체구조물(120) 내에서 전류 분산 특성이 저하될 수 있다. 또한, 활성층은 GaN 기반의 청색 발광 소자에 비하여 측면으로 방출하는 광량이 증가하게 된다(TM 모드). 이러한 TM모드는 자외선 반도체 소자에서 주로 발생할 수 있다.
자외선 반도체 소자는 청색 GaN 반도체 소자에 비해 전류 분산 특성이 떨어진다. 따라서, 자외선 반도체 소자는 청색 GaN 반도체 소자에 비해 상대적으로 많은 제1 전극(142)을 배치할 필요가 있다.
제2 전극(246)은 제2 도전형 반도체층(127)의 제1면(127G)에 배치될 수 있다. 제2 전극(246)은 상대적으로 자외선 광 흡수가 적은 투광 전극을 포함할 수 있다.
제1 전극(142)과 제2 전극(246)은 오믹 전극일 수 있다. 제1 전극(142)과 제2 전극(246)은 ITO(indium tin oxide), IZO(indium zinc oxide), IZTO(indium zinc tin oxide), IAZO(indium aluminum zinc oxide), IGZO(indium gallium zinc oxide), IGTO(indium gallium tin oxide), AZO(aluminum zinc oxide), ATO(antimony tin oxide), GZO(gallium zinc oxide), IZON(IZO Nitride), AGZO(Al-Ga ZnO), IGZO(In-Ga ZnO), ZnO, IrOx, RuOx, NiO, RuOx/ITO, Ni/IrOx/Au, 또는 Ni/IrOx/Au/ITO, Ag, Ni, Cr, Ti, Al, Rh, Pd, Ir, Sn, In, Ru, Mg, Zn, Pt, Au, Hf 중 적어도 하나를 포함하여 구성될 수 있으나, 이러한 재료에 한정되는 않는다.
광흡수층(13)은 반도체 소자의 최외측 가장자리에 배치될 수 있다. 광흡수층(13)은 반도체구조물이 성장한 기판을 제거하기 위해 조사하는 레이저를 흡수할 수 있다. 경우에 따라 광흡수층(13)은 활성층(126)에서 조사되는 광을 흡수할 수도 있다. 따라서, 광흡수층(13)의 면적은 최소화되는 것이 바람직할 수 있다.
도 2a를 참조하면, 광흡수층(13)은 제2 도전형 반도층(127)과 제1 절연층(131) 사이에 배치될 수 있다. 광흡수층(13)의 폭(L1)은 반도체 소자의 최외측에서 제2 전극(246)까지의 최단거리(L2)보다 작을 수 있다.
광흡수층(13)은 활성층(126)에서 생성된 자외선 광을 흡수할 수 있으므로 광흡수층(13)의 폭이 커지는 경우 광 추출 효율이 감소할 수 있다. 따라서, 광흡수층의 폭(L11)은 두께 방향(Y 방향)으로 반도체 구조물(120)과 중첩되지 않도록 짧게 형성될 수 있다. 그러나, 반드시 이에 한정하는 것은 아니고 광흡수층(13)은 반도체 소자의 내측으로 더 연장(L12)되어 반도체 구조물(120)과 두께 방향으로 중첩될 수도 있다. 광흡수층(13)의 연장 부분(L12)은 제조 공차 또는 공정 마진에 의해 형성될 수도 있다.
광흡수층(13)의 폭(L1)은 반도체 소자의 최외측에서 1㎛ 내지 20㎛일 수 있으나 반드시 이에 한정하지 않는다.
제2전극(246)은 활성층(126)에서 생성된 광을 흡수하지 않도록 얇게 형성하는 것이 유리하다. 예시적으로 제2전극(246)의 두께는 1nm 내지 20nm일 수 있다. 이와 반대로 광흡수층(13)은 성장기판 제거용 레이저를 최대한 흡수할 수 있도록 두꺼운 것이 유리하다. 예시적으로 광흡수층(13)의 두께는 15nm 내지 100nm일 수 있다.
따라서, 광흡수층(13)과 제2전극(246)이 동일한 조성을 갖는다면, 광흡수층(13)의 두께(d2)는 제2전극(246)의 두께(d1)보다 두꺼울 수 있다. 예시적으로 광흡수층(13)과 제2전극(246)은 ITO일 수 있으나 반드시 이에 한정하지 않는다. 광흡수층(13)은 에너지 밴드갭이 레이저보다 작은 물질이면 제한 없이 적용될 수 있다.
도 2b를 참조하면, 광흡수층(13)은 반도체 소자의 가장자리를 따라 4개 측면에 각각 배치될 수 있으나 반드시 이에 한정하지 않는다. 예시적으로 광흡수층(13)은 제1측면에 배치된 제1광흡수층(13a), 및 제2측면에 배치된 제2광흡수층(13b)으로만 구성될 수도 있다. 즉, 광흡수층(13)은 필요한 측면에만 선택적으로 배치될 수도 있다.
다시 도 1을 참조하면, 제2 도전층(150)은 복수 개의 제2 전극(246)과 전기적으로 연결될 수 있다. 제2 도전층(150)은 제1 절연층(131)과 접착력이 좋은 물질을 포함할 수 있다. 예시적으로 제2 도전층(150)은 Cr, Al, Ti, Ni, Au 등의 물질로 구성되는 군으로부터 선택되는 적어도 하나의 물질 및 이들의 합금으로 이루어질 수 있으며, 단일층 혹은 복수의 층으로 이루어질 수 있다.
반도체 소자의 일 측 모서리 영역에는 제2 전극패드(166)가 배치될 수 있다. 제2 전극패드(166)는 중앙 부분이 함몰되어 상면이 오목부와 볼록부를 가질 수 있다. 상면의 오목부에는 와이어(미도시)가 본딩될 수 있다. 따라서, 접착 면적이 넓어져 제2 전극패드(166)와 와이어가 더 견고히 본딩될 수 있다.
제2 전극패드(166)는 광을 반사하는 작용을 할 수 있으므로, 제2 전극패드(166)는 반도체구조물(120)과 가까울수록 광 추출효율이 향상될 수 있다.
제2 전극패드(166)는 활성층(126)보다 높을 수 있다. 따라서 제2 전극패드(166)는 활성층(126)에서 소자의 수평방향으로 방출되는 광을 상부로 반사하여 광 추출효율을 향상시키고, 지향각을 제어할 수 있다.
제2 전극패드(166)는 제1 절연층(131)을 관통하여 제2 도전층(150), 및 제2 전극(246)과 전기적으로 연결될 수 있다.
제1 절연층(131)은 제1 전극(142)을 활성층(126) 및 제2 도전형 반도체층(127)과 전기적으로 절연시킬 수 있다. 또한, 제1 절연층(131)은 광흡수층(13)을 덮을 수 있다.
제1 절연층(131)은 SiO2, SixOy, Si3N4, SixNy, SiOxNy, Al2O3, TiO2, AlN 등으로 이루어진 군에서 적어도 하나가 선택되어 형성될 수 있으나, 이에 한정하지 않는다. 제1 절연층(131)은 단층 또는 다층으로 형성될 수 있다. 예시적으로 제1 절연층(131)은 Si 산화물이나 Ti 화합물을 포함하는 다층 구조의 DBR(distributed Bragg reflector) 일 수도 있다. 그러나, 반드시 이에 한정하지 않고 제1 절연층(131)은 다양한 반사 구조를 포함할 수 있다.
제2 절연층(132)은 제2 도전층(150)을 제1 도전층(165)과 전기적으로 절연시킬 수 있다. 제1 도전층(165)은 제2 절연층(132)을 관통하여 제1 전극(142)과 전기적으로 연결될 수 있다.
반도체구조물(120)의 하부면과 리세스(128)의 형상을 따라 제1 도전층(165)과 접합층(160)이 배치될 수 있다. 제1 도전층(165)은 반사율이 우수한 물질로 이루어질 수 있다. 예시적으로 제1 도전층(165)은 알루미늄을 포함할 수 있다. 제1 도전층(165)이 알루미늄을 포함하는 경우, 활성층(126)에서 방출되는 광을 상부로 반사하는 역할을 하여 광 추출 효율을 향상시킬 수 있다.
접합층(160)은 도전성 재료를 포함할 수 있다. 예시적으로 접합층(160)은 금, 주석, 인듐, 알루미늄, 실리콘, 은, 니켈, 및 구리로 구성되는 군으로부터 선택되는 물질 또는 이들의 합금을 포함할 수 있다. 접합층(160)은 LLO 공정시 기판(170)과 반도체구조물(120)을 접합시킬 수도 있다.
기판(170)은 도전성 물질로 이루어질 수 있다. 예시적으로 기판(170)은 금속 또는 반도체 물질을 포함할 수 있다. 기판(170)은 전기 전도도 및/또는 열 전도도가 우수한 금속일 수 있다. 이 경우 반도체 소자 동작시 발생하는 열을 신속이 외부로 방출할 수 있다.
기판(170)은 실리콘, 몰리브덴, 실리콘, 텅스텐, 구리 및 알루미늄으로 구성되는 군으로부터 선택되는 물질 또는 이들의 합금을 포함할 수 있다. 기판(170)은 제1 도전형 반도체층(124)과 외부 전극을 전기적으로 연결할 수 있다.
패시베이션층(180)은 반도체구조물(120)의 상부면과 측면에 형성될 수 있다. 패시베이션층(180)은 제2 전극(246)과 인접한 영역이나 제2 전극(246)의 하부에서 제1 절연층(131)과 접촉할 수 있다.
반도체구조물(120)의 상면에는 요철이 형성될 수 있다. 이러한 요철은 반도체구조물(120)에서 출사되는 광의 추출 효율을 향상시킬 수 있다. 요철은 자외선 파장에 따라 평균 높이가 다를 수 있으며, UV-C의 경우 300 nm 내지 800 nm 정도의 높이를 갖고, 평균 500nm 내지 600nm 정도의 높이를 가질 때 광 추출 효율이 향상될 수 있다.
도 3은 종래 구조에서 기판 제거시 발생하는 문제점을 설명하기 위한 도면이고, 도 4a 내지 도 4c는 기판 제거시 반도체 소자가 손상된 상태를 보여주는 도면이다.
도 3을 참조하면, 반도체 소자의 기판 제거 방법은, 먼저 기판(1)상에 반도체구조물(120)을 형성하여 복수 개의 칩 영역(10)과 채널층(12)으로 구획할 수 있다. 이후, 반도체구조물(120) 상에 복수 개의 전극층(M1)을 형성하고 기판(1)을 제거할 수 있다.
기판(1)을 제거하기 위해 레이저를 조사할 수 있다. 반도체구조물(120)에는 레이저를 흡수하기 위한 메인 흡수층(P1)이 형성될 수 있다. 그러나, 자외선 반도체구조물(120)의 경우 레이저의 에너지 밴드갭이 레이저가 반도체구조물(120)을 통과하여 채널층(12)에 손상을 줄 수 있다.
예시적으로 레이저가 메인 흡수층(P1)을 통과하여 채널층(12)에 형성된 전극층(M1)에 흡수되면 박리가 발생할 수 있다. 이에 반해 칩 영역(10)은 레이저를 일부 흡수할 수 있는 다수의 층(예: 제2전극)들이 배치되므로 상대적으로 채널층(12)에 비해 손상이 덜할 수 있다.
그러나, 채널층(12)에 형성된 전극층(M1)은 칩 영역(10)의 전극층(M1)과 연결되어 있다. 따라서, 채널층(12)의 전극층(M1)에 박리 현상이 발생하면 칩 영역(10)까지 손상될 수 있다. 도 4a 내지 4c를 참조하면, 채널층(12)이 손상됨으로써 칩 영역(10)까지 손상되었음을 알 수 있다.
따라서, 채널층(12)으로 레이저가 투과되는 것을 방지하거나 채널층(12)의 손상이 칩 영역(10)으로 전파되지 않도록 제어하는 것이 중요하다.
도 5a 내지 도 5d는 본 발명의 일 실시 예에 따른 반도체 소자의 제조방법을 설명하기 위한 도면이고, 도 6은 반도체구조물을 메사 식각하여 복수 개의 반도체 소자 사이에 채널을 형성하고, 광흡수층을 형성한 상태를 보여주는 도면이고, 도 7은 반도체구조물에서 기판을 제거하는 상태를 보여주는 도면이다.
실시 예에 따른 반도체 소자 제조방법은 기판(1)상에 메인 흡수층(P1), 제1 도전형 반도체층(124), 활성층(126), 및 제2 도전형 반도체층(127)을 차례로 형성하여 반도체구조물을 형성하는 단계, 복수 개의 칩 영역(10) 사이에 배치되는 채널층(12)상에 광흡수층(13)을 형성하는 단계, 칩 영역(10)과 채널층(12)에 전극을 형성하는 단계, 및 기판(1)에 레이저를 조사하여 기판(1)을 분리하는 단계를 포함할 수 있다.
도 5a를 참조하면, 반도체구조물을 형성하는 단계는, 기판(1)상에 메인 흡수층(P1), 제1 도전형 반도체층(124), 활성층(126), 제2 도전형 반도체층(127)을 차례로 형성하여 반도체구조물(120)을 형성할 수 있다.
기판(1)은 사파이어(Al2O3), SiC, GaAs, GaN, ZnO, Si, GaP, InP 및 Ge 중 선택된 물질로 형성될 수 있으며, 이에 대해 한정하지는 않는다.
메인 흡수층(P1)은 Al 조성이 낮은 물질로 구성되어 레이저를 흡수할 수 있다. 예시적으로 메인 흡수층(P1)은 AlGaN 단일층이거나, 초격자 구조일 수도 있다.
도 5a, 및 도 6을 참조하면, 광흡수층(13)을 형성하는 단계는, 채널층(12) 상에 광흡수층(13)을 형성할 수 있다. 광흡수층(13)은 LLO 레이저를 흡수할 수 있을 정도의 에너지 밴드갭을 갖는 물질을 포함할 수 있다. LLO 레이저의 파장대는 특별히 한정하지 않는다. 광흡수층(13)은 ITO일 수 있으나 반드시 이에 한정하지 않는다. 예시적으로 광흡수층(13)은 제2 전극과 동일한 조성을 가질 수도 있다.
전극을 형성하는 단계는, 복수 개의 칩 영역(10)과 채널층(12)에 제1 전극(142), 제2 전극(246), 제1도전층(165), 제2도전층(150), 전도성 기판(170)을 차례로 형성할 수 있다.
도 5b 및 도 7을 참조하면, 기판(1)을 분리하는 단계는 레이저를 조사하여 기판(1)을 반도체구조물(120)에서 분리할 수 있다. 이때, 메인 흡수층(P1)은 레이저를 흡수하여 분리될 수 있다.
채널층(12)에는 광흡수층(13)이 추가적으로 배치되어 있으므로 메인 흡수층(P1)을 통과한 레이저는 대부분 광흡수층(13)에 흡수될 수 있다. 따라서, 채널층(12)에 형성된 전극층(M1, 165, 150)이 레이저를 흡수하지 않아 박리 현상이 개선될 수 있다.
도 5c를 참조하면, 기판(1)이 제거된 반도체구조물(120)의 일면을 메사 식각하여 복수 개의 칩 영역(10)을 분리할 수 있다. 이때, 광흡수층(13)의 일부는 칩 영역(10)의 내측에 배치될 수 있다. 그러나, 반드시 이에 한정되지 않고 광흡수층(13)이 두께 방향으로 중첩되지 않도록 반도체 구조물(120)을 식각할 수도 있다.
도 5d를 참조하면, 이격 배치된 반도체구조물(120)의 사이를 절단하여 복수 개의 반도체 소자로 분리하고, 반도체 구조물(120)과 광흡수층(13)상에 패시베이션층(180)을 형성할 수 있다.
도 8은 도 6의 변형예이고, 도 9는 도 8의 구조에서 반도체구조물에서 기판을 제거하는 상태를 보여주는 도면이다.
도 8을 참조하면, 채널층(12)에 광흡수층(13)을 형성하는 대신 리세스(11a)와 리세스(11a)의 바닥면에서 돌출된 돌출부(11b)를 포함할 수 있다. 돌출부(11b)는 복수 개의 칩 영역(10)을 둘러싸도록 배치될 수 있다. 이 경우 채널층(12)의 전극층(M1)이 레이저를 흡수하여 박리되는 경우에도 돌출부(11b)에 의해 칩 영역(10)으로 전파되는 것이 방지될 수 있다. 즉, 돌출부(11b)는 박리의 전파를 방지하는 방지벽의 역할을 수행할 수 있다. 그러나, 반드시 이에 한정되는 것은 아니고 리세스(11a)와 돌출부(11b)를 형성한 후, 그 위에 광흡수층을 더 형성할 수도 있다.
반도체 소자는 조명 시스템의 광원으로 사용되거나, 영상표시장치의 광원이나 조명장치의 광원으로 사용될 수 있다. 즉, 반도체 소자는 케이스에 배치되어 광을 제공하는 다양한 전자 디바이스에 적용될 수 있다. 예시적으로, 반도체 소자와 RGB 형광체를 혼합하여 사용하는 경우 연색성(CRI)이 우수한 백색광을 구현할 수 있다.
상술한 반도체 소자는 발광소자 패키지로 구성되어, 조명 시스템의 광원으로 사용될 수 있는데, 예를 들어 영상표시장치의 광원이나 조명 장치 등의 광원으로 사용될 수 있다.
영상표시장치의 백라이트 유닛으로 사용될 때 에지 타입의 백라이트 유닛으로 사용되거나 직하 타입의 백라이트 유닛으로 사용될 수 있고, 조명 장치의 광원으로 사용될 때 등기구나 벌브 타입으로 사용될 수도 있으며, 또한 이동 단말기의 광원으로 사용될 수도 있다.
발광 소자는 상술한 발광 다이오드 외에 레이저 다이오드가 있다.
레이저 다이오드는, 발광소자와 동일하게, 상술한 구조의 제1도전형 반도체층과 활성층 및 제2도전형 반도체층을 포함할 수 있다. 그리고, p-형의 제1 도전형 반도체와 n-형의 제2 도전형 반도체를 접합시킨 뒤 전류를 흘러주었을 때 빛이 방출되는 electro-l㎛inescence(전계발광) 현상을 이용하나, 방출되는 광의 방향성과 위상에서 차이점이 있다. 즉, 레이저 다이오드는 여기 방출(stimulated emission)이라는 현상과 보강간섭 현상 등을 이용하여 하나의 특정한 파장(단색광, monochromatic beam)을 가지는 빛이 동일한 위상을 가지고 동일한 방향으로 방출될 수 있으며, 이러한 특성으로 인하여 광통신이나 의료용 장비 및 반도체 공정 장비 등에 사용될 수 있다.
수광 소자로는 빛을 검출하여 그 강도를 전기 신호로 변환하는 일종의 트랜스듀서인 광 검출기(photodetector)를 예로 들 수 있다. 이러한 광 검출기로서, 광전지(실리콘, 셀렌), 광 출력전 소자(황화 카드뮴, 셀렌화 카드뮴), 포토 다이오드(예를 들어, visible blind spectral region이나 true blind spectral region에서 피크 파장을 갖는 PD), 포토 트랜지스터, 광전자 증배관, 광전관(진공, 가스 봉입), IR(Infra-Red) 검출기 등이 있으나, 실시 예는 이에 국한되지 않는다.
또한, 광검출기와 같은 반도체 소자는 일반적으로 광변환 효율이 우수한 직접 천이 반도체(direct bandgap semiconductor)를 이용하여 제작될 수 있다. 또는, 광검출기는 구조가 다양하여 가장 일반적인 구조로는 p-n 접합을 이용하는 pin형 광검출기와, 쇼트키접합(Schottky junction)을 이용하는 쇼트키형 광검출기와, MSM(Metal Semiconductor Metal)형 광검출기 등이 있다.
포토 다이오드(Photodiode)는 발광소자와 동일하게, 상술한 구조의 제1 도전형 반도체층과 활성층 및 제2도전형 반도체층을 포함할 수 있고, pn접합 또는 pin 구조로 이루어진다. 포토 다이오드는 역바이어스 혹은 제로바이어스를 가하여 동작하게 되며, 광이 포토 다이오드에 입사되면 전자와 정공이 생성되어 전류가 흐른다. 이때 전류의 크기는 포토 다이오드에 입사되는 광의 강도에 거의 비례할 수 있다.
광전지 또는 태양 전지(solar cell)는 포토 다이오드의 일종으로, 광을 전류로 변환할 수 있다. 태양 전지는, 발광소자와 동일하게, 상술한 구조의 제1 도전형 반도체층과 활성층 및 제2도전형 반도체층을 포함할 수 있다.
또한, p-n 접합을 이용한 일반적인 다이오드의 정류 특성을 통하여 전자 회로의 정류기로 이용될 수도 있으며, 초고주파 회로에 적용되어 발진 회로 등에 적용될 수 있다.
또한, 상술한 반도체 소자는 반드시 반도체로만 구현되지 않으며 경우에 따라 금속 물질을 더 포함할 수도 있다. 예를 들어, 수광 소자와 같은 반도체 소자는 Ag, Al, Au, In, Ga, N, Zn, Se, P, 또는 As 중 적어도 하나를 이용하여 구현될 수 있으며, p형이나 n형 도펀트에 의해 도핑된 반도체 물질이나 진성 반도체 물질을 이용하여 구현될 수도 있다.
이상에서 실시예를 중심으로 설명하였으나 이는 단지 예시일 뿐 본 발명을 한정하는 것이 아니며, 본 발명이 속하는 분야의 통상의 지식을 가진 자라면 본 실시예의 본질적인 특성을 벗어나지 않는 범위에서 이상에 예시되지 않은 여러 가지의 변형과 응용이 가능함을 알 수 있을 것이다. 예를 들어, 실시예에 구체적으로 나타난 각 구성 요소는 변형하여 실시할 수 있는 것이다. 그리고 이러한 변형과 응용에 관계된 차이점들은 첨부된 청구 범위에서 규정하는 본 발명의 범위에 포함되는 것으로 해석되어야 할 것이다.

Claims (10)

  1. 제1 도전형 반도체층, 제2 도전형 반도체층, 상기 제1 도전형 반도체층과 상기 제2 도전형 반도체층 사이에 배치되는 활성층을 포함하고,
    상기 제2 도전형 반도체층 및 상기 활성층을 관통하여 상기 제1 도전형 반도체층의 일부 영역까지 배치되는 복수 개의 리세스를 포함하는 반도체 구조물;
    상기 복수 개의 리세스의 내부에 배치되어 상기 제1 도전형 반도체층과 전기적으로 연결되는 제1 전극;
    상기 제2 도전형 반도체층과 전기적으로 연결되는 제2 전극;
    상기 반도체 구조물의 가장자리에 배치되는 광흡수층;
    상기 제1 전극과 전기적으로 연결되는 제1 도전층;
    상기 제2 전극과 전기적으로 연결되는 제2 도전층; 및
    상기 리세스의 내부에 배치되어 상기 제1 도전층을 상기 활성층 및 제2 도전형 반도체층과 절연시키는 제1 절연층을 포함하고,
    상기 광흡수층은 상기 제2 전극보다 두껍고,
    상기 활성층은 자외선(UV) 파장대의 광을 출사하고,
    상기 광흡수층은 상기 반도체 구조물의 두께 방향으로 상기 반도체 구조물과 중첩되지 않고,
    상기 제1 절연층은 상기 두께 방향과 수직한 수평방향으로 상기 광흡수층과 상기 제2 도전층 사이에 배치되고, 상기 제2 도전층은 상기 수평방향으로 상기 제1 절연층과 상기 제2 전극 사이에 배치되는 반도체 소자.
  2. 제1항에 있어서,
    상기 광흡수층과 상기 제2 전극은 ITO를 포함하는 반도체 소자.
  3. 제1항에 있어서,
    상기 광흡수층의 폭은 반도체 소자의 최외측에서 상기 제2 전극까지의 최단 거리보다 짧은 반도체 소자.
  4. 제1항에 있어서,
    상기 제1 도전층과 전기적으로 연결되는 전도성 기판을 포함하는 반도체 소자.
  5. 제4항에 있어서,
    상기 제1 도전층과 제2 도전층 사이에 배치되는 제2 절연층을 포함하는 반도체 소자.
  6. 제5항에 있어서,
    상기 광흡수층은 상기 제2 도전형 반도체층과 상기 제1 절연층 사이에 배치되는 반도체 소자.
  7. 삭제
  8. 기판상에 메인 흡수층, 제1 도전형 반도체층, 활성층, 및 제2 도전형 반도체층을 차례로 형성하여 반도체구조물을 형성하는 단계;
    상기 반도체구조물을 복수 개의 칩 영역 및 상기 복수 개의 칩 영역 사이에 배치되는 채널층으로 구분하고, 상기 채널층상에 광흡수층을 형성하는 단계;
    상기 복수 개의 칩 영역과 채널층상에 전극을 형성하는 단계;
    상기 기판에 레이저를 조사하여 상기 기판을 분리하는 단계; 및
    상기 채널층을 절단하여 상기 복수 개의 칩 영역을 분리하는 단계를 포함하고,
    상기 분리된 칩 영역은 상기 광흡수층의 일부를 포함하고, 상기 광흡수층은 상기 반도체 구조물의 두께 방향으로 상기 반도체구조물과 중첩하지 않고,
    상기 메인 흡수층과 상기 광흡수층은 상기 레이저를 흡수하고,
    상기 광흡수층은 상기 메인 흡수층을 통과한 레이저를 흡수하는 반도체 소자 제조방법.
  9. 삭제
  10. 삭제
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