KR102281633B1 - 인버터 제어장치 및 방법 - Google Patents

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Abstract

인버터 제어장치 및 방법이 개시된다. 본 발명의 일실시예의 방법은, 인버터의 운전지령을 수신하고, 상기 인버터의 출력의 단락을 진단하기 위한 유효벡터를 상기 인버터부가 출력하도록 하는 제1PWM 제어신호를 상기 인버터부로 출력하고, 상기 인버터부의 단락전류를 검출하는 경우, 상기 인버터의 출력을 차단한다.

Description

인버터 제어장치 및 방법{APPARATUS AND METHOD FOR CONTROLLING INVERTER}
본 발명은 인버터 제어장치 및 방법에 대한 것이다.
일반적으로 인버터는 전기적으로 직류(DC)를 교류(AC)로 변환하는 역변환 장치로써, 산업계에서 사용되는 인버터는 상용전원으로부터 공급된 전력을 입력받아 자체적으로 전압과 주파수를 가변하여 전동기에 공급함으로써 전동기 속도를 고효율로 이용하게 제어하는 일련의 장치로 정의된다. 이러한 인버터는, 가변전압 가변주파수(variable voltage variable frequency, VVVF) 방식에 의해 제어되며, 펄스폭변조(pulse width modulation, PWM) 출력에 따라 전동기에 입력되는 전압과 주파수를 가변할 수 있다.
도 1은 일반적인 인버터의 구성도이다.
일반적으로, 인버터(100)는 전원부(200)로부터 3상의 교류전원을 인가받아, 정류부(110)가 이를 정류하고, 평활부(120)는 정류부(110)가 정류한 직류전압을 평활하여 저장한다. 인버터부(130)는 평활부(120)인 직류링크 커패시터에 저장된 직류전압을 PWM 제어신호에 따라 소정 전압 및 주파수를 가지는 교류전압을 출력하여, 이를 전동기(300)에 제공한다.
이때 인버터(100)의 인버터부(130)는 3상의 레그로 구성되며, 각 레그에는 2개의 스위칭 소자가 직렬로 연결되어 구성된다.
인버터(100)의 단락은, 인버터(100)의 출력중 2상 이상이 서로 단락되어 아주 큰 단락전류가 인버터(100)의 내부로 흐르는 경우로서, 인버터(100)의 출력선 피복의 열화에 의해 피복이 벗겨지면서 발생되거나, 전동기(300) 내부의 피복이 열화에 의해 벗겨지면서 발생되거나, 또는 작업자의 작업실수에 의해 발생된다.
인버터(100)의 단락시 인버터(100)로 흐르는 전류는 정격의 몇배 이상에 달하므로, 인버터(100)가 소손될 수 있고, 인명사고까지 발생할 수 있는 가능성이 있다.
따라서, 전동기(300)를 구동하는 인버터(100)는 출력단락시 사용자에게 이를 알리고, 인버터(100)의 운전을 정지하여 전동기(300) 및 사용자를 안전하게 보호하는 기능을 제공하고 있다.
그러나, 이러한 단락검출 회로에는 하드웨어적인 회로 지연구간이 존재하고, 유효벡터의 크기가 작은 경우, 이와 같은 지연에 의해 출력단락을 검출하지 못하는 구간이 발생하게 되는 문제점이 있다.
본 발명이 해결하고자 하는 기술적 과제는, 인버터의 운전 전에 단락을 진단하여 안정적으로 인버터를 구동하기 위한, 인버터 제어장치 및 방법을 제공하는 것이다.
상기와 같은 기술적 과제를 해결하기 위해, 본 발명의 일실시예에 의해 인버터를 제어하는 장치는, 복수의 스위칭소자로 구성되어, 직류전압을 제어부의 제어에 의해 교류전압으로 변환하여 출력하는 인버터부; 상기 인버터부에 흐르는 단락전류를 검출하는 단락검출부; 및 상기 인버터의 출력의 단락을 진단하기 위한 유효벡터를 상기 인버터부가 출력하도록 하는 펄스폭변조(PWM) 제어신호를 상기 인버터부에 인가하는 상기 제어부를 포함할 수 있다.
본 발명의 일실시예에서, 상기 인버터부는, 3상의 교류전압을 출력하는 3상의 레그로 구성되고, 상기 단락검출부는, 상기 3상의 레그의 하부레그로 흐르는 단락전류를 검출할 수 있다.
본 발명의 일실시예에서, 상기 PWM 제어신호는, U-V상의 단락에 대하여 상기 인버터부가 유효벡터 [1 0 0], [0 1 0], [0 1 1] 및 [1 0 1] 중 어느 하나를 출력하게 하는 신호를 포함할 수 있다.
본 발명의 일실시예에서, 상기 PWM 제어신호는, V-W상의 단락에 대하여 상기 인버터부가 유효벡터 [1 1 0], [0 1 0], [0 0 1] 및 [1 0 1] 중 어느 하나 이상을 출력하게 하는 신호를 포함할 수 있다.
본 발명의 일실시예에서, 상기 PWM 제어신호는, W-U상의 단락에 대하여 상기 인버터부가 유효벡터 [1 0 0], [1 1 0], [0 1 1] 및 [0 0 1] 중 어느 하나 이상을 출력하게 하는 신호를 포함할 수 있다.
본 발명의 일실시예에서, 상기 제어부는, 상기 인버터부가 어느 하나의 상기 유효벡터를 소정 시간 이상 출력할 수 있도록 상기 PWM 제어신호를 출력할 수 있다.
본 발명의 일실시예에서, 상기 소정 시간은 상기 단락검출부의 회로적인 특성으로부터 결정될 수 있다.
또한, 상기와 같은 기술적 과제를 해결하기 위해, 본 발명의 일실시예에 의해 복수의 스위칭소자로 구성되어 직류전압을 교류전압으로 변환하여 출력하는 인버터부를 포함하는, 인버터를 제어하는 방법은, 상기 인버터의 운전지령을 수신하는 단계; 상기 인버터의 출력의 단락을 진단하기 위한 유효벡터를 상기 인버터부가 출력하도록 하는 제1PWM 제어신호를 상기 인버터부로 출력하는 단계; 및 상기 인버터부의 단락전류를 검출하는 경우, 상기 인버터의 출력을 차단하는 단계를 포함할 수 있다.
본 발명의 일실시예에서, 상기 제1PWM 제어신호는, U-V상의 단락에 대하여 상기 인버터부가 유효벡터 [1 0 0], [0 1 0], [0 1 1] 및 [1 0 1] 중 어느 하나를 출력하게 하는 신호를 포함할 수 있다.
본 발명의 일실시예에서, 상기 제1PWM 제어신호는, V-W상의 단락에 대하여 상기 인버터부가 유효벡터 [1 1 0], [0 1 0], [0 0 1] 및 [1 0 1] 중 어느 하나 이상을 출력하게 하는 신호를 포함할 수 있다.
본 발명의 일실시예에서, 상기 제1PWM 제어신호는, W-U상의 단락에 대하여 상기 인버터부가 유효벡터 [1 0 0], [1 1 0], [0 1 1] 및 [0 0 1] 중 어느 하나 이상을 출력하게 하는 신호를 포함할 수 있다.
본 발명의 일실시예에서, 상기 제1PWM 제어신호는, 상기 인버터부가 어느 하나의 상기 유효벡터를 소정 시간 이상 출력하게 할 수 있다.
본 발명의 일실시예에서, 상기 소정 시간은 단락전류를 검출하는 단락검출부의 회로적인 특성으로부터 결정될 수 있다.
본 발명의 일실시예의 방법은, 상기 인버터부의 단락전류가 검출되지 않은 경우, 상기 인버터의 정상운전을 위한 제2PWM 제어신호를 출력하는 단계를 더 포함할 수 있다.
상기와 같은 본 발명은, 단락이 발생한 경우 인버터에 운전지령이 수신되면, 진단 PWM 제어신호에 의해 단락진단을 수행하여 미리 인버터의 출력을 차단함으로써 인버터를 보호하고 작업자를 보호하게 하는 효과가 있다.
도 1은 일반적인 인버터의 구성도이다.
도 2는 인버터 출력중 U상과 V상이 단락된 경우 전류경로를 나타낸 것이다.
도 3은 인버터 출력중 U상과 W상이 단락된 경우 전류경로를 나타낸 것이다.
도 4는 인버터 출력중 V상과 W상이 단락된 경우 전류경로를 나타낸 것이다.
도 5는 인버터의 공간벡터 펄스폭 변조방식(spacial vector pulse width modulation, SVPWM)을 설명하기 위한 예시도이다.
도 6은 도 5의 섹터1에서의 유효벡터를 나타내는 예시도이다.
도 7은 섹터1에서 U-V상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 8은 섹터1에서 V-W상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 9는 섹터1에서 W-U상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 10은 섹터2에서 U-V상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 11은 섹터2에서 V상과 W상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이다.
도 12는 섹터2에서 W-U상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 13은 섹터3에서 U-V상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 14는 섹터3에서 V-W상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 15는 섹터3에서 W-U상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 16은 섹터4에서 U-V상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 17는 섹터4에서 V-W상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 18는 섹터4에서 W-U상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 19는 섹터5에서 U-V상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 20은 섹터5에서 V-W상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 21은 섹터5에서 W-U상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 22는 섹터6에서 U-V상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 23은 섹터6에서 V-W상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 24는 섹터6에서 W-U상의 출력단락의 경우 전류경로를 나타낸 예시도이다.
도 25는 유효벡터 [1 0 0] 구간이 짧게 형성되는 경우 단락검출이 불가능해지는 것을 설명하기 위한 예시도이다.
도 26은 U-V상 출력단락이 발생한 경우, 단락전류의 검출이 불가능한 구간을 설명하기 위한 예시도다.
도 27은 본 발명의 일실시예의 인버터 시스템의 구성도이다.
도 28은 본 발명의 일실시예의 제어방법을 설명하기 위한 일예시도이다.
도 29는 U-V상이 단락된 경우 각 유효벡터에 의해 단락전류가 흐르는 경우를 나타낸 것이다.
도 30은 V-W상이 단락된 경우 각 유효벡터에 의해 단락전류가 흐르는 경우를 나타낸 것이다.
도 31은 W-U상이 단락된 경우 각 유효벡터에 의해 단락전류가 흐르는 경우를 나타낸 것이다.
본 발명의 구성 및 효과를 충분히 이해하기 위하여, 첨부한 도면을 참조하여 본 발명의 바람직한 실시예들을 설명한다. 그러나 본 발명은 이하에서 개시되는 실시예에 한정되는 것이 아니라, 여러가지 형태로 구현될 수 있고 다양한 변경을 가할 수 있다. 단지, 본 실시예에 대한 설명은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야의 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위하여 제공되는 것이다. 첨부된 도면에서 구성요소는 설명의 편의를 위하여 그 크기를 실제보다 확대하여 도시한 것이며, 각 구성요소의 비율은 과장되거나 축소될 수 있다.
'제1', '제2' 등의 용어는 다양한 구성요소를 설명하는데 사용될 수 있지만, 상기 구성요소는 위 용어에 의해 한정되어서는 안 된다. 위 용어는 하나의 구성요소를 다른 구성요소로부터 구별하는 목적으로만 사용될 수 있다. 예를 들어, 본 발명의 권리범위를 벗어나지 않으면서 '제1구성요소'는 '제2구성요소'로 명명될 수 있고, 유사하게 '제2구성요소'도 '제1구성요소'로 명명될 수 있다. 또한, 단수의 표현은 문맥상 명백하게 다르게 표현하지 않는 한, 복수의 표현을 포함한다. 본 발명의 실시예에서 사용되는 용어는 다르게 정의되지 않는 한, 해당 기술분야에서 통상의 지식을 가진 자에게 통상적으로 알려진 의미로 해석될 수 있다.
이하에서는, 도면을 참조하여, 종래의 인버터 출력단락 방식을 설명하고, 본 발명의 일실시예에 따른 인버터 제어장치를 설명하기로 한다.
도 2는 인버터 출력중 U상과 V상이 단락된 경우 전류경로를 나타낸 것이고, 도 3은 인버터 출력중 U상과 W상이 단락된 경우 전류경로를 나타낸 것이고, 도 4는 인버터 출력중 V상과 W상이 단락된 경우 전류경로를 나타낸 것이다.
즉, 도 2 내지 도 4와 같이, 인버터 출력이 '단락'되었다는 것은, '단락전류'가 흐른다는 것을 의미하고, 이는 인버터부(130)의 상부와 하부의 스위치가 같이 켜지는 상황을 의미하게 된다.
도 5는 인버터의 공간벡터 펄스폭 변조방식(spacial vector pulse width modulation, SVPWM)을 설명하기 위한 예시도이고, 도 6은 도 5의 섹터1에서의 유효벡터를 나타내는 예시도이다.
또한, 도 7은 섹터1에서 U상과 V상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 8은 섹터1에서 V상과 W상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 9는 섹터1에서 W상과 U상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이다.
일반적으로 SVPWM은 지령전압과 인접한 2개의 유효벡터와 영전압을 이용하여 한 주기 동안 평균적으로 합성하는 방식으로 변조를 수행한다. 도 5의 음영부분이 섹터1(5A)으로서, 섹터1(5A)에서의 유효벡터는 [1 0 0]과 [1 1 0]이다.
이와 같이 섹터1(5A)에서, U상과 V상의 출력이 단락된 경우, 유효벡터 [1 0 0]에서 단락전류가 흐르게 되고, 이때의 전류경로가 도 7의 (a)와 같다. 이때, 유효벡터 [1 1 0]인 경우에는 도 7의 (b)와 같이 전류가 흐르게 되는데, 이 경우, 전위차가 없으므로 단락전류가 흐르지 않는다. 즉, 섹터1에서 U상과 V상의 출력이 단락된 경우에는, 유효벡터가 [1 0 0]인 경우에만 단락전류가 흐르게 된다.
한편, 섹터1(5A)에서 V상과 W상의 출력이 단락된 경우, 유효벡터 [1 1 0]에서 단락전류가 흐르게 되고, 이때의 전류경로가 도 8의 (b)와 같다. 유효벡터가 [1 0 0]인 경우에는 도 8의 (a)와 같이 단락전류가 흐르지 않는다. 즉, 섹터1에서 V상과 W상의 출력이 단락된 경우에는 유효벡터가 [1 1 0]인 경우에만 단락전류가 흐르게 된다.
또, 섹터1(5A)에서 W상과 U상의 출력이 단락된 경우, 유효벡터 [1 0 0] 및 [1 1 0]에서 모두 단락전류가 흐르게 되고, 이때의 전류경로가 각각 도 9의 (a) 및 (b)와 같다. 즉, 섹터1에서 W상과 U상의 출력이 단락된 경우에는 유효벡터 [1 0 0] 및 [1 1 0]에서 모두 단락전류가 흐르게 된다.
이와 유사하게, 도 5의 섹터2(5B)에서는, 유효벡터가 [1 1 0]과 [0 1 0]이다.
도 10은 섹터2에서 U상과 V상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 11은 섹터2에서 V상과 W상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 12는 섹터2에서 W상과 U상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이다.
도 10에 도시된 바와 같이, 섹터2(5B)에서 U상과 V상의 출력이 단락된 경우, 유효벡터 [0 1 0]에서 단락전류가 흐르게 되고((b) 참조), 유효벡터 [1 1 0]에서는 전위차가 없으므로 단락전류가 흐르지 않는다((a) 참조).
도 11에 도시된 바와 같이, 섹터2(5B)에서 V상과 W상의 출력이 단락된 경우, 유효벡터 [1 1 0] 및 [0 1 0]에서 모두 단락전류가 흐르게 된다.
또한, 도 12에 도시된 바와 같이, 섹터2(5B)에서 W상과 U상의 출력이 단락된 경우, 유효벡터 [1 1 0]에서 단락전류가 흐르게 되고((a) 참조), 유효벡터 [0 1 0]에서는 단락전류가 흐르지 않는다((b) 참조).
도 5의 섹터3(5C)에서는, 유효벡터가 [0 1 0]과 [0 1 1]이다.
도 13은 섹터3에서 U상과 V상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 14는 섹터3에서 V상과 W상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 15는 섹터3에서 W상과 U상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이다.
도 13에 도시된 바와 같이, 섹터3(5C)에서 U상과 V상의 출력이 단락된 경우, 유효벡터 [0 1 0]에서 단락전류가 흐르게 되고((a) 참조), 유효벡터 [0 1 1]에서 역시 단락전류가 흐르게 된다((b) 참조).
도 14에 도시된 바와 같이, 섹터3(5C)에서 V상과 W상의 출력이 단락된 경우, 유효벡터 [0 1 0]에서 단락전류가 흐르게 되고((a) 참조), 유효벡터 [0 1 1]에서는 전위차가 없으므로 단락전류가 흐르지 않는다((b) 참조).
또한, 도 15에 도시된 바와 같이, 섹터3(5C)에서 W상과 U상의 출력이 단락된 경우, 유효벡터 [0 1 1]에서 단락전류가 흐르게 되고((b) 참조), 유효벡터 [0 1 0]에서는 단락전류가 흐르지 않는다((a) 참조).
도 5의 섹터4(5D)에서 유효벡터는 [0 1 1]과 [0 0 1]이다.
도 16은 섹터4에서 U상과 V상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 17는 섹터4에서 V상과 W상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 18는 섹터4에서 W상과 U상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이다.
도 16에 도시된 바와 같이, 섹터4(5D)에서 U상과 V상의 출력이 단락된 경우, 유효벡터 [0 1 1]에서 단락전류가 흐르게 되고((a) 참조), 유효벡터 [0 0 1]에서는 단락전류가 흐르지 않는다((b) 참조).
도 17에 도시된 바와 같이, 섹터4(5D)에서 V상과 W상의 출력이 단락된 경우, 유효벡터 [0 1 1]에서는 전위차가 없으므로 단락전류가 흐르지 않고((a) 참조), 유효벡터 [0 0 1]에서는 단락전류가 흐르게 된다((b) 참조).
또한, 도 18에 도시된 바와 같이, 섹터4(5D)에서 W상과 U상의 출력이 단락된 경우, 유효벡터 [0 1 1]에서 단락전류가 흐르게 되고((a) 참조), 유효벡터 [0 0 1]에서 역시 단락전류가 흐르게 된다((b) 참조).
도 5의 섹터5(5E)에서 유효벡터는 [0 0 1]과 [1 0 1]이다.
도 19는 섹터5에서 U상과 V상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 20은 섹터5에서 V상과 W상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 21은 섹터5에서 W상과 U상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이다.
도 19에 도시된 바와 같이, 섹터5(5E)에서 U상과 V상의 출력이 단락된 경우, 유효벡터 [0 0 1]에서는 단락전류가 흐르지 않고((a) 참조), 유효벡터 [1 0 1]에서는 단락전류가 흐르게 된다((b) 참조).
도 20에 도시된 바와 같이, 섹터5(5E)에서 V상과 W상의 출력이 단락된 경우, 유효벡터 [0 0 1]에서는 단락전류가 흐르게 되고((a) 참조), 유효벡터 [1 0 1]에서 역시 단락전류가 흐르게 된다((b) 참조).
또한, 도 21에 도시된 바와 같이, 섹터5(5E)에서 W상과 U상의 출력이 단락된 경우, 유효벡터 [0 0 1]에서 단락전류가 흐르게 되고((a) 참조), 유효벡터 [1 0 1]에서는 전위차가 없으므로 단락전류는 흐르지 않는다((b) 참조).
도 5의 섹터6(5F)에서 유효벡터는 [1 0 1]과 [1 0 ]이다.
도 22는 섹터6에서 U상과 V상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 23은 섹터6에서 V상과 W상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이고, 도 24는 섹터6에서 W상과 U상의 출력이 단락된 경우 전류경로를 설명하기 위한 예시도이다.
도 22에 도시된 바와 같이, 섹터6(5F)에서 U상과 V상의 출력이 단락된 경우, 유효벡터 [1 0 1] 및 [1 0 0]에서 모두 단락전류가 흐르게 된다((a) 및 (b) 참조).
도 23에 도시된 바와 같이, 섹터6(5F)에서 V상과 W상의 출력이 단락된 경우, 유효벡터 [1 0 1]에서는 단락전류가 흐르게 되고((a) 참조), 유효벡터 [1 0 0]에서는 단락전류가 흐르지 않는다((b) 참조).
또한, 도 24에 도시된 바와 같이, 섹터6(5F)에서 W상과 U상의 출력이 단락된 경우, 유효벡터 [1 0 1]에서는 전위차가 없으므로 단락전류가 흐르지 않고((a) 참조), 유효벡터 [1 0 0]에서는 단락전류는 흐르게 된다((b) 참조).
이와 같이, U상과 V상이 단락된 경우, 유효벡터 [1 0 0], [0 1 0], [0 1 1], 및 [1 0 1]에서 단락전류가 흐르게 된다. 또, V상과 W상이 단락된 경우, 유효벡터 [1 1 0], [0 1 0], [0 0 1] 및 [1 0 1]에서 단락전류가 흐르게 된다. 또한, W상과 V상이 단락된 경우, 유효벡터 [1 0 0], [1 1 0], [0 1 1] 및 [0 0 1]에서 단락전류가 흐르게 된다.
종래의 단락검출방식에 의하면, 단락발생시 유효벡터에서 흐르는 단락전류를 검출하여 인버터의 출력을 차단하고 고장발생을 알림으로써, 인버터를 보호하고 작업자를 보호하게 된다.
즉, 종래의 인버터 출력단락 검출방식은, 단락이 발생한 경우 유효벡터가 인가되는 구간에서 전류경로가 형성이 되므로, 단락검출 회로에서 단락전류를 검출할 수 있다. 그러나, 단락검출 회로에 하드웨어적인 지연시간이 존재하여, 지연시간에 의해 단락전류를 정확히 검출하지 못하는 경우가 발생하게 된다.
도 25는 유효벡터 [1 0 0] 구간이 짧게 형성되는 경우 단락검출이 불가능해지는 것을 설명하기 위한 예시도이다.
단락검출회로에 회로적인 지연시간이 존재하여, 유효벡터 [1 0 0] 구간이 짧게 형성되는 인버터 저속운전 구간에서는, 유효벡터의 크기가 단락경로를 만드는 시간과 같게 되어, 유효벡터의 크기가 줄어들수록 단락검출회로에서는 지연으로 인해 검출이 불가능하게 되는 문제점이 있다.
도 26은 U-V상 출력단락이 발생한 경우, 인버터의 저속운전으로 인해 유효벡터의 크기가 작게 형성되면서(1.8us) 단락전류의 검출이 불가능한 구간을 설명하기 위한 것이다.
이와 같이, 종래의 단락전류 검출회로는, 하드웨어적으로 검출가능한 시간에 한계가 있으므로, 짧은 시간의 단락전류는 검출이 불가능하고, 이 불가능한 구간이 반복적이고 지속적으로 이어지는 경우, 순간성 단락전류가 지속적으로 인버터에 누적되면서 인버터의 소손에 이르게 되는 문제점이 있다.
본 발명은 이와 같은 문제점을 해결하기 위한 것으로서, 인버터의 운전을 시작하기 전에 단락을 진단함으로써, 인버터의 출력단락을 사전에 검출하여 인버터의 손상을 방지하기 위한 것이다.
도 27은 본 발명의 일실시예의 인버터 시스템의 구성도이다.
도면에 도시된 바와 같이, 본 발명의 일실시예의 인버터 시스템은, 인버터(1)와, 인버터(1)의 출력에 의해 구동되는 전동기(2) 및 인버터(1)를 제어하는 제어부(3)를 포함할 수 있다. 또한, 본 발명의 일실시예의 시스템은, 디스플레이부(4) 및 통신부(5)를 더 포함할 수 있다. 또한, 본 발명의 일실시예의 시스템은, 단락검출부(6)를 더 포함할 수 있다.
인버터(1)는, 입력되는 삼상전원을 평활하는 정류부(11), 정류부(11)에 의해 정류된 직류전압을 평활하는 평활부(12) 및 평활부(12)에 저장된 직류전압을 제어부(3)의 제어에 의해 3상의 교류전압으로 변환하는 인버터(13)를 포함할 수 있다.
인버터부(13)는 소정 토폴로지에 의해 배열되는 복수의 스위칭소자로 구성되며, 3개의 레그에서 출력되는 단상의 교류전압이 각각 전동기(2)로 출력될 수 있다.
제어부(3)는 소정 지령전압에 의해 평활부(12)에 저장된 직류전압을 교류전압으로 변환하도록 펄스폭제어(PWM) 제어신호를 인버터부(13)에 출력할 수 있다.
인버터(1)의 정지상태에서는 제어부(3)의 PWM 제어신호가 인가되지 않으므로, 단락이 형성되어도 단락경로가 형성되지 않기 때문에 정상적으로 보여진다. 그러나 인버터(1)가 운전지령에 의해 제어부(3)로부터 PWM 제어신호가 인가되면, 단락경로가 형성되어 단락전류가 흐르면서 인버터(1)에 손상이 발생할 수 있다.
따라서, 본 발명의 제어부(3)는 인버터(1)가 운전지령을 받은 경우, 운전 PWM 제어신호를 인버터부(13)에 인가하게 전에 단락을 진단하기 위한 진단 PWM 제어신호를 인가하는 방식으로 사전에 진단하여, 단락이 검출되면 인버터(1)의 출력을 차단하고 고장정보를 상위 제어시스템(도시되지 않음)에 통신부(5)를 통해 알리거나, 또는 디스플레이부(4)에 작업자가 확인가능하게 시각적으로 고장이 발생하였음을 알리는 정보를 표시할 수 있다.
또, 제어부(3)는 단락이 검출되지 않으면 인버터(1)의 인버터부(13)에 정상 PWM 제어신호를 인가하여 정상운전을 시작할 수 있다.
이때 단락검출부(6)는 인버터부(13)의 하부 레그를 흐르는 단락전류를 검출하여 제어부(3)에 검출여부를 제공할 수 있다. 단락검출부(6)는 예를 들어 변류기(CT)를 포함할 수 있으나, 본 발명이 이에 한정되는 것은 아니다.
도 28은 본 발명의 일실시예의 제어방법을 설명하기 위한 일예시도이다.
도면에 도시된 바와 같이, 본 발명의 일실시예의 제어부(3)는, 운전지령이 수신되기 전에는 동작하지 않다가, 운전지령을 수신하는 경우(S10), 정상 PWM 제어신호의 인가 전에 진단 PWM 제어신호를 인가할 수 있다(S15).
진단 PWM 제어신호는, U-V상의 단락에 대하여 인버터부(13)가 유효벡터 [1 0 0], [0 1 0], [0 1 1] 및 [1 0 1] 중 어느 하나를 출력하게 하는 PWM 제어신호일 수 있고, V-W상의 단락에 대하여 인버터부(13)가 유효벡터 [1 1 0], [0 1 0], [0 0 1] 및 [1 0 1] 중 어느 하나 이상을 출력하게 하는 신호일 수 있고, W-U상의 단락에 대하여 유효벡터 [1 0 0], [1 1 0], [0 1 1] 및 [0 0 1] 중 어느 하나 이상을 출력하게 하는 신호일 수 있다.
먼저 제어부(3)는 인버터부(13)가 유효벡터 [1 0 0], [0 1 0], [0 1 1] 중 [1 0 1] 어느 하나를 출력하게 하는 PWM 제어신호를 인가하여 U상과 V상의 단락여부를 결정할 수 있다. 도 29는 U-V상이 단락된 경우 각 유효벡터에 의해 단락전류가 흐르는 경우를 나타낸 것이다.
즉, 제어부(3)가 위 유효벡터 중 하나를 출력하게 하는 PWM 제어신호를 인가하여 도 29와 같이 인버터부(13)의 하부 레그로 흐르는 전류를 단락검출부(6)가 검출한 경우(S20), 제어부(3)는 U-V상 단락을 확인하여, 인버터(1)의 출력을 차단하고(S25), 통신부(5)를 통해 상위 제어 시스템에 고장정보를 전송하고, 디스플레이부(4)에 고장정보를 표시할 수 있다(S30). 이때, 유효벡터의 출력시간은, 단락검출부(6)의 회로적인 지연을 고려하여 단락전류를 검출할 수 있는 설계시간 이상을 설정할 수 있다. 단락전류 검출가능 설계시간은, 단락검출부(6)의 회로적인 구성에 의해 달라질 수 있는 것으로서, 어느 하나의 값에 한정되는 것은 아니다.
이와 같은 진단 PWM 제어신호는, U-V상, V-W상, W-U상에 대해 모두 수행할 수 있다(S35).
즉, 제어부(3)는 인버터부(13)가 유효벡터 [1 1 0], [0 1 0], [0 0 1] 및 [1 0 1] 중 어느 하나를 출력하게 하는 PWM 제어신호를 인가하여 V상과 W상의 단락여부를 확인할 수 있다. 도 30은 V-W상이 단락된 경우 각 유효벡터에 의해 단락전류가 흐르는 경우를 나타낸 것이다.
제어부(3)가 위 유효벡터 중 하나를 출력하게 하는 PWM 제어신호를 인가하여 도 30과 같이 인버터부(13)의 하부 레그로 흐르는 전류를 단락검출부(6)가 검출한 경우(S20), 제어부(3)는 U-V상 단락을 확인하여, 인버터(1)의 출력을 차단하고(S25), 통신부(5)를 통해 상위 제어 시스템에 고장정보를 전송하고, 디스플레이부(4)에 고장정보를 표시할 수 있다(S30).
또, 제어부(3)는, 유효벡터 [1 0 0], [1 1 0], [0 1 1] 및 [0 0 1] 중 어느 하나를 출력하게 하는 PWM 제어신호를 인가하여 W상과 U상의 단락여부를 확인할 수 있다. 도 31은 W-U상이 단락된 경우 각 유효벡터에 의해 단락전류가 흐르는 경우를 나타낸 것이다.
제어부(3)가 위 유효벡터 중 하나를 출력하게 하는 PWM 제어신호를 인가하여 도 31과 같이 인버터부(13)의 하부 레그로 흐르는 전류를 단락검출부(6)가 검출한 경우(S20), 제어부(3)는 U-V상 단락을 확인하여, 인버터(1)의 출력을 차단하고(S25), 통신부(5)를 통해 상위 제어 시스템에 고장정보를 전송하고, 디스플레이부(4)에 고장정보를 표시할 수 있다(S30).
한편, 도 29 내지 도 31과 같은 단락전류가 흐르지 않는 경우에는, 제어부(3)는 인버터(1)의 인버터부(13)에 정상 PWM 제어신호를 인가하여 정상운전을 시작할 수 있다(S40).
이와 같이, 본 발명의 일실시예에 의하면, 단락이 발생한 경우 인버터(1)에 운전지령이 수신되면, 제어부(3)가 미리 진단 PWM 제어신호에 의해 단락진단을 수행하여 미리 인버터의 출력을 차단함으로써 인버터를 보호하고 작업자를 보호할 수 있다. 단락이 발생하지 않은 경우에 진단 PWM 제어신호가 출력되지만, 전동기(2)의 임피던스로 인해 짧은 진단 PWM 구간에서 큰 전류가 흐르지는 않기 때문에 오진단의 가능성이 적다.
이상에서 본 발명에 따른 실시예들이 설명되었으나, 이는 예시적인 것에 불과하며, 당해 분야에서 통상적 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 범위의 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 다음의 청구범위에 의해서 정해져야 할 것이다.

Claims (14)

  1. 인버터를 제어하는 제어장치에 있어서,
    복수의 스위칭소자로 구성되어, 직류전압을 제어부의 제어에 의해 교류전압으로 변환하여 출력하는 인버터부;
    상기 인버터부에 흐르는 단락전류를 검출하는 단락검출부; 및
    상기 인버터의 출력의 단락을 진단하기 위한 유효벡터를 상기 인버터부가 출력하도록 하는 펄스폭변조(PWM) 제어신호를 상기 인버터부에 인가하는 상기 제어부를 포함하고,
    상기 제어부는
    상기 단락 검출부의 회로적인 지연을 고려하여 상기 유효 벡터의 출력시간을 상기 단락 검출부가 상기 단락 전류를 검출할 수 있는 설계 시간 이상으로 설정하는 제어장치.
  2. 제1항에 있어서, 상기 인버터부는, 3상의 교류전압을 출력하는 3상의 레그로 구성되고,
    상기 단락검출부는, 상기 3상의 레그의 하부레그로 흐르는 단락전류를 검출하는 제어장치.
  3. 제1항에 있어서, 상기 PWM 제어신호는,
    U-V상의 단락에 대하여 상기 인버터부가 유효벡터 [1 0 0], [0 1 0], [0 1 1] 및 [1 0 1] 중 어느 하나를 출력하게 하는 신호를 포함하는 제어장치.
  4. 제1항에 있어서, 상기 PWM 제어신호는,
    V-W상의 단락에 대하여 상기 인버터부가 유효벡터 [1 1 0], [0 1 0], [0 0 1] 및 [1 0 1] 중 어느 하나 이상을 출력하게 하는 신호를 포함하는 제어장치.
  5. 제1항에 있어서, 상기 PWM 제어신호는,
    W-U상의 단락에 대하여 상기 인버터부가 유효벡터 [1 0 0], [1 1 0], [0 1 1] 및 [0 0 1] 중 어느 하나 이상을 출력하게 하는 신호를 포함하는 제어장치.
  6. 삭제
  7. 삭제
  8. 복수의 스위칭소자로 구성되어 직류전압을 교류전압으로 변환하여 출력하는 인버터부를 포함하는, 인버터를 제어하는 방법에 있어서,
    상기 인버터의 운전지령을 수신하는 단계;
    상기 인버터의 출력의 단락을 진단하기 위한 유효벡터를 상기 인버터부가 출력하도록 하는 제1PWM 제어신호를 상기 인버터부로 출력하는 단계; 및
    단락 검출부가 상기 인버터부의 단락전류를 검출하는 경우, 상기 인버터의 출력을 차단하는 단계를 포함하고,
    상기 제1PWM 제어신호를 상기 인버터부로 출력하는 단계 이전에,
    상기 단락 검출부의 회로적인 지연을 고려하여 상기 유효벡터의 출력시간을 상기 단락 검출부가 상기 단락전류를 검출할 수 있는 설계 시간 이상으로 설정하는 단계를 더 포함하는 제어방법.
  9. 제8항에 있어서, 상기 제1PWM 제어신호는,
    U-V상의 단락에 대하여 상기 인버터부가 유효벡터 [1 0 0], [0 1 0], [0 1 1] 및 [1 0 1] 중 어느 하나를 출력하게 하는 신호를 포함하는 제어방법.
  10. 제8항에 있어서, 상기 제1PWM 제어신호는,
    V-W상의 단락에 대하여 상기 인버터부가 유효벡터 [1 1 0], [0 1 0], [0 0 1] 및 [1 0 1] 중 어느 하나 이상을 출력하게 하는 신호를 포함하는 제어방법.
  11. 제8항에 있어서, 상기 제1PWM 제어신호는,
    W-U상의 단락에 대하여 상기 인버터부가 유효벡터 [1 0 0], [1 1 0], [0 1 1] 및 [0 0 1] 중 어느 하나 이상을 출력하게 하는 신호를 포함하는 제어방법.
  12. 삭제
  13. 삭제
  14. 제8항에 있어서,
    상기 인버터부의 단락전류가 검출되지 않은 경우, 상기 인버터의 정상운전을 위한 제2PWM 제어신호를 출력하는 단계를 더 포함하는 제어방법.
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