KR102271488B1 - 전압 공급부와 이를 포함한 표시장치 - Google Patents

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Abstract

본 발명의 실시예는 전압 공급부가 정상적으로 게이트 구동부와 데이터 구동부에 구동전압들을 공급함에도, 방전신호가 게이트 구동부를 방전 모드로 제어하는 경우, 전압 공급부의 전류를 제어함으로써 표시장치의 비정상적인 화상 표시를 방지할 수 있는 전압 공급부와 그를 포함한 표시장치에 관한 것이다. 본 발명의 실시예에 따른 전압 공급부는 직류전압인 제1 전압이 입력되는 제1 전압 입력단자; 교류전압인 제2 전압이 입력되는 제2 전압 입력단자; 제1 노드와 상기 제2 전압 입력단자 사이에 마련된 제1 커패시터; 및 상기 제1 전압 입력단자와 상기 제1 노드 사이에 마련되어 상기 제1 전압 입력단자로부터 상기 제1 노드로 흐르는 전류값을 전류 제한값 이하로 제어하는 전류제어회로를 포함한다.

Description

전압 공급부와 이를 포함한 표시장치{VOLTAGE SUPPLY UNIT AND DISPLAY DEVICE INCLUDING THE SAME}
본 발명의 실시예는 전압 공급부와 이를 포함한 표시장치에 관한 것이다.
최근, 음극선관(Cathode Ray Tube)의 단점인 무게와 부피를 줄일 수 있는 다양한 평판표시장치들(flat display devices)이 개발되고 있다. 이러한 평판표시장치들로는 액정표시장치(Liquid Crystal Display), 전계방출 표시장치(Field Emission Display), 유기발광표시장치(Organic Light Emitting Display) 등이 있다.
평판표시장치는 데이터라인들, 게이트라인들, 및 데이터라인들과 게이트라인들에 접속된 다수의 화소들을 구비하는 표시패널, 게이트라인들에 게이트신호들을 공급하는 게이트 구동부, 데이터라인들에 데이터전압들을 공급하는 데이터 구동부, 및 게이트 구동부와 데이터 구동부에 구동전압들을 공급하는 전압 공급부를 포함한다. 화소들 각각은 게이트라인으로부터 게이트하이전압의 게이트신호가 공급될때 데이터라인으로부터 데이터전압을 공급받으며, 상기 데이터전압에 따라 소정의 밝기로 발광한다.
평판표시장치가 파워 오프(power off)되는 경우, 전압 공급부에 입력되는 전압이 차단되므로, 전압 공급부는 게이트 구동부와 데이터 구동부에 더이상 구동전압들을 공급하지 않는다. 평판표시장치의 파워 오프시에 화소들에 공급된 데이터전압들이 방전되지 않는 경우 화소들에 데이터전압들이 잔류될 수 있다. 이 경우, 평판표시장치가 파워 오프되었음에도, 표시패널은 화소들에 잔류된 데이터전압들에 의해 소정의 기간 동안 잔상 또는 비정상적인 화상을 표시하게 된다. 이를 방지하기 위해, 평판표시장치는 파워 오프시에 방전신호를 이용하여 게이트 구동부를 방전 모드로 제어한다. 게이트 구동부는 방전 모드에서 소정의 기간 동안 게이트라인들 모두에 게이트하이전압의 게이트신호들을 공급하도록 제어된다. 이 경우, 화소들에 잔류된 데이터전압들은 데이터라인들로 방전되므로, 표시패널은 잔상 또는 비정상적인 화상을 표시하지 않게 된다.
한편, 평판표시장치가 슬립 모드(sleep mode)로 구동되거나 펌웨어 업데이트(firmware update) 후 리프레쉬(refresh)되는 경우 또는 원인 모를 오류에 의해, 전압 공급부가 정상적으로 게이트 구동부와 데이터 구동부에 구동전압들을 공급함에도, 방전신호가 게이트 구동부를 방전 모드로 제어하는 문제가 발생할 수 있다. 이 경우, 게이트 구동부는 평판표시장치가 파워 오프되지 않았음에도 게이트라인들 모두에 게이트하이전압의 게이트신호들을 공급하는 비정상적인 구동을 하게 된다. 게이트 구동부는 비정상적인 구동시 정상적으로 구동할때보다 매우 높은 전류를 필요로 하며, 이로 인해 전압 공급부는 게이트 구동부가 정상적으로 구동할때보다 매우 높은 전류를 게이트 구동부에 공급하게 된다. 이때, 게이트 구동부의 비정상적인 구동이 소정의 기간 이상 지속되는 경우, 방전신호가 게이트 구동부를 더이상 방전 모드로 제어하지 않더라도, 전압 공급부로부터 게이트 구동부로 공급되는 전류는 원래대로 복구되지 않는 문제가 발생할 수 있다. 이 경우, 평판표시장치 계속하여 비정상적인 화상을 표시하게 된다.
또한, 전압 공급부는 게이트 구동부가 정상적으로 구동할때 공급하는 전류보다 매우 높은 전류를 게이트 구동부에 공급하기 때문에, 전압 공급부의 저항이 타버리는(burnt) 등의 부품이 손상되는 문제가 발생할 수도 있다.
본 발명의 실시예는 전압 공급부가 정상적으로 게이트 구동부와 데이터 구동부에 구동전압들을 공급함에도, 방전신호가 게이트 구동부를 방전 모드로 제어하는 경우, 전압 공급부의 전류를 제어함으로써 표시장치의 비정상적인 화상 표시를 방지할 수 있는 전압 공급부와 그를 포함한 표시장치를 제공한다.
본 발명의 실시예에 따른 전압 공급부는 직류전압인 제1 전압이 입력되는 제1 전압 입력단자; 교류전압인 제2 전압이 입력되는 제2 전압 입력단자; 제1 노드와 상기 제2 전압 입력단자 사이에 마련된 제1 커패시터; 및 상기 제1 전압 입력단자와 상기 제1 노드 사이에 마련되어 상기 제1 전압 입력단자로부터 상기 제1 노드로 흐르는 전류값을 전류 제한값 이하로 제어하는 전류제어회로를 포함한다.
상기 전류제어회로는, 입력단자가 상기 제1 전압 입력단자에 접속되고, 출력단자와 ADJ 단자가 상기 제1 노드에 접속되는 레귤레이터; 및 상기 레귤레이터의 상기 출력단자와 상기 제1 노드 사이에 마련된 제1 저항을 포함한다.
상기 전류 제한값을 CLV, 상기 제1 저항의 저항값을 RV1, 상기 레귤레이터의 상기 ADJ 단자의 출력전압을 Vadj라 할 때, 상기 전류 제한값은,
Figure 112014117014991-pat00001
을 만족한다.
상기 제1 노드와 상기 전류제어회로 사이에 마련된 제1 다이오드; 및 상기 제1 노드와 출력단자 사이에 마련된 제2 다이오드를 더 포함한다.
본 발명의 실시예에 따른 표시장치는 데이터라인들, 게이트라인들, 및 상기 데이터라인들과 게이트라인들에 접속되는 화소들을 포함하는 표시패널; 상기 게이트라인들에 게이트신호들을 공급하는 게이트 구동부; 상기 데이터라인들에 데이터전압들을 공급하는 데이터 구동부; 상기 게이트 구동부를 정상 모드 또는 방전 모드로 제어하기 위한 방전신호를 공급하는 방전제어회로; 및 상기 게이트 구동부에 게이트하이전압을 공급하는 게이트하이전압 공급부를 구비하고, 상기 게이트하이전압 공급부는, 직류전압인 제1 전압이 입력되는 제1 전압 입력단자; 교류전압인 제2 전압이 입력되는 제2 전압 입력단자; 제1 노드와 상기 제2 전압 입력단자 사이에 마련된 제1 커패시터; 및 상기 제1 전압 입력단자와 상기 제1 노드 사이에 마련되어 상기 제1 전압 입력단자로부터 상기 제1 노드로 흐르는 전류값을 전류 제한값 이하로 제어하는 전류제어회로를 포함한다.
상기 전류제어회로는, 입력단자가 상기 제1 전압 입력단자에 접속되고, 출력단자와 ADJ 단자가 상기 제1 노드에 접속되는 레귤레이터; 및 상기 레귤레이터의 상기 출력단자와 상기 제1 노드 사이에 마련된 제1 저항을 포함한다.
상기 전류 제한값을 CLV, 상기 제1 저항의 저항값을 RV1, 상기 레귤레이터의 상기 ADJ 단자의 출력전압을 Vadj라 할 때, 상기 전류 제한값은,
Figure 112014117014991-pat00002
을 만족한다.
상기 게이트하이전압 공급부는, 상기 제1 노드와 상기 전류제어회로 사이에 마련된 제1 다이오드; 및 상기 제1 노드와 출력단자 사이에 마련된 제2 다이오드를 더 포함한다.
상기 게이트 구동부에 제1 로직 레벨 전압 또는 제2 로직 레벨 전압을 갖는 방전신호를 공급하는 방전제어회로; 및 상기 게이트 구동부의 동작 타이밍을 제어하기 위한 게이트 제어신호를 상기 게이트 구동부에 공급하는 타이밍 제어부를 더 구비하고, 상기 게이트 구동부는 제1 로직 레벨 전압의 방전신호가 입력되는 경우 상기 게이트 제어신호에 따라 상기 게이트하이전압의 펄스들을 갖는 게이트신호들을 생성하여 상기 게이트라인들에 출력하고, 제2 로직 레벨 전압의 방전신호가 입력되는 경우 상기 게이트라인들에 상기 게이트하이전압의 게이트신호들을 출력한다.
상기 게이트 구동부의 동작 타이밍을 제어하기 위한 게이트 제어신호를 상기 게이트 구동부에 공급하는 타이밍 제어부를 더 구비하고, 상기 방전제어회로는 상기 정상 모드에서 제1 로직 레벨 전압의 방전신호를 상기 게이트 구동부에 공급하고, 상기 방전 모드에서 제2 로직 레벨 전압의 방전신호를 상기 게이트 구동부에 공급하며, 상기 게이트 구동부는 상기 제1 로직 레벨 전압의 방전신호가 입력되는 경우 상기 게이트 제어신호에 따라 상기 게이트하이전압의 펄스들을 갖는 게이트신호들을 생성하여 상기 게이트라인들에 출력하고, 상기 제2 로직 레벨 전압의 방전신호가 입력되는 경우 상기 게이트라인들에 상기 게이트하이전압의 게이트신호들을 출력한다.
상기 방전신호가 상기 제1 로직 레벨 전압에서 상기 제2 로직 레벨 전압으로 반전되는 경우 상기 제1 노드의 전류값은 소정의 폭만큼 상승하고, 이후에 상기 방전신호가 상기 제2 로직 레벨 전압에서 상기 제1 로직 레벨 전압으로 반전되는 경우 상기 제1 노드의 전류값은 상기 소정의 폭만큼 하강한다.
본 발명의 실시예는 전류제어회로를 이용하여 제1 전압 입력단자로부터 제1 노드로 흐르는 전류값을 전류 제한값 이하로 제어할 수 있다. 이로 인해, 본 발명의 실시예는 게이트하이전압 공급부로부터 게이트 구동부로 공급되는 전류값을 소정의 값 이하로 제어할 수 있다. 그 결과, 본 발명의 실시예는 방전신호가 정상적으로 복구되는 경우, 게이트하이전압 공급부로부터 게이트 구동부에 공급되는 전류를 원래대로 복구할 수 있으므로, 표시장치가 정상적인 화상을 표시하도록 할 수 있다.
또한, 본 발명의 실시예는 게이트하이전압 공급부로부터 게이트 구동부로 공급되는 전류값을 소정의 값 이하로 제어할 수 있으므로, 게이트하이전압 공급부의 저항이 타버리는 등의 부품이 손상되는 것을 방지할 수 있다.
도 1은 본 발명의 실시예에 따른 표시장치를 개략적으로 보여주는 블록도.
도 2는 도 1의 화소를 상세히 보여주는 회로도.
도 3a 및 도 3b는 방전신호와 게이트신호들을 보여주는 파형도.
도 4는 도 1의 전압 공급부을 상세히 보여주는 블록도.
도 5는 도 4의 게이트하이전압 공급부를 상세히 보여주는 회로도.
도 6a 내지 도 6d는 제1 노드의 전압, 제2 전압, 제2 노드의 전압, 및 제3 노드의 전압을 보여주는 파형도들.
도 7a 및 도 7b는 본 발명의 실시예에 따른 게이트하이전압 공급부의 제2 노드의 전류값을 보여주는 실험 예시 도면들.
도 8a 및 도 8b는 전류제어회로의 유무에 따른 제1 노드의 전류를 보여주는 실험 예시 도면들.
이하 첨부된 도면을 참조하여 본 발명에 따른 바람직한 실시예들을 상세히 설명한다. 명세서 전체에 걸쳐서 동일한 참조번호들은 실질적으로 동일한 구성요소들을 의미한다. 이하의 설명에서, 본 발명과 관련된 공지 기능 혹은 구성에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우, 그 상세한 설명을 생략한다. 또한, 이하의 설명에서 사용되는 구성요소 명칭은 명세서 작성의 용이함을 고려하여 선택된 것일 수 있는 것으로서, 실제 제품의 부품 명칭과는 상이할 수 있다.
도 1은 본 발명의 실시예에 따른 표시장치를 개략적으로 보여주는 블록도이다. 도 1을 참조하면, 본 발명의 실시예에 따른 표시장치는 표시패널(10), 게이트 구동부(20), 데이터 구동부(30), 타이밍 제어부(40), 전압 공급부(50), 및 방전제어회로(60)를 구비한다.
본 발명의 실시예에 따른 표시장치는 게이트신호들을 게이트라인들(G1~Gn)에 순차적으로 공급하는 라인 순차 스캐닝으로 데이터라인들(D1~Dm)을 통해 화소(P)들에 데이터전압들을 공급하는 어떠한 표시장치도 포함될 수 있다. 예를 들어, 본 발명의 실시예에 따른 표시장치는 액정표시장치(Liquid Crystal Display), 유기발광 표시장치(Organic Light Emitting Display), 전계 방출 표시장치(Field Emission Display), 전기영동 표시장치(Electrophoresis display) 중에 어느 하나로 구현될 수도 있다. 본 발명은 아래의 실시예에서 표시장치가 액정표시장치로 구현된 것을 중심으로 설명하였으나, 이에 한정되지 않음에 주의하여야 한다.
표시패널(10)은 상부기판, 하부기판, 및 그들 사이에 개재된 액정층을 포함한다. 표시패널(10)의 하부기판에는 데이터라인들(D1~Dm, m은 2 이상의 양의 정수)과 게이트라인들(G1~Gn, n은 2 이상의 양의 정수)의 교차 구조에 의해 형성된 영역에 매트릭스 형태로 배열되는 화소(P)들을 포함하는 화소 어레이(PA)가 마련된다.
화소(P)들 각각은 도 2와 같이 트랜지스터(T), 화소전극(11), 공통전극(12), 액정셀(13), 및 스토리지 커패시터(Cst)를 포함할 수 있다. 트랜지스터(T)는 제k(k는 1≤k≤n을 만족하는 양의 정수) 게이트라인(Gk)의 게이트신호에 의해 턴-온되어 제j(j는 1≤j≤m을 만족하는 양의 정수) 데이터라인(Dj)의 데이터전압을 화소전극(11)에 공급한다. 공통전극(12)은 공통전압라인(VcomL)으로부터 공통전압을 공급받는다. 이로 인해, 화소(P)들 각각은 화소전극(11)에 공급된 데이터전압과 공통전극(12)에 공급된 공통전압의 전위차에 의해 발생되는 전계에 의해 액정셀(13)의 액정을 구동하여 백라이트 유닛으로부터 입사되는 빛의 투과량을 조정할 수 있다. 그 결과, 화소(P)들은 화상을 표시할 수 있다. 또한, 스토리지 커패시터(Cst)는 화소전극(11)과 공통전극(12) 사이에 마련되어 화소전극(11)과 공통전극(12) 간의 전압차를 일정하게 유지한다.
표시패널(10)의 상부기판상에는 블랙 매트릭스(black matrix)와 컬러필터들(color filters)이 형성될 수 있다. 다만, 액정표시장치가 COT(color filters on tft array) 방식으로 형성되는 경우, 블랙 매트릭스와 컬러필터들은 하부기판상에 형성될 수도 있다.
공통 전극은 TN(Twisted Nematic) 모드와 VA(Vertical Alignment) 모드와 같은 수직전계 구동방식의 경우에 상부기판상에 형성되며, IPS(In-Plane Switching) 모드와 FFS(Fringe Field Switching) 모드와 같은 수평전계 구동방식의 경우에 화소전극과 함께 하부기판상에 형성될 수 있다. 본 발명의 액정표시장치는 TN 모드, VA 모드, IPS 모드, FFS 모드뿐 아니라 어떠한 액정모드로도 구현될 수 있다. 표시패널(10)의 상부기판과 하부기판 각각에는 편광판이 부착되고 액정의 프리틸트각(pre-tilt angle)을 설정하기 위한 배향막이 형성된다.
표시패널(10)의 아래에는 표시패널(10)에 빛을 균일하게 조사하기 위한 백라이트 유닛(미도시)이 배치될 수 있다. 백라이트 유닛(미도시)은 직하형(direct type) 또는 에지형(edge type)으로 구현될 수 있다.
게이트 구동부(20)는 게이트라인들(G1~Gn)에 접속되어 게이트신호들을 게이트라인들(G1~Gn)에 출력한다. 게이트신호들은 게이트하이전압(VGH)과 게이트로우전압(VGL) 사이에서 스윙할 수 있다. 게이트하이전압(VGH)은 화소(P)들의 트랜지스터들을 턴-온시킬 수 있는 전압이고, 게이트로우전압(VGL)은 화소(P)들의 트랜지스터들을 턴-오프시킬 수 있는 전압이다. 예를 들어, 게이트하이전압(VGH)은 25V 이상의 전압일 수 있으며, 게이트로우전압(VGL)은 -5V 이하의 전압일 수 있다.
게이트 구동부(20)는 타이밍 제어부(40)로부터 게이트 제어신호(GCS)를 입력받는다. 또한, 게이트 구동부(20)는 전압 공급부(50)로부터 게이트하이전압(VGH)과 게이트로우전압(VGL)을 입력받으며, 방전제어회로(60)로부터 방전신호(ALL_H)를 입력받는다. 방전신호(ALL_H)는 도 3a 및 도 3b와 같이 제1 로직 레벨 전압(V1)과 제2 로직 레벨 전압(V2) 사이에서 스윙할 수 있다. 제1 로직 레벨 전압(V1)은 대략 3.3V의 전압이고, 제2 로직 레벨 전압(V2)은 대략 0V 전압일 수 있다.
게이트 구동부(20)는 제1 로직 레벨 전압의 방전신호(ALL_H)가 입력되는 경우, 정상 모드로 구동된다. 게이트 구동부(20)는 정상 모드에서 게이트 제어신호(GCS)에 따라 게이트하이전압(VGH)의 펄스를 갖는 게이트신호들을 생성하여 미리 정해진 순서대로 게이트라인들(G1~Gn)에 출력한다. 미리 정해진 순서는 순차적인 순서일 수 있다.
게이트 구동부(20)는 제2 로직 레벨 전압의 방전신호(ALL_H)가 입력되는 경우, 방전 모드로 구동된다. 게이트 구동부(20)는 방전 모드에서 게이트하이전압(VGH)의 게이트신호들을 생성하여 게이트라인들(G1~Gn)에 출력한다.
게이트 구동부(20)가 제2 로직 레벨 전압의 방전신호(ALL_H)가 입력되는 기간 동안 게이트하이전압(VGH)의 게이트신호들을 게이트라인들(G1~Gn)에 출력하는 경우, 화소(P)들 각각의 트랜지스터(T)는 턴-온된 상태를 유지한다. 이때, 표시장치가 파워 오프된 경우라면, 데이터 구동부(30)가 데이터전압들을 데이터라인들(D1~Dm)에 공급하지 않으므로, 화소전극(11)의 전압은 데이터라인으로 방전된다. 그 결과, 화소(P)들에 데이터전압들이 잔류하지 않기 때문에, 표시장치는 파워 오프시에 잔상 또는 비정상적인 화상을 표시하지 않게 된다.
정상 모드와 방전 모드에서 게이트 구동부(20)로부터 출력되는 게이트신호들에 대한 자세한 설명은 도 3a 및 도 3b를 결부하여 후술한다.
데이터 구동부(30)는 데이터라인들(D1~Dm)에 접속되어 데이터전압들을 데이터라인들(D1~Dm)에 출력한다. 데이터 구동부(30)는 타이밍 제어부(40)로부터 디지털 비디오 데이터(DATA)와 데이터 제어신호(DCS)를 입력받고, 데이터 제어신호(DCS)에 따라 디지털 비디오 데이터(DATA)를 아날로그 데이터전압들로 변환한다. 데이터 구동부(30)는 아날로그 데이터전압들을 데이터라인들(D1~Dm)에 공급한다.
타이밍 제어부(40)는 표시장치가 파워 온(power on)되는 경우, 외부로부터 소정의 구동전압들을 입력받아 턴-온되며, 전압 공급부(50)에 전원관리신호(DPM)를 공급한다. 전원관리신호(DPM)는 전압 공급부(50)의 온/오프를 제어하기 위한 신호이며, 제3 로직 레벨 전압과 제4 로직 레벨 전압 사이에서 스윙할 수 있다. 제3 로직 레벨 전압은 제1 로직 레벨 전압과 실질적으로 동일한 전압일 수 있고, 제4 로직 레벨 전압은 제2 로직 레벨 전압과 실질적으로 동일한 전압일 수 있으나, 이에 한정되지 않음에 주의하여야 한다.
또한, 타이밍 제어부(40)는 외부의 시스템 보드(미도시)로부터 디지털 비디오 데이터(DATA)와 타이밍 신호를 입력받는다. 타이밍 신호는 수직동기신호(vertical sync signal), 수평동기신호(horizontal sync signal), 데이터 인에이블 신호(data enable signal), 및 도트 클럭(dot clock)을 포함할 수 있다. 타이밍 제어부(40)는 타이밍 신호에 기초하여 게이트 구동부(20)의 동작 타이밍을 제어하기 위한 게이트 제어신호(GCS)와 데이터 구동부(30)의 동작 타이밍을 제어하기 위한 데이터 제어신호(DCS)를 발생한다.
전압 공급부(50)는 타이밍 제어부(40)로부터 전원관리신호(DPM)를 입력받고, 외부의 전원부로부터 12V의 구동전압(VIN)을 입력받을 수 있다.
전압 공급부(50)는 제3 로직 레벨 전압의 전원관리신호(DPM)가 입력되는 경우 턴-온되어 구동전압(VDD), 게이트하이전압(VGH), 게이트로우전압(VGL), 방전제어회로 구동전압들(VD1, VD2)을 생성할 수 있다. 이 경우, 전압 공급부(50)는 구동전압(VDD)을 데이터 구동부(30)에 공급하고, 게이트하이전압(VGH)과 게이트로우전압(VGL)을 게이트 구동부(20)에 공급하며, 방전제어회로 구동전압들(VD1, VD2)을 방전제어회로(60)에 공급할 수 있다. 전압 공급부(50)는 제4 로직 레벨 전압의 전원관리신호(DPM)가 입력되는 경우 턴-오프될 수 있다. 전압 공급부(50)에 대한 자세한 설명은 도 4를 결부하여 후술한다.
방전제어회로(60)는 전압 공급부(50)로부터 방전제어회로 구동전압들(VD1, VD2)을 입력받는다. 방전제어회로 구동전압들(VD1, VD2)은 방전제어회로(60)를 구동하기 위한 구동전압과 방전제어회로(60)를 인에이블하기 위한 인에이블 전압일 수 있다. 방전제어회로(60)는 방전제어회로 구동전압들(VD1, VD2)이 입력되는 경우, 방전신호(ALL_H)를 게이트 구동부(20)에 출력한다. 방전제어회로(60)는 집적회로(integrated circuit, 이하 "IC"라 칭함)로 구현될 수 있다.
방전제어회로(60)는 표시장치가 파워 온되는 경우 제1 로직 레벨 전압의 방전신호(ALL_H)를 게이트 구동부(20)로 출력한다. 또한, 방전제어회로(60)는 표시장치가 파워 오프(power off)되는 경우 수십 ms 내지 수 초 동안 제2 로직 레벨 전압의 방전신호(ALL_H)를 게이트 구동부(20)로 출력한다.
한편, 방전신호(ALL_H)는 표시장치가 파워 온되는 경우 제1 로직 레벨 전압으로 출력되고 표시장치가 파워 오프되는 경우 제2 로직 레벨 전압으로 출력되는 것이 일반적이나, 표시장치가 파워 오프되지 않았더라도, 표시장치가 슬립 모드로 구동되거나 펌웨어 업데이트 후 리프레쉬되는 경우 또는 원인 모를 오류에 의해 제2 로직 레벨 전압으로 출력될 수 있다.
도 3a 및 도 3b는 정상 모드와 방전 모드에서 방전신호와 게이트신호들을 보여주는 파형도이다. 도 3a에는 정상 모드에서 방전신호(ALL_H)와 게이트신호들(GS1~GSn)이 나타나 있고, 도 3b에는 방전 모드에서 방전신호(ALL_H)와 게이트신호들(GS1~GSn)이 나타나 있다. 도 3a 및 도 3b에서는 설명의 편의를 위해 제1 내지 제3 게이트신호들(GS1~GS3)과 제n-1 및 제n 게이트신호들(GSn-1, GSn)만을 도시하였다.
도 3a를 참조하면, 게이트 구동부(20)는 제1 로직 레벨 전압(V1)의 방전신호(ALL_H)가 입력되는 경우, 게이트 제어신호(GCS)에 따라 게이트라인들(G1~Gn)에 미리 정해진 순서대로 게이트하이전압(VGH)의 펄스를 갖는 게이트신호들(GS1~GSn)을 출력한다. 미리 정해진 순서는 도 3a와 같이 순차적인 순서일 수 있다.
게이트신호들(GS1~GSn) 각각의 펄스폭은 대략 1 수평기간(horizontal period)일 수 있다. 1 수평기간은 1 수평라인의 화소(P)들에 데이터전압들이 공급되는 기간을 지시하고, 1 수평라인의 화소(P)들은 동일한 게이트라인에 접속될 수 있다.
도 3b를 참조하면, 게이트 구동부(20)는 제2 로직 레벨 전압(V2)의 방전신호(ALL_H)가 입력되는 경우, 게이트 제어신호(GCS)에 상관없이 게이트라인들(G1~Gn)에 게이트하이전압(VGH)의 게이트신호들(GS1~GSn)을 미리 정해진 순서대로 출력한다. 미리 정해진 순서는 도 3b와 같이 순차적인 순서일 수 있다.
특히, 게이트 구동부(20)는 제2 로직 레벨 전압(V2)의 방전신호(ALL_H)가 입력되는 기간 동안 게이트신호들(GS1~GSn)을 게이트하이전압(VGH)으로 유지할 수 있다. 이로 인해, 표시패널(10)의 화소(P)들 각각의 트랜지스터(T)는 턴-온될 수 있으므로, 화소(P)들 각각의 화소전극의 전압은 데이터라인으로 방전될 수 있다. 또한, 게이트 구동부(20)는 방전신호(ALL_H)가 제2 로직 레벨 전압(V2)에서 제1 로직 레벨 전압(V1)으로 반전되는 경우, 게이트로우전압(VGL)의 게이트신호들(GS1~GSn)을 출력할 수 있다.
이상에서 살펴본 바와 같이, 본 발명의 실시예는 제2 로직 레벨 전압(V2)의 방전신호(ALL_H)가 입력되는 경우 게이트 제어신호(GCS)에 상관없이 게이트라인들(G1~Gn)에 게이트하이전압(VGH)의 게이트신호들(GS1~GSn)을 출력한다. 그 결과, 본 발명의 실시예는 파워 오프시에 화소(P)들 각각의 화소전극의 전압들을 데이터라인들로 방전시킬 수 있다. 따라서, 본 발명의 실시예는 화소(P)들에 데이터전압들이 잔류하지 않기 때문에, 표시장치는 파워 오프시에 잔상 또는 비정상적인 화상을 표시하지 않게 된다.
도 4는 도 1의 전압 공급부를 상세히 보여주는 블록도이다. 도 4를 참조하면, 전압 공급부(50)는 전압제어회로(51), 구동전압 공급부(52), 게이트하이전압 공급부(53), 및 게이트로우전압 공급부(54)를 포함한다.
전압제어회로(51)는 구동전압 공급부(52), 게이트하이전압 공급부(53), 및 게이트로우전압 공급부(54)에 접속되어 여러 레벨의 전압들을 공급한다. 전압제어회로(51)는 IC로 구현될 수 있다.
전압제어회로(51)는 타이밍 제어부(40)로부터 전원관리신호(DPM)를 입력받는다. 예를 들어, 전압제어회로(51)는 제3 로직 레벨 전압의 전원관리신호(DPM)가 입력되는 경우 턴-온되고, 제4 로직 레벨 전압의 전원관리신호(DPM)가 입력되는 경우 턴-오프될 수 있다. 이 경우, 전압제어회로(51)는 제3 로직 레벨 전압의 전원관리신호(DPM)가 입력되는 경우 턴-온되어 구동전압 공급부(52), 게이트하이전압 공급부(53), 및 게이트로우전압 공급부(54)에 여러 레벨의 전압들을 공급할 수 있다.
구동전압 공급부(52)는 전압제어회로(51)로부터 입력받은 전압들을 이용하여 구동전압(VDD)을 생성한다. 구동전압(VDD)은 데이터 구동부(30)를 구동하기 위한 전압일 수 있다. 구동전압 공급부(52)는 구동전압(VDD)을 데이터 구동부(30)에 공급한다.
게이트하이전압 공급부(53)는 전압제어회로(51)로부터 입력받은 전압들을 이용하여 게이트하이전압(VGH)을 생성한다. 또는, 게이트하이전압 공급부(53)는 전압제어회로(51)로부터 입력받은 전압과 구동전압 공급부(52)로부터 입력받은 구동전압(VDD)을 이용하여 게이트하이전압(VGH)을 생성할 수 있다. 게이트하이전압 공급부(53)는 게이트하이전압(VGH)을 게이트 구동부(20)로 출력한다. 게이트하이전압 공급부(53)에 대한 자세한 설명은 도 5를 결부하여 후술한다.
게이트로우전압 공급부(54)는 전압제어회로(51)로부터 입력받은 전압들을 이용하여 게이트로우전압(VGL)을 생성한다. 게이트로우전압 공급부(54)는 게이트로우전압(VGL)을 게이트 구동부(20)로 출력한다.
도 5는 도 4의 게이트하이전압 공급부를 상세히 보여주는 회로도이다. 도 5를 참조하면, 게이트하이전압 공급부(53)는 제1 전압 입력단자(IT1), 제2 전압 입력단자(IT2), 출력단자(OT), 전류제어회로(CC), 제1 및 제2 다이오드들(D1, D2) 등을 포함한다.
제1 전압 입력단자(IT1)에는 직류전압인 제1 전압이 입력된다. 제1 전압은 전압제어회로(51)로부터 입력되는 전압이거나 구동전압 공급부(52)로부터 입력되는 구동전압(VDD)일 수 있다.
전류제어회로(current control circuit, CC)는 제1 전압 입력단자(IT1)과 제1 노드(N1) 사이에 마련될 수 있다. 도 5와 같이 제1 노드(N1)와 제2 노드(N2) 사이에 제1 다이오드(D1)가 마련되는 경우, 전류제어회로(CC)는 제1 전압 입력단자(IT1)와 제2 노드(N2) 사이에 마련되는 것이 바람직하다. 전류제어회로(CC)는 레귤레이터(regulator, REG)와 제1 저항(R1)을 포함한다. 레귤레이터(REG)는 IC로 구현될 수 있다. 레귤레이터(REG)의 입력단자(IN)는 제1 전압 입력단자(IT)에 접속되고, 출력단자(OUT)와 ADJ 단자(ADJ)는 제2 노드(N2)에 접속된다. 제1 저항(R1)은 레귤레이터(REG)의 출력단자(OUT)와 제2 노드(N2) 사이에 마련된다.
이 경우, 전류제어회로(CC)는 제1 전압 입력단자(IT1)로부터 제1 노드(N1)로 흐르는 전류값을 수학식 1과 같이 전류 제한값(current limit value, CLV) 이하로 제어할 수 있다.
Figure 112014117014991-pat00003
수학식 1에서, "CLV"는 전류 제한값, "RV1"은 제1 저항(R1)의 저항값, "Vadj"는 레귤레이터(REG)의 ADJ 단자(ADJ)의 출력전압값을 의미한다. 예를 들어, 레귤레이터(REG)의 ADJ 단자(ADJ)의 출력전압값(Vadj)이 "1.25V"이고, 제1 저항(R1)의 저항값(RV1)이 "24.9Ω"인 경우, 전류 제한값(CLV)은 대략 50mA로 산출될 수 있다. 이 경우, 전류제어회로(CC)는 제1 전압 입력단자(IT1)로부터 제1 노드(N1)로 흐르는 전류값을 "50mA" 이하로 제어할 수 있다.
제1 다이오드(D1)는 제1 노드(N1)와 전류제어회로(CC) 사이에 마련될 수 있다. 제1 다이오드(D1)는 전류제어회로(CC)로부터 출력된 제2 노드(N2)의 전압을 직류전압으로 제1 노드(N1)로 공급한다. 예를 들어, 제2 노드(N2)의 전압(VN2)은 도 6a와 같이 14V의 직류전압일 수 있다.
제2 전압 입력단자(IT2)에는 교류전압인 제2 전압이 입력된다. 제2 전압은 전압제어회로(51)로부터 입력되는 전압일 수 있다. 예를 들어, 제2 전압(VIT2)은 도 6b와 같이 0V와 13V 사이를 스윙하는 교류전압일 수 있다. 제2 전압 입력단자(IT2)와 제1 노드(N1) 사이에는 제1 커패시터(C1)와 제2 저항(R2)이 마련될 수 있다. 제2 저항(R2)은 제2 전원 입력단자(VIT2)를 보호하기 위한 댐핑(damping) 저항으로서 기능할 수 있다.
한편, 제2 전압 입력단자(IT)로 입력되는 교류전압인 제2 전압은 제1 커패시터(C1)에 의해 제1 다이오드(D1)를 통해 제1 노드(N1)에 공급된 직류전압에 차지 펌프(charge pump)될 수 있다. 예를 들어, 제2 노드(N2)의 전압(VN2)이 도 6a와 같이 14V의 직류전압이고, 제2 전압(VIT2)이 도 6b와 같이 0V와 13V 사이를 스윙하는 교류전압인 경우, 제1 커패시터(C1)에 의해 차지 펌프된 제1 노드(N1)의 전압(VN1)은 도 6c와 같이 14V와 27V 사이를 스윙하는 교류전압일 수 있다.
제2 다이오드(D2)는 제1 노드(N1)와 제3 노드(N3) 사이에 마련될 수 있다. 제2 다이오드(D2)는 제1 노드(N1)의 전압(VN1)을 직류전압으로 제3 노드(N3)에 공급한다. 제3 노드(N3)의 직류전압은 게이트하이전압(VGH)으로 출력단자(OUT)에 출력될 수 있다. 예를 들어, 제1 노드(N1)의 전압(VN1)이 도 6c와 같이 14V와 27V 사이를 스윙하는 교류전압인 경우, 제2 다이오드(D2)를 통해 공급된 제3 노드(N3)의 전압(VN3)은 도 6d와 같이 27V의 직류전압일 수 있다. 이 경우, 27V의 직류전압은 게이트하이전압(VGH)으로 출력단자(OUT)에 출력될 수 있다.
제2 노드(N2)와 그라운드 전원(GND) 사이에는 직렬로 접속된 제2 및 제3 커패시터들(C2, C3)이 마련될 수 있다. 제2 및 제3 커패시터들(C2, C3)은 제2 노드(N2)의 서지 전압을 흡수할 수 있다. 제3 노드(N3)와 그라운드 전압원(GND) 사이에는 제4 커패시터(C4)가 마련될 수 있고, 제3 노드(N3)와 출력단자(OT) 사이에는 제3 저항(R3)이 마련될 수 있다. 제4 커패시터(C4)는 제2 다이오드(D2)로부터 출력된 직류전압의 리플(ripple)을 제거하는 평활 커패시터로서 기능하고, 제3 저항(R3)은 과전류가 흐르는 것을 방지할 수 있다.
한편, 제2 내지 제4 커패시터들(C2, C3, C4)과 제2 및 제3 저항들(R2, R3)은 당업자가 변경 가능한 내에서 생략되거나, 다른 구성으로 대체될 수 있음에 주의하여야 한다.
이상에서 살펴본 바와 같이, 본 발명의 실시예에 따른 게이트하이전압 공급부(53)는 제1 전압 입력단자(IT1)로부터 제1 노드(N1)로 흐르는 전류값을 전류 제한값(CLV) 이하로 제어할 수 있다. 그 결과, 본 발명의 실시예는 표시장치가 전원 오프되지 않았음에도 게이트 구동부(20)가 게이트라인들 모두에 게이트하이전압(VGH)의 게이트신호들을 공급하는 비정상적인 구동을 하는 경우, 게이트하이전압 공급부(53)로부터 게이트 구동부(20)로 공급되는 전류가 증가하는 것을 방지할 수 있다. 게이트 구동부(20)의 비정상적인 구동은 표시장치가 파워 오프되지 않아 전압 공급부(50)가 정상적으로 게이트 구동부(20)에 구동전압들을 공급함에도, 방전신호(ALL_H)가 제2 로직 레벨 전압으로 게이트 구동부(20)에 입력되는 경우 발생할 수 있다. 이로 인해, 본 발명의 실시예는 방전신호(ALL_H)가 제1 로직 레벨 전압으로 정상적으로 복구되는 경우, 게이트하이전압 공급부(53)로부터 게이트 구동부(20)에 공급되는 전류를 원래대로 복구할 수 있으므로, 표시장치는 정상적인 화상을 표시할 수 있다. 이에 대한 자세한 설명은 도 7a, 도 7b, 도 8a 및 도 8b를 결부하여 후술한다.
도 7a 및 도 7b는 본 발명의 실시예에 따른 게이트하이전압 공급부의 제2 노드의 전류값을 보여주는 실험 예시 도면들이다. 도 7a에는 제1 로직 레벨 전압(V1)의 방전신호(ALL_H)가 게이트 구동부(20)에 입력되는 경우, 게이트하이전압 공급부(53)의 제2 노드(N2)의 전류값(CN2)이 나타나 있다. 도 7b에는 제2 로직 레벨 전압(V2)의 방전신호(ALL_H)가 게이트 구동부(20)에 입력되는 경우, 게이트하이전압 공급부(53)의 제2 노드(N2)의 전류값(CN2)이 나타나 있다. 도 7b에서는 수학식 1을 결부하여 예시한 바와 같이, 전류제어회로(CC)의 전류 제한값(CLV)이 50mA인 것을 중심으로 설명하였다.
도 7a를 참조하면, 제1 로직 레벨 전압(V1)의 방전신호(ALL_H)가 게이트 구동부(20)에 입력되는 경우 제2 노드(N2)의 전류값(CN2)은 대략 30mA를 유지한다. 도 7b를 참조하면, 제2 로직 레벨 전압(V2)의 방전신호(ALL_H)가 게이트 구동부(20)에 입력되는 기간 동안 게이트 구동부(20)가 게이트하이전압 공급부(53)에 더 많은 전류를 요구하더라도, 제2 노드(N2)의 전류값(CN2)은 전류 제한값(CLV)인 50mA를 넘어서지 않는다.
이상에서 살펴본 바와 같이, 본 발명의 실시예는 전류제어회로(CC)를 이용하여 제1 전압 입력단자(IT1)로부터 제1 노드(N1)로 흐르는 전류값을 전류 제한값(CLV) 이하로 제어할 수 있다.
도 8a 및 도 8b는 전류제어회로의 유무에 따른 제1 노드의 전류를 보여주는 실험 예시 도면들이다. 도 8a에는 제2 로직레벨전압(V2)의 방전신호(ALL_H)가 게이트 구동부(20)에 입력되는 경우 전류제어회로(CC)를 포함하지 않는 게이트하이전압 공급부(53)의 제1 노드(N1)의 전류값(CN1)이 나타나 있다. 도 8b에는 제2 로직레벨전압(V2)의 방전신호(ALL_H)가 게이트 구동부(20)에 입력되는 경우 전류제어회로(CC)를 포함하는 게이트하이전압 공급부(53)의 제1 노드(N1)의 전류값(CN1)이 나타나 있다.
도 8a를 참조하면, 게이트하이전압 공급부(53)가 전류제어회로(CC)를 포함하지 않는 경우, 제2 로직레벨전압(V2)의 방전신호(ALL_H)가 게이트 구동부(20)에 입력되면 제1 노드(N1)의 전류값(CN1)은 급상승한다.
도 8b를 참조하면, 게이트하이전압 공급부(53)가 전류제어회로(CC)를 포함하는 경우, 제2 로직레벨전압(V2)의 방전신호(ALL_H)가 게이트 구동부(20)에 입력되더라도 제1 노드(N1)의 전류값(CN1)은 급상승하지 않는다. 즉, 게이트하이전압 공급부(53)가 전류제어회로(CC)를 포함하는 경우 제1 노드(N1)의 전류값(CN1)은 게이트하이전압 공급부(53)가 전류제어회로(CC)를 포함하지 않는 경우보다 적은 폭(W)으로 상승한다.
게이트하이전압 공급부(53)가 전류제어회로(CC)를 포함하는 경우, 방전신호(ALL_H)가 제1 로직 레벨 전압(V1)에서 제2 로직 레벨 전압(V2)으로 반전되면 제1 노드의 전류값(CN1)은 소정의 폭(W)만큼 상승한다. 또한, 이후에 방전신호(ALL_H)가 제2 로직 레벨 전압(V2)에서 제1 로직 레벨 전압(V1)으로 반전되는 경우 제1 노드의 전류값(CN1)은 소정의 폭(W)만큼 하강한다. 즉, 방전신호(ALL_H)가 제1 로직 레벨 전압으로 정상적으로 복구되는 경우, 제1 노드의 전류값(CN1)은 원래대로 복구될 수 있다.
소정의 폭(W)은 방전신호(ALL_H)가 제2 로직 레벨 전압(V2)에서 제1 로직 레벨 전압(V1)으로 복구될 때, 제1 노드(N1)의 전류값(CN1) 역시 복구될 수 있을 정도로 설정되는 것이 바람직하다. 소정의 폭(W)은 전류 제한값(CLV)에 어느 정도 비례할 수 있다. 예를 들어, 게이트하이전압 공급부(53)가 전류제어회로(CC)를 포함하는 경우 소정의 폭(W)은 전류 제한값(CLV)이 클수록 커지고, 전류 제한값(CLV)이 작을수록 작아질 수 있다.
이상에서 살펴본 바와 같이, 표시장치가 파워 오프되지 않아 게이트하이전압 공급부(53)가 정상적으로 게이트 구동부(20)에 구동전압들을 공급함에도 제2 로직 레벨 전압(V2)의 방전신호(ALL_H)가 게이트 구동부(20)에 입력되는 경우, 게이트 구동부(20)는 게이트라인들 모두에 게이트하이전압(VGH)의 게이트신호들을 공급하는 비정상적인 구동을 한다. 게이트 구동부(20)는 비정상적인 구동시 정상적으로 구동할때보다 매우 높은 전류를 필요로 한다. 이로 인해, 게이트하이전압 공급부(53)는 전류제어회로(CC)를 포함하지 않는 경우, 게이트 구동부(20)가 정상적으로 구동할때보다 매우 높은 전류를 게이트 구동부(20)에 공급하게 된다.
하지만, 본 발명의 실시예는 도 7b와 같이 전류제어회로(CC)를 이용하여 제1 전압 입력단자(IT1)로부터 제1 노드(N1)로 흐르는 전류값을 전류 제한값(CLV) 이하로 제어할 수 있다. 이로 인해, 본 발명의 실시예는 게이트하이전압 공급부(53)로부터 게이트 구동부(20)로 공급되는 전류값을 도 8b와 같이 소정의 값 이하로 제어할 수 있다. 이때, 소정의 값은 방전신호(ALL_H)가 제1 로직 레벨 전압으로 정상적으로 복구되는 경우, 게이트하이전압 공급부(53)로부터 게이트 구동부(20)에 공급되는 전류가 복구될 수 있는 전류값에 해당한다. 그 결과, 본 발명의 실시예는 방전신호(ALL_H)가 제1 로직 레벨 전압으로 정상적으로 복구되는 경우, 게이트하이전압 공급부(53)로부터 게이트 구동부(20)에 공급되는 전류를 원래대로 복구할 수 있으므로, 표시장치는 정상적인 화상을 표시할 수 있다.
또한, 본 발명의 실시예는 게이트하이전압 공급부(53)로부터 게이트 구동부(20)로 공급되는 전류값을 도 8b와 같이 소정의 값 이하로 제어할 수 있으므로, 게이트하이전압 공급부(53)의 저항이 타버리는(burnt) 등의 부품이 손상되는 것을 방지할 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.
10: 표시패널 20: 게이트 구동부
30: 데이터 구동부 40: 타이밍 제어부
50: 전압 공급부 51: 전압제어회로
52: 구동전압 공급부 53: 게이트하이전압 공급부
54: 게이트로우전압 공급부 60: 방전제어회로
CC: 전류제어회로 REG: 레귤레이터

Claims (10)

  1. 직류전압인 제1 전압이 입력되는 제1 전압 입력단자;
    교류전압인 제2 전압이 입력되는 제2 전압 입력단자;
    제1 노드와 상기 제2 전압 입력단자 사이에 마련된 제1 커패시터; 및
    상기 제1 전압 입력단자와 상기 제1 노드 사이에 마련되어 상기 제1 전압 입력단자로부터 상기 제1 노드로 흐르는 전류값을 전류 제한값 이하로 제어하는 전류제어회로를 포함하고,
    상기 전류제어회로는,
    입력단자가 상기 제1 전압 입력단자에 접속되고, 출력단자와 ADJ 단자가 상기 제1 노드에 접속되는 레귤레이터; 및
    상기 레귤레이터의 상기 출력단자와 상기 제1 노드 사이에 마련된 제1 저항을 포함하는 전압 공급부.
  2. 삭제
  3. 제 1 항에 있어서,
    상기 전류 제한값을 CLV, 상기 제1 저항의 저항값을 RV1, 상기 레귤레이터의 상기 ADJ 단자의 출력전압을 Vadj라 할 때,
    상기 전류 제한값은,
    Figure 112020127139830-pat00004
    을 만족하는 전압 공급부.
  4. 제 1 항에 있어서,
    상기 제1 노드와 상기 전류제어회로 사이에 마련된 제1 다이오드; 및
    상기 제1 노드와 출력단자 사이에 마련된 제2 다이오드를 더 포함하는 전압 공급부.
  5. 데이터라인들, 게이트라인들, 및 상기 데이터라인들과 게이트라인들에 접속되는 화소들을 포함하는 표시패널;
    상기 게이트라인들에 게이트신호들을 공급하는 게이트 구동부;
    상기 데이터라인들에 데이터전압들을 공급하는 데이터 구동부;
    상기 게이트 구동부를 정상 모드 또는 방전 모드로 제어하기 위한 방전신호를 공급하는 방전제어회로; 및
    상기 게이트 구동부에 게이트하이전압을 공급하는 게이트하이전압 공급부를 구비하고,
    상기 게이트하이전압 공급부는,
    직류전압인 제1 전압이 입력되는 제1 전압 입력단자;
    교류전압인 제2 전압이 입력되는 제2 전압 입력단자;
    제1 노드와 상기 제2 전압 입력단자 사이에 마련된 제1 커패시터; 및
    상기 제1 전압 입력단자와 상기 제1 노드 사이에 마련되어 상기 제1 전압 입력단자로부터 상기 제1 노드로 흐르는 전류값을 전류 제한값 이하로 제어하는 전류제어회로를 포함하고,
    상기 전류제어회로는,
    입력단자가 상기 제1 전압 입력단자에 접속되고, 출력단자와 ADJ 단자가 상기 제1 노드에 접속되는 레귤레이터; 및
    상기 레귤레이터의 상기 출력단자와 상기 제1 노드 사이에 마련된 제1 저항을 포함하는 표시장치.
  6. 삭제
  7. 제 5 항에 있어서,
    상기 전류 제한값을 CLV, 상기 제1 저항의 저항값을 RV1, 상기 레귤레이터의 상기 ADJ 단자의 출력전압을 Vadj라 할 때,
    상기 전류 제한값은,
    Figure 112020127139830-pat00005
    을 만족하는 표시장치.
  8. 제 5 항에 있어서,
    상기 게이트하이전압 공급부는,
    상기 제1 노드와 상기 전류제어회로 사이에 마련된 제1 다이오드; 및
    상기 제1 노드와 출력단자 사이에 마련된 제2 다이오드를 더 포함하는 표시장치.
  9. 제 5 항에 있어서,
    상기 게이트 구동부의 동작 타이밍을 제어하기 위한 게이트 제어신호를 상기 게이트 구동부에 공급하는 타이밍 제어부를 더 구비하고,
    상기 방전제어회로는 상기 정상 모드에서 제1 로직 레벨 전압의 방전신호를 상기 게이트 구동부에 공급하고, 상기 방전 모드에서 제2 로직 레벨 전압의 방전신호를 상기 게이트 구동부에 공급하며,
    상기 게이트 구동부는 상기 제1 로직 레벨 전압의 방전신호가 입력되는 경우 상기 게이트 제어신호에 따라 상기 게이트하이전압의 펄스들을 갖는 게이트신호들을 생성하여 상기 게이트라인들에 출력하고, 상기 제2 로직 레벨 전압의 방전신호가 입력되는 경우 상기 게이트라인들에 상기 게이트하이전압의 게이트신호들을 출력하는 표시장치.
  10. 제 9 항에 있어서,
    상기 방전신호가 상기 제1 로직 레벨 전압에서 상기 제2 로직 레벨 전압으로 반전되는 경우 상기 제1 노드의 전류값은 소정의 폭만큼 상승하고, 이후에 상기 방전신호가 상기 제2 로직 레벨 전압에서 상기 제1 로직 레벨 전압으로 반전되는 경우 상기 제1 노드의 전류값은 상기 소정의 폭만큼 하강하는 표시장치.
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