KR100839383B1 - 플라즈마 표시 장치 및 그 구동 방법 - Google Patents

플라즈마 표시 장치 및 그 구동 방법 Download PDF

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Abstract

플라즈마 표시 장치 및 그 구동 방법에서, 리셋 기간에서 유지 전극의 전압을 점진적으로 하강시켜서 각 전극 사이에 벽 전압을 형성시킨 후, 주사 전극의 전압을 점진적으로 하강시켜서 각 셀의 벽 전하 상태를 초기화한다. 그리고 유지 기간에서 주사 전극의 전압을 접지 전압으로 유지한 상태에서 유지 전극에 양의 전압을 갖는 하이 레벨의 유지 방전 펄스와 음의 전압을 갖는 로우 레벨의 유지 방전 펄스를 인가한다.
이와 같이 하면 구동 파형을 주사 전극에 인가하는 주사 전극 구동부에 인가되는 내압이 감소하고, 공통 전극인 유지 전극에만 유지 방전 펄스를 인가하므로, 유지 기간에서 셀 사이에 구동 파형의 왜곡이 발생하는 것을 방지할 수 있다.
Figure R1020070029772
PDP, 플라즈마 표시 장치, 싱글 서스테인, 유지 전극, 내압

Description

플라즈마 표시 장치 및 그 구동 방법{PLASMA DISPLAY DEVICE AND DRIVING METHOD THEREOF}
도 1은 본 발명의 실시예에 따른 플라즈마 표시 장치의 개념도를 나타낸 것이다.
도 2는 본 발명의 실시예에 따른 플라즈마 표시 장치의 구동 파형을 나타낸 것이다.
도 3은 본 발명의 제1 실시예에 따른 주사 전극 구동부(400) 및 유지 전극 구동부(500)의 회로를 나타낸 것이다.
도 4a 및 도 4b는 본 발명의 제1 실시예에 따른 도 3의 주사 전극 구동부(400) 및 유지 전극 구동부(500)의 리셋 기간에서의 전류흐름을 나타낸 것이다.
도 5는 본 발명의 제1 실시예에 따른 도 3의 유지 전극 구동부(500)의 유지 기간에서의 구동타이밍을 나타낸 도면이다.
도 6a 및 도 6b는 본 발명의 제1 실시예에 따른 도 3의 유지 전극 구동부(500)의 유지 기간에서의 전류흐름을 나타낸 도면이다.
도 7은 본 발명의 제2 실시예에 따른 유지 전극 구동부(500)의 회로를 나타낸 도면이다.
도 8은 본 발명의 제2 실시예에 따른 도 7의 유지 전극 구동부(500)의 유지 기간에서의 구동타이밍을 나타낸 도면이다.
도 9a 및 도 9b는 본 발명의 제2 실시예에 따른 도 7의 유지 전극 구동부(500)의 유지 기간에서의 전류 흐름을 나타낸 도면이다.
도 10은 본 발명의 제3 실시예에 따른 주사 전극 구동부(400) 및 유지 전극 구동부(500)를 나타낸 것이다.
본 발명은 플라즈마 표시 장치 및 그 구동 방법에 관한 것이다.
플라즈마 표시 장치는 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치이다. 플라즈마 표시 장치의 표시 패널에는 그 크기에 따라 수십에서 수백 만개 이상의 방전 셀(이하 "셀"이라 함)이 매트릭스(matrix)형태로 배열되어 있다.
일반적으로 플라즈마 표시 장치에서는 한 프레임이 각각의 계조 가중치를 갖는 복수의 서브필드로 분할된다. 이때, 셀의 휘도는 복수의 서브필드 중 해당 방전 셀이 발광하는 서브필드의 가중치 합에 의해 결정된다.
각각의 서브필드는 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어진다. 리셋기간은 셀의 벽 전하 상태를 초기화시키는 기간이며, 어드레스 기간은 셀 중 발광시킬 셀과 발광시키지 않을 셀을 선택하기 위해 어드레싱 동작을 수행하는 기간이다. 유지기간은 어드레스 기간에서 발광 셀로 설정된 셀을 해당 서브필드의 가 중치에 해당하는 기간동안 유지방전시켜 화상을 표시하는 기간이다.
일반적으로, 리셋 기간에서는 모든 셀의 벽 전하 상태를 초기화 시키기 위하여, 주사 전극에 점진적으로 상승하는 리셋 상승 파형을 인가한 후 주사 전극에 점진적으로 하강하는 리셋 하강 파형을 인가하였다. 이때 리셋 상승 파형의 최고 전압이 갖는 전압레벨은 유지 기간에서 주사 전극과 유지 전극에 교대로 인가되는 유지 방전 펄스의 하이 전압 레벨에 두 배 이상으로 설정된다. 이에 따라 주사 전극에 구동 전압을 인가하는 주사 전극 구동부에서, 리셋 상승 파형을 생성하는 데에 관계된 다수의 소자들에 높은 내압이 인가된다.
또한 유지 기간에서는 유지 방전을 일으키기 위하여, 주사 전극과 유지 전극에 교대로 유지 방전 펄스를 인가한다. 그런데 주사 전극과 유지 전극이 용량성 부하로 작용하기 때문에, 주사 전극과 유지 전극에 대한 커패시턴스 성분(이하, '패널 커패시터'라 함)이 존재하게 된다. 따라서 유지 기간에서 유지 방전 펄스를 인가하기 위해서는 유지 방전을 위한 전력 외에 무효 전력이 요구된다. 이러한 무효 전력을 회수하여 재사용하는 회로를 전력 회수 회로라고 한다. 즉, 유지 방전 펄스를 인가하기 위하여, 주사 전극에 구동 전압을 인가하는 주사 전극 구동부 및 유지 전극에 구동 전압을 인가하는 유지 전극 구동부에는 별도의 전력 회수 회로가 각각 연결된다. 따라서 플라즈마 표시 장치의 구동 장치가 복잡해지는 문제점이 있다.
본 발명이 이루고자 하는 기술적 과제는 구동 회로를 간단하게 구성할 수 있는 플라즈마 표시 장치 및 이러한 구동 회로에 적합한 플라즈마 표시 장치의 구동 방법을 제공하는 것이다.
본 발명의 한 특징에 따르면, 플라즈마 표시 장치는 복수의 제1 전극 및 복수의 제2 전극을 포함하는 플라즈마 표시 패널, 상기 복수의 제1 전극에 연결되고, 유지 기간에서 상기 복수의 제1 전극에 제1 전압을 인가하는 제1 구동부 및 상기 복수의 제2 전극에 연결되고, 유지 기간에서 상기 복수의 제2 전극에 상기 제1 전압보다 높은 제2 전압과 상기 제1 전압보다 낮은 제3 전압을 교대로 갖는 유지 방전 펄스를 인가하는 제2 구동부를 포함한다. 여기서 상기 제1 구동부는, 상기 제1 전압을 공급하는 제1 전원에 제1단이 연결되고, 상기 복수의 제1 전극에 제2단이 연결되며, 상기 제1단에 캐소드가 연결되고 상기 제2단에 애노드가 연결되는 바디 다이오드를 갖는 제1 스위치 및 상기 제1 전압보다 낮은 제4 전압을 공급하는 제2 전원에 제1단이 연결되고, 상기 복수의 제1 전극에 제2단이 연결되며, 상기 제1단에 애노드가 연결되고 상기 제2단에 캐소드가 연결되는 바디 다이오드를 갖는 제2 스위치를 포함한다. 이때 상기 제1 스위치의 제2단과 상기 제2 스위치의 제2단이 서로 연결된다.
그리고 상기 제2 구동부는, 상기 제3 전압을 공급하는 제3 전원에 제1단이 연결되고, 상기 복수의 제2 전극에 제2단이 연결되는 제3 스위치를 포함하고, 리셋 기간의 일부 기간에서 상기 제3 스위치를 턴온하여, 상기 복수의 제2 전극의 전압을 상기 제3 전압까지 점진적으로 하강시킨다. 여기서 상기 제2 구동부는 상기 제2 전압을 공급하는 제4 전원에 제1단이 연결되고, 상기 복수의 제2 전극에 제2단이 연결되는 제4 스위치 및 상기 제3 전원에 제1단이 연결되고, 상기 복수의 제2 전극에 제2단이 연결되는 제5 스위치를 포함한다.
또한 상기 제2 구동부는 상기 제1 전극과 제2 전극 사이에 형성되는 용량성 성분인 패널 커패시터의 무효 전력을 회수하는 전력 회수부를 더 포함하고, 상기 전력 회수부는, 상기 복수의 제2 전극에 제1단이 연결되는 인덕터, 상기 제1 전원에 제1단이 연결되고, 상기 인덕터의 제2단에 제2단이 연결되는 제6 스위치, 상기 인덕터의 제2단에 제1단이 연결되고, 상기 제1 전원에 제2단이 연결되는 제7 스위치를 포함한다. 여기서 상기 전력 회수부는, 상기 제6 스위치의 제2단에 애노드가 연결되고 상기 인덕터의 제2단에 캐소드가 연결되는 제1 다이오드, 상기 제7 스위치의 제1단에 캐소드가 연결되고 상기 인덕터의 제2단에 애노드가 연결되는 제2 다이오드, 상기 제4 전원에 캐소드가 연결되고 상기 인덕터의 제2단에 애노드가 연결되는 제3 다이오드 및 상기 제3 전원에 애노드가 연결되고 상기 인덕터의 제2단에 캐소드가 연결되는 제4 다이오드를 더 포함한다.
또는 상기 제2 구동부는, 상기 제1 전압과 상기 제2 전압 사이의 전압을 충전하고 있는 제5 전원 및 상기 제5 전원과 상기 복수의 제2 전극 사이에 연결되는 제1 인덕터를 포함하는 제1 전력 회수부, 그리고 상기 제1 전압과 상기 제3 전압 사이의 전압을 충전하고 있는 제6 전원 및 상기 제6 전원과 상기 복수의 제2 전극 사이에 연결되는 제2 인덕터를 포함하는 제2 전력 회수부를 포함한다. 여기서 상기 제1 전력회수부는, 상기 제5 전원의 제1단에 제1단이 연결되고 상기 제1 인덕터의 제1단에 제2단이 연결되는 제6 스위치 및 상기 제5 전원의 제1단에 제1단이 연결되 고 상기 제1 인덕터의 제1단에 제2단이 연결되는 제7 스위치를 더 포함하고, 상기 제2 전력 회수부는, 상기 제6 전원의 제1단에 제1단이 연결되고 상기 제2 인덕터의 제1단에 제2단이 연결되는 제8 스위치 및 상기 제6 전원의 제1단에 제1단이 연결되고 상기 제2 인덕터의 제1단에 제2단이 연결되는 제9 스위치를 더 포함한다. 이때 상기 제1 인덕터의 제2단과 상기 제2 인덕터의 제2단은 상기 복수의 제2 전극에 연결된다. 또한 상기 제1 전력회수부는, 상기 제5 전원의 제1단에 애노드가 연결되고 상기 제1 인덕터의 제1단에 캐소드가 연결되는 제1 다이오드 및 상기 제5 전원의 제1단에 캐소드가 연결되고 상기 제1 인덕터의 제1단에 애노드가 연결되는 제2 다이오드를 더 포함하고, 상기 제2 전력회수부는, 상기 제6 전원의 제1단에 애노드가 연결되고 상기 제2 인덕터의 제1단에 캐소드가 연결되는 제3 다이오드 및 상기 제6 전원의 제1단에 캐소드가 연결되고 상기 제2 인덕터의 제1단에 애노드가 연결되는 제4 다이오드를 더 포함한다. 그리고 상기 제1 전력회수부는 상기 제4 전원에 캐소드가 연결되고 상기 제1 인덕터의 제1단에 애노드가 연결되는 제5 다이오드를 더 포함하고, 상기 제2 전력회수부는 상기 제3 전원에 애노드가 연결되고 상기 제2 인덕터의 제1단에 캐소드가 연결되는 제6 다이오드를 더 포함한다.
상기 제1 구동부는, 상기 복수의 제1 전극에 각각 연결되고, 각각 제1 노드 또는 제2 노드의 전압을 상기 복수의 제1 전극 중 대응하는 제1 전극에 선택적으로 인가하는 복수의 선택회로 및 상기 제1 전압보다 높은 제5 전압을 공급하는 제5 전원에 제1단이 연결되고, 상기 제2 스위치의 제2단에 제2단이 연결되며, 상기 제5 전압과 상기 제4 전압 사이의 전압차에 해당하는 제6 전압으로 충전되는 커패시터 를 더 포함한다. 여기서 상기 제1 구동부는, 상기 복수의 제1 전극에 캐소드가 연결되는 다이오드 및 상기 다이오드의 애노드에 제1단이 연결되고, 상기 제2 전원에 제2단이 연결되며, 리셋 기간의 일부 기간에서 턴온하여 상기 복수의 제1 전극의 전압을 상기 제4 전압보다 높은 제7 전압까지 점진적으로 하강시키는 제6 스위치를 더 포함한다. 이때 상기 제7 전압은 상기 제2 전압과 상기 다이오드의 항복전압의 합에 해당한다.
상기 복수의 제2 전극은 동일한 구동파형이 인가되는 공통 전극이고, 상기 제3 전압과 상기 제4 전압은 동일한 전압 레벨을 갖는다. 또한 상기 제2 전압과 상기 제3 전압은 서로 절대값이 동일하고 반대 위상의 전압 레벨을 갖는다.
본 발명의 다른 특징에 따르면, 복수의 제1 전극 및 상기 복수의 제1 전극과 같은 방향으로 배열되는 복수의 제2 전극을 포함하는 플라즈마 표시 장치의 구동 방법에 있어서, 유지 기간에서, 제1 전압을 공급하는 제1 전원과 상기 복수의 제1 전극 사이에 연결되는 제1 스위치를 턴온하여 상기 복수의 제1 전극을 제1 전압으로 유지한 상태에서, 상기 복수의 제2 전극에 상기 제1 전압보다 높은 제2 전압의 유지방전펄스와 상기 제1 전압보다 낮은 제3 전압의 유지방전펄스를 교대로 인가하는 단계; 리셋 기간에서, 상기 복수의 제1 전극의 전압을 상기 제1 전압보다 높은 제4 전압으로 유지한 상태에서, 상기 복수의 제2 전극의 전압을 상기 제2 전압까지 점진적으로 하강시키고, 상기 복수의 제2 전극의 전압을 상기 제1 전압보다 높은 제5 전압으로 유지한 상태에서, 상기 복수의 제1 전극의 전압을 상기 제1 전압보다 낮은 제6 전압까지 점진적으로 하강시키는 단계; 및 어드레스 기간에서, 상기 제1 전압보다 낮은 제7 전압을 공급하는 제2 전원과 상기 복수의 제1 전극사이에 연결되는 제2 스위치를 턴온하여, 상기 복수의 제1 전극에 상기 제7 전압을 순차적으로 인가하는 단계;를 포함한다.
여기서 상기 제1 스위치 및 상기 제2 스위치는 각각 제1단에 애노드가 연결되고 제2단에 캐소드가 연결되는 바디 다이오드를 갖고, 상기 제1 스위치의 제1단과 상기 제2 스위치의 제2단은 서로 연결한다.
또한 상기 리셋 기간에서, 상기 제3 전압을 공급하는 제3 전원과 상기 복수의 제2 전극사이에 연결되는 제3 스위치를 턴온하여, 상기 복수의 제2 전극의 전압을 점진적으로 하강시킨다. 그리고 상기 제7 전압과 상기 제3 전압은 전압 레벨의 절대값이 동일하게 설정된다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다. 그리고 도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였으며, 명세서 전체를 통하여 유사한 부분에 대해서는 유사한 도면 부호를 붙였다.
명세서 전체에서, 어떤 부분이 다른 부분과 "연결"되어 있다고 할 때, 이는 "직접적으로 연결"되어 있는 경우뿐 아니라, 그 중간에 다른 소자를 사이에 두고 "전기적으로 연결"되어 있는 경우도 포함한다. 또한 어떤 부분이 어떤 구성요소를 "포함"한다고 할 때, 이는 특별히 반대되는 기재가 없는 한 다른 구성요소를 제외하 는 것이 아니라 다른 구성요소를 더 포함할 수 있는 것을 의미한다.
또한, 명세서 전체에서, 벽전하란 각 전극에 가깝게 방전 셀의 벽(예를들어, 유전체층)에 형성되어, 상기 전극에 축적되는 전하를 말한다. 상기 벽전하는 실제로 전극 자체에 접촉하지 않지만, 이하에서는 벽전하가 전극에 "형성됨", "축적됨" 또는 "쌓임"과 같이 설명된다. 또한, 상기 벽전압은 벽전하에 의해서 방전 셀의 벽에 형성되는 전위차를 의미한다.
이제 본 발명의 실시예에 따른 플라즈마 표시 장치 및 그 구동 방법에 대하여 도면을 참고로 하여 상세하게 설명한다.
도 1은 본 발명의 실시예에 따른 플라즈마 표시 장치의 개념도를 나타낸 것이다.
도 1에 도시한 바와 같이, 본 발명의 실시예에 따른 플라즈마 표시 장치는 플라즈마 표시 패널(100), 제어부(200), 어드레스 전극 구동부(300), 주사 전극 구동부(400) 및 유지 전극 구동부(500)를 포함한다. 플라즈마 표시 패널(100)은 열 방향으로 뻗어 있는 복수의 어드레스 전극(A1-Am)(이하 "A 전극"이라 함), 그리고 행 방향으로 뻗어 있는 복수의 유지 전극(X1-Xn) (이하 "X 전극"이라 함) 및 복수의 주사 전극(Y1-Yn) (이하 "Y 전극"이라 함)을 포함한다. 복수의 Y 전극(Y1-Yn) 및 X 전극(X1-Xn)은 서로 쌍을 이루며 배열되어 있다. 그리고 인접하는 Y 전극(Y1-Yn)과 X 전극(X1-Xn) 및 A 전극(A1-Am)이 교차하는 곳에 방전 셀(12)이 형성된다.
제어부(200)는 외부로부터 영상신호를 수신하여 어드레스 전극 구동 제어 신호, 유지 전극 구동 제어 신호 및 주사 전극 구동 제어 신호를 출력한다. 또한 제 어부(200)는 하나의 프레임을 각각의 가중치를 가지는 복수의 서브필드로 분할하여 구동시킨9다.
어드레스 전극 구동부(300)는 제어부(200)로부터 어드레스 전극 구동 제어 신호를 수신하여 표시하고자 하는 방전 셀을 선택하기 위한 신호를 각 A 전극(A1-Am)에 인가한다. 주사 전극 구동부(400)는 제어부(200)로부터 주사 전극 구동 제어 신호를 수신하여 Y 전극(Y1-Yn)에 구동 전압을 인가하고, 유지 전극 구동부(500)는 제어부(200)로부터 유지 전극 구동 제어 신호를 수신하여 X 전극(X1-Xn)에 구동 전압을 인가한다.
다음, 본 발명의 실시예에 따른 플라즈마 표시 장치의 구동 파형에 대해서 알아본다. 아래에서는 편의상 하나의 셀을 형성하는 Y 전극, X 전극 및 A 전극에 인가되는 구동 파형에 대해서만 설명한다.
본 발명의 실시예에 따르면, 한 프레임은 각각의 가중치를 갖는 복수의 서브필드로 분할하여 구동되며, 각 서브필드는 리셋 기간, 어드레스 기간 및 유지 기간을 포함한다. 그리고 복수의 서브필드 중 적어도 하나의 서브필드에 포함되는 리셋 기간은 모든 셀에서 벽 전하의 초기화를 수행하기 위하여 제1 리셋 기간과 제2 리셋 기간으로 구성되는 메인 리셋 기간으로 설정된다. 또한 메인 리셋 기간으로 설정되지 않는 나머지 서브필드의 리셋 기간은 이전 서브필드의 유지 기간에서 유지방전한 일부 셀에서만 벽 전하의 초기화를 수행하는 보조 리셋 기간으로 설정된다.
도 2는 본 발명의 실시예에 따른 플라즈마 표시 장치의 구동 파형을 나타낸 도면이다. 도 2에서는 한 프레임을 분할한 복수의 서브필드에 속하고, 리셋 기간이 메인 리셋 기간으로 설정된 서브필드를 도시하였다.
도 2에 도시한 바와 같이, 제1 리셋 기간에서는, Y 전극과 A 전극에 각각 리셋 시작 전압(도 2에서 "dVscH"으로 도시함)과 기준 전압(도 2에서 "0V"로 도시하고, 이하, "0V 전압"이라 함)을 인가한 상태에서, X 전극의 전압을 0V에서 로우 유지 전압(도 2에서 "-Vs"으로 도시하고, 이하 "-Vs 전압"이라 함)까지 점진적으로 하강시킨다. 이와 같이 X 전극의 전압이 점진적으로 하강하는 동안, X 전극과 Y 전극 사이의 전압차 및 X 전극과 A 전극 사이의 전압차가 증가하여, X 전극과 Y 전극 사이, X 전극과 A 전극 사이 및 Y 전극과 A 전극 사이에서 미약한 방전(이하, "리셋 방전"이라 함)이 일어난다. 이때 발생하는 리셋 방전에 의해, X 전극에 (+)의 벽 전하가 형성되고, Y 전극과 A 전극에 (-)의 벽 전하가 형성된다.
다음으로, 제2 리셋 기간에서는, X 전극과 A 전극에 각각 바이어스 전압(도 2에서 "Ve"으로 도시하고, 이하 "Ve 전압"이라 함)과 0V 전압을 인가한 상태에서, Y 전극의 전압을 0V 전압에서 Y 리셋최저전압(도 2에서 "Vnf"으로 도시하고 이하 "Vnf 전압"이라 함)까지 점진적으로 하강시킨다. 이와 같이 Y 전극의 전압이 점진적으로 하강하는 동안, Y 전극과 X 전극 사이, Y 전극과 A 전극 사이 및 X 전극과 A 전극 사이에서 리셋 방전이 발생되어, X 전극에 형성되어 있던 (+)의 벽 전하와 Y 전극 및 A 전극에 형성되어 있던 (-)의 벽 전하가 소거된다. 일반적으로 (Vnf-Ve) 전압은 Y 전극과 X 전극 사이의 방전 개시 전압(Vfxy)과 사실상 동일하게 설정된다. 이에 따라 제2 리셋 기간이 종료한 때에, Y 전극과 X 전극 사이의 벽 전압이 사실상 0V가 되므로, 유지 기간에서 오방전 또는 저방전이 발생하는 것을 방지할 수 있다. 여기서 Vnf 전압은 -Vs 전압과 동일하거나 높은 전압 레벨을 갖는 것으로 설정될 수 있다.
도 2에 도시한 것과 같이, 어드레스 기간에서는, 켜질 방전 셀을 선택하기 위해서, X 전극에 Ve 전압을 인가한 상태에서, 복수의 Y 전극에 순차적으로 주사 전압(도 2에서 "VscL"이라 도시하고, 이하 "VscL 전압"이라 함)을 인가한다. 이때, Y 전극에 의해 VscL 전압이 인가된 복수의 방전 셀 중에서 선택하고자 하는 방전 셀을 통과하는 A 전극에 어드레스 전압(도 2에서 "Va"라 도시하고, 이하 "Va 전압"이라 함)을 인가한다. 그러면, Va 전압이 인가된 A 전극과 VscL 전압이 인가된 Y 전극 사이 및 VscL 전압이 인가된 Y 전극과 Ve 전압이 인가된 X 전극 사이에서 어드레스 방전이 일어나 Y 전극에 (+) 벽 전하, A 전극 및 X 전극에 각각 (-) 벽 전하가 형성된다. 여기서, VscL 전압은 전원수의 감축을 위하여, Vnf 전압과 같거나 낮은 전압레벨을 갖는 것으로 설정될 수 있으며, VscL 전압보다 높게 설정되는 Vnf 전압은 VscL 전압을 생성하는 전원과 항복전압을 갖는 제너 다이오드를 통해 생성될 수 있다. 그리고 VscL 전압이 인가되지 않는 Y 전극에는 VscL 전압보다 높은 비주사 전압(도 2에서 "VscH"이라 도시하고, 이하 "VscH 전압"이라 함)이 인가되고, 선택되지 않는 방전 셀을 구성하는 A 전극에는 0V 전압이 인가된다.
다음으로, 유지 기간에서는, Y 전극과 A 전극에 0V 전압을 인가한 상태에서, X 전극에 -Vs 전압의 유지 방전 펄스와 하이 유지 전압(도 2에서, "Vs"으로 도시하고, 이하, "Vs 전압"이라 함)의 유지 방전 펄스를 교대로 인가하여, 어드레스 기간에서 선택한 셀에서 유지 방전을 일으킨다.
즉, 어드레스 기간에서 어드레스 방전이 일어난 방전 셀의 Y 전극에는 (+)의 벽 전하가 형성되고, X 전극 및 A 전극에는 (-)의 벽전하가 형성되어 있으므로, 유지 기간에서 첫번째 유지 방전을 일으키기 위하여 X 전극에 -Vs 전압의 유지 방전 펄스를 인가한다. 이와 같이 첫번째 유지 방전이 일어난 후, X 전극에 (+)의 벽 전하가 형성되고 Y 전극과 A 전극에 (-)의 벽 전하가 형성된다. 첫번째 유지 방전으로 인하여 벽 전하 분포가 바뀌었으므로, 두번째 유지 방전을 일으키기 위하여, X 전극에 Vs 전압의 유지 방전 펄스를 인가한다. 이와 같이 두번째 유지 방전이 일어난 후에는 X 전극에 (-)의 벽 전하가 형성되고, Y 전극과 A 전극에 (+)의 벽 전하가 형성된다.
이상과 같이 유지 기간에서 X 전극에 -Vs 전압의 유지 방전 펄스를 인가하는 과정과 Vs 전압의 유지 방전 펄스를 인가하는 과정을 해당 서브필드가 표시하는 가중치에 대응하는 횟수만큼 반복한다.
한편, 도 2에서는 간결한 설명을 위하여, 리셋 기간에서 Y 전극 및 X 전극에 인가되는 하강 파형을 램프 파형의 형태로 도시 및 설명하였으나, 본 발명의 실시예는 하강 파형을 RC파형, 점진적으로 하강하면서 플로팅되는 파형 등과 같이 점진적으로 하강하는 파형이면 어떤 것이든지 적용할 수 있다.
이상에서 설명한 바와 같이, 본 발명의 실시예에 따르면, Y 전극에 Vs 전압이하의 전압만이 인가되어, 주사 전극 구동부에 연결되는 전원의 개수를 줄일 수 있고, 소자에 인가되는 내압을 감소시킬 수 있어, 주사 전극 구동부가 안정적으로 구동될 수 있다. 또한 유지방전펄스는 X 전극에만 인가하므로, 유지 기간에서 구동 파형이 왜곡되는 것을 줄일 수 있다.
이하에서는 도 2에 도시한 플라즈마 표시 장치의 구동 파형을 생성하면서도 구동 회로를 간단하게 설계할 수 있는 플라즈마 표시 장치에 대해 설명한다. 이하에서 스위치는 바디 다이오드(도시하지 않음)를 갖는 n-채널 전계 효과 트랜지스터(FET)로 도시하였으나, 이는 단지 예시일 뿐이며, 본 발명의 실시예에서 스위치는 n-채널 전계 효과 트랜지스터와 동일 또는 유사한 기능을 수행할 수 있는 다른 소자로 대체될 수 있다. 또한 X 전극과 Y 전극에 의해 형성되는 용량성 성분은 패널 커패시터(Cp)로 도시되었다.
도 3은 본 발명의 제1 실시예에 따른 주사 전극 구동부(400) 및 유지 전극 구동부(500)의 회로를 나타낸 것이다.
도 3에 도시한 것과 같이, 주사 전극 구동부(400)는 스위치(Yg, YscL, Yr), 커패시터(CscH), 다이오드(DscH) 및 복수의 선택회로를 포함한다. 이와 같이 구성되는 주사 전극 구동부(400)는 리셋 기간의 제2 리셋 기간에서 복수의 Y 전극에 점진적으로 하강하는 전압 파형을 인가하고, 어드레스 기간에서 복수의 Y 전극에 순차적으로 주사 전압을 인가하며, 유지 기간에서 복수의 Y 전극에 0V 전압을 인가한다.
스위치(Yg)는 Y 전극에 제1단이 연결되고, GND 전원에 제2단이 연결되며, 유지 기간에서 턴온되어 Y 전극에 0V 전압을 인가한다. 그리고 스위치(YscL)는 VscL 전압을 공급하는 VscL 전원에 제1단이 연결되고, Y 전극에 제2단이 연결된다. 어드레스 기간에서 스위치(YscL)를 턴온시키면, 스위치(YscL)의 제2단의 전압은 VscL 전압이 된다.
또한, 도 3에 도시한 것과 같이, 스위치(Yg)로 구성된 n-채널 FET와 스위치(YscL)로 구성된 n-채널 FET의 연결에서, 스위치(Yg)의 소스와 스위치(YscL)의 드레인이 서로 연결된다. 이와 같이 하면, 스위치(Yg)로 구성된 n-채널 FET의 내부에 존재하는 바디 다이오드는 Y 전극에 애노드가 연결되고, 스위치(YscL)로 구성된 n-채널 FET의 내부에 존재하는 바디 다이오드는 Y 전극에 캐소드가 연결된다. 이에 따라 Y 전극에 0V 전압보다 낮은 전압 레벨의 전압을 인가하는 동안에 GND 전원을 향하는 방향의 전류가 발생하는 것이 방지되므로, GND 전원과 VscL 전원 사이에 별도의 스위치를 구성할 필요가 없다.
스위치(Yr)는 VscL 전원에 제1단이 연결되고, 제너 다이오드(ZD)의 애노드에 제2단이 연결되며, 제너 다이오드(ZD)의 캐소드는 Y 전극에 연결된다. 이때 제너 다이오드(ZD)와 스위치(Yr)의 위치는 서로 바뀔 수 있다. 즉, 제너 다이오드(ZD)의 애노드는 VscL 전원에 연결되고, 제너 다이오드(ZD)의 캐소드는 스위치(Yr)의 제1단에 연결되며, 스위치(Yr)의 제2단은 Y 전극에 연결될 수도 있다. 스위치(Yr)는 제2 리셋 기간에서 턴온되며, 이와 같이 스위치(Yr)를 턴온시키면 제너 다이오드(ZD)의 캐소드 전압이 VscL 전압과 제너 다이오드(ZDf)의 항복 전압의 합에 해당하는 Vnf 전압까지 점진적으로 하강된다.
커패시터(CscH)는 VscH 전압을 공급하는 VscH 전원에 제1단이 연결되고, VscL 전원에 제1단이 연결된 스위치(YscL)의 제2단에 제2단이 연결된다. 이와 같이 구성되는 커패시터(CscH)는, 플라즈마 표시 장치의 초기 구동시에 스위치(YscL)를 턴온시켜서, VscH 전압과 VscL 전압 사이의 전압차(VscH-VscL)에 해당하는 dVscH 전압으로 충전된다.
다이오드(DscH)는 VscH 전원에 애노드가 연결되고, 커패시터(CscH)의 제1단에 캐소드가 연결된다. 다이오드(DscH)는 패널 커패시터(Cp)에 VscH 전압보다 높은 전압이 인가된 경우에, VscH 전원으로 전류가 흐르는 것을 방지하여, Y 전극의 전압이 안정적으로 유지될 수 있도록 한다.
선택회로(401)는 스위치(Sch)와 스위치(Scl)를 포함한다. 스위치(Sch)는 다이오드(DscH)와 커패시터(CscH) 사이의 접점에 제1단이 연결되고 Y 전극에 제2단이 연결된다. 그리고 스위치(Scl)는 VscL 전원에 제1단이 연결된 스위치(YscL)에 제1단이 연결되고, Y 전극에 제2단이 연결된다. 도 3에서는 하나의 Y 전극에 연결되는 선택회로(401)만을 도시하였으나, 본 발명의 실시예에 따르면, 플라즈마 표시 장치는 복수의 Y 전극에 각각 연결되는 복수의 선택회로를 포함하며, 이러한 선택회로는 복수 개가 연결된 IC 형태로 구성되는 것이 일반적이다.
도 3에 도시한 바와 같이, 유지 전극 구동부(500)는 유지 구동부(510), 리셋 구동부(520) 및 바이어스 구동부(530)를 포함한다.
유지 전극 구동부(500)에서, 유지 구동부(510)는 제1 전력 회수부(511), 제2 전력 회수부(512) 및 스위치(Xs1, Xs2)를 포함하며, 유지 기간에서 X 전극에 Vs 전압의 유지 방전 펄스와 -Vs 전압의 유지 방전 펄스를 교대로 인가한다. 여기서 제1 전력 회수부(511)는 X 전극의 전압이 Vs 전압에서 0V 전압 사이에서 변동될 때 무효전력을 회수하기 위하여 구성되며, 제2 전력 회수부(512)는 X 전극의 전압이 -Vs 전압에서 0V 전압 사이에서 변동될 때 무효 전력을 회수하기 위하여 구성된다.
스위치(Xs1)는 Vs 전압을 공급하는 Vs 전원에 제1단이 연결되고, X 전극에 제2단이 연결되어, 유지 기간에서 턴온되면 X 전극에 Vs 전압을 인가한다. 그리고 스위치(Xs2)는 -Vs 전압을 공급하는 -Vs 전원에 제1단이 연결되고, X 전극에 제2단이 연결되어, 유지 기간에서 턴온되면 X 전극에 -Vs 전압을 인가한다.
제1 전력 회수부(511)는 스위치(Xpr, Xpf), 다이오드(Dpr, Dpf, D1), 커패시터(Cerc1) 및 인덕터(Lerc1)를 포함한다. 여기서 커패시터(Cerc1)는 Vs 전압과 0V 전압 사이의 전압(예를 들면, Vs/2 전압일 수 있음)으로 충전되고, 인덕터(Lerc1)의 제1단은 X 전극에 연결된다.
스위치(Xpr)는 커패시터(Cerc1)의 제1단에 제1단이 연결되고, 다이오드(Dpr)의 애노드에 제2단이 연결되며, 다이오드(Dpr)의 캐소드는 인덕터(Lerc1)의 제1단에 연결된다. 또한 인덕터(Lerc1)의 제2단은 X 전극에 연결된다. 그리고 스위치(Xpf)는 커패시터(Cerc1)의 제1단에 제1단이 연결되고, 다이오드(Dpf)의 캐소드에 제2단이 연결되며, 다이오드(Dpr)의 애노드는 인덕터(Lerc1)의 제1단에 연결된다.
제1 전력 회수부(511)에서, 스위치(Xpr)가 유지 기간에서 턴온되면, 커패시터(Cerc1), 인덕터(Lerc1) 및 패널 커패시터(Cp) 사이에 LC 공진 전류가 발생되며, 이와 같은 공전 전류에 의해 X 전극의 전압이 Vs 전압 근처까지 상승된다. 그리고 스위치(Xpf)가 유지 기간에서 턴온되면, 패널 커패시터(Cp), 인덕터(Lerc1) 및 커패시터(Cerc1) 사이에 LC 공진 전류가 발생되며, 이와 같은 공진 전류에 의해 X 전 극의 전압이 0V 전압 근처까지 하강된다.
또한 다이오드(D1)은 Vs 전원에 캐소드가 연결되고, 인덕터(Lerc1)의 제1단에 애노드가 연결된다. 이와 같은 다이오드(D1)에 의해, 스위치(Xpr) 또는 스위치(Xpf)의 턴온시에 발생되는 공진 전류에 의해 인덕터(Lerc1)의 제1단에 Vs 전압보다 높은 기전력이 발생된 경우에도, 인덕터(Lerc1)의 제1단의 전압은 Vs 전압으로 유지될 수 있다. 이에 따라 공진전류의 증가에 따른 주위 소자들의 내압 증가를 방지할 수 있다.
한편, 따로 도시하지 않았으나, 제1 전력 회수부(511)에서, 스위치(Xpr)와 다이오드(Dpr)는 서로 위치를 바꿀 수 있고, 스위치(Xpf)와 다이오드(Dpf) 또한 서로 위치를 바꿀 수 있다. 즉, 스위치(Xpr)의 제1단에 다이오드(Dpr)의 캐소드가 연결되고, 스위치(Xpr)의 제2단에 인덕터(Lerc1)의 제1단이 연결될 수 있다. 그리고 스위치(Xpf)의 제1단에 다이오드(Dpf)의 애노드가 연결되고 스위치(Xpf)의 제2단에 인덕터(Lerc1)의 제1단이 연결될 수 있다.
또한 제2 전력 회수부(512)는 스위치(Xnr, Xnf), 다이오드(Dnr, Dnf, D2), 커패시터(Cerc2) 및 인덕터(Lerc2)를 포함한다. 여기서 커패시터(Cerc2)는 0V 전압과 -Vs 전압 사이의 전압(예를 들면, -Vs/2 전압일 수 있음)으로 충전되고, 인덕터(Lerc2)의 제1단은 X 전극에 연결된다.
스위치(Xnr)는 커패시터(Cerc2)의 제1단에 제1단이 연결되고, 다이오드(Dnr)의 애노드에 제2단이 연결되며, 다이오드(Dnr)의 캐소드는 인덕터(Lerc2)의 제1단에 연결된다. 그리고 인덕터(Lerc2)의 제2단은 X 전극에 연결된다. 또한 스위 치(Xnf)는 커패시터(Cerc2)의 제1단에 제1단이 연결되고, 다이오드(Dnf)의 캐소드에 제2단이 연결되며, 다이오드(Dnf)의 애노드는 인덕터(Lerc2)의 제1단에 연결된다.
제2 전력 회수부(512)에서, 스위치(Xnr)가 유지 기간에서 턴온되면, 커패시터(Cerc2), 인덕터(Lerc2) 및 패널 커패시터(Cp) 사이에 LC 공진전류가 발생되며, 이와 같은 공진 전류에 의해 X 전극의 전압이 0V 전압 근처까지 상승된다. 그리고 스위치(Xnf)가 유지 기간에서 턴온되면, 패널 커패시터(Cp), 인덕터(Lerc2) 및 커패시터(Cerc2) 사이에 LC 공진 전류가 발생되며, 이와 같은 공진 전류에 의해 X 전극의 전압이 -Vs 전압 근처까지 하강된다.
한편, 제1 전력 회수부(511)와 마찬가지로, 제2 전력 회수부(512)에서도, 스위치(Xnr)와 다이오드(Dnr)의 위치는 서로 바뀔 수 있으며, 스위치(Xnf)와 다이오드(Dnf)의 위치 또한 서로 바뀔 수 있다.
또한 다이오드(D2)은 -Vs 전원에 애노드가 연결되고, 인덕터(Lerc2)의 제1단에 캐소드가 연결된다. 이와 같은 다이오드(D2)에 의해, 스위치(Xnr) 또는 스위치(Xnf)의 턴온시에 발생되는 공진 전류에 의해 인덕터(Lerc2)의 제1단에 -Vs 전압보다 낮은 기전력이 발생된 경우에도, 인덕터(Lerc2)의 제1단의 전압은 -Vs 전압으로 유지될 수 있다. 이에 따라 공진 전류에 의한 주위 소자들의 불필요한 내압 증가를 방지할 수 있다.
리셋 구동부(520)는 -Vs 전원과 X 전극 사이에 연결되는 스위치(Xr)를 포함한다. 리셋 기간 중 제1 리셋 기간에서, 스위치(Xr)가 턴온되면, X 전극의 전압은 -Vs 전압까지 점진적으로 하강된다. 즉 스위치(Xr)는 -Vs 전원에 제1단이 연결되고, X 전극에 제2단이 연결된다. 제1 리셋 기간에서 스위치(Xr)를 턴온시키면, X 전극의 전압은 -Vs 전압까지 점진적으로 하강된다.
또한 바이어스 구동부(530)는 Ve 전압을 공급하는 Ve 전원과 X 전극 사이에 연결되는 스위치(Xe1, Xe2)를 포함한다.
스위치(Xe1)와 스위치(Xe2)는 바디 다이오드를 갖는 n-채널 FET로 구성될 수 있으므로, 이러한 경우에 바디 다이오드를 통해 패널 커패시터(Cp)에 충전되어 있는 전압이 Ve 전원에 인가될 수 있다. 이에 따라 스위치(Xe1)와 스위치(Xe2)를 백투백(back-to-back)으로 연결하여, Ve 전원이 과충전되는 것을 방지한다. 즉 도 3에 도시한 것과 같이, 스위치(Xe1)로 구성되는 트랜지스터의 소스와 스위치(Xe2)로 구성되는 트랜지스터의 소스가 서로 연결되며, 스위치(Xe1)로 구성되는 트랜지스터의 드레인은 Ve 전원에 연결되고, 스위치(Xe2)로 구성되는 트랜지스터의 드레인은 X 전극에 연결된다.
도 3에서는 Ve 전원과 X 전극 사이에 연결되어 제2 리셋 기간 및 어드레스 기간에서 턴온되면 X 전극에 Ve 전압을 인가하는 스위치를 바디 다이오드를 갖고 백투백으로 연결된 두 개의 n-채널 트랜지스터로 도시하였으나, 바디 다이오드가 존재하지 않는 소자를 이용할 수도 있다.
스위치(Xg)는 0V 전압을 공급하는 GND 전원에 제1단이 연결되고, X 전극에 제2단이 연결된다. 본 발명의 실시예에 따른 구동파형에서, 제1 리셋 기간이 종료되는 때에, X 전극의 전압은 -Vs 전압에서 Ve 전압으로 변동된다. 이때 도 2에 도 시하지 않았으나, X 전극의 전압을 -Vs 전압에서 0V 전압으로 변동시킨 후, 0V 전압에서 Ve 전압으로 변동시키면, X 전극의 전압이 안정적으로 유지될 수 있다. 이와 마찬가지로 유지 기간에서, X 전극의 전압은 -Vs 전압과 Vs 전압 사이에서 주기적으로 변동된다. 이때 X 전극의 전압을 -Vs 전압에서 0V 전압으로 변동시킨 후 0V 전압에서 Vs 전압으로 변동시키거나, 또는 Vs 전압에서 0V 전압으로 변동시킨 후 0V 전압에서 -Vs 전압으로 변동시키면 X 전극에 유지방전펄스를 안정적으로 인가할 수 있다. 이와 같이, X 전극의 전압이 음의 전압에서 양의 전압으로 변동되는 때 또는 양의 전압에서 음의 전압으로 변동되는 때에 스위치(Xg)를 턴온시킬 수 있다. 그리고 스위치(Xg)에 연결된 GND 전원은 플라즈마 표시 장치의 동작 중에 유지 전극 구동부를 효과적으로 방전시키기는 데에 이용될 수 있다.
그러나, 본 발명의 제1 실시예는 도 3에 도시된 것에 국한된 것이 아니며, X 전극에 구동 전압을 안정적으로 인가시킬 수 있고, 제1 전력 회수부, 제2 전력 회수부 및 주사 전극 구동부(400)에 연결되는 GND 전원을 통해 유지 전극 구동부(500)의 방전을 안정적으로 수행할 수 있다면, 유지 전극 구동부(500)의 간소화를 위하여 스위치(Xg)는 생략될 수 있다.
다음으로, 본 발명의 제1 실시예에 따른 주사 전극 구동부(400)의 리셋 기간에서의 구동 동작 및 유지 전극 구동부(500)의 리셋 기간에서의 구동 동작을 설명한다.
도 4a 및 도 4b는 본 발명의 제1 실시예에 따른 도 3의 주사 전극 구동부(400)의 리셋 기간에서의 전류흐름 및 유지 전극 구동부(500)의 리셋 기간에서의 전류흐름을 나타낸 것이다.
우선 플라즈마 표시 장치의 초기 구동시에 스위치(YscL)를 턴온하여 커패시터(CscH)에 VscH 전압과 VscL 전압 사이의 전압차(VscH-VscL)에 해당하는 dVscH 전압을 충전하는 것으로 가정한다.
앞서 설명한 바와 같이, 리셋 기간 중 제1 기간에서는, Y 전극에 VscH 전압을 인가한 상태에서, X 전극에 -Vs 전압까지 점진적으로 하강시킨다.
이와 같은 구동 파형을 생성하기 위하여, 도 4a에 도시한 것과 같이, 주사 전극 구동부(400)에서는 스위치(Yg) 및 선택회로의 스위치(Sch)를 턴온시킨다. 이와 같이 하면, GND 전원, 스위치(Yg), 커패시터(CscH), 스위치(Scl) 및 패널 커패시터(Cp)의 Y 전극을 포함하는 전류 경로(①)를 통해, Y 전극에 커패시터(CscH)에 충전되어 있던 dVscH 전압이 인가된다.
또한 이와 동시에 유지 전극 구동부(500)에서는, 스위치(Xr)를 턴온시킨다. 이와 같이 스위치(Xr)를 턴온하면, 도 4a에 도시한 것과 같이, 패널 커패시터(Cp)의 X 전극, 스위치(Xr) 및 -Vs 전원을 포함하는 전류 경로(ⓐ)가 발생된다. 이때 전류 경로(ⓐ)를 통해 일정한 전류가 흐르게 되어, X 전극의 전압이 점진적으로 하강하게 된다.
이와 같이 스위치(Xr)를 턴온시켜서, X 전극의 전압을 -Vs 전압까지 점진적으로 하강시키며, 여기서 X 전극의 전압이 하강하는 기울기는 전류 경로(ⓐ)를 통해 흐르는 전류의 크기에 의해 결정된다.
또한 리셋 기간 중 제2 리셋 기간에서는, X 전극에 Ve 전압을 인가한 상태에 서 Y 전극의 전압을 Vnf 전압까지 점진적으로 하강시킨다.
이와 같은 구동 파형을 생성하기 위하여, 도 4b에 도시한 것과 같이, 유지 전극 구동부(500)에서는, 스위치(Xe1)를 턴온시킨다. 이와 같이 하면, Ve 전원, 스위치(Xe1), 스위치(Xe2)의 바디 다이오드 및 패널 커패시터(Cp)의 X 전극을 포함하는 전류 경로(ⓑ)를 통해 X 전극에 Ve 전압을 인가한다.
그리고 주사 전극 구동부(400)에서는 선택회로의 스위치(Scl) 및 스위치(Yr)를 턴온시킨다. 이와 같이 하면, 도 4b에 도시한 바와 같이, 패널 커패시터(Cp)의 Y 전극, 스위치(Scl), 제너 다이오드(ZD), 스위치(Yr) 및 VscL 전원을 포함하는 전류 경로(②)가 발생한다. 이때 Y 전극의 전압은 VscL 전압과 제너 다이오드(ZD)의 항복 전압의 합에 해당하는 Vnf 전압까지 점진적으로 하강된다. 여기서 Y 전극의 전압이 하강하는 기울기는 전류 경로(②)를 통해 흐르는 전류 크기에 의존한다.
이하에서는 도 5, 도 6a 및 도 6b를 참고하여, 본 발명의 제1 실시예에 따른 주사 전극 구동부(400) 및 유지 전극 구동부(500)의 유지 기간에서의 시계열적 동작 변화에 대해 상세하게 설명한다. 여기서 동작 변화는 6개의 모드(M1~M6)로 일순하며, 모드 변화는 스위치의 조작에 의해 발생한다. 그리고 아래에서 LC 공진으로 칭하고 있는 현상은 연속적 발진이 아니며, 스위치(Xpr, Xpf, Xnr, Xnf)의 턴온시에 발생하는 인덕터(Lerc1, Lerc2), 패널 커패시터(Cp) 및 커패시터(Cerc1, Cerc2)의 조합에 의한 전압 및 전류의 변화 현상이다.
도 5는 본 발명의 제1 실시예에 따른 도 3의 유지 전극 구동부(500)의 회로에서 유지 기간동안의 구동타이밍을 나타낸 것이고, 도 6a 및 도 6b는 본 발명의 제1 실시예에 따른 도 3의 회로에서 유지 기간에서의 전류흐름을 나타낸 것이다.
앞서 설명한 바와 같이, 유지 기간에서 Y 전극의 전압은 0V 전압으로 유지한 상태에서 X 전극에 -Vs 전압의 유지 방전 펄스와 Vs 전압의 유지 방전 펄스를 교대로 인가한다. 즉, 유지 기간에서, 주사 전극 구동부(400)는 스위치(Yg) 및 선택회로의 스위치(Scl)를 턴온한다. 이와 같이 하면, 도 6a 및 도 6b에 도시한 바와 같이, GND 전원, 스위치(Yg), 선택회로의 스위치(Scl) 및 패널 커패시터(Cp)의 Y 전극을 포함하는 전류 경로(③)를 통해 Y 전극에 0V 전압이 인가된다. 유지 기간에서 Y 전극에는 지속적으로 0V 전압이 인가되므로, 이하에서 별도의 언급은 생략한다.
모드 1(M1)이 시작되기 전에 패널 커패시터(Cp)의 X 전극의 전압은 0V 전압 근처인 것으로 가정한다.
모드 1(M1)에서는 스위치(Xpr)가 턴온된다. 그러면 도 6a에 나타낸 바와 같이, 커패시터(Cerc1), 스위치(Xpr), 다이오드(Dpr), 인덕터(Lerc1) 및 패널 커패시터(Cp)의 X 전극을 포함하는 전류 경로(ⓒ)가 형성된다. 이때 패널 커패시터(Cp), 인덕터(Lerc1) 및 커패시터(Cerc1) 사이에 LC 공진이 발생되고, 커패시터(Cerc1)는 0V 전압과 Vs 전압 사이의 전압으로 충전되어 있는 상태이므로, 전류 경로(ⓒ)를 통과하는 공진 전류에 의해 패널 커패시터(Cp)의 X 전극의 전압이 Vs 전압 근처까지 증가한다.
모드 2(M2)에서는 스위치(Xpr)를 턴오프하고, 스위치(Xs1)를 턴온한다. 그러면, 도 6a에 나타낸 바와 같이, Vs 전원, 스위치(Xs1) 및 패널 커패시터(Cp)의 X 전극을 포함하는 전류 경로(ⓓ)가 형성된다. 이때 전류 경로(ⓓ)에 의해 X 전극에 Vs 전압이 인가된다.
모드 3(M3)에서는 스위치(Xs1)를 턴오프하고, 스위치(Xpf)를 턴온한다. 그러면 도 6a에 나타낸 바와 같이, 패널 커패시터(Cp)의 X 전극, 인덕터(Lerc1), 다이오드(Dpf), 스위치(Xpf) 및 커패시터(Cerc1)를 포함하는 전류 경로(ⓔ)가 형성된다. 이러한 전류 경로(ⓔ)에는 패널 커패시터(Cp), 인덕터(Lerc1) 및 커패시터(Cerc1) 사이에서 발생되는 LC 공진에 의해 공진 전류가 발생되고, 이때의 공진 전류에 의해 패널 커패시터(Cp)에 충전되어 있던 전압이 방전되어, 패널 커패시터(Cp)의 X 전극의 전압이 0V 전압 근처까지 감소한다.
모드 4(M4)에서는 스위치(Xpf)가 턴오프되고, 스위치(Xnf)가 턴온된다. 그러면 도 6b에 도시한 바와 같이, 패널 커패시터(Cp)의 X 전극, 인덕터(Lerc2), 다이오드(Dnf), 스위치(Xnf) 및 커패시터(Cerc2)를 포함하는 전류 경로(ⓕ)가 형성된다. 이때의 전류 경로(ⓕ)에 의해 패널 커패시터(Cp), 인덕터(Lerc2) 및 커패시터(Cerc2) 사이에서 발생되는 LC 공진에 의해 공진 전류가 발생되고, 이와 같은 공진 전류에 의해 패널 커패시터(Cp)의 X 전극의 전압이 -Vs 전압 근처까지 감소한다.
모드 5(M5)에서는 스위치(Xnf)가 턴오프되고, 스위치(Xs2)가 턴온된다. 그러면, 도 6b에 도시한 바와 같이, -Vs 전원, 스위치(Xs2), 패널 커패시터(Cp)의 X 전극을 포함하는 전류 경로(ⓖ)가 형성된다. 이때 전류 경로(ⓖ)를 통해, 패널 커패시터(Cp)의 X 전극에 -Vs 전압이 인가된다.
모드 6(M6)에서는 스위치(Xs2)가 턴오프되고, 스위치(Xnr)가 턴온된다. 그러 면, 도 6b에 도시한 바와 같이, 커패시터(Cerc2), 스위치(Xnr), 다이오드(Dnr), 인덕터(Lerc2) 및 패널 커패시터(Cp)의 X 전극을 포함하는 전류 경로(ⓗ)가 형성된다. 이때의 전류 경로(ⓗ)에 의해 패널 커패시터(Cp), 인덕터(Lerc2) 및 커패시터(Cerc2) 사이에 LC 공진이 발생된다. 여기서 커패시터(Cerc2)는 -Vs 전압과 0V 전압 사이의 전압으로 충전되어 있으므로, 전류 경로(ⓗ)에서의 LC 공진에 의해 패널 커패시터(Cp)의 X 전극의 전압이 0V 전압 근처까지 증가한다.
여기서 모드 3(M3)이 종료되고 모드 4(M4)가 시작되기 전에 X 전극에 0V 전압을 인가할 수 있다. 즉, 스위치(Xpf)를 턴오프한 후에 스위치(Xg)를 턴온하여 X 전극에 0V 전압을 인가한 후 스위치(Xnf)를 턴온할 수 있다. 또한 모드 6(M6)이 종료되고 모드 1(M1)이 시작되기 전에 0V 전압을 인가할 수 있다. 즉, 스위치(Xnr)를 턴오프한 이후에 스위치(Xg)를 턴온하여 X 전극에 0V 전압을 인가한 후에 스위치(Xpr)를 턴온할 수 있다. 이와 같이 하면, 유지 기간에서 X 전극의 전압이 안정적으로 변동될 수 있다.
도 5, 도 6a 및 도 6b에 도시한 것과 같이, 제1 실시예에 따르면, 유지 기간에서 모드1 내지 모드 6(M1~M6)의 반복을 통해 X 전극에 Vs 전압과 -Vs 전압을 교대로 인가될 수 있다. 그리고 이와 같이 전력 회수 회로(410, 420)를 두 개로 분리할 때의 전력 손실은 {(1/2)Cp(Vs)2+(1/2)Cp(Vs)2}이 된다. 따라서 Y 전극에 Vs 전압과 -Vs 전압을 교대로 인가하는 경우의 전력 손실(1/2)Cp(2Vs)2에 비해 전력 손실을 줄일 수 있다.
또한, 본 발명의 제1 실시예에 따르면, Y 전극에 Vs 전압보다 높은 전압을 인가하지 않고도 X 전극과 Y 전극 사이의 전압차를 점진적으로 상승시킬 수 있다. 따라서 주사 전극 구동부에 포함되는 다수의 소자들에 높은 내압이 인가되는 것을 방지하여, 회로의 신뢰성을 향상시킬 수 있다.
또한, 주사 전극 구동부에서 0V 전압을 공급하는 GND 전원에 연결되는 스위치(Yg)를 구성하는 트랜지스터는, 내부에 존재하는 바디 다이오드의 애노드가 Y 전극에 연결되도록 구성하고, 0V 전압보다 낮은 VscL 전압을 공급하는 VscL 전원에 연결되는 스위치(YscL)를 구성하는 트랜지스터는, 내부에 존재하는 바디 다이오드의 캐소드가 Y 전극에 연결되도록 구성한다. 이와 같이 함으로써, GND 전원에 음의 전압이 인가되는 것을 방지하기 위하여, GND 전원과 VscL 전원 사이에 별도의 소자를 구성할 필요가 없으므로, 주사 전극 구동부를 더욱 간결하게 설계할 수 있다.
그리고 유지 기간에서 Y 전극의 전압은 0V 전압으로 유지한 상태에서, 공통전극으로 구성되는 X 전극에만 -Vs 전압의 유지 방전 펄스와 Vs 전압의 유지 방전 펄스를 교대로 인가한다. 이와 같이 하면, 각각의 Y 전극에 연결되는 복수의 선택회로를 통해 유지 방전 펄스를 인가함으로 인해 발생하는 각 Y 전극에 인가되는 유지 방전 펄스 사이에 발생하는 왜곡을 줄일 수 있고, 선택회로에 인가되는 높은 내압을 감소시킬 수 있어, 회로의 신뢰성을 향상시킬 수 있다.
한편, 제1 실시예에 따르면, 유지 기간에서 X 전극에 Vs 전압의 유지 방전 펄스와 -Vs 전압의 유지 방전 펄스를 교대로 인가하기 위하여, 스위치(Xpr, Xs1, Xpf, Xnf, Xs2, Xnr)를 순차적으로 턴온시킨다. 또한 Vs 전압의 유지 방전 펄스의 전력 회수를 위한 인덕터(Lerc1)과 -Vs 전압의 유지 방전 펄스의 전력 회수를 위한 인덕터(Lerc2)를 별도로 구성한다. 이에 따라 회로의 간소화에 한계가 있고, 스위칭 횟수가 잦아서 발열현상이 일어날 수 있다.
이에 따라 이하에서는 소자의 개수를 줄이면서도 유지 방전 펄스를 안정적으로 생성할 수 있는 유지 구동부(510)를 포함하는 유지 전극 구동부(500)에 대하여 설명한다.
도 7은 본 발명의 제2 실시예에 따른 유지 전극 구동부(500)를 나타낸 것이다. 본 발명의 제2 실시예에 따르면, 유지 구동부(510)를 제외하고는 나머지 리셋 구동부(520) 및 바이어스 구동부(530)의 구성은 도 3에 도시한 제1 실시예에서와 동일하므로, 이하에서 중복되는 설명은 생략하기로 한다.
본 발명의 제2 실시예에 따르면, 유지 구동부(510)는 스위치(Xs1, Xs2) 및 전력 회수부(513)를 포함한다.
도 7에 도시한 바와 같이, 스위치(Xs1)은 Vs 전압을 공급하는 Vs 전원에 제1단이 연결되고, X 전극에 제2단이 연결되어, 유지 기간에서 턴온되면 X 전극에 Vs 전압을 인가한다. 그리고 스위치(Xs2)는 -Vs 전압을 공급하는 -Vs 전원에 제1단이 연결되고, X 전극에 제2단이 연결되어, 유지 기간에서 턴온되면 X 전극에 -Vs 전압을 인가한다.
전력 회수부(513)는 스위치(Xer, Xef), 다이오드(Der, Def, D3, D4) 및 인덕터(Lerc)를 포함한다.
스위치(Xer)는 0V 전압을 공급하는 GND 전원에 제1단이 연결되고, 다이오 드(Der)의 애노드에 제2단이 연결되며, 다이오드(Der)의 캐소드는 인덕터(Lerc)의 제1단에 연결된다. 그리고 스위치(Xef)는 GND 전원에 제1단이 연결되고, 다이오드(Def)의 캐소드에 제2단이 연결되며, 다이오드(Def)의 애노드는 인덕터(Lerc)의 제1단에 연결된다. 또한 인덕터(Lerc)의 제2단은 X 전극에 연결된다.
다이오드(D3)는 Vs 전원에 캐소드가 연결되고, 인덕터(Lerc)의 제1단에 애노드가 연결되어, 인덕터(Lerc)에서 발생되는 역기전력에 의해 인덕터(Lerc)의 제1단의 전압이 Vs 전압 이상이 되면, 도통하여 Vs 전압이 되도록 클램핑한다.
다이오드(D4)는 -Vs 전원에 애노드가 연결되고, 인덕터(Lerc)의 제1단에 캐소드가 연결되어, 인덕터(Lerc)에서 발생되는 역기전력에 의해 인덕터(Lerc)의 제1단의 전압이 -Vs 전압 이하가 되면, 도통하여 -Vs 전압이 되도록 클램핑한다.
한편, 따로 도시하지 않았으나, 전력 회수부(513)에서, 스위치(Xer)와 다이오드(Der)의 위치는 서로 바뀔 수 있고, 스위치(Xef)와 다이오드(Def)의 위치 또한 서로 바뀔 수 있다. 즉 스위치(Xer)의 제1단에 다이오드(Der)의 캐소드가 연결되고, 스위치(Xer)의 제2단에 인덕터(Lerc)의 제1단이 연결될 수 있다. 그리고 스위치(Xef)의 제1단에 다이오드(Def)의 애노드가 연결되고 스위치(Xef)의 제2단에 인덕터(Lerc)의 제1단이 연결될 수 있다.
다음으로 제2 실시예에 따른 유지 전극 구동부(500)에서 유지 기간에서의 구동동작에 대하여 설명한다.
도 8은 본 발명의 제2 실시예에 따른 도 7의 유지 전극 구동부(500)의 유지 기간에서의 구동타이밍을 나타낸 도면이고, 도 9a 및 도 9b는 본 발명의 제2 실시 예에 따른 도 7의 유지 전극 구동부(500)의 유지 기간에서의 전류 흐름을 나타낸 도면이다.
제2 실시예에 따르면, 유지 기간에서 주사 전극 구동부는 스위치(Yg) 및 선택회로의 스위치(Scl)를 턴온하여 GND 전원, 스위치(Yg), 선택회로의 스위치(Scl) 및 패널 커패시터(Cp)의 Y 전극을 포함하는 전류 경로를 통해 Y 전극에 0V 전압을 인가한다. 유지 기간에서 Y 전극의 전압은 0V 전압으로 유지되므로, 이하에서 별도의 언급은 생략한다.
제2 실시예에 따른 유지 구동부의 유지 기간에서의 구동 동작을 설명함에 잇어서, 모드 7(M7)이 시작되기 전에 패널 커패시터(Cp)의 X 전극의 전압은 Vs 전압이었던 것으로 가정한다. 이하에서 설명하는 제2 실시예에 따른 유지 기간에서의 동작 변화는 4개의 모드(M7~M10)로 일순하며, 모드 변화는 스위치의 조작에 의해 발생한다. 또한 이하에서 LC 공진으로 칭하고 있는 현상은 연속적 발진이 아니며, 스위치(Xer, Xef)의 턴온시에 발생하는 인덕터(Lerc), 패널 커패시터(Cp)의 조합에 의한 전압 및 전류의 변화 현상이다.
모드 7(M7)에서는 스위치(Xef)를 턴온하여, 도 9a에 도시한 바와 같이, 패널 커패시터(Cp)의 X 전극, 인덕터(Lerc), 다이오드(Def), 스위치(Xef), GND 전원을 포함하는 전류 경로(ⓘ)를 형성시킨다. 이때 패널 커패시터(Cp)와 인덕터(Lerc) 사이에서 LC 공진이 발생되어, 전류 경로(ⓘ)를 흐르는 공진 전류에 의해 X 전극의 전압은 -Vs 전압 근처로 하강한다.
모드 8(M8)에서는 스위치(Xs2)를 턴온하여, 도 9a에 도시한 바와 같이, 패널 커패시터(Cp)의 X 전극, 스위치(Xs2), -Vs 전원을 포함하는 전류 경로(ⓙ)를 형성시킨다. 이때 전류 경로(ⓙ)를 흐르는 전류에 의해, X 전극의 전압은 -Vs 전압으로 유지된다.
모드 9(M9)에서는 스위치(Xer)를 턴온하여, 도 9b에 도시한 바와 같이, GND 전원, 스위치(Xer), 다이오드(Der), 인덕터(Lerc), 패널 커패시터(Cp)의 X 전극을 포함하는 전류 경로(ⓚ)를 형성시킨다. 이때 패널 커패시터(Cp)와 인덕터(Lerc) 사이에서 LC 공진이 발생되어, 전류 경로(ⓚ)를 흐르는 공진 전류에 의해 X 전극의 전압은 Vs 전압 근처로 상승한다.
모드 10(M10)에서는 스위치(Xs1)를 턴온하여, 도 9b에 도시한 바와 같이, Vs 전원, 스위치(Xs1), 패널 커패시터(Cp)의 X 전극을 포함하는 전류 경로(ⓛ)를 형성시킨다. 이때 전류 경로(ⓛ)를 흐르는 전류에 의해, X 전극의 전압은 Vs 전압으로 유지된다.
이상과 같이, 제2 실시예에 따르면, 회로를 간소하게 구성할 수 있고, 스위치의 동작변화 횟수가 줄어들게 되어, 발열이 작게 일어나므로, 회로가 안정적으로 구동될 수 있다.
한편, 어드레스 기간에서 Y 전극에 순차적으로 인가되는 VscL 전압은, 유지 기간에서 X 전극에 인가되는 -Vs 전압과 동일한 전압 레벨을 갖도록 설정할 수 있다.
도 10은 본 발명의 제3 실시예에 따른 주사 전극 구동부(400) 및 유지 전극 구동부(500)를 나타낸 것이다.
도 10에 도시한 바와 바와 같이, 본 발명의 제3 실시예에 따른 주사 전극 구동부(400) 및 유지 전극 구동부(500)는, 주사 전극 구동부(400)에서 VscL 전원을 삭제하고, VscL 전압을 공급하는 전원으로 -Vs 전원을 이용하는 것을 제외하고는 앞서 설명한 제1 실시예와 동일하므로, 이하 중복되는 설명은 생략한다.
본 발명의 제3 실시예에 따른 주사 전극 구동부(400)는 VscL 전압을 공급하는 전원으로 -Vs 전원을 이용하므로, 어드레스 기간에서 Y 전극에 순차적으로 인가하는 주사 전압의 전압 레벨은 -Vs 전압이 된다. 또한 제2 리셋 기간에서 Y 전극의 전압은 0V 전압에서 Vnf 전압까지 점진적으로 하강하는데, 이때 Vnf 전압은 -Vs 전압과 제너 다이오드(ZD)의 항복 전압의 합에 해당한다.
이상과 같이, 제3 실시예에 따르면, VscL 전원을 생략할 수 있어, 전원의 개수를 줄일 수 있으므로, 회로를 간결하게 구성할 수 있다.
이상에서 본 발명의 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
본 발명에 따르면, 유지 기간에서 유지방전을 일으키기 위한 구동파형의 왜곡을 감소시킬 수 있다. 또한 주사 전극 구동부에 인가되는 내압을 줄일 수 있으며, 주사 전극 구동부를 간단하게 설계할 수 있으므로 회로의 신뢰성을 향상시킬 수 있다.

Claims (19)

  1. 복수의 제1 전극 및 복수의 제2 전극을 포함하는 플라즈마 표시 패널,
    상기 복수의 제1 전극에 연결되고, 유지 기간에서 상기 복수의 제1 전극에 제1 전압을 인가하는 제1 구동부 및
    상기 복수의 제2 전극에 연결되고, 유지 기간에서 상기 복수의 제2 전극에 상기 제1 전압보다 높은 제2 전압과 상기 제1 전압보다 낮은 제3 전압을 교대로 갖는 유지 방전 펄스를 인가하는 제2 구동부를 포함하고,
    리셋 기간의 제1 기간에서,
    상기 제1 구동부는 상기 복수의 제1 전극의 전압을 상기 제1 전압보다 높은 제4 전압으로 유지시키며, 상기 복수의 제1 전극의 전압이 상기 제4 전압으로 유지되는 동안, 상기 제2 구동부는 상기 복수의 제2 전극의 전압을 상기 제3 전압까지 점진적으로 하강시키며,
    상기 리셋 기간의 제2 기간에서,
    상기 제2 구동부는 상기 복수의 제2 전극의 전압을 상기 제1 전압보다 높은 제5 전압으로 유지시키며, 상기 제2 전극의 전압이 상기 제5 전압으로 유지되는 동안, 상기 제1 구동부는 상기 복수의 제1 전극의 전압을 상기 제1 전압보다 낮은 제6 전압까지 점진적으로 하강시키는 플라즈마 표시 장치.
  2. 제1항에 있어서,
    상기 제1 구동부는,
    상기 제1 전압을 공급하는 제1 전원에 제1단이 연결되고, 상기 복수의 제1 전극에 제2단이 연결되며, 상기 제1단에 캐소드가 연결되고 상기 제2단에 애노드가 연결되는 바디 다이오드를 갖는 제1 스위치, 및
    상기 제1 전압보다 낮은 제 7 전압을 공급하는 제2 전원에 제1단이 연결되고, 상기 복수의 제1 전극에 제2단이 연결되며, 상기 제1단에 애노드가 연결되고 상기 제2단에 캐소드가 연결되는 바디 다이오드를 갖는 제2 스위치를 포함하고, 상기 제1 스위치의 제2단과 상기 제2 스위치의 제2단이 서로 연결되며,
    상기 제2 구동부는,
    상기 제3 전압을 공급하는 제3 전원에 제1단이 연결되고, 상기 복수의 제2 전극에 제2단이 연결되는 제3 스위치를 포함하고,
    리셋 기간의 제1 기간에서 상기 제3 스위치를 턴온하여, 상기 복수의 제2 전극의 전압을 상기 제3 전압까지 점진적으로 하강시키는 플라즈마 표시 장치.
  3. 제2항에 있어서,
    상기 제2 구동부는,
    상기 제2 전압을 공급하는 제4 전원에 제1단이 연결되고, 상기 복수의 제2 전극에 제2단이 연결되는 제4 스위치 및
    상기 제3 전원에 제1단이 연결되고, 상기 복수의 제2 전극에 제2단이 연결되는 제5 스위치를 포함하는 플라즈마 표시 장치.
  4. 제3항에 있어서,
    상기 제2 구동부는 상기 제1 전극과 제2 전극 사이에 형성되는 용량성 성분인 패널 커패시터의 무효 전력을 회수하는 전력 회수부를 더 포함하고,
    상기 전력 회수부는,
    상기 복수의 제2 전극에 제1단이 연결되는 인덕터,
    상기 제1 전원에 제1단이 연결되고, 상기 인덕터의 제2단에 제2단이 연결되는 제6 스위치,
    상기 인덕터의 제2단에 제1단이 연결되고, 상기 제1 전원에 제2단이 연결되 는 제7 스위치를 포함하는 플라즈마 표시 장치.
  5. 제4항에 있어서,
    상기 전력 회수부는,
    상기 제6 스위치의 제2단에 애노드가 연결되고 상기 인덕터의 제2단에 캐소드가 연결되는 제1 다이오드,
    상기 제7 스위치의 제1단에 캐소드가 연결되고 상기 인덕터의 제2단에 애노드가 연결되는 제2 다이오드,
    상기 제4 전원에 캐소드가 연결되고 상기 인덕터의 제2단에 애노드가 연결되는 제3 다이오드 및
    상기 제3 전원에 애노드가 연결되고 상기 인덕터의 제2단에 캐소드가 연결되는 제4 다이오드를 더 포함하는 플라즈마 표시 장치.
  6. 제3항에 있어서,
    상기 제2 구동부는,
    상기 제1 전압과 상기 제2 전압 사이의 전압을 충전하고 있는 제5 전원 및 상기 제5 전원과 상기 복수의 제2 전극 사이에 연결되는 제1 인덕터를 포함하는 제1 전력 회수부, 그리고
    상기 제1 전압과 상기 제3 전압 사이의 전압을 충전하고 있는 제6 전원 및 상기 제6 전원과 상기 복수의 제2 전극 사이에 연결되는 제2 인덕터를 포함하는 제 2 전력 회수부를 포함하는 플라즈마 표시 장치.
  7. 제6항에 있어서,
    상기 제1 전력회수부는,
    상기 제5 전원의 제1단에 제1단이 연결되고 상기 제1 인덕터의 제1단에 제2단이 연결되는 제6 스위치 및 상기 제5 전원의 제1단에 제1단이 연결되고 상기 제1 인덕터의 제1단에 제2단이 연결되는 제7 스위치를 더 포함하고,
    상기 제2 전력 회수부는,
    상기 제6 전원의 제1단에 제1단이 연결되고 상기 제2 인덕터의 제1단에 제2단이 연결되는 제8 스위치 및 상기 제6 전원의 제1단에 제1단이 연결되고 상기 제2 인덕터의 제1단에 제2단이 연결되는 제9 스위치를 더 포함하며,
    상기 제1 인덕터의 제2단과 상기 제2 인덕터의 제2단은 상기 복수의 제2 전극에 연결되는 플라즈마 표시 장치.
  8. 제7항에 있어서,
    상기 제1 전력회수부는,
    상기 제5 전원의 제1단에 애노드가 연결되고 상기 제1 인덕터의 제1단에 캐소드가 연결되는 제1 다이오드 및 상기 제5 전원의 제1단에 캐소드가 연결되고 상기 제1 인덕터의 제1단에 애노드가 연결되는 제2 다이오드를 더 포함하고,
    상기 제2 전력회수부는,
    상기 제6 전원의 제1단에 애노드가 연결되고 상기 제2 인덕터의 제1단에 캐소드가 연결되는 제3 다이오드 및 상기 제6 전원의 제1단에 캐소드가 연결되고 상기 제2 인덕터의 제1단에 애노드가 연결되는 제4 다이오드를 더 포함하는 플라즈마 표시 장치.
  9. 제8항에 있어서,
    상기 제1 전력회수부는 상기 제4 전원에 캐소드가 연결되고 상기 제1 인덕터의 제1단에 애노드가 연결되는 제5 다이오드를 더 포함하고,
    상기 제2 전력회수부는 상기 제3 전원에 애노드가 연결되고 상기 제2 인덕터의 제1단에 캐소드가 연결되는 제6 다이오드를 더 포함하는 플라즈마 표시 장치.
  10. 제2항에 있어서,
    상기 제1 구동부는,
    상기 복수의 제1 전극에 각각 연결되고, 각각 제1 노드 또는 제2 노드의 전압을 상기 복수의 제1 전극 중 대응하는 제1 전극에 선택적으로 인가하는 복수의 선택회로 및
    상기 제1 전압보다 높은 제8 전압을 공급하는 제7 전원에 제1단이 연결되고, 상기 제2 스위치의 제2단에 제2단이 연결되며, 상기 제8 전압과 상기 제7 전압 사이의 전압차에 해당하는 제4 전압으로 충전되는 커패시터를 더 포함하는 플라즈마 표시 장치.
  11. 제10항에 있어서,
    상기 제1 구동부는,
    상기 복수의 제1 전극에 캐소드가 연결되는 다이오드 및
    상기 다이오드의 애노드에 제1단이 연결되고, 상기 제2 전원에 제2단이 연결되며, 상기 리셋 기간의 제2 기간에서 턴온하여 상기 복수의 제1 전극의 전압을 상기 제7 전압보다 높은 제9 전압까지 점진적으로 하강시키는 제6 스위치를 더 포함하는 플라즈마 표시 장치.
  12. 제11항에 있어서,
    상기 제9 전압은 상기 제7 전압과 상기 다이오드의 항복전압의 합에 해당하는 플라즈마 표시 장치.
  13. 제3항에 있어서,
    상기 복수의 제2 전극은 동일한 구동파형이 인가되는 공통 전극인 플라즈마 표시 장치.
  14. 제3항에 있어서,
    상기 제3 전압과 상기 제7 전압은 동일한 전압 레벨을 갖는 플라즈마 표시 장치.
  15. 제3항에 있어서,
    상기 제2 전압과 상기 제3 전압은 서로 절대값이 동일하고 반대 위상의 전압 레벨을 갖는 플라즈마 표시 장치.
  16. 복수의 제1 전극 및 상기 복수의 제1 전극과 같은 방향으로 배열되는 복수의 제2 전극을 포함하는 플라즈마 표시 장치의 구동 방법에 있어서,
    유지 기간에서, 제1 전압을 공급하는 제1 전원과 상기 복수의 제1 전극사이에 연결되는 제1 스위치를 턴온하여 상기 복수의 제1 전극을 제1 전압으로 유지한 상태에서, 상기 복수의 제2 전극에 상기 제1 전압보다 높은 제2 전압의 유지방전펄스와 상기 제1 전압보다 낮은 제3 전압의 유지방전펄스를 교대로 인가하는 단계;
    리셋 기간에서, 상기 복수의 제1 전극의 전압을 상기 제1 전압보다 높은 제4 전압으로 유지한 상태에서, 상기 복수의 제2 전극의 전압을 상기 제2 전압까지 점진적으로 하강시키고, 상기 복수의 제2 전극의 전압을 상기 제1 전압보다 높은 제5 전압으로 유지한 상태에서, 상기 복수의 제1 전극의 전압을 상기 제1 전압보다 낮은 제6 전압까지 점진적으로 하강시키는 단계; 및
    어드레스 기간에서, 상기 제1 전압보다 낮은 제7 전압을 공급하는 제2 전원과 상기 복수의 제1 전극사이에 연결되는 제2 스위치를 턴온하여, 상기 복수의 제1 전극에 상기 제7 전압을 순차적으로 인가하는 단계;를 포함하는 플라즈마 표시 장치의 구동 방법.
  17. 제16항에 있어서,
    상기 제1 스위치 및 상기 제2 스위치는 각각 제1단에 애노드가 연결되고 제2단에 캐소드가 연결되는 바디 다이오드를 갖고,
    상기 제1 스위치의 제1단과 상기 제2 스위치의 제2단은 서로 연결되는 플라즈마 표시 장치의 구동 방법.
  18. 제16항에 있어서,
    상기 리셋 기간에서, 상기 제3 전압을 공급하는 제3 전원과 상기 복수의 제2 전극사이에 연결되는 제3 스위치를 턴온하여, 상기 복수의 제2 전극의 전압을 점진적으로 하강시키는 플라즈마 표시 장치의 구동 방법.
  19. 제16항에 있어서,
    상기 제7 전압과 상기 제3 전압은 전압 레벨의 절대값이 동일하게 설정되는 플라즈마 표시 장치의 구동 방법.
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