KR100573125B1 - 안정된 표시-유지 방전을 위한 방전 표시 패널의 구동 방법 - Google Patents

안정된 표시-유지 방전을 위한 방전 표시 패널의 구동 방법 Download PDF

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Abstract

본 발명은, 표시 전극 라인쌍들이 나란하게 형성되고, 어드레스 전극 라인들이 표시 전극 라인쌍들과 이격 및 교차되도록 형성되는 방전 표시 패널에 대하여, 복수의 서브-필드들을 단위 프레임에 포함시켜서 시분할 구동에 의하여 계조 표시를 수행하는 방전 표시 패널의 구동 방법이다. 여기서, 서브-필드들 각각이 어드레싱 시간 및 표시-유지 시간을 포함한다. 어드레싱 시간에서는 선택된 방전 셀들에 설정 벽전위가 생성된다. 표시-유지 시간에서는, 서브-필드들 각각에 설정된 계조 가중값에 비례한 횟수의 방전이 상기 벽전위가 생성된 방전 셀들에서 일어난다. 또한, 표시-유지 시간에서는, 표시 전극 라인쌍들 각각의 두 전극 라인들에 제1 극성의 펄스가 교호하게 인가되고, 시간이 흐를수록 접지 전위까지 점진적으로 낮아지는 제1 극성의 전위가 어드레스 전극 라인들에 인가된다.

Description

안정된 표시-유지 방전을 위한 방전 표시 패널의 구동 방법{Method of driving plat-panel display panel for stabilized display-sustaining discharge}
도 1은 통상적인 방전 표시 패널로서의 3-전극 면방전 방식의 플라즈마 표시 패널의 구조를 보여주는 내부 사시도이다.
도 2는 도 1의 패널의 단위 셀의 구성을 보여주는 단면도이다.
도 3은 본 발명에 따른 구동 방법을 수행하는 도 1의 플라즈마 표시 패널의 구동 장치를 보여주는 블록도이다.
도 4는 본 발명에 따른 플라즈마 표시 패널의 구동 방법에 의한 단위 프레임의 구조를 보여주는 타이밍도이다.
도 5는 도 4의 단위 서브-필드에서 도 1의 플라즈마 표시 패널의 전극 라인들에 인가되는 신호들을 보여준다.
<도면의 주요 부분에 대한 부호의 설명>
1...플라즈마 표시 패널, 10...앞쪽 글라스 기판,
11, 15...유전체층, 12...보호층,
13...뒤쪽 글라스 기판, 14...방전 공간,
16...형광체, 17...격벽,
X1, ..., Xn...X 전극 라인, Y1, ..., Yn...Y 전극 라인,
AR1, ..., ABm...어드레스 전극 라인, Xna, Yna...투명 전극 라인,
Xnb, Ynb...금속 전극 라인, SF1, ...SF8...서브-필드,
52...논리 제어부, 53...어드레스 구동부,
54...X 구동부, 55...Y 구동부,
56...영상 처리부.
본 발명은, 방전 표시 패널의 구동 방법에 관한 것으로서, 보다 상세하게는, 단위 프레임을 복수의 서브필드들로 시분할하여 구동하는 방전 표시 패널의 구동 방법에 관한 것이다.
도 1은 통상적인 방전 표시 패널로서의 3-전극 면방전 방식의 플라즈마 표시 패널의 구조를 보여준다. 도 2는 도 1의 패널의 한 셀의 예를 보여준다. 도 1 및 2를 참조하면, 통상적인 면방전 플라즈마 표시 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(10, 13) 사이에는, 어드레스 전극 라인들(AR1, ..., ABm), 유전체층(11, 15), Y 전극 라인들(Y1, ..., Yn), X 전극 라인들(X1, ..., Xn), 형광체(16), 격벽(17) 및 보호층으로서의 일산화마그네슘(MgO)층(12)이 마련되어 있다.
어드레스 전극 라인들(AR1, ..., ABm)은 뒤쪽 글라스 기판(13)의 앞쪽에 일정한 패턴으로 형성된다. 하부 유전체층(15)은 어드레스 전극 라인들(AR1, ..., ABm )의 앞쪽에서 전면(全面) 도포된다. 하부 유전체층(15)의 앞쪽에는 격벽(17)들이 어드레스 전극 라인들(AR1, ..., ABm)과 평행한 방향으로 형성된다. 이 격벽(17)들은 각 셀의 방전 영역을 구획하고 각 셀 사이의 광학적 간섭(cross talk)을 방지하는 기능을 한다. 형광체(16)는, 격벽(17)들 사이에 도포된다.
X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)은 어드레스 전극 라인들(AR1, ..., ABm)과 직교되도록 앞쪽 글라스 기판(10)의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 셀을 설정한다. 각 X 전극 라인(X1, ..., Xn )과 각 Y 전극 라인(Y1, ..., Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인(도 2의 Xna, Yna)과 전도도를 높이기 위한 금속 전극 라인(도 2의 Xnb, Ynb)이 결합되어 형성된다. 앞쪽 유전체층(11)은 X 전극 라인들(X 1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 보호층(12) 예를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전체층(11)의 뒤쪽에 전면 도포되어 형성된다. 방전 공간(14)에는 플라즈마 형성용 가스가 밀봉된다.
상기와 같은 방전 표시 패널의 구동 방법에 있어서, 통상적으로 복수의 서브-필드들이 단위 프레임에 포함되어 시분할 구동에 의하여 계조 표시가 수행된다(미국 특허 제5,541,618호 참조). 여기서, 단위 프레임의 단위 서브-필드는 리셋, 어드레싱, 및 표시-유지 시간들로 분류된다. 리셋 시간에서는, 모든 방전 셀들의 전하 상태들이 균일해진다. 어드레싱 시간에서는, 선택된 방전 셀들에 설정 벽전위가 생성된다. 표시-유지 시간에서는, 자신에 설정된 계조 가중값에 비례한 횟수의 방전이 상기 벽전위가 생성된 방전 셀들에서 일어난다.
위와 같은 방전 표시 패널의 종래의 구동 방법에 있어서, 상기 표시-유지 시간에서 표시 전극 라인쌍들 각각의 X 전극 라인(X1, ..., Xn) 및 Y 전극 라인(Y 1, ..., Yn)에 제1 극성의 펄스가 교호하게 인가된다. 하지만, 어드레스 전극 라인들(AR1, ..., ABm)의 전위가 적절히 제어되지 못함에 따라, 선택된 방전 셀들에서 일어나는 X 전극과 Y 전극 사이의 표시-유지 방전이 어드레스 전극의 영향에 의하여 불안정해지는 문제점이 있다. 이 불안정을 방지하기 위하여 어드레스 전극 라인들(AR1, ..., ABm)에 상기 제1 극성의 전위를 단순히 인가하는 경우, 다음 서브-필드의 리셋팅 동작이 불안정해지고, 이로 인하여 어드레싱 동작까지 불안정해질 수 있다.
본 발명의 목적은, 현재 서브-필드의 표시-유지 방전을 안정화시키면서도 다음 서브-필드의 동작에 악영향을 미치지 않을 수 있는 방전 표시 패널의 구동 방법을 제공하는 것이다.
상기 목적을 이루기 위한 본 발명은, 표시 전극 라인쌍들이 나란하게 형성되고, 어드레스 전극 라인들이 상기 표시 전극 라인쌍들과 이격 및 교차되도록 형성되는 방전 표시 패널에 대하여, 복수의 서브-필드들을 단위 프레임에 포함시켜서 시분할 구동에 의하여 계조 표시를 수행하는 방전 표시 패널의 구동 방법이다. 여기서, 상기 서브-필드들 각각이 어드레싱 시간 및 표시-유지 시간을 포함한다. 상기 어드레싱 시간에서는 선택된 방전 셀들에 설정 벽전위가 생성된다. 상기 표시-유지 시간에서는, 상기 서브-필드들 각각에 설정된 계조 가중값에 비례한 횟수의 방전이 상기 벽전위가 생성된 방전 셀들에서 일어난다. 또한, 상기 표시-유지 시간에서는, 상기 표시 전극 라인쌍들 각각의 두 전극 라인들에 제1 극성의 펄스가 교호하게 인가되고, 시간이 흐를수록 접지 전위까지 점진적으로 낮아지는 상기 제1 극성의 전위가 상기 어드레스 전극 라인들에 인가된다.
본 발명의 상기 구동 방법에 의하면, 상기 표시-유지 시간에서 상기 제1 극성의 전위가 상기 어드레스 전극 라인들에 인가되므로, 선택된 방전 셀들에서 일어나는 표시 전극들 사이의 표시-유지 방전에 미치는 어드레스 전극의 영향을 방지할 수 있다. 이에 따라, 상기 표시-유지 시간에서의 방전이 안정화될 수 있다. 한편, 상기 표시-유지 시간에서 상기 어드레스 전극 라인들에 인가되는 상기 제1 극성의 전위가 점진적으로 낮아짐에 따라, 상기 표시-유지 시간의 종료 시점에서 상기 어드레스 전극 라인들에 상기 제1 극성과 반대 극성인 제2 극성의 벽전위가 생성되지 않는다. 이에 따라, 다음 서브-필드의 어드레싱 시간에서, 선택된 방전 셀 들의 어드레스 전극들에 생성되는 상기 제1 극성의 벽전위가 낮아지지 않으므로, 현재 서브-필드의 표시-유지 방전이 안정화되면서도 다음 서브-필드의 동작에 악영향이 미치지 않는다.
이하, 본 발명에 따른 바람직한 실시예가 상세히 설명된다. 여기서, 상기 도 1 및 도 2의 설명은 본 발명에서도 동일하게 적용된다.
도 3을 참조하면, 본 발명에 따른 구동 방법을 수행하는 도 1의 플라즈마 표시 패널(1)의 구동 장치는 영상 처리부(56), 논리 제어부(52), 어드레스 구동부(53), X 구동부(54) 및 Y 구동부(55)를 포함한다. 영상 처리부(56)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8 비트의 적색(R), 녹색(G) 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다. 논리 제어부(52)는 영상 처리부(56)로부터의 내부 영상 신호에 따라 구동 제어 신호들(SA, SY, SX)을 발생시킨다. 이하에서 설명될 본 발명에 따른 구동 방법은 이 논리 제어부(52)에 의하여 수행된다. 어드레스 구동부(53)는, 논리 제어부(52)로부터의 구동 제어 신호들(SA, SY, SX)중에서 어드레스 신호(SA)를 처리하여 표시 데이터 신호를 발생시키고, 발생된 표시 데이터 신호를 어드레스 전극 라인들에 인가한다. X 구동부(54)는 논리 제어부(52)로부터의 구동 제어 신호들(SA, SY, SX)중에서 X 구동 제어 신호(SX)를 처리하여 X 전극 라인들에 인가한다. Y 구동부(55)는 논리 제어부(52)로부터의 구동 제어 신호들(SA, SY, SX)중에서 Y 구동 제어 신호(SY)를 처리하여 Y 전극 라인들에 인가한다.
도 4를 참조하여, 본 발명에 따른 플라즈마 표시 패널의 구동 방법에 의한 단위 프레임의 구조를 설명하면 다음과 같다.
모든 단위 프레임들 각각은 시분할 계조 표시를 실현하기 위하여 8 개의 서브-필드들(SF1, ..., SF8)로 분할된다. 또한, 각 서브-필드(SF1, ..., SF8)는 리셋팅 시간(R1, ..., R8), 어드레싱 시간(A1, ..., A8), 및 표시-유지 시간(S1, ..., S8)로 분할된다.
모든 방전 셀들의 방전 조건들은 각 리셋팅 시간(R1, ..., R8)에서 균일해지면서 동시에 다음 단계에서 수행될 어드레싱에 적합해지도록 된다.
각 어드레싱 시간(A1, ..., A8)에서는, 어드레스 전극 라인들(도 1의 AR1, ..., ABm)에 표시 데이터 신호가 인가됨과 동시에 각 Y 전극 라인(Y1, ..., Y n)에 상응하는 주사 펄스가 순차적으로 인가된다. 이에 따라 주사 펄스가 인가되는 동안에 높은 레벨의 표시 데이터 신호가 인가되면 상응하는 방전 셀에서 어드레싱 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전 셀에서는 벽전하들이 형성되지 않는다. 즉, 선택된 방전 셀들에 설정 벽전위가 생성되지만, 선택되지 않은 방전 셀들에는 벽전위가 생성되지 않는다.
각 표시-유지 시간(S1, ..., S8)에서는, 모든 Y 전극 라인들(Y1, ..., Yn)과 모든 X 전극 라인들(X1, ..., Xn)에 제1 극성의 표시-유지용 펄스가 교호하게 인가 되어, 상응하는 어드레싱 시간(A1, ..., A8)에서 벽전하들이 형성된 방전 셀들에서 표시 방전을 일으킨다. 따라서 플라즈마 표시 패널의 휘도는 단위 프레임에서 차지하는 표시-유지 시간(S1, ..., S8)의 길이에 비례한다. 단위 프레임에서 차지하는 표시-유지 시간(S1, ..., S8)의 길이는 255T(T는 단위 시간)이다. 따라서 단위 프레임에서 한 번도 표시되지 않은 경우를 포함하여 256 계조로써 표시할 수 있다.
여기서, 제1 서브-필드(SF1)의 표시-유지 시간(S1)에는 20에 상응하는 시간(1T)이, 제2 서브-필드(SF2)의 표시-유지 시간(S2)에는 21에 상응하는 시간(2T)이, 제3 서브-필드(SF3)의 표시-유지 시간(S3)에는 22에 상응하는 시간(4T)이, 제4 서브-필드(SF4)의 표시-유지 시간(S4)에는 23에 상응하는 시간(8T)이, 제5 서브-필드(SF5)의 표시-유지 시간(S5)에는 24에 상응하는 시간(16T)이, 제6 서브-필드(SF6)의 표시-유지 시간(S6)에는 25에 상응하는 시간(32T)이, 제7 서브-필드(SF7)의 표시-유지 시간(S7)에는 26에 상응하는 시간(64T)이, 그리고 제8 서브-필드(SF8)의 표시-유지 시간(S8)에는 27에 상응하는 시간(128T)이 각각 설정된다.
이에 따라, 8 개의 서브-필드들중에서 표시될 서브-필드를 적절히 선택하면, 어느 서브-필드에서도 표시되지 않는 0(영) 계조를 포함하여 모두 256 계조의 표시가 수행될 수 있다.
한편, 표시-유지 시간들(S1, ..., S8) 각각에 있어서, 점진적으로 낮아지는 상기 제1 극성의 전위가 상기 어드레스 전극 라인들에 인가된다. 이에 따라, 다음과 같은 효과들을 얻을 수 있다.
표시-유지 시간들(S1, ..., S8) 각각에서 상기 제1 극성의 전위가 어드레스 전극 라인들(AR1, ..., ABm)에 인가되므로, 선택된 방전 셀들에서 일어나는 표시 전극들 사이의 표시-유지 방전에 미치는 어드레스 전극의 영향을 방지할 수 있다. 이에 따라, 표시-유지 시간들(S1, ..., S8) 각각에서의 방전이 안정화될 수 있다. 한편, 표시-유지 시간들(S1, ..., S8) 각각에서 어드레스 전극 라인들(AR1, ..., ABm)에 인가되는 상기 제1 극성의 전위가 점진적으로 낮아짐에 따라, 어느 한 표시-유지 시간의 종료 시점에서 어드레스 전극 라인들(AR1, ..., ABm)에 상기 제1 극성과 반대 극성인 제2 극성의 벽전위가 생성되지 않는다. 이에 따라, 다음 서브-필드의 어드레싱 시간에서, 선택된 방전 셀들의 어드레스 전극들에 생성되는 상기 제1 극성의 벽전위가 낮아지지 않으므로, 현재 서브-필드의 표시-유지 방전이 안정화되면서도 다음 서브-필드의 동작에 악영향이 미치지 않는다.
도 5는 도 4의 단위 서브-필드(SF)에서 도 1의 플라즈마 표시 패널(1)의 전극 라인들에 인가되는 신호들을 보여준다. 도 5에서 참조부호 SAR1..ABm은 각 어드레스 전극 라인(도 1의 AR1, AG1, ..., AGm, ABm)에 인가되는 구동 신호를, SX1..Xn은 X 전극 라인들(도 1의 X1, ...Xn)에 인가되는 구동 신호를, 그리고 SY1, ..., SYn은 각 Y 전극 라인(도 1의 Y1, ...Yn)에 인가되는 구동 신호를 가리킨다.
도 1, 4, 및 5를 참조하면, 단위 서브필드(SF)의 리셋팅 시간(R)의 제1 시간(t1 ~ t2)에서는, 먼저 X 전극 라인들(X1, ..., Xn)에 인가되는 전위가 접지 전위(VG)로부터 제1 극성으로서의 정극성의 표시-유지 전위(VS)까지 지속적으로 상승된다. 여기서, Y 전극 라인들(Y1, ..., Yn)과 어드레스 전극 라인들(AR1 , ..., ABm)에는 접지 전위(VG)가 인가된다. 이에 따라, X 전극 라인들(X1, ..., Xn )과 Y 전극 라인들(Y1, ..., Yn) 사이, 및 X 전극 라인들(X1, ..., Xn)과 어드레스 전극 라인들(A1, ..., Am) 사이에 약한 방전이 일어나면서 X 전극 라인들(X1 , ..., Xn) 주위에 제2 극성으로서의 부극성의 벽전하들이 형성된다.
벽전하 축적 시간으로서의 제2 시간(t2 ~ t3)에서는, Y 전극 라인들(Y1 , ..., Yn)에 인가되는 전위가 표시-유지 전위(VS)부터 표시-유지 전위(VS)보다 상승 전위(VSET)만큼 더 높은 제1 전위(VSET+VS)까지 지속적으로 상승된다. 여기서, X 전극 라인들(X1, ..., Xn)과 어드레스 전극 라인들(AR1, ..., ABm )에는 접지 전위(VG)가 인가된다. 이에 따라, Y 전극 라인들(Y1, ..., Yn)과 X 전극 라인들(X1 , ..., Xn) 사이에 약한 방전이 일어나는 한편, Y 전극 라인들(Y1, ..., Yn)과 어드레스 전극 라인들(AR1, ..., ABm) 사이에 더욱 약한 방전이 일어난다. 여기서, Y 전극 라인들(Y1, ..., Yn)과 어드레스 전극 라인들(AR1, ..., ABm ) 사이의 방전보다 Y 전극 라인들(Y1, ..., Yn)과 X 전극 라인들(X1, ..., Xn) 사이의 방전이 더 강해지는 이유는, X 전극 라인들(X1, ..., Xn) 주위에 부극성의 벽전하들이 형성되어 있었기 때문이다. 이에 따라, Y 전극 라인들(Y1, ..., Yn) 주위에는 부극성 벽전하들이 많이 형성되고, X 전극 라인들(X1, ..., Xn) 주위에는 정극성의 벽전하들이 형성되며, 어드레스 전극 라인들(AR1, ..., ABm) 주위에는 정극성의 벽전하들이 적게 형성된다.
벽전하 배분 시간으로서의 제3 시간(t3 ~ t4)에서는, X 전극 라인들(X1 , ..., Xn)에 인가되는 전위가 표시-유지 전위(VS)인 상태에서, Y 전극 라인들(Y1 , ..., Yn)에 인가되는 전위가 표시-유지 전위(VS)로부터 부극성의 주사 전위(VSCAN)까지 지속적으로 하강된다. 여기서, 어드레스 전극 라인들(AR1, ..., ABm)에는 접지 전위(V G)가 인가된다. 이에 따라, X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1 , ..., Yn) 사이의 약한 방전으로 인하여, Y 전극 라인들(Y1, ..., Yn) 주위의 부극성의 벽전하들의 일부가 X 전극 라인들(X1, ..., Xn) 주위로 이동한다. 이에 따라, X 전극 라인들(X1, ..., Xn)의 벽전위(wall electric-potential)가 어드레스 전극 라인들(AR1, ..., ABm)의 벽전위보다 낮고 Y 전극 라인들(Y1, ..., Y n)의 벽전위보다 높아진다. 여기서, 리셋 시간(R)의 종료 시점(t4)에서 모든 어드레스 전극 라인들(AR1, ..., ABm) 주위에 상기 제1 극성으로서의 정극성의 벽전위가 생성되고, X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)에 상기 제2 극성으로서의 정극성의 벽전위가 생성된다.
이에 따라, 이어지는 어드레싱 시간(A)에서 선택된 어드레스 전극 라인들과 Y 전극 라인 사이의 대향 방전에 요구되는 어드레싱 전압이 낮아질 수 있다. 한편, 모든 어드레스 전극 라인들(AR1, ..., ABm)에는 접지 전위(VG)가 인가되므로, 어드레스 전극 라인들(AR1, ..., ABm)은 X 전극 라인들(X1, ..., X n)과 Y 전극 라인들(Y1, ..., Yn)에 대하여 방전을 수행하고, 이 방전으로 인하여 어드레스 전극 라인들(AR1, ..., ABm) 주위의 정극성의 벽전하들이 약간 소멸한다.
이어지는 어드레싱 시간(A)에서, 어드레스 전극 라인들(AR1, ..., ABm)에 표시 데이터 신호들이 인가되고, 표시-유지 전위(VS)보다 낮은 주사-바이어싱 전위(VE)로 바이어싱된 Y 전극 라인들(Y1, ..., Yn)에 부극성의 주사 전위(V SCAN)의 주사 펄스가 순차적으로 인가됨에 따라, 원활한 어드레싱이 수행될 수 있다. 각 어드레스 전극 라인(AR1, ..., ABm)에 인가되는 표시 데이터 신호들에 있어서, 방전 셀을 선택할 경우에 정극성 어드레싱 전위(VA)의 데이터 펄스가, 그렇지 않을 경우에 접지 전위(VG)가 인가된다. 이에 따라 부극성의 주사 전위(VSCAN)의 주사 펄스가 인가되는 동안에 정극성 어드레싱 전위(VA)의 표시 데이터 신호들이 인가되면 상응하는 방전 셀들에서 어드레싱 방전에 의하여 설정 벽전위가 생성되며, 그렇지 않은 방전 셀들에서는 벽전위가 생성되지 않는다. 즉, 어드레싱 시간(A)의 종료 시점에서, 선택된 방전 셀들의 Y 전극들에 상기 제1 극성으로서의 정극성의 벽전위가 생성된다. 한편, 보다 정확하고 효율적인 어드레싱 방전을 위하여, X 전극 라인들(X1, ...Xn)에 표시-유지 전위(VS)가 인가된다.
이어지는 표시-유지 시간(S)에서는, 모든 Y 전극 라인들(Y1, ...Yn)과 X 전극 라인들(X1, ...Xn)에 표시-유지 전위(VS)의 펄스들이 교호하게 인가되어, 상응하는 어드레싱 시간(A)에서 벽전하들이 형성된 방전 셀들에서 표시-유지을 일으킨다. 여기서, 어드레싱 시간(A)의 종료 시점에서 선택된 방전 셀들의 Y 전극들에 상기 제1 극성으로서의 정극성의 벽전위가 생성된 상태이었으므로, 최초로 모든 Y 전극 라인들(Y1, ...Yn)에 상기 제1 극성으로서의 정극성의 펄스가 인가되어야 한다.
한편, 표시-유지 시간(S)에 있어서, 점진적으로 낮아지는 정극성 전위가 모든 어드레스 전극 라인들(AR1, ..., ABm)에 인가된다. 예를 들어, 표시-유지 시간(S)의 시작 시점에서는 상기 데이터 펄스의 정극성 어드레싱 전위(VA)가 모든 어드레스 전극 라인들(AR1, ..., ABm)에 인가되고, 표시-유지 시간(S)의 종료 시점에서는 접지 전위(VG)가 모든 어드레스 전극 라인들(AR1, ..., ABm)에 인가된다. 이에 따라, 다음과 같은 효과들을 얻을 수 있다.
표시-유지 시간(S)에서 정극성의 전위가 어드레스 전극 라인들(AR1, ..., ABm)에 인가되므로, 선택된 방전 셀들에서 일어나는 표시 전극들 사이의 표시-유지 방전에 미치는 어드레스 전극의 영향을 방지할 수 있다. 이에 따라, 표시-유지 시간(S)에서의 방전이 안정화될 수 있다. 한편, 표시-유지 시간(S)에서 어드레스 전극 라인들(AR1, ..., ABm)에 인가되는 정극성의 전위가 점진적으로 낮아짐에 따라, 어느 한 표시-유지 시간의 종료 시점에서 어드레스 전극 라인들(AR1, ..., ABm)에 부극성의 벽전위가 생성되지 않는다. 이에 따라, 다음 서브-필드의 어드레싱 시간에서, 선택된 방전 셀들의 어드레스 전극들에 생성되는 정극성의 벽전위가 낮아지지 않으므로, 현재 서브-필드의 표시-유지 방전이 안정화되면서도 다음 서브-필드의 동작에 악영향이 미치지 않는다.
이상 설명된 바와 같이, 본 발명에 따른 방전 표시 패널의 구동 방법에 의하면, 표시-유지 시간에서 제1 극성의 전위가 어드레스 전극 라인들에 인가되므로, 선택된 방전 셀들에서 일어나는 표시 전극들 사이의 표시-유지 방전에 미치는 어드레스 전극의 영향을 방지할 수 있다. 이에 따라, 표시-유지 시간에서의 방전이 안정화될 수 있다. 한편, 표시-유지 시간에서 어드레스 전극 라인들에 인가되는 상기 제1 극성의 전위가 점진적으로 낮아짐에 따라, 표시-유지 시간의 종료 시점에서 어드레스 전극 라인들에 상기 제1 극성과 반대 극성인 제2 극성의 벽전위가 생성되 지 않는다. 이에 따라, 다음 서브-필드의 어드레싱 시간에서, 선택된 방전 셀들의 어드레스 전극들에 생성되는 상기 제1 극성의 벽전위가 낮아지지 않으므로, 현재 서브-필드의 표시-유지 방전이 안정화되면서도 다음 서브-필드의 동작에 악영향이 미치지 않는다.
본 발명은, 상기 실시예에 한정되지 않고, 청구범위에서 정의된 발명의 사상 및 범위 내에서 당업자에 의하여 변형 및 개량될 수 있다.

Claims (11)

  1. 표시 전극 라인쌍들이 나란하게 형성되고, 어드레스 전극 라인들이 상기 표시 전극 라인쌍들과 이격 및 교차되도록 형성되는 방전 표시 패널에 대하여, 복수의 서브-필드들을 단위 프레임에 포함시켜서 시분할 구동에 의하여 계조 표시를 수행하는 방전 표시 패널의 구동 방법에 있어서,
    상기 서브-필드들 각각이,
    선택된 방전 셀들에 설정 벽전위가 생성되는 어드레싱 시간, 및
    상기 서브-필드들 각각에 설정된 계조 가중값에 비례한 횟수의 방전이 상기 벽전위가 생성된 방전 셀들에서 일어나는 표시-유지 시간을 포함하고,
    상기 표시-유지 시간에서,
    상기 표시 전극 라인쌍들 각각의 두 전극 라인들에 제1 극성의 펄스가 교호하게 인가되고,
    시간이 흐를수록 접지 전위까지 점진적으로 낮아지는 상기 제1 극성의 전위가 상기 어드레스 전극 라인들에 인가되는 방전 표시 패널의 구동 방법.
  2. 제1항에 있어서, 상기 서브-필드들 각각이,
    상기 어드레싱 시간의 시작 전에 모든 방전 셀들의 전하 상태들이 균일해지는 리셋 시간을 더 포함한 방전 표시 패널의 구동 방법.
  3. 제2항에 있어서,
    나란하게 형성된 X 전극 라인과 Y 전극 라인이 상기 표시 전극 라인쌍들 각각에 포함되고,
    상기 리셋 시간의 종료 시점에서,
    상기 Y 전극 라인들의 벽전위가 상기 X 전극 라인들의 벽전위보다 낮고,
    상기 어드레스 전극 라인들의 벽전위가 상기 X 전극 라인들의 벽전위보다 높은 방전 표시 패널의 구동 방법.
  4. 제3항에 있어서, 상기 리셋 시간의 종료 시점에서,
    상기 어드레스 전극 라인들 주위에 상기 제1 극성의 벽전위가 생성되고,
    상기 X 및 Y 전극 라인들에 상기 제1 극성과 반대인 제2 극성의 벽전위가 생성되는 방전 표시 패널의 구동 방법.
  5. 제4항에 있어서, 상기 어드레싱 시간에서,
    상기 제2 극성 전위의 주사 펄스가 상기 Y 전극 라인들에 순차적으로 인가됨과 동시에, 상기 주사 펄스가 인가되는 Y 전극 라인들 각각에 상응하는 표시 데이터 신호들이 상기 어드레스 전극 라인들에 인가되는 방전 표시 패널의 구동 방법.
  6. 제5항에 있어서, 상기 어드레싱 시간에서,
    선택된 어드레스 전극 라인들에 상기 제1 극성 전위의 데이터 펄스가 인가되는 방전 표시 패널의 구동 방법.
  7. 제6항에 있어서, 상기 어드레싱 시간에서,
    선택되지 않은 어드레스 전극 라인들에 접지 전위가 인가되는 방전 표시 패널의 구동 방법.
  8. 제7항에 있어서, 상기 어드레싱 시간의 종료 시점에서,
    선택된 방전 셀들의 상기 Y 전극들에 상기 제1 극성의 벽전위가 생성되는 방전 표시 패널의 구동 방법.
  9. 제8항에 있어서, 상기 표시-유지 시간에서,
    최초로 상기 Y 전극들 모두에 상기 제1 극성의 펄스가 인가되는 방전 표시 패널의 구동 방법.
  10. 제6항에 있어서, 상기 표시-유지 시간의 시작 시점에서,
    상기 데이터 펄스의 전위가 모든 어드레스 전극 라인들에 인가되는 방전 표시 패널의 구동 방법.
  11. 제10항에 있어서, 상기 표시-유지 시간의 종료 시점에서,
    접지 전위가 모든 어드레스 전극 라인들에 인가되는 방전 표시 패널의 구동 방법.
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