KR100402872B1 - Dc-dc 승압 방법 및 그것을 사용한 전원 회로 - Google Patents
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- (a) 클록 신호를 사용하여 입력 전압을 승압하는 것에 의해 승압 전압을 발생하는 스텝과,(b) 상기 승압 전압을 사용하여, 안정화된 동작 전압을 발생하는 스텝과,(c) 상기 승압 전압과 상기 동작 전압 사이의 마진 전압을 검출하는 스텝과,(d) 스텝 (c)에서의 검출 결과에 기초하여, 스텝 (a)에서 사용하는 클록 신호의 주파수를 조정하며, 또는 적어도 1개의 스위칭 소자를 제어하는 클록 신호를 고정하는 스텝을 구비하는 것을 특징으로 하는 DC-DC 승압 방법.
- 제 3 항에 있어서,스텝 (d)가 스텝 (a)에서 사용하는 적어도 1개의 스위칭 소자를 제어하는 클록 신호를 고정하는 것에 의해 스텝 (a)에서의 입력 전압의 승압 배율을 변화시키는 스텝을 포함하는 것을 특징으로 하는 DC-DC 승압 방법.
- 제 4 항에 있어서,스텝 (c)가 상기 마진 전압을 제 1 소정 전압 및 제 2 소정 전압과 비교하는 스텝을 포함하며,스텝 (d)가, 상기 마진 전압이 제 1 소정 전압보다도 클 때에 승압 배율을 1단계 내리는 스텝과, 상기 마진 전압이 제 1 소정 전압보다도 작고 제 2 소정 전압보다도 클 때에 클록 신호의 주파수를 1단계 내리는 스텝과, 상기 마진 전압이 제 2 소정 전압보다도 작을 때에 클록 신호의 주파수를 1단계 올리든지 또는 승압 배율을 1단계 올리는 스텝을 포함하는 것을 특징으로 하는 DC-DC 승압 방법.
- 제 4 항에 있어서,스텝 (c)가 상기 마진 전압을 제 1에서 제 3까지의 소정 전압과 비교하는 스텝을 포함하며,스텝 (d)가, 상기 마진 전압이 제 1 소정 전압보다도 클 때에 승압 배율을 1단계 내리는 스텝과, 상기 마진 전압이 제 1 소정 전압보다도 작고 제 2 소정 전압보다도 클 때에 클록 신호의 주파수를 1단계 내리는 스텝과, 상기 마진 전압이 제 2 소정 전압보다도 작고 제 3 소정 전압보다도 클 때에 승압 배율과 클록 신호의 주파수를 유지하는 스텝과, 상기 마진 전압이 제 3 소정 전압보다도 작을 때에 클록 신호의 주파수를 1단계 올리든지 또는 승압 배율을 1단계 올리는 스텝을 포함하는 것을 특징으로 하는 DC-DC 승압 방법.
- 입력 전압이 공급되고, 클록 신호를 사용하여 입력 전압을 승압하는 것에 의해 승압 전압을 발생하는 승압 회로와,상기 승압 회로가 발생하는 승압 전압을 적어도 1개의 소정 전압과 비교하는 비교 회로와,상기 비교 회로의 비교 결과에 기초하여, 상기 승압 회로가 사용하는 클록 신호의 주파수를 조정하며, 또는 적어도 1개의 스위칭 소자를 제어하는 클록 신호를 고정하는 승압 클록 조정 회로를 구비하는 것을 특징으로 하는 전원 회로.
- 제 7 항에 있어서,상기 승압 클록 조정 회로가, 상기 승압 회로가 사용하는 적어도 1개의 스위칭 소자를 제어하는 클록 신호를 고정하는 것에 의해 상기 승압 회로에 있어서의 입력 전압의 승압 배율을 변화시키는 것을 특징으로 하는 전원 회로.
- 입력 전압이 공급되고, 클록 신호를 사용하여 입력 전압을 승압하는 것에 의해 승압 전압을 발생하는 승압 회로와,상기 승압 회로가 발생하는 승압 전압을 사용하여, 안정화된 동작 전압을 발생하는 전압 조정 회로와,상기 승압 회로가 발생하는 승압 전압과 상기 전압 조정 회로가 발생하는 동작 전압 사이의 마진 전압을 검출하는 검출 회로와,상기 검출 회로의 검출 결과에 기초하여, 상기 승압 회로가 사용하는 클록 신호의 주파수를 조정하며, 또는 적어도 1개의 스위칭 소자를 제어하는 클록 신호를 고정하는 승압 클록 조정 회로를 구비하는 것을 특징으로 하는 전원 회로.
- 제 9 항에 있어서,상기 승압 클록 조정 회로가, 상기 승압 회로가 사용하는 적어도 1개의 스위칭 소자를 제어하는 클록 신호를 고정하는 것에 의해 상기 승압 회로에 있어서의 입력 전압의 승압 배율을 변화시키는 것을 특징으로 하는 전원 회로.
- 제 10 항에 있어서,상기 검출 회로가 상기 마진 전압을 제 1 소정 전압 및 제 2 소정 전압과 비교하고,상기 승압 클록 조정 회로가, 상기 마진 전압이 제 1 소정 전압보다도 클 때에 승압 배율을 1단계 내리고, 상기 마진 전압이 제 1 소정 전압보다도 작고 제 2소정의 전압보다도 클 때에 클록 신호의 주파수를 1단계 내리며, 상기 마진 전압이 제 2 소정 전압보다도 작을 때에 클록 신호의 주파수를 1단계 올리든지 또는 승압 배율을 1단계 올리도록, 클록 신호의 진폭 또는 주파수를 조정하는 것을 특징으로 하는 전원 회로.
- 제 10 항에 있어서,상기 검출 회로가 상기 마진 전압을 제 1에서 제 3까지의 소정 전압과 비교하고,상기 승압 클록 조정 회로가, 상기 마진 전압이 제 1 소정 전압보다도 클 때에 승압 배율을 1단계 내리고, 상기 마진 전압이 제 1 소정 전압보다도 작고 제 2 소정 전압보다도 클 때에 클록 신호의 주파수를 1단계 내리며, 상기 마진 전압이 제 2 소정 전압보다도 작고 제 3 소정 전압보다도 클 때에 승압 배율과 클록 신호의 주파수를 유지하며, 상기 마진 전압이 제 3 소정 전압보다도 작을 때에 클록 신호의 주파수를 1단계 올리든지 또는 승압 배율을 1단계 올리도록, 클록 신호의 진폭 또는 주파수를 조정하는 것을 특징으로 하는 전원 회로.
- 제 7 항 내지 제 12 항 중 어느 한 항에 있어서,콘덴서와, 복수의 저항과, 상기 승압 클록 조정 회로로부터 출력되는 복수의 제어 신호에 따라서 상기 복수의 저항의 접속을 변화시키는 복수의 스위치 회로를 포함하며, 가변 주파수의 클록 신호를 발생하여 상기 승압 회로에 공급하는 승압클록 발생 회로를 더 구비하는 것을 특징으로 하는 전원 회로.
- 제 7 항 내지 제 12 항 중 어느 한 항에 있어서,상기 승압 회로에 포함되고, 상부 전극과 하부 전극에 제 1 위상으로 신호가 인가되는 적어도 1개의 콘덴서와, 상부 전극과 하부 전극에 제 1 위상과 반대인 제 2 위상으로 신호가 인가되는 적어도 1개의 콘덴서가 반도체 기판 내에 M×N의 체크 형상(M, N은 자연수)으로 배치된 것을 특징으로 하는 전원 회로.
- 제 13 항에 있어서,상기 승압 회로에 포함되고, 상부 전극과 하부 전극에 제 1 위상으로 신호가 인가되는 적어도 1개의 콘덴서와, 상부 전극과 하부 전극에 제 1 위상과 반대인 제 2 위상으로 신호가 인가되는 적어도 1개의 콘덴서가 반도체 기판 내에 M×N의 체크 형상(M, N은 자연수)으로 배치된 것을 특징으로 하는 전원 회로.
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