JPS6395892A - インバ−タの制御装置 - Google Patents

インバ−タの制御装置

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Publication number
JPS6395892A
JPS6395892A JP61240691A JP24069186A JPS6395892A JP S6395892 A JPS6395892 A JP S6395892A JP 61240691 A JP61240691 A JP 61240691A JP 24069186 A JP24069186 A JP 24069186A JP S6395892 A JPS6395892 A JP S6395892A
Authority
JP
Japan
Prior art keywords
inverter
signal
phase
circuit
current
Prior art date
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Pending
Application number
JP61240691A
Other languages
English (en)
Inventor
Naohide Tsuchimoto
直秀 土本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP61240691A priority Critical patent/JPS6395892A/ja
Publication of JPS6395892A publication Critical patent/JPS6395892A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野コ この発明は、電動機の可変速運転を行なうインバータの
制御装置に関するものである。
[従来の技術] 第4図は従来のインバータの制御装置を示す電気回路図
であり、この第4図において、1は速度指令信号N傘を
受けて電圧指令信号vネと周波数指令信号f*とを作成
するV/f制御回路、2は各信号y*、f傘からU、V
、W各相のオンオフ信号U、V、Wを作成するパルス幅
変調(PWM)信号作成回路、3a、3b、3cは各相
のオンオフ信号に短絡防止時間を設けた信号を作成する
短絡防止時間作成回路、4は短絡防止時間作成回路3a
3b、3cに駆動され電動機(交流機)5を駆動するた
めの上下トランジスタ(上下スイッチング素子)UP、
VP、WP ;UN、VN、WNを有する6相トランジ
スタインバータである。
次に動作について説明する。V/f制御回路1によって
速度指令信号Nネから電圧指令信号7本および周波数指
令信号f傘を作成する。ついで、パルス幅変調信号作成
回路2により各信号v*、f串からU、V、W各相のオ
ンオフ信号を作成し、例えばU相については、短絡防止
時間作成回路3aによりU相信号Uから上下トランジス
タUP、[JNのオンオフ信号U÷、U−を作成する。
この短絡防止時間作成回路3aの入出力信号波形を第5
図(a)〜(c)に示す。第5図(a)はパルス幅変調
信号作成回路2からのU相信号Uの波形図、第5図(b
)は短絡防止時間作成回路3aからの上トランジスタU
Pのオンオフ信号U1の波形図であり、この信号U+は
U相信号Uの立ち上がりをTdだけ遅らせたものである
。また、第5図(c)は下トランジスタUNのオンオフ
信号U−の波形図であり、この信号U−はU相信号Uを
反転した信号の立ち上がりをTdだけ遅らせたものであ
る。
ここで時間Tdは、上下トランジスタUP、UNが短絡
しないように、通常トランジスタのオフ時の遅れ時間よ
り少し長い時間が選ばれる。なお、第4図に示すv、W
相開の短絡防止時間作成回路3b、3cの入出力波形も
ほぼ同様である。そして上記のようなオンオフ信号を6
相トランジスタインバータ4の上下トランジスタが受け
てスイッチング動作を行なうことにより電動機5が駆動
される。
[発明が解決しようとする問題点] 従来のこのようなインバータの制御装置は、以上のよう
に構成されているので、トランジスタオフ時の遅れ時間
Tdにより上下トランジスタが短終するのを防止してい
るため、短絡防止時間を設ける必要があり、これにより
不安定現象を引き起こすおそれがあるなどの問題点があ
った。
この発明は上記のような問題点を解消、するためになさ
れたもので、インバータを構成する上下スイッチング素
子の短絡を防止するとともに不安定現象を引き起こすこ
とのないインバータの制御装置を得ることを目的とする
[問題点を解決するための手段] この発明に係るインバータの制御装置は、インバータの
出力電流の方向を検出して、この出力電流の方向に基づ
いて、上下スイッチング素子をオンオフ制御するように
したものである。
[作 用] この発明におけるインバータの制御装置は、電流方向検
出回路によってインバータ出力電流の方向が検出され、
その後制御回路によってこの出力電流の方向に基づき上
下スイッチング素子が制御される。
[発明の実施例] 以下、この発明の一実施例を図について説明する。第1
図において、1は速度指令信号N傘を、受けて電圧指令
信号vlと周波数指令信号f傘とを作成するV/f制御
回路、2は各信号V”、f”からU、V、W各相のオン
オフ信号U、V、Wを作成するパルス幅変調(PWM)
信号作成回路、6a。
6b、6cはU、V、W各相の電流方向を検出する電流
方向検出回路、13a、13b、13cはパルス幅変調
信号作成回路2からの各相のオンオフ信号U、V、Wと
電流方向検出回路6a、6b。
6cからの電流方向検出信号SU、SV、SWとから電
動機5を駆動するための6相トランジスタインバータ4
を構成する上下トランジスタUP。
VP、WP ; UN、VN、WNへ(71オンオフ信
号U”l V”、W”; U−I V−、W−を作成す
るオンオフ信号作成回路である。
次に動作について説明する。V/f制御回路1によって
速度指令信号N傘から電圧指令信号V傘と周波数指令信
号f*とを作成し、パルス幅変調信号作成回路2により
各信号y*、f*から各相のオンオフ信号U、V、Wを
作成する。ついで、例えばU相については、U相の電流
方向検出回路6aによりU相の電流方向を検出する。こ
の電流方向検出回路6aは、出力電流IUがインバータ
4から電動機5へ流れ込む正電流の場合にHレベルの電
流方向検出信号SUを出力し、出力電流IUが電動機5
からインバータ4へ流れ込む負電流の場合にLレベルの
電流方向検出信号SUを出力するものである。第2図(
a)に出力電流IUの波形図を示し、第2図(b)に電
流方向検出信号SUの波形図を示す。なお、第1図の電
流方向検出回路6b、6cも同様にして出力電流IV;
 IWから検出信号sv、swを出力する。
そして、U相のオンオフ信号作成回路13aは、U相の
オンオフ信号Uと出力電流方向検出信号SUにより上下
トランジスタUP、UNのオンオフ信号U+、U−を作
成する。このオンオフ信号作成回路13aの入出力波形
を第3図(a)〜(d)に示す。第3図(a)はパルス
幅変調信号作成回路2からのU相信号Uの波形図、第3
図(b)はU相の電流方向検出信号SUの波形図、第3
図(c)は上トランジスタUPのオンオフ信号U+の波
形図であり、この信号U+がHレベルの場合、即ちU相
の出力電流方向が正電流の場合は、上トランジスタUP
のみオンオフさせる。また第3図(d)は下トランジス
タUNのオンオフ信号U−の波形図であり、この信号U
′″がLレベルの場合、即ちU相の出力電流方向が負電
流の場合は、下トランジスタUNのみオンオフさせる。
なお、第1図に示すv、W相開のオンオフ信号作成回路
13b。
13cの入出力波形もほぼ同様である。そして上記のよ
うなオンオフ信号を6相トランジスタインバータ4の上
下トランジスタが受けてスイッチング動作を行なうこと
により電動機5が駆動される。
なお、上記実施例では、6相トランジスタインバータの
制御装置を示したが、12.18,24相トランジスタ
インバータの制御装置にも同様にして適用が可能である
またスイッチング素子としてはトランジスタのほかGT
O,サイリスタ、FET等でもよい。
[発明の効果コ 以上のように、この発明によれば、インバータの出力電
流の方向を検出して、この出力電流の方向に基づいて、
上下スイッチング素子をオンオフ制御するように構成し
たので、従来のように短絡防止時間を設けなくても上下
スイッチング素子の短絡を防止することができ、更には
不安定現象も引き起こさないという効果がある。
【図面の簡単な説明】
第1〜3図はこの発明の一実施例によるイン1<−タの
制御装置を示すもので、第1図はその電気回路図、第2
図はその出力電流方向検出回路の動作を説明するための
波形図、第3図はそのオンオフ信号作成回路の動作を説
明するための波形図であり、第4,5図は従来のインバ
ータの制御装置を示すもので、第4図はその電気回路図
、第5図はその短絡防止時間作成回路の動作を説明する
ための波形図である。 図において、1−V/f制御回路、2−・−パルス幅変
調信号作成回路、4−6相トランジスタインバータ、5
−・−電動機、6a、6b、6cm電流方向検出回路、
13a、13b、13cmオンオフ信号作成回路。 なお、図中、同一符号は同一、又は相当部分を示す。

Claims (1)

    【特許請求の範囲】
  1. 電動機の可変速運転を行なうべく上下スチツチング素子
    を有するインバータにおいて、同インバータの出力電流
    の方向を検出する電流方向検出回路をそなえ、同電流方
    向検出回路によつて検出された上記出力電流の方向に基
    づき上記上下スイッチング素子をオンオフ制御する制御
    回路が設けられたことを特徴とするインバータの制御装
    置。
JP61240691A 1986-10-08 1986-10-08 インバ−タの制御装置 Pending JPS6395892A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP61240691A JPS6395892A (ja) 1986-10-08 1986-10-08 インバ−タの制御装置

Applications Claiming Priority (1)

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JP61240691A JPS6395892A (ja) 1986-10-08 1986-10-08 インバ−タの制御装置

Publications (1)

Publication Number Publication Date
JPS6395892A true JPS6395892A (ja) 1988-04-26

Family

ID=17063270

Family Applications (1)

Application Number Title Priority Date Filing Date
JP61240691A Pending JPS6395892A (ja) 1986-10-08 1986-10-08 インバ−タの制御装置

Country Status (1)

Country Link
JP (1) JPS6395892A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0322889A (ja) * 1989-06-16 1991-01-31 Toyo Electric Mfg Co Ltd インバータ制御装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0322889A (ja) * 1989-06-16 1991-01-31 Toyo Electric Mfg Co Ltd インバータ制御装置

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