JPS63942B2 - - Google Patents

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Publication number
JPS63942B2
JPS63942B2 JP53066400A JP6640078A JPS63942B2 JP S63942 B2 JPS63942 B2 JP S63942B2 JP 53066400 A JP53066400 A JP 53066400A JP 6640078 A JP6640078 A JP 6640078A JP S63942 B2 JPS63942 B2 JP S63942B2
Authority
JP
Japan
Prior art keywords
wafer
mask
alignment
pattern
alignment mark
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP53066400A
Other languages
English (en)
Other versions
JPS54157478A (en
Inventor
Kazuhisa Okutsu
Katsumi Momose
Ryozo Hiraga
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Canon Inc
Original Assignee
Canon Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Canon Inc filed Critical Canon Inc
Priority to JP6640078A priority Critical patent/JPS54157478A/ja
Publication of JPS54157478A publication Critical patent/JPS54157478A/ja
Priority to US06/521,016 priority patent/US4530604A/en
Publication of JPS63942B2 publication Critical patent/JPS63942B2/ja
Granted legal-status Critical Current

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Classifications

    • GPHYSICS
    • G03PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
    • G03FPHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
    • G03F9/00Registration or positioning of originals, masks, frames, photographic sheets or textured or patterned surfaces, e.g. automatically
    • G03F9/70Registration or positioning of originals, masks, frames, photographic sheets or textured or patterned surfaces, e.g. automatically for microlithography
    • G03F9/7073Alignment marks and their environment
    • G03F9/7076Mark details, e.g. phase grating mark, temporary mark

Landscapes

  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)
  • Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)

Description

【発明の詳細な説明】 本発明はIC、LSI等の回路素子を製造する際に
使用されるフオト・マスクとウエハーのアライメ
ント方法に関するものである。
通常、マスクとウエハーのアライメントはマス
クに設けられたアライメントマークとウエハーに
設けられたアライメントマークとを所定の位置関
係に導くことによつてマスクの実素子パターンと
ウエハーの実素子パターンとのアライメントを行
なつている。この際マスクの実素子パターン及び
アライメントマークはフオト・リピータによつて
マスクに形成される。すなわち、第1図に示すマ
スク1の実素子パターン2は第2図々示の実素子
パターン用レチクル4をステツプ・アンド・リピ
ート方法で記録し、このレチクル4を第3図々示
のアライメントマーク用のレチクル5に交換して
アライメントマーク3を記録する。この際、実素
子パターン用のレチクル4をアライメントマーク
用のレチクル5と交換する為、実素子パターン2
とアライメントマーク3の間に1〜3μm位の位置
誤差が生じる可能性が有る。従つて、実素子パタ
ーン2とアライメントマーク3の間に位置誤差が
有つた場合、マスクのアライメントマークとウエ
ハーのアライメントマークによつてマスク、ウエ
ハーのアライメントを正確に行なつたとしても、
マスクの実素子パターンとウエハーの実素子パタ
ーンの間にはアライメント誤差が生じてしまう。
この為、従来は1枚、1枚のウエハーに対し、
マスクとウエハーのアライメントマークを整合し
た後、マスクの実素子パターンとウエハーの実素
子パターンとを比較して実素子パターンとアライ
メントマークのずれ量を検出し、このずれ量に基
づきマスク、ウエハーの少なくとも1方を平行移
動させ、マスクの実素子パターンとウエハーの実
素子パターンとを整合させている。
この様に従来のアライメント方法は、1枚、1
枚のウエハーに対して整合しずらいマスク、ウエ
ハーの実素子パターンの整合を行なつている為、
作業が非常に困難であるという欠点を有してい
る。
従つて、本発明の方法はマスクと第1のウエハ
ーのアライメントマークの整合を行なつた後、マ
スクのキーパターンと第1のウエハーのキーパタ
ーンの不整合量を検出し、第1のウエハーを第2
のウエハーと交換し、アライメントマークによつ
てマスクと第2のウエハーのアライメントを行な
つた後この不整合量に基づいて補正するこによつ
てこの欠点を解消している。この際、実素子パタ
ーンと実質的に位置ずれの無いキーパターンは、
先に述べたフオト・リピータでマスク作成の際、
レチクルに実素子パターンと無関係のキーパター
ンを記録しておくことによつて得られる。このキ
ーパターンは実素子パターンの空白部に記録され
るものである為、非常に小さいものとなる。従つ
て、このキーパターンを最初から整合することは
非常に困難が伴う。従つて、比較的大なるアライ
メントマークで粗整合を行ない、キーパターンに
よつて粗整合を行なうことはこの困難性を解決す
るものである。
尚、実素子パターンの空白部に比較的小なるア
ライメントマークを設けたマスク、ウエハーは米
国特許3796497に示されている。しかしながらこ
のマスク、ウエハーのアライメント方法は比較的
大なるアライメントマークを整合した後、比較的
小なるキーパターンによつて更に整合するもので
はない、又更にこのアライメント方法は本願の如
く、比較的大なるアライメントマークを整合後、
前述のキーパターンのずれ量を検出することによ
つて実素子パターンのずれ量を検出し、この検出
値を基に、次なるウエハーのアライメントマーク
とマスクのアライメントマークを整合した際補正
し、実素子パターンの整合を行なつたことについ
ては何等述べていない。
以下本発明を添付した図面を使用して説明す
る。
第1図は従来のマスクを示す図である。マスク
1は複数個の実素子パターン2及びアライメント
マーク3を有している、そしてこのマスクは第2
図に4で示す実素子パターン用のレチクル、及び
第3図に5で示すアライメントマーク用レチクル
をホト・リピータで縮小記録することによつて作
製される。この際、先に述べた様にアライメント
マーク用レチクル5をホト・リピータでマスク上
に記録する際、実素子パターン用レチクルと交換
する為、交換誤差が生じてしまう。
この為、実素子パターン2とアライメントマー
ク3は所定位置関係に無い場合が生じてしまう。
又、ウエハーは同様に作製したマスクの像を焼
き込んだものである為、やはり実素子パターンと
アライメントマークは所定位置関係に無い場合が
有る。従つて、マスクとウエハーのアライメント
マークを整合しても、マスクとウエハーの実素子
パターンは整合している保証は無い、この為、従
来は先に述べた通り、マスクとウエハーのアライ
メントマークを整合した後、マスクとウエハーの
実素子パターンのずれ量を検出し、整合を行なつ
ている。
第4図には本発明の方法で適用するマスクが示
されている。このマスク6には第1図のマスク1
と同様に複数個の実素子パターン2を有してい
る。しかしながら、この実素子パターンの夫々は
この実素子パターン2に位置ずれなく設けられた
キーパターン7を有している。この実素子パター
ン2及びキーパターン7は第5図に示す実素子パ
ターン用レチクル8及び第3図のアライメントマ
ーク用のレチクル5を使用してホト・リピータで
作製される。第5図に示した実素子パターン用レ
チクル8は第2図のレチクルとほぼ同様である
が、キーパターン7が実素子パターンの余白部に
形成されている点が異なつている。このキーパタ
ーン7の実素子に対する位置精度はレチクル上で
1μm以内であり、このレチクル7はホトマスク作
製の際、1/10程度に縮小される為、ホトマスク6
上ではキーパターンの実素子に対する位置精度は
0.1μm以内となり、実素子との位置ずれは等倍焼
付の際はほとんど無視出来る誤差である。従つ
て、ホトマスク6の実素子パターン2とキーパタ
ーン7は実質的に位置ずれが無いと言える。
次にウエハーについて説明する。第4図のマス
クと整合されるウエハーは一枚のマスクが焼付け
られたもの、若しくは複数枚のマスクが焼付けら
れたものの2通りが考えられるが、説明を簡単に
する為、以下の説明では1枚のマスクが焼付けら
れている場合について説明する。
第4図のマスク6に整合されるウエハーは、第
4図に示したマスク6と同様の方法で作成された
マスクが既に記録されたものである。すなわち、
既に記録されたマスクは第5図の実素子パターン
用のレチクル8及び第3図のアライメントマーク
用のレチクル5と、実素子パターンが異なり、か
つアライメントマーク3、及びキーパターン7が
第6図に実線で示す形状をしたマーク9にそれぞ
れ置き換えてある点以外まつたく同様のレチクル
を使用して同様の方法で作製したものである。
そして、マスク、ウエハーのアライメントマー
ク、及びキーパターンの整合状態は第6図に示す
様に、ウエハーのアライメントマーク、若しくは
キーパターン9に対してマスクのアライメントマ
ーク3,7が中間に位置した状態である。従つ
て、まず、マスクとウエハーのアライメントマー
クを整合した後、キーパターンを整合すればマス
ク、ウエハーの実素子パターンは整合状態にな
る。又、マスク、ウエハーのアライメントマーク
を整合後、マスク、ウエハーのキーパターンの不
整合量を検出し、これを記憶装置によつて記憶す
ることによつて、次なるウエハーとマスクを整合
する際、マスク、ウエハーのアライメントマーク
を整合後、その記憶値に基づいて、マスク、ウエ
ハーのどちらか一方をx、y、e平行移動させる
ことによつて実素子パターンの整合をキーパター
ンを整合することなく行ない得る。
又、このアライメントマーク及びキーパターン
を読み取る際、本件出願人が先に提案した特願昭
52―26304号に示されている装置を使用して、第
6図の走査線10に沿つて光電的に読み取ること
が望ましい。即ちキーパターンの不整合量は特願
昭52―26304号に記載の走査型光検出装置を任意
の実素子位置上にくるように設け、アライメント
マークによる整合終了後第6図の走査線10で示
されるようにレーザースポツトを走査させてキー
パターン7とマーク9からの散乱光を光電検出し
てこの信号を特願昭52―26304号記載の移動量計
算回路で処理する事で求めるのがよい。
【図面の簡単な説明】
第1図は従来のマスクを示す図、第2図は第1
図のマスクを作製する為の実素子パターン用レチ
クルを示す図、第3図は第1図のマスクを作製す
る為のアライメントマーク用レチクルを示す図、
第4図は本発明の方法で使用するマスクを示す
図、第5図は第4図のマスクを作製する為のレチ
クルを示す図、第6図はマスクとウエハーのアラ
イメントマークを示す図である。 図中、1,6はマスク、2は実素子パターン、
3はアライメントマーク、4,5,8はレチク
ル、7はキーパターンである。

Claims (1)

  1. 【特許請求の範囲】 1 フオト・マスク上に設けられた粗アライメン
    ト用の第1アライメントマークと第1ウエハー上
    に設けられた粗アライメント用の第2アライメン
    トマークとの整合を行つた後、フオトマスク上に
    設けられた微アライメント用の第1キーパターン
    と第1ウエハー上に設けられた微アライメント用
    の第2キーパターンとの不整合量を検出して記憶
    し、前記第1ウエハーを、前記第1ウエハーの第
    2アライメントマーク・第2キーパターン間位置
    関係と実質的に同じ関係の第2アライメントマー
    クと第2キーパターンとを有する第2ウエハーと
    交換し、前記フオトマスクと前記第2ウエハーと
    を、前記第1アライメントマークと、前記第2ウ
    エハー上に設けられた第2アライメントマークと
    を用いて整合し、かつ前記第1キーパターンと前
    記第2ウエハー上の第2キーパターンとの位置関
    係を前記記憶された不整合量に基づいて補正する
    ことを特徴とするアライメント方法。 2 前記第1及び第2キーパターンとして、夫々
    マスク、ウエハー上の実素子パターンと実質的に
    位置ずれのないよう設けられているパターンを用
    いることを特徴とする特許請求の範囲第1項記載
    のアライメント方法。
JP6640078A 1978-06-01 1978-06-01 Alignment method Granted JPS54157478A (en)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP6640078A JPS54157478A (en) 1978-06-01 1978-06-01 Alignment method
US06/521,016 US4530604A (en) 1978-06-01 1983-08-08 Method of aligning a mask and a wafer for manufacturing semiconductor circuit elements

Applications Claiming Priority (1)

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JP6640078A JPS54157478A (en) 1978-06-01 1978-06-01 Alignment method

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Publication Number Publication Date
JPS54157478A JPS54157478A (en) 1979-12-12
JPS63942B2 true JPS63942B2 (ja) 1988-01-09

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ID=13314717

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JP (1) JPS54157478A (ja)

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US4530604A (en) 1985-07-23
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