JPS6379184A - 表示制御装置 - Google Patents
表示制御装置Info
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- JPS6379184A JPS6379184A JP61223549A JP22354986A JPS6379184A JP S6379184 A JPS6379184 A JP S6379184A JP 61223549 A JP61223549 A JP 61223549A JP 22354986 A JP22354986 A JP 22354986A JP S6379184 A JPS6379184 A JP S6379184A
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- JP
- Japan
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- window
- display
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- 238000000034 method Methods 0.000 description 13
- 238000001514 detection method Methods 0.000 description 3
- 101710130550 Class E basic helix-loop-helix protein 40 Proteins 0.000 description 2
- 102100025314 Deleted in esophageal cancer 1 Human genes 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/14—Digital output to display device ; Cooperation and interconnection of the display device with other functional units
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
- G09G5/14—Display of multiple viewports
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Human Computer Interaction (AREA)
- General Engineering & Computer Science (AREA)
- Digital Computer Display Output (AREA)
- Controls And Circuits For Display Device (AREA)
- Image Generation (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野コ
この発明は、表示制御技術さらにはマルチウィンドウ制
御方式に適用して特に有効な技術に関し、例えばグラフ
ィック・コントローラのような表示制御装置に利用して
有効な技術に関する。
御方式に適用して特に有効な技術に関し、例えばグラフ
ィック・コントローラのような表示制御装置に利用して
有効な技術に関する。
[従来の技術]
従来、例えばグラフィック表示システムにおいて、表示
画面上に複数のウィンドウを表示させるマルチウィンド
ウ制御方式として、ソフトウェアウィンドウ方式とハー
ドウェアウィンドウ方式とが提案されている。
画面上に複数のウィンドウを表示させるマルチウィンド
ウ制御方式として、ソフトウェアウィンドウ方式とハー
ドウェアウィンドウ方式とが提案されている。
このうち、ハードウェアウィンドウ方式は、表示コント
ローラLSIにマルチウィンドウ制御機能を持たせたも
のである。また、ソフトウェアウィンドウ方式は、フレ
ームバッファ内で矩形領域を転送するビットビルトと呼
ばれる機能を、ソフトウェアで実行してマルチウィンド
ウ表示させるものである(マルチウィンドウ制御に関し
ては、日経マグロウヒル社発行、1986年7月14日
号(No、399)第115頁〜132頁参照)。
ローラLSIにマルチウィンドウ制御機能を持たせたも
のである。また、ソフトウェアウィンドウ方式は、フレ
ームバッファ内で矩形領域を転送するビットビルトと呼
ばれる機能を、ソフトウェアで実行してマルチウィンド
ウ表示させるものである(マルチウィンドウ制御に関し
ては、日経マグロウヒル社発行、1986年7月14日
号(No、399)第115頁〜132頁参照)。
[発明が解決しようとする問題点コ
従来のマルチウィンドウ制御にあっては、ハードウェア
方式の方が表示速度は早いが、ウィンドウの優先順位が
固定であるなど表示画面上での表示の自由度が低い。一
方、ソフトウェア方式はウィンドウ数が多いなど表示画
面の自由度は高いが表示速度が非常に遅いという問題点
があった。
方式の方が表示速度は早いが、ウィンドウの優先順位が
固定であるなど表示画面上での表示の自由度が低い。一
方、ソフトウェア方式はウィンドウ数が多いなど表示画
面の自由度は高いが表示速度が非常に遅いという問題点
があった。
この発明の目的は、表示画面の自由度が高く。
しかも高速表示可能なマルチウィンドウ制御技術を提供
することにある。
することにある。
この発明の前記ならびにそのほかの目的と新規な特徴に
ついては1本明細書の記述および添附図面から明らかに
なるであろう。
ついては1本明細書の記述および添附図面から明らかに
なるであろう。
[問題点を解決するための手段]
本願において開示される発明のうち代表的なものの概要
を説明すれば、下記のとおりである。
を説明すれば、下記のとおりである。
すなわち、自己の管理下で制御したいウィンドウの数だ
け、表示画面上での表示開始位置および終了位置を設定
するレジスタとアドレス比較器を有するウィンドウ管理
回路およびアドレス演算回路を設け、ウィンドウごとに
表示アドレスの演算を行なえるようにするとともに、各
ウィンドウの優先度を設定するためのレジスタを有しこ
のレジスタの内容に基づいて優先度を判定して上記アド
レス演算回路でそれぞれ演算されている表示アドレスの
うち優先度の高いウィンドウに対応するものを出力させ
る制御信号を形成するウィンドウ表示優先度指定回路を
設けるものである。
け、表示画面上での表示開始位置および終了位置を設定
するレジスタとアドレス比較器を有するウィンドウ管理
回路およびアドレス演算回路を設け、ウィンドウごとに
表示アドレスの演算を行なえるようにするとともに、各
ウィンドウの優先度を設定するためのレジスタを有しこ
のレジスタの内容に基づいて優先度を判定して上記アド
レス演算回路でそれぞれ演算されている表示アドレスの
うち優先度の高いウィンドウに対応するものを出力させ
る制御信号を形成するウィンドウ表示優先度指定回路を
設けるものである。
C作用コ
上記した手段によれば、レジスタの設定内容を変更する
だけで、ウィンドウの表示位置や大きさおよび表示内容
さらには重なり部分での表示優先順位の変更などを行な
えるようになり、これによって、表示画面の自由度が高
くしかも高速でマルチウィンドウ制御を行なえるように
するという上記目的を達成することができる。
だけで、ウィンドウの表示位置や大きさおよび表示内容
さらには重なり部分での表示優先順位の変更などを行な
えるようになり、これによって、表示画面の自由度が高
くしかも高速でマルチウィンドウ制御を行なえるように
するという上記目的を達成することができる。
[実施例コ
第1図には、本発明に係る表示制御装置の一実施例が示
されている。
されている。
この実施例では、表示画面上にn個のウィンドウを表示
し制御できるようにするため、n個のウィンドウ管理回
路WND、〜W N D nが設けられている。各ウィ
ンドウ管理回路WND工〜W N D nは、それぞれ
画面上での水平方向の開始位置を指定する開始アドレス
レジスタと、水平方向の終了位置を指定する終了アドレ
スレジスタと、同じく垂直方向の開始位置を指定する開
始アドレスレジスタと、垂直方向の終了位置を指定する
終了アドレスレジスタおよびアドレス比較用のコンパレ
ータとにより構成されている。
し制御できるようにするため、n個のウィンドウ管理回
路WND、〜W N D nが設けられている。各ウィ
ンドウ管理回路WND工〜W N D nは、それぞれ
画面上での水平方向の開始位置を指定する開始アドレス
レジスタと、水平方向の終了位置を指定する終了アドレ
スレジスタと、同じく垂直方向の開始位置を指定する開
始アドレスレジスタと、垂直方向の終了位置を指定する
終了アドレスレジスタおよびアドレス比較用のコンパレ
ータとにより構成されている。
各ウィンドウ管理回路WND工〜W N D nには、
画面上での水平方向の表示位置を示す水平カウンタCN
Thおよび垂直方向の表示位置を示す垂直カウンタCN
Tvからの信号が供給され、内部のコンパレータによっ
て上記アドレスレジスタの値と供給されたカウント値と
を比較し1表示位置が自己のウィンドウ内に入った場合
、および表示位置が自己のウィンドウから外れたときに
それぞれ一致検出信号を出力する。
画面上での水平方向の表示位置を示す水平カウンタCN
Thおよび垂直方向の表示位置を示す垂直カウンタCN
Tvからの信号が供給され、内部のコンパレータによっ
て上記アドレスレジスタの値と供給されたカウント値と
を比較し1表示位置が自己のウィンドウ内に入った場合
、および表示位置が自己のウィンドウから外れたときに
それぞれ一致検出信号を出力する。
各ウィンドウ管理回路WND工〜WNDnから出力され
た検出信号は、複数のウィンドウが重なっている場合い
ずれのウィンドウの優先度が最も高いか、つまり重複部
分についていずれのウィンドウの表示データを表示させ
るか判定するウィンドウ表示優先度指定回路PRTに供
給される。ウィンドウ表示優先度指定回路PRTは、各
ウィンドウ管理回路WND1〜WNDnからの表示開始
の検出信号を受けると、そのウィンドウに対応するアド
レス演算部WALi (i=1.2.”、n)に演算開
始信号S T iを出力する。また、ウィンドウ表示優
先度指定回路PRT内には、各ウィンドウの優先度を設
定する優先度指定レジスタが設けられ、予めCPUによ
りこのレジスタに設定された優先度に従ってウィンドウ
の制御を行なう。
た検出信号は、複数のウィンドウが重なっている場合い
ずれのウィンドウの優先度が最も高いか、つまり重複部
分についていずれのウィンドウの表示データを表示させ
るか判定するウィンドウ表示優先度指定回路PRTに供
給される。ウィンドウ表示優先度指定回路PRTは、各
ウィンドウ管理回路WND1〜WNDnからの表示開始
の検出信号を受けると、そのウィンドウに対応するアド
レス演算部WALi (i=1.2.”、n)に演算開
始信号S T iを出力する。また、ウィンドウ表示優
先度指定回路PRT内には、各ウィンドウの優先度を設
定する優先度指定レジスタが設けられ、予めCPUによ
りこのレジスタに設定された優先度に従ってウィンドウ
の制御を行なう。
すなわち、ウィンドウ表示優先度指定回路PRTは、同
時に複数のウィンドウ管理回路から表示開始信号が入っ
て来ても、そのうち最も優先度の高いウィンドウに対応
したアドレス演算部WALiの出力ゲートGiを開くよ
うな制御信号Ciを出力する。すると、開かれた出力ゲ
ートGiを通って内部バスBUS上に出力されたアドレ
スは。
時に複数のウィンドウ管理回路から表示開始信号が入っ
て来ても、そのうち最も優先度の高いウィンドウに対応
したアドレス演算部WALiの出力ゲートGiを開くよ
うな制御信号Ciを出力する。すると、開かれた出力ゲ
ートGiを通って内部バスBUS上に出力されたアドレ
スは。
表示アドレスとしてI10インタフェース回路工NT、
を介して外部へ出力され、フレームバッファなどに供給
される。
を介して外部へ出力され、フレームバッファなどに供給
される。
この実施例では、特に制限されないが、上記表示アドレ
スと共に、ウィンドウ表示優先度指定回路PRTで形成
された優先度のレベルを示す信号や出力中の表示アドレ
スがいずれのウィンドウに属するか示すウィンドウ番号
も外部へ出力できるようにされている。
スと共に、ウィンドウ表示優先度指定回路PRTで形成
された優先度のレベルを示す信号や出力中の表示アドレ
スがいずれのウィンドウに属するか示すウィンドウ番号
も外部へ出力できるようにされている。
ウィンドウ表示優先度指定回路PRTにおける優先度レ
ジスタによる優先度の設定方式としては。
ジスタによる優先度の設定方式としては。
ウィンドウと同じ数(n個)のレジスタを用意し、予め
それらのレジスタに優先順位をつけておいて、各レジス
タ内にウィンドウ番号を設定することで各ウィンドウに
優先度を与える方式と、各ウィンドウに1対1で対応さ
れたレジスタを設けておいて、各々のレジスタに優先度
レベルを示すコードを設定しておく方式とが考えられる
。各優先度レジスタにはCPU側のI10インタフェー
ス回路INT、を介してCPUが予めウィンドウ番号ま
たは優先度レベルを設定するように構成される。
それらのレジスタに優先順位をつけておいて、各レジス
タ内にウィンドウ番号を設定することで各ウィンドウに
優先度を与える方式と、各ウィンドウに1対1で対応さ
れたレジスタを設けておいて、各々のレジスタに優先度
レベルを示すコードを設定しておく方式とが考えられる
。各優先度レジスタにはCPU側のI10インタフェー
ス回路INT、を介してCPUが予めウィンドウ番号ま
たは優先度レベルを設定するように構成される。
第2図には、上記優先度設定方式のうち優先順位付けさ
れたレジスタにウィンドウ番号を設定する方式を採用し
たウィンドウ表示優先度指定回路PRTの一構成例が示
されている。
れたレジスタにウィンドウ番号を設定する方式を採用し
たウィンドウ表示優先度指定回路PRTの一構成例が示
されている。
すなわち、第2図に符号PRG、〜PRGnで示されて
いるのが、優先順位づけされた優先度レジスタである。
いるのが、優先順位づけされた優先度レジスタである。
各優先度レジスタPR01〜PRGn内には、最も優先
的に表示させたいウィンドウから順番にそのウィンドウ
番号を入れておく。そして、各優先度レジスタPR01
〜PRGn内のウィンドウ番号をデコーダDEC1〜D
ECnでデコードすることにより、各デコーダのn本の
出力信号のうちウィンドウ番号に対応した一つの信号の
みがハイレベルにされる。各デコーダDEC1〜DEC
nの出力信号は、制御信号およびステータス信号形成ロ
ジックSQLの入力信号とされている。
的に表示させたいウィンドウから順番にそのウィンドウ
番号を入れておく。そして、各優先度レジスタPR01
〜PRGn内のウィンドウ番号をデコーダDEC1〜D
ECnでデコードすることにより、各デコーダのn本の
出力信号のうちウィンドウ番号に対応した一つの信号の
みがハイレベルにされる。各デコーダDEC1〜DEC
nの出力信号は、制御信号およびステータス信号形成ロ
ジックSQLの入力信号とされている。
一方、ウィンドウ表示優先度指定回路PRT内には、各
ウィンドウに対応してフリップフロップからなるフラグ
FG□〜FGnが設けられており、これらのフラグFG
1〜FGnは、前記ウィンドウ管理回路WND工〜WN
Dnからの表示開始信号および表示終了信号によってセ
ットされたり、リセットされたりするようになっている
。各フラグは対応するウィンドウの表示開始信号によっ
て出力が“1”にされると1表示終了信号が入って来る
まで“1″を保持する。これらのフラグFG、〜FGn
の出力が、ウィンドウアドレス演算部WAL1〜WAL
nに対して演算開始信号として供給され、フラグ出力が
“1”の間、対応するウィンドウの表示アドレスの演算
が継続される。従って、複数の演算部が同時に動作する
ことがある(ウィンドウ重なり部の表示の際)。
ウィンドウに対応してフリップフロップからなるフラグ
FG□〜FGnが設けられており、これらのフラグFG
1〜FGnは、前記ウィンドウ管理回路WND工〜WN
Dnからの表示開始信号および表示終了信号によってセ
ットされたり、リセットされたりするようになっている
。各フラグは対応するウィンドウの表示開始信号によっ
て出力が“1”にされると1表示終了信号が入って来る
まで“1″を保持する。これらのフラグFG、〜FGn
の出力が、ウィンドウアドレス演算部WAL1〜WAL
nに対して演算開始信号として供給され、フラグ出力が
“1”の間、対応するウィンドウの表示アドレスの演算
が継続される。従って、複数の演算部が同時に動作する
ことがある(ウィンドウ重なり部の表示の際)。
また、上記実施例では、フラグFG1〜FOnの出力が
上記デコーダDEC工〜DECnの出力と共に、上記信
号形成ロジックSQLに供給され、アドレス演算部WA
L1〜W A L nで演算中のアドレスのうち、表示
アドレスとして出力すべきものを決定するために使用さ
れる。すなわち、フラグFG1〜FG、の出力から演算
実行中のウィンドウを知り、優先度レジスタPRG、〜
PROnの情報からその中で最も優先度レベルの高いウ
ィンドウ番号を見つけ、それ対応した演算部の出力ゲー
トGiを開かせるような制御信号Ciを出力するように
されている。しかも、そのとき出力している表示アドレ
スの属するウィンドウの番号を選択して出力するととも
に、デコーダの出力に基づいてそのウィンドウの優先レ
ベルをも出力するようにされている。
上記デコーダDEC工〜DECnの出力と共に、上記信
号形成ロジックSQLに供給され、アドレス演算部WA
L1〜W A L nで演算中のアドレスのうち、表示
アドレスとして出力すべきものを決定するために使用さ
れる。すなわち、フラグFG1〜FG、の出力から演算
実行中のウィンドウを知り、優先度レジスタPRG、〜
PROnの情報からその中で最も優先度レベルの高いウ
ィンドウ番号を見つけ、それ対応した演算部の出力ゲー
トGiを開かせるような制御信号Ciを出力するように
されている。しかも、そのとき出力している表示アドレ
スの属するウィンドウの番号を選択して出力するととも
に、デコーダの出力に基づいてそのウィンドウの優先レ
ベルをも出力するようにされている。
第3図には、−例として3つのウィンドウQ。
m、nを用意し、それを優先度レベルが「3」と「2」
と「5」の優先度レジスタに設定した場合(ただし数字
が大きいほど優先度が高いとする)の表示型なり部分で
の各種制御信号および表示アドレスの出力状態を示す。
と「5」の優先度レジスタに設定した場合(ただし数字
が大きいほど優先度が高いとする)の表示型なり部分で
の各種制御信号および表示アドレスの出力状態を示す。
各ウィンドウに対応するフラグは、ウィンドウ管理回路
WND、〜W N D n内のコンパレータの出力によ
って、セットまたはリセットされる。フラグがセット(
1′1”レベル)にされている間、対応するアドレス演
算部での表示アドレスの演算が継続される。そして、複
数の演算部で同時に演算が行なわれているときは、最も
優先レベルの高いウィンドウ(実施例ではn ) Q
) mの順位)に対応する演算部で演算されたアドレス
が表示アドレスとして出力される。
WND、〜W N D n内のコンパレータの出力によ
って、セットまたはリセットされる。フラグがセット(
1′1”レベル)にされている間、対応するアドレス演
算部での表示アドレスの演算が継続される。そして、複
数の演算部で同時に演算が行なわれているときは、最も
優先レベルの高いウィンドウ(実施例ではn ) Q
) mの順位)に対応する演算部で演算されたアドレス
が表示アドレスとして出力される。
なお、上記実施例では、ウィンドウ表示についてのみ説
明し背景画面の表示について述べていないが、表示画面
全体を一つのウィンドウとみなし、例えば最も低い優先
レベルを与えておくことによりそれを背景画面となし、
その上にそれよりも小さくかつ優先度の高いウィンドウ
を表示させることで所望のウィンドウ表示制御を行なう
ことができる。
明し背景画面の表示について述べていないが、表示画面
全体を一つのウィンドウとみなし、例えば最も低い優先
レベルを与えておくことによりそれを背景画面となし、
その上にそれよりも小さくかつ優先度の高いウィンドウ
を表示させることで所望のウィンドウ表示制御を行なう
ことができる。
また、上記優先度レジスタPRG□〜PROnの代わり
に、ウィンドウ番号の順番に表示優先度レベル値を設定
するウィンドウ番号レジスタとしてもよい。
に、ウィンドウ番号の順番に表示優先度レベル値を設定
するウィンドウ番号レジスタとしてもよい。
以上説明したようにこの実施例は、自己の管理下で制御
したいウィンドウの数だけ、表示画面上での表示開始位
置および終了位置を設定するレジスタとアドレス比較器
を有するウィンドウ管理回路およびアドレス演算回路を
設け、ウィンドウごとにアドレス演算を行なえるように
するとともに、各ウィンドウの優先度を設定するための
レジスタを有しこのレジスタの内容に基づいて優先度を
判定し、上記アドレス演算回路でそれぞれ演算されてい
るアドレスのうち優先度の高いウィンドウに対応するも
のを出力させる制御信号を形成するウィンドウ制御回路
(ウィンドウ表示優先度指定回路)を設けてなるので、
レジスタの設定内容を変更するだけで、ウィンドウの表
示位置や大きさおよび表示内容さらには重なり部分での
表示優先順位の変更などを行なえるという作用により、
表示画面の自由度が高くしかも高速でマルチウィンドウ
制御を行なうことができるという効果がある。
したいウィンドウの数だけ、表示画面上での表示開始位
置および終了位置を設定するレジスタとアドレス比較器
を有するウィンドウ管理回路およびアドレス演算回路を
設け、ウィンドウごとにアドレス演算を行なえるように
するとともに、各ウィンドウの優先度を設定するための
レジスタを有しこのレジスタの内容に基づいて優先度を
判定し、上記アドレス演算回路でそれぞれ演算されてい
るアドレスのうち優先度の高いウィンドウに対応するも
のを出力させる制御信号を形成するウィンドウ制御回路
(ウィンドウ表示優先度指定回路)を設けてなるので、
レジスタの設定内容を変更するだけで、ウィンドウの表
示位置や大きさおよび表示内容さらには重なり部分での
表示優先順位の変更などを行なえるという作用により、
表示画面の自由度が高くしかも高速でマルチウィンドウ
制御を行なうことができるという効果がある。
以上本発明者によってなされた発明を実施例に基づき具
体的に説明したが、本発明は上記実施例に限定されるも
のではなく、その要旨を逸脱しない範囲で種々変更可能
であることはいうまでもない。例えば上記実施例では1
表示制御装置が優先度レベルおよびウィンドウ番号を出
力できるように構成されているが、これらのステータス
信号は必ずしも外部へ出力させる必要はない。
体的に説明したが、本発明は上記実施例に限定されるも
のではなく、その要旨を逸脱しない範囲で種々変更可能
であることはいうまでもない。例えば上記実施例では1
表示制御装置が優先度レベルおよびウィンドウ番号を出
力できるように構成されているが、これらのステータス
信号は必ずしも外部へ出力させる必要はない。
以上の説明では主として本発明者によってなされた発明
をその背景となった利用分野である表示制御装置に適用
したものについて説明したが、この発明はそれに限定さ
れず、レーザビームプリンタにおけるメモリ内のデータ
の読出し書込みを行なう制御装置に利用することができ
る。
をその背景となった利用分野である表示制御装置に適用
したものについて説明したが、この発明はそれに限定さ
れず、レーザビームプリンタにおけるメモリ内のデータ
の読出し書込みを行なう制御装置に利用することができ
る。
[発明の効果]
本願において開示される発明のうち代表的なものによっ
て得られる効果を簡単に説明すれば下記のとおりである
。
て得られる効果を簡単に説明すれば下記のとおりである
。
すなわち、グラフィック表示システムにおいて、表示画
面の自由度が高くしかも高速表示可能なマルチウィンド
ウ制御を行なうことができる。
面の自由度が高くしかも高速表示可能なマルチウィンド
ウ制御を行なうことができる。
第1図は本発明に係る表示制御装置の一実施例を示すブ
ロック図、 第2図はウィンドウ表示優先度指定回路の構成例を示す
ブロック図。 第3図は第1図の表示制御装置におけるマルチウィンド
ウ制御のタイミングの一例を示すタイミングチャートで
ある。 WND1〜WNDn・・・・ウィンドウ管理回路、WA
L1〜WALn・・・・アドレス演算部、PRT・・・
・ウィンドウ制御回路(ウィンドウ表示優先度指定回路
) 、 I N T’、、 I NT2・・・・工/○
インタフェース回路、PRG□〜PRGn・・・・優先
度レジスタ。
ロック図、 第2図はウィンドウ表示優先度指定回路の構成例を示す
ブロック図。 第3図は第1図の表示制御装置におけるマルチウィンド
ウ制御のタイミングの一例を示すタイミングチャートで
ある。 WND1〜WNDn・・・・ウィンドウ管理回路、WA
L1〜WALn・・・・アドレス演算部、PRT・・・
・ウィンドウ制御回路(ウィンドウ表示優先度指定回路
) 、 I N T’、、 I NT2・・・・工/○
インタフェース回路、PRG□〜PRGn・・・・優先
度レジスタ。
Claims (1)
- 【特許請求の範囲】 1、表示画面上での表示開始位置および終了位置を設定
するレジスタとアドレス比較器を有する複数個のウィン
ドウ管理回路と、このウィンドウ管理回路と同数のアド
レス演算回路と、各ウィンドウの優先度を設定するため
の優先度設定用レジスタを有しこのレジスタの内容に基
づいて優先度を判定して上記アドレス演算回路でそれぞ
れ演算されている表示アドレスのうち優先度の高いウィ
ンドウに対応するものを出力させる制御信号を形成する
ウィンドウ制御回路とを備えてなることを特徴とする表
示制御装置。 2、上記優先度設定用レジスタは、各レジスタごとに優
先度の順位づけがなされ、各レジスタにはレジスタ番号
を設定するように構成され、かつウィンドウ制御回路に
はこれらのレジスタに設定されたレジスタ番号をデコー
ドするデコーダが設けられてなることを特徴とする特許
請求の範囲第1項記載の表示制御装置。
Priority Applications (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61223549A JPH0814785B2 (ja) | 1986-09-24 | 1986-09-24 | 表示制御装置 |
KR1019870008983A KR950012080B1 (ko) | 1986-09-24 | 1987-08-17 | 표시 제어 장치 |
DE3751302T DE3751302T2 (de) | 1986-09-24 | 1987-09-02 | Anzeigesteuergerät. |
EP87112830A EP0261463B1 (en) | 1986-09-24 | 1987-09-02 | Display control apparatus |
US07/670,526 US5129055A (en) | 1986-09-24 | 1991-03-18 | Display control apparatus including a window display priority designation arrangement |
HK214196A HK214196A (en) | 1986-09-24 | 1996-12-12 | Display control apparatus |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61223549A JPH0814785B2 (ja) | 1986-09-24 | 1986-09-24 | 表示制御装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6379184A true JPS6379184A (ja) | 1988-04-09 |
JPH0814785B2 JPH0814785B2 (ja) | 1996-02-14 |
Family
ID=16799896
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61223549A Expired - Lifetime JPH0814785B2 (ja) | 1986-09-24 | 1986-09-24 | 表示制御装置 |
Country Status (6)
Country | Link |
---|---|
US (1) | US5129055A (ja) |
EP (1) | EP0261463B1 (ja) |
JP (1) | JPH0814785B2 (ja) |
KR (1) | KR950012080B1 (ja) |
DE (1) | DE3751302T2 (ja) |
HK (1) | HK214196A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01261722A (ja) * | 1988-04-13 | 1989-10-18 | Hitachi Ltd | マルチウインドウ表示装置とマルチウインドウ表示制御方法およびマルチウインドウ表示制御装置 |
Families Citing this family (35)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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