JPS6368054U - - Google Patents

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JPS6368054U
JPS6368054U JP15896586U JP15896586U JPS6368054U JP S6368054 U JPS6368054 U JP S6368054U JP 15896586 U JP15896586 U JP 15896586U JP 15896586 U JP15896586 U JP 15896586U JP S6368054 U JPS6368054 U JP S6368054U
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JP
Japan
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bus
shared memory
memory
bus master
register
Prior art date
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Pending
Application number
JP15896586U
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Publication date
Application filed filed Critical
Priority to JP15896586U priority Critical patent/JPS6368054U/ja
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【図面の簡単な説明】
第１図は、本考案によるプライオリテイ決定装
置を説明する為の図、第２図は、従来のプライオ
リテイ決定装置を説明する為の図である。１，２
，３は、バスマスタ、４は共有メモリ、５，６，
７はバス要求信号、８，９，１０はプライオリテ
イ信号、１１，１２，１３は共有メモリへのデコ
ードアドレス、１４はレジスタ、１５はメモリで
ある。なお、図中同一あるいは相当部分には同一
符号を付して示してある。

Claims (1)

    【実用新案登録請求の範囲】
  1. バス上に接続された共有メモリを用いて、デー
    タ授受を行うマルチコンピユータシステムにおい
    て、共有メモリとのデータの転送を行う各々のバ
    スマスタから転送される共有メモリへのデコード
    アドレスを取込むレジスタと、このレジスタの内
    容と各バスマスタからのバス使用要求線をアドレ
    スとするメモリとを有し、このメモリの内容によ
    り各バスマスタのプライオリテイを決める信号を
    発生することを特徴とするプライオリテイ決定装
    置。
JP15896586U 1986-10-17 1986-10-17 Pending JPS6368054U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP15896586U JPS6368054U (ja) 1986-10-17 1986-10-17

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP15896586U JPS6368054U (ja) 1986-10-17 1986-10-17

Publications (1)

Publication Number Publication Date
JPS6368054U true JPS6368054U (ja) 1988-05-07

Family

ID=31082953

Family Applications (1)

Application Number Title Priority Date Filing Date
JP15896586U Pending JPS6368054U (ja) 1986-10-17 1986-10-17

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JP (1) JPS6368054U (ja)

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