JPS6355617A - キ−入力装置 - Google Patents
キ−入力装置Info
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- JPS6355617A JPS6355617A JP61198993A JP19899386A JPS6355617A JP S6355617 A JPS6355617 A JP S6355617A JP 61198993 A JP61198993 A JP 61198993A JP 19899386 A JP19899386 A JP 19899386A JP S6355617 A JPS6355617 A JP S6355617A
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- 239000011159 matrix material Substances 0.000 claims description 6
- 238000004519 manufacturing process Methods 0.000 abstract description 3
- 238000006243 chemical reaction Methods 0.000 abstract description 2
- 238000000034 method Methods 0.000 description 6
- 101150065817 ROM2 gene Proteins 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 101150073133 Cpt1a gene Proteins 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000006870 function Effects 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、複数のキー入力スイッチを有するキー入力装
置に関する。
置に関する。
［従来の技術］
従来、この種のキー入力装置では、−敗に第６図に示す
ように、マイクロコンピュータヘノデータ入力用装置と
してキーマトリックスを用い、キースキャン（キー走査
）によってキー入力の判別を行っており、マイクロコン
ピュータ１の出力ボートと入力ボートとの間に複数のキ
ースイッチ５１〜５１６を、マトリックス状に接続して
いる。また、出力ボートＰＡＯ〜 ＰＡ３から時分割に
よりその出力ボートの端子を順次アクティブ（高レベル
）にするように、キースキャン信号を出力して、その時
のキースイッチからのＯＮ、ＯＦＦ信号を入力ボートＰ
ＢＯ〜ＰＢ３に入力するということを出方ボートの端子
数と同じ数だけ繰り返し、これによりどのキーが押され
たかのキー入力判断を行っている。
ように、マイクロコンピュータヘノデータ入力用装置と
してキーマトリックスを用い、キースキャン（キー走査
）によってキー入力の判別を行っており、マイクロコン
ピュータ１の出力ボートと入力ボートとの間に複数のキ
ースイッチ５１〜５１６を、マトリックス状に接続して
いる。また、出力ボートＰＡＯ〜 ＰＡ３から時分割に
よりその出力ボートの端子を順次アクティブ（高レベル
）にするように、キースキャン信号を出力して、その時
のキースイッチからのＯＮ、ＯＦＦ信号を入力ボートＰ
ＢＯ〜ＰＢ３に入力するということを出方ボートの端子
数と同じ数だけ繰り返し、これによりどのキーが押され
たかのキー入力判断を行っている。
〔発明が解決しようとする問題点Ｊ
ところが、このような従来の回路構成ではキースイッチ
５１〜５１Ｂが同時に２個以上押された場合に出力ボー
トの端子を短絡から保護する必要があるので、ダイオー
ドＤ１〜Ｄ１６を付加する必要がある。
５１〜５１Ｂが同時に２個以上押された場合に出力ボー
トの端子を短絡から保護する必要があるので、ダイオー
ドＤ１〜Ｄ１６を付加する必要がある。
また、データ入力端子として入力ポートを使用している
ので、例えば１６個のキースイッチに対して、マイクロ
コンピュータの端子を少くとも８端子使用することにな
り、従）てキースイッチの数が増えてくると、マイクロ
コンピュータの端子数が不足してくるという欠点があっ
た。
ので、例えば１６個のキースイッチに対して、マイクロ
コンピュータの端子を少くとも８端子使用することにな
り、従）てキースイッチの数が増えてくると、マイクロ
コンピュータの端子数が不足してくるという欠点があっ
た。
本発明は、上述の欠点を除去し、キースキャンラインの
回路構成が単純になると同時に、マイクロコンピュータ
の使用端子の節約が可能となるキー入力装置を提供する
ことを目的とする。
回路構成が単純になると同時に、マイクロコンピュータ
の使用端子の節約が可能となるキー入力装置を提供する
ことを目的とする。
［問題点を解決するための手段］
かかる目的を達成するため、本発明はマトリックス配列
の複数のキー入力スイッチと、キー入力スイッチを走査
するキースキャンラインを有する複数のキースキャン駆
動部とにより時分割でキー入力を受付けるキー入力装置
において、キースキャンラインに複数の抵抗を並列に接
続、し、抵抗の各々の片側にキー入力スイッチを各々接
続したこと特徴とする。
の複数のキー入力スイッチと、キー入力スイッチを走査
するキースキャンラインを有する複数のキースキャン駆
動部とにより時分割でキー入力を受付けるキー入力装置
において、キースキャンラインに複数の抵抗を並列に接
続、し、抵抗の各々の片側にキー入力スイッチを各々接
続したこと特徴とする。
［作 用］
本発明は、複数のキー入力スイッチと複数のキースキャ
ン駆動部とにより時分割でキー入力を受は付けるキー入
力装置において、キースキャンラインに複数の抵抗を並
列に配置し、各抵抗片側にキースイッチを設けたので、
構造の単純化と製造コストの低減が図られ、また、各キ
ースキャンラインの抵抗値の変化による電位の変化をア
ナログ入力端子を通じてアナログディジタル変換して３
値以上判別できるようにしたので、マイクロコンピュー
タの端子の節約が得られ、特にキースイッチの数が多い
時には非常に有効となる。
ン駆動部とにより時分割でキー入力を受は付けるキー入
力装置において、キースキャンラインに複数の抵抗を並
列に配置し、各抵抗片側にキースイッチを設けたので、
構造の単純化と製造コストの低減が図られ、また、各キ
ースキャンラインの抵抗値の変化による電位の変化をア
ナログ入力端子を通じてアナログディジタル変換して３
値以上判別できるようにしたので、マイクロコンピュー
タの端子の節約が得られ、特にキースイッチの数が多い
時には非常に有効となる。
［実施例］
以下、図面を参照して本発明の実施例を詳細に説明する
。
。
第１図は本発明の一実施例の回路構成を示し、ここで４
は第４図および第５図に示す制御手順に従ってキー入力
の判断を行うマイクロコンピュータ、５はキー入力部、
６はキー入力判断を行うためのキースキャンライン駆動
部（キースキャン駆動部）である。なお、上述の制御手
順はマイクロコンピュータ４の内部メモリＲＯＭＩにあ
らかじめ格納されている。
は第４図および第５図に示す制御手順に従ってキー入力
の判断を行うマイクロコンピュータ、５はキー入力部、
６はキー入力判断を行うためのキースキャンライン駆動
部（キースキャン駆動部）である。なお、上述の制御手
順はマイクロコンピュータ４の内部メモリＲＯＭＩにあ
らかじめ格納されている。
７はキースキャンライン（Ａ）であり、キースイッチＳ
１７〜３２０の判別時に使用される。同様に、８はキー
スキャンライン（Ｂ）であり、キースイッチＳ２１〜Ｓ
２４の判別時に使用される。９はキースキャンライン
（Ｃ）であり、キースイッチＳ２５〜Ｓ２８の判別時に
使用される。１０はキースキャンライン（Ｄ）であり、
キースイッチＳ２９〜Ｓ３２の判別時に使用内れる。
１７〜３２０の判別時に使用される。同様に、８はキー
スキャンライン（Ｂ）であり、キースイッチＳ２１〜Ｓ
２４の判別時に使用される。９はキースキャンライン
（Ｃ）であり、キースイッチＳ２５〜Ｓ２８の判別時に
使用される。１０はキースキャンライン（Ｄ）であり、
キースイッチＳ２９〜Ｓ３２の判別時に使用内れる。
Ｒ１９〜Ｒ１３はトランジスタＴ５〜Ｔ８のドライブ抵
抗、Ｒ１４〜Ｒ２５はキースキャンライン７〜１０に並
列に配置した抵抗である。また、Ｒ９は入力ライン１１
に共通の負荷抵抗である。Ｑ５〜Ｑ８はインバータであ
る。
抗、Ｒ１４〜Ｒ２５はキースキャンライン７〜１０に並
列に配置した抵抗である。また、Ｒ９は入力ライン１１
に共通の負荷抵抗である。Ｑ５〜Ｑ８はインバータであ
る。
さらに、ＡＮＤおよびｐｃＯ〜ｐｃ３は各々マイクロコ
ンピュータ４の端子であり、ＡＮＤは各キースキャンラ
インの抵抗値の変化による電位の変化を３値以上判別を
行えるアナログ入力端子、ｐｃＯ〜ｐｃ３は各々２値の
ディジタル出力を行える出力端子である。また、νＳは
任意に設定した電位である。
ンピュータ４の端子であり、ＡＮＤは各キースキャンラ
インの抵抗値の変化による電位の変化を３値以上判別を
行えるアナログ入力端子、ｐｃＯ〜ｐｃ３は各々２値の
ディジタル出力を行える出力端子である。また、νＳは
任意に設定した電位である。
また、マイクロコンピュータ４は、アナログ入力端子Ａ
ＮＤからの入力電位をラッチするラッチ回路り、ラッチ
したその電位をアナログデジタル（Ａ／Ｄ）変換するＡ
／ＤコンバータＡＤ、Ａ／ＤコンバータＡＤで変換され
たデジタルデータを格納するレジスタＲ１しきい値とな
る第３図に示されたτ位しベルに相当する複数のデータ
があらかじめ格納されているメモリＲＯＭ２ 、レジス
タＲの内容とメモリＲＯＭ２のデータを順次比較して押
されているキースイッチを判別する中央処理装置０２口
および中央処理装置ＣＰｔ１の判別結果を対応するキャ
ラクタコードにして出力するエンコーダＥ Ｎ Ｃとを
有する。
ＮＤからの入力電位をラッチするラッチ回路り、ラッチ
したその電位をアナログデジタル（Ａ／Ｄ）変換するＡ
／ＤコンバータＡＤ、Ａ／ＤコンバータＡＤで変換され
たデジタルデータを格納するレジスタＲ１しきい値とな
る第３図に示されたτ位しベルに相当する複数のデータ
があらかじめ格納されているメモリＲＯＭ２ 、レジス
タＲの内容とメモリＲＯＭ２のデータを順次比較して押
されているキースイッチを判別する中央処理装置０２口
および中央処理装置ＣＰｔ１の判別結果を対応するキャ
ラクタコードにして出力するエンコーダＥ Ｎ Ｃとを
有する。
以上の構成において、−例として出力端子ｐｃＯをアク
ティブ（高レベル）にして、キースキャンライン（Ａ）
７を駆動状態にした時の作用を第２図および第３図を参
照して説明する。
ティブ（高レベル）にして、キースキャンライン（Ａ）
７を駆動状態にした時の作用を第２図および第３図を参
照して説明する。
まず、出力端子ｐｃＯをアクティブにするとトランジス
タＴ５が″ＯＮ″状態（導通）になり、これによりキー
スキャンライン（Ａ）７が駆動された時の等価回路は第
２図に示すようになる。また、このときのキースイッチ
ＳＬ７〜Ｓ２０の“ＯＮ ”および“ＯＦＦ”の状態
によるアナログ入力端子ＡＮＤへのアナログ入力値は第
３図に示すようになる。
タＴ５が″ＯＮ″状態（導通）になり、これによりキー
スキャンライン（Ａ）７が駆動された時の等価回路は第
２図に示すようになる。また、このときのキースイッチ
ＳＬ７〜Ｓ２０の“ＯＮ ”および“ＯＦＦ”の状態
によるアナログ入力端子ＡＮＤへのアナログ入力値は第
３図に示すようになる。
ここで“ＯＮ”とは導通状態をいい、“ＯＦＦ”とは開
放状態をいうものとする。
放状態をいうものとする。
また、第３図中のＲ１／／Ｒ」 は２つの抵抗Ｒｉ＋
ＲＪ （例えばＲ２６，Ｒ１４）の合成抵抗値を示す
。
ＲＪ （例えばＲ２６，Ｒ１４）の合成抵抗値を示す
。
同様にＲ＋／／Ｒ，＋／／ｈは３つの抵抗Ｒ＋、 Ｒｒ
、Ｒｉ＝の合成抵抗値を示す。
、Ｒｉ＝の合成抵抗値を示す。
このようにマイクロコンピュータ１は、ライン抵抗Ｒ１
４〜Ｒ２９と、負荷抵抗Ｒ９で分圧された電圧を３値以
上の閾値と比較して、どのキースイッチが押されたかを
判別する。
４〜Ｒ２９と、負荷抵抗Ｒ９で分圧された電圧を３値以
上の閾値と比較して、どのキースイッチが押されたかを
判別する。
すなわち、第３図に示すように４つキースイッチＳ１７
〜Ｓ２０の状態により、１６種類のアナログ入力値が阜
−のアナログ入力端子へＮＤから得られる。同様に、キ
ースキャンライン（Ｂ）８、キースキャンライン （Ｃ
）９、およびキースキャンライン（Ｉ）） １０に接続
された各々のキースイッチの状態によって、異ったアナ
ログ入力値がアナログ入力端子ＡＮＤから得られる。従
って、このように得られたアナログ入力値よりキースイ
ッチの入力状態を正しく判別できる。
〜Ｓ２０の状態により、１６種類のアナログ入力値が阜
−のアナログ入力端子へＮＤから得られる。同様に、キ
ースキャンライン（Ｂ）８、キースキャンライン （Ｃ
）９、およびキースキャンライン（Ｉ）） １０に接続
された各々のキースイッチの状態によって、異ったアナ
ログ入力値がアナログ入力端子ＡＮＤから得られる。従
って、このように得られたアナログ入力値よりキースイ
ッチの入力状態を正しく判別できる。
次に、第４図および第５図のフローチャートを参照して
、第１図の本発明実施例装置のマイクロコンピュータ４
の制御動作を説明する。
、第１図の本発明実施例装置のマイクロコンピュータ４
の制御動作を説明する。
まず、ステップ１０１において、内部メモリの番地を示
す内部のアドレスカウンタを“ＫＥＹ”（所定値）に設
定する。次のステップ１０２に進み、出力端子ｐｃＯを
”ＯＮ”にし、第５図のＫＥＹ−ＩＮサブルーチンを実
行して（ステップ１０３ ） 、出力端子ｐｃＯＡを“
ＯＦＦ″にする（ステップ１０４）。
す内部のアドレスカウンタを“ＫＥＹ”（所定値）に設
定する。次のステップ１０２に進み、出力端子ｐｃＯを
”ＯＮ”にし、第５図のＫＥＹ−ＩＮサブルーチンを実
行して（ステップ１０３ ） 、出力端子ｐｃＯＡを“
ＯＦＦ″にする（ステップ１０４）。
すなわち、ＫＥＹ−ＩＮサブルーチンでは、アナログ入
力端子ＡＮＤからの入力電位をラッチ回路りでラッチし
て（ステップ２０１）、その電位をＡ／ＤコンバータＡ
Ｄでデジタルデータに変換してレジスタＲに格納しくス
テップ２０２）、そのレジスタＲの内容とメモリＲＯＭ
２内のしきい値電位レベルに相当するデータとを順次比
較して押されているキースイッチを判別しくステップ２
０３）、その判別結果によりエンコーダＥＮＣよりキー
データを出力した後（ステップ２０４ ） 、メインル
ーチンに戻る。
力端子ＡＮＤからの入力電位をラッチ回路りでラッチし
て（ステップ２０１）、その電位をＡ／ＤコンバータＡ
Ｄでデジタルデータに変換してレジスタＲに格納しくス
テップ２０２）、そのレジスタＲの内容とメモリＲＯＭ
２内のしきい値電位レベルに相当するデータとを順次比
較して押されているキースイッチを判別しくステップ２
０３）、その判別結果によりエンコーダＥＮＣよりキー
データを出力した後（ステップ２０４ ） 、メインル
ーチンに戻る。
上述と同様に、ステップ１０４〜１１３において、キー
スキャンライン（Ｂ）８、キースキャンライン（Ｃ）
９ 、およびキースキャンライン（Ｄ） ｌｏの各々の
スイッチの押下によるアナログ入力値をアナログ−ディ
ジタル変換した後に、内部メモリに入力 □データ
の格納を行い、ステップ１１３の処理が終了したら、最
初のステップ１０１に戻って上述の処理を繰り返す。
スキャンライン（Ｂ）８、キースキャンライン（Ｃ）
９ 、およびキースキャンライン（Ｄ） ｌｏの各々の
スイッチの押下によるアナログ入力値をアナログ−ディ
ジタル変換した後に、内部メモリに入力 □データ
の格納を行い、ステップ１１３の処理が終了したら、最
初のステップ１０１に戻って上述の処理を繰り返す。
なお、上述した本実施例では、マトリックス構成された
１６個のキースイッチを有するキー入力装置について述
べたが、キースイッチの数のいかんにかかわらず、本発
明は適用できることは勿論である。
１６個のキースイッチを有するキー入力装置について述
べたが、キースイッチの数のいかんにかかわらず、本発
明は適用できることは勿論である。
［発明の効果コ
以上説明したように、本発明によれば、複数のキー入力
スイッチと複数のキースキャン駆動部とにより時分割で
キー入力を受は付けるキー入力装置において、キースキ
ャンラインに複数の抵抗を並列に配置し、各抵抗片側に
キースイッチを設けたので、構造の単純化と製造コスト
の低減が図られ、また、各キースキャンラインの抵抗値
の変化による電位の変化をアナログ入力端子を通じてア
ナログディジタル変換して３値以上判別できるようにし
たので、マイクロコンピュータの端子の節約が得られ、
特にキースイッチの数が多い時には非常に有効となる。
スイッチと複数のキースキャン駆動部とにより時分割で
キー入力を受は付けるキー入力装置において、キースキ
ャンラインに複数の抵抗を並列に配置し、各抵抗片側に
キースイッチを設けたので、構造の単純化と製造コスト
の低減が図られ、また、各キースキャンラインの抵抗値
の変化による電位の変化をアナログ入力端子を通じてア
ナログディジタル変換して３値以上判別できるようにし
たので、マイクロコンピュータの端子の節約が得られ、
特にキースイッチの数が多い時には非常に有効となる。
第１図は、本発明の１実施例におけるキー入力装置の構
成を示す回路図、 第２図は、第１図における一部の等価回路図、 第３図は第２図の回路の動作状態におけるアナログ入力
値を示す図、 第４図は第１図のキー入力装置の制御動作を示すフロー
チャート、 第５図は第４図のサブルーチンを示すフローチャート、 第６図は従来のキー入力装置の構成を示す回路図である
。 ４・・・マイクロコンピュータ、 ５・・・キー入力部、 ６・・・キースキャン駆動部、 ７〜１０・・・キースキャンライン、 ５１〜Ｓ３２・・・キースイッチ、 Ｒ１〜Ｒ２５・・・抵抗、 Ｔ５〜Ｔ８・・・トランジスタ、 Ｄ１〜Ｄ１［ｉ・・・ダイオード、 Ｑ５〜Ｑ６・・・インバータ、 ｐｃＯ〜ｐｃ３・・・出力端子、 ＡＮＤ・・・アナログ入力端子。 案方也仔ＩＪ装置の一郡の千イ面回闘 第２図 実オ色府・」の１カイ乍：Ｉに態にｈ”ブろアナログＸ
カイ直Ｂ示寄４直第３図 １才回イ列０動イ乍εボＴメインルーチンカフローチャ
ート第４図 第５図
成を示す回路図、 第２図は、第１図における一部の等価回路図、 第３図は第２図の回路の動作状態におけるアナログ入力
値を示す図、 第４図は第１図のキー入力装置の制御動作を示すフロー
チャート、 第５図は第４図のサブルーチンを示すフローチャート、 第６図は従来のキー入力装置の構成を示す回路図である
。 ４・・・マイクロコンピュータ、 ５・・・キー入力部、 ６・・・キースキャン駆動部、 ７〜１０・・・キースキャンライン、 ５１〜Ｓ３２・・・キースイッチ、 Ｒ１〜Ｒ２５・・・抵抗、 Ｔ５〜Ｔ８・・・トランジスタ、 Ｄ１〜Ｄ１［ｉ・・・ダイオード、 Ｑ５〜Ｑ６・・・インバータ、 ｐｃＯ〜ｐｃ３・・・出力端子、 ＡＮＤ・・・アナログ入力端子。 案方也仔ＩＪ装置の一郡の千イ面回闘 第２図 実オ色府・」の１カイ乍：Ｉに態にｈ”ブろアナログＸ
カイ直Ｂ示寄４直第３図 １才回イ列０動イ乍εボＴメインルーチンカフローチャ
ート第４図 第５図
Claims (1)
- 【特許請求の範囲】 １）マトリックス配列の複数のキー入力スイッチと、 該キー入力スイッチを走査するキースキャンラインを有
する複数のキースキャン駆動部とにより時分割でキー入
力を受付けるキー入力装置において、 前記キースキャンラインに複数の抵抗を並列に接続し、
該抵抗の各々の片側に前記キー入力スイッチを各々接続
したこと特徴とするキー入力装置。 ２）特許請求の範囲第１項記載の装置において、前記キ
ースキャンラインの抵抗値の変化による電位の変化を単
一のアナログ入力端子に通じて入力し、該入力した値を
３値以上の閾値で比較してキー入力を判別する制御部を
有することを特徴とするキー入力装置。 ３）特許請求の範囲第２項記載の装置において、前記ア
ナログ入力端子は前記マトリックス配列の複数の入力ラ
インと各々接続し、かつ並列に負荷抵抗と接続し、該負
荷抵抗と前記キースキャンラインの前記抵抗とで分圧さ
れた電圧を前記制御部に入力することを特徴とするキー
入力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61198993A JPS6355617A (ja) | 1986-08-27 | 1986-08-27 | キ−入力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61198993A JPS6355617A (ja) | 1986-08-27 | 1986-08-27 | キ−入力装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6355617A true JPS6355617A (ja) | 1988-03-10 |
Family
ID=16400321
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61198993A Pending JPS6355617A (ja) | 1986-08-27 | 1986-08-27 | キ−入力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6355617A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06124155A (ja) * | 1992-10-13 | 1994-05-06 | Nec Corp | キーボード |
| JPH06131089A (ja) * | 1991-08-02 | 1994-05-13 | Nec Corp | キーボード |
| WO2009119947A1 (en) * | 2008-03-27 | 2009-10-01 | Skydigital Co., Ltd. | Keyboard for detecting a number of keys inputted concurrently and method thereof |
| JP2009541862A (ja) * | 2006-06-20 | 2009-11-26 | クゥアルコム・インコーポレイテッド | 移動体装置におけるキーマトリクスへの２線接続 |
-
1986
- 1986-08-27 JP JP61198993A patent/JPS6355617A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06131089A (ja) * | 1991-08-02 | 1994-05-13 | Nec Corp | キーボード |
| JPH06124155A (ja) * | 1992-10-13 | 1994-05-06 | Nec Corp | キーボード |
| JP2009541862A (ja) * | 2006-06-20 | 2009-11-26 | クゥアルコム・インコーポレイテッド | 移動体装置におけるキーマトリクスへの２線接続 |
| US8471733B2 (en) | 2006-06-20 | 2013-06-25 | Qualcomm Incorporated | Two-wire connection to a key matrix in a mobile device |
| WO2009119947A1 (en) * | 2008-03-27 | 2009-10-01 | Skydigital Co., Ltd. | Keyboard for detecting a number of keys inputted concurrently and method thereof |
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