JPS6288318A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPS6288318A JPS6288318A JP60229382A JP22938285A JPS6288318A JP S6288318 A JPS6288318 A JP S6288318A JP 60229382 A JP60229382 A JP 60229382A JP 22938285 A JP22938285 A JP 22938285A JP S6288318 A JPS6288318 A JP S6288318A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
く技術分野〉
本発明は、MBE(分子線エピタキシー)法により単結
晶基板上に高品質なエピタキシャル層を形成して成る半
導体装置に関するものである。
晶基板上に高品質なエピタキシャル層を形成して成る半
導体装置に関するものである。
〈従来技術〉
近年、MBE成長技術の進歩は著しく、10Å以下の単
分子層オーダーまでの極めて薄いエピタキシャル層の制
御が可能となっている。このようなMBE成長技術の進
歩は半導体装置においても、従来の液相エピタキシャル
層長(LPE)法などでは製作が困難であった極めて薄
い層を有する素子構造に基づく新しい効果を利用した半
導体装置の製作を可能とした。その代表的なものとして
、GaAs/A1GaAs1子井戸(Quantum
Well;略してQW)レーザがある。このQWレー
ザは従来の二重へテロ接合(DI()レーザでは、数百
Å以上あった活性層厚を100人程度あるいはそれ以下
とすることによって、活性層中に量子化準位が形成され
ることを利用しており、従来のDHレーザに比べて閾値
電流が下がる、温度特性が良い、あるいは過渡特性に優
れている等の数々の利点を有している。これに関する参
考文献としては次のようなものがある。
分子層オーダーまでの極めて薄いエピタキシャル層の制
御が可能となっている。このようなMBE成長技術の進
歩は半導体装置においても、従来の液相エピタキシャル
層長(LPE)法などでは製作が困難であった極めて薄
い層を有する素子構造に基づく新しい効果を利用した半
導体装置の製作を可能とした。その代表的なものとして
、GaAs/A1GaAs1子井戸(Quantum
Well;略してQW)レーザがある。このQWレー
ザは従来の二重へテロ接合(DI()レーザでは、数百
Å以上あった活性層厚を100人程度あるいはそれ以下
とすることによって、活性層中に量子化準位が形成され
ることを利用しており、従来のDHレーザに比べて閾値
電流が下がる、温度特性が良い、あるいは過渡特性に優
れている等の数々の利点を有している。これに関する参
考文献としては次のようなものがある。
■ ダブリュー、ティ、ツアング、フィジックス レタ
ーズ、ボリューム39.ナンバー10.ページ786
(1981) (W、 T、 Tsang、 Phys
ics Letters。
ーズ、ボリューム39.ナンバー10.ページ786
(1981) (W、 T、 Tsang、 Phys
ics Letters。
vol、 39. No、IO,pll、 786 (
1981))。
1981))。
■ エヌ、ケイ、ドゥッタア、ジャーナル オヴ アプ
ライド フィジックス、ボリューム53゜ナンバー11
.ページ721.1. (1982XN、 K、 Du
tta。
ライド フィジックス、ボリューム53゜ナンバー11
.ページ721.1. (1982XN、 K、 Du
tta。
Journal of Applied Physic
s、 vol、 53. No、lI。
s、 vol、 53. No、lI。
pp、 7211 (19g2))。
■ エイチ、イワムラ、ティ、ザク、ティ、イシハシ、
ケイ、オオツ力、ワイ、ポリコシ、エレクトロニクス
レターズ、ボリューム19.ナンバー5.ページ180
(1983) (Hllwamura、 T、5ak
u。
ケイ、オオツ力、ワイ、ポリコシ、エレクトロニクス
レターズ、ボリューム19.ナンバー5.ページ180
(1983) (Hllwamura、 T、5ak
u。
T、 l5hibashi、 K、 0tsuka、
Y、 Horikoshi。
Y、 Horikoshi。
Electronics Letters、 vol、
19. No、5. pp、 180(] 983)
)。
19. No、5. pp、 180(] 983)
)。
また、MBE法により作製されたもう1つの代表的な半
導体装置として、GaAsとAjjGaAs界面に形成
された2次元電子ガスの高移動度特性を利用した電界効
果トランジスタ(FET)がある(ティ、ミムラ(’I
’、 Mimura)他 ジャパンジャーナル アプラ
イド フィジックス ポリコーム] 9 (Japn
、 、1 Δpp1.Phys、vo1. 19
)(1980)p、 L225)。 これらの半導体装
置をM B E法で製作する場合、成長層の結晶性が素
子特性に大きな影響を及ぼすことが知られている。特に
、GaAs基板、QGaAs系の素子では、Δ!を含む
A1GaAsの結晶性が成長条件に大きく依存するため
、A4GaAsの結晶性の向−にが重要である。(ダブ
リュ・ティ・ツアンク(W、 T、 Tsang)他
アプライド フィジックス レター ポリコーム36(
1980)ページ118 (Appl、 Pbys、
Lett、 vow、 36(1980) l)、11
8)。
導体装置として、GaAsとAjjGaAs界面に形成
された2次元電子ガスの高移動度特性を利用した電界効
果トランジスタ(FET)がある(ティ、ミムラ(’I
’、 Mimura)他 ジャパンジャーナル アプラ
イド フィジックス ポリコーム] 9 (Japn
、 、1 Δpp1.Phys、vo1. 19
)(1980)p、 L225)。 これらの半導体装
置をM B E法で製作する場合、成長層の結晶性が素
子特性に大きな影響を及ぼすことが知られている。特に
、GaAs基板、QGaAs系の素子では、Δ!を含む
A1GaAsの結晶性が成長条件に大きく依存するため
、A4GaAsの結晶性の向−にが重要である。(ダブ
リュ・ティ・ツアンク(W、 T、 Tsang)他
アプライド フィジックス レター ポリコーム36(
1980)ページ118 (Appl、 Pbys、
Lett、 vow、 36(1980) l)、11
8)。
〈発明の目的〉
本発明は、以」二のにうな事情に鑑み、MBE法を用い
てエピタキシャル成長したエピタキシャル層の結晶性を
従来より向」ニさせることにより、閾値電流が小さく、
温度特性、過渡特性等に優れた半導体装置を提供するこ
とを目的とする。
てエピタキシャル成長したエピタキシャル層の結晶性を
従来より向」ニさせることにより、閾値電流が小さく、
温度特性、過渡特性等に優れた半導体装置を提供するこ
とを目的とする。
〈発明の構成〉
3一
本発明者らは、MBE法により成長したエピタキシャル
層の結晶性を改善する目的で、面方位の異なるGaAs
基板」二にA、1xGa、−xAs (X=0.2〜0
.8)を成長して、エピタキシャル層の結晶性を評価し
た。この結果、従来から用いられている(001)面上
では基板温度720℃以上で表面が完全鏡面の良質なエ
ピタキシャル成長層が得られるが、(011)及び(I
N)B面」二では非鏡面の成長層しか得られないことが
判明した。更に、(Ill)B面の基板について、第1
図に示すように、成長前の硫酸・過酸化水素水・水の混
合液によるエツチングの際に基板周辺部にだれを生じせ
しめ、(Ill)B面より角度が連続して傾いたオフ面
を形成し、同様の成長を行った。この際、通常の(00
1,)面基板上にも同時に成長を行い、両者の比較を行
った。
層の結晶性を改善する目的で、面方位の異なるGaAs
基板」二にA、1xGa、−xAs (X=0.2〜0
.8)を成長して、エピタキシャル層の結晶性を評価し
た。この結果、従来から用いられている(001)面上
では基板温度720℃以上で表面が完全鏡面の良質なエ
ピタキシャル成長層が得られるが、(011)及び(I
N)B面」二では非鏡面の成長層しか得られないことが
判明した。更に、(Ill)B面の基板について、第1
図に示すように、成長前の硫酸・過酸化水素水・水の混
合液によるエツチングの際に基板周辺部にだれを生じせ
しめ、(Ill)B面より角度が連続して傾いたオフ面
を形成し、同様の成長を行った。この際、通常の(00
1,)面基板上にも同時に成長を行い、両者の比較を行
った。
第2図に示すように、GaAs基板31」二に21zm
厚のA l o 、 ? G a o 、 3A 8層
32を成長し、その上に80人厚のGaAs量子井戸層
33を形成し、更に1000人のAI。、7Gao、s
AsAs層成4成長量子井戸層33の発光特性よりAI
−o 、 ? G a o 、 3 A 8層32の結
晶性を評価した。
厚のA l o 、 ? G a o 、 3A 8層
32を成長し、その上に80人厚のGaAs量子井戸層
33を形成し、更に1000人のAI。、7Gao、s
AsAs層成4成長量子井戸層33の発光特性よりAI
−o 、 ? G a o 、 3 A 8層32の結
晶性を評価した。
GaAs基板31の面方位の(11,1)B面からの傾
き角度が0.1〜1度の範囲では完全に鏡面の成長表面
ポモロジ−が得られたが、この範囲をはずれると大小い
ずれ側にずれても非鏡面しか得られなかった。514.
5nmのArレーザ光で励起して量子井戸層33からの
室温におけろフォトルミネッセンスの効率を測定したと
ころ、第3図に示すように、傾き角度が01〜1度の範
囲ではそれ以外の部分に比べて1桁以上高い発光効率が
得られ、この部分の成長層が高い品質を有ずろことが確
認された。同時に(001,)面基板」二に成長を行い
、鏡面の成長が得られたが、量子井戸層33からの発光
強度は、(III)面上の非鏡面の成長層と同一オーダ
ーであり、(III)B面からの傾いた面」二の鏡面成
長部分の方が格段に優れていることがわかった。(11
,1)B面」―の非鏡面成長部の発光効率が比較的高く
、(001)面」二と同程度であるのは、非鏡面の原因
が局部的な表面欠陥の形成によるものであって、表面欠
陥以外の部分は完全鏡面であるため、この部分での発光
が強いことに起因している。
き角度が0.1〜1度の範囲では完全に鏡面の成長表面
ポモロジ−が得られたが、この範囲をはずれると大小い
ずれ側にずれても非鏡面しか得られなかった。514.
5nmのArレーザ光で励起して量子井戸層33からの
室温におけろフォトルミネッセンスの効率を測定したと
ころ、第3図に示すように、傾き角度が01〜1度の範
囲ではそれ以外の部分に比べて1桁以上高い発光効率が
得られ、この部分の成長層が高い品質を有ずろことが確
認された。同時に(001,)面基板」二に成長を行い
、鏡面の成長が得られたが、量子井戸層33からの発光
強度は、(III)面上の非鏡面の成長層と同一オーダ
ーであり、(III)B面からの傾いた面」二の鏡面成
長部分の方が格段に優れていることがわかった。(11
,1)B面」―の非鏡面成長部の発光効率が比較的高く
、(001)面」二と同程度であるのは、非鏡面の原因
が局部的な表面欠陥の形成によるものであって、表面欠
陥以外の部分は完全鏡面であるため、この部分での発光
が強いことに起因している。
以」二のように、(III)8面から0.1〜1度傾い
た而」二に高品質の成長が可能であることを見出したが
、1=れを形成したJli板の周辺部にはその方向に依
存せず、高品質のエビタギンヤル成長が可能であった。
た而」二に高品質の成長が可能であることを見出したが
、1=れを形成したJli板の周辺部にはその方向に依
存せず、高品質のエビタギンヤル成長が可能であった。
このことから傾むかせる方向にはよらないことがわかっ
た。
た。
本発明は、」−記の発見に基づき、面方位が(III)
8面から0.1〜1度傾いた基板」二にMBE成長した
エピタキシャル層を用いて、高性能のデバイスを得るも
のである。
8面から0.1〜1度傾いた基板」二にMBE成長した
エピタキシャル層を用いて、高性能のデバイスを得るも
のである。
〈実施例〉
以下、本発明を図示の実施例により詳細に説明する。
本発明の一実施例であるGRIN−SCI((Gr−a
ded Index 5eparate Confin
ement l1eterostruc−ture)型
半導体レーザの断面構成図を第4図に示す。(+11)
8面から(110)面に向かって0.5度傾むかせたn
−GaAs基板(Si:1018cm″−3ドープ)1
上に、n−GaAsバッファ層2(0,5μm)、n−
八!。7Gao、:+Asクラッド層3(1μm)、ア
ンドープΔ、9xGa+−xAs光ガイド層4(0,2
71m)、アンドープG aA sfi子井戸層5(7
0人)、アンドープAl1xGa+−xAsAsイガ1
1層6.2μm)、p−A ji:o、tG ao、s
Asクラッド層7 (I tt m)、p−GaAsキ
ャップ層8(0,5μm)、n−Al−o−5Gao、
5As電流閉じ込め層9を基板温度720℃において連
続的にMBE成長した。光ガイド層4及び6はクラッド
層3及び7から量子井戸層5の端に向かってへ!混晶比
が0.7−0.2と2乗分布をとるよに変化させている
。成長後、フッ化水素(HF)により電流閉じ込め層9
を5μm幅のストライプ状に選択的に除去し、電流スト
ライプ20を形成し、n側にAuGe−Ni層+1.p
側にAuZn層IOを蒸着・アロイしてオーミック電極
を形成した。このレーザは250μmキャビティ長の場
合、室温での閾値電流40mAで発振した。比較のため
同時に従来の(100) n−GaAs基板」−に同一
の素子構造を製作したところ、閾値電流【J6−7= OmAであり、本発明により半導体レーザの閾値電流が
大幅に低減できた。
ded Index 5eparate Confin
ement l1eterostruc−ture)型
半導体レーザの断面構成図を第4図に示す。(+11)
8面から(110)面に向かって0.5度傾むかせたn
−GaAs基板(Si:1018cm″−3ドープ)1
上に、n−GaAsバッファ層2(0,5μm)、n−
八!。7Gao、:+Asクラッド層3(1μm)、ア
ンドープΔ、9xGa+−xAs光ガイド層4(0,2
71m)、アンドープG aA sfi子井戸層5(7
0人)、アンドープAl1xGa+−xAsAsイガ1
1層6.2μm)、p−A ji:o、tG ao、s
Asクラッド層7 (I tt m)、p−GaAsキ
ャップ層8(0,5μm)、n−Al−o−5Gao、
5As電流閉じ込め層9を基板温度720℃において連
続的にMBE成長した。光ガイド層4及び6はクラッド
層3及び7から量子井戸層5の端に向かってへ!混晶比
が0.7−0.2と2乗分布をとるよに変化させている
。成長後、フッ化水素(HF)により電流閉じ込め層9
を5μm幅のストライプ状に選択的に除去し、電流スト
ライプ20を形成し、n側にAuGe−Ni層+1.p
側にAuZn層IOを蒸着・アロイしてオーミック電極
を形成した。このレーザは250μmキャビティ長の場
合、室温での閾値電流40mAで発振した。比較のため
同時に従来の(100) n−GaAs基板」−に同一
の素子構造を製作したところ、閾値電流【J6−7= OmAであり、本発明により半導体レーザの閾値電流が
大幅に低減できた。
以上、本発明の実施例としてAflGaAs系半導体レ
ーザを例にとって説明したが、本発明の基礎となる現象
はm−v族化合物半導体をMBE成長する際の本質的な
成長機構に基づいているので、MBE成長により作成し
た他のm−v族半導体デバイス全般に適用可能である。
ーザを例にとって説明したが、本発明の基礎となる現象
はm−v族化合物半導体をMBE成長する際の本質的な
成長機構に基づいているので、MBE成長により作成し
た他のm−v族半導体デバイス全般に適用可能である。
例えば、GaAs基板上に作製したGaAs/A4Ga
As、2次元電子ガス電界効果トランジスタやInP基
板」二のInA4As/InGaAsレーザ等がある。
As、2次元電子ガス電界効果トランジスタやInP基
板」二のInA4As/InGaAsレーザ等がある。
〈発明の効果〉
以」二より明らかなように、本発明によれば、エピタキ
シャル層を高品質化でき、閾値電流が小さい等の優れた
特性を有する半導体装置が得られる。
シャル層を高品質化でき、閾値電流が小さい等の優れた
特性を有する半導体装置が得られる。
第1図はエピタキシャル層の基板の面方位依存性を調べ
るために用いたGaAs基板の断面模式図である。第2
図はエピタキシャル層の品質を評価するために成長した
構造の断面模式図である。第3図は量子井戸層からのフ
ォトルミネッセンス発光効率の(III)B而からの傾
き角度の依存性を示す説明図である。第4図は本発明の
一実施例として製作した半導体レーザの断面模式図であ
る。 1 ・・ n−GaAs基板、2・−n−GaAsバッ
ファ層、3”’ n AJLo7Gao、3Asクラ
ッド層、4・・・A 、exG al −XA S光ガ
イド層、5−GaA5i子井戸層、6−A fly、G
a、−xΔS光ガイガ11層、、、p4Z+1−7Ga
o、3Asクラッド層、8・・p−GaASキャップ層
、9・=n−Al。5Gao、sAS電流閉じ込め層、
10.11・・・オーミック電極、20・・電流ストラ
イプ、3l−GaAs基板、32’=A(2o、vGa
o、Js層、33・・・量子井戸層。 特 許 出 願 人 シャープ株式会社代 理 人
弁理士 前出 停他2名 第10 (III) B ↑ 第2図 第31¥1 第4図
るために用いたGaAs基板の断面模式図である。第2
図はエピタキシャル層の品質を評価するために成長した
構造の断面模式図である。第3図は量子井戸層からのフ
ォトルミネッセンス発光効率の(III)B而からの傾
き角度の依存性を示す説明図である。第4図は本発明の
一実施例として製作した半導体レーザの断面模式図であ
る。 1 ・・ n−GaAs基板、2・−n−GaAsバッ
ファ層、3”’ n AJLo7Gao、3Asクラ
ッド層、4・・・A 、exG al −XA S光ガ
イド層、5−GaA5i子井戸層、6−A fly、G
a、−xΔS光ガイガ11層、、、p4Z+1−7Ga
o、3Asクラッド層、8・・p−GaASキャップ層
、9・=n−Al。5Gao、sAS電流閉じ込め層、
10.11・・・オーミック電極、20・・電流ストラ
イプ、3l−GaAs基板、32’=A(2o、vGa
o、Js層、33・・・量子井戸層。 特 許 出 願 人 シャープ株式会社代 理 人
弁理士 前出 停他2名 第10 (III) B ↑ 第2図 第31¥1 第4図
Claims (3)
- (1)分子線エピタキシー法により、単結晶基板上にエ
ピタキシャル層を形成して成る半導体装置において、前
記単結晶基板の面方位が(111)B面より0.1〜1
度の範囲で傾いていることを特徴とする半導体装置。 - (2)前記単結晶基板がGaAs、GaSb、InAs
、InP、GaP、InSbのいずれかから成ることを
特徴とする特許請求の範囲第1項に記載の半導体装置。 - (3)前記エピタキシャル層がIII−V族化合物半導体
であることを特徴とする特許請求の範囲第1項に記載の
半導体装置。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60229382A JPS6288318A (ja) | 1985-10-14 | 1985-10-14 | 半導体装置の製造方法 |
GB8706194A GB2202371B (en) | 1985-10-14 | 1987-03-16 | Semiconductor device |
DE19873709134 DE3709134A1 (de) | 1985-10-14 | 1987-03-20 | Halbleiterbauelement |
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60229382A JPS6288318A (ja) | 1985-10-14 | 1985-10-14 | 半導体装置の製造方法 |
GB8706194A GB2202371B (en) | 1985-10-14 | 1987-03-16 | Semiconductor device |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6288318A true JPS6288318A (ja) | 1987-04-22 |
JPH0473610B2 JPH0473610B2 (ja) | 1992-11-24 |
Family
ID=39345493
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60229382A Granted JPS6288318A (ja) | 1985-10-14 | 1985-10-14 | 半導体装置の製造方法 |
Country Status (3)
Country | Link |
---|---|
JP (1) | JPS6288318A (ja) |
DE (1) | DE3709134A1 (ja) |
GB (1) | GB2202371B (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6431410A (en) * | 1987-07-27 | 1989-02-01 | Sharp Kk | Semiconductor device |
JPH01128423A (ja) * | 1987-11-12 | 1989-05-22 | Sharp Corp | 半導体装置 |
JPH01154513A (ja) * | 1987-12-11 | 1989-06-16 | Sony Corp | エピタキシャル成長法 |
US5647917A (en) * | 1994-09-08 | 1997-07-15 | Sumitomo Electric Industries, Ltd. | Epitaxy for growing compound semiconductors and an InP substrate for epitaxial growth |
JP2013117228A (ja) * | 2011-12-02 | 2013-06-13 | Bosch Mahle Turbo Systems Gmbh & Co Kg | 過給装置 |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH039515A (ja) * | 1989-06-07 | 1991-01-17 | Sharp Corp | 半導体装置 |
CN100453690C (zh) * | 2006-07-21 | 2009-01-21 | 哈尔滨工业大学 | GaAs基InSb薄膜的分子束外延生长方法 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3325314A (en) * | 1961-10-27 | 1967-06-13 | Siemens Ag | Semi-conductor product and method for making same |
US3379584A (en) * | 1964-09-04 | 1968-04-23 | Texas Instruments Inc | Semiconductor wafer with at least one epitaxial layer and methods of making same |
US3476592A (en) * | 1966-01-14 | 1969-11-04 | Ibm | Method for producing improved epitaxial films |
GB8518353D0 (en) * | 1985-07-20 | 1985-08-29 | Plessey Co Plc | Heterostructure device |
EP0214610B1 (en) * | 1985-09-03 | 1990-12-05 | Daido Tokushuko Kabushiki Kaisha | Epitaxial gallium arsenide semiconductor wafer and method of producing the same |
-
1985
- 1985-10-14 JP JP60229382A patent/JPS6288318A/ja active Granted
-
1987
- 1987-03-16 GB GB8706194A patent/GB2202371B/en not_active Expired
- 1987-03-20 DE DE19873709134 patent/DE3709134A1/de active Granted
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Also Published As
Publication number | Publication date |
---|---|
GB2202371A (en) | 1988-09-21 |
DE3709134A1 (de) | 1988-09-29 |
JPH0473610B2 (ja) | 1992-11-24 |
GB8706194D0 (en) | 1987-04-23 |
GB2202371B (en) | 1991-03-20 |
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