JPS62242413A - トランジスタのベ−ス駆動回路 - Google Patents
トランジスタのベ−ス駆動回路Info
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- JPS62242413A JPS62242413A JP61084992A JP8499286A JPS62242413A JP S62242413 A JPS62242413 A JP S62242413A JP 61084992 A JP61084992 A JP 61084992A JP 8499286 A JP8499286 A JP 8499286A JP S62242413 A JPS62242413 A JP S62242413A
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- 238000010586 diagram Methods 0.000 description 14
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明はトランジスタのベース駆動回路に関するもの
である。
である。
＠６図は例えば電気学会技術報告（■部）第１６２号の
３．１９図に示された従来のベース駆動回路である。図
において、１１Ｆｉ主トランジスタ。
３．１９図に示された従来のベース駆動回路である。図
において、１１Ｆｉ主トランジスタ。
１２は主トランジスタ１１を駆動するベース駆動回路で
あＶ、このベース駆動回路１２Ｆｉ主トラ／ジスタ１１
にオンベース電流を供給するオンベース電流供給回路１
３と、主トランジスタ１１に対してオフベース電流を供
給するオフベース電流供給回路１４と、主トランジスタ
１１へのオンオフ指令を増巾する増幅回路１５とで構成
されている。
あＶ、このベース駆動回路１２Ｆｉ主トラ／ジスタ１１
にオンベース電流を供給するオンベース電流供給回路１
３と、主トランジスタ１１に対してオフベース電流を供
給するオフベース電流供給回路１４と、主トランジスタ
１１へのオンオフ指令を増巾する増幅回路１５とで構成
されている。
１３ｍ、１４ａは増幅回路１５の指令に従って交互にオ
ンオフするトランジスタ、１３ｂ、１４ｂは各々トラン
ジスタ１３ａ、１４ａのオン電流およびオフ電流を制限
する抵抗、１３ｃ、１４ｃＦｉオン電流およびオフ電流
供給用の電源、１６Ｆｉオ／オフ指令を与える信号発生
回路である。
ンオフするトランジスタ、１３ｂ、１４ｂは各々トラン
ジスタ１３ａ、１４ａのオン電流およびオフ電流を制限
する抵抗、１３ｃ、１４ｃＦｉオン電流およびオフ電流
供給用の電源、１６Ｆｉオ／オフ指令を与える信号発生
回路である。
第７図（ａ）〜（ｆ） ＃ｉ、第６因に示す回路各部の
動作波形図であり１この動作波形図を参照して第６図の
回路動作について説明する。
動作波形図であり１この動作波形図を参照して第６図の
回路動作について説明する。
時刻Ｔ０において、第７図（ａ）に示すように主トラン
ジスタ１１をオフさせるための信号Ｐｏｎが信号発生回
路１６から、増幅回路１５に供給されると、増幅回路１
５ｔｌｆトランジスタ１３＆に対して第７１ｇ（ｂ）に
示すオンベース電流１ｌｔ−供給するので、トランジス
タ１３ａがオンして主トランジスタ１１のベースには抵
抗１３ｂ（抵抗値Ｒ１）と電源１３ｃ（電圧Ｅ工）およ
び主トランジスタ１１のベース書エミッタ間の順電圧ｖ
ｎｇで規定される電流 Ｉ ｎ＝（Ｉｔ −Ｖ ａ Ｅ ）／Ｒ１−・・−ｎ＋
が流れて主トランジスタ１１がオンする。
ジスタ１１をオフさせるための信号Ｐｏｎが信号発生回
路１６から、増幅回路１５に供給されると、増幅回路１
５ｔｌｆトランジスタ１３＆に対して第７１ｇ（ｂ）に
示すオンベース電流１ｌｔ−供給するので、トランジス
タ１３ａがオンして主トランジスタ１１のベースには抵
抗１３ｂ（抵抗値Ｒ１）と電源１３ｃ（電圧Ｅ工）およ
び主トランジスタ１１のベース書エミッタ間の順電圧ｖ
ｎｇで規定される電流 Ｉ ｎ＝（Ｉｔ −Ｖ ａ Ｅ ）／Ｒ１−・・−ｎ＋
が流れて主トランジスタ１１がオンする。
次いで時刻Ｔ２において、オフ指令ＰｏｎがＬになると
、増幅回路１５の出力はトラ／ジス４１４ａをオフシ、
トラ／ジスタ１３ａをオフするような電流を流すため、
主トランジスタ１１０ベースには ｉ Ｂ＝−Ｒ２／Ｒ２ （ただしＲ２：１４ａの電源電圧＊ Ｒ２： １４ｂの
抵抗値） なる電流が流れて主トランジスタ１１の蓄積ギヤリアが
なくなると１時刻Ｔ、において主トランジスタ１１／ｆ
ｉオンする。時刻Ｔ、以降は、主トランジスタ１１０ベ
ース、エミッタ間の等価抵抗で規定される電流が流れる
ことになる。
、増幅回路１５の出力はトラ／ジス４１４ａをオフシ、
トラ／ジスタ１３ａをオフするような電流を流すため、
主トランジスタ１１０ベースには ｉ Ｂ＝−Ｒ２／Ｒ２ （ただしＲ２：１４ａの電源電圧＊ Ｒ２： １４ｂの
抵抗値） なる電流が流れて主トランジスタ１１の蓄積ギヤリアが
なくなると１時刻Ｔ、において主トランジスタ１１／ｆ
ｉオンする。時刻Ｔ、以降は、主トランジスタ１１０ベ
ース、エミッタ間の等価抵抗で規定される電流が流れる
ことになる。
従来のベース駆動回路は１以上のように構成されている
ので、主トランジスタをオンさせるなめに、（１１式の
ようなベース電流を主トランジスタのベース−エミッタ
間電圧のばらつき（通常、ダーリ／ドアトラ／ジスタで
Ｖ Ｂ ｚ ＝１−３ｖ程度）にあまシ依存しないよう
に供給しようとすれば。
ので、主トランジスタをオンさせるなめに、（１１式の
ようなベース電流を主トランジスタのベース−エミッタ
間電圧のばらつき（通常、ダーリ／ドアトラ／ジスタで
Ｖ Ｂ ｚ ＝１−３ｖ程度）にあまシ依存しないよう
に供給しようとすれば。
ｖｌにの最大値よりもかなり高い電源が必要となる。そ
のため、仮りにベース電流１Ｂ＝３Ａｔ−供給するため
にＥ１＝７Ｖの電源を使用し１通流率５０％の条件で主
トランジスタを動作させようとすれば、オンベース電流
を供給するためだけでも−ｘ （７Ｖｘ ３ Ａ ）
＝ １０．５ＷＯ大＠すｔ力カ必要となり、トランジス
タに大きなベース電流を流丁必要のある場合や、トラン
ジスタの個数が増大した場合にはベース駆動回路用の電
源として大容量のものが必要となるという問題点があっ
た。
のため、仮りにベース電流１Ｂ＝３Ａｔ−供給するため
にＥ１＝７Ｖの電源を使用し１通流率５０％の条件で主
トランジスタを動作させようとすれば、オンベース電流
を供給するためだけでも−ｘ （７Ｖｘ ３ Ａ ）
＝ １０．５ＷＯ大＠すｔ力カ必要となり、トランジス
タに大きなベース電流を流丁必要のある場合や、トラン
ジスタの個数が増大した場合にはベース駆動回路用の電
源として大容量のものが必要となるという問題点があっ
た。
この発明は、上記のような問題点を解消するためになさ
ｎたもので、オンベース電流供給のための１カを極力小
さくすることのできるトランジスタのベース駆動回路を
得ることを目的とする。
ｎたもので、オンベース電流供給のための１カを極力小
さくすることのできるトランジスタのベース駆動回路を
得ることを目的とする。
この発明に係るトランジスタのベース駆動回路は、交流
母線に設けた変流器によって供給される電流を、主回路
電流の極性によって各々２次巻線及び３次巻線に流れる
ように各巻線に整流回路を設け、２次巻線から供給され
る電流は主トランジスタへのオン指令によって主トラン
ジスタのベースへ供給され、オフ指令時には主トランジ
スタのベースへ供給されないようにすると共に、３次巻
線に′ｄＬ流が流れるモードで変流器の鉄心にリセット
をかける構成にしたものである。
母線に設けた変流器によって供給される電流を、主回路
電流の極性によって各々２次巻線及び３次巻線に流れる
ように各巻線に整流回路を設け、２次巻線から供給され
る電流は主トランジスタへのオン指令によって主トラン
ジスタのベースへ供給され、オフ指令時には主トランジ
スタのベースへ供給されないようにすると共に、３次巻
線に′ｄＬ流が流れるモードで変流器の鉄心にリセット
をかける構成にしたものである。
この発明におけるトランジスタのベース駆動回路は、変
流器の２次巻線が該２次巻線に設けられた整流回路を通
って主トランジスタをオンするためのペース電流の大部
分を供給し、これと共にスイッチ手段が主トランジスタ
をオンする時に導通して該主トランジスタのベースに変
流器の２次巻線から供給される電流を電源手段から供給
される電流に重畳して流し、オフする時には半波整流さ
れた電流をバイパスして主トランジスタのベース側に流
入しないようにし、３次巻線は２次巻線に設けた半波整
流回路の順方向に電流が流れない極性に主回路電流が流
れた時に導通し、過電圧抑止回路に発生する電圧によっ
て変流器の鉄心にリセットｋかける方向に電圧を印加す
る。
流器の２次巻線が該２次巻線に設けられた整流回路を通
って主トランジスタをオンするためのペース電流の大部
分を供給し、これと共にスイッチ手段が主トランジスタ
をオンする時に導通して該主トランジスタのベースに変
流器の２次巻線から供給される電流を電源手段から供給
される電流に重畳して流し、オフする時には半波整流さ
れた電流をバイパスして主トランジスタのベース側に流
入しないようにし、３次巻線は２次巻線に設けた半波整
流回路の順方向に電流が流れない極性に主回路電流が流
れた時に導通し、過電圧抑止回路に発生する電圧によっ
て変流器の鉄心にリセットｋかける方向に電圧を印加す
る。
以Ｆ、この発明の一実施例を図について説明する。′Ｉ
ＩＪ１図において、１，２ＩＩ′ｉ直列に接続された直
流電源、３／ｆｉ負荷、４Ｑ、５Ｑは直流電源１゜２と
直流に接続された主回路を構成する主トランジスタで、
この主トランジスタ４Ｑ、５Ｑの接続点と直流電源１．
２の接続点との間に上記負荷３を有する交流母線を接続
している。４Ｄ、５ＤＦｉ主トランジスタ４Ｑ、ＳＱと
夫々並列に接続された帰還ダイオードである。
ＩＪ１図において、１，２ＩＩ′ｉ直列に接続された直
流電源、３／ｆｉ負荷、４Ｑ、５Ｑは直流電源１゜２と
直流に接続された主回路を構成する主トランジスタで、
この主トランジスタ４Ｑ、５Ｑの接続点と直流電源１．
２の接続点との間に上記負荷３を有する交流母線を接続
している。４Ｄ、５ＤＦｉ主トランジスタ４Ｑ、ＳＱと
夫々並列に接続された帰還ダイオードである。
６はベース駆動回路のスイッチ部であＶ、このスイッチ
部６はダイオード６ａと、バイパス用スイッチ６ｂと、
主トランジスタ４Ｑにベース電流を供給するスイッチ６
Ｃと、初期ベース電流を流すための抵抗６ｅおよび電源
６ｆよりなる初期電流供給回路としての電源回路６ｄと
、オフ用の電源６ｇと、主トランジスタ４Ｑをオフする
時に導通するスイッチ６ｊとオフ電流を制限するための
抵抗６ｈとで構成されている。
部６はダイオード６ａと、バイパス用スイッチ６ｂと、
主トランジスタ４Ｑにベース電流を供給するスイッチ６
Ｃと、初期ベース電流を流すための抵抗６ｅおよび電源
６ｆよりなる初期電流供給回路としての電源回路６ｄと
、オフ用の電源６ｇと、主トランジスタ４Ｑをオフする
時に導通するスイッチ６ｊとオフ電流を制限するための
抵抗６ｈとで構成されている。
７は主回路の交流母線を１次巻線とする変流器で、この
変流器７は２次巻線７ａと３次巻線７ｂとで構成されて
いる。この３次巻線ｙｂけダイオード８および過電圧抑
止回路９と直列に接続され、変流器７の鉄心にリセット
をかける作用をする。
変流器７は２次巻線７ａと３次巻線７ｂとで構成されて
いる。この３次巻線ｙｂけダイオード８および過電圧抑
止回路９と直列に接続され、変流器７の鉄心にリセット
をかける作用をする。
第２図は第１図に示す回路各部の動作波形図であり、こ
の動作波形図を参照して第１図の回路動作を説明する。
の動作波形図を参照して第１図の回路動作を説明する。
負荷としては誘導性の負荷３が接続されているとし、第
２因に示すタイミングで主トランジスタ４Ｑ、５Ｑがス
イッチングすることによって、交流電流１１が交流母線
に流れているとする。上記主トランジスタ４Ｑ、５ＱＨ
半サイクルの期間をおいて同じ動作をするので、ここで
はトランジスタ４Ｑ側の動作を例にとって説明する。
２因に示すタイミングで主トランジスタ４Ｑ、５Ｑがス
イッチングすることによって、交流電流１１が交流母線
に流れているとする。上記主トランジスタ４Ｑ、５ＱＨ
半サイクルの期間をおいて同じ動作をするので、ここで
はトランジスタ４Ｑ側の動作を例にとって説明する。
時刻で１において、主トランジスタ４Ｑｔオンさせる場
合、スイッチ６ｃをオフさせる。この時点では２次巻線
７ａからの電流はないので、主トランジスタ４Ｑのベー
スには初期電流を供給する回路６ｄの電源６ｆ（電圧ｔ
Ｅ工とする。）と抵抗６ｅ（抵抗値Ｒ工）および主トラ
ンジスタ４Ｑ時刻Ｔ２において、交流母線電流１１の極
性が反転すると、ダイオード６ａが導通し、スィッチ６
Ｃ全通して上記１２１式の電流と変流器Ｔの２次巻が主
トランジスタ４Ｑのベースに供給される。この時、２次
巻線７ａにはスイッチ６ａｔ−理想スイッチと考えれば
、ダイオード６＆の順方向電圧と主トランジスタ４Ｑの
ベース・エミッタ間電圧”Ｂｇが印加される。
合、スイッチ６ｃをオフさせる。この時点では２次巻線
７ａからの電流はないので、主トランジスタ４Ｑのベー
スには初期電流を供給する回路６ｄの電源６ｆ（電圧ｔ
Ｅ工とする。）と抵抗６ｅ（抵抗値Ｒ工）および主トラ
ンジスタ４Ｑ時刻Ｔ２において、交流母線電流１１の極
性が反転すると、ダイオード６ａが導通し、スィッチ６
Ｃ全通して上記１２１式の電流と変流器Ｔの２次巻が主
トランジスタ４Ｑのベースに供給される。この時、２次
巻線７ａにはスイッチ６ａｔ−理想スイッチと考えれば
、ダイオード６＆の順方向電圧と主トランジスタ４Ｑの
ベース・エミッタ間電圧”Ｂｇが印加される。
時刻Ｔ、において、主トランジスタ４Ｑｋオフする時に
は、スイッチ６ｃｔ−オフすると共にバイパス用スイッ
チ６ｂをオンさせることにより、２次Ｓ線７ａの電流を
主トランジスタ４ＱＯベースへ供給しないようにする。
は、スイッチ６ｃｔ−オフすると共にバイパス用スイッ
チ６ｂをオンさせることにより、２次Ｓ線７ａの電流を
主トランジスタ４ＱＯベースへ供給しないようにする。
ｔ＋、同時にオフ用スイッチ６ｊｔ−オンすることによ
り、主トランジスタ４Ｑのベースにオフ用電源６ｇ（電
圧Ｅ２）および抵抗ｓｈ（抵抗値Ｒ２）によって決まる
べ一スミ流−−ｔ−流すことによって１時刻Ｔ、におい
て、主トランジスタ４Ｑがオフする。時刻Ｔ４から後述
の時刻Ｔ、ｔでは、２次巻線７ｍには。
り、主トランジスタ４Ｑのベースにオフ用電源６ｇ（電
圧Ｅ２）および抵抗ｓｈ（抵抗値Ｒ２）によって決まる
べ一スミ流−−ｔ−流すことによって１時刻Ｔ、におい
て、主トランジスタ４Ｑがオフする。時刻Ｔ４から後述
の時刻Ｔ、ｔでは、２次巻線７ｍには。
スイッチ５ｂｔ−理想スイッチとすれば、ダイオード６
ａの順方向電圧が印加される。
ａの順方向電圧が印加される。
時刻Ｔ、において、交流母線電流１、の極性が反転する
と、ダイオード６ａはオフし％３次巻線７ｂに接続され
た夕°イオード８が導通する。その結果、３次巻線７ｂ
には過電圧抑止回路９の電圧Ｅ、が印加され始め１時刻
Ｔ２から同Ｔ、までの間に２次巻線７ａによって変流器
７の鉄心に印加・・・・・・＋５１（Ｎ：３次巻線７ｂ
の巻数〕なる電流が過電圧抑止回路９に流入する。この
期間に変流器１の鉄心が逆励磁されてリセット状態とな
る。
と、ダイオード６ａはオフし％３次巻線７ｂに接続され
た夕°イオード８が導通する。その結果、３次巻線７ｂ
には過電圧抑止回路９の電圧Ｅ、が印加され始め１時刻
Ｔ２から同Ｔ、までの間に２次巻線７ａによって変流器
７の鉄心に印加・・・・・・＋５１（Ｎ：３次巻線７ｂ
の巻数〕なる電流が過電圧抑止回路９に流入する。この
期間に変流器１の鉄心が逆励磁されてリセット状態とな
る。
なお、上記実施例では変流器７の２次電流を整−流する
ためのダイオード６ａｔ、変流器７０２次巻線７ａに対
して１個だけ設けているが、第３図に示す↓うにベース
電流を供給する経路および短絡する経路に、ダイオード
６に、６１を別々に設けても工い。
ためのダイオード６ａｔ、変流器７０２次巻線７ａに対
して１個だけ設けているが、第３図に示す↓うにベース
電流を供給する経路および短絡する経路に、ダイオード
６に、６１を別々に設けても工い。
ま之、第４図に示すように、初期電流を供給する回路は
スイッチ６ｍｅ含む回路構成とし、スイッチ６ｃを通さ
ずに主トランジスタ４Ｑのベースへ初期電流を供給する
ようにしてもぷい。
スイッチ６ｍｅ含む回路構成とし、スイッチ６ｃを通さ
ずに主トランジスタ４Ｑのベースへ初期電流を供給する
ようにしてもぷい。
上記実施例では、過電圧抑止回路９を変流器７に対応さ
せて図示したが、他の変流器のリセット用として共用し
てもよい。
せて図示したが、他の変流器のリセット用として共用し
てもよい。
また、上記実施例でＩＩ′ｉ３次巻線７ｂの整流手段と
して半波整流回路を示したが、全波整流回路を用いても
同様の効果を奏する。
して半波整流回路を示したが、全波整流回路を用いても
同様の効果を奏する。
また、第５図に示すように、変流器Ｔに４次巻線７ｃを
設けると共に、交流リプル全抑制する直流電源にて上記
４次巻線に電流を流す構成とすればインバータ装置起動
時においても確実に変流器７の鉄心にリセットをかける
ことができる。
設けると共に、交流リプル全抑制する直流電源にて上記
４次巻線に電流を流す構成とすればインバータ装置起動
時においても確実に変流器７の鉄心にリセットをかける
ことができる。
また、上記実施例ではハーフブリッジ電圧給電形インバ
ータの場合を示し九が、フルブリッジ形インバータでも
よく、また、電流給電形のインバータに用いても上記実
施例と同様の効果を奏する。
ータの場合を示し九が、フルブリッジ形インバータでも
よく、また、電流給電形のインバータに用いても上記実
施例と同様の効果を奏する。
以上のように、この発明によれば、主トランジスタに供
給すべきベース′成流の大部分を交流母線に設けた変流
器によって供給するように構成とし。
給すべきベース′成流の大部分を交流母線に設けた変流
器によって供給するように構成とし。
主トランジスタをオフさせる期間に必ず流す電流は小さ
くしたので、ベース駆動回路を動作させるために供給す
る電力が小さくてよいという効果がある。
くしたので、ベース駆動回路を動作させるために供給す
る電力が小さくてよいという効果がある。
第１図はこの発明の一実施例によるベース駆動回路を示
す回路回、＠２図＃ｉ第１図に示す回路各部の動作波形
図、第３図、第４図はスイッチ部の他の構成を示す回路
図、第５図はこの発明の他の実施例を示す回路図、第６
図は従来のベース駆動回路を示す回路図、第７図は第６
図に示す回路各部の動作波形図である◇ １．２は直流電源、３は交流母線に設けた負荷。 ４Ｑ、５Ｑは主トランジスタ、６ａ＃：を第１の整流手
段（ダイオード）、６ａＩＩｉ第１のスイッチング素子
（トランジスタ）、６ｂは第２のスイッチング素子（ト
ランジスタ）、６ｄ＃：を初期電流供給回路（電源回路
）＆７Ｆｉ変流器、７ａ、７ｂ＋７ｅは各々変流器７の
２次、３次、４次巻線、８け第２の整流手段（ダイオー
ド） 、５ｉｆｔ過電圧抑止回路。 なお、図中、同一符号は同一、又は相当部分を示す。 特許出願人 三菱電機株式会社 （外２名）’−” 第１図 第２図 第３図 第４図 ６ｍ：トフレシ゛スタスイ１す 第５図 １０：交ジ先すリ゛ｌレー１作用と鳴すう直Ｓ先電ご凰
第６図 第７図 手続補正書（自発）
す回路回、＠２図＃ｉ第１図に示す回路各部の動作波形
図、第３図、第４図はスイッチ部の他の構成を示す回路
図、第５図はこの発明の他の実施例を示す回路図、第６
図は従来のベース駆動回路を示す回路図、第７図は第６
図に示す回路各部の動作波形図である◇ １．２は直流電源、３は交流母線に設けた負荷。 ４Ｑ、５Ｑは主トランジスタ、６ａ＃：を第１の整流手
段（ダイオード）、６ａＩＩｉ第１のスイッチング素子
（トランジスタ）、６ｂは第２のスイッチング素子（ト
ランジスタ）、６ｄ＃：を初期電流供給回路（電源回路
）＆７Ｆｉ変流器、７ａ、７ｂ＋７ｅは各々変流器７の
２次、３次、４次巻線、８け第２の整流手段（ダイオー
ド） 、５ｉｆｔ過電圧抑止回路。 なお、図中、同一符号は同一、又は相当部分を示す。 特許出願人 三菱電機株式会社 （外２名）’−” 第１図 第２図 第３図 第４図 ６ｍ：トフレシ゛スタスイ１す 第５図 １０：交ジ先すリ゛ｌレー１作用と鳴すう直Ｓ先電ご凰
第６図 第７図 手続補正書（自発）
Claims (3)
- （１）第１、第２の直流電源と直列に接続された第１、
第２のトランジスタと、前記第１、第２の直流電源の接
続点と前記第１、第２のトランジスタの接続点との間に
接続された交流母線と、前記交流母線の電流に付勢され
て電流を誘起する２次巻線と３次巻線を有する変流器と
、前記２次巻線に誘起する電流を半波整流する第１の整
流手段と、前記第１の整流手段から出力される整流電流
を前記第１、第２のトランジスタのいずれかのベースへ
供給する第１のスイッチング素子と、前記第１のスイッ
チング素子を流れる電流に重畳して前記トランジスタの
ベースへ初期電流を供給する初期電流供給回路と、前記
整流電流を前記トランジスタのベースへ供給しないよう
にバイパスするための第２のスイッチング素子と、前記
変流器の３次巻線に誘起する電流を整流する第２の整流
手段と、前記第２の整流手段に接続され前記変流器の鉄
心にリセットをかける過電圧抑止手段とを備えたトラン
ジスタのベース駆動回路。 - （２）変流器に４次巻線を設け、前記４次巻線に交流リ
ップル電流抑制機能を有する直流電源を接続したことを
特徴とする特許請求の範囲第（１）項記載のトランジス
タのベース駆動回路。 - （３）過電圧抑止手段として直流電源を用いることを特
徴とする特許請求の範囲第（１）項または第（２）項記
載のトランジスタのベース駆動回路。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61084992A JPS62242413A (ja) | 1986-04-15 | 1986-04-15 | トランジスタのベ−ス駆動回路 |
| KR1019860006843A KR900001809B1 (ko) | 1986-04-15 | 1986-08-19 | 트랜지스터의 베이스구동회로 |
| DE19873710801 DE3710801A1 (de) | 1986-04-15 | 1987-03-31 | Basissteuerschaltung fuer einen transistor |
| US07/037,836 US4775803A (en) | 1986-04-15 | 1987-04-13 | Base drive circuit of transistor |
| CA534704A CA1268221C (en) | 1986-04-15 | 1987-04-14 | TRANSISTOR BASE ATTACK CIRCUIT |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61084992A JPS62242413A (ja) | 1986-04-15 | 1986-04-15 | トランジスタのベ−ス駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62242413A true JPS62242413A (ja) | 1987-10-23 |
| JPH0464207B2 JPH0464207B2 (ja) | 1992-10-14 |
Family
ID=13846126
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61084992A Granted JPS62242413A (ja) | 1986-04-15 | 1986-04-15 | トランジスタのベ−ス駆動回路 |
Country Status (5)
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|---|---|
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| JP (1) | JPS62242413A (ja) |
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Family Cites Families (7)
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-
1987
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- 1987-04-14 CA CA534704A patent/CA1268221C/en not_active Expired
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