JPS62240566A - 感熱記録制御方法 - Google Patents
感熱記録制御方法Info
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- JPS62240566A JPS62240566A JP60266329A JP26632985A JPS62240566A JP S62240566 A JPS62240566 A JP S62240566A JP 60266329 A JP60266329 A JP 60266329A JP 26632985 A JP26632985 A JP 26632985A JP S62240566 A JPS62240566 A JP S62240566A
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- NGVDGCNFYWLIFO-UHFFFAOYSA-N pyridoxal 5'-phosphate Chemical compound CC1=NC=C(COP(O)(O)=O)C(C=O)=C1O NGVDGCNFYWLIFO-UHFFFAOYSA-N 0.000 description 3
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Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/315—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material
- B41J2/32—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads
- B41J2/35—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads providing current or voltage to the thermal head
- B41J2/355—Control circuits for heating-element selection
- B41J2/36—Print density control
Landscapes
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の技術分野］
本発明は感熱記録装置の感熱記録制御方法に関し、詳し
くは感熱素子の蓄熱補正に関するものである。
くは感熱素子の蓄熱補正に関するものである。
［発明の技術的背ｌｌ］
周知のように、感熱記録装置は記録媒体の主走査方向の
画素に対応した発熱素子のそれぞれを画素毎の記録デー
タに従って発熱させ、この発熱素子に摺接する感熱記録
紙やインクドナーシート等の記録媒体を発色させること
により、文字や画像の記録を行うものである。
画素に対応した発熱素子のそれぞれを画素毎の記録デー
タに従って発熱させ、この発熱素子に摺接する感熱記録
紙やインクドナーシート等の記録媒体を発色させること
により、文字や画像の記録を行うものである。
このような感熱記録装置において、主走査方向における
１記録ラインの記録周期を’ｌ Ｑｍｓ以下に設定した
低速記録のものでは、゛同一発熱素子を各記録ライン毎
に連続して発熱させたとしても、次の記録ラインの記録
動作に移る前に発熱素子の放熱がほぼ完了するため、発
熱素子の蓄熱による記録濃度のばらつきは生じない。
１記録ラインの記録周期を’ｌ Ｑｍｓ以下に設定した
低速記録のものでは、゛同一発熱素子を各記録ライン毎
に連続して発熱させたとしても、次の記録ラインの記録
動作に移る前に発熱素子の放熱がほぼ完了するため、発
熱素子の蓄熱による記録濃度のばらつきは生じない。
ところが、記録周期をＩ Ｑｍｓ以下にした高速記録の
ものでは、放熱が完了しないうちに次の記録動作に移る
ことになるため、蓄熱による記録濃度のばらつきが生じ
てしまう。
ものでは、放熱が完了しないうちに次の記録動作に移る
ことになるため、蓄熱による記録濃度のばらつきが生じ
てしまう。
そこで、従来において、各画素毎に前ラインあるいは前
々ラインの記録データの有無によって当該画素の記録履
歴を調べ、その記録履歴に応じて発熱素子の印加パルス
幅あるいは印加電圧を開開して蓄熱による画質の劣化を
補正するようにした記録制御方法が実施されている。
々ラインの記録データの有無によって当該画素の記録履
歴を調べ、その記録履歴に応じて発熱素子の印加パルス
幅あるいは印加電圧を開開して蓄熱による画質の劣化を
補正するようにした記録制御方法が実施されている。
［背景技術の問題点］
ところが、上記のように各画素の記録囮歴に応じて現在
の記録ラインの各画素の発熱素子に印加する印加パルス
幅あるいは印加電圧を制御する方法においては、前ライ
ン以前の記録データによる蓄熱の影響が現れなくなるラ
イン数に相当する吊の記録データを保存しておかなけれ
ばならないため、記録周期をさらに短くする場合にはそ
の周期の短縮量に比例して記録データを保存するための
記憶手段が増加し、回路が複雑で高価なものになるとい
う問題がある。
の記録ラインの各画素の発熱素子に印加する印加パルス
幅あるいは印加電圧を制御する方法においては、前ライ
ン以前の記録データによる蓄熱の影響が現れなくなるラ
イン数に相当する吊の記録データを保存しておかなけれ
ばならないため、記録周期をさらに短くする場合にはそ
の周期の短縮量に比例して記録データを保存するための
記憶手段が増加し、回路が複雑で高価なものになるとい
う問題がある。
［発明の目的］
本発明は上記のような問題点を除去し、簡単で安価な回
路構成で発熱素子の蓄熱による画質の劣化を防止するこ
とができる感熱記録制御方法を提供することを目的とす
る。
路構成で発熱素子の蓄熱による画質の劣化を防止するこ
とができる感熱記録制御方法を提供することを目的とす
る。
［発明の概要１
本発明では、各画素の記録履歴または記録履歴と主走査
方向に隣接する画素の記録データの有無に応じて現在の
記録ラインにおける画素の感熱素子の通電回数を制御す
ることにより、上記の目的を達成するものである。
方向に隣接する画素の記録データの有無に応じて現在の
記録ラインにおける画素の感熱素子の通電回数を制御す
ることにより、上記の目的を達成するものである。
［発明の実施例］
第１図は本発明を適用した感熱記録装置の記録制御回路
の一実施例を示すブロック図である。同図において、１
はシリアルデータとして入力される各画素の記録データ
ＨＤを８ビット並列の記録データに変換する直列／並列
変換器（ＳＰＣ）、２は１画素単位の記録データＨＤの
入力周期に同期したクロック信号ＨＧＫをカウントし、
そのカウント値が「８」 （最大値）に達する毎にラッ
チパルスＬＰ１を発生する３ビツトカウンタ、３は前記
ラッチパルスＬＰ１によって５ＰＣＩから出力される並
列８ビツトの記録データをラッチするラッチ、４は現在
の記録ラインｎとそれ以前の３つのラインｎ−１，ｎ−
２，ｎ−３の記録データを記憶する第１メモリ、５はこ
の第１メモリにおける記録データの入出力径路を開閉す
る双方向のトライステートゲート、６は現在の記録ライ
ンにおける記録データＨＤを記憶するラッチ、７は第１
メモリ４から時分割で読み出されるｎ−１，ｎ−２，ｎ
−３の記録ラインにおける記録データを記憶するラッチ
、８は８個のインバータとアンドゲートとから成り、現
在の記録ラインｎとそれ以前の記録ラインｎ−ｉ （ｉ
＝１．２．３）の記録データとを同−画漿同志で比較し
、記録ラインｎの画素に記録データがあり、かつｎ−ｉ
の記録ラインの同一画素に記録データが無ければ“１”
のデータを当該画素の履歴データＨＤＤ ｉとして出力
する履歴データ作成回路、９は履歴データＨＤＤｉを出
力するためのトライステートゲート、１０および１１は
一方が読出しモードの時は他方が出込みモードに制御さ
れ、現在の記録ラインｎの記録データＨＤと前記履歴デ
ータ作成回路８で作成された３ライン分の履歴データ）
（ＤＤ ｉとを記憶する第２および第３メモリ、１２−
１〜１２−８は読出しモードとなっている第２メモリ１
０（または第３メモリ１１）カーら読み出されたｎ己録
データＨＤおよび３ライン分の履歴データＨＤＤｉをラ
イン単位で時分割的に記憶するラッチ、１３−１〜１３
−８はラッチ１２−１〜１２−８に記憶されたブタＨＤ
、ｔ（ＤＤｉを８ビツトシリアルのデータ８１１〜８１
８として８個の感熱素子（図示せず）にそれぞれ供給す
る並列／直列変換回路（ＰＳＧ）、１４および１５は第
２および第３メモリ１０．１１のデータ入出力径路をそ
れぞれ開閉する双方向のトライステートゲート、１６お
よび１７はラッチ１２−１〜１２−８のデータ入力径路
を開閉するトライステートゲート、１８は履歴データ１
−ＩＤＤｉを作成するための履歴データ作成用制御回路
、１９は履歴データの作成時に用いるメモリ４の読出し
アドレスデータおよびメモリ１０（または１１）の書込
みアドレスデータを出力するアドレスカウンタ、２０は
メモリ１０（または１１）に記憶された記録ラインｎの
記録ブタＨＤおよび３ライン分のｌｌｌ歴データＨＯＤ
ｉを読み出して発熱素子に転送するためのデータ転送
用制御回路、２１はデータ転送時に用いるメモリ１０（
または１１）の読出しアドレスデータを出力するアドレ
スカウンタ、２２は記録ラインｎの記録データＨＤの入
力開始時に入力されるライン同期信号Ｌ Ｓ Ｔに基づ
いてメモリ１０および１１を１ライン毎に交互に読出し
モードと書込みモードに制御するメモリモード制御回路
、２３はメモリ１０および１１のうち読出しモードとな
っているメモリに対してデータ転送用のアドレスカウン
タ２１から出力されるアドレスデータを供給Ｕ、また書
込みモードと成っているメモリに対して履歴データ作成
用のアドレスカウンタ１９から出力されるアドレスデー
タを供給するアドレスセレクタ、２４はブロック印字ス
タート信号ＢＰＳを受け、ＰＳＣ１３−１〜１３−８か
ら出力されるデータ８１１〜８１８を発熱素子の入力段
のラッチ（図示せず）にラッチさせるためのラッチパル
スＰＬＰを出力する同期回路である。
の一実施例を示すブロック図である。同図において、１
はシリアルデータとして入力される各画素の記録データ
ＨＤを８ビット並列の記録データに変換する直列／並列
変換器（ＳＰＣ）、２は１画素単位の記録データＨＤの
入力周期に同期したクロック信号ＨＧＫをカウントし、
そのカウント値が「８」 （最大値）に達する毎にラッ
チパルスＬＰ１を発生する３ビツトカウンタ、３は前記
ラッチパルスＬＰ１によって５ＰＣＩから出力される並
列８ビツトの記録データをラッチするラッチ、４は現在
の記録ラインｎとそれ以前の３つのラインｎ−１，ｎ−
２，ｎ−３の記録データを記憶する第１メモリ、５はこ
の第１メモリにおける記録データの入出力径路を開閉す
る双方向のトライステートゲート、６は現在の記録ライ
ンにおける記録データＨＤを記憶するラッチ、７は第１
メモリ４から時分割で読み出されるｎ−１，ｎ−２，ｎ
−３の記録ラインにおける記録データを記憶するラッチ
、８は８個のインバータとアンドゲートとから成り、現
在の記録ラインｎとそれ以前の記録ラインｎ−ｉ （ｉ
＝１．２．３）の記録データとを同−画漿同志で比較し
、記録ラインｎの画素に記録データがあり、かつｎ−ｉ
の記録ラインの同一画素に記録データが無ければ“１”
のデータを当該画素の履歴データＨＤＤ ｉとして出力
する履歴データ作成回路、９は履歴データＨＤＤｉを出
力するためのトライステートゲート、１０および１１は
一方が読出しモードの時は他方が出込みモードに制御さ
れ、現在の記録ラインｎの記録データＨＤと前記履歴デ
ータ作成回路８で作成された３ライン分の履歴データ）
（ＤＤ ｉとを記憶する第２および第３メモリ、１２−
１〜１２−８は読出しモードとなっている第２メモリ１
０（または第３メモリ１１）カーら読み出されたｎ己録
データＨＤおよび３ライン分の履歴データＨＤＤｉをラ
イン単位で時分割的に記憶するラッチ、１３−１〜１３
−８はラッチ１２−１〜１２−８に記憶されたブタＨＤ
、ｔ（ＤＤｉを８ビツトシリアルのデータ８１１〜８１
８として８個の感熱素子（図示せず）にそれぞれ供給す
る並列／直列変換回路（ＰＳＧ）、１４および１５は第
２および第３メモリ１０．１１のデータ入出力径路をそ
れぞれ開閉する双方向のトライステートゲート、１６お
よび１７はラッチ１２−１〜１２−８のデータ入力径路
を開閉するトライステートゲート、１８は履歴データ１
−ＩＤＤｉを作成するための履歴データ作成用制御回路
、１９は履歴データの作成時に用いるメモリ４の読出し
アドレスデータおよびメモリ１０（または１１）の書込
みアドレスデータを出力するアドレスカウンタ、２０は
メモリ１０（または１１）に記憶された記録ラインｎの
記録ブタＨＤおよび３ライン分のｌｌｌ歴データＨＯＤ
ｉを読み出して発熱素子に転送するためのデータ転送
用制御回路、２１はデータ転送時に用いるメモリ１０（
または１１）の読出しアドレスデータを出力するアドレ
スカウンタ、２２は記録ラインｎの記録データＨＤの入
力開始時に入力されるライン同期信号Ｌ Ｓ Ｔに基づ
いてメモリ１０および１１を１ライン毎に交互に読出し
モードと書込みモードに制御するメモリモード制御回路
、２３はメモリ１０および１１のうち読出しモードとな
っているメモリに対してデータ転送用のアドレスカウン
タ２１から出力されるアドレスデータを供給Ｕ、また書
込みモードと成っているメモリに対して履歴データ作成
用のアドレスカウンタ１９から出力されるアドレスデー
タを供給するアドレスセレクタ、２４はブロック印字ス
タート信号ＢＰＳを受け、ＰＳＣ１３−１〜１３−８か
ら出力されるデータ８１１〜８１８を発熱素子の入力段
のラッチ（図示せず）にラッチさせるためのラッチパル
スＰＬＰを出力する同期回路である。
以上の構成において、ライン同期信号ＬＳＴおよびクロ
ック信号ＨＣＫに同期して記録ラインｎの記録データＨ
Ｄは５ＰＣＩにおいて並列８ビツトの記録データＨＤに
順次変換され、カウンタ２から８ビツト周期毎に出力さ
れるラッチパルスＬＰ１によってラッチ３にラッチされ
る。
ック信号ＨＣＫに同期して記録ラインｎの記録データＨ
Ｄは５ＰＣＩにおいて並列８ビツトの記録データＨＤに
順次変換され、カウンタ２から８ビツト周期毎に出力さ
れるラッチパルスＬＰ１によってラッチ３にラッチされ
る。
一方、メモリモード制御回路２２はライン同期信号ＬＳ
Ｔが入力されたことにより、第２メモリ１０および第３
メモリ１１の動作モードを書込みモードから読出しモー
ド、あるいは読出しモードから害込みモードへ切替える
。すなわち、ｎ−１ライン目の記録データＨＤの入力時
は第３メモリ１１がｍ込みモード、第２メモリ１０が読
出しモードとなっていたものとすると、今度は第２メモ
リ１０を書込みモード、第３メモリ１１を読出しモード
に切替える。
Ｔが入力されたことにより、第２メモリ１０および第３
メモリ１１の動作モードを書込みモードから読出しモー
ド、あるいは読出しモードから害込みモードへ切替える
。すなわち、ｎ−１ライン目の記録データＨＤの入力時
は第３メモリ１１がｍ込みモード、第２メモリ１０が読
出しモードとなっていたものとすると、今度は第２メモ
リ１０を書込みモード、第３メモリ１１を読出しモード
に切替える。
一方、履歴データ作成用の制御回路１８は記録ラインｎ
の記録データＨＤが入力され始めたことに伴い、この記
録データを８ピット単位の並列データＨＤに変換してい
る間に次の７つのステートＳＴ１〜ＳＴ７から成る動作
を制御し、記録ラインｎに関するｌｉｌ歴データＨＤＤ
ｉ （ｉ＝１．２゜３）を作成し、害込みモードとなっ
てりる第２メモリ１０に書込む。
の記録データＨＤが入力され始めたことに伴い、この記
録データを８ピット単位の並列データＨＤに変換してい
る間に次の７つのステートＳＴ１〜ＳＴ７から成る動作
を制御し、記録ラインｎに関するｌｉｌ歴データＨＤＤ
ｉ （ｉ＝１．２゜３）を作成し、害込みモードとなっ
てりる第２メモリ１０に書込む。
すなわち、第１ステートＳＴ１において、ラッチ３にラ
ッチされた第にバイト目（ｋ＝１〜８）の記録データＨ
Ｄを第１メモリ４および書込みモードとなっている第２
メモリ１０に書込む。さらにラッチ６にラッチさせる。
ッチされた第にバイト目（ｋ＝１〜８）の記録データＨ
Ｄを第１メモリ４および書込みモードとなっている第２
メモリ１０に書込む。さらにラッチ６にラッチさせる。
この場合、メモリ４には現在の記録ラインｎとそれ以前
の記録ラインｎ−１，ｎ−２，ｎ−３の記録データＨ０
１、）−ＩＤ２．ＨＯ２をライン単位で記憶するエリア
ＭＥｏ 、ＭＥｌ 、ＭＥ２ 、ＭＥ３が用意されてい
るため、記録ラインｎの記録データＨＤはこれに対応す
るエリアＭＥＯに書込まれる。同様に、メモリ１０およ
び１１についても現在の記録ラインｎの記録データＨＤ
と３ライン分の履歴データＨＤＤＩ 、ＨＣＯ２、ＨＣ
Ｏ３をライン単位で記憶するエリアＭＥＯ、ＭＥ１．Ｍ
Ｅ２ 、ＭＥ３が用意されているため、記録ラインｎの
記録データＨＤはこれに対応するエリアＭＥＯに書込ま
れる。
の記録ラインｎ−１，ｎ−２，ｎ−３の記録データＨ０
１、）−ＩＤ２．ＨＯ２をライン単位で記憶するエリア
ＭＥｏ 、ＭＥｌ 、ＭＥ２ 、ＭＥ３が用意されてい
るため、記録ラインｎの記録データＨＤはこれに対応す
るエリアＭＥＯに書込まれる。同様に、メモリ１０およ
び１１についても現在の記録ラインｎの記録データＨＤ
と３ライン分の履歴データＨＤＤＩ 、ＨＣＯ２、ＨＣ
Ｏ３をライン単位で記憶するエリアＭＥＯ、ＭＥ１．Ｍ
Ｅ２ 、ＭＥ３が用意されているため、記録ラインｎの
記録データＨＤはこれに対応するエリアＭＥＯに書込ま
れる。
次に、第２ステートＳＴ２において、ラッチ３およびゲ
ート１５をハイインピーダンス状態とし、第ｎ−１ライ
ンの記録データをメモリ４のエリアＭＥ１から読出し、
ラッチ７ヘラツチさぎる。これにより、履歴データ作成
回路８では第ｎラインと第ｎ−１ライン目の記録データ
がそれぞれ対応する画素同志で比較され、ｎ−１ライン
の記録データとの関係のＩ［１１ｕデータｌ−１００１
が形成される。
ート１５をハイインピーダンス状態とし、第ｎ−１ライ
ンの記録データをメモリ４のエリアＭＥ１から読出し、
ラッチ７ヘラツチさぎる。これにより、履歴データ作成
回路８では第ｎラインと第ｎ−１ライン目の記録データ
がそれぞれ対応する画素同志で比較され、ｎ−１ライン
の記録データとの関係のＩ［１１ｕデータｌ−１００１
が形成される。
次に、第３ステートＳＴ３において、ラッチ３およびゲ
ート５をハイインピーダンス状態とし、またゲート９．
ゲート１５を開状態とし、第ｎラインと第ｎ−１ライン
との関係の履歴データＨＤＤ１をメモリ１０のエリアＭ
ＥＩに虐込む。
ート５をハイインピーダンス状態とし、またゲート９．
ゲート１５を開状態とし、第ｎラインと第ｎ−１ライン
との関係の履歴データＨＤＤ１をメモリ１０のエリアＭ
ＥＩに虐込む。
次に第４ステートＳＴ４において、ラッチ３およびゲー
ト１５をハイインピーダンス状態とし、第ｎ−２ライン
目の記録データをメモリ４のエリアＭＥ２から読出し、
ラッチ７ヘラツチさぜる。
ト１５をハイインピーダンス状態とし、第ｎ−２ライン
目の記録データをメモリ４のエリアＭＥ２から読出し、
ラッチ７ヘラツチさぜる。
これにより、履歴データ作成回路８では第ｎラインと第
ｎ−２ライン目の記録データがそれぞれ対応する画素同
志で比較され、ｎ−２ラインの記録データとの関係の履
歴データＨＤＤ２が形成される。
ｎ−２ライン目の記録データがそれぞれ対応する画素同
志で比較され、ｎ−２ラインの記録データとの関係の履
歴データＨＤＤ２が形成される。
次に、第５ステートＳＴ５において、ラッチ３およびゲ
ート５をハイインピーダンス状態とし、またゲート９．
ゲート１５を開状態とし、第ｎラインと第ｎ−２ライン
との関係の履歴データＨＤＤ２をメモリ１０のエリアＭ
Ｅ２に出込む。
ート５をハイインピーダンス状態とし、またゲート９．
ゲート１５を開状態とし、第ｎラインと第ｎ−２ライン
との関係の履歴データＨＤＤ２をメモリ１０のエリアＭ
Ｅ２に出込む。
次に第６ステートＳＴ６において、ラッチ３およびゲー
ト１５をハイインピーダンス状態とし、第ｎ−３ライン
の記録データをメモリ４のエリアＭＥ３から読出し、ラ
ッチ７ヘラツチさせる。これにより、履歴データ作成回
路８では第ｎラインと第ｎ−３ライン目の記録データが
それぞれ対応する画素同志で比較され、ｎ−３ラインの
記録データとの関係のａｌｆｆｌデータｌ−１［）０３
が形成される。
ト１５をハイインピーダンス状態とし、第ｎ−３ライン
の記録データをメモリ４のエリアＭＥ３から読出し、ラ
ッチ７ヘラツチさせる。これにより、履歴データ作成回
路８では第ｎラインと第ｎ−３ライン目の記録データが
それぞれ対応する画素同志で比較され、ｎ−３ラインの
記録データとの関係のａｌｆｆｌデータｌ−１［）０３
が形成される。
次に、第７ステートＳＴ？において、ラッチ３およびゲ
ート５をハイインピーダンス状態とし、またゲート９．
ゲート１５を開状態とし、第ｎラインと第ｎ−３ライン
との関係の履歴データ１−ＩＤＤ３をメモリ１０のエリ
アＭＥ３に書込む。
ート５をハイインピーダンス状態とし、またゲート９．
ゲート１５を開状態とし、第ｎラインと第ｎ−３ライン
との関係の履歴データ１−ＩＤＤ３をメモリ１０のエリ
アＭＥ３に書込む。
以上の動作は、１ラインの画素数が６４ビツトであり、
また５ＰＣ１における変換動作が８ビット単位で行なわ
れるため、合計で８回繰返される・これにより、６４画
素の記録ラインｎとそれ以前の記録ラインｎ−１，ｎ−
２，ｎ−３との関係の履歴データＨＤＤ１〜ＨＤＤ３が
形成され、書込みモードとなっているメモリ１０のエリ
アＭＥ１〜ＭＥ３に記憶される。
また５ＰＣ１における変換動作が８ビット単位で行なわ
れるため、合計で８回繰返される・これにより、６４画
素の記録ラインｎとそれ以前の記録ラインｎ−１，ｎ−
２，ｎ−３との関係の履歴データＨＤＤ１〜ＨＤＤ３が
形成され、書込みモードとなっているメモリ１０のエリ
アＭＥ１〜ＭＥ３に記憶される。
この場合、メモリ４の読出しアドレスデータおよびメモ
リ１０の書込みアドレスデータはアドレスカウンタ１９
から与えられる。
リ１０の書込みアドレスデータはアドレスカウンタ１９
から与えられる。
一方、読出しモードとなっているメモリ１１はライン同
期信号ＬＳＴに同期してアドレスカウンタ２１から出力
される読出しアドレスデータに基づきその記憶内容が８
ビット単位で並列に読み出され、ゲート１６を介してラ
ッチ１２−１〜１２−８に順次転送される。
期信号ＬＳＴに同期してアドレスカウンタ２１から出力
される読出しアドレスデータに基づきその記憶内容が８
ビット単位で並列に読み出され、ゲート１６を介してラ
ッチ１２−１〜１２−８に順次転送される。
ここで、説明をわかり易くするために、メモリ１０に対
して第ｎラインと第ｎ−’Ｉ、 ｎ−２，ｎ−３ライン
の履歴データＨＤＤ１〜ＨＤＤ３の書込みが終わって次
の第ｎ＋１ライン目の記録データＨＤの入力が開始され
、メモリ１０が読出しモードになったものとすると、メ
モリ１０のエリアＥＯ〜ＭＥ３にそれぞれ記憶されたデ
ータはＨＤ。
して第ｎラインと第ｎ−’Ｉ、 ｎ−２，ｎ−３ライン
の履歴データＨＤＤ１〜ＨＤＤ３の書込みが終わって次
の第ｎ＋１ライン目の記録データＨＤの入力が開始され
、メモリ１０が読出しモードになったものとすると、メ
モリ１０のエリアＥＯ〜ＭＥ３にそれぞれ記憶されたデ
ータはＨＤ。
ＨＤＤＩ 、ＨＤＤ２ 、ＨＤＤ３の順に読み出される
。この場合、各データＨＤ、ＨＤ０１〜ＨＤＤ３はいず
れも８ビット単位で分割して読み出され、ラッチ１２−
１〜１２−８に順次ラッチされる。
。この場合、各データＨＤ、ＨＤ０１〜ＨＤＤ３はいず
れも８ビット単位で分割して読み出され、ラッチ１２−
１〜１２−８に順次ラッチされる。
このようにしてラッチ１２−１〜１２−８にライン単位
で記憶されるデータ）−ＩＤおよびＨＤＤ１〜ＨＤＤ３
は、各ラッチ１２−１〜１２−８に対応して設けられた
ＰＳＣ１３−１〜１３−８が順次に能動状態とされるこ
とにより、ライン毎に６４ビツトのシリアルデータＳｌ
〜８１８に変換され、第２図（ｂ）に示すようにして出
力される。
で記憶されるデータ）−ＩＤおよびＨＤＤ１〜ＨＤＤ３
は、各ラッチ１２−１〜１２−８に対応して設けられた
ＰＳＣ１３−１〜１３−８が順次に能動状態とされるこ
とにより、ライン毎に６４ビツトのシリアルデータＳｌ
〜８１８に変換され、第２図（ｂ）に示すようにして出
力される。
この時、データ転送用の副部回路２０は第２図（Ｃ）に
示すように１ライン分のデータ出力完了時にラッチパル
スＰＬＰを出力し、発熱素子の入力段のラッチにこの時
出力した１ライン分のデータをラッチさせる。また、第
２図（ａ）に示すように各ラインのシリアルデータ８１
１〜８１８の各ピットタイミングに同期した転送りロッ
クＰＣＫを出力する。さらに、１ライン分のシリアルデ
ータの転送が終了した段階では、当該データによる記録
を開始させるための記録イネーブル信号ＥＮをオン（“
Ｌ″）レベルとする。この場合、現在の記録ラインｎの
記録データに対する信号ＥＮのオン時間はＴ１、ｎ−１
ライン〜ｎ−３ラインの履歴データＨＤＤＩ〜ＨＤＤ３
に対する信号ＥＮのオン時間はそれぞれＴ２．Ｔ３．Ｔ
４．（但し、Ｔ２ ＞Ｔ３ ＞Ｔ４ ）とする。
示すように１ライン分のデータ出力完了時にラッチパル
スＰＬＰを出力し、発熱素子の入力段のラッチにこの時
出力した１ライン分のデータをラッチさせる。また、第
２図（ａ）に示すように各ラインのシリアルデータ８１
１〜８１８の各ピットタイミングに同期した転送りロッ
クＰＣＫを出力する。さらに、１ライン分のシリアルデ
ータの転送が終了した段階では、当該データによる記録
を開始させるための記録イネーブル信号ＥＮをオン（“
Ｌ″）レベルとする。この場合、現在の記録ラインｎの
記録データに対する信号ＥＮのオン時間はＴ１、ｎ−１
ライン〜ｎ−３ラインの履歴データＨＤＤＩ〜ＨＤＤ３
に対する信号ＥＮのオン時間はそれぞれＴ２．Ｔ３．Ｔ
４．（但し、Ｔ２ ＞Ｔ３ ＞Ｔ４ ）とする。
このようにして信号ＥＮが４回オンされることにより、
現在の記録ラインｎの記録データによる記録が終了する
。
現在の記録ラインｎの記録データによる記録が終了する
。
第３図は第ｎラインとそれ以前の３つのラインｎ−１〜
ｎ−３における１画素の記録データの組合せパターンと
信号ＥＮのオン時間との関係を示したもので、同図（１
）〜（８）の組合゛じパターンでは第ｎラインの画素が
全て白”であるため、信号ＥＮはいずれもオンとならず
、記録は行なわれない。しかし、同図（９）の組合せパ
ターンでは第ｎラインの画素が“黒″であり、それ以前
の３つのラインｎ −１，ｎ−２，ｎ−３の画素が全て
″白″であるため、信号ＥＮは４回オンとなる。
ｎ−３における１画素の記録データの組合せパターンと
信号ＥＮのオン時間との関係を示したもので、同図（１
）〜（８）の組合゛じパターンでは第ｎラインの画素が
全て白”であるため、信号ＥＮはいずれもオンとならず
、記録は行なわれない。しかし、同図（９）の組合せパ
ターンでは第ｎラインの画素が“黒″であり、それ以前
の３つのラインｎ −１，ｎ−２，ｎ−３の画素が全て
″白″であるため、信号ＥＮは４回オンとなる。
すなわち、記録の履歴が少ないために合計で「ＴＩ ＋
Ｔ２ ＋Ｔ３ ＋Ｔ４ Ｊ時間に相当する最大光熱量が
発熱素子から発生される。
Ｔ２ ＋Ｔ３ ＋Ｔ４ Ｊ時間に相当する最大光熱量が
発熱素子から発生される。
また、同図（１０）の組合せパターンでは第ｎラインと
ｎ−１ライン目の画素が“黒”で、それ以前の第ｎ−２
，ｎ−３ライン目の画素は“白″であるため、信号ＥＮ
は第ｎ−１ライン目に対応するオン時間を除いて３回だ
けオンとなり、合計ではｒＴｌ ＋Ｔ３ ＋Ｔ４ Ｊ時
間に相当する発熱Φが発生される。
ｎ−１ライン目の画素が“黒”で、それ以前の第ｎ−２
，ｎ−３ライン目の画素は“白″であるため、信号ＥＮ
は第ｎ−１ライン目に対応するオン時間を除いて３回だ
けオンとなり、合計ではｒＴｌ ＋Ｔ３ ＋Ｔ４ Ｊ時
間に相当する発熱Φが発生される。
要約すると、現在の記録ラインｎの各画素は、自己が゛
黒″であれば信号ＥＮが最大で４回オンとされることに
よって記録されるが、４回の通電回数の内３回はそれ以
前のラインの記録の履歴の大小によって３回〜０回に削
減される。すなわち、通電回数は記録履歴が多いほど削
減される。しかも、各回の通電時間は現在の記録ライン
ｎに近いものほど長く割当てられているため、記ａ履歴
が新しいものほど通電時間の削減量は多くなる。
黒″であれば信号ＥＮが最大で４回オンとされることに
よって記録されるが、４回の通電回数の内３回はそれ以
前のラインの記録の履歴の大小によって３回〜０回に削
減される。すなわち、通電回数は記録履歴が多いほど削
減される。しかも、各回の通電時間は現在の記録ライン
ｎに近いものほど長く割当てられているため、記ａ履歴
が新しいものほど通電時間の削減量は多くなる。
この結果、記録履歴の大小を問わず発熱素子゛の発熱量
がほぼ均一に制御され、記録濃度のばらつきを抑えるこ
とができる。
がほぼ均一に制御され、記録濃度のばらつきを抑えるこ
とができる。
このように本実施例においては、１ラインの記録を４回
の通電によって終了するようにし、しかも４回の通電の
うち３回は以前のラインの記録履歴の吊に比例し、かつ
経過時間に反比例して全体としての通電時間を削減して
いるため、記録ＭＩ歴の大小を問わず発熱量の発熱量を
ほぼ均一に制御することができ、画質の低下を防止する
ことが可能となったうえ、１０ｍｓ以下のさらに高速記
録を行う場合でも、各回の通電時間の割当てを適宜゛
に設定すればよく、記録履歴を調べるための参照ライン
の数は少なくても済み、回路構成も簡単にすることがで
きる。
の通電によって終了するようにし、しかも４回の通電の
うち３回は以前のラインの記録履歴の吊に比例し、かつ
経過時間に反比例して全体としての通電時間を削減して
いるため、記録ＭＩ歴の大小を問わず発熱量の発熱量を
ほぼ均一に制御することができ、画質の低下を防止する
ことが可能となったうえ、１０ｍｓ以下のさらに高速記
録を行う場合でも、各回の通電時間の割当てを適宜゛
に設定すればよく、記録履歴を調べるための参照ライン
の数は少なくても済み、回路構成も簡単にすることがで
きる。
第４図は本発明の他の実施例を示すブロック図であり、
第１図の実施例に対して主走査方向の隣接画素の記録の
有無も考慮して通電回数を制御するようにしたものであ
る。このために、第１図の構成に対して２段構成のフリ
ップフロップ２５および２６と、隣接画素との関係の履
歴データＨＤＤ４を１ラインの各画素毎に作成するノア
ゲート２７およびアンドゲート２８と、作成された隣接
画素との履歴データＨＤＤ４を並列８ビツトのデータに
変換する直列／並列変換器（ＳＰＣ）２９と、８画素分
の履歴データＨＤＤ４が形成されるたびにラッチパルス
ＬＰ５を発生するカウンタ３０と、ラッチパルスＬＰ５
によって８画素分の履歴ブタＨＤＤ４をラッ乏するトラ
イステートラッチ３１とからなる部分が新たに付加され
ている。
第１図の実施例に対して主走査方向の隣接画素の記録の
有無も考慮して通電回数を制御するようにしたものであ
る。このために、第１図の構成に対して２段構成のフリ
ップフロップ２５および２６と、隣接画素との関係の履
歴データＨＤＤ４を１ラインの各画素毎に作成するノア
ゲート２７およびアンドゲート２８と、作成された隣接
画素との履歴データＨＤＤ４を並列８ビツトのデータに
変換する直列／並列変換器（ＳＰＣ）２９と、８画素分
の履歴データＨＤＤ４が形成されるたびにラッチパルス
ＬＰ５を発生するカウンタ３０と、ラッチパルスＬＰ５
によって８画素分の履歴ブタＨＤＤ４をラッ乏するトラ
イステートラッチ３１とからなる部分が新たに付加され
ている。
また、メモリ１０および１１には隣接画素との関係の履
歴データＨＤＤ４を記憶するエリアＭＥ４が新たに付加
されている。そして、この履歴データＨＤＤ４の書込み
と読出しの為に、制御回路１８．２０には第７ステート
ＳＴ７の次にｆｆ１８ステートＳＴ８の動作状態が付加
され、この第８ステートＳＴ８においてノアゲート２７
とアンドゲート２８で作成された隣接画素との関係の履
歴データＨＤＤ４がラッチ３１およびゲート１５（また
は１４）を介してメモリ１０（または１１）のエリアＭ
Ｅ４に８ビット単位で順次書込まれるようになっている
。
歴データＨＤＤ４を記憶するエリアＭＥ４が新たに付加
されている。そして、この履歴データＨＤＤ４の書込み
と読出しの為に、制御回路１８．２０には第７ステート
ＳＴ７の次にｆｆ１８ステートＳＴ８の動作状態が付加
され、この第８ステートＳＴ８においてノアゲート２７
とアンドゲート２８で作成された隣接画素との関係の履
歴データＨＤＤ４がラッチ３１およびゲート１５（また
は１４）を介してメモリ１０（または１１）のエリアＭ
Ｅ４に８ビット単位で順次書込まれるようになっている
。
ここで、隣接画素との履歴データＨＤＤ４の作成論理は
、注目画素が“′黒”であり、その両隣りの画素の両方
がパ白″である時のみＨＤＤ４＝“′１”となり、両隣
りの画素のいずれか一方が“黒”であるか、または注目
画素が“白”である場合にはＨＤＤ４＝”Ｏ”となるよ
うにノアゲート２７およびアンドゲート２８の入力が接
続されている。
、注目画素が“′黒”であり、その両隣りの画素の両方
がパ白″である時のみＨＤＤ４＝“′１”となり、両隣
りの画素のいずれか一方が“黒”であるか、または注目
画素が“白”である場合にはＨＤＤ４＝”Ｏ”となるよ
うにノアゲート２７およびアンドゲート２８の入力が接
続されている。
従って、この実施例においてメモリ１０（または１１）
に記憶された隣接画素との関係のｗＩ履歴データＤＤ４
は、読出しモードにおいて第５図に示すように第ｎ−３
ラインとの関係の履歴データＨＤＤ３の次に読み出され
るが、記録イネーブル信号ＥＮはＨＤＤ４＝“１”の時
のみ１５時間だけオンとなる。
に記憶された隣接画素との関係のｗＩ履歴データＤＤ４
は、読出しモードにおいて第５図に示すように第ｎ−３
ラインとの関係の履歴データＨＤＤ３の次に読み出され
るが、記録イネーブル信号ＥＮはＨＤＤ４＝“１”の時
のみ１５時間だけオンとなる。
第６図は、注目画素と隣接画素との組合せパターンを示
したもので、両隣りの画素が“白”の時のみ信号ＥＮが
１５時間だけオンとなる様子を示している。なお、第６
図においては前ラインとの関係は第３図と同様であるた
めに斜線で省略している。
したもので、両隣りの画素が“白”の時のみ信号ＥＮが
１５時間だけオンとなる様子を示している。なお、第６
図においては前ラインとの関係は第３図と同様であるた
めに斜線で省略している。
このように、主走査方向の隣接画素との関係も考慮すれ
ば画素密度を高密度にした場合に、隣接画素の発熱の影
響による記録濃度のばらつきを抑え、さらに高品質の記
録を行うことが可能となる。
ば画素密度を高密度にした場合に、隣接画素の発熱の影
響による記録濃度のばらつきを抑え、さらに高品質の記
録を行うことが可能となる。
なお、第１図および第４図の実施例では３ライン前まで
の記録データを参照しているが、記録速度に応じてその
参照ライン数を適宜に増減することができることは言う
までもない。
の記録データを参照しているが、記録速度に応じてその
参照ライン数を適宜に増減することができることは言う
までもない。
［発明の効果１
以上説明したように本発明によれば、ｇＪ走査方向にお
ける各画素の記録履歴または該記録履歴と主走査方向に
隣接する画素の記録データの有無に応じて現在の記録ラ
インにおける各画素の感熱素子の通電回数を制御するよ
うにしたため、記録速度の高速化を図る場合でも、簡単
で安価な回路構成で発熱素子の蓄熱による画質の劣化を
防止することができる。
ける各画素の記録履歴または該記録履歴と主走査方向に
隣接する画素の記録データの有無に応じて現在の記録ラ
インにおける各画素の感熱素子の通電回数を制御するよ
うにしたため、記録速度の高速化を図る場合でも、簡単
で安価な回路構成で発熱素子の蓄熱による画質の劣化を
防止することができる。
また、主走査方向における隣接画素との関係をも考慮す
るようにした場合は、画素密度の高密度化に対しても画
質の劣化を防止することができる。
るようにした場合は、画素密度の高密度化に対しても画
質の劣化を防止することができる。
第１図は本発明を適用した感熱記録装置の記録制御回路
の一実施例を示すブロック図、第２図は記録データの出
力時の動作を説明するためのタイムチャート、第３図は
現在の記録ラインとその前ラインの記録データの組合せ
パターンを示す図、第５図は第４図の実施例における記
録データ出力時の動作を説明するためのタイムチャート
、第６図は注目画素と隣接画素の記録データの組合せパ
ターンを示す図である。 ４．１０．１１・・・メモリ、６，７・・・ラッチ、８
・・・履歴データ作成回路、１８・・・履歴データ作成
用制御回路、２０・・・データ転送用制御回路、２２・
・・メモリモード制御回路。 Ｃσ） ＰＣＫ −＝−−−一−″
″−一−−一−−−−。 （Ｃ）ＰＬＰ ； 第２図 第５図 （１） （２） ｔ３） （４） （５） （６） （
７） （８）ｎ−ｓｙイ・ロロ■口■■■口 ｎ−２，イ２ロ■ロ■■ロ■口 ｎ−ｔライ、■ロロ■口■■口 ｎライ、ロロロロロロロロ 通を時間」−上」−上」− ｎ−３ライン 口 ｎ−２ヲイン ■ ｎ−１ライン ■ ｎライン ■ 通５１吟間二ｍ 口 口 ■ コ ロ ■ 口 口 ■■■■ □□［ＬＬ□ ■■■ 口 ■ ■ ■ 口 ■ ■■冒 □□□ 第３図 ｎ−３，イ２０ 口 ｎ−２ライン 口
ロｎ−ｔライン 口
口ｎライア 口 −口 ■ ■
■第６ １３ノ ｔ４ノロ
ロ ロ 口 口 ロ ■■ロ ロ■− 一図函’ｌｌＡヨー 」ゴｍ二二 図 手続？Ｉｎ正書 昭和６２年３月３日 °−て 特ｎ庁良官 １股 １、事件の表示 昭和６０年特許願第２６６３２９号 ２、発明の名称 感熱記録制御方法 ３、補正をする者 小１！１との関係 特許出願人 （３０７）株式会社 東芝 ４、代理人 （〒１０４）東京都中央区銀ＢＡ２丁目１１番２号明１
０閉の図面の簡単な説明の欄 ７、補正の内容 （１）本願明細書、第２１ページ第１１行の「示ず図、
」の後に下記の文章を挿入する。 ［第４図は本発明の他の実施例を示づブロック図、」
の一実施例を示すブロック図、第２図は記録データの出
力時の動作を説明するためのタイムチャート、第３図は
現在の記録ラインとその前ラインの記録データの組合せ
パターンを示す図、第５図は第４図の実施例における記
録データ出力時の動作を説明するためのタイムチャート
、第６図は注目画素と隣接画素の記録データの組合せパ
ターンを示す図である。 ４．１０．１１・・・メモリ、６，７・・・ラッチ、８
・・・履歴データ作成回路、１８・・・履歴データ作成
用制御回路、２０・・・データ転送用制御回路、２２・
・・メモリモード制御回路。 Ｃσ） ＰＣＫ −＝−−−一−″
″−一−−一−−−−。 （Ｃ）ＰＬＰ ； 第２図 第５図 （１） （２） ｔ３） （４） （５） （６） （
７） （８）ｎ−ｓｙイ・ロロ■口■■■口 ｎ−２，イ２ロ■ロ■■ロ■口 ｎ−ｔライ、■ロロ■口■■口 ｎライ、ロロロロロロロロ 通を時間」−上」−上」− ｎ−３ライン 口 ｎ−２ヲイン ■ ｎ−１ライン ■ ｎライン ■ 通５１吟間二ｍ 口 口 ■ コ ロ ■ 口 口 ■■■■ □□［ＬＬ□ ■■■ 口 ■ ■ ■ 口 ■ ■■冒 □□□ 第３図 ｎ−３，イ２０ 口 ｎ−２ライン 口
ロｎ−ｔライン 口
口ｎライア 口 −口 ■ ■
■第６ １３ノ ｔ４ノロ
ロ ロ 口 口 ロ ■■ロ ロ■− 一図函’ｌｌＡヨー 」ゴｍ二二 図 手続？Ｉｎ正書 昭和６２年３月３日 °−て 特ｎ庁良官 １股 １、事件の表示 昭和６０年特許願第２６６３２９号 ２、発明の名称 感熱記録制御方法 ３、補正をする者 小１！１との関係 特許出願人 （３０７）株式会社 東芝 ４、代理人 （〒１０４）東京都中央区銀ＢＡ２丁目１１番２号明１
０閉の図面の簡単な説明の欄 ７、補正の内容 （１）本願明細書、第２１ページ第１１行の「示ず図、
」の後に下記の文章を挿入する。 ［第４図は本発明の他の実施例を示づブロック図、」
Claims (3)
- （１）感熱記録媒体の主走査方向の画素数に対応した感
熱素子を有する感熱記録装置の記録制御方法において、 主走査方向の画素のそれぞれについて副走査方向におけ
る複数ライン前までの記録データと現在の記録ラインに
おける記録データとを比較し、当該画素におけるデータ
の記録履歴を調べ、その記録履歴の量に応じて現在の記
録ラインにおける記録データを記録するための感熱素子
の通電回数を制御することを特徴とする感熱記録制御方
法。 - （２）通電回数の最大値は現在の記録ラインの記録デー
タと比較する副走査方向のライン数と同じであることを
特徴とする特許請求の範囲１項記載の感熱記録制御方法
。 - （３）感熱記録媒体の主走査方向の画素数に対応した感
熱素子を有する感熱記録装置の記録制御方法において、 主走査方向の画素のそれぞれについて副走査方向におけ
る複数ライン前までの記録データと現在の記録ラインに
おける記録データとを比較し、当該画素におけるデータ
の記録履歴を調べると共に、主走査方向に隣接する画素
における記録データの有無を調べ、記録履歴の量と隣接
する画素における記録データの有無に応じて現在の記録
ラインにおける記録データを記録するための感熱素子の
通電回数を制御することを特徴とする感熱記録制御方法
。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60266329A JPS62240566A (ja) | 1985-11-27 | 1985-11-27 | 感熱記録制御方法 |
| US06/885,693 US4723132A (en) | 1985-11-27 | 1986-07-15 | Method and apparatus for preventing unevenness in printing depth in a thermal printing |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60266329A JPS62240566A (ja) | 1985-11-27 | 1985-11-27 | 感熱記録制御方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62240566A true JPS62240566A (ja) | 1987-10-21 |
Family
ID=17429414
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60266329A Pending JPS62240566A (ja) | 1985-11-27 | 1985-11-27 | 感熱記録制御方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4723132A (ja) |
| JP (1) | JPS62240566A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH028065A (ja) * | 1988-06-28 | 1990-01-11 | Hitachi Ltd | サーマルヘッドの駆動装置 |
Families Citing this family (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5657066A (en) * | 1992-10-02 | 1997-08-12 | Zebra Technologies Corporation | Thermal demand printer |
| US4912485A (en) * | 1987-01-28 | 1990-03-27 | Seiko Epson Corporation | Print controlling apparatus for a thermal printer |
| JP2630960B2 (ja) * | 1987-10-17 | 1997-07-16 | グラフテック株式会社 | サーマルドットアレイを用いた波形記録装置 |
| GB2212691B (en) * | 1987-11-20 | 1992-04-15 | Mitsubishi Electric Corp | Halftone printing system |
| US5037216A (en) * | 1988-09-23 | 1991-08-06 | Datacard Corporation | System and method for producing data bearing cards |
| US5025267A (en) * | 1988-09-23 | 1991-06-18 | Datacard Corporation | Thermal print head termperature control |
| US5043742A (en) * | 1989-02-09 | 1991-08-27 | Victor Company Of Japan, Ltd. | Correction of printing signal to be supplied to thermal head of thermal printer |
| US5132703A (en) * | 1991-03-08 | 1992-07-21 | Yokogawa Electric Corporation | Thermal history control in a recorder using a line thermal head |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3710913A (en) * | 1968-12-31 | 1973-01-16 | Texas Instruments Inc | Electronic printing input-output station |
| DE3273429D1 (en) * | 1981-06-19 | 1986-10-30 | Toshiba Kk | Thermal printer |
| JPS60139465A (ja) * | 1983-12-28 | 1985-07-24 | Fuji Xerox Co Ltd | サ−マルヘツド駆動装置 |
-
1985
- 1985-11-27 JP JP60266329A patent/JPS62240566A/ja active Pending
-
1986
- 1986-07-15 US US06/885,693 patent/US4723132A/en not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH028065A (ja) * | 1988-06-28 | 1990-01-11 | Hitachi Ltd | サーマルヘッドの駆動装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| US4723132A (en) | 1988-02-02 |
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