JPS62209417A - 能動マトリクスのデイスプレイスクリ−ン - Google Patents

能動マトリクスのデイスプレイスクリ−ン

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JPS62209417A
JPS62209417A JP62015306A JP1530687A JPS62209417A JP S62209417 A JPS62209417 A JP S62209417A JP 62015306 A JP62015306 A JP 62015306A JP 1530687 A JP1530687 A JP 1530687A JP S62209417 A JPS62209417 A JP S62209417A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、能動マトリクスのディスプレイスクリーンに
関し、評言すれば能動マトリクスおよび行および列冗長
のディスプレイスクリーンに関するものである。
本発明はと＜［［気的情報の光学的情報への変換器とし
て利用される液晶ディスプレイの実施における九゛［「
工学Ｖこ適用される。
一般に、能動マトリクスのディスプレイスクリーンは液
晶のごとき光電材料がそれらの間に挿入される２枚のプ
レートからなる。これらのプレートの一方上には、透明
な導電性底部（ブロック）薄／ｍ　）ランジスタ、１群
の導電性アドレッシング行、および１群の導電性アドレ
ッシング列がある。
各トランジスタは１本の行に接続されたクリット、底部
に接続されたソースおよび１本の列に接続されたドレイ
ンを有している。第２のプレート上には、対向電極があ
る。
かかるＷＩｔ造は第１図に示しである。簡略化した方法
テ、導’［ｌｌ：列１２　オ！ヒ導？ＩＣ性行１４、ト
ランジスタ２０および４電性底部２２を有する下方プレ
ート１０および対向ｆｔ極２４で被覆された上方プレー
ト２４が示しである。
第２図には、第１図の素子が説明されるディスプレイス
クリーン全体の等価回路が示しである。
このスクリーンは適宜なビデオ′磁圧を供給する制ａ１
０路２８に接続された導電性列１２、および行了ドレッ
シング軍圧を供給する制御回路３０１Ｃ接続された導電
性行１４からなる。破線において、ディスプレイスクリ
ーンの画像点３２を示す。これらの画像点は導′心性行
１４と列１２の交点に置かれる。これらの画像褪３２（
−２た「ピクセル」または「エルデイム」と呼ばれる）
は各々トランジスタ２０およびコンデンサを含んでいる
。極板の一方はプレート１０上に配置された導電性底部
２２により構成されかつ他方の極板は他方のプレート２
４上に配置された対向電極２６によって構成される。
この図において、導電性列（列１２かまたは行１４）の
切断の場合において、切断された列の部分は制御回路２
８または６０により引き出される制御電圧をもはや支持
しない。
これは結果としてこの列部分に接続されるエルデイムの
罪作！［−生じ、このことはディスプレイスクリーン上
に非常に明白な寄生作用によって表現される。この作用
は例えば黒いスクリーンの背景上で切断された列の部分
に接続された欠陥のあるエルデイムに対応する白い筋と
なるかも知れない。
本発明はこの不都合を改善することにある。このために
、本発明は導電性行または列の切断がＯの切断に工って
絶縁されたエルデイムを役に立たなくするのを回避せし
める能動マトリクスのディスプレイスクリーンを提案す
る。この結果はそれらの間に抵抗を介して導′ｒＩＬａ
行および列の端部を接続することに工って得られる。
より詳細には、本発明は、公知の方法で、液晶がそれら
の＋Ｓ］に挿入される第１および第２の透明プレートか
らナリ、第１プレートがディスプレイ素子を画成する導
電性底部および複数の行および列ｆ（よって組織された
複数のアドレッシングを電極列を含み、これらの電極列
がディスプレイ制御回路に接続され、第２プレートが対
向電極を含む能動マトリクスのディスプレイスクリーン
を目的とする。本発明による能動マトリクスのディスプ
レイスクリーンの特徴的な原理によれば、電極列はそれ
らの間で抵抗を介してそれらの端部に接続される。
本発明の好適な実施方法によれば、各抵抗各電極列の抵
抗より非常に大きい制御回路の出力インピーダンスより
大きい値Ｒ５を有し、Ｒｓ／２は、Ｒａが検討される行
または列の各ディスプレイ素子の特性インピーダンスで
ありかつｎが前記行または列上に同時に作用する能ｍ素
子の数である場合にＲａｇばり非常に低い。
本発明によるディスプレイスクリーンの変形例は帯電防
止保護を提供する。このために、それらの間に複数の行
を接続する抵抗網およびそれらの間に複数の列を接続す
る抵抗網は抵抗Ｒｓに等しいかまたは近い値の抵抗Ｒｐ
Ｖｃよって相互に接続される。
好適な実施方法によれば、抵抗ＲｓおよびＲｐの組合せ
はディスプレイスクリーンを一巡する抵抗性テープに工
って構成され、このテープは行および列と接触する。
本発明は添付図面を参照して単なる例示でかつ限定され
ない以下の説明ｔ−読むことにより明らかとなる。
第３図において、本発明によるディスプレイスクリーン
の第１プレート１０上に配置された導′成性行１４が示
しである。これらの行１４は抵抗ＲＩ。
全盲しかつ制御回路６０に接続される。
本発明の特徴的原理によれば、行１４はそれらの間で抵
抗Ｒｓを介してそれらの端部に接続される。
同様に、ディスプレイスクリーンの第１プレート１０に
配置された導電性列はそれらの間で抵抗Ｒｓを介してそ
れらの端部に接続される（図示せず鬼これらの抵抗は、
１本の行おたび／または１本の列の切断の場合に、隣接
する行および／または列のｒ「位の合計の半分に等しい
電位に切断された行および／または列の部分を支持させ
る行および／または列の冗長を形成する。
Ｗ、４図には、導電性行の考え得る他の配ｔｉｔを示す
。行１４はプレート１０の右側に配置される回路３０お
Ｌびプレート１０の左側に回路６０に関連して配置され
る制御回路３０′に交互に接続される。
かくして、ディスプレイスクリーンの第１プレート１０
は、交互に、制副回＃！１３０に接続された導電性行１
４、制御回路３０′に接続された導電性行１４、制御回
路３０に接続された導電性行１４等からなる。
行１４はそれらの間で抵抗Ｒｓ（ｉ−介してそ！ｔらの
２つの端部に接続される。
第３図の変形例に訃けるように、これらの抵抗は、１本
の行の切断の場合において、切断された行と同様な制御
回路に接続された隣接する行の′電位の合計の半分に等
しい電位に切断された行の部分を支持させる行冗長を形
成する。
同様に、導電性列１２はプレート１０上で上方にかつ下
方に配置された２つの制御回路に交互に接続される。
抵抗Ｒｓはディスプレイスクリーンの良好な作用を損な
わない念めに多数の条件と実証しなければならない。
まず最初に、抵抗Ｒｓは制御回路の出力インピーダンス
より大たくなければならない。この条件は制御回路の利
用の限界内に置きかつ制御回路を過負荷にしないことを
許容する。次に抵抗Ｒｓは行および／または列の抵抗よ
り非常に大きい。この条件は等電位を残すような切断さ
れない行および列を許容する。最後に、抵抗ＲＳはＲａ
がディスプレイ素子の特性インピーダンスでｎが行また
は列に同時に作用する素子の数である場合に２Ｒａ／ｎ
より非常に低くなければならない。この条件は、切断さ
れた列の部分が、隣接する列の電位の全体の半分に等し
い電位に支持されることを許容する。
次に、邂極列（行または列）の切断の場合における、本
発明によるディスプレイスクリーンの制御を説明する。
制御回路２８または６０が合成ビデオ制御信号を供給、
するとき、切断された列の部分は隣接する列の電位の合
計の半分に等しい電位に支持される。
切断によって絶縁されたエルデイムはかくして列を受容
する制御ビデオ電位に近づく平均のビデオ電位によって
制御される。より正確には、第５図において、切断され
た導電性行の部分の制御を示すタイミングチャートが示
される。部分ａは１本の行、すなわち最終的にこの行に
接続されるトランジスタのグリッドに印加される電圧Ｖ
、をホす。
指数ｎは行の°順番を示す。電圧Ｖは遮断値ＶＢおよび
解放値ちを有するパルスの形の信号である。行ｎの各画
像点は行電圧Ｖ。がＶＤｖｃ等しい時間間隔ＴＬｎの間
中作動する。破線において行ｎ′−１およびｎ＋１に印
加される電圧がそして実線において行ｎに印加される電
圧が示される。
導電性列１２上に制御回路２８によって供給される制御
信号はビデオ信号（図示せず〕である。
部分すは切断されたと見做される行ｎの部分に接続され
るトランジスタのグリッドに印加される電圧を示す。抵
抗Ｒ５１Ｃよって形成される行冗長（冗長＃Ｊ）により
、切断された行の部分は行ｎ−１および行ｎ　＋　１の
電位の合計の半分に等しい電位に支持される。理解でき
るように、この電位は解放電圧ＶＤより低い状態に留ま
る。これらの条件において、切断された行の部分は対応
する画像点を作動させしめない電位に支持される。この
制御はそれゆえ本発明によるディスプレイスクリーンに
適用し１４÷ない。
第６図には、考え得る制御に対応するタイミングチャー
トが示しである。
部分ａは行ｎ−１．ｎ、ｎ＋１１ｃ印加される電圧Ｖを
示す。この電圧はまた解放値ＶＤおよび遮断値ＶＢヲ示
す。行ｎの各画像点は電圧Ｖ。がその間中ＶＤＶＣ等し
い間隔ＴＬｎの間中作動する。
破線において、行ｎ−１およびｎ＋１にそれぞれ印加さ
れる電圧を示す。これらの行ｎ−１およびｎ＋ＩＵそれ
ぞれ行アドレッシングＱ　間ＴＬｎ−１およびＴＬｎ＋
１を有する。
行アドレッシング時間ＴＬｎ−１，ＴＬｎ、ＴＬｎ＋１
は重なり白い、したがって３つのアドレッシング時間の
重畳に対応する間隔Ｔ１の間中、３本の行Ｌｎ−１，Ｌ
ｎおよびＬｎ＋１は、同時に、解放電圧に等しい電圧Ｖ
。
全受容する。
部分すは切断されたと見做される行ｎの部分が支持され
る電圧を示す。この電圧は行ｎ−１およびｎ＋１のＩＦ
圧の合計の半分に等しい。理解で＾る工うに、間隔Ｔｉ
の間中、行ｎ−１および行ｎ＋１の？ｎ位の合計の半分
は解放電圧ＶＤに等しい。切断された行の部分はかくし
てこの行の部分に接続された画像点をｒ「拗せしめる電
位に支持される。
、　第７図には、導電性列１２および４電性行１４から
組織される電極列が示しである。導電性列１２はＦＸ１
プレート１０の上方に配置される制御回路２８にかつ下
方に配置される制御回路２８′に交互に接続される。
導電性行１４は右方に配置される制御回路３０にかつ左
方に配置される制御回路３０′に交互に接続される。
すべての導電性行および列にそれらの間で抵抗網Ｒｓを
介してそれらの端部に接続される。それらの間に行１４
を接続する抵抗網およびそれらの間に列１２を接続する
抵抗網は抵抗Ｒｐを介して相互に接続される。
Ｒｐの値はＲｓの値に等しいかまたは近い。任意の行１
４と列１２との間の最大インピーダンスはｎＬ＋ｎｃ／
２・Ｒｓ程度であり、ｎＬおよびｎＣはそれぞれディス
プレイスクリーンの行および列の数に対応する。このイ
ンピーダンスはディスプレイスクリーンの実施および操
作の間中性および列の電位を等しくする傾向がある。こ
れはディスプレイスクリーンの操作のときまたは実施の
とき発生するかも知れない静電気の蓄積に対してスクリ
ーンを保護する結果となる。かくして行および列の交差
におけるこのような電荷の出現は抑制される。抵抗Ｒｐ
ヲ介しての抵抗網Ｒｓのこの相互接続はそれゆえディス
プレイスクリーンの帯電防止保護ヲ得させる。
次に抵抗ＲｓおよびＲｐの実施方法を説明する。
Ｒｓ　Ｖｃｌｌせられた条件はこれらの抵抗および行お
よび列の実施に関して強制されたものを導く。
第１の条件は抵抗Ｒｓを制御回路の出力インピーダンス
より高くさせる。それゆえＲｓの値は小さ過ぎてはなら
ない。例えばＲｓの値は、制御回路が１０ボルトの制御
電圧下で各行または列について０．１ｍＡをもはや供給
できないとき１００にΩ以上またはそれに等しい。
＠２の条件は列１２および行１４がＲｓより非常に小さ
い抵抗値を有することを意味する。例えば！極列の抵抗
は１〜１０にΩ程度にすべきである。
この強制は実際上行または列の実施のためスズおよびイ
ンジウム酸化物（ＩＴＯ）のごとき導電性酸化物の利用
を排除する。
これらすべての条件および強制の組合せはアルミニウム
のような小さい抵抗の金属からなる導電性の行°および
列の実施を課する。
第８図には、第７図に関連して説明したような帯電防止
保護の場合における抵抗網の実施例を示す。抵抗Ｒｓお
よびＲｐの組合せはプレートを一巡する抵抗性テープ３
２１Ｃよって得られる。このテープ３２Ｆｉ行１４およ
び列１２と接触する。このテープ６２は好ましくはスズ
およびインジウム酸化物によって実施される。例えば画
像点が２５０μｍ程度の幅を有するときかつＲｓの抵抗
値が１００にΩ程度であるとき、テープ３２の幅ｅは２
５μｍ程度である。
テープ６２は第１プレートのマトリクスの製造方法の第
１段階のときＩＴＯの堆積により得られることができる
。この方法で、抵抗テープ３２はスクリーンの製造方法
の次の段階のときの帯電防止保護を生じる。
【図面の簡単な説明】
第１図は従来の能動マｌ−ＩＪクスのディスプレイスク
リーンの構造を示す概略図、 第２図は第１図のディスプレイスクリーン全体の等価回
路を示す概略図、 第３図は本発明によるディスプレイスクリーンの第１プ
レート上に配置された導電性行を示す概略図、 第４図は導電性行の考え得る他の配置を示す概略図、 第５図は切断された導電性行の部分の制御を示すタイミ
ングチャート、 第６図は切断された導電性行の部分の制御の変形例金示
すタイミングチャート、 第７図は帯電防止保護を得るのに利用される抵抗の組合
せを示す概略図、 ！８図は行と列との間の結合の抵抗を得させる抵抗テー
プを示す概略図である。 図中、符号１０は第１プレート、１２は列、１４は行、
２２は導電性底部、２４は第２プレート、２６は対向１
１ｆ極、３２は抵抗テープである。 代理人　弁理士　佐　々　木　清　隆τ−（外３名）シ
、。 ・７゛コ Ｕ） ｄ ： ｑ〕 ムー

Claims (1)

  1. 【特許請求の範囲】 （１）液晶がそれらの間に挿入される第１および第２の
    透明プレートからなり、前記第１プレートがディスプレ
    イ素子を画成する導電性底部および複数の行および列に
    よつて組織された複数のアドレッシング電極列を含み、
    これらの電極列がディスプレイ制御回路に接続され、前
    記第２プレートが対向電極を含む能動マトリクスのディ
    スプレイスクリーンにおいて、前記複数の電極列はこれ
    らの間で複数の抵抗を介してそれらの端部に接続される
    ことを特徴とする能動マトリクスのディスプレイスクリ
    ーン。 （２）各抵抗は各電極列の抵抗より非常に大きい前記制
    御回路の出力インピーダンスより大きい値Ｒｓを有し、
    Ｒｓ／２は、Ｒａが検討される行または列の各ディスプ
    レイ素子の特性インピーダンスでありかつｎが前記行ま
    たは列上に同時に作用する能動素子の数である場合にＲ
    ａ／ｎより非常に低いことを特徴とする特許請求の範囲
    第１項に記載の能動マトリクスのディスプレイスクリー
    ン。 （８）それらの間に複数の行を接続する前記抵抗網およ
    びそれらの間に複数の列を接続する抵抗網は前記抵抗Ｒ
    ｓに等しいかまたは近い値の抵抗Ｒｐによつて相互に接
    続されることを特徴とする特許請求の範囲第１項に記載
    の能動マトリクスのディスプレイスクリーン。 （４）抵抗ＲｓおよびＲｐの組合せは前記ディスプレイ
    スクリーンを一巡する抵抗性テープによつて構成され、
    このテープは前記行および前記列と接触することを特徴
    とする特許請求の範囲第３項に記載の能動マトリクスの
    ディスプレイスクリーン。
JP62015306A 1986-01-27 1987-01-27 能動マトリクスのデイスプレイスクリ−ン Expired - Fee Related JPH0715540B2 (ja)

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FR8601081 1986-01-27

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JPS62209417A true JPS62209417A (ja) 1987-09-14
JPH0715540B2 JPH0715540B2 (ja) 1995-02-22

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EP (1) EP0236167B1 (ja)
JP (1) JPH0715540B2 (ja)
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