JPS6217797A - 液晶表示装置 - Google Patents
液晶表示装置Info
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- JPS6217797A JPS6217797A JP15652085A JP15652085A JPS6217797A JP S6217797 A JPS6217797 A JP S6217797A JP 15652085 A JP15652085 A JP 15652085A JP 15652085 A JP15652085 A JP 15652085A JP S6217797 A JPS6217797 A JP S6217797A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、静止画表示にて多重表示を行うための液晶表
示装置に関する。
示装置に関する。
本発明は液晶表示装置にて静止画表示を行うと共に、こ
の静止画表示に任意の映像信号を加算して多重表示を行
うものである。
の静止画表示に任意の映像信号を加算して多重表示を行
うものである。
映像信号を静止画表示すると共に、この表示に一以上の
映像を加算して多重表示を行うことが提案されている。
映像を加算して多重表示を行うことが提案されている。
ところがその場合に、映像信号の多重表示を行う装置と
しては、従来は例えば１フイールドメモリや特別な記憶
装置を必要とし、多重化された表示の用途に比して装置
が複雑かつ高価なものになってしまっていた。
しては、従来は例えば１フイールドメモリや特別な記憶
装置を必要とし、多重化された表示の用途に比して装置
が複雑かつ高価なものになってしまっていた。
本願はこのような点にかんがみ、液晶表示装置を用いる
ことにより簡単な構成で多重表示を行うものである。
ことにより簡単な構成で多重表示を行うものである。
すなわち、例えば液晶を用いてテレビ画像を表示するこ
とが提案されている。
とが提案されている。
第５図において、（１）はテレビの映像信号が供給され
る入力端子で、この入力端子（１）からの信号がそれぞ
れ例えばＮチャンネルＦＥＴからなるスイッチング素子
Ｍ１．Ｍ２ ・・・Ｍｍを通じて垂直（Ｙ軸）方向の
ラインＬＬ、Ｌ２ ・・・Ｌｍに供給される。なおｍ
は水平（Ｘ軸）方向の画素数に相当する数である。さら
にｍ段のシフトレジスタ（２） ／’ｌ’設けられ、こ
のシフトレジスタ（２）に水平周波数のｍ倍のクロック
信号Φ８１＋ Φ２Ｈが供給され、このシフトレジス
タ（２）の各出力端子からのクロック信号ΦＨＬ＋ Φ
２Ｈによって順次走査される駆動パルス信号φＭｉｎ
φＨ２・・・φＩ１１がスイッチング素子Ｍ１〜Ｍｍ
の各制御端子に供給される。なおシフトレジスタ（２）
には低電位（Ｖｓｓ）と高電位（Ｖｏｏ）が供給され、
この２つの電位の駆動パルスが形成される。
る入力端子で、この入力端子（１）からの信号がそれぞ
れ例えばＮチャンネルＦＥＴからなるスイッチング素子
Ｍ１．Ｍ２ ・・・Ｍｍを通じて垂直（Ｙ軸）方向の
ラインＬＬ、Ｌ２ ・・・Ｌｍに供給される。なおｍ
は水平（Ｘ軸）方向の画素数に相当する数である。さら
にｍ段のシフトレジスタ（２） ／’ｌ’設けられ、こ
のシフトレジスタ（２）に水平周波数のｍ倍のクロック
信号Φ８１＋ Φ２Ｈが供給され、このシフトレジス
タ（２）の各出力端子からのクロック信号ΦＨＬ＋ Φ
２Ｈによって順次走査される駆動パルス信号φＭｉｎ
φＨ２・・・φＩ１１がスイッチング素子Ｍ１〜Ｍｍ
の各制御端子に供給される。なおシフトレジスタ（２）
には低電位（Ｖｓｓ）と高電位（Ｖｏｏ）が供給され、
この２つの電位の駆動パルスが形成される。
また各ラインＬ１〜ＬｒＲにそれぞれ例えばＮチャンネ
ルＦＥＴからなるスイッチング素子（Ｍ １１ 。
ルＦＥＴからなるスイッチング素子（Ｍ １１ 。
Ｍ２１・・・Ｍｎ１）（Ｍ１２２Ｍ２２・・・Ｍｎ２）
・・・ （Ｍ ｔｌ 、 Ｍ ２＠・・・Ｍｎｓ＋）の
一端が接続される。
・・・ （Ｍ ｔｌ 、 Ｍ ２＠・・・Ｍｎｓ＋）の
一端が接続される。
なおｎは水平走査線数に相当する数である。このスイッ
チング素子Ｍｉ１〜Ｍｎｍの他端がそれぞれ液晶セルＣ
ＩＬ〜Ｃｎｍを通じてターゲット端子（３）に接続され
る。
チング素子Ｍｉ１〜Ｍｎｍの他端がそれぞれ液晶セルＣ
ＩＬ〜Ｃｎｍを通じてターゲット端子（３）に接続され
る。
さらにｎ段のシフトレジスタ（４）が設けられ、このシ
フトレジスタ（４）に水平周波数のクロック信号ΦＩＶ
＋ Φ２ｖが供給され、このシフトレジスタ（４）の各
出力端子からのクロック信号ΦＩＶｒ Φ２ｖによっ
て順次走査される駆動パルス信号φＶ１＋ φＶ２・
・・φｖｎがそれぞれ水平（Ｘ軸）方向のゲート線Ｇ１
゜Ｇ２ ・・・Ｇｎを通じてスイッチング素子Ｍ１１〜
ＭｎｍのＸ軸方向の各列（Ｍ１１〜Ｍ１ｎ＋）〜（Ｍｎ
１〜Ｍｎｍ）ごとの制御端子にそれぞれ供給される。な
お、シフトレジスタ（４）にもシフトレジスタ（２）と
同様にＶＳ３とＶＯＯが供給される。
フトレジスタ（４）に水平周波数のクロック信号ΦＩＶ
＋ Φ２ｖが供給され、このシフトレジスタ（４）の各
出力端子からのクロック信号ΦＩＶｒ Φ２ｖによっ
て順次走査される駆動パルス信号φＶ１＋ φＶ２・
・・φｖｎがそれぞれ水平（Ｘ軸）方向のゲート線Ｇ１
゜Ｇ２ ・・・Ｇｎを通じてスイッチング素子Ｍ１１〜
ＭｎｍのＸ軸方向の各列（Ｍ１１〜Ｍ１ｎ＋）〜（Ｍｎ
１〜Ｍｎｍ）ごとの制御端子にそれぞれ供給される。な
お、シフトレジスタ（４）にもシフトレジスタ（２）と
同様にＶＳ３とＶＯＯが供給される。
すなわちこの回路において、シフトレジスタ（２）。
（４）には第６図Ａ、 Ｂに示すようなりロック信号Φ
ＩＨ＋ Φ２イ、ΦＩＶ＋ Φ２ｖが供給される。そし
てシフトレジスタ（２）からは同図Ｃに示すように各画
素期間ごとにφＨ１〜φＨｉｌｌが出力され、シフトレ
ジスタ（４）からは同図りに示すように１水平期間ごと
にφｖ１〜φｖｎが出力される。
ＩＨ＋ Φ２イ、ΦＩＶ＋ Φ２ｖが供給される。そし
てシフトレジスタ（２）からは同図Ｃに示すように各画
素期間ごとにφＨ１〜φＨｉｌｌが出力され、シフトレ
ジスタ（４）からは同図りに示すように１水平期間ごと
にφｖ１〜φｖｎが出力される。
そして例えばφＶ１＋ φＨ１が出力されているとき
は、スイッチング素子Ｍ１とＭｕ〜Ｍ１ｍがオンされ、
入力端子（１）→Ｍ１→Ｌ１→Ｍ １１ ＝ Ｃｕ→ツ
タ−ット端子（３）の電流路が形成されて液晶セルＣ１
ｌに入力端子（１）に供給された信号とターゲット端子
（３）との電位差が供給される。このためこのセルＣ□
□の容量分に、１番目の画素の信号による電位差に相当
する電荷がサンプルホールドされる。この電荷量に対応
して液晶の光透過率が変化される。これと同様のことが
セルＣ１２〜Ｃｎｌ１１について順次行われ、さらに次
のフレームの信号が供給された時点で各セルＣ１ｉ〜Ｃ
ｎｍの電荷量が書き換えられる。
は、スイッチング素子Ｍ１とＭｕ〜Ｍ１ｍがオンされ、
入力端子（１）→Ｍ１→Ｌ１→Ｍ １１ ＝ Ｃｕ→ツ
タ−ット端子（３）の電流路が形成されて液晶セルＣ１
ｌに入力端子（１）に供給された信号とターゲット端子
（３）との電位差が供給される。このためこのセルＣ□
□の容量分に、１番目の画素の信号による電位差に相当
する電荷がサンプルホールドされる。この電荷量に対応
して液晶の光透過率が変化される。これと同様のことが
セルＣ１２〜Ｃｎｌ１１について順次行われ、さらに次
のフレームの信号が供給された時点で各セルＣ１ｉ〜Ｃ
ｎｍの電荷量が書き換えられる。
このようにして、映像信号の各画素に対応して液晶セル
Ｃｏ〜Ｃｎ＋ｎの光透過率が変化され、これが順次繰り
返されてテレ゛ビ画像の表示が行われる。
Ｃｏ〜Ｃｎ＋ｎの光透過率が変化され、これが順次繰り
返されてテレ゛ビ画像の表示が行われる。
ところで液晶で表示を行う場合には、一般にその信頼性
、寿命を長くするため交流駆動が用いられる。例えばテ
レビ画像の表示においては、１フイールドまたは１フレ
ームごとに映像信号を反転させた信号を液晶セルに供給
する。上述の例では入力端子（１）の次に交流駆動アン
プ（５）を設け、例えば１フレームごとに信号を反転す
ることで交流駆動が行わ゛れる。
、寿命を長くするため交流駆動が用いられる。例えばテ
レビ画像の表示においては、１フイールドまたは１フレ
ームごとに映像信号を反転させた信号を液晶セルに供給
する。上述の例では入力端子（１）の次に交流駆動アン
プ（５）を設け、例えば１フレームごとに信号を反転す
ることで交流駆動が行わ゛れる。
そしてこのような液晶表示装置について、本願出願人は
先に簡単な構成を用いて静止画表示を行う装置を提案し
た（特願昭５９−１９０．７８３号）。
先に簡単な構成を用いて静止画表示を行う装置を提案し
た（特願昭５９−１９０．７８３号）。
すなわちその装置においては、液晶セルに保持された信
号電荷を読出し、この読出された信号を補正して再度同
じ液晶セルに供給して静止画表示を行うものである。
号電荷を読出し、この読出された信号を補正して再度同
じ液晶セルに供給して静止画表示を行うものである。
本願はこのような静止画表示を行っている液晶表示装置
を応用するものである。
を応用するものである。
〔発明が解決しようとする問題点〕
従来の多重化を行う装置では、１フイールドメモリや特
別な記憶装置が必要となり、装置が複雑かつ高価なもの
になってしまう問題点があった。
別な記憶装置が必要となり、装置が複雑かつ高価なもの
になってしまう問題点があった。
本発明は、液晶セルＣが多数配され、映像信号（入力端
子（１））が順次供給（スイッチング素子Ｍ１す〜Ｍ
＆）されて表示の行われる液晶表示装置において、各上
記液晶セルの信号を順次読出しくスイッチング素子Ｍ
ＩＲ” Ｍ ｗ＜ ） 、この読出された信号を同じ上
記液晶セルに再供給して静止画表示を行う （スイッチ
（５））ようにすると共に、上記再供給される信号に任
意の上記映像信号を加算（回路（９））して、上記静止
画表示にて多重表示が行われるようにした液晶表示装置
である。
子（１））が順次供給（スイッチング素子Ｍ１す〜Ｍ
＆）されて表示の行われる液晶表示装置において、各上
記液晶セルの信号を順次読出しくスイッチング素子Ｍ
ＩＲ” Ｍ ｗ＜ ） 、この読出された信号を同じ上
記液晶セルに再供給して静止画表示を行う （スイッチ
（５））ようにすると共に、上記再供給される信号に任
意の上記映像信号を加算（回路（９））して、上記静止
画表示にて多重表示が行われるようにした液晶表示装置
である。
この装置によれば、表示装置にて静止画表示を行うと共
に、この静止画信号に任意の映像信号を加算して表示の
多重化を行うので、極めて簡単な構成で良好な多重表示
を行うことができる。
に、この静止画信号に任意の映像信号を加算して表示の
多重化を行うので、極めて簡単な構成で良好な多重表示
を行うことができる。
第１図において、入力端子（１）からの映像信号が、動
画と静止画の切換スイッチ（６）の動画側の接点Ｍを通
じて交流駆動アンプ（５）に供給される。
画と静止画の切換スイッチ（６）の動画側の接点Ｍを通
じて交流駆動アンプ（５）に供給される。
さらにラインＬ１〜Ｌｍに対して上述のスイッチング素
子ＭＩ１．Ｉ−Ｍ＆Ｉと同等のスイッチング素子Ｍ Ｉ
ＦＬ ” Ｍ ＩＴＩＲが接続され、それぞれの制御端
子にシフトレジスタ（２）と同等のシフトレジスタ（７
）からのパルス信号φＨ１〜φ−が供給される。ここで
パルス信号φＨ１’〜φ−は第２図Ａに示すようなパル
ス信号φＨ１〜φＨ１１１に対して、例えば１画素期間
先行した同図Ｃに示すような信号とされる。そしてスイ
ッチング素子ＭＩＲ，Ｍ２Ｒ・・・Ｍｒｒ＠の出力側が
互いに接続され、この接続中点に得られる信号が静止処
理回路（８）を通じて切換スイッチ（６）の静止画側の
接点Ｓに供給される。
子ＭＩ１．Ｉ−Ｍ＆Ｉと同等のスイッチング素子Ｍ Ｉ
ＦＬ ” Ｍ ＩＴＩＲが接続され、それぞれの制御端
子にシフトレジスタ（２）と同等のシフトレジスタ（７
）からのパルス信号φＨ１〜φ−が供給される。ここで
パルス信号φＨ１’〜φ−は第２図Ａに示すようなパル
ス信号φＨ１〜φＨ１１１に対して、例えば１画素期間
先行した同図Ｃに示すような信号とされる。そしてスイ
ッチング素子ＭＩＲ，Ｍ２Ｒ・・・Ｍｒｒ＠の出力側が
互いに接続され、この接続中点に得られる信号が静止処
理回路（８）を通じて切換スイッチ（６）の静止画側の
接点Ｓに供給される。
また各信号ラインＬ１〜Ｌｍにそれぞれスイッチング素
子Ｍｅが接続され、このスイッチング素子Ｍｃを通じて
所定の電圧源、例えばターゲット端子（３）に接続され
る。このスイッチング素子Ｍｃの制御端子に入力信号の
ブランキングパルスφＢＬＫが供給される。
子Ｍｅが接続され、このスイッチング素子Ｍｃを通じて
所定の電圧源、例えばターゲット端子（３）に接続され
る。このスイッチング素子Ｍｃの制御端子に入力信号の
ブランキングパルスφＢＬＫが供給される。
従ってこれまでの構成において、スイッチ（５）が接点
Ｍに接続されているときは、入力端子（１１からの映像
信号が順次液晶セルＣ１１〜Ｃｎ…に供給されて動画の
表示が行われる。
Ｍに接続されているときは、入力端子（１１からの映像
信号が順次液晶セルＣ１１〜Ｃｎ…に供給されて動画の
表示が行われる。
これに対してスイッチ（５）が接点Ｓに接続されると、
パルス信号φＨ１’〜φ）−のタイミングで各液晶セル
Ｃ１１〜Ｃｎｒａに保持された信号電荷がスイッチング
素子ＭＩＲ−ＭｍＲを通じて読出され、この信号が静止
処理回路（７）、スイッチ（８）を通じて次の画素期間
にスイッチング素子ＭＩＩＪ〜Ｍａｗに供給され、同じ
液晶セルＣ１１〜Ｃｎｍに再書込される。これによって
スイッチ（５）が切換られた瞬間の映像が静止° 画
表示される。なお静止処理回路（８）はリーク等による
信号の劣化を補正したり、エフレームごとに反転された
信号を元に戻す処理を行うためのものである。
パルス信号φＨ１’〜φ）−のタイミングで各液晶セル
Ｃ１１〜Ｃｎｒａに保持された信号電荷がスイッチング
素子ＭＩＲ−ＭｍＲを通じて読出され、この信号が静止
処理回路（７）、スイッチ（８）を通じて次の画素期間
にスイッチング素子ＭＩＩＪ〜Ｍａｗに供給され、同じ
液晶セルＣ１１〜Ｃｎｍに再書込される。これによって
スイッチ（５）が切換られた瞬間の映像が静止° 画
表示される。なお静止処理回路（８）はリーク等による
信号の劣化を補正したり、エフレームごとに反転された
信号を元に戻す処理を行うためのものである。
さらにスイッチング素子Ｍｃの制御端子にはブランキン
グパルスφＢＬＫが供給される。このため各信号ライン
Ｌ１〜ＬｆｆＩはブランキングごとにターゲット電圧に
リセットされる。このため各信号ラインに残留した信号
がリセットされ、液晶セルＣの信号を取出す際に不要信
号が混入されることがない。
グパルスφＢＬＫが供給される。このため各信号ライン
Ｌ１〜ＬｆｆＩはブランキングごとにターゲット電圧に
リセットされる。このため各信号ラインに残留した信号
がリセットされ、液晶セルＣの信号を取出す際に不要信
号が混入されることがない。
そしてこの装置において、さらに静止処理回路（８）か
らの信号と入力端子（１）からの信号とが加算回路（９
）に供給され、この加算信号がスイッチ（６）の多重側
の接点Ｘに供給される。
らの信号と入力端子（１）からの信号とが加算回路（９
）に供給され、この加算信号がスイッチ（６）の多重側
の接点Ｘに供給される。
従ってこの装置において、スイッチ′（６）が接点Ｓに
接続されている時点で、例えば１フイ一ルド期間のみス
イッチ（６）が接点Ｘに接続されると、この間に静止処
理回路（８）からの信号と入力端子（１１からの信号と
が加算され、この加算信号がアンプ（５）に供給される
と共に、ｌフィールド期間の経過後にスイッチ（６）が
再び接点Ｓに接続されると、この加算信号による多重画
像が静止画表示される。
接続されている時点で、例えば１フイ一ルド期間のみス
イッチ（６）が接点Ｘに接続されると、この間に静止処
理回路（８）からの信号と入力端子（１１からの信号と
が加算され、この加算信号がアンプ（５）に供給される
と共に、ｌフィールド期間の経過後にスイッチ（６）が
再び接点Ｓに接続されると、この加算信号による多重画
像が静止画表示される。
こうして映像信号の多重化が行われるわけであるが、こ
の装置によれば、液晶表示装置の静止画機能を流用する
ことにより、余分な構成を最少にして良好な信号の多重
化を行うことができる。
の装置によれば、液晶表示装置の静止画機能を流用する
ことにより、余分な構成を最少にして良好な信号の多重
化を行うことができる。
なお加算回路（９）にてｌ：１の加算を繰り返した場合
には、多重画像は初期の画像はどレベルが低下され、常
に最新のものが最大レベルになる表示となる。
には、多重画像は初期の画像はどレベルが低下され、常
に最新のものが最大レベルになる表示となる。
これに対して写真の多重露光のようにそれぞれの画像の
レベルを等しくするには、例えば第３図Ａに示すように
、静止処理回路（８）からの信号が端子（９０）に供給
され、抵抗値Ｒの抵抗器（９１）を通じて接点Ｘに接続
される端子（９２）に供給されると共に、入力端子（１
）からの信号が端子（９３）に供給され、抵抗値（ｎ−
１）Ｒ（但しｎは多重の回数〕の抵抗器（９４）を通じ
て加算されるようにすればよい。これによればそれぞれ
の画像は全て等しいレベルで加算され、等しいレベルの
画像が多重化される。
レベルを等しくするには、例えば第３図Ａに示すように
、静止処理回路（８）からの信号が端子（９０）に供給
され、抵抗値Ｒの抵抗器（９１）を通じて接点Ｘに接続
される端子（９２）に供給されると共に、入力端子（１
）からの信号が端子（９３）に供給され、抵抗値（ｎ−
１）Ｒ（但しｎは多重の回数〕の抵抗器（９４）を通じ
て加算されるようにすればよい。これによればそれぞれ
の画像は全て等しいレベルで加算され、等しいレベルの
画像が多重化される。
さらにこのための具体的な構成としては同図ＢまたはＣ
に示すように全て抵抗値Ｒの抵抗器とスイッチを組み合
せればよく、Ｂの例ではスイッチを順に開くことにより
、またＣの例ではｎ番目のスイッチを閉じることにより
、上述の抵抗値を得ることができる。
に示すように全て抵抗値Ｒの抵抗器とスイッチを組み合
せればよく、Ｂの例ではスイッチを順に開くことにより
、またＣの例ではｎ番目のスイッチを閉じることにより
、上述の抵抗値を得ることができる。
また映像信号が例えばコンピュータ出力のような２値信
号の場合には、第４図に示すように加算回路（９）はオ
ア（図示）、あるいはアンド、ノア。
号の場合には、第４図に示すように加算回路（９）はオ
ア（図示）、あるいはアンド、ノア。
ナンド、エクスクル−シブオア回路等の論理回路で形成
してもよい。この場合に入力端子（１）と加算回路（９
）を構成する論理回路との間にゲート回路を設けて１フ
イールドのみを抜出すようにしてもよく、そのときはス
イッチ（６）を接点Ｘに接続したままで多重画像を形成
することができる。
してもよい。この場合に入力端子（１）と加算回路（９
）を構成する論理回路との間にゲート回路を設けて１フ
イールドのみを抜出すようにしてもよく、そのときはス
イッチ（６）を接点Ｘに接続したままで多重画像を形成
することができる。
さらに静止処理回路（８）からの信号を外部に取出すこ
とにより、多重化信号を他の記録装置等に供給すること
もできる。
とにより、多重化信号を他の記録装置等に供給すること
もできる。
なお液晶表示装置を構成するスイッチング素子Ｍｔｗ＝
Ｍｗ、ＭｔＲ〜ＭＩＴＩＲ，Ｍｕ〜Ｍｎｍはシリコン、
ポリシリコン、アモルファスシリコン、ＳＯＳ。
Ｍｗ、ＭｔＲ〜ＭＩＴＩＲ，Ｍｕ〜Ｍｎｍはシリコン、
ポリシリコン、アモルファスシリコン、ＳＯＳ。
ＳＯ■、有機半導体などに適用できる。
本発明によれば、表示装置にて静止画表示を行うと共に
、この静止画信号に任意の映像信号を加算して表示の多
重化を行うので、極めて簡単な構成で良好な多重表示を
行うことができるようになった。
、この静止画信号に任意の映像信号を加算して表示の多
重化を行うので、極めて簡単な構成で良好な多重表示を
行うことができるようになった。
第１図は本発明の一例の構成図、第２図〜第４図はその
説明のための図、第５図、第６図は液晶表示装置の説明
のための図である。 Ｌ１〜ＬＩＩ＋は垂直信号ライン、０１〜Ｇｎはゲート
線、Ｍｘｗ〜Ｍｎｖ＋ ＭＩＲ〜Ｍｍｕ＋ Ｍｕ 〜Ｍ
ｎｍはスイッチング素子、 Ｃ１ｌ〜Ｃｎｎ＋は液晶セ
ル、（１１は入力端子、（２） 、 （４） 、 （７
）はシフトレジスタ、（５）は交流駆動アンプ、（６）
は切換スイッチ、（８）は静止処理回路、（９）は加算
回路である。 同 松隈秀盛Ｔ、ｊ、、。 、６・′ ＡＢ Ｃ カロ１［回ＲｎＡイア（４＋１ 第３図 ４ｔ”ｓ例の、ｔＪＩ八図 へ４図 第５図 タイｔ−千ヤ−ト 第６図
説明のための図、第５図、第６図は液晶表示装置の説明
のための図である。 Ｌ１〜ＬＩＩ＋は垂直信号ライン、０１〜Ｇｎはゲート
線、Ｍｘｗ〜Ｍｎｖ＋ ＭＩＲ〜Ｍｍｕ＋ Ｍｕ 〜Ｍ
ｎｍはスイッチング素子、 Ｃ１ｌ〜Ｃｎｎ＋は液晶セ
ル、（１１は入力端子、（２） 、 （４） 、 （７
）はシフトレジスタ、（５）は交流駆動アンプ、（６）
は切換スイッチ、（８）は静止処理回路、（９）は加算
回路である。 同 松隈秀盛Ｔ、ｊ、、。 、６・′ ＡＢ Ｃ カロ１［回ＲｎＡイア（４＋１ 第３図 ４ｔ”ｓ例の、ｔＪＩ八図 へ４図 第５図 タイｔ−千ヤ−ト 第６図
Claims (1)
- 【特許請求の範囲】 液晶セルが多数配され、映像信号が順次供給されて表示
の行われる液晶表示装置において、各上記液晶セルの信
号を順次読出し、 この読出された信号を同じ上記液晶セルに再供給して静
止画表示を行うようにすると共に、上記再供給される信
号に任意の上記映像信号を加算して、上記静止画表示に
て多重表示が行われるようにした液晶表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60156520A JPH0693167B2 (ja) | 1985-07-16 | 1985-07-16 | 液晶表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60156520A JPH0693167B2 (ja) | 1985-07-16 | 1985-07-16 | 液晶表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6217797A true JPS6217797A (ja) | 1987-01-26 |
| JPH0693167B2 JPH0693167B2 (ja) | 1994-11-16 |
Family
ID=15629579
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60156520A Expired - Lifetime JPH0693167B2 (ja) | 1985-07-16 | 1985-07-16 | 液晶表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0693167B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009086603A (ja) * | 2007-10-03 | 2009-04-23 | Seiko Epson Corp | 制御方法、制御装置、表示体および情報表示装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58198084A (ja) * | 1982-05-14 | 1983-11-17 | セイコーインスツルメンツ株式会社 | 表示素子 |
| JPS6183586A (ja) * | 1984-10-01 | 1986-04-28 | パイオニア株式会社 | 文字表示システム |
-
1985
- 1985-07-16 JP JP60156520A patent/JPH0693167B2/ja not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58198084A (ja) * | 1982-05-14 | 1983-11-17 | セイコーインスツルメンツ株式会社 | 表示素子 |
| JPS6183586A (ja) * | 1984-10-01 | 1986-04-28 | パイオニア株式会社 | 文字表示システム |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009086603A (ja) * | 2007-10-03 | 2009-04-23 | Seiko Epson Corp | 制御方法、制御装置、表示体および情報表示装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0693167B2 (ja) | 1994-11-16 |
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