JPS6133575U - クロツク形成回路 - Google Patents
クロツク形成回路Info
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- JPS6133575U JPS6133575U JP1984115642U JP11564284U JPS6133575U JP S6133575 U JPS6133575 U JP S6133575U JP 1984115642 U JP1984115642 U JP 1984115642U JP 11564284 U JP11564284 U JP 11564284U JP S6133575 U JPS6133575 U JP S6133575U
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- JP
- Japan
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- clock
- signal
- clocks
- integer
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Links
- 230000015572 biosynthetic process Effects 0.000 title 1
- 230000001360 synchronised effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
- 238000000926 separation method Methods 0.000 description 2
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/79—Processing of colour television signals in connection with recording
- H04N9/87—Regeneration of colour television signals
- H04N9/89—Time-base error compensation
- H04N9/896—Time-base error compensation using a digital memory with independent write-in and read-out clock generators
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/08—Details of the phase-locked loop
- H03L7/085—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
- H03L7/089—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal the phase or frequency detector generating up-down pulses
- H03L7/0891—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal the phase or frequency detector generating up-down pulses the up-down pulses controlling source and sink current generators, e.g. a charge pump
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Television Signal Processing For Recording (AREA)
- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図はこの考案に係るクロック形成回路の一例を示す
系統図、第2図及び第3図はその動作説明に供する波形
図、第4図は周波数比較器の一例を示す系統図、第5図
は従来のクロック形成回路の一例を示す系統図である。 3は同期分離回路、4はバースト信号分離回路、8はP
LL回路、14はゲート形可変発振器、一30は周波数
差検出器、11.16はカウン,タ、20は周波数比較
器、40はチャージポンプである。
系統図、第2図及び第3図はその動作説明に供する波形
図、第4図は周波数比較器の一例を示す系統図、第5図
は従来のクロック形成回路の一例を示す系統図である。 3は同期分離回路、4はバースト信号分離回路、8はP
LL回路、14はゲート形可変発振器、一30は周波数
差検出器、11.16はカウン,タ、20は周波数比較
器、40はチャージポンプである。
Claims (1)
- 入力映像信号より同期信号を分離し、これをPLL回路
に供給してnf}l(rlは整数)の第1のクロツクを
形成し、上記入力映像信号よりバースト信号を分離し、
これでゲート形可変発振器を駆動してバースト信号に位
相同期した平均周波数がnfHの第2のクロックを形成
すると共に、上記第1及び第2のクロツクを夫々1/M
(Mは整数)にカウントダウンしj;もの同志の周波数
差を比較し、その比較出力で上記可変発振器の周波数を
制御することにより、バースト信号に位相同期した同期
信号のn倍の周波数を有する第2のクロックを得るよう
にしたクロツク形成回路。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1984115642U JPS6133575U (ja) | 1984-07-28 | 1984-07-28 | クロツク形成回路 |
AU45141/85A AU588239B2 (en) | 1984-07-28 | 1985-07-18 | A write clock pulse generator used for a time base corrector |
CA000487218A CA1235800A (en) | 1984-07-28 | 1985-07-22 | Write clock pulse generator used for a time base corrector |
US06/758,341 US4613827A (en) | 1984-07-28 | 1985-07-24 | Write clock pulse generator used for a time base corrector |
EP85109317A EP0170207A3 (en) | 1984-07-28 | 1985-07-25 | A write clock pulse generator used for a time base corrector |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1984115642U JPS6133575U (ja) | 1984-07-28 | 1984-07-28 | クロツク形成回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6133575U true JPS6133575U (ja) | 1986-02-28 |
JPH0419907Y2 JPH0419907Y2 (ja) | 1992-05-07 |
Family
ID=14667691
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1984115642U Granted JPS6133575U (ja) | 1984-07-28 | 1984-07-28 | クロツク形成回路 |
Country Status (5)
Country | Link |
---|---|
US (1) | US4613827A (ja) |
EP (1) | EP0170207A3 (ja) |
JP (1) | JPS6133575U (ja) |
AU (1) | AU588239B2 (ja) |
CA (1) | CA1235800A (ja) |
Families Citing this family (25)
Publication number | Priority date | Publication date | Assignee | Title |
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JPS61189094A (ja) * | 1985-02-16 | 1986-08-22 | Sony Corp | 読出スタ−トパルス発生回路 |
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JPH06101860B2 (ja) * | 1986-04-11 | 1994-12-12 | ソニー株式会社 | 時間軸補正装置 |
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Publication number | Priority date | Publication date | Assignee | Title |
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JPS5444831A (en) * | 1977-09-13 | 1979-04-09 | Nec Corp | Correcting equipment for time-axis error |
JPS54143017A (en) * | 1978-04-28 | 1979-11-07 | Sony Corp | Time base error correction unit |
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JPS5665309A (en) * | 1979-10-26 | 1981-06-03 | Sony Corp | Time-axis converter |
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-
1984
- 1984-07-28 JP JP1984115642U patent/JPS6133575U/ja active Granted
-
1985
- 1985-07-18 AU AU45141/85A patent/AU588239B2/en not_active Ceased
- 1985-07-22 CA CA000487218A patent/CA1235800A/en not_active Expired
- 1985-07-24 US US06/758,341 patent/US4613827A/en not_active Expired - Fee Related
- 1985-07-25 EP EP85109317A patent/EP0170207A3/en not_active Withdrawn
Also Published As
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---|---|
AU4514185A (en) | 1986-01-30 |
US4613827A (en) | 1986-09-23 |
EP0170207A3 (en) | 1988-06-01 |
EP0170207A2 (en) | 1986-02-05 |
AU588239B2 (en) | 1988-09-14 |
JPH0419907Y2 (ja) | 1992-05-07 |
CA1235800A (en) | 1988-04-26 |
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