JPS61227668A - 電源回路 - Google Patents
電源回路Info
- Publication number
- JPS61227668A JPS61227668A JP60067685A JP6768585A JPS61227668A JP S61227668 A JPS61227668 A JP S61227668A JP 60067685 A JP60067685 A JP 60067685A JP 6768585 A JP6768585 A JP 6768585A JP S61227668 A JPS61227668 A JP S61227668A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- load
- power source
- voltage
- turned
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of ac power input into dc power output; Conversion of dc power input into ac power output
- H02M7/02—Conversion of ac power input into dc power output without possibility of reversal
- H02M7/04—Conversion of ac power input into dc power output without possibility of reversal by static converters
- H02M7/06—Conversion of ac power input into dc power output without possibility of reversal by static converters using discharge tubes without control electrode or semiconductor devices without control electrode
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Accessory Devices And Overall Control Thereof (AREA)
- Rectifiers (AREA)
- Control Of Electric Motors In General (AREA)
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（発明の技術分野）
本発明は、モータ等を負荷とする電源における電源オフ
時の短絡回路に関する。
時の短絡回路に関する。
モータ等が負荷として使われる電源回路において、入力
電源がオフ時にモータ逆起電力による出力電圧を短時間
にショートする手法は種々考えられる。
電源がオフ時にモータ逆起電力による出力電圧を短時間
にショートする手法は種々考えられる。
まず、入力電源オフ時にリレーを使ってモータ出力電圧
を短絡する方法は、リレーの作動について時間的な遅れ
が生じ、不具合である。
を短絡する方法は、リレーの作動について時間的な遅れ
が生じ、不具合である。
また、その短絡のスイッチング手段に半導体を使用した
場合は、その半導体を動かす電力が必要となるため、一
旦オンすればその動作を持続するサイリスタ等が採用さ
れるが、モータ負荷の場合は供給電力がなくなった時点
で回生電力が発生し、サイリスタをオンしつづける。
場合は、その半導体を動かす電力が必要となるため、一
旦オンすればその動作を持続するサイリスタ等が採用さ
れるが、モータ負荷の場合は供給電力がなくなった時点
で回生電力が発生し、サイリスタをオンしつづける。
この状態で、入力電源がオンされると、サイリスタはオ
ンを継続しつづけるため負荷短絡となり、モータへの電
力の供給ができなくなるという欠点がある。
ンを継続しつづけるため負荷短絡となり、モータへの電
力の供給ができなくなるという欠点がある。
ここにおいて本発明は、従来装置の難点を克服し、たと
えばＯＡ用電電源して多出力をもつ電源が要求され、こ
れらの電源負荷にはＣＰＵやモータなどがあり、モータ
の制御はＣＰＬＩで行なわれるので、モータへの電源よ
り必ずＣＰＵへの電源が先に電圧が立上り、入力電源オ
フ時にｃｐｕ電源が最後まで供給される必要があり、こ
のような手段をそなえる電源回路を提供することを、そ
の目的とする。
えばＯＡ用電電源して多出力をもつ電源が要求され、こ
れらの電源負荷にはＣＰＵやモータなどがあり、モータ
の制御はＣＰＬＩで行なわれるので、モータへの電源よ
り必ずＣＰＵへの電源が先に電圧が立上り、入力電源オ
フ時にｃｐｕ電源が最後まで供給される必要があり、こ
のような手段をそなえる電源回路を提供することを、そ
の目的とする。
本発明は、
１入力多出力のトランス出力を整流して多数負荷へ直流
電圧を与える電源回路において、電源オフ時に、それか
らある遅れ時間を経て、第１の負荷（たとえばマイコン
）に電圧が印加されていることから、第２以下の負荷の
蓄積している電荷を強制的に放電させる手段をそなえる
電源回路である。
電圧を与える電源回路において、電源オフ時に、それか
らある遅れ時間を経て、第１の負荷（たとえばマイコン
）に電圧が印加されていることから、第２以下の負荷の
蓄積している電荷を強制的に放電させる手段をそなえる
電源回路である。
本発明の一実施例における回路構成を表わすブロック図
を第１図に示す。
を第１図に示す。
１は機器を作動させる駆動源となるモータ負荷、２はモ
ータその他部材を制御するマイコン負荷、３は第１の集
積化制御部材、４は演算増幅器、５は定電圧源でたとえ
ば電池、６はチョッパ制御回路、７は停電検知用の第２
の集積化制御部材、８゜９は整流回路、１０は商用交流
電源、Ｃ１〜Ｃ６はコンデンサ、Ｄ 〜Ｄ７はダイオー
ド、ＺＤはツェナダイオード、Ｌ、Ｌ２はインダクタ、
Ｐｌ、Ｐ２はフォトカプラ、０１〜Ｑ５はトランジスタ
、Ｒ−Ｒ１□は抵抗、王は１入力２出力のトランスであ
る。
ータその他部材を制御するマイコン負荷、３は第１の集
積化制御部材、４は演算増幅器、５は定電圧源でたとえ
ば電池、６はチョッパ制御回路、７は停電検知用の第２
の集積化制御部材、８゜９は整流回路、１０は商用交流
電源、Ｃ１〜Ｃ６はコンデンサ、Ｄ 〜Ｄ７はダイオー
ド、ＺＤはツェナダイオード、Ｌ、Ｌ２はインダクタ、
Ｐｌ、Ｐ２はフォトカプラ、０１〜Ｑ５はトランジスタ
、Ｒ−Ｒ１□は抵抗、王は１入力２出力のトランスであ
る。
交流電源１０から供給される交流電圧は整流回路８で直
流に変換し、コンデンサＣ５で平滑し、トランジスタＱ
５によりチョッパリングされ、トランスＴを介して負荷
側へ出力する。
流に変換し、コンデンサＣ５で平滑し、トランジスタＱ
５によりチョッパリングされ、トランスＴを介して負荷
側へ出力する。
マイコン負荷２へはダイオードＤ２で整流し、インダク
タＬ２およびコンデンサＣ４で平滑し負荷２へ直流電圧
が与えられる。可変抵抗Ｒ１ｏからは制御回路６へ分圧
された回路電圧が帰還され、チョッパでの流通位相を制
御してトランスの出力電圧を一定に調整する。
タＬ２およびコンデンサＣ４で平滑し負荷２へ直流電圧
が与えられる。可変抵抗Ｒ１ｏからは制御回路６へ分圧
された回路電圧が帰還され、チョッパでの流通位相を制
御してトランスの出力電圧を一定に調整する。
モータ負荷１へはダイオードＤ３で整流し、インダクタ
Ｌ１およびコンデンサＣ３で平滑し、かつトランジスタ
Ｑ４で電圧を一定電圧に降下させ、コンデンサＣ２を並
列接続したモータ負荷１へ直流電圧が印加される。
Ｌ１およびコンデンサＣ３で平滑し、かつトランジスタ
Ｑ４で電圧を一定電圧に降下させ、コンデンサＣ２を並
列接続したモータ負荷１へ直流電圧が印加される。
ドロッパは、分圧された回路電圧が抵抗Ｒ８から入力し
定電圧源５の基準電圧と比較演算された動 す る。
定電圧源５の基準電圧と比較演算された動 す る。
一方、交流電源１０が整流回路９で直流へ変換されコン
デンサＣ６で平滑した電圧は制御回路６へ供給されると
ともに、停電検知用の第２の集積化制御部材７はコンデ
ンサＣ６の両端子に接続される。
デンサＣ６で平滑した電圧は制御回路６へ供給されると
ともに、停電検知用の第２の集積化制御部材７はコンデ
ンサＣ６の両端子に接続される。
第２図は、この実施例の各部の動作を表わすタイムチャ
ートである。
ートである。
では、その回路動作を示す。
時点ｔ１で電源投入により信号１０１が発生ずる→信号
１０１が■Ｃ１の３に入力する→時点ｔ２でマイコン負
荷２の電源電圧（マイコン電源）が立上る、それと同時
にイニシャル信号１０３が発生ずる→ツェナダイオード
ＺＤおよびフォトカブラＰ 、Ｐ２を経てすこし遅れて
時点ｔ３でモ−タ負荷１の電源電圧（モータ用電源）が
立上る→ある時間遅れ時点ｔ４で信号１０２が発生しト
ランジスタＱ３がオンし信号１０３がなくなる→これを
条件にマイコンが正常動作を行なう→この後モータ負荷
１はマイコンに運転制御を受けて作動する。
１０１が■Ｃ１の３に入力する→時点ｔ２でマイコン負
荷２の電源電圧（マイコン電源）が立上る、それと同時
にイニシャル信号１０３が発生ずる→ツェナダイオード
ＺＤおよびフォトカブラＰ 、Ｐ２を経てすこし遅れて
時点ｔ３でモ−タ負荷１の電源電圧（モータ用電源）が
立上る→ある時間遅れ時点ｔ４で信号１０２が発生しト
ランジスタＱ３がオンし信号１０３がなくなる→これを
条件にマイコンが正常動作を行なう→この後モータ負荷
１はマイコンに運転制御を受けて作動する。
電源断が時点ｔ５で起り→信号１０１が消え→ＩＣ２の
７はある遅れ時定数をも°つて時点ｔ６で信号１０２を
消滅させる→トランジスタＱ３がオフして信号１０４が
発生しくｔ６）→マイコンが動作を停止しく１ ）→
ＩＣ１の３から信号１０４が発生しくｔ６）、信＠１０
３がＩＣ１の３に入力しくｔ６）→信号１０１がなく信
号 。
７はある遅れ時定数をも°つて時点ｔ６で信号１０２を
消滅させる→トランジスタＱ３がオフして信号１０４が
発生しくｔ６）→マイコンが動作を停止しく１ ）→
ＩＣ１の３から信号１０４が発生しくｔ６）、信＠１０
３がＩＣ１の３に入力しくｔ６）→信号１０１がなく信
号 。
１０３があるのを条件としてＩＣ１の３は信号１０４を
発生ずる。
発生ずる。
時点ｔ６で信号１０４がトランジスタＱ２のベースに与
えられるとこれが遠通し→トランジスタＱ１も関連して
導通し→ドロッパＱ４はオフとなり→コンデンサＣ２に
蓄積された電荷は抵抗Ｒ１゜ダイオードＤ１．トランジ
スタＱ１を経て強制的に瞬時（コンデンサＣ１，抵抗Ｒ
５で決定する放電時定数で決る時間）に放電される。も
つともそのさいのトランジスタＱ１の駆動電源はトラン
ジスタＱ２がオンによりコンデンサＣ１に蓄えられた電
気的エネルＶ−による。
えられるとこれが遠通し→トランジスタＱ１も関連して
導通し→ドロッパＱ４はオフとなり→コンデンサＣ２に
蓄積された電荷は抵抗Ｒ１゜ダイオードＤ１．トランジ
スタＱ１を経て強制的に瞬時（コンデンサＣ１，抵抗Ｒ
５で決定する放電時定数で決る時間）に放電される。も
つともそのさいのトランジスタＱ１の駆動電源はトラン
ジスタＱ２がオンによりコンデンサＣ１に蓄えられた電
気的エネルＶ−による。
その後、時点ｔ７でマイコン用電源、イニシャル信号１
０３および信号１０４も共に消滅する。
０３および信号１０４も共に消滅する。
このように、特定のマイコン負荷２は他の被制御のモー
タ負荷１等を十分制御可能な状態において、常に電源の
オン、オフがなされており、マイコンの被制御部材が制
御から外れてフリーランすることはない。
タ負荷１等を十分制御可能な状態において、常に電源の
オン、オフがなされており、マイコンの被制御部材が制
御から外れてフリーランすることはない。
（発明の効果）
かくして本発明によれば、１入力多出力電源をそなえる
回路において、特定の負荷の短絡状態を長時間保持する
ための手段を容易に実現でき、また負荷がモータであっ
ても問題は生じない。
回路において、特定の負荷の短絡状態を長時間保持する
ための手段を容易に実現でき、また負荷がモータであっ
ても問題は生じない。
本発明は当該分野に寄与するところ大きく、とくにプリ
ンター用電源とし最適である。
ンター用電源とし最適である。
１１図は本発明の一実施例の回路構成を表わすブロック
図、第２図はその各部の動作を示すタイムチャートであ
る。 １・・・モータ負荷、２・・・マイコン負荷、３・・・
第１の集積化制御部材、４・・・演算増幅器、５・・・
定電圧電源、６・・・チョッパ制御回路、７・・・停電
検知用筒２の集積化制御部材、８．９・・・整流回路、
１０・・・商用交流電源。
図、第２図はその各部の動作を示すタイムチャートであ
る。 １・・・モータ負荷、２・・・マイコン負荷、３・・・
第１の集積化制御部材、４・・・演算増幅器、５・・・
定電圧電源、６・・・チョッパ制御回路、７・・・停電
検知用筒２の集積化制御部材、８．９・・・整流回路、
１０・・・商用交流電源。
Claims (1)
- 【特許請求の範囲】 １、１入力多出力のトランス出力を整流して多数負荷へ
直流電圧を与える電源回路において、電源のオン、オフ
により立上り、立下る第１の信号を発生する手段と、 第１の信号が立上り、立下ってからある遅れ時定数で発
生し、消滅する第２の信号を発生する手段と、 第１の負荷に電圧が印加されておりかつ第２の信号がな
いとき生起する第３の信号を発生する手段と、 第１の負荷に電圧がありさらに第２の信号が立下ったと
きに発生する第４の信号を発生する手段と、 第４の信号により第２以下の負荷に蓄積された電荷を強
制放電させる手段と、 を具備することを特徴とする電源回路。 ２、第２以下の負荷に蓄積された電荷を強制放電すると
き、第２以下の負荷へ与えられる直流電圧のドロッパー
をスイッチング手段とする特許請求の範囲第１項記載の
電源回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60067685A JPS61227668A (ja) | 1985-03-30 | 1985-03-30 | 電源回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60067685A JPS61227668A (ja) | 1985-03-30 | 1985-03-30 | 電源回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61227668A true JPS61227668A (ja) | 1986-10-09 |
Family
ID=13352092
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60067685A Pending JPS61227668A (ja) | 1985-03-30 | 1985-03-30 | 電源回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61227668A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7085947B2 (en) | 2000-04-28 | 2006-08-01 | Denso Corporation | Electronic control apparatus having a plurality of power source circuits |
| JP2014130393A (ja) * | 2012-12-27 | 2014-07-10 | Fujitsu Frontech Ltd | 電源起動・停止制御回路 |
-
1985
- 1985-03-30 JP JP60067685A patent/JPS61227668A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7085947B2 (en) | 2000-04-28 | 2006-08-01 | Denso Corporation | Electronic control apparatus having a plurality of power source circuits |
| JP2014130393A (ja) * | 2012-12-27 | 2014-07-10 | Fujitsu Frontech Ltd | 電源起動・停止制御回路 |
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