JPS60153346U - キヤツシユメモリ - Google Patents

キヤツシユメモリ

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Publication number
JPS60153346U
JPS60153346U JP3800084U JP3800084U JPS60153346U JP S60153346 U JPS60153346 U JP S60153346U JP 3800084 U JP3800084 U JP 3800084U JP 3800084 U JP3800084 U JP 3800084U JP S60153346 U JPS60153346 U JP S60153346U
Authority
JP
Japan
Prior art keywords
directory
exclusive
cache memory
control devices
types
Prior art date
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Pending
Application number
JP3800084U
Other languages
English (en)
Inventor
十川　健二
窪田　憲治
Original Assignee
株式会社日立製作所
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Filing date
Publication date
Application filed by 株式会社日立製作所 filed Critical 株式会社日立製作所
Priority to JP3800084U priority Critical patent/JPS60153346U/ja
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Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例のキャッシュメモリシステム
の当該ディレクトリ専有制御部の機能ブロック図、第２
図は同じくディレクトリ専有制御部の専有指示信号と専
有信号のタイムチャート図である。 １〜４・・・ディスク制御装置、５・・・キャッシュメ
モリ、６・・・ディレクトリ専有制御部、７〜１０・・
・短い専有指示信号、１１〜１４・・・長い専有指示信
号、１５〜１８・・・専有信号。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の制御装置からアクセスされるキャッシュメモリと
    、キャッシュメモリの管理情報を格納し、前記複数の制
    御装置から排他的に使用されるディレクトリにより構成
    されるキャッシュメモリシステムにおいて、前記複数の
    制御装置はディレクトリを専有する時間の長短に応じた
    ２種の専有指示信号を出力し、さらに前記ディレクトリ
    は前記複数の制御装置からの各々２種の専有指示信号を
    検出し、どちらの専有指示信号が出力されているかによ
    り、専有する制御装置の優先順位を決定しディレクトリ
    の専有を許可し、またディレクトリを専有したか否かの
    結果を前記複数の制御装置に報告することを特徴とする
    キャッシュメモリ。
JP3800084U 1984-03-19 1984-03-19 キヤツシユメモリ Pending JPS60153346U (ja)

Priority Applications (1)

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JP3800084U JPS60153346U (ja) 1984-03-19 1984-03-19 キヤツシユメモリ

Applications Claiming Priority (1)

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JP3800084U JPS60153346U (ja) 1984-03-19 1984-03-19 キヤツシユメモリ

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Publication Number Publication Date
JPS60153346U true JPS60153346U (ja) 1985-10-12

Family

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JP3800084U Pending JPS60153346U (ja) 1984-03-19 1984-03-19 キヤツシユメモリ

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