JPS5995471A - 波形表示装置 - Google Patents
波形表示装置Info
- Publication number
- JPS5995471A JPS5995471A JP20585682A JP20585682A JPS5995471A JP S5995471 A JPS5995471 A JP S5995471A JP 20585682 A JP20585682 A JP 20585682A JP 20585682 A JP20585682 A JP 20585682A JP S5995471 A JPS5995471 A JP S5995471A
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- Japan
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- output
- memory
- waveform
- digital comparator
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、被硯測波形の入力信号をA−D変換器でデジ
タル信号に変換し、その出力をメモリに記憶した後、こ
の記憶したデータを読出してアナログ波形として陰極線
管上に表示するデジタルストレージスコープなどの波形
表示装置において、管面出力波形の任意時間軸点に対応
する時間差、電圧差などの情報を表示するようにした波
形表示装置に関するものである。
タル信号に変換し、その出力をメモリに記憶した後、こ
の記憶したデータを読出してアナログ波形として陰極線
管上に表示するデジタルストレージスコープなどの波形
表示装置において、管面出力波形の任意時間軸点に対応
する時間差、電圧差などの情報を表示するようにした波
形表示装置に関するものである。
従来、陰極線管上の管面出力波形の時間差、電圧差を求
めるには、測定器から読み取った値により算出する方法
がとられている。しかし、この方法は、読み取り誤差が
生じて測定値が不正確である。また、アナログ比較器を
用いても、直接、数値表示するには、サンプルホールド
回路やアナログ比較器の出力を処理する演算装置が必要
になり、装置も大きくなり、コストもかがるなどの欠点
があった。
めるには、測定器から読み取った値により算出する方法
がとられている。しかし、この方法は、読み取り誤差が
生じて測定値が不正確である。また、アナログ比較器を
用いても、直接、数値表示するには、サンプルホールド
回路やアナログ比較器の出力を処理する演算装置が必要
になり、装置も大きくなり、コストもかがるなどの欠点
があった。
本発明は以上の点に鑑み、かかる従来の欠点を解消する
ためになされたもので、その目的は、管面出力波形の任
意時間軸点の時間差、電圧差などの情報を容易に、しか
も正確に表示することができる波形表示装置を提供する
ことにある。
ためになされたもので、その目的は、管面出力波形の任
意時間軸点の時間差、電圧差などの情報を容易に、しか
も正確に表示することができる波形表示装置を提供する
ことにある。
このような目的を達成するために、本発明は、波形表示
装置において、出力波形のデータを記憶したメモリのア
ドレスなカウントするアドレスカウンタのカウント出力
をそれぞれ第1および第2のデジタル比較器に入力し、
これら第1および第2のデジタル比較器にその設定値を
プログラマブルに設定可能な第1および第2の設定器を
別個に設け、前記第1のデジタル比較器の一致出力によ
り前記メモリのアドレスに対応するデータを一時記憶す
るとともに、前記第2のデジタル比較器の一致出力によ
り前記メモリのアドレスに対応するデータを一時記憶し
、この一時記憶した各データ出力と前記第゛1および第
2の設定器の各数値出力とを演算することにより、その
演算結果に基いて管面出力波形の任意時間軸点に対応す
る時間差。
装置において、出力波形のデータを記憶したメモリのア
ドレスなカウントするアドレスカウンタのカウント出力
をそれぞれ第1および第2のデジタル比較器に入力し、
これら第1および第2のデジタル比較器にその設定値を
プログラマブルに設定可能な第1および第2の設定器を
別個に設け、前記第1のデジタル比較器の一致出力によ
り前記メモリのアドレスに対応するデータを一時記憶す
るとともに、前記第2のデジタル比較器の一致出力によ
り前記メモリのアドレスに対応するデータを一時記憶し
、この一時記憶した各データ出力と前記第゛1および第
2の設定器の各数値出力とを演算することにより、その
演算結果に基いて管面出力波形の任意時間軸点に対応す
る時間差。
電圧差などの情報を表示するようにしたものである。
以下、本発明の実施例を図面に基いて詳細に説明する。
図は本発明に係る波形表示装置の一実施例を示す基本的
なブロック図である。図において、1は入力されるアナ
ログ信号Aをデジタル信号に変換するA−D変換器、2
はA−D変換器1で変換されるデジタル信号をデータと
して記憶する第1のメモリ、3は第1のメモリ2で記憶
したデータをもとのアナログ信号に変換するD−A変換
器であシ、そのアナログ出力を偏向信号Yとして陰極線
管6の垂直偏向部に送出する。4は後述するアドレスカ
ウンタ8からのカウント出力を受けて時間軸信号Xを発
生する掃引回路であり、この時間軸信号Xを陰極線管6
の水平偏向部に送出する。5は後述するオアゲート17
のオア出力を受けて陰極線管6の輝度を制御する輝度変
調回路である。
なブロック図である。図において、1は入力されるアナ
ログ信号Aをデジタル信号に変換するA−D変換器、2
はA−D変換器1で変換されるデジタル信号をデータと
して記憶する第1のメモリ、3は第1のメモリ2で記憶
したデータをもとのアナログ信号に変換するD−A変換
器であシ、そのアナログ出力を偏向信号Yとして陰極線
管6の垂直偏向部に送出する。4は後述するアドレスカ
ウンタ8からのカウント出力を受けて時間軸信号Xを発
生する掃引回路であり、この時間軸信号Xを陰極線管6
の水平偏向部に送出する。5は後述するオアゲート17
のオア出力を受けて陰極線管6の輝度を制御する輝度変
調回路である。
まだ、TはA−D変換器1のデータを記憶する前記メモ
リ2と同様の第2のメモリ、8は第2のメモリ7のアド
レスをカウントしそのカウント出力をシフトパルスとし
て該メモリ7に送出するアドレスカウンタ、9,10は
前記アドレスカウンタ8のカウント出力を一方の入力端
子にそれぞれ入力とする第1および第2のデジタル比較
器、11は第1のデジタル比較器9の他方の入力端子に
その設定値として符号化された数値信号を送出する第1
の設定器、12は第2のデジタル比較器10の他方の入
力端子にその設定値として符号化された数値信号を送出
する第2の設定器で1、これら第1および第2設定器1
1.12は第2のメモリ7のアドレスに相当する数値信
号をプログラマブルに設定可能なものからなる。13は
第1のデジタル比較器9の一致出力により第2のメモリ
7のアドレスに対応するデータを一時記憶する第1のラ
ンチ回路、14は第2のデジタル比較器10の一致出力
によシ第2のメモリ7のアドレスに対応するデータを一
時記憶する第2のランチ回路、15は第1および第2の
ランチ回路13.14の各データ出力を入力とするとと
もに、第1および第2の設定器11.12の数値出力を
入力とする演算器である。この演算器15は、演算素子
およびデコーダなどから構成され、前記各設定器11.
12およびランチ回路13.14からの各々の出力に基
いて周知の演算法によシ処理を行うことにより、管面出
力波形の2点間の時間差、電圧差などの情報を算出して
、その演算結果を表示すべき数値信号として口字状のセ
グメント素子などからなる表示器16に送出するものと
なっている。17は第1のデジタル比較器9の一致出力
と第2のデジタル比較器10の一致出力を入力とするオ
アゲートでt>D、とのオア出力を輝度信号として輝度
変調回路5に送出している。
リ2と同様の第2のメモリ、8は第2のメモリ7のアド
レスをカウントしそのカウント出力をシフトパルスとし
て該メモリ7に送出するアドレスカウンタ、9,10は
前記アドレスカウンタ8のカウント出力を一方の入力端
子にそれぞれ入力とする第1および第2のデジタル比較
器、11は第1のデジタル比較器9の他方の入力端子に
その設定値として符号化された数値信号を送出する第1
の設定器、12は第2のデジタル比較器10の他方の入
力端子にその設定値として符号化された数値信号を送出
する第2の設定器で1、これら第1および第2設定器1
1.12は第2のメモリ7のアドレスに相当する数値信
号をプログラマブルに設定可能なものからなる。13は
第1のデジタル比較器9の一致出力により第2のメモリ
7のアドレスに対応するデータを一時記憶する第1のラ
ンチ回路、14は第2のデジタル比較器10の一致出力
によシ第2のメモリ7のアドレスに対応するデータを一
時記憶する第2のランチ回路、15は第1および第2の
ランチ回路13.14の各データ出力を入力とするとと
もに、第1および第2の設定器11.12の数値出力を
入力とする演算器である。この演算器15は、演算素子
およびデコーダなどから構成され、前記各設定器11.
12およびランチ回路13.14からの各々の出力に基
いて周知の演算法によシ処理を行うことにより、管面出
力波形の2点間の時間差、電圧差などの情報を算出して
、その演算結果を表示すべき数値信号として口字状のセ
グメント素子などからなる表示器16に送出するものと
なっている。17は第1のデジタル比較器9の一致出力
と第2のデジタル比較器10の一致出力を入力とするオ
アゲートでt>D、とのオア出力を輝度信号として輝度
変調回路5に送出している。
次に、上記実施例構成の動作について説明する。
ここで、被観測波形のアナログ4g@AがA−D変換器
1に入力されると、この入力信号はA−D変換器1によ
ってデジタル信号に変換され、その出力がデータとして
第1および第2のメモリ2,7にそれぞれ記憶される。
1に入力されると、この入力信号はA−D変換器1によ
ってデジタル信号に変換され、その出力がデータとして
第1および第2のメモリ2,7にそれぞれ記憶される。
しかる後、波形表示に際し第1のメモリ2に記憶された
データが読出されると、このデータはD−A変換器3に
入力されてもとのアナログ信号に変換され、そのアナロ
グ出力が偏向信号Yとして陰極線管6の垂直偏向部に順
次送出される。これと同時にアドレスカウンタ8は前記
第1のメモリ2の読出し動作と同期して第2のメモリ8
のアドレスをカウントしておシ、そのカウント出力は掃
引回路4.第2のメモリ1に送出でれるとともに、第1
および第2のデジタル比較器9.10にも送出される。
データが読出されると、このデータはD−A変換器3に
入力されてもとのアナログ信号に変換され、そのアナロ
グ出力が偏向信号Yとして陰極線管6の垂直偏向部に順
次送出される。これと同時にアドレスカウンタ8は前記
第1のメモリ2の読出し動作と同期して第2のメモリ8
のアドレスをカウントしておシ、そのカウント出力は掃
引回路4.第2のメモリ1に送出でれるとともに、第1
および第2のデジタル比較器9.10にも送出される。
すると、第2のメモリ7は記憶したデータをアドレスカ
ウンタ8からのカウント出力により順次読出し、そのデ
ータ出力をそれぞれ第1および第2のラッチ回路13.
14に送出する。また、前記掃引回路4はアドレスカウ
ンタ8からのカウント出力を受けて時間軸信号Xを発生
し、この信号Xを陰極線管6の水平偏向部に送出する。
ウンタ8からのカウント出力により順次読出し、そのデ
ータ出力をそれぞれ第1および第2のラッチ回路13.
14に送出する。また、前記掃引回路4はアドレスカウ
ンタ8からのカウント出力を受けて時間軸信号Xを発生
し、この信号Xを陰極線管6の水平偏向部に送出する。
これによって、陰極線管6は、その管面に前記掃引回路
4からの時間軸信号Xによ#)D−A変換器3のアナロ
グ出力に対応した出力波形を表示する。
4からの時間軸信号Xによ#)D−A変換器3のアナロ
グ出力に対応した出力波形を表示する。
この出力波形表示中において、第1および第2の設定器
11.12を個々に操作してそれら設定器11および1
2に出力波形上の測定すべき2点間に対応した数値を設
定する。すると、第1のデジタル比較器9は、第1の設
定器11の数値出力とアドレスカウンタ8からのカウン
ト出力つます第2のメモリ7のアドレスが一致したとき
一致出力を発生する。この一致出力によって第1のラン
チ回路13は第2のメモリTから送出されてくるアドレ
スに対応するデータを一時記憶するとともに、その出力
を演算器15に送出する。また、第2のデジタル比較器
10も上述と同様に、第2の設定器12の数値出力と第
2のメモリ7のアドレスが一致したとき一致出力を発生
し、この一致出力によって第2のランチ回路14は第2
のメモリ7のアドレスに対応するデータを一時記憶する
とともに、その出力を演算器15に送出する。
11.12を個々に操作してそれら設定器11および1
2に出力波形上の測定すべき2点間に対応した数値を設
定する。すると、第1のデジタル比較器9は、第1の設
定器11の数値出力とアドレスカウンタ8からのカウン
ト出力つます第2のメモリ7のアドレスが一致したとき
一致出力を発生する。この一致出力によって第1のラン
チ回路13は第2のメモリTから送出されてくるアドレ
スに対応するデータを一時記憶するとともに、その出力
を演算器15に送出する。また、第2のデジタル比較器
10も上述と同様に、第2の設定器12の数値出力と第
2のメモリ7のアドレスが一致したとき一致出力を発生
し、この一致出力によって第2のランチ回路14は第2
のメモリ7のアドレスに対応するデータを一時記憶する
とともに、その出力を演算器15に送出する。
したがって、演算器15には前記第1および第2の設定
器11.12から第2のメモリ、7のアドレスに相当す
る数値出力が入力されるとともに、前記第1および第2
のランチ回路13.14から第2のメモリTのアドレス
に対応したデータ出力が入力されるため、演算器15は
これら各々の出力に基いて出力波形の2点間の時間差、
電圧差などを演算し、その演算結果を表示器16にて表
示することができる。例えば、出力波形の2点間の時間
差を表示する場合、演算器15は第1の設定器11の数
値出力と第2の設定器の数値出力とから時間差を演算す
ることによシ、その時間差出力を表示器16によって表
示できる。また、出力波形の2点間の電圧差を表示する
場合には、演算器15は第1のランチ回路13のデータ
出力と第2のランチ回路14のデータ出力とから電圧差
を演算することにより、その電圧差出力を表示器16に
て表示できる。このとき、前記各デジタル比較器9およ
び10からの一致出力はオアゲート17を通して輝度信
号Bとして輝度変調回路5に送出されるため、この輝度
変調回路5はその輝度信号を受けて陰極線管6の出力波
形上の2点間にカーソルを表示することになる。
器11.12から第2のメモリ、7のアドレスに相当す
る数値出力が入力されるとともに、前記第1および第2
のランチ回路13.14から第2のメモリTのアドレス
に対応したデータ出力が入力されるため、演算器15は
これら各々の出力に基いて出力波形の2点間の時間差、
電圧差などを演算し、その演算結果を表示器16にて表
示することができる。例えば、出力波形の2点間の時間
差を表示する場合、演算器15は第1の設定器11の数
値出力と第2の設定器の数値出力とから時間差を演算す
ることによシ、その時間差出力を表示器16によって表
示できる。また、出力波形の2点間の電圧差を表示する
場合には、演算器15は第1のランチ回路13のデータ
出力と第2のランチ回路14のデータ出力とから電圧差
を演算することにより、その電圧差出力を表示器16に
て表示できる。このとき、前記各デジタル比較器9およ
び10からの一致出力はオアゲート17を通して輝度信
号Bとして輝度変調回路5に送出されるため、この輝度
変調回路5はその輝度信号を受けて陰極線管6の出力波
形上の2点間にカーソルを表示することになる。
このように、上記実施例によると、陰極線管6の管面出
力波形上の2つの時間軸点間にカーソルを表示しながら
、その時間軸点に対応する時間差。
力波形上の2つの時間軸点間にカーソルを表示しながら
、その時間軸点に対応する時間差。
電圧差などの情報を表示することができる。また、出力
波形を記憶したメモリのデータおよび各設定器の数値出
力をデジタルのまま演算処理しているので、従来のよう
に、測定器による読み取り誤差もなく、出力波形上の時
間差および電圧差などの情報を正確に表示することがで
きる。さらに、各処理系はすべてデジタル化し得るため
、従来のアナログ比較器を用いるものに比べて構成が非
常に簡素化され、装置の小型化、低コスト化がはかれる
利点を有する。
波形を記憶したメモリのデータおよび各設定器の数値出
力をデジタルのまま演算処理しているので、従来のよう
に、測定器による読み取り誤差もなく、出力波形上の時
間差および電圧差などの情報を正確に表示することがで
きる。さらに、各処理系はすべてデジタル化し得るため
、従来のアナログ比較器を用いるものに比べて構成が非
常に簡素化され、装置の小型化、低コスト化がはかれる
利点を有する。
なお、本発明は上記実施例に限定されるものではなく、
演算器15の演算処理は出力波形上の2点間の関係に限
らず、第1および第2の設定器11゜12に対応する一
点の値を表示してもよい。また、演算器15の演算結果
は別の表示器16を用いることガく、陰極線管6面上に
表示することも周知の文字表示手段を用いて行うことが
できる。
演算器15の演算処理は出力波形上の2点間の関係に限
らず、第1および第2の設定器11゜12に対応する一
点の値を表示してもよい。また、演算器15の演算結果
は別の表示器16を用いることガく、陰極線管6面上に
表示することも周知の文字表示手段を用いて行うことが
できる。
以上説明したように本発明によれば、デジタルストレー
ジスコープなどの波形記憶装置において管面出力波形上
の任意時間軸点の情報を取シ出すことができるとともに
、その時間軸点に対応する時間差および電圧差などの情
報を容易にかつ正確に表示することができる。しかも、
装置の小型化。
ジスコープなどの波形記憶装置において管面出力波形上
の任意時間軸点の情報を取シ出すことができるとともに
、その時間軸点に対応する時間差および電圧差などの情
報を容易にかつ正確に表示することができる。しかも、
装置の小型化。
低コスト化がはかれるなどの優れた効果がある。
図は本発明に係る波形表示装置の一実施例を示す基本的
なブロック図である。 1・・・・AD変換器、2・・・・第1のメモリ、3・
・・・DA変換器、4・・・・掃引回路、5・・・・輝
度変調回路、6・・・・陰極線管、7・・・・第2のメ
モリ、8・・・・アドレスカウンタ、9・・・・第1の
デジタル比較器、10・・・・第2のデジタル比較器、
11・・・・第1の設定器、12・・・・第2の設定器
、13・・・・第1のラッチ回路、14・・・・第2の
ランチ回路、15・・・・演算器、16・・・・表示器
、1T・・・・オアゲート。 特許出願人 日立電子株式会社 代理人 山川政樹(を勃≧1名)
なブロック図である。 1・・・・AD変換器、2・・・・第1のメモリ、3・
・・・DA変換器、4・・・・掃引回路、5・・・・輝
度変調回路、6・・・・陰極線管、7・・・・第2のメ
モリ、8・・・・アドレスカウンタ、9・・・・第1の
デジタル比較器、10・・・・第2のデジタル比較器、
11・・・・第1の設定器、12・・・・第2の設定器
、13・・・・第1のラッチ回路、14・・・・第2の
ランチ回路、15・・・・演算器、16・・・・表示器
、1T・・・・オアゲート。 特許出願人 日立電子株式会社 代理人 山川政樹(を勃≧1名)
Claims (1)
- 入力信号をA−D変換器でデジタル信号に変換し、その
出力をメモリに記憶した後、この記憶したデータを読出
してD−A変換しアナログ波形として陰極線管上に表示
する波形表示装置において、前記メモリのアドレスをカ
ウントするアドレスカウンタのカウント出力をそれぞれ
入力とする第1および第2のデジタル比較器と、該第1
のデジタル比較器の設定値をプログラマブルに設定可能
な第1の設定器と、前記第2のデジタル比較器の設定値
をプログラマブルに設定可能な第2の設定器と、前記第
1のデジタル比較器の一致出方にょシ前記メモリのアド
レスに対応するデータを一時記憶する第1のランチ回路
と、前記第2のデジタル比較器の一致出力により前記メ
モリのアドレスに対応するデータを一時記憶する第2の
ラッチ回路と、前記第1および第2のランチ回路に一時
記憶したデータ出力と前記第1および第2の設定器に設
定した数値出力とを入力としこれら各出力に基いて演算
する演算手段と、この演算手段から得られる演算結果を
表示する表示手段とを備え、管面出力波形の任意時間軸
点に対応する時間差、電圧差などの情報を表示するよう
にしたことを特徴とする波形表示装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20585682A JPS5995471A (ja) | 1982-11-24 | 1982-11-24 | 波形表示装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20585682A JPS5995471A (ja) | 1982-11-24 | 1982-11-24 | 波形表示装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5995471A true JPS5995471A (ja) | 1984-06-01 |
Family
ID=16513839
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP20585682A Pending JPS5995471A (ja) | 1982-11-24 | 1982-11-24 | 波形表示装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5995471A (ja) |
-
1982
- 1982-11-24 JP JP20585682A patent/JPS5995471A/ja active Pending
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