JPS599245Y2 - display device - Google Patents
display deviceInfo
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- JPS599245Y2 JPS599245Y2 JP2548679U JP2548679U JPS599245Y2 JP S599245 Y2 JPS599245 Y2 JP S599245Y2 JP 2548679 U JP2548679 U JP 2548679U JP 2548679 U JP2548679 U JP 2548679U JP S599245 Y2 JPS599245 Y2 JP S599245Y2
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- display
- digit
- register
- microprocessor
- display device
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- Digital Computer Display Output (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Devices For Indicating Variable Information By Combining Individual Elements (AREA)
- Displays For Variable Information Using Movable Means (AREA)
Description
【考案の詳細な説明】
本考案は、マイクロプロセッサにより複数桁の表示をリ
フレッシュ動作させて、複数桁の数字或は、文字等を表
示する表示装置において、リフレッシュ動作中断時にお
ける誤り表示を防止する回路を具備した表示装置に関す
るものである。[Detailed description of the invention] The present invention refreshes a multi-digit display using a microprocessor to prevent erroneous display when the refresh operation is interrupted in a display device that displays multi-digit numbers or characters. The present invention relates to a display device equipped with a circuit.
例えば複数桁の数字表示を行うLED等の表示器により
数字を表示する場合は、表示装置の各桁のセグメントを
選択駆動するセグメントドライバーにより表示装置を駆
動している。For example, when displaying numbers using a display device such as an LED that displays a multi-digit number, the display device is driven by a segment driver that selectively drives a segment for each digit of the display device.
第1図は、そのような従来装置の概略を示すブロック系
統図である。FIG. 1 is a block diagram schematically showing such a conventional device.
1は例えば、6桁の数字を表示するため6個のデイジッ
ト11〜16を具備した表示器であり、各デイジットは
、7つのセグメントa−gの発光により数字を表示する
。For example, 1 is a display device having six digits 11 to 16 to display a six-digit number, and each digit displays a number by the light emission of seven segments a to g.
この7つのセグメン}a−gは、夫々各テ゛イジットに
対応して設けられたセグメントドライバー21〜26に
より、各セグメン}a−gが適宜選択駆動され、表示器
1は、6つのデイジット11〜16が同時に発光するこ
とにより、6桁の数字を表示する。These seven segments }a-g are selectively driven as appropriate by segment drivers 21-26 provided corresponding to the respective digits, and the display 1 displays six digits 11-16. By emitting light at the same time, a 6-digit number is displayed.
このような従来装置においては、各デイジット即ち6個
のデイジットは、同時に駆動されるため、表示器1は比
較的大きな電流が必要とされる。In such conventional devices, each digit, or six digits, are driven simultaneously, so the display 1 requires a relatively large current.
このような上記欠点を避けるため、従来よりマイクロプ
ロセッサを用いて表示器をリフレッシュ動作させること
が行われている。In order to avoid the above-mentioned drawbacks, a microprocessor has conventionally been used to perform a refresh operation on a display.
第2図は、マイクロプロセッサを用いて表示器をリフレ
ッシュ動作させる従来からの表示装置を示すブロック系
統図である。FIG. 2 is a block system diagram showing a conventional display device in which a display device is refreshed using a microprocessor.
1は表示器であり、第1図に於ける表示器と同様に、例
えば6個のデイジット11〜16を含み、各デイジット
は、7つのセグメントの発光により麹字を表示する。Reference numeral 1 denotes a display, which, like the display in FIG. 1, includes, for example, six digits 11 to 16, and each digit displays a koji character by emitting light from seven segments.
31はデイジットドライバ、32はセグメントドライバ
、41はテ゛イジットレジスタ、42はセグメントレジ
スタである。31 is a digit driver, 32 is a segment driver, 41 is a digit register, and 42 is a segment register.
5はマイクロプロセッサ、6はROM(読み出し専用メ
モリ)、7はRAM (リードライトメモリ)である。5 is a microprocessor, 6 is a ROM (read only memory), and 7 is a RAM (read/write memory).
表示器1に表示すべきデータは、RAM7に書込まれて
おり、このデータが、マイクロプロセッサ5によりRO
M6に格納されたプログラムに従って表示器1をリフレ
ッシュ動作されるよう処理され、この処理されたデータ
がデータバス50を介してレジスタ41, 42に書込
まれる。The data to be displayed on the display 1 is written in the RAM 7, and this data is sent to the RO by the microprocessor 5.
The display device 1 is processed to be refreshed according to the program stored in the M6, and the processed data is written to the registers 41 and 42 via the data bus 50.
即ち、マイ.クロプロセッサ5は、ROM6に格納され
たプログラムに従って、デイジット11〜16のうちい
ずれか1つを選択するデイジット情報をテ゛イジットレ
ジスタ41に書込み、RAM7より表示すべきデータを
読出して、上記選択されたデイジットのセグメントを選
択するセグメント情報をセグメントレジスタ42に書込
む。In other words, my. The computer processor 5 writes digit information for selecting one of digits 11 to 16 in the digit register 41 according to the program stored in the ROM 6, reads data to be displayed from the RAM 7, and selects the selected digit. Segment information for selecting a segment of digits is written to segment register 42.
なお、これら情報の書込みは、マイクロプロセッサ5よ
りレジスタ41,レジスタ42のクロツク端子に供給さ
れる書込みストローブ信号Stに同期して行われる。Note that writing of this information is performed in synchronization with a write strobe signal St supplied from the microprocessor 5 to the clock terminals of the registers 41 and 42.
さらに、デイジットドライバ31は、テ゛イジットレジ
スタ41に書込まれたデイジット情報に従って、デイジ
ット11〜16のうち1つを選択駆動させ、セグメント
ドライバ32は、セグメントレジスタ42に書込まれた
セグメント情報に従って、上記選択されたlつのデイジ
ットのセグメン}a−gを選択駆動し、表示器上の1つ
のテ゛イジットに数字を表示する。Further, the digit driver 31 selectively drives one of digits 11 to 16 according to the digit information written in the digit register 41, and the segment driver 32 selectively drives one of the digits 11 to 16 according to the segment information written in the segment register 42. , segments }a-g of the selected one digit are selectively driven to display a number on one digit on the display.
例えばRAM7に書込まれた6桁の10進数に対応する
データは、マイクロプロセッサ5により始めその10進
数の第1桁目の数が取出され、レジスタ41に第1桁目
のデイジット11ヲ選択するディジット情報が書込まれ
、レジスタ42には第1桁目の数を表示するためのセグ
メント情報が書込まれる。For example, for data corresponding to a 6-digit decimal number written in the RAM 7, the first digit of the decimal number is taken out by the microprocessor 5, and the first digit 11 is selected in the register 41. Digit information is written, and segment information for displaying the first digit number is written into the register 42.
このようにして始めに第1桁目の数字が、デイジット1
1に表示された後、一定時間が経過すると、次の桁を表
示するようマイクロプロセッサ5より次のデイジット情
報及びセグメント情報が、夫々レジスタ41,レジスタ
42に書込みストローブ信号Stの発生とともに書込ま
れる。In this way, the first digit is digit 1.
1, after a certain period of time has elapsed, the microprocessor 5 writes the next digit information and segment information into the registers 41 and 42, respectively, in order to display the next digit, with the generation of the write strobe signal St. .
従って、第l桁目が表示されて一定時間が経過すると、
次の書込みストローブ信号の発生により、次の桁の情報
がレジスタ41.42に書込まれて第2桁目がデイジッ
ト12に表示され、以下順次第3桁目、第4桁目と間欠
的に表示が行われる。Therefore, after the first digit is displayed and a certain period of time has passed,
When the next write strobe signal is generated, the next digit of information is written to registers 41 and 42, the second digit is displayed on digit 12, and then the third and fourth digits are displayed intermittently. Display is performed.
第2図の如く6桁を表示する表示器においては、5QH
z以上の周期でリフレッシュ動作をくり返せば、見かけ
上全桁を同時に表示することが可能となる。In a display that displays 6 digits as shown in Figure 2, 5QH
By repeating the refresh operation at a cycle of z or more, it becomes possible to display all digits at the same time.
このようにマイクロプロセッサにより、リフレッシュ動
作をさせる従来からの表示装置は、駆動されるデイジッ
トが常に1つであるため、消費電流を非常に少なくする
ことができる。In the conventional display device in which the refresh operation is performed by a microprocessor in this manner, only one digit is driven at all times, so current consumption can be extremely reduced.
しがしながらマイクロプロセッサ5が他の演算処理を行
い、その間リフレッシュ動作を止めると、レジスタ41
. 42の内容は書きかえられない。However, if the microprocessor 5 performs other arithmetic processing and stops the refresh operation during that time, the register 41
.. The contents of 42 cannot be rewritten.
このために最後に選択された桁だけが表示器1に表示さ
れ、他の桁は表示されず、表示器1には誤まった表示が
行われることになる。For this reason, only the last selected digit is displayed on the display 1, and the other digits are not displayed, resulting in an incorrect display on the display 1.
従って、このような誤表示を行うことなしに、マイクロ
プロセッサ5にリフレッシュ動作以外の演算処理を行わ
せるには、リフレッシュ動作を最優先させ、他の処理は
リフレッシュ動作の合間に行うことが必要であった。Therefore, in order to have the microprocessor 5 perform arithmetic processing other than the refresh operation without causing such erroneous display, it is necessary to give top priority to the refresh operation and perform other processes in between the refresh operations. there were.
従って、リフレッシュ動作のために費す時間、所謂オー
バーヘッドのためにマイクロプロセッサの処理能力が著
しく狭められていた。Therefore, the processing power of the microprocessor has been significantly reduced due to the so-called overhead, which is the time required for the refresh operation.
本考案は、このような従来技術の欠点を解決するもので
あり、マイクロプロセッサがリフレッシュ動作以外の演
算処理を連続して行う場合に、レジスタ41或は、42
の出力を禁止する禁止手段により表示器の表示を禁止し
、誤った表示を行わないようにしたものである。The present invention solves these drawbacks of the conventional technology, and when a microprocessor continuously performs arithmetic processing other than refresh operations, the register 41 or 42 is
In this system, the display on the display device is prohibited by means of a prohibition means that prohibits the output of the signal, thereby preventing erroneous display.
第3図aは、このような本考案目的を達戊するための禁
止手段を示すブロック系統図である。FIG. 3a is a block system diagram showing prohibition means for achieving the object of the present invention.
禁止手段10はリトリガブル・パルス発生回路8とゲー
ト回路9とを具備している。The inhibiting means 10 includes a retriggerable pulse generating circuit 8 and a gate circuit 9.
40は第2図に於ける従来装置のレジスタ41或は、4
2を表わし、30は同じく第2図に於けるドライバ31
或は、32を示す。40 is the register 41 or 4 of the conventional device in FIG.
2, and 30 also represents the driver 31 in FIG.
Or it shows 32.
レジスタ40の各出力40 aは夫夫ゲート回路9を介
してドライバ30に接続されており、上記ゲート回路9
はリトリガブル・パルス発生回路8の出力aがら供給さ
れるパルスPによりゲートを開く。Each output 40a of the register 40 is connected to the driver 30 via the gate circuit 9.
The gate is opened by the pulse P supplied from the output a of the retriggerable pulse generation circuit 8.
従って、パルスPがゲート回路9に供給されている間は
、ドライバ30にレジスタ40の出力40 aが供給さ
れる。Therefore, while the pulse P is being supplied to the gate circuit 9, the output 40a of the register 40 is supplied to the driver 30.
またリトリガブル・パルス発生回路8は、書込ストロー
ブ信号Stの入力により、所定時間tなるパルス幅を有
するパルスPを発生し、この時間tは書込ストローブ信
号Stが発生する時間間隔、即ちリフレッシュ間隔より
もわずかに大きくとられている。In addition, the retriggerable pulse generation circuit 8 generates a pulse P having a pulse width of a predetermined time t in response to the input of the write strobe signal St, and this time t is the time interval at which the write strobe signal St is generated, that is, the refresh interval. It is slightly larger than the
図bは、リトリガブル・パルス発生器8の動作説明に供
する図であり、書込ストローブ信号Stが発生すると、
時間幅大なる出力端子aより発生するパルスPと、書込
ストローブ信号Stを示している。FIG. b is a diagram for explaining the operation of the retriggerable pulse generator 8. When the write strobe signal St is generated,
A pulse P generated from an output terminal a having a large time width and a write strobe signal St are shown.
このため、マイクロプロセッサ5がリフレッシュ動作を
行っている間は、第2図に示した従来装置と同様に表示
器1には各桁の表示が順次行われ、全桁のデータが表示
される。Therefore, while the microprocessor 5 is performing the refresh operation, each digit is sequentially displayed on the display 1, similar to the conventional device shown in FIG. 2, and data for all digits is displayed.
一方マイクロプロセッサ5が一時他の演算処理を行う必
要がある時は、リフレッシュ動作の中断後、所定の時間
tを経ると、リトリガブルス発生回路8のパルスPが消
えてゲート9が閉じる。On the other hand, when the microprocessor 5 temporarily needs to perform other arithmetic processing, the pulse P of the retriggerable generation circuit 8 disappears and the gate 9 closes after a predetermined time t has elapsed after the refresh operation is interrupted.
従って、ドライバ30にはレジスタ40の出力40 a
が供給されなくなり、表示器1にはテ゛一夕が表示され
ない。Therefore, the driver 30 has the output 40a of the register 40.
is no longer supplied, and the display 1 does not display any data at all.
このように本考案の実施により、マイクロプロセッサ5
が、リフレッシュ動作を中止した場合は、表示器1の表
示が行われないため、表示器1に誤まった表示がなされ
ることはなくなる。In this way, by implementing the present invention, the microprocessor 5
However, if the refresh operation is canceled, no display is performed on the display 1, so that the display 1 will not display an incorrect display.
また従来では、誤表示を行わせることなくリフレッシュ
動作以外の演算をマイクロプロセッサに行わせるには、
リフレッシュ動作によるオーバーヘッドによりマイクロ
プロセッサの処理能力が制限されていた。In addition, in the past, in order to have a microprocessor perform operations other than refresh operations without causing erroneous display,
The overhead of refresh operations has limited the processing power of microprocessors.
しかし本考案の実施により、リフレッシュ動作を中断し
ても誤表示を行わないため、マイクロプロセッサはオー
バーヘッドの影響を受けることがなく、長い間リフレッ
シュ動作以外の演算を行うことができるようになる。However, by implementing the present invention, no erroneous display occurs even if the refresh operation is interrupted, so the microprocessor is not affected by overhead and can perform operations other than the refresh operation for a long time.
なお、第3図aにおいて、禁止手段10は第2図におけ
るデイジットレジスタ41又は、セグメントレジスタ4
2のいずれかに適用されればよく、デイジットレジスタ
41又は、セグメントレジスタ42のいずれかの出力が
禁止手段10により禁止されれば、表示器1は表示を行
わない。In addition, in FIG. 3a, the inhibiting means 10 is the digit register 41 or the segment register 4 in FIG.
If the output of either the digit register 41 or the segment register 42 is prohibited by the inhibiting means 10, the display 1 will not display.
しかしながら禁止手段10をレジスタ41. 42の双
方に適用してもよいことはもちろんである。However, the inhibiting means 10 is set to the register 41. Of course, the present invention may be applied to both of 42 and 42.
第4図は、禁止手段10の他の実施例を示す系統ブロッ
ク図である。FIG. 4 is a system block diagram showing another embodiment of the inhibiting means 10.
この禁止手段は、レジスタ40がリセット端子CRを有
する場合に適用されうるちのであり、書込ストローブ信
号Stがレジスタ40のクロツク端子CLに供給される
とともに、リトリガブル・パルス発生器8にも供給され
、この’J }リガブル発生器8の出力は、レジスタ4
0のリセツト端子CRに供給される。This inhibiting means is applicable when the register 40 has a reset terminal CR, and the write strobe signal St is supplied to the clock terminal CL of the register 40 and also to the retriggerable pulse generator 8. , this 'J } output of the regable generator 8 is stored in the register 4
0 reset terminal CR.
リト゛リガブル・パルス発生器8は第3図にて示したも
のと同様、書込ストローブ信号Stが供給されると、所
定時間tなるパルス幅を有するものである。Like the one shown in FIG. 3, the resettable pulse generator 8 has a pulse width of a predetermined time t when the write strobe signal St is supplied.
従って、所定時間t内に書込ストローブ信号Stが供給
されないとパルスPが消失することによりレジスタ40
はリセットされ、ドライバ30は駆動されない。Therefore, if the write strobe signal St is not supplied within the predetermined time t, the pulse P disappears and the register 40
is reset and the driver 30 is not driven.
第1図は、複数桁の表示を同時に行う表示装置のブロッ
ク系統図、第2図は、リフレッシュ動作を行う従来の表
示装置のブロック系統図、第3図aは、本考案表示装置
に適用される禁止手段のブロック系統図、図bはその動
作説明に供する図、第4図は、本考案表示装置に適用さ
れる禁止手段の他の例のブロック系統図である。
1:表示器、31:デイジットドライバ、32:セグメ
ントドライバ、41:デイジットレジスタ、42:セグ
メントレジスタ、5:マイクロプロセッサ、6:ROM
、7:RAM、40:レジスタ、8:リトリガブル・パ
ルス発生回路、9:ゲート回路、10:禁止手段、30
:ドライバ、St:書込みストローブ信号。FIG. 1 is a block system diagram of a display device that simultaneously displays multiple digits, FIG. 2 is a block system diagram of a conventional display device that performs a refresh operation, and FIG. FIG. 4 is a block system diagram of another example of the prohibition means applied to the display device of the present invention. FIG. 1: Display, 31: Digit driver, 32: Segment driver, 41: Digit register, 42: Segment register, 5: Microprocessor, 6: ROM
, 7: RAM, 40: Register, 8: Retriggerable pulse generation circuit, 9: Gate circuit, 10: Inhibition means, 30
: Driver, St: Write strobe signal.
Claims (1)
あって、該表示すべき数字或は、文字の各桁を順次1桁
づつマイクロプロセッサよりストローブ信号の発生によ
り、リフレッシュ表示する表示装置において、上記スト
ローブ信号が発生した後一定時間は上記表示器を駆動さ
せ上記一定時間新たなストローブ信号が発生されないと
上記表示器の駆動を禁止する禁止手段を具備してなる表
示装置。A display device that displays multiple digits or characters on a display, in which each digit of the numbers or characters to be displayed is refreshed one by one by the generation of a strobe signal from a microprocessor. The display device comprises a prohibiting means for driving the display for a predetermined period of time after the generation of the strobe signal and prohibiting driving of the display if no new strobe signal is generated for the predetermined period of time.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2548679U JPS599245Y2 (en) | 1979-02-28 | 1979-02-28 | display device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2548679U JPS599245Y2 (en) | 1979-02-28 | 1979-02-28 | display device |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS55125679U JPS55125679U (en) | 1980-09-05 |
JPS599245Y2 true JPS599245Y2 (en) | 1984-03-23 |
Family
ID=28865943
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2548679U Expired JPS599245Y2 (en) | 1979-02-28 | 1979-02-28 | display device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS599245Y2 (en) |
-
1979
- 1979-02-28 JP JP2548679U patent/JPS599245Y2/en not_active Expired
Also Published As
Publication number | Publication date |
---|---|
JPS55125679U (en) | 1980-09-05 |
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