JPS5981712A - 制御方式 - Google Patents
制御方式Info
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- JPS5981712A JPS5981712A JP57191789A JP19178982A JPS5981712A JP S5981712 A JPS5981712 A JP S5981712A JP 57191789 A JP57191789 A JP 57191789A JP 19178982 A JP19178982 A JP 19178982A JP S5981712 A JPS5981712 A JP S5981712A
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- Japan
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- frequency
- phase
- load
- control
- clock
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- Pending
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02P—CONTROL OR REGULATION OF ELECTRIC MOTORS, ELECTRIC GENERATORS OR DYNAMO-ELECTRIC CONVERTERS; CONTROLLING TRANSFORMERS, REACTORS OR CHOKE COILS
- H02P5/00—Arrangements specially adapted for regulating or controlling the speed or torque of two or more electric motors
- H02P5/46—Arrangements specially adapted for regulating or controlling the speed or torque of two or more electric motors for speed regulation of two or more dynamo-electric motors in relation to one another
- H02P5/52—Arrangements specially adapted for regulating or controlling the speed or torque of two or more electric motors for speed regulation of two or more dynamo-electric motors in relation to one another additionally providing control of relative angular displacement
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S388/00—Electricity: motor control systems
- Y10S388/907—Specific control circuit element or device
- Y10S388/911—Phase locked loop
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
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- Y10S388/907—Specific control circuit element or device
- Y10S388/921—Timer or time delay means
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S388/00—Electricity: motor control systems
- Y10S388/923—Specific feedback condition or device
- Y10S388/933—Radiant energy responsive device
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Control Of Multiple Motors (AREA)
- Control Of Electric Motors In General (AREA)
- Control Of Velocity Or Acceleration (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明は’pLしくフェーズロックループ)による制御
方式に関するものである。さらに、本発明は複写機等に
おいて複数のDC(直流)モータをPLL制御で速度制
御する場合に好適である。
方式に関するものである。さらに、本発明は複写機等に
おいて複数のDC(直流)モータをPLL制御で速度制
御する場合に好適である。
従来技術
従来の複写機やファクシミリ装置等の画像記録装置にお
いて、感光ドラムや光学系等の駆動を複数のDCモータ
により駆動する場合に、それらのモータの速度を制御す
る方法としては一般的にPLL制御で行っていた。この
ようなPLL制御には種々の制御方式が提案され実施さ
れているが、それらのどの制御方式でも制御に電源の容
量との関連を持たせたものはなかった。一方、複写機の
駆動用DCモータは合計すると通常数A(アンペア)の
電流が流れるので、PLL制御を各負荷毎に独自に行っ
たりあるいは同じ基準周波数でPLL制御を行ったりす
ると各負荷の合計電流は非常に大きくなり、そのため電
源の容量を大きくし、またその負荷電流に見合った素子
や保護部品等を選択する必要が生じるので製造原価が上
昇してしまうという問題があった。
いて、感光ドラムや光学系等の駆動を複数のDCモータ
により駆動する場合に、それらのモータの速度を制御す
る方法としては一般的にPLL制御で行っていた。この
ようなPLL制御には種々の制御方式が提案され実施さ
れているが、それらのどの制御方式でも制御に電源の容
量との関連を持たせたものはなかった。一方、複写機の
駆動用DCモータは合計すると通常数A(アンペア)の
電流が流れるので、PLL制御を各負荷毎に独自に行っ
たりあるいは同じ基準周波数でPLL制御を行ったりす
ると各負荷の合計電流は非常に大きくなり、そのため電
源の容量を大きくし、またその負荷電流に見合った素子
や保護部品等を選択する必要が生じるので製造原価が上
昇してしまうという問題があった。
目的
本発明は上述の点に鑑みてなされたもので、複数の負荷
のPLL制御を行う際して、共通の原発振器から発信し
た基準信号からそれぞれ位相をずらした複数の基準周波
数を生成して位相制御を行うことにより、各負荷に流れ
る電流を時間的にずらして電源の負担を軽減するように
した制御hts方式を提供することを目的とする。
のPLL制御を行う際して、共通の原発振器から発信し
た基準信号からそれぞれ位相をずらした複数の基準周波
数を生成して位相制御を行うことにより、各負荷に流れ
る電流を時間的にずらして電源の負担を軽減するように
した制御hts方式を提供することを目的とする。
実施例
以下、図面を参照して本発明の詳細な説明する。
第1図は本発明制御方式を適用した複写機等の制御回路
の概略構成例を示し、ここで、lは周波数foのクロッ
クを発生する共通の原発振器、2は周波数fOを分周し
て第1の基準周波数fsのクロックを送出する分周器、
3は第1の基準周波数f8かも所定量位相をずらした第
2の基準周波数fs’のクロックを生成する遅延回路、
4は後述の負荷からの帰還周波数fRと基準周波数fs
の両位相を比較してその誤差に比例した平均直流電圧O
Vを発生する位相比較器である。5は誤差増幅器とPW
M器(パルス幅変調器)から成る回路であり、位相比較
器4の出力OVに応して位相誤差に対応したPWM出力
を送出する。6は所定のフィルタ回路と駆動回路とから
なる回路であり、PWM出力に応じて第1の負荷7を駆
動する。負荷7は例えば複写機の感光ドラムや光学系等
の駆動を行うDCモータである。8はその負荷7の回転
速度に対応した帰還信号を増幅して前述の帰還周波数f
Rの信号を供給する増幅器であり、上述の回路4〜8お
よび8により負荷7を位相制御するPLL制御回路9を
構成する。
の概略構成例を示し、ここで、lは周波数foのクロッ
クを発生する共通の原発振器、2は周波数fOを分周し
て第1の基準周波数fsのクロックを送出する分周器、
3は第1の基準周波数f8かも所定量位相をずらした第
2の基準周波数fs’のクロックを生成する遅延回路、
4は後述の負荷からの帰還周波数fRと基準周波数fs
の両位相を比較してその誤差に比例した平均直流電圧O
Vを発生する位相比較器である。5は誤差増幅器とPW
M器(パルス幅変調器)から成る回路であり、位相比較
器4の出力OVに応して位相誤差に対応したPWM出力
を送出する。6は所定のフィルタ回路と駆動回路とから
なる回路であり、PWM出力に応じて第1の負荷7を駆
動する。負荷7は例えば複写機の感光ドラムや光学系等
の駆動を行うDCモータである。8はその負荷7の回転
速度に対応した帰還信号を増幅して前述の帰還周波数f
Rの信号を供給する増幅器であり、上述の回路4〜8お
よび8により負荷7を位相制御するPLL制御回路9を
構成する。
10は第2の負荷、11は上述の制御回路8と同様な構
成のPLL制御回路であり、この制御回路11は遅延回
路3から供給される第2の基準周波数 fS’に応して
第2の負荷10の位相制御を行う。
成のPLL制御回路であり、この制御回路11は遅延回
路3から供給される第2の基準周波数 fS’に応して
第2の負荷10の位相制御を行う。
次に第1図の動作を説明する。
原発振器lから発振された周波数fOのクロックを分周
器2により分周して得られた周波数f8のクロックが、
分周器2から送出される。この周波数f8のクロックは
位相比較器4に基準クロックとして供給され、負荷7の
回転速度に同期した周波afRの帰還信号と位相比較さ
れる。位相比較器4によって検出された誤差信号OVは
、誤差増幅器とPWM (パルス幅変調)とから成る
回路5により処理を受けてPWM出力に変換され、回路
5がら送出される。このPWM出力は適切なフィルタ回
路と駆動回路とがうなる回路8に供給されて負荷7を駆
動する。
器2により分周して得られた周波数f8のクロックが、
分周器2から送出される。この周波数f8のクロックは
位相比較器4に基準クロックとして供給され、負荷7の
回転速度に同期した周波afRの帰還信号と位相比較さ
れる。位相比較器4によって検出された誤差信号OVは
、誤差増幅器とPWM (パルス幅変調)とから成る
回路5により処理を受けてPWM出力に変換され、回路
5がら送出される。このPWM出力は適切なフィルタ回
路と駆動回路とがうなる回路8に供給されて負荷7を駆
動する。
一力、分周器2によって生成された周波数fsのクロッ
クは遅延回路3にも供給されて適切な遅れをもった周波
数rs′のクロック信号に変換され、他の負荷用回路1
1に供給される。この回路11においては、周波数fs
′のクロックと第2の負荷10の回転速度に対応した周
波数fK帰還信号との位相比較が行われる。
クは遅延回路3にも供給されて適切な遅れをもった周波
数rs′のクロック信号に変換され、他の負荷用回路1
1に供給される。この回路11においては、周波数fs
′のクロックと第2の負荷10の回転速度に対応した周
波数fK帰還信号との位相比較が行われる。
第2図(A)〜(C)は!J1図の回路8または11に
おける位相比較動作の一例を示し、図示のように基準周
波afsまたはfs′と帰還周波数fRまたはfR′の
位相差に応じて、その位相差がある場合にはこの誤差を
縮める方向に制御信号としてPWM信号が発生される。
おける位相比較動作の一例を示し、図示のように基準周
波afsまたはfs′と帰還周波数fRまたはfR′の
位相差に応じて、その位相差がある場合にはこの誤差を
縮める方向に制御信号としてPWM信号が発生される。
なお、実際の回路では第1図に示したような単純な回路
構成のみではなく、本例の位相制御と他の速度制御等を
組合わせて精度の良い負荷駆動制御を行うように構成す
ることは勿論である。例えば、帰還周波数がX準周波数
に対して一定の差になるまでは速度誤差を検出して制御
し、ある程度基準周波数に近づいてきたら位相制御を行
うというようにしても良い。その際の速度制御では負荷
からの帰11波数をF/V (周波数−電圧)変換して
基準電だと比較し、その誤差で速度制御するようにする
。−力、位相制御の方では位相に対して進み方向か遅れ
方向かの状態を表す信号を出し、速度制御信号と位相制
御信号の組合わせで位相制御のロック範囲に持っていく
ようにすると好適である。
構成のみではなく、本例の位相制御と他の速度制御等を
組合わせて精度の良い負荷駆動制御を行うように構成す
ることは勿論である。例えば、帰還周波数がX準周波数
に対して一定の差になるまでは速度誤差を検出して制御
し、ある程度基準周波数に近づいてきたら位相制御を行
うというようにしても良い。その際の速度制御では負荷
からの帰11波数をF/V (周波数−電圧)変換して
基準電だと比較し、その誤差で速度制御するようにする
。−力、位相制御の方では位相に対して進み方向か遅れ
方向かの状態を表す信号を出し、速度制御信号と位相制
御信号の組合わせで位相制御のロック範囲に持っていく
ようにすると好適である。
第3図(A)〜(E)は第1図の各部の出力信号のタイ
ミングの一例を示し、ここで周波数fsと周波数fS’
とは互いに位相が180 °ずれているため、その時雨
負荷7およびlOに流れる合計電流lの波形は図(E)
で示すように、例えばわずかにα点の時にのみ加算され
るにすぎないこととなる。このように、適切な位相ずれ
を各基準クロックに対して設けるようにしているので電
源への負担は従来方式に比較して著しく少なくなる。す
なわち、画周波数fsおよびfS′の位相がもし従来の
ように゛ずれていない場合には、第4図(A)〜(D)
に示したようになり、負荷7およびlOに対して大きな
電流工′が流れる時間が圧倒的に長いこととなるからで
ある。
ミングの一例を示し、ここで周波数fsと周波数fS’
とは互いに位相が180 °ずれているため、その時雨
負荷7およびlOに流れる合計電流lの波形は図(E)
で示すように、例えばわずかにα点の時にのみ加算され
るにすぎないこととなる。このように、適切な位相ずれ
を各基準クロックに対して設けるようにしているので電
源への負担は従来方式に比較して著しく少なくなる。す
なわち、画周波数fsおよびfS′の位相がもし従来の
ように゛ずれていない場合には、第4図(A)〜(D)
に示したようになり、負荷7およびlOに対して大きな
電流工′が流れる時間が圧倒的に長いこととなるからで
ある。
なお、実際の回路では、モータの時定数やフィルタの特
性のために、あるいは帰還ループの遅れ等の種々の要素
があるために第2図〜第4図に示すようなきれいな波形
が必ずしも得られるわけではないが、それらの添付図面
は本制御原理を説明する上でわかりやすいように図示し
たものである。また、本実施例ではディジタルPLL制
御回路を用いて説明したが、従来のアナログPLL制御
回路を用いてもさしつかえない。
性のために、あるいは帰還ループの遅れ等の種々の要素
があるために第2図〜第4図に示すようなきれいな波形
が必ずしも得られるわけではないが、それらの添付図面
は本制御原理を説明する上でわかりやすいように図示し
たものである。また、本実施例ではディジタルPLL制
御回路を用いて説明したが、従来のアナログPLL制御
回路を用いてもさしつかえない。
効果
以上説明したように、本発明によれば、原発振器から発
振させたクロックの周波数の位相を少しづつずらして生
成した周波数を、各PLL制御回路の基準周波数として
供給するようにしたので、電源の負担を少なくして負荷
の制御を行うことができる。
振させたクロックの周波数の位相を少しづつずらして生
成した周波数を、各PLL制御回路の基準周波数として
供給するようにしたので、電源の負担を少なくして負荷
の制御を行うことができる。
第1図は本発明を適用した制御回路の概略構成例を示す
ブロック図、第2図(A)〜CC)は第1図の位相比較
動作の原理を赤す波形図、第3図(A)、〜(E)は第
1図の各部の出力信号の波形を示す波形図、第4図(A
)〜(D)は従来方式による出力信号の波形を示す波形
図である。 l・・・原発振器、 2・・・分周器 、 3・・・遅延回路、 4・・・位相比較器、 5・・・誤差増幅器とPWM器から成る回路、6・・・
フィルタ回路と駆動回路から成る回路、7・・・負荷、 8・・・増幅器、 8・・・PLL制御回路、 lO・・・負荷、 11・・・PLL制御回路、 fo +fS +’S’ ・・・周波数。
ブロック図、第2図(A)〜CC)は第1図の位相比較
動作の原理を赤す波形図、第3図(A)、〜(E)は第
1図の各部の出力信号の波形を示す波形図、第4図(A
)〜(D)は従来方式による出力信号の波形を示す波形
図である。 l・・・原発振器、 2・・・分周器 、 3・・・遅延回路、 4・・・位相比較器、 5・・・誤差増幅器とPWM器から成る回路、6・・・
フィルタ回路と駆動回路から成る回路、7・・・負荷、 8・・・増幅器、 8・・・PLL制御回路、 lO・・・負荷、 11・・・PLL制御回路、 fo +fS +’S’ ・・・周波数。
Claims (1)
- 基準周波数と負荷からの帰還信号の帰還周波数とを位相
比較してその誤差に応じて前記負荷を位相ロックループ
制御するようにした位相ロックループ制御回路を複数の
負荷に設け、原発振器から供給された信号の位相を所定
量づつずらして生成した周波数をそれぞれ前記基準周波
数として前記各位相ロックループ制御回路に供給するよ
うにしたことを特徴とする制御方式。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57191789A JPS5981712A (ja) | 1982-11-02 | 1982-11-02 | 制御方式 |
US06/544,619 US4625156A (en) | 1982-11-02 | 1983-10-24 | Control device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57191789A JPS5981712A (ja) | 1982-11-02 | 1982-11-02 | 制御方式 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5981712A true JPS5981712A (ja) | 1984-05-11 |
Family
ID=16280560
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57191789A Pending JPS5981712A (ja) | 1982-11-02 | 1982-11-02 | 制御方式 |
Country Status (2)
Country | Link |
---|---|
US (1) | US4625156A (ja) |
JP (1) | JPS5981712A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0399475A2 (en) * | 1989-05-22 | 1990-11-28 | Sharp Kabushiki Kaisha | PLL speed control circuit |
JP2006505236A (ja) * | 2002-10-29 | 2006-02-09 | セイコーエプソン株式会社 | モーターの回転制御回路、これを駆動源として利用した駆動体 |
Families Citing this family (18)
Publication number | Priority date | Publication date | Assignee | Title |
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GB2185834B (en) * | 1985-11-20 | 1990-03-14 | British Aerospace | Cooling apparatus |
JPH0731869B2 (ja) * | 1986-10-17 | 1995-04-10 | 株式会社日立製作所 | デイスク回転駆動装置 |
JP2858319B2 (ja) * | 1989-01-30 | 1999-02-17 | 松下電器産業株式会社 | 多軸同期駆動装置及び歯車加工装置 |
US5287045A (en) * | 1990-02-20 | 1994-02-15 | Kabushiki Kaisha Toshiba | Fully digital apparatus for controlling operation of electric motor |
US5354179A (en) * | 1990-08-01 | 1994-10-11 | Matsushita Electric Industrial Co., Ltd. | Fluid rotating apparatus |
JP3049793B2 (ja) * | 1991-03-04 | 2000-06-05 | 松下電器産業株式会社 | 流体回転装置 |
JPH04357703A (ja) * | 1991-06-04 | 1992-12-10 | Matsushita Electric Ind Co Ltd | 周波数変調回路 |
JP3074845B2 (ja) * | 1991-10-08 | 2000-08-07 | 松下電器産業株式会社 | 流体回転装置 |
JPH05195957A (ja) * | 1992-01-23 | 1993-08-06 | Matsushita Electric Ind Co Ltd | 真空ポンプ |
JPH05202855A (ja) * | 1992-01-29 | 1993-08-10 | Matsushita Electric Ind Co Ltd | 流体回転装置 |
JPH05272478A (ja) * | 1992-01-31 | 1993-10-19 | Matsushita Electric Ind Co Ltd | 真空ポンプ |
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JPH07123501A (ja) * | 1993-10-28 | 1995-05-12 | Toshiba Corp | 電気車制御装置 |
US6885568B2 (en) * | 2002-11-14 | 2005-04-26 | Fyre Storm, Inc. | Ripple free measurement and control methods for switched power converters |
JP2004364366A (ja) * | 2003-06-02 | 2004-12-24 | Seiko Epson Corp | Pwm制御システム |
US8421393B2 (en) * | 2007-10-19 | 2013-04-16 | Lockheed Martin Corporation | System and method for pulse edge synchronization |
JP5292770B2 (ja) * | 2007-11-07 | 2013-09-18 | セイコーエプソン株式会社 | Pwm制御回路、該pwm制御回路を備えた電動機、該電動機を備えた装置及びpwm信号を生成する方法 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
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US3718845A (en) * | 1971-06-22 | 1973-02-27 | Borg Warner | Variable speed master-slave motor control system with continuous position adjustment |
US4135118A (en) * | 1976-10-05 | 1979-01-16 | Kernforschungsanlage Julich Gesellschaft Mit Beschrankter Haftung | System for determining the relative angular positions of the rotors of two synchronously driven synchronous motors |
DE2856012C2 (de) * | 1978-12-23 | 1983-10-06 | Kernforschungsanlage Juelich Gmbh, 5170 Juelich | Schaltungsanordnung zur Phasenverschiebung und deren Verwendung |
DE2910399A1 (de) * | 1979-03-16 | 1980-10-02 | Schuler Gmbh L | Schaltungsanordnung fuer eine automatisierte pressenanordnung |
US4249118A (en) * | 1979-08-27 | 1981-02-03 | Square D Company | Control system for multiple speed motor |
GB2088572A (en) * | 1980-12-02 | 1982-06-09 | Gestetner Mfg Ltd | Variable speed scan drive |
US4408144A (en) * | 1982-01-28 | 1983-10-04 | Sundstrand Data Control, Inc. | Tape tension control for a tape transducer |
-
1982
- 1982-11-02 JP JP57191789A patent/JPS5981712A/ja active Pending
-
1983
- 1983-10-24 US US06/544,619 patent/US4625156A/en not_active Expired - Lifetime
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Publication number | Priority date | Publication date | Assignee | Title |
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EP0399475A2 (en) * | 1989-05-22 | 1990-11-28 | Sharp Kabushiki Kaisha | PLL speed control circuit |
JP2006505236A (ja) * | 2002-10-29 | 2006-02-09 | セイコーエプソン株式会社 | モーターの回転制御回路、これを駆動源として利用した駆動体 |
Also Published As
Publication number | Publication date |
---|---|
US4625156A (en) | 1986-11-25 |
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