JPS5947755A - 半導体装置 - Google Patents
半導体装置Info
- Publication number
- JPS5947755A JPS5947755A JP15809382A JP15809382A JPS5947755A JP S5947755 A JPS5947755 A JP S5947755A JP 15809382 A JP15809382 A JP 15809382A JP 15809382 A JP15809382 A JP 15809382A JP S5947755 A JPS5947755 A JP S5947755A
- Authority
- JP
- Japan
- Prior art keywords
- impurity diffusion
- diffusion layer
- ohmic electrode
- electrode
- metal electrode
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/58—Structural electrical arrangements for semiconductor devices not otherwise provided for, e.g. in combination with batteries
- H01L23/64—Impedance arrangements
- H01L23/66—High-frequency adaptations
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
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- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Electrodes Of Semiconductors (AREA)
- Semiconductor Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は半導体集積回路に訃ける容量素子の構造に係り
、特に高周波特性を改善した容−W素子に関するもので
ある。
、特に高周波特性を改善した容−W素子に関するもので
ある。
第1図(娼(1)]は従来の半導体集積回路に構成され
た標準的容量素子の平面図および断面図〔(a)におけ
るA−A、’断面〕を示す。図に勢いて、1はp形(又
はn形)基板(シリコン基板)、2はn形(又はp形)
エピタキシャル層(シリコンエピタキシャル層)、3は
01形(又はp+形)不純物拡散層、4はS + O□
等による絶縁膜、5は金属電極、6は不純物拡散層3の
オーミック電極、7はコンタクト孔である。この容量素
子は、不純物拡散層3と絶縁膜4と金属電極5とオーミ
ック電極6で構成されている。
た標準的容量素子の平面図および断面図〔(a)におけ
るA−A、’断面〕を示す。図に勢いて、1はp形(又
はn形)基板(シリコン基板)、2はn形(又はp形)
エピタキシャル層(シリコンエピタキシャル層)、3は
01形(又はp+形)不純物拡散層、4はS + O□
等による絶縁膜、5は金属電極、6は不純物拡散層3の
オーミック電極、7はコンタクト孔である。この容量素
子は、不純物拡散層3と絶縁膜4と金属電極5とオーミ
ック電極6で構成されている。
第2図は上記容量素子の等価回路図である。従来の構造
(第1図参照)では、不純物拡散層3のオーミック電極
6のコンタクト面積が小さいので、直列の寄生抵抗rが
大きくなり高周波性能が不充分であるという欠点があっ
た。
(第1図参照)では、不純物拡散層3のオーミック電極
6のコンタクト面積が小さいので、直列の寄生抵抗rが
大きくなり高周波性能が不充分であるという欠点があっ
た。
本発明は上記の欠点を解消するためになされたもので、
不純物拡散層の寄生抵抗を低減させ、高周波性能が向上
した容量素子を提供することを目的とするものである。
不純物拡散層の寄生抵抗を低減させ、高周波性能が向上
した容量素子を提供することを目的とするものである。
上記の目的を過酸するために、本発明の容量素子は、不
純物拡散層へのオーミック電極のコンタクト面積を太き
くシ、かつオーミック電極が金属電極周囲を取囲むよう
に配置して構成した。
純物拡散層へのオーミック電極のコンタクト面積を太き
くシ、かつオーミック電極が金属電極周囲を取囲むよう
に配置して構成した。
以下、本発明を実施例によって説明する。
第3図は本発明による一実施例の容量素子を示したもの
で、同図(a)は平面図、(b)は(匈のB −B ’
断面図である。この容座素子は、図に示したように金属
電極5とn + (又はp”)形不純物拡散層3を対
向電極とし、例えば5i02で形成した絶縁膜4を銹電
体とする構造であり、オーミック電極6を金属電極5の
周囲に形成したものである。なお、図では、矩形金属電
極5の3側面にオーミック電極6を設けた場合を示して
いるが、少なくとも2側面にオーミック電極6を設ける
ことにより所期の効果が得られる。凍だ、金属電極5の
形状が種々変形された場合も考えられるが、その2鴨合
には上記オーミック電極が不純物拡散l−上に占める面
積の割合に準じて金属電極の周囲にオーミック電極を設
ければよい。
で、同図(a)は平面図、(b)は(匈のB −B ’
断面図である。この容座素子は、図に示したように金属
電極5とn + (又はp”)形不純物拡散層3を対
向電極とし、例えば5i02で形成した絶縁膜4を銹電
体とする構造であり、オーミック電極6を金属電極5の
周囲に形成したものである。なお、図では、矩形金属電
極5の3側面にオーミック電極6を設けた場合を示して
いるが、少なくとも2側面にオーミック電極6を設ける
ことにより所期の効果が得られる。凍だ、金属電極5の
形状が種々変形された場合も考えられるが、その2鴨合
には上記オーミック電極が不純物拡散l−上に占める面
積の割合に準じて金属電極の周囲にオーミック電極を設
ければよい。
以上説明したように、本発明によりば、金属電極の周囲
にそれを取囲むように不純物拡散層のオーミック電極を
形成しているので、第2図に示した直列抵抗rの原因と
なる不純物拡散層の寄生抵抗が低減でき、高周波性能が
大幅に改善できる効果がある。
にそれを取囲むように不純物拡散層のオーミック電極を
形成しているので、第2図に示した直列抵抗rの原因と
なる不純物拡散層の寄生抵抗が低減でき、高周波性能が
大幅に改善できる効果がある。
第11]t1.従来の半λσ体集積回路に構成された容
量素子を示し2、回1.m (、+1 rj平面図、(
1))は(a)の八−八′fと二かける断面図、第2図
QJ第11n’′lに示した各層素子の等価回路図、第
3図Ilj本発明による一実施例の容拐叱子を示し、同
図(a丹:l:平角1図、(b丹よ(3)のB−B′に
おける断面図である。 1・・・基板、2・・・エピタキシャル層、3・・・4
・細物拡散層、4・・・絶縁膜、5・・・くζ属電極、
6・・・オーミツ第 i 図 (aン 第2 図 第 3 区 (η〕
量素子を示し2、回1.m (、+1 rj平面図、(
1))は(a)の八−八′fと二かける断面図、第2図
QJ第11n’′lに示した各層素子の等価回路図、第
3図Ilj本発明による一実施例の容拐叱子を示し、同
図(a丹:l:平角1図、(b丹よ(3)のB−B′に
おける断面図である。 1・・・基板、2・・・エピタキシャル層、3・・・4
・細物拡散層、4・・・絶縁膜、5・・・くζ属電極、
6・・・オーミツ第 i 図 (aン 第2 図 第 3 区 (η〕
Claims (1)
- 1、半導体基板上のn+又はp+形不純物拡散層と、該
不純物拡散層上の絶縁膜と金属電極を備えて成る容量素
子に訃いて、上記不純物拡散層とオーミックコンタクト
しているオーミック電極を上記金属電極の周囲の少なく
とも2側面に沿って設けたことを特徴とする半導体装]
d、。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15809382A JPS5947755A (ja) | 1982-09-13 | 1982-09-13 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15809382A JPS5947755A (ja) | 1982-09-13 | 1982-09-13 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5947755A true JPS5947755A (ja) | 1984-03-17 |
Family
ID=15664143
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP15809382A Pending JPS5947755A (ja) | 1982-09-13 | 1982-09-13 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5947755A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4971924A (en) * | 1985-05-01 | 1990-11-20 | Texas Instruments Incorporated | Metal plate capacitor and method for making the same |
US5006480A (en) * | 1988-08-08 | 1991-04-09 | Hughes Aircraft Company | Metal gate capacitor fabricated with a silicon gate MOS process |
US6100591A (en) * | 1998-05-25 | 2000-08-08 | Nec Corporation | Semiconductor device and method of fabricating the same |
-
1982
- 1982-09-13 JP JP15809382A patent/JPS5947755A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4971924A (en) * | 1985-05-01 | 1990-11-20 | Texas Instruments Incorporated | Metal plate capacitor and method for making the same |
US5006480A (en) * | 1988-08-08 | 1991-04-09 | Hughes Aircraft Company | Metal gate capacitor fabricated with a silicon gate MOS process |
US6100591A (en) * | 1998-05-25 | 2000-08-08 | Nec Corporation | Semiconductor device and method of fabricating the same |
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