JPS592432A - ビデオ信号用アナログ−デジタル変換器 - Google Patents
ビデオ信号用アナログ−デジタル変換器Info
- Publication number
- JPS592432A JPS592432A JP10971082A JP10971082A JPS592432A JP S592432 A JPS592432 A JP S592432A JP 10971082 A JP10971082 A JP 10971082A JP 10971082 A JP10971082 A JP 10971082A JP S592432 A JPS592432 A JP S592432A
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- JP
- Japan
- Prior art keywords
- voltage
- bias voltage
- comparator
- comparators
- converter
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/124—Sampling or signal conditioning arrangements specially adapted for A/D converters
- H03M1/129—Means for adapting the input signal to the range the converter can handle, e.g. limiting, pre-scaling ; Out-of-range indication
- H03M1/1295—Clamping, i.e. adjusting the DC level of the input signal to a predetermined value
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/34—Analogue value compared with reference values
- H03M1/36—Analogue value compared with reference values simultaneously only, i.e. parallel type
- H03M1/361—Analogue value compared with reference values simultaneously only, i.e. parallel type having a separate comparator and reference value for each quantisation level, i.e. full flash converter type
- H03M1/362—Analogue value compared with reference values simultaneously only, i.e. parallel type having a separate comparator and reference value for each quantisation level, i.e. full flash converter type the reference values being generated by a resistive voltage divider
- H03M1/365—Analogue value compared with reference values simultaneously only, i.e. parallel type having a separate comparator and reference value for each quantisation level, i.e. full flash converter type the reference values being generated by a resistive voltage divider the voltage divider being a single resistor string
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はアナログ−デジタル変換器(以下VD変換器と
いう)に係シ、特にビデオ信号を扱うに好適なA11)
変換器に関する。
いう)に係シ、特にビデオ信号を扱うに好適なA11)
変換器に関する。
一般に並列形ルの変換器は第1図に示すように基準電圧
を与える電圧源11分圧抵抗2.比較器3、エンコーデ
ィングのロジック4とから構成される。例えば8ビツト
のデジタル信号への変換1cVi255個の比較器と基
準電圧を255等分する分圧抵抗2とを必要とする。V
D変換器へのアナログ入力信号条幅は比較器3への基準
電圧の大きさから定められている。従来のルの変換器は
アナログ入力信号として接地電位から正極性のある値ま
で(例えばD〜10ポルト)、または負極性のある値か
ら正極性のある値まで(例えば−5〜+5ボルト)を扱
かっている。また比較器は第2図に示すような差動増幅
器で構成されている。したがって入力端子5へ人力され
るアナログ信号の入力値が接地電位または負極性の値で
正常に動作するためには、端子6へは正極性の電源、端
子7へは入力信号値よυ低い負極性の電源を接続しなけ
ればならない。このためルの変換器用として+10ボル
トおよび一10ボルトと2つの電源を必要とする。一般
にテレビ受信機、ビデオテープレコーダなどビデオ信号
を扱う民生機器は電圧が+12ボルト程度の一つの電源
で動作しているので、従来のルω変換器を使用するには
負極性の電源を追加しなければならず、不経済となるば
かシか機器内に占める容積も大きく小形化の障害となる
。
を与える電圧源11分圧抵抗2.比較器3、エンコーデ
ィングのロジック4とから構成される。例えば8ビツト
のデジタル信号への変換1cVi255個の比較器と基
準電圧を255等分する分圧抵抗2とを必要とする。V
D変換器へのアナログ入力信号条幅は比較器3への基準
電圧の大きさから定められている。従来のルの変換器は
アナログ入力信号として接地電位から正極性のある値ま
で(例えばD〜10ポルト)、または負極性のある値か
ら正極性のある値まで(例えば−5〜+5ボルト)を扱
かっている。また比較器は第2図に示すような差動増幅
器で構成されている。したがって入力端子5へ人力され
るアナログ信号の入力値が接地電位または負極性の値で
正常に動作するためには、端子6へは正極性の電源、端
子7へは入力信号値よυ低い負極性の電源を接続しなけ
ればならない。このためルの変換器用として+10ボル
トおよび一10ボルトと2つの電源を必要とする。一般
にテレビ受信機、ビデオテープレコーダなどビデオ信号
を扱う民生機器は電圧が+12ボルト程度の一つの電源
で動作しているので、従来のルω変換器を使用するには
負極性の電源を追加しなければならず、不経済となるば
かシか機器内に占める容積も大きく小形化の障害となる
。
本発明の目的は一つの電源で動作する比較器を備えたビ
デオ信号用のAl1)変換器を提供することにある。
デオ信号用のAl1)変換器を提供することにある。
本発明では、入力信号に負極性の値を含んでいても比較
器が一つの電源で正常に動作をするようにするため、入
力ビデオ信号をルの変換器内のバイアス電圧にクランプ
し、そのバイアス電圧を重畳した基準電圧とクランプさ
れた入力信号を比較器の入力とする。
器が一つの電源で正常に動作をするようにするため、入
力ビデオ信号をルの変換器内のバイアス電圧にクランプ
し、そのバイアス電圧を重畳した基準電圧とクランプさ
れた入力信号を比較器の入力とする。
以下、本発明の一実施例を第3図によシ説明する。第3
図において、第1図と同じものには同じ符号を付しであ
る。8はバイアス電圧を与える電圧源、9はクランプ用
ス・イッチ、10はクランプ用コンデンサを示す。基準
電圧源1の基準電圧を分圧用抵抗2で分圧し、それらに
バイアス電圧源8の電圧を重畳して、比較器への基チ9
とクランプ用コンデンサ10によシ入カビデオ信号の同
期部分をバイアス電圧源80レベルにクランプする。そ
の動作は第4図に示すようなビデオ信号が入力端子5へ
印加されると、その信号の同期部分の時刻(第4図のα
)の間だけスイッチ9を閉じてコンデンサ10をバイア
ス電圧源8で充電する。その結果比較器3へはバイアス
電圧源8の電圧でクランプされたビデオ入力信号と、バ
イアス電圧源8の電圧が重畳された基準電圧とが入力さ
れる。バイアス電圧は両入力に対して同相的に動作する
ので、比較器の比較動作に対しては影響せず、比較器に
バイアス電圧を与えている。したがって第2図に示す方
式の比較器は端子7を接地、端子6へ正極性の一つの電
源を接続することによって正常に比較動作を行なえる。
図において、第1図と同じものには同じ符号を付しであ
る。8はバイアス電圧を与える電圧源、9はクランプ用
ス・イッチ、10はクランプ用コンデンサを示す。基準
電圧源1の基準電圧を分圧用抵抗2で分圧し、それらに
バイアス電圧源8の電圧を重畳して、比較器への基チ9
とクランプ用コンデンサ10によシ入カビデオ信号の同
期部分をバイアス電圧源80レベルにクランプする。そ
の動作は第4図に示すようなビデオ信号が入力端子5へ
印加されると、その信号の同期部分の時刻(第4図のα
)の間だけスイッチ9を閉じてコンデンサ10をバイア
ス電圧源8で充電する。その結果比較器3へはバイアス
電圧源8の電圧でクランプされたビデオ入力信号と、バ
イアス電圧源8の電圧が重畳された基準電圧とが入力さ
れる。バイアス電圧は両入力に対して同相的に動作する
ので、比較器の比較動作に対しては影響せず、比較器に
バイアス電圧を与えている。したがって第2図に示す方
式の比較器は端子7を接地、端子6へ正極性の一つの電
源を接続することによって正常に比較動作を行なえる。
本実施例に示すように入力ビデオ信号の同期部分をバイ
アス電圧でクランプし、また基準電圧に同じバイアス電
圧を重畳することによシ、&ω変換器の比較器を一つの
電源で動作させることが可能となシ、従来の欠点である
不経済性と小形化への障害を除去できる。
アス電圧でクランプし、また基準電圧に同じバイアス電
圧を重畳することによシ、&ω変換器の比較器を一つの
電源で動作させることが可能となシ、従来の欠点である
不経済性と小形化への障害を除去できる。
また第5図に本発明の他の実施例を示す。第5図におい
て第4図の実施例と同じものには同じ符号を付しである
。11はクランプスイッチ用トランジスタ、12け基準
電圧用ツェナーダイオード、15はコンデンサ1oの電
荷を長時間保持させるためのバッファ用トランジスタ、
16けバイアス電圧を定電圧化するためのバッファ用ト
ランジスタ、17はツェナーダイオード12による基準
電圧をさらに定電圧化するためのバッファ用トランジス
タ、14.15は入力ビデオ信号のバッファトランジス
タ13による直流シフト量を補償するダイオードを示し
である。
て第4図の実施例と同じものには同じ符号を付しである
。11はクランプスイッチ用トランジスタ、12け基準
電圧用ツェナーダイオード、15はコンデンサ1oの電
荷を長時間保持させるためのバッファ用トランジスタ、
16けバイアス電圧を定電圧化するためのバッファ用ト
ランジスタ、17はツェナーダイオード12による基準
電圧をさらに定電圧化するためのバッファ用トランジス
タ、14.15は入力ビデオ信号のバッファトランジス
タ13による直流シフト量を補償するダイオードを示し
である。
ツェナダイオード12のアノード(第5図のA点)は抵
抗を通して接地し、カソード(第5図のB点)は抵抗を
通して電源に接続しである。
抗を通して接地し、カソード(第5図のB点)は抵抗を
通して電源に接続しである。
そして点Aにバイアス電圧を点Bにバイアス電圧を重畳
した基準電圧を発生している。それぞれの電圧はバッフ
ァトランジスタ16,17を介してそれぞれのトランジ
スタ46.17のエミッタ電位となっている。一方クラ
ンプ用コンデンサはスイッチトランジスタ11を介して
トランジスタ16のエミッタへ接続されている。したが
ってビデオ信号の同期部の間にスイッチトランジスタ1
1を導通させると、トランジスタ150ペース電位はト
ランジスタ16のエミッタ鑞付にクランプされる。この
電位は各比較器6(8ピツトの場合255個)へ共通に
入力されるので、コンデンサから比較器へ流れる入力!
、流が多くなシ、クランプ電圧が変化する。それを防止
するためバッフ7トランジスタ13を介して各比較器3
へ入力しである。その結果バッファトランジスタ15の
入力端子のベース電位と出力端子のエミッタ電位に約0
.7ボルトのベース−エミッタ間電圧の降下が生じ、バ
イアス載位トランジスタ16のエミッタ電位とに差が生
じ不都合となる。そこでバイアス電位を前記トランジス
タ15のベース・エミッタ間電圧と等しい電圧だけダイ
オード14によシ降下させである。またバイアス電位の
み降下させたのでは分圧抵抗20両端にはツェナダイオ
ード12による基準電圧よシ前記ダイオード送圧だけ大
きい電圧が加わるので、それを補償するためダイオード
15を介して分圧抵抗2に基準電圧を印加しである。上
記構成にょシ、各比較器にはバイアス電圧を同相的に与
え、比較動作はツェナーダイオード12による基準電圧
で行なうことができ、一つの眠源で動かすことができる
。さらに本実施例は半導体集積回路に適したもので、集
積化によりトランジスタ16と17およびトランジスタ
15とダイオード14.15のペース−エミッタ間紙圧
を等しく、さらに温度変化にJ、る値をも等しくできる
。ぞの結沫バイアス送圧によるクランプ電位と基準電圧
への重畳電位が比較器の入力端において等しくできるの
で、本発明を採用するととKよるルω変換誤差を最も少
なくすることができる。
した基準電圧を発生している。それぞれの電圧はバッフ
ァトランジスタ16,17を介してそれぞれのトランジ
スタ46.17のエミッタ電位となっている。一方クラ
ンプ用コンデンサはスイッチトランジスタ11を介して
トランジスタ16のエミッタへ接続されている。したが
ってビデオ信号の同期部の間にスイッチトランジスタ1
1を導通させると、トランジスタ150ペース電位はト
ランジスタ16のエミッタ鑞付にクランプされる。この
電位は各比較器6(8ピツトの場合255個)へ共通に
入力されるので、コンデンサから比較器へ流れる入力!
、流が多くなシ、クランプ電圧が変化する。それを防止
するためバッフ7トランジスタ13を介して各比較器3
へ入力しである。その結果バッファトランジスタ15の
入力端子のベース電位と出力端子のエミッタ電位に約0
.7ボルトのベース−エミッタ間電圧の降下が生じ、バ
イアス載位トランジスタ16のエミッタ電位とに差が生
じ不都合となる。そこでバイアス電位を前記トランジス
タ15のベース・エミッタ間電圧と等しい電圧だけダイ
オード14によシ降下させである。またバイアス電位の
み降下させたのでは分圧抵抗20両端にはツェナダイオ
ード12による基準電圧よシ前記ダイオード送圧だけ大
きい電圧が加わるので、それを補償するためダイオード
15を介して分圧抵抗2に基準電圧を印加しである。上
記構成にょシ、各比較器にはバイアス電圧を同相的に与
え、比較動作はツェナーダイオード12による基準電圧
で行なうことができ、一つの眠源で動かすことができる
。さらに本実施例は半導体集積回路に適したもので、集
積化によりトランジスタ16と17およびトランジスタ
15とダイオード14.15のペース−エミッタ間紙圧
を等しく、さらに温度変化にJ、る値をも等しくできる
。ぞの結沫バイアス送圧によるクランプ電位と基準電圧
への重畳電位が比較器の入力端において等しくできるの
で、本発明を採用するととKよるルω変換誤差を最も少
なくすることができる。
本発明によれば、−電源で動作する比較器にてルω変換
器を構成することができるので、経済的であるばかシか
、装置の小形化にも効果がある。
器を構成することができるので、経済的であるばかシか
、装置の小形化にも効果がある。
第1図は従来の、νの変換器の構成図、第2図Fiルの
変換器を構成する比較器の回路図、第6図は本発明の一
実施例によるルの変換器の要部を示す回路図、第4図は
本発明を説明づ°るためのビデオ信号を表わす波形図、
第5図Vま本発明の他の実施例によるルω変換器の要部
を示す回路図である。 1・・・基準電圧を与える電圧源、 2・・・分圧抵抗、 3・・・比較器。 8・・・バイアス送圧を与える電圧源、9・・・クラン
プ用スイッチ、 10・・・クランプ用コンデフザ、 12・・・ツェナーダイオード。 15.16.17・・・バッファトランジスタ。 14.15・・・補償用ダイオード。 才3図 才 4 図
変換器を構成する比較器の回路図、第6図は本発明の一
実施例によるルの変換器の要部を示す回路図、第4図は
本発明を説明づ°るためのビデオ信号を表わす波形図、
第5図Vま本発明の他の実施例によるルω変換器の要部
を示す回路図である。 1・・・基準電圧を与える電圧源、 2・・・分圧抵抗、 3・・・比較器。 8・・・バイアス送圧を与える電圧源、9・・・クラン
プ用スイッチ、 10・・・クランプ用コンデフザ、 12・・・ツェナーダイオード。 15.16.17・・・バッファトランジスタ。 14.15・・・補償用ダイオード。 才3図 才 4 図
Claims (1)
- 1、 比較器と前記比較器に基準電位を与える基準電圧
源とその分圧抵抗とを含む、4./l)変換器において
、前記比較器の基準電位にバイアス電圧を重畳する手段
と、アナログ入力信号にクランプ電位を与えるクランプ
用コンデンサと、前記コンデンサと前記バイアス電圧を
与える電圧源とを接続する入力信号の同期部の時刻のみ
に導通するスイッチとが設けられていることを特徴とす
るビデオ信号用アナログ−デジタル変換器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10971082A JPS592432A (ja) | 1982-06-28 | 1982-06-28 | ビデオ信号用アナログ−デジタル変換器 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10971082A JPS592432A (ja) | 1982-06-28 | 1982-06-28 | ビデオ信号用アナログ−デジタル変換器 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS592432A true JPS592432A (ja) | 1984-01-09 |
Family
ID=14517250
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10971082A Pending JPS592432A (ja) | 1982-06-28 | 1982-06-28 | ビデオ信号用アナログ−デジタル変換器 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS592432A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01318431A (ja) * | 1988-06-20 | 1989-12-22 | Toshiba Corp | アナログ/ディジタル変換回路 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5323553A (en) * | 1976-08-18 | 1978-03-04 | Toshiba Corp | Encoder circu it |
JPS5374314A (en) * | 1976-12-14 | 1978-07-01 | Nec Corp | Transmitting system for composite video signal |
-
1982
- 1982-06-28 JP JP10971082A patent/JPS592432A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5323553A (en) * | 1976-08-18 | 1978-03-04 | Toshiba Corp | Encoder circu it |
JPS5374314A (en) * | 1976-12-14 | 1978-07-01 | Nec Corp | Transmitting system for composite video signal |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01318431A (ja) * | 1988-06-20 | 1989-12-22 | Toshiba Corp | アナログ/ディジタル変換回路 |
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