JPS5924195Y2 - トランジスタ回路 - Google Patents
トランジスタ回路Info
- Publication number
- JPS5924195Y2 JPS5924195Y2 JP13045679U JP13045679U JPS5924195Y2 JP S5924195 Y2 JPS5924195 Y2 JP S5924195Y2 JP 13045679 U JP13045679 U JP 13045679U JP 13045679 U JP13045679 U JP 13045679U JP S5924195 Y2 JPS5924195 Y2 JP S5924195Y2
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- load
- collector
- transistors
- loads
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Electronic Switches (AREA)
Description
【考案の詳細な説明】
本考案は2つ以上の負荷をお互いの干渉がないように駆
動するようにしたトランジスタ回路に関するものである
。
動するようにしたトランジスタ回路に関するものである
。
第1図は従来のサイリスクによるスイッチ回路で、1は
ゲート端子、2は出力端子、■+は電源端子、3はサイ
リスタ、R1は負荷で゛ある。
ゲート端子、2は出力端子、■+は電源端子、3はサイ
リスタ、R1は負荷で゛ある。
サイリスタ3はゲート端子1に加えられる信号によって
導通し、負荷R1に電流を流し、出力端子2に出力信号
がとり出される。
導通し、負荷R1に電流を流し、出力端子2に出力信号
がとり出される。
しかしながら、このような従来のサイリスクによるスイ
ッチ回路では、2つ以上の負荷を同時に駆動する時は、
負荷を共通に接続しなければならず、一方の負荷が変動
すると、その変動は他方の負荷に変動を与えるため、負
荷はお互いの影響を受け、負荷間の分離が悪いという欠
点があった。
ッチ回路では、2つ以上の負荷を同時に駆動する時は、
負荷を共通に接続しなければならず、一方の負荷が変動
すると、その変動は他方の負荷に変動を与えるため、負
荷はお互いの影響を受け、負荷間の分離が悪いという欠
点があった。
本考案はこのような欠点を除去し、簡単な回路で多くの
負荷を互に分離して駆動し得るようにしたトランジスタ
回路を提供するものである。
負荷を互に分離して駆動し得るようにしたトランジスタ
回路を提供するものである。
以下、第2図に示す本考案の一実施例を用いて本考案を
詳細に説明する。
詳細に説明する。
第2図に於て、トランジスタ5およびトランジスタ4は
お互いに逆導電型のトランジスタであり、この接続によ
り、第1図のサイリスタ3と同じ効果を持つ。
お互いに逆導電型のトランジスタであり、この接続によ
り、第1図のサイリスタ3と同じ効果を持つ。
トランジスタ5のエミッタに負荷R1が接続され、ゲー
ト端子1に与えられる信号によりトランジスタ4,5は
導通し、負荷R1には規定の電流が流れる。
ト端子1に与えられる信号によりトランジスタ4,5は
導通し、負荷R1には規定の電流が流れる。
トランジスタ6および7はトランジスタ4と同一導電型
のトランジスタであり、各ベースは共通に接続されてい
る。
のトランジスタであり、各ベースは共通に接続されてい
る。
もしトランジスタ4と6が同一特性を持ったトランジス
タであれは゛、トランジスタ6にはトランジスタ4と同
じ電流が流れ、負荷R11に電流を与える。
タであれは゛、トランジスタ6にはトランジスタ4と同
じ電流が流れ、負荷R11に電流を与える。
もしトランジスタ6と4とが形状(面積比)製造法その
他によって特性が異なれば、その差に応じた電流が流れ
る。
他によって特性が異なれば、その差に応じた電流が流れ
る。
トランジスタ7はエミッタと第1の電流が印加される電
源端子V+との間に、抵抗R2が挿入されている場合で
あり、この場合は抵抗R2間の電圧降下に応じて電流が
低下し、負荷R1□に電圧降下を生じる。
源端子V+との間に、抵抗R2が挿入されている場合で
あり、この場合は抵抗R2間の電圧降下に応じて電流が
低下し、負荷R1□に電圧降下を生じる。
なお、負荷R1、R1□、R1□の他端は第2の電位で
あるアースに接続されている。
あるアースに接続されている。
以上の場合はトランジスタ6および7が飽和していない
場合であるが、これらトランジスタが飽和動作をすると
きは、各負荷R11,R1□に流れる電流は負荷の大き
さに依存する。
場合であるが、これらトランジスタが飽和動作をすると
きは、各負荷R11,R1□に流れる電流は負荷の大き
さに依存する。
しかしながら、いずれの場合でも、各負荷R1□、R1
□に流れる電流は各々独心して決めることができ、お互
いに干渉し合うことはない。
□に流れる電流は各々独心して決めることができ、お互
いに干渉し合うことはない。
第3図は集積回路によってこれを実現した場合であって
、トランジスタ8はマルチコレクタ型横方向トランジス
タによって実現され、各負荷に流れる電流は各コレクタ
の面積に比例する。
、トランジスタ8はマルチコレクタ型横方向トランジス
タによって実現され、各負荷に流れる電流は各コレクタ
の面積に比例する。
集積回路では各素子間の温度および特性が非常によく一
致しているので、−上記関係は特に安定して得られる。
致しているので、−上記関係は特に安定して得られる。
以上述べた説明は基本的なものであるが、これに加えて
、上記説明と導電性が全く逆のトランジスタの組合わせ
による回路においても全く同じ効果が得られることはい
うまでもなく、また負荷は抵抗で代表しているが、他の
素子でも本考案の特長は生かされる。
、上記説明と導電性が全く逆のトランジスタの組合わせ
による回路においても全く同じ効果が得られることはい
うまでもなく、また負荷は抵抗で代表しているが、他の
素子でも本考案の特長は生かされる。
さらに、各素子間に若干の抵抗その他の素子を挿入する
ことによって種々の展開をすることができ、例えば゛第
2図のトランジスタ4のコレクタとトランジスタ5のベ
ース間にダイオードを挿入してスイッチ回路のオン電圧
を制御することができる。
ことによって種々の展開をすることができ、例えば゛第
2図のトランジスタ4のコレクタとトランジスタ5のベ
ース間にダイオードを挿入してスイッチ回路のオン電圧
を制御することができる。
また上記説明では、独立負荷が2つの場合であるが、3
つ以上の負荷に対してもトランジスタを増やすことで容
易に実現できることはいうまでもない。
つ以上の負荷に対してもトランジスタを増やすことで容
易に実現できることはいうまでもない。
以上のようにこの考案によれば、1つのスイッチ回路に
よって多くの負荷を同時に制御でき、しかも各負荷間の
分離を良好に保つことができる。
よって多くの負荷を同時に制御でき、しかも各負荷間の
分離を良好に保つことができる。
第1図は従来のサイリスタによるスイッチ回路を示す回
路図、第2図は本考案の一実施例を示す回路図、第3図
は本考案の他の実施例を示す回路図である。 なお、図中同一符号は同一または相当部分を示す。 4.8・・・・・・第2のトランジスタ、5・・・・・
・第1のトランジスタ、6,7・・・・・・他のトラン
ジスタ、R1・・・・・・第1の負荷、R1□、R1□
・・・・・・第2の負荷。
路図、第2図は本考案の一実施例を示す回路図、第3図
は本考案の他の実施例を示す回路図である。 なお、図中同一符号は同一または相当部分を示す。 4.8・・・・・・第2のトランジスタ、5・・・・・
・第1のトランジスタ、6,7・・・・・・他のトラン
ジスタ、R1・・・・・・第1の負荷、R1□、R1□
・・・・・・第2の負荷。
Claims (1)
- 第1の負荷がエミッタに接続された第1のトランジスタ
のベースに上記第1のトランジスタと逆導電形の第2の
トランジスタのコレクタを接続し、上記第1のトランジ
スタのコレクタと上記第2のトランジスタのベースとを
接続し、かつ上記第2のトランジスタに設けられた他の
コレクタに或は上記第2のトランジスタのベースにベー
スが接続された上記逆導電形の他のトランジスタのコレ
クタに第2の負荷を接続し、上記第2のトランジスタの
エミッタ、上記他のトランジスタのエミッタを第1の電
位に接続するとともに、上記第1の負荷および第2の負
荷の他端を第2の電位に接続するようにしたことを特徴
とするトランジスタ回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13045679U JPS5924195Y2 (ja) | 1979-09-20 | 1979-09-20 | トランジスタ回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13045679U JPS5924195Y2 (ja) | 1979-09-20 | 1979-09-20 | トランジスタ回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5544690U JPS5544690U (ja) | 1980-03-24 |
JPS5924195Y2 true JPS5924195Y2 (ja) | 1984-07-18 |
Family
ID=29096091
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP13045679U Expired JPS5924195Y2 (ja) | 1979-09-20 | 1979-09-20 | トランジスタ回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5924195Y2 (ja) |
-
1979
- 1979-09-20 JP JP13045679U patent/JPS5924195Y2/ja not_active Expired
Also Published As
Publication number | Publication date |
---|---|
JPS5544690U (ja) | 1980-03-24 |
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