JPS59211143A - マイクロコンピユ−タを用いた車両用制御回路 - Google Patents
マイクロコンピユ−タを用いた車両用制御回路Info
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- JPS59211143A JPS59211143A JP58084904A JP8490483A JPS59211143A JP S59211143 A JPS59211143 A JP S59211143A JP 58084904 A JP58084904 A JP 58084904A JP 8490483 A JP8490483 A JP 8490483A JP S59211143 A JPS59211143 A JP S59211143A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、電源投入時およびプログラム異常を検出した
ときにプログラム制御を初期状態に戻すリセットを掛け
るマイクロコンビコータを用いた車両用制御回路に関す
る。
ときにプログラム制御を初期状態に戻すリセットを掛け
るマイクロコンビコータを用いた車両用制御回路に関す
る。
従来、マイクロコンピュータを用いたアンチスキッド制
御、エンジン制御、自動変速制御、ドライブコンビコー
タ（当社７１３０で採用）などにあっては、例えば、第
１図に示すようなリセッ１一方式を採用している。
御、エンジン制御、自動変速制御、ドライブコンビコー
タ（当社７１３０で採用）などにあっては、例えば、第
１図に示すようなリセッ１一方式を採用している。
第１図において、１はマイクロコンピュータであり、イ
グニッションスイッチ３のオン操作による電源投入時に
マイクロコンピュータ１を初期状態にするため、電源リ
セット回路２を設けており、オアゲート４を介してマイ
クロコンビコータのリセット端子ＲＥＳにリセット信号
を供給すること−２− でマイクロコンビコータ１を初期状態にイニシャルリレ
ン１−シ、プログラムの先頭番地から制御を開始するよ
うにしている１゜ また、制御中にお（）るプログラムの異常を判別するた
め、通常マイクｒ−１１ンビユータ１の４ｉ、ｉｉ了Ｐ
Ｒにはプログラムを実行する毎に反転するプログラムラ
ン１ｈ号（」メ下ＰＲ信号という）が出力されており、
プ［１グラムの実行に異常があれば、このＰＲ信号の反
転周期が良くなる。 従って、ＰＲ信号の周期を検出Ｊ
るＩこめ一般にドックウオッチドタイマどして知られた
安常検出回路５が設りられ、ＰＲ信号の周期が一定時間
以上となったことを検出してＡアゲ−ｈ ４を介してマ
イクロ：］ンビ］−夕１にリヒットを１卦Ｃノ、マイク
ロコンビコ−タ１を強制的に初１υ１状態に戻し、ラフ
１〜的４ｆ巽常を回避できるようにしている。
グニッションスイッチ３のオン操作による電源投入時に
マイクロコンピュータ１を初期状態にするため、電源リ
セット回路２を設けており、オアゲート４を介してマイ
クロコンビコータのリセット端子ＲＥＳにリセット信号
を供給すること−２− でマイクロコンビコータ１を初期状態にイニシャルリレ
ン１−シ、プログラムの先頭番地から制御を開始するよ
うにしている１゜ また、制御中にお（）るプログラムの異常を判別するた
め、通常マイクｒ−１１ンビユータ１の４ｉ、ｉｉ了Ｐ
Ｒにはプログラムを実行する毎に反転するプログラムラ
ン１ｈ号（」メ下ＰＲ信号という）が出力されており、
プ［１グラムの実行に異常があれば、このＰＲ信号の反
転周期が良くなる。 従って、ＰＲ信号の周期を検出Ｊ
るＩこめ一般にドックウオッチドタイマどして知られた
安常検出回路５が設りられ、ＰＲ信号の周期が一定時間
以上となったことを検出してＡアゲ−ｈ ４を介してマ
イクロ：］ンビ］−夕１にリヒットを１卦Ｃノ、マイク
ロコンビコ−タ１を強制的に初１υ１状態に戻し、ラフ
１〜的４ｆ巽常を回避できるようにしている。
更に、電源投入１ｈにあっては、制御システムの状態を
チェックする必要があることから、電源リセット回路２
のリレン１〜出力に基づいてマイクロコンビコータ１の
端子Ｐ１． Ｐ２から信号出力を− ３ − 行ない、１〜ランジスタＱ１および１〜ランジスタＱｚ
分の作動で電磁ソレノイド等の制御負荷６の試験作動お
よび警報ランプ７の球切れチェックおよび表示部の作動
チェックを行イｆうことが可能である。
チェックする必要があることから、電源リセット回路２
のリレン１〜出力に基づいてマイクロコンビコータ１の
端子Ｐ１． Ｐ２から信号出力を− ３ − 行ない、１〜ランジスタＱ１および１〜ランジスタＱｚ
分の作動で電磁ソレノイド等の制御負荷６の試験作動お
よび警報ランプ７の球切れチェックおよび表示部の作動
チェックを行イｆうことが可能である。
この試験作動おｊ：びチェックは、所定時間経過後、終
了あるいは、他の車両スイッチの動作に関連して終了さ
せ、本来の制御に復帰さぼる必要がある。
了あるいは、他の車両スイッチの動作に関連して終了さ
せ、本来の制御に復帰さぼる必要がある。
しかしながら、このＪζうな従来のマイクロコンビコー
タを用いた制御回路にあっては、システムの制御中に生
じたプログラム巽常時のリレン１〜においても端子Ｐ１
．Ｐ２Ｊ：り信号出力を生じ、球切れチェックのための
警報ランプ７の点灯がシステ１＼の異常警報と誤認され
、また制御負荷６の試験作動にまり異常な０荷の作動が
行なわれるという可能性がある。
タを用いた制御回路にあっては、システムの制御中に生
じたプログラム巽常時のリレン１〜においても端子Ｐ１
．Ｐ２Ｊ：り信号出力を生じ、球切れチェックのための
警報ランプ７の点灯がシステ１＼の異常警報と誤認され
、また制御負荷６の試験作動にまり異常な０荷の作動が
行なわれるという可能性がある。
本発明は、このような従来の問題点に鑑みてなされたも
ので、電源投入時のりレツ１〜と制御中のリセットとを
区別し、ＩＱ御中のリレン１〜については、負荷および
警報ランプ等の試験動作を禁１１−シて制御システムの
信頼性を向上することを目的と＝ ４ − する１゜ この目的を）構成するため本発明は、マイクロコンピュ
ータの特定端子に゛電源投入時のリセットから一定時間
にわたって電源検出信号を供給する電源検出回路の出力
を接続し、リセットが掛かったときには電源検出信号の
状態を判別し、電源検出信号が得られている時には、電
源リセットと判別して制御負荷ａ３よび、または警報ラ
ンプに対する動作試駆信号の出力を許容し、一方、電源
検出信号が得られていない時には、制御中にＪりけるリ
セットと判別して動作試験信号の出力を禁止するように
したものである。
ので、電源投入時のりレツ１〜と制御中のリセットとを
区別し、ＩＱ御中のリレン１〜については、負荷および
警報ランプ等の試験動作を禁１１−シて制御システムの
信頼性を向上することを目的と＝ ４ − する１゜ この目的を）構成するため本発明は、マイクロコンピュ
ータの特定端子に゛電源投入時のリセットから一定時間
にわたって電源検出信号を供給する電源検出回路の出力
を接続し、リセットが掛かったときには電源検出信号の
状態を判別し、電源検出信号が得られている時には、電
源リセットと判別して制御負荷ａ３よび、または警報ラ
ンプに対する動作試駆信号の出力を許容し、一方、電源
検出信号が得られていない時には、制御中にＪりけるリ
セットと判別して動作試験信号の出力を禁止するように
したものである。
以下、本発明の実施例を図面に基づいて説明する。
第２図は本発明の一実施例を示した回路ブロック図であ
る。まず構成を説明づると、１はマイクロコンピュータ
であり、例えばアンチスーヤツド制御システムを例にと
ると、車輪速センサーで検出した車輪速に基づいて、制
動液圧の増圧と減圧を繰り返す制御信号を演算出力する
ように］ノでいる。
る。まず構成を説明づると、１はマイクロコンピュータ
であり、例えばアンチスーヤツド制御システムを例にと
ると、車輪速センサーで検出した車輪速に基づいて、制
動液圧の増圧と減圧を繰り返す制御信号を演算出力する
ように］ノでいる。
＝ ５ −
２はマイク［二１コンピュータ１に対し、イグニッショ
ンスイッチ３のオン操作で電源を投入した峙に、電源投
入かｌう一定時間の間、１−レベルとなるリレン１〜信
号を出力する電源リセット回路である。電源リセッ１〜
回路２の出力は、オアゲー１へ４を介してマイクロコン
ビコータ１のリセット端子ＲＦＳに接続され、マイクロ
コンビコータ１のリセット端子口］が１−レベルからＨ
レベルに立ちトがった時にマイクロコンピュータにおけ
る各種のカウンタに初期値をセラ１〜し、かつ制御プロ
グラムの先頭番地を実行番地とするイニシレルリセッ１
へを行なうようになる。
ンスイッチ３のオン操作で電源を投入した峙に、電源投
入かｌう一定時間の間、１−レベルとなるリレン１〜信
号を出力する電源リセット回路である。電源リセッ１〜
回路２の出力は、オアゲー１へ４を介してマイクロコン
ビコータ１のリセット端子ＲＦＳに接続され、マイクロ
コンビコータ１のリセット端子口］が１−レベルからＨ
レベルに立ちトがった時にマイクロコンピュータにおけ
る各種のカウンタに初期値をセラ１〜し、かつ制御プロ
グラムの先頭番地を実行番地とするイニシレルリセッ１
へを行なうようになる。
５はマイクロコンビコータ夕の制御中にお【プるプログ
ラムの異常を検出する異常検出回路であり、マイクロコ
ンピュータ１の端子ＰＲに出力されるプログラムラン信
号（ＰＲ信＠）の反転周期を監視し、この周期が一定時
間以」−となった時にＡアゲート４を介してしレベルに
立ち下がるリレン１へ信号をマイクロコンビコータのリ
セット端子面了合に出力する。すなわち、マイクロゴ１
ンビコーター ６ ＝ １の制御プログラムには、一連の制御プログラムを実行
するごとにＰＲ端子の信号レベルを判定する命令が含ま
れており、プログラムの実行が正常に行なわれていれば
一定周明ごとにＰＲ端子が反転Ｊるのに対し、ブ［１グ
ラム巽常を牛じた揚台には一定時間を越えてもＰＲ端子
の信号レベルが反転けず、このＰＲ端子にお（プる信号
レベルの状態を異常検出回路５で監視し、プログラム異
常を検出するＪ：うにしている。
ラムの異常を検出する異常検出回路であり、マイクロコ
ンピュータ１の端子ＰＲに出力されるプログラムラン信
号（ＰＲ信＠）の反転周期を監視し、この周期が一定時
間以」−となった時にＡアゲート４を介してしレベルに
立ち下がるリレン１へ信号をマイクロコンビコータのリ
セット端子面了合に出力する。すなわち、マイクロゴ１
ンビコーター ６ ＝ １の制御プログラムには、一連の制御プログラムを実行
するごとにＰＲ端子の信号レベルを判定する命令が含ま
れており、プログラムの実行が正常に行なわれていれば
一定周明ごとにＰＲ端子が反転Ｊるのに対し、ブ［１グ
ラム巽常を牛じた揚台には一定時間を越えてもＰＲ端子
の信号レベルが反転けず、このＰＲ端子にお（プる信号
レベルの状態を異常検出回路５で監視し、プログラム異
常を検出するＪ：うにしている。
さらに、マイクロコンピュータ１には電源投入時に制御
負荷６の動作試験と警報ランプ７の球切れチェックを行
なうため、電源リセットが掛かった時に信号出力を行な
う出力端子Ｐ１．Ｐ２を設けており、電源投入時のリセ
ツ１〜で端子Ｐ１．Ｐ２＋にり信号を出力してトランジ
スタＱ１．Ｑ２をオンし、制御負荷６の試験作動と警報
ランプ７の球切れチ１ツクを行なうＪ：うにしている。
負荷６の動作試験と警報ランプ７の球切れチェックを行
なうため、電源リセットが掛かった時に信号出力を行な
う出力端子Ｐ１．Ｐ２を設けており、電源投入時のリセ
ツ１〜で端子Ｐ１．Ｐ２＋にり信号を出力してトランジ
スタＱ１．Ｑ２をオンし、制御負荷６の試験作動と警報
ランプ７の球切れチ１ツクを行なうＪ：うにしている。
このような構成は従来装置と同じであるが、これに加え
て本発明では、マイクロコンビコータ１の端子Ｐ３を新
たに使用し、この端子Ｐ３に電源−７− 投入から１−ルベル出力を発し、電源リセッ１〜回路２
のリセッ１〜出力時間（Ｌレベル出力時間）より長い遅
延時間後にＬレベルとなる電源検出信号を出力する電源
検出回路８を接続している。
て本発明では、マイクロコンビコータ１の端子Ｐ３を新
たに使用し、この端子Ｐ３に電源−７− 投入から１−ルベル出力を発し、電源リセッ１〜回路２
のリセッ１〜出力時間（Ｌレベル出力時間）より長い遅
延時間後にＬレベルとなる電源検出信号を出力する電源
検出回路８を接続している。
第３図は、第２図の実施例におりる電源検１１回路８の
具体的な回路構成を示したらので、抵抗Ｒ２すとＲ３の
分圧電圧でコンパレータ９のプラス入力端子に対する基
準電圧を設定し、マイナス入力端子には抵抗Ｒ１とコン
デンサＣ１でなる充電回路の出力を接続しており、抵抗
Ｒ１の他端にはイグニッションスイッチのオン操作にｊ
こる電源電圧が供給される。
具体的な回路構成を示したらので、抵抗Ｒ２すとＲ３の
分圧電圧でコンパレータ９のプラス入力端子に対する基
準電圧を設定し、マイナス入力端子には抵抗Ｒ１とコン
デンサＣ１でなる充電回路の出力を接続しており、抵抗
Ｒ１の他端にはイグニッションスイッチのオン操作にｊ
こる電源電圧が供給される。
すなわち、電源投入により、］ンデンザＣ１の充電電圧
は抵抗Ｒ１とコンデンサＣ１の時定数に従って一ト界し
、抵抗Ｒ２とＲ３で定まる基準電圧に達した時に＝１ン
パレータ９の出力がそれまでの１」レベル出力から１−
レベル出力に立ち下がる。
は抵抗Ｒ１とコンデンサＣ１の時定数に従って一ト界し
、抵抗Ｒ２とＲ３で定まる基準電圧に達した時に＝１ン
パレータ９の出力がそれまでの１」レベル出力から１−
レベル出力に立ち下がる。
コンパレータ９の電源投入時からの１」レベル出力発生
時間はこのよう２ｆｆｉ回路構成を−ｂつ電源リセッ１
−回路２によるリセッ１へ信号のＬレベル出力時−８＝ 間Ｊ：り長い遅延１）間とされており、その結果、電源
リセッｌ〜回路２の出力が［−レベルからトｌレベルに
立ち十がって、マイクロコンビコータ１にリセットが掛
けられた後に電源検出回路８の出力が１−レベルから１
−ルベルに立ち上がるようになる。
時間はこのよう２ｆｆｉ回路構成を−ｂつ電源リセッ１
−回路２によるリセッ１へ信号のＬレベル出力時−８＝ 間Ｊ：り長い遅延１）間とされており、その結果、電源
リセッｌ〜回路２の出力が［−レベルからトｌレベルに
立ち十がって、マイクロコンビコータ１にリセットが掛
けられた後に電源検出回路８の出力が１−レベルから１
−ルベルに立ち上がるようになる。
次に、第２図に示ｌ）た本発明の実施例の動作を説明す
る。
る。
第４図は、第２図の実施例にお【ノるリレット制御を示
したプログラム７０−図であり、まず、イグニッション
スイッチスイッチ３をΔン操作しＣマイクロコンビコー
タ１に電源を投入したとすると、電源リセット回路２が
作動し、第５図のタイムヂャートに示すように電源投入
から一定時間ＴＩ中の間１−レベルとなるリセット信号
を出力する。
したプログラム７０−図であり、まず、イグニッション
スイッチスイッチ３をΔン操作しＣマイクロコンビコー
タ１に電源を投入したとすると、電源リセット回路２が
作動し、第５図のタイムヂャートに示すように電源投入
から一定時間ＴＩ中の間１−レベルとなるリセット信号
を出力する。
この時、電源検出回路８の出力は１−ルベルにあり従っ
て、第４図の判別ブロックａに示Ｊようにマイクロコン
ビコータ１はまず端子Ｐ３の信号レベルをチェックし、
端子Ｐ３は１」レベルにあることから、ブロックｂに進
んで、端子Ｐ１、Ｒ２をＨレベルとする信号出力を生じ
、トランジスタＱ１− ９ − Ｑ２のオンにより、制御負荷６を試験作動し、かつ警報
ランプ７を点灯して球切れチェックを行ない、もちろん
同時にマイクロコンビコータ１のイニシャルリセットを
行なう。このように電源投入からＴ１時間経過後のリセ
ッ１へ信りの１−ルベルへの立ち上がりでマイクロコン
ピュータ１のイニシャルリセットおよび制御負荷、警報
ランプの動作チェックが終了した後に、電源検出回路８
の出力が１−レベルに立ち下がり、マイクロコンピュー
タ１の端子Ｐ３を制御中においてＬレベル状態に保つ。
て、第４図の判別ブロックａに示Ｊようにマイクロコン
ビコータ１はまず端子Ｐ３の信号レベルをチェックし、
端子Ｐ３は１」レベルにあることから、ブロックｂに進
んで、端子Ｐ１、Ｒ２をＨレベルとする信号出力を生じ
、トランジスタＱ１− ９ − Ｑ２のオンにより、制御負荷６を試験作動し、かつ警報
ランプ７を点灯して球切れチェックを行ない、もちろん
同時にマイクロコンビコータ１のイニシャルリセットを
行なう。このように電源投入からＴ１時間経過後のリセ
ッ１へ信りの１−ルベルへの立ち上がりでマイクロコン
ピュータ１のイニシャルリセットおよび制御負荷、警報
ランプの動作チェックが終了した後に、電源検出回路８
の出力が１−レベルに立ち下がり、マイクロコンピュー
タ１の端子Ｐ３を制御中においてＬレベル状態に保つ。
次に、マイクロコンビコータ１にＪ：る制御中にプログ
ラム異常を異常検出回路５が検出したと覆ると、異常検
出回路５よりのリセット信号が、オアゲート４を介して
マイクロコンビコータ１に供給され、まず第４図の判別
ブロックａに示づように、電源投入時と同様に端子Ｐ３
の信号レベルをチェックし、この時、電源検出回路８の
出力は、第６図のタイムヂャ−１・に示すように１−レ
ベルにあることから、ブロックＣに進み端子Ｐ１．Ｐ２
の信号出力を禁止した状態でマイクロコンビ］−−１０
− タ１にリセットを掛（プる。
ラム異常を異常検出回路５が検出したと覆ると、異常検
出回路５よりのリセット信号が、オアゲート４を介して
マイクロコンビコータ１に供給され、まず第４図の判別
ブロックａに示づように、電源投入時と同様に端子Ｐ３
の信号レベルをチェックし、この時、電源検出回路８の
出力は、第６図のタイムヂャ−１・に示すように１−レ
ベルにあることから、ブロックＣに進み端子Ｐ１．Ｐ２
の信号出力を禁止した状態でマイクロコンビ］−−１０
− タ１にリセットを掛（プる。
従って、制御中にお（Ｊる異常検出でリレッ１へが掛け
られても、制御負荷６と警報ランプ７の作動は行なわれ
ない。
られても、制御負荷６と警報ランプ７の作動は行なわれ
ない。
以上説明してぎたように、本発明によれば、マイクロコ
ンビコータの特定端子に電源投入時から一定時間にわた
って電源検出信号を供給する電源検出回路の出ツノを接
続し、電源りｂツ１−または制御中のプログラム嬰常の
検出に基づくリセッ１へが掛かった時には、マイクロコ
ンピュータの特定端子に対する電源検出信号の状態を判
別し、電源検出信号が得られている時には、電源リセッ
トと判別して制御負荷および、または警報ランプに対す
る動作試験信号の出力を許容し、一方、電源検出信号が
１ｑられていない時には制御中にお（プるリセッｌ〜と
判別して制御負荷と警報ランプに対する動作試験信号の
出力を禁圧するようにしているため、電源投入時のみ制
御負荷および警報ランプなどの動作試験が行なわれ、同
じリセット信号であっても、制御中のリセット信号につ
いては制御Ｉ負負荷−１１− よび警報ランプの動作試験が行なわれず、制御中に動作
試験を行なってしまうことによる制御異常を確実に防止
Ｊ゛るとともに、警報ランプを不必要に点灯することに
よる不要な混乱を未然に防１にし、マイクロコンビコー
タを用いた車両用制御システムの信頼性を大幅に向上す
ることができる。
ンビコータの特定端子に電源投入時から一定時間にわた
って電源検出信号を供給する電源検出回路の出ツノを接
続し、電源りｂツ１−または制御中のプログラム嬰常の
検出に基づくリセッ１へが掛かった時には、マイクロコ
ンピュータの特定端子に対する電源検出信号の状態を判
別し、電源検出信号が得られている時には、電源リセッ
トと判別して制御負荷および、または警報ランプに対す
る動作試験信号の出力を許容し、一方、電源検出信号が
１ｑられていない時には制御中にお（プるリセッｌ〜と
判別して制御負荷と警報ランプに対する動作試験信号の
出力を禁圧するようにしているため、電源投入時のみ制
御負荷および警報ランプなどの動作試験が行なわれ、同
じリセット信号であっても、制御中のリセット信号につ
いては制御Ｉ負負荷−１１− よび警報ランプの動作試験が行なわれず、制御中に動作
試験を行なってしまうことによる制御異常を確実に防止
Ｊ゛るとともに、警報ランプを不必要に点灯することに
よる不要な混乱を未然に防１にし、マイクロコンビコー
タを用いた車両用制御システムの信頼性を大幅に向上す
ることができる。
第１図は従来例を示した回路ブロック図、第２図は本発
明の一実施例を示した回路ブロック図、第３図は第２図
の実施例における電源回路の具体的な実施例を示したプ
ログラムフロー図、第４図は第２図の実施例におけるリ
セット制御を示したプログラムフロー図、第５図は電源
投入時のリセット制御を示したタイムチャート図、第６
図は制御中におけるリセット制御を示したタイムチャー
ト図である。 １：マイクロコンピュータ ２：電源リセット回路 ３：イグニッションスイッヂ ４ニオアゲート ５：異常検出回路−１２− ６：制御負荷 ７：警報ランプ８：電源検出
回路 ９：コンパレータ特許出願人 日産自動車
株式会社、、−一代理人 弁理士 土 橋 皓 ニヘ
パ一 １３ − 第４図 第６図
明の一実施例を示した回路ブロック図、第３図は第２図
の実施例における電源回路の具体的な実施例を示したプ
ログラムフロー図、第４図は第２図の実施例におけるリ
セット制御を示したプログラムフロー図、第５図は電源
投入時のリセット制御を示したタイムチャート図、第６
図は制御中におけるリセット制御を示したタイムチャー
ト図である。 １：マイクロコンピュータ ２：電源リセット回路 ３：イグニッションスイッヂ ４ニオアゲート ５：異常検出回路−１２− ６：制御負荷 ７：警報ランプ８：電源検出
回路 ９：コンパレータ特許出願人 日産自動車
株式会社、、−一代理人 弁理士 土 橋 皓 ニヘ
パ一 １３ − 第４図 第６図
Claims (1)
- 【特許請求の範囲】 マイクロコンピュータの電源投入時および制御中におけ
るプログラム異常を検出したときにマイクロコンピュー
タにリセッ１〜をかけて初期状態に戻し、電源投入時の
リセットにおいてはマイクロコンピュータの出力で作動
負荷およびまたは警報ランプおよび、または表示部等の
作動を試験するマイクロコンピュータを用いた車両用制
御回路において、 マイクロコンピュータの電源投入時から一定時間にわた
って電源検出信号をマイクロコンピュータの特定入力端
子に供給する電源検出回路と、前記リセットが掛けられ
たときに該電源検出回路の電源検出信号を判別し、電源
検出信号が得られているとぎは前記作動負荷および、ま
たは警報ランプおよび、または表示部への動作試験信号
の出力を許容し、電源検出信号が得られていないと−１
− きには前記作動負荷と警報ランプｌ＼の動作試１１号の
出力を禁止するりセラ１−制御手段を設けたことを特徴
とするマイク１］コンビコ−一夕を用イタ車両用制御回
路。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58084904A JPS59211143A (ja) | 1983-05-17 | 1983-05-17 | マイクロコンピユ−タを用いた車両用制御回路 |
| EP84105454A EP0125682B1 (en) | 1983-05-17 | 1984-05-14 | Digital control system with error monitor operative upon starting system operation |
| DE8484105454T DE3484860D1 (de) | 1983-05-17 | 1984-05-14 | Digitales steuersystem mit fehlerueberwachung funktionsfaehig beim beginn des systemarbeitsgangs. |
| US06/610,004 US4597052A (en) | 1983-05-17 | 1984-05-14 | Digital control system with error monitor operative upon starting system operation |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58084904A JPS59211143A (ja) | 1983-05-17 | 1983-05-17 | マイクロコンピユ−タを用いた車両用制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59211143A true JPS59211143A (ja) | 1984-11-29 |
Family
ID=13843720
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58084904A Pending JPS59211143A (ja) | 1983-05-17 | 1983-05-17 | マイクロコンピユ−タを用いた車両用制御回路 |
Country Status (4)
| Country | Link |
|---|---|
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