JPS59200365A - 制御情報転送方式 - Google Patents

制御情報転送方式

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JPS59200365A
JPS59200365A JP58074834A JP7483483A JPS59200365A JP S59200365 A JPS59200365 A JP S59200365A JP 58074834 A JP58074834 A JP 58074834A JP 7483483 A JP7483483 A JP 7483483A JP S59200365 A JPS59200365 A JP S59200365A
Authority
JP
Japan
Prior art keywords
information
processing system
information processing
output
register
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP58074834A
Other languages
English (en)
Inventor
Hiroshi Kitano
博 北野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nippon Telegraph and Telephone Corp
Original Assignee
Nippon Telegraph and Telephone Corp
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Filing date
Publication date
Application filed by Nippon Telegraph and Telephone Corp filed Critical Nippon Telegraph and Telephone Corp
Priority to JP58074834A priority Critical patent/JPS59200365A/ja
Publication of JPS59200365A publication Critical patent/JPS59200365A/ja
Pending legal-status Critical Current

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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/07Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/14Error detection or correction of the data by redundancy in operation
    • G06F11/1497Details of time redundant execution on a single processing unit

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Quality & Reliability (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Detection And Correction Of Errors (AREA)
  • Retry When Errors Occur (AREA)
  • Multi Processors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 発明の技術分野 本発明は、互に情報通信をおこなう二つの情報処理シス
テムにおいて、情報を送出する側の情報処理システムが
故障した場合でも、誤った情報が受信側の情報処理シス
テムへ転送されることを防止する制御情報転送方式に関
するものである。
技術の背景 従来、プロセッサの故障を検出する手法としては、ソフ
トウェアによシ一定時間内にリセットするタイマを設け
て金物の正常性およびソフトウェアの正常性をチェック
する手法が用いられている。
また電子交換機においては、一定時間ごとに擬似的に呼
を発生させ、所要の呼接続処理がおこなわれるかどうか
をチェックする外部監視回路を設ける手法も用いられて
いる。ソフトウェアによるプロセッサの故障検出は、プ
ロセッサが故障すれば、リセットされるべきタイマがリ
セットされずオーバフローする。また電子交換機におけ
る外部監視回路では接続動作が完了されないことを容易
に検出できる。
従来技術と問題点 従来の故障検出手法のみを用いても故障の発見、は可能
であるが、故障発見に至るまでに時間を要し、そ−の間
(送出された異常な情報が受信側の情報処理システムへ
転送され、受信側の情報処理システムをじよう乱させて
しまうという欠点を有していた。
発明の目的 本発明の目的は、従来の欠点を除去するために、送信側
情報処理システムが故障しても、異常な情報を受信側の
情報処理システムへ送出しない手段を備えた制御情報転
送方式を提供するもので、以下図面について詳細に説明
する。
発明の実施例 図は本発明の実施例であって、太線は情報線を示し、細
線は制御線を示す。1は送信側情報処理、 システム、
2は送信側情報処理システム1のアドレスバス、3は送
信側情報処理システム1のデータバス、4および5はそ
れぞれアドレスノ(ス2およびデータバス3のバス情報
の受信回路、6はアドレスバス2の情報を一時蓄積する
レジスタ、7はアドレスバス2の内容が自装置の番号と
一致しているかどうかをチェックする装置番号照合回路
、8は装置番号照合回路7における照合の結果、自装置
あてであることが判った場合に駆動されるタイミング制
御回路、9はデータバス3の情報を一時蓄積するレジス
タ、10〜14は論理積回路、15は論理積回路lOの
出力情報を一時蓄積するレジスタ、16はレジスタ9お
よび15の出力情報を比較して一致しているかどうかを
判定する比較器、17は受信側情報処理システムである
。また、70は装置番号照合回路7の出力、80〜85
はタイミング制御回路8の出力、匍はレジスタ9の出力
、130は論理積回路13の出力、140は論理積回路
14の出力、150はレジスタ15の出力、160は比
較器16での比較の結果、一致した場合に出力される一
致出力、161は比較器16での比較の結果、不一致の
場合に出力される不一致出力である。
本回路は、送信側情報処理システム1がアドレスバスお
よびデータバス2.3に情報を出力することで動作を開
始する。受信回路4.5によシ受信した第1回目の情報
はレジスタ6.9にそれぞれ一時蓄積される。装置番号
照合回路7はレジスタ6の情報を用いて自装置あてであ
ること全判定するとタイミング制御回路8を起動する。
タイミング制御回路8は、第1回目の情報ということで
出力82ヲ活性化させ、論理積回路10t−動作させて
レジスタ9に蓄積されている情報をレジスタ15にも入
力させる。
送信側情報処理システム1は、引き続き同一情報の第2
回目の送出をおこなう。この場合、タイミング制御回路
8は第2回目であることからあらかじめ出力81を活性
化させてレジスタ9t−クリアしておく。レジスタ9に
第2回目の情報が格納されるとタイミング制御回路8は
出力門を活性化させ、比較器16ヲ動作させる。両者の
情報が同一であれば、比較器16は一致出力160ヲ活
性化させタイミング制御回路8に動作の継続を指示する
。第3回目以降の情報受信の際も同様な動作となる。
前回までに一致が確認された情報はレジスタ15に格納
されておシ、−1新たに受信される情報はレジスタ9に
格納される。
同一情報をN回(Nは2以上の整数)比較する仕様の場
合であれば、第(N+1)回目の情報受信が最終回とな
る。この場合、一致出カ160が出力されると、タイミ
ング制御回路8は最終回ということで出力84ヲ活性化
し、その結果、該情報を受信側情報処理システム17へ
転送することができる。
これに対し、送信側情報処理システム1が故障すれば、
アドレスバスおよびデータバス2.3よシ異常な情報が
送られてくる。従って、前回までに受信した情報と異な
るため、比較器16は不一致出力161を活性化する。
その結果、タイミング制御回路8はただちにすべてのレ
ジスタ6.9.15をクリアするとともに異常情報を受
信側情報処理システム17へ送出することを防止する。
また、第1回目の受信情報がすでに異常である場合は、
すでに送信側情報処理システム1が故障している場合で
あるから、同一内容の情報を今後複数回連続して送出す
ることは不可能であり、この場合も異常情報を受信側情
報処理システム1ケへ送出することを防止することがで
きる。
すなわち、本実施例においては、送信側情報処環システ
ムlから受信側情報処理システム17あてに、あらかじ
め定めた複数回連続して送られる同一内容の情報を、た
とえば受信回路4.5で受信し、レジスタ6.9.15
で格納する手段と、受信した複数個の情報がすべて同一
か否かを、たとえば論理積回路11 、12および比較
器16などによシ確認する手段と、受信した複数個の情
報がすべて同一であることを、たとえば論理積回路13
の出力130によシ確認したときのみ受信側情報処理シ
ステム17に情報を論理積回路14を介して転送する手
段を備え、送信側情報処理システムlから受信側情報処
理システム17に制御情報の転送を行っている。
なお、送信側情報処理システム1セよび受信側情報処理
システム17は、中央制御装置、記憶装置、データチャ
ネル装置等から構成されておシ、公知の技術にて実現で
きるため説明は省略する。また、タイミング制御回路色
は、通常の論理回路設計技術者が容易に設計できるもの
で、とくに説明は省略する。
上記説明では、情報の流れは一方向と仮定したが、情報
通信は一般的には双方向で実施される。
従って、上記説明した回路を逆方向の情報に対しても設
けることによシ双方向の情報通信に本発明を適用するこ
とができる。
以上のような構成となっているため、情報を送出する側
の情報処理システムが故障しても、異常な情報によシ、
情報を受信する側の情報処理システムがじょう乱を受け
ることを防止できる。
発明の詳細 な説明したように、本発明によれば、情報を送出する側
の情報処理システムの故障もしくはソフトウェアの暴走
によシ異常な情報が送出された場合でも、異常情報の転
送をただちに抑止することが可能となυ、情報を受信す
る側の情報処理システムのしよう乱を防止することがで
きる。
【図面の簡単な説明】
図は本発明の一実施例である。 1・・・送信側情報処理システム、2・・・アドレスノ
くス、3・・・データバス、4,5・・・受信回路、6
,9゜15・・・レジスタ、7・・・装置番号照合回路
、8・・・タイミンク制御回路、10 、11.12 
、13 、14・・・論理積回路、16・・・比較器、
17・・・受信側情報処理システム、70・・・装置番
号照合回路7の出力、(資)、 81 、82 、83
 、84 、85・・・タイミング制御回路8の出力、
90・・・レジスタ9の出力、130・・・論理積回路
13の出力、140・・・論理積回路14の出力、15
0・・・レジスタ15の出力、160・・・比較器16
の一致出力、161・・・比較器16の不一致出力。 特許出願人 日本電信電話公社

Claims (1)

    【特許請求の範囲】
  1. 相互に情報通信を行う二つの情報処理システム間の制御
    情報転送方式において、前記二つの情報処理システム間
    に、該二つの情報処理システムの−1の情報処理システ
    ムから他方の情報処理システムあてに、あらかじめ定め
    た複数回連続して送出される同一内容の情報を受信し格
    納する手段と、該受信した複数個の情報がすべて同一か
    否か′f、確認する手段と、該確認する手段によシ該受
    信した複数個の情報がすべて同一であることを確認した
    ときのみ該他方の情報処理システムあてに該情報を転送
    する手段とを備えてなる制御情報転送方式。
JP58074834A 1983-04-27 1983-04-27 制御情報転送方式 Pending JPS59200365A (ja)

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JP58074834A JPS59200365A (ja) 1983-04-27 1983-04-27 制御情報転送方式

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JP58074834A JPS59200365A (ja) 1983-04-27 1983-04-27 制御情報転送方式

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Cited By (3)

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