JPS59133B2 - マルチチップ式半導体パッケ−ジ - Google Patents
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- JPS59133B2 JPS59133B2 JP54166597A JP16659779A JPS59133B2 JP S59133 B2 JPS59133 B2 JP S59133B2 JP 54166597 A JP54166597 A JP 54166597A JP 16659779 A JP16659779 A JP 16659779A JP S59133 B2 JPS59133 B2 JP S59133B2
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Description
【発明の詳細な説明】
本発明は、1枚の多層配線基板に多数の半導体チップが
搭載されまとめてパッケージされたマルチチップ式半導
体パッケージに関し、(半導体)チップの端子が高密度
の装置においても、端子を確実に基板に接続することが
でき、しかも各実装レベルごとの試験を簡単・確実に且
つ能率的に行なえるようにするものである。
搭載されまとめてパッケージされたマルチチップ式半導
体パッケージに関し、(半導体)チップの端子が高密度
の装置においても、端子を確実に基板に接続することが
でき、しかも各実装レベルごとの試験を簡単・確実に且
つ能率的に行なえるようにするものである。
近年、LSrチップを高密度実装するために、複数のL
SIチップをベアチップの状態でまとめて1つのパッケ
ージ中に実装することが試みられている。
SIチップをベアチップの状態でまとめて1つのパッケ
ージ中に実装することが試みられている。
また、従来のDIP式パッケージを各々プリント基板に
搭載する方式では搭載基板上に占める実装面積が大きく
、高密度化が図れない為、LSIチップをセラミック製
のチップキャリヤに搭載し、チップキャリヤを基板に直
接フェイスダウン状にボンディングすることも試みられ
ている。本発明は両思想の応用により、LSI等のチッ
プを1個ずつ簡易式パッケージともいえる個別のチップ
ホルダに搭載し、このチップホルダをフェイスダウンボ
ンディングの思想でパッケージ基板に接続固定して成る
簡易構成の低コストパッケージを実現するものであり、
特にこの種の実装構造においてチップホルダをパッケー
ジ基板にボンディングする際の接続不良を防止すると共
に接続部の試験を簡単・確実に行なえるようにし、高密
度なマルチチップ実装構造の実用化を図ることを目的と
する。次に、本発明の詳細を図示実施例に基づいて説明
する。
搭載する方式では搭載基板上に占める実装面積が大きく
、高密度化が図れない為、LSIチップをセラミック製
のチップキャリヤに搭載し、チップキャリヤを基板に直
接フェイスダウン状にボンディングすることも試みられ
ている。本発明は両思想の応用により、LSI等のチッ
プを1個ずつ簡易式パッケージともいえる個別のチップ
ホルダに搭載し、このチップホルダをフェイスダウンボ
ンディングの思想でパッケージ基板に接続固定して成る
簡易構成の低コストパッケージを実現するものであり、
特にこの種の実装構造においてチップホルダをパッケー
ジ基板にボンディングする際の接続不良を防止すると共
に接続部の試験を簡単・確実に行なえるようにし、高密
度なマルチチップ実装構造の実用化を図ることを目的と
する。次に、本発明の詳細を図示実施例に基づいて説明
する。
第1図は本発明によるマルチチップ式半導体パッケージ
の全体構成を示す縦断面図である。1はセラミック多層
(配線)基板であり、その上にチツプホルダ2・・・が
基板上にマトリツクス状に配置された半田バンプ3・・
・を介して直接接続固定され、チツプホルダ2・・・に
はLSI等のチツプ4・・・が1個ずつ搭載されている
。
の全体構成を示す縦断面図である。1はセラミック多層
(配線)基板であり、その上にチツプホルダ2・・・が
基板上にマトリツクス状に配置された半田バンプ3・・
・を介して直接接続固定され、チツプホルダ2・・・に
はLSI等のチツプ4・・・が1個ずつ搭載されている
。
チツプ4は各端子は、ワイヤ5で、チツプホルダ2の表
面のパツドに接続され、該パツドは、後で詳述するプロ
ーピングパツドを介して、半田バンプ3に接続されてい
る。このようにしてパツケージ基板1に多数のチツプ4
・・・が搭載され、ケース6中に封入されている。ケー
ス6中には、冷却用のフレオンTが充填されており、ケ
ース外面には、放熱のためのフイン8が設けられている
。パツケージ基板1には、リード片9・・・が固設され
ており、本リード片9・・・を介しプリント基板10に
実装される。なお、パツケージの交換性を重視する場合
には本リード片9・・・に代えてコネクタを使用するこ
とも可能である。このようなマルチチツプパツケージ構
成の従来例としては、チツプの裏面にPbSn等のバン
プを設け、ベアチツプを直接セラミツク基板上に搭載す
るいわゆるフリツプチツプ方式が挙げられる。
面のパツドに接続され、該パツドは、後で詳述するプロ
ーピングパツドを介して、半田バンプ3に接続されてい
る。このようにしてパツケージ基板1に多数のチツプ4
・・・が搭載され、ケース6中に封入されている。ケー
ス6中には、冷却用のフレオンTが充填されており、ケ
ース外面には、放熱のためのフイン8が設けられている
。パツケージ基板1には、リード片9・・・が固設され
ており、本リード片9・・・を介しプリント基板10に
実装される。なお、パツケージの交換性を重視する場合
には本リード片9・・・に代えてコネクタを使用するこ
とも可能である。このようなマルチチツプパツケージ構
成の従来例としては、チツプの裏面にPbSn等のバン
プを設け、ベアチツプを直接セラミツク基板上に搭載す
るいわゆるフリツプチツプ方式が挙げられる。
この方式は、半導体チツプの実装効率およびパツケージ
基板1、プリント基板10の配線効率の面で極めて勝れ
ているが、その実用化を妨げている問題点として、(1
)チツプとセラミツク基板間の接続部が目視できないた
め、接続部の検査に支障を来たし、パツケージ全体の信
頼性を低下させている、(2)通常のシングルチツプパ
ツケージと異なつて、ベア(裸の)チツプ状態での単体
試験がやり難い、(3レリコン上に直接バンプが設けら
れている為、機械的強度が極めて弱く、チツプの取りは
ずし、交換がやり難い、(4)端子が高密度の場合は、
隣接するバンプ同士がブリツジしたり、チツプのバンプ
とセラミツタ基板のランドとのずれが発生する、等が挙
げられる。本発明の場合、これらの問題は、以下の様な
工夫を施すことによつて解決されている。
基板1、プリント基板10の配線効率の面で極めて勝れ
ているが、その実用化を妨げている問題点として、(1
)チツプとセラミツク基板間の接続部が目視できないた
め、接続部の検査に支障を来たし、パツケージ全体の信
頼性を低下させている、(2)通常のシングルチツプパ
ツケージと異なつて、ベア(裸の)チツプ状態での単体
試験がやり難い、(3レリコン上に直接バンプが設けら
れている為、機械的強度が極めて弱く、チツプの取りは
ずし、交換がやり難い、(4)端子が高密度の場合は、
隣接するバンプ同士がブリツジしたり、チツプのバンプ
とセラミツタ基板のランドとのずれが発生する、等が挙
げられる。本発明の場合、これらの問題は、以下の様な
工夫を施すことによつて解決されている。
第2図において、イ図は、第1図のA部を拡大して示し
た断面図であり、口図はイ図の部分の平面図、ハ図はイ
図の部分の底面図である。チツプホルダ2は、セラミツ
ク等でできているが、一般のシングルチツプパツケージ
と異なり、チツプ4は裸の状態か、せいぜい樹脂を滴下
して保護膜で覆われている程度であるからベアチツプを
直接搭載する場合と比較してもほとんど同等の実装密度
を得ることが出来る。このような実装形式によれば、チ
ツプ4が外力に対し保護されていないため、第1図のよ
うにパツケージが完成するまでの取扱いに注意を要する
が、シングルチツプパツケージのような完全な封入構造
になつていないので、外形寸法の小型化、コストダウン
の利点が大きい。また、チツプの単体試験は、チツプを
チツプホルダ2に取付けた状態で行うが、試験の結果不
良品のため廃棄する場合の無駄を最少限に抑えることが
できる。なお、チツプ4は、チツプホルダの凹部11中
にダイボンデイング等で固定されている。チツプホルダ
2の表面には、ボンデイングパツド12・・・が形成さ
れており、また各ボンデイングパツド12・・・は、プ
ローピングパツド13・・・に配線パターンで接続され
ている。
た断面図であり、口図はイ図の部分の平面図、ハ図はイ
図の部分の底面図である。チツプホルダ2は、セラミツ
ク等でできているが、一般のシングルチツプパツケージ
と異なり、チツプ4は裸の状態か、せいぜい樹脂を滴下
して保護膜で覆われている程度であるからベアチツプを
直接搭載する場合と比較してもほとんど同等の実装密度
を得ることが出来る。このような実装形式によれば、チ
ツプ4が外力に対し保護されていないため、第1図のよ
うにパツケージが完成するまでの取扱いに注意を要する
が、シングルチツプパツケージのような完全な封入構造
になつていないので、外形寸法の小型化、コストダウン
の利点が大きい。また、チツプの単体試験は、チツプを
チツプホルダ2に取付けた状態で行うが、試験の結果不
良品のため廃棄する場合の無駄を最少限に抑えることが
できる。なお、チツプ4は、チツプホルダの凹部11中
にダイボンデイング等で固定されている。チツプホルダ
2の表面には、ボンデイングパツド12・・・が形成さ
れており、また各ボンデイングパツド12・・・は、プ
ローピングパツド13・・・に配線パターンで接続され
ている。
プローピングパツド13・・・は、試験を行う際にプロ
ーブピンを接触させるためのものであり、ある程度の面
積を要するから、LSIの様に多数の端子を有する場合
には、図のように1端子おきに千鳥状に配置すれば良い
。一方チツプホルダ2の底面には、そのほぼ全面を有効
に利用して、ハ図のようにランド14・・・がマトリツ
クス状に配設されている。
ーブピンを接触させるためのものであり、ある程度の面
積を要するから、LSIの様に多数の端子を有する場合
には、図のように1端子おきに千鳥状に配置すれば良い
。一方チツプホルダ2の底面には、そのほぼ全面を有効
に利用して、ハ図のようにランド14・・・がマトリツ
クス状に配設されている。
そして、これらのランド14・・・と表面のプローピン
グパツド13・・・とが内部導体15・・・により、1
対1で接続されている。従つて、内部導体15・・・は
、表面と裏面の導体を1対1で接続するという点で一種
のスルーホール導体であるが、底面の導体が表面の導体
の真下に無いので、チツプホルダ2自体をセラミツク多
層基板等で構成し、内層パターンを利用するのが有利で
ある。チツプ4は、そのボンデイングパツド16・・・
が、ワイヤ5・・・でチツプホルダ2のボンデイングパ
ツド12・・・に接続されているので、結局チツプ4の
各端子はチツプホルダ底面のランド14・・・に接続さ
れ、チツプホルダ底面の全面にマトリツクス状に端子配
列された格好になり、セラミツク基板でのDAによるパ
ターン設計上、有利である。
グパツド13・・・とが内部導体15・・・により、1
対1で接続されている。従つて、内部導体15・・・は
、表面と裏面の導体を1対1で接続するという点で一種
のスルーホール導体であるが、底面の導体が表面の導体
の真下に無いので、チツプホルダ2自体をセラミツク多
層基板等で構成し、内層パターンを利用するのが有利で
ある。チツプ4は、そのボンデイングパツド16・・・
が、ワイヤ5・・・でチツプホルダ2のボンデイングパ
ツド12・・・に接続されているので、結局チツプ4の
各端子はチツプホルダ底面のランド14・・・に接続さ
れ、チツプホルダ底面の全面にマトリツクス状に端子配
列された格好になり、セラミツク基板でのDAによるパ
ターン設計上、有利である。
通常のシングルチツプパツケージは、パツケージ完成状
態でプロービングし試験するので、試験は容易であるが
、本発明のようにチツプを裸の状態でチツプホルダに取
付けた場合は、従来ではプロービングが困難であつた。
しかしながら、本発明に於いては、第2図イ,口のよう
に、チツプホルダ表面に配設したプローピングパツド1
3・・・にチツプ4をワイヤボンデイングしてあるため
、チツプホルダ2のプロービング用のパツド13・・・
を利用することにより、容易にチツプ単体の試験を行う
ことができ、前記(2)の問題が解消される。また、ワ
イヤボンデイング面が、プローピングパツド13・・・
と同じ面に有するので、プロービングし試験を行いなが
ら、ワイヤボンデイングの状態を観察できる便利さもあ
る。なお、チツプとチツプホルダ間の接続は、ワイヤボ
ンデイングに限らず、ビームリード方式等他の方式で行
つてもよく、フリツプチツプの様に、チツプに特殊な処
理を行なう必要がないのも、本発明の有利な点である。
チツプが正常に動作するか、機能的な試験を行う場合は
、プローピングパツド13に直接ワイヤを接続して電源
や信号を供給し、試験後は該ワイヤを切断すればよい。
チツプの単体試験は、チツプをパツケージ基板1に実装
する前に行われることは言うまでもない。第2図ハのよ
うに、チツプホルダ底面のランド14・・・には半田バ
ンプ3・・・が形成されており、チツプホルダ2はこの
半田バンプ3・・・を介してパツケージ基板1に接続固
定される。
態でプロービングし試験するので、試験は容易であるが
、本発明のようにチツプを裸の状態でチツプホルダに取
付けた場合は、従来ではプロービングが困難であつた。
しかしながら、本発明に於いては、第2図イ,口のよう
に、チツプホルダ表面に配設したプローピングパツド1
3・・・にチツプ4をワイヤボンデイングしてあるため
、チツプホルダ2のプロービング用のパツド13・・・
を利用することにより、容易にチツプ単体の試験を行う
ことができ、前記(2)の問題が解消される。また、ワ
イヤボンデイング面が、プローピングパツド13・・・
と同じ面に有するので、プロービングし試験を行いなが
ら、ワイヤボンデイングの状態を観察できる便利さもあ
る。なお、チツプとチツプホルダ間の接続は、ワイヤボ
ンデイングに限らず、ビームリード方式等他の方式で行
つてもよく、フリツプチツプの様に、チツプに特殊な処
理を行なう必要がないのも、本発明の有利な点である。
チツプが正常に動作するか、機能的な試験を行う場合は
、プローピングパツド13に直接ワイヤを接続して電源
や信号を供給し、試験後は該ワイヤを切断すればよい。
チツプの単体試験は、チツプをパツケージ基板1に実装
する前に行われることは言うまでもない。第2図ハのよ
うに、チツプホルダ底面のランド14・・・には半田バ
ンプ3・・・が形成されており、チツプホルダ2はこの
半田バンプ3・・・を介してパツケージ基板1に接続固
定される。
第3図はチツプホルダ2が搭載されたパツケージ基板1
の断面構造およびパツケージ試験の際のプロービング状
態を示す要部断面側面図である。パツケージ基板1の内
面には、チツプホルダ2の底面の各ランド14・・・と
対向する位置にランド17・・・を備えており、また外
面には、内部導体例えばスルーホール導体18・・・を
介して接続されたランド19・・・を備えている。パツ
ケージ基板1は、パツケージ内において、各チツプ4・
・・間の配線を行うための内層パターン20・・・を有
しており、多層配線構造に成つているが、基板内面のラ
ンド17・・・をスルーホール導体18・・・で基板外
面に引出すのを妨げないように、内層パターン20・・
・はスルーホール導体18・・・を避けて配置されてい
る。このように基板内面のランド17・・・が外面に引
出されていることにより、チツプホルダ側のランド14
・・・とパツケージ基板側のランド17・・・との接続
試験は、次のようにして容易に行うことができる。
の断面構造およびパツケージ試験の際のプロービング状
態を示す要部断面側面図である。パツケージ基板1の内
面には、チツプホルダ2の底面の各ランド14・・・と
対向する位置にランド17・・・を備えており、また外
面には、内部導体例えばスルーホール導体18・・・を
介して接続されたランド19・・・を備えている。パツ
ケージ基板1は、パツケージ内において、各チツプ4・
・・間の配線を行うための内層パターン20・・・を有
しており、多層配線構造に成つているが、基板内面のラ
ンド17・・・をスルーホール導体18・・・で基板外
面に引出すのを妨げないように、内層パターン20・・
・はスルーホール導体18・・・を避けて配置されてい
る。このように基板内面のランド17・・・が外面に引
出されていることにより、チツプホルダ側のランド14
・・・とパツケージ基板側のランド17・・・との接続
試験は、次のようにして容易に行うことができる。
パツケージ基板1の下側に示されているプローバボード
B1には、 ガイド管21・・・が設けられ、その中に
プローブピン22・・・が挿入支持されている。プロー
ブピン22・・・は、パツケージ基板1の外面のランド
19・・・と対応して配設されているので、プローバボ
ードB,をパツケージ基板1に当接し位置決めすること
により、プローブピン22・・・を基板のランド19・
・・に圧接させることができる。一方、チツプホルダ2
の上側に示されているプローバボードB2には、チツプ
ホルダ2のプローピングパツド13・・・の位置と対向
する位置にガイド管23・・・が設けられ、その中にプ
ローブピン24・・・が挿入支持されている。従つて、
プローバボードB2をチツプホルダ2に対して位置決め
しセツトすることにより、プローブピン24・・・をチ
ツプホルダのプローピングパツド13・・・に圧接させ
ることができる。このようにチツプホルダ2のプローピ
ングパツド13・・・にプローブピン24・・・を圧接
させ、基板外面のランド19・・・にプローブピン22
・・・を圧接させて、両プローブピン24・・・22・
・・間に順次通電していくことにより、チツプホルダ底
面のランド14・・・とパツケージ基板内面のランド1
7・・・とが半田バンプ3・・・によつて正常に接続さ
れているかどうか、試験することができる。
B1には、 ガイド管21・・・が設けられ、その中に
プローブピン22・・・が挿入支持されている。プロー
ブピン22・・・は、パツケージ基板1の外面のランド
19・・・と対応して配設されているので、プローバボ
ードB,をパツケージ基板1に当接し位置決めすること
により、プローブピン22・・・を基板のランド19・
・・に圧接させることができる。一方、チツプホルダ2
の上側に示されているプローバボードB2には、チツプ
ホルダ2のプローピングパツド13・・・の位置と対向
する位置にガイド管23・・・が設けられ、その中にプ
ローブピン24・・・が挿入支持されている。従つて、
プローバボードB2をチツプホルダ2に対して位置決め
しセツトすることにより、プローブピン24・・・をチ
ツプホルダのプローピングパツド13・・・に圧接させ
ることができる。このようにチツプホルダ2のプローピ
ングパツド13・・・にプローブピン24・・・を圧接
させ、基板外面のランド19・・・にプローブピン22
・・・を圧接させて、両プローブピン24・・・22・
・・間に順次通電していくことにより、チツプホルダ底
面のランド14・・・とパツケージ基板内面のランド1
7・・・とが半田バンプ3・・・によつて正常に接続さ
れているかどうか、試験することができる。
試験の結果、接続不良があれば、そのチツプホルダを加
熱し半田バンプ3・・・を溶かしてチツプホルダを取外
し、ボンデイングをやり直したり、別のチツプホルダを
ボンデイングすることができる。このように本発明によ
れば、対向する面同士が半田バンプで直接接続され、目
視できない構造であるにも拘わらず、チツプホルダ表面
のプローピングパツド13・・・とパツケージ基板外面
のランド19・・・にプローブピンを当接させ、最短ル
ートの配線に通電することができるので、試験の作業性
にも勝れ、容易・正確にかつ能率的に試験することがで
きる。従つて、通常のフリツプチツプ構造において端子
接続部の試験を行うには、マルチチツプの機能試験を行
わなければならなかつたのに比べると、試験の負担が大
幅に軽減される。なお、プロービング用のランド19・
・・は、試験終了後は、パツケージ内あるいは他のパツ
ケージやプリント基板10との間の配線変更(改造)に
際してのワイヤボンデイングパツドに兼用することもで
きる。以上のように本発明によれば、半導体チツプが1
個ずつ個別の簡易構成のチツプホルダに取付けられ、該
チツプホルダの底面が半田バンプ等で直接パツケージ基
板の内面に接続固定された安価でかつ配線効率に勝れた
マルチチツプパツケージにおいて、チツプホルダの裏面
および多層配線基板の裏面に、相互の接続用のランドを
マトリツクス状に配設することにより、各ランドの間隔
や大きさを充分大きくすることができ、ランドのずれや
ランド間のブリツジの問題が容易に解決され、端子が高
密度の半導体チツプの実装が容易になる。
熱し半田バンプ3・・・を溶かしてチツプホルダを取外
し、ボンデイングをやり直したり、別のチツプホルダを
ボンデイングすることができる。このように本発明によ
れば、対向する面同士が半田バンプで直接接続され、目
視できない構造であるにも拘わらず、チツプホルダ表面
のプローピングパツド13・・・とパツケージ基板外面
のランド19・・・にプローブピンを当接させ、最短ル
ートの配線に通電することができるので、試験の作業性
にも勝れ、容易・正確にかつ能率的に試験することがで
きる。従つて、通常のフリツプチツプ構造において端子
接続部の試験を行うには、マルチチツプの機能試験を行
わなければならなかつたのに比べると、試験の負担が大
幅に軽減される。なお、プロービング用のランド19・
・・は、試験終了後は、パツケージ内あるいは他のパツ
ケージやプリント基板10との間の配線変更(改造)に
際してのワイヤボンデイングパツドに兼用することもで
きる。以上のように本発明によれば、半導体チツプが1
個ずつ個別の簡易構成のチツプホルダに取付けられ、該
チツプホルダの底面が半田バンプ等で直接パツケージ基
板の内面に接続固定された安価でかつ配線効率に勝れた
マルチチツプパツケージにおいて、チツプホルダの裏面
および多層配線基板の裏面に、相互の接続用のランドを
マトリツクス状に配設することにより、各ランドの間隔
や大きさを充分大きくすることができ、ランドのずれや
ランド間のブリツジの問題が容易に解決され、端子が高
密度の半導体チツプの実装が容易になる。
チツプホルダ表面に設けたプローピングパツドを使用し
て容易にチツプ単体の試験を行うことができ、また該プ
ローピングパツドおよびパツケージ基板外面のランドを
使用することにより、従来試験に支障を来たしていた半
田バンプ接続部も容易に試験できる。又、チツプがホル
ダーを介して基板上に取付けられていることから、チツ
プの故障等に依る取りはずし、交換も、従来のフリツプ
チツプその他、ベアチツプを直接実装した場合と比べ、
容易になつている。そのため、ベアチツプを、チップホ
ルダを介してパツケージ基板に高密度実装した簡易式マ
ルチチツプパツケージの実用化を実現することが可能と
なり、装置のコストダウンおよび信頼性向上に大きく寄
与することができる。
て容易にチツプ単体の試験を行うことができ、また該プ
ローピングパツドおよびパツケージ基板外面のランドを
使用することにより、従来試験に支障を来たしていた半
田バンプ接続部も容易に試験できる。又、チツプがホル
ダーを介して基板上に取付けられていることから、チツ
プの故障等に依る取りはずし、交換も、従来のフリツプ
チツプその他、ベアチツプを直接実装した場合と比べ、
容易になつている。そのため、ベアチツプを、チップホ
ルダを介してパツケージ基板に高密度実装した簡易式マ
ルチチツプパツケージの実用化を実現することが可能と
なり、装置のコストダウンおよび信頼性向上に大きく寄
与することができる。
図面は本発明によるマルチチツプ式半導体パツケージの
実施例を示すもので、第1図は全体構成を示す縦断面図
、第2図イ,口,ハはチツプホルダの要部を示す縦断面
図、平面図および底面図、第3図はマルチチツプ式半導
体パツケージの試験作業状態を示す要部断面側面図であ
る。 図において、1はパツケージ基板、2はチツプホルダ、
3は半田バンプ、4は(半導体)チツプ、6はケース、
10はプリント基板、13はプローピングパツド、14
,17,19はランド、15は内部導体、18はスルー
ホール導体、22,24はプローブピンである。
実施例を示すもので、第1図は全体構成を示す縦断面図
、第2図イ,口,ハはチツプホルダの要部を示す縦断面
図、平面図および底面図、第3図はマルチチツプ式半導
体パツケージの試験作業状態を示す要部断面側面図であ
る。 図において、1はパツケージ基板、2はチツプホルダ、
3は半田バンプ、4は(半導体)チツプ、6はケース、
10はプリント基板、13はプローピングパツド、14
,17,19はランド、15は内部導体、18はスルー
ホール導体、22,24はプローブピンである。
Claims (1)
- 1 1枚の多層配線基板に、複数の半導体チップを搭載
したマルチチップ式半導体パッケージにおいて、半導体
チップは1個ずつ個別のチップホルダに取付けられてお
り、各チップホルダの表面には、半導体チップの端子と
接続されたボンディングパッド、並びに該ボンディング
パッドと接続されたプロービングパッドを有し、裏面に
は、上記プロービングパッドにチップホルダの内部導体
で接続されたランドが、裏面全面にわたつてマトリック
ス状に配設されており、しかも前記多層配線基板のチッ
プ搭載面には、チップホルダのマトリックス状ランドと
対向し直接接続されたランドを有しており、これらのラ
ンドが多層配線基板の内部導体を介して、もう一方の面
に配設されたプロービング用のランドに1対1で接続さ
れていることを特徴とするマルチチップ式半導体パッケ
ージ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP54166597A JPS59133B2 (ja) | 1979-12-21 | 1979-12-21 | マルチチップ式半導体パッケ−ジ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP54166597A JPS59133B2 (ja) | 1979-12-21 | 1979-12-21 | マルチチップ式半導体パッケ−ジ |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5688343A JPS5688343A (en) | 1981-07-17 |
JPS59133B2 true JPS59133B2 (ja) | 1984-01-05 |
Family
ID=15834230
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP54166597A Expired JPS59133B2 (ja) | 1979-12-21 | 1979-12-21 | マルチチップ式半導体パッケ−ジ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59133B2 (ja) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58106854A (ja) * | 1981-12-18 | 1983-06-25 | Nec Corp | 集積回路 |
JPS58122753A (ja) * | 1982-01-14 | 1983-07-21 | Nec Corp | 高密度チツプキヤリア |
JPS5954938U (ja) * | 1982-10-01 | 1984-04-10 | 京セラ株式会社 | リ−ドレスパッケ−ジの多段構造 |
EP0351581A1 (de) * | 1988-07-22 | 1990-01-24 | Oerlikon-Contraves AG | Hochintegrierte Schaltung sowie Verfahren zu deren Herstellung |
JPH0821648B2 (ja) * | 1989-06-20 | 1996-03-04 | 三菱マテリアル株式会社 | 厚膜技術により形成されたピンレスグリッドアレイ電極構造 |
-
1979
- 1979-12-21 JP JP54166597A patent/JPS59133B2/ja not_active Expired
Also Published As
Publication number | Publication date |
---|---|
JPS5688343A (en) | 1981-07-17 |
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