JPS5843955B2 - 時分割電子交換機 - Google Patents

時分割電子交換機

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JPS5843955B2
JPS5843955B2 JP54121423A JP12142379A JPS5843955B2 JP S5843955 B2 JPS5843955 B2 JP S5843955B2 JP 54121423 A JP54121423 A JP 54121423A JP 12142379 A JP12142379 A JP 12142379A JP S5843955 B2 JPS5843955 B2 JP S5843955B2
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JP
Japan
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signal
circuit
time division
path memory
communication path
Prior art date
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Expired
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JP54121423A
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English (en)
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JPS5644294A (en
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隆 横戸
潔夫 小沢
英二 南谷
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Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
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Priority to GB8029628A priority patent/GB2059719B/en
Priority to US06/187,420 priority patent/US4370742A/en
Priority to CA000360252A priority patent/CA1155208A/en
Priority to DE3034911A priority patent/DE3034911C2/de
Priority to FR8020246A priority patent/FR2466160B1/fr
Publication of JPS5644294A publication Critical patent/JPS5644294A/ja
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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04Q—SELECTING
    • H04Q11/00—Selecting arrangements for multiplex systems
    • H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing
    • H04Q11/0407—Selecting arrangements for multiplex systems for time-division multiplexing using a stored programme control
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04Q—SELECTING
    • H04Q11/00—Selecting arrangements for multiplex systems
    • H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)

Description

【発明の詳細な説明】 本発明は信号処理装置と押釦ダイヤル信号受信装置、多
周波信号受信装置とのインタフェースを簡潔にし、増設
することを容易にした時分割電子交換機に関する。
従来の時分割交換機は第１図のようにブロック構成で示
すことができる。
第１図において中央処理装置ＣＰＵ、信号処理装置Ｓ
Ｐ Ｒ，通話路メモＩＪｓＰＭを含む時分割スイッチＴ
ＤＳＷが時分割電子交換機の主要構成要素となっていて
、加入者ＳＵＢとの間にライン回路ＬＣ１他局との間に
トランク回路ＴＲＫを介して接続されている。
そして発信音、呼出音などのトーントランクＴＮＴ、ダ
イヤル信号特に押釦ダイヤル信号を受信する回路ＰＢＲ
１他局との信号に関連する多周波信号受信回路ＭＦＲが
設けられている。
また信号処理ＳＰＲは信号分配回路ＳＤ１スイッチ制御
回路５ＷＣ１走査回路ＳＣＮを主要要素としている。
信号処理装置ＳＰＲ中の走査回路ＳＣＮはライン回路Ｌ
Ｃにより加入者のオンフック・オフフックの状態をまた
トランク回路ＴＲＫの状態を監視するため定期的に信号
を走査している。
また通話路メモリＳＰＭには加入者ＳＵＢの送信音声の
外、相手局からの受信音声についても書込み、読出しし
ながら通話がなされている。
ライン回路ＬＣの監視情報は１回路当り１ビツトで良く
、押釦ダイヤル信号受信回路ＰＢＲは４ビツトあるいは
５ビツト必要となり、又、アナログ−ディジタル変換方
式がＰＣＭ方式ならば、通話路メモリＳＰＭも８ビツト
必要となるため電子交換機内において通話時メモリを含
む時分割スイッチあるいは信号処理装置ＳＰＲと他の装
置とのインタフェースは複雑となっていた。
そのためシステム構成上の実装位置の制限があって増設
が容易でない欠点があった。
本発明の目的は前述の欠点を改善し、時分割スイッチと
他の装置間のインタフェースを整理してシステム増設を
容易にした電子交換機を提供することにある。
以下図面に示す本発明の実施例について説明する。
第２図は本発明の実施例主要部を示すブロック図で第１
図の時分割スイッチを詳細に示している。
また第１図と同一の符号は同様のものを示す。第２図に
おいてＳＰＭＴは通話路メモリ（送信側）、ＳＰＭＲは
通話路メモリ（受信側）、Ｈ８Ｗはハイウェイスイッチ
、ＨＭｉ 、ＨＭ２は保持メモリ回路でＨＭｌはＳＰＭ
Ｔ、ＳＰＭＲの両者を対制御している。
なおＴＩＭはクロック、同期信号等のタイミング作成回
路、ＡＣ８は通話路メモリ（送信側）ＳＰＭＴの内容を
読出して信号処理装置ＳＰＨに取込むためのアクセス回
路を示す。
加入者５ＵＢｌが押釦ダイヤル式電話機であって、ダイ
ヤル動作がされた場合、ダイヤルのアナログ信号はライ
ン回路ＬＣ１においてディジタル信号に変換され、送信
信号ＳＳ１となる。
送信信号ＳＳ１は通話路メモリ（送信側）ＳＰＭＴの割
当てられたアドレス（第２図ではアドレスＡ。
）に書込みされる。
保持メモｌＪＨＭｌの内容による所定時間に通話路メモ
リ（送信側）ＳＰＭＴが読出され、ハイウェイスイッチ
Ｈ８Ｗを経て通話路メモリ（受信側）ＳＰＭＨの中で押
釦ダイヤル受信装置ＰＢＨに割当てられたアドレス（第
２図ではアドレスＡｘ）に書込みされる。
このデータは再び保持メモｌＪＨＭｌによって読出され
、受信信号Ｒ８１として押釦ダイヤル受信装置ＰＢＨに
入力される。
該受信装置ＰＢＨにおいて、ダイヤル情報を検出すると
、再び通話路メモリ（送信側）ＳＰＭＴにデータＳＳ２
を送信し、書込みをされる。
このデータは読出したときアクセス回路ＡＣ８により信
号処理装置ＳＰＨにおいてダイヤル情報として処理され
、中央処理装置に通知される。
受信装置ＰＢＲ近傍に示した信号“ＳＰ”は、ＰＢＲが
前記ダイヤル情報を検出したことを示す信号であって、
この信号が発生した後に、信号処理装置ＳＰＲはメモリ
ＳＰＭＴを読出す。
また保持メモリＨＭｉのデータビットのうち１ビツトは
通話路メモリ（受信側）ＳＰＭＲにデータＳＳ２が書込
まれるとき、加入者５ＵＢ１に送信されることを防止す
るため使用され、第２図では各アドレスに示される最後
のビットが該当し ４１１１１のときのみ書込可能とし
ている。
′０”では書込まれないため新たに送信がなされない。
以上は押釦ダイヤル信号受信装置について説明したが、
多周波信号受信装置ＭＦＨに関係する信号を書込み、読
出すときも同様に動作する。
またライン回路ＬＣからの電話機オフフック状態信号お
よび、押釦ダイヤル受信装置ＰＢＲからのＳＰ信号を送
信信号上に挿入し周期的に読出すようにすれば、第２図
中の走査信号線ＳＣＮは不要となる。
従来は時分割スイッチ、信号処理装置とライン回路、ト
ランク、押釦ダイヤル信号装置、多周波信号受信装置と
の、インタフェースは情報量が異なるので、システム上
実装位置の制限がなされたが、このようにして本発明の
構成によると時分割スイッチとのインタフェースが共通
に考えられるので、システム内の実装・増設において極
めて容易に行なうことができる。
また通話路メモリ本来の動作であるディジタル化された
通話信号を処理する途中で読出し、解析すれば、通話が
行なわれているときは通話信号が刻々に変化する筈であ
る所、若し変化しないときは障害発生であることを検出
できる効果も有する。
【図面の簡単な説明】
第１図は従来の時分割電子交換僅を示すブロック構成図
、第２図は本発明の実施例の主要部を示すブロック図で
ある。 ＣＰＵ・・・・・・中央処理装置、ＳＰＲ・・・・・・
信号処理装置、ＴＤＳＷ・・・・・・時分割スイッチ、
ＳＵＢ・・・・・・加入者、ＬＣ・・・・・・ライン回
路、ＴＲＫ・・・・・・トランク回路、ＴＮＴ、・、−
）−ントランク、ＰＢＲ・・・・・・押釦ダイヤル信号
受は回路、ＭＦＲ・・・・・・多周波信号受信回路、Ｓ
ＣＮ・・・・・・走査回路、ＳＰＭ・・・・・・通話路
メモリ、Ｈ８Ｗ・・・・・・ハイウェイスイッチ、ＳＰ
ＭＴ・・・・・・通話路メモリ（送信側）、ＳＰＭＲ・
・・・・・通話路メモリ（受信側）、ＨＭｌ、ＨＭ２・
・・・・・保持メモリ回路、ＡＣ８・・・・・・アクセ
ス回路。

Claims (1)

    【特許請求の範囲】
  1. １ 中央処理装置・多周波信号受信装置・信号処理装置
    ・及び通話路メモリを含む時分割スイッチを主要構成要
    素とする時分割電子交換機において、加入者或いは他局
    からのダイヤル情報を多周波信号受信装置で検出し、そ
    の出力を前記通話路メモリに一旦書込む手段と、該通話
    路メモリに書込んだ内容を読出して前記信号処理装置に
    取込むためのアクセス回路とを具備することを特徴とす
    る時分割電子交換機。
JP54121423A 1979-09-20 1979-09-20 時分割電子交換機 Expired JPS5843955B2 (ja)

Priority Applications (7)

Application Number Priority Date Filing Date Title
JP54121423A JPS5843955B2 (ja) 1979-09-20 1979-09-20 時分割電子交換機
SE8006312A SE442935B (sv) 1979-09-20 1980-09-10 Kretsanordning for ett pulskodmodulerat telefonvexelsystem
GB8029628A GB2059719B (en) 1979-09-20 1980-09-12 Time division electronic switching system
US06/187,420 US4370742A (en) 1979-09-20 1980-09-15 Time division electronic switching system
CA000360252A CA1155208A (en) 1979-09-20 1980-09-15 Time division electronic switching system
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JP54121423A JPS5843955B2 (ja) 1979-09-20 1979-09-20 時分割電子交換機

Publications (2)

Publication Number Publication Date
JPS5644294A JPS5644294A (en) 1981-04-23
JPS5843955B2 true JPS5843955B2 (ja) 1983-09-30

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ID=14810769

Family Applications (1)

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JP54121423A Expired JPS5843955B2 (ja) 1979-09-20 1979-09-20 時分割電子交換機

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JP (1) JPS5843955B2 (ja)
CA (1) CA1155208A (ja)
DE (1) DE3034911C2 (ja)
FR (1) FR2466160B1 (ja)
GB (1) GB2059719B (ja)
SE (1) SE442935B (ja)

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DE3034911C2 (de) 1989-11-23
DE3034911A1 (de) 1981-03-26
GB2059719B (en) 1984-07-25
FR2466160A1 (fr) 1981-03-27
SE8006312L (sv) 1981-03-21
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