JPH1055160A - Ｖｇａ画像をウィンドウ表示する装置および方法 - Google Patents
Ｖｇａ画像をウィンドウ表示する装置および方法Info
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- JPH1055160A JPH1055160A JP9086505A JP8650597A JPH1055160A JP H1055160 A JPH1055160 A JP H1055160A JP 9086505 A JP9086505 A JP 9086505A JP 8650597 A JP8650597 A JP 8650597A JP H1055160 A JPH1055160 A JP H1055160A
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Abstract
(57)【要約】
【課題】 ＶＧＡ画像を含むグラフィックス画像を記憶
するため１つのメモリ装置のみ使用し、またＶＧＡ画像
と加速されたグラフィックス画像を同時に表示可能とす
るＶＧＡ能力を有するディスプレイ・アダプタを提供す
ること。 【解決手段】 本発明はディスプレイ・スクリーンにＶ
ＧＡ画像をウィンドウ表示する装置および方法を提供す
る。この装置は、ＶＧＡコントローラと、ラスタライザ
・エンジンと、表示可能メモリおよび表示不可能メモリ
を有するフレーム・バッファとを含むグラフィックス・
アダプタである。ＶＧＡコントローラはフレーム・バッ
ファの表示不可能メモリにＶＧＡデータを記憶させた
り、引き出したりし、またディスプレイ・スクリーンに
ＶＧＡ画像をウィンドウ表示するように、さらに処理す
るためにそのデータをラスタライザ・エンジンに供給す
る。処理の後、後に表示するフレーム・バッファの表示
可能メモリでの他のグラフィックス・データと同様に、
ラスタライザ・エンジンの加速型グラフィックス・プロ
セッサがＶＧＡデータを記憶する。
するため１つのメモリ装置のみ使用し、またＶＧＡ画像
と加速されたグラフィックス画像を同時に表示可能とす
るＶＧＡ能力を有するディスプレイ・アダプタを提供す
ること。 【解決手段】 本発明はディスプレイ・スクリーンにＶ
ＧＡ画像をウィンドウ表示する装置および方法を提供す
る。この装置は、ＶＧＡコントローラと、ラスタライザ
・エンジンと、表示可能メモリおよび表示不可能メモリ
を有するフレーム・バッファとを含むグラフィックス・
アダプタである。ＶＧＡコントローラはフレーム・バッ
ファの表示不可能メモリにＶＧＡデータを記憶させた
り、引き出したりし、またディスプレイ・スクリーンに
ＶＧＡ画像をウィンドウ表示するように、さらに処理す
るためにそのデータをラスタライザ・エンジンに供給す
る。処理の後、後に表示するフレーム・バッファの表示
可能メモリでの他のグラフィックス・データと同様に、
ラスタライザ・エンジンの加速型グラフィックス・プロ
セッサがＶＧＡデータを記憶する。
Description
【０００１】
【発明の属する技術分野】本発明はグラフィックス表示
アダプタに関し、詳細にはウィンドウにビデオ・グラフ
ィックス・アレイ（ＶＧＡ）画像を表示する能力を有す
るアダプタに関する。
アダプタに関し、詳細にはウィンドウにビデオ・グラフ
ィックス・アレイ（ＶＧＡ）画像を表示する能力を有す
るアダプタに関する。
【０００２】
【従来の技術】高機能の加速型グラフィックス表示アダ
プタが産業界で広範囲に使われてきている。その結果、
これらのアダプタは標準品としてＶＧＡアダプタと漸次
入れ替わっている。加速型グラフィックス・アダプタは
メモリ装置に画像情報を伝えるために専用のプロセッサ
を有している。一方、ＶＧＡはシステムのプロセッサあ
るいはホストコンピュータのプロセッサを使用して、メ
モリ装置に画像情報を伝えている。専用のプロセッサに
より、加速型グラフィックス・アダプタはＶＧＡより高
速で効率が良い。
プタが産業界で広範囲に使われてきている。その結果、
これらのアダプタは標準品としてＶＧＡアダプタと漸次
入れ替わっている。加速型グラフィックス・アダプタは
メモリ装置に画像情報を伝えるために専用のプロセッサ
を有している。一方、ＶＧＡはシステムのプロセッサあ
るいはホストコンピュータのプロセッサを使用して、メ
モリ装置に画像情報を伝えている。専用のプロセッサに
より、加速型グラフィックス・アダプタはＶＧＡより高
速で効率が良い。
【０００３】しかし、ＶＧＡアプリケーションが存在す
るので、産業界ではＶＧＡアダプタを持続的に供給する
ことを望む声が根強くある。この要望を満たすため、デ
ィスプレイ・アダプタの製造メーカの数社はＶＧＡ能力
のある加速型グラフィックス表示アダプタを設計した。
図１はこうしたＶＧＡ能力を有する加速型グラフィック
ス表示アダプタの一例を示している。グラフィックス・
アダプタ１００は、ＶＧＡポートと入力ポートを有する
加速型グラフィックス・コントローラ１１０を含む。こ
のグラフィックス・コントローラ１１０はフレーム・バ
ッファ１３０に接続されており、このフレーム・バッフ
ァはさらにランダム・アクセス・メモリ・デジタル−ア
ナログ変換器（ＲＡＭＤＡＣ）１５０に接続されてい
る。ＲＡＭＤＡＣ１５０は、ディスプレイ・モニタ１６
０に画像を提供するため使用されるディスプレイ・ポー
トを有する。さらに、ＲＡＭＤＡＣ１５０はＶＧＡ画像
データを受け取るためのＶＧＡポートも有する。また、
このグラフィックス・アダプタ１００は加速型グラフィ
ックス・コントローラ１１０のＶＧＡポート、ＲＡＭＤ
ＡＣ１５０およびダイナミック・ランダム・アクセス・
メモリ（ＤＲＡＭ）１４０に接続したＶＧＡコントロー
ラ１２０も有する。
るので、産業界ではＶＧＡアダプタを持続的に供給する
ことを望む声が根強くある。この要望を満たすため、デ
ィスプレイ・アダプタの製造メーカの数社はＶＧＡ能力
のある加速型グラフィックス表示アダプタを設計した。
図１はこうしたＶＧＡ能力を有する加速型グラフィック
ス表示アダプタの一例を示している。グラフィックス・
アダプタ１００は、ＶＧＡポートと入力ポートを有する
加速型グラフィックス・コントローラ１１０を含む。こ
のグラフィックス・コントローラ１１０はフレーム・バ
ッファ１３０に接続されており、このフレーム・バッフ
ァはさらにランダム・アクセス・メモリ・デジタル−ア
ナログ変換器（ＲＡＭＤＡＣ）１５０に接続されてい
る。ＲＡＭＤＡＣ１５０は、ディスプレイ・モニタ１６
０に画像を提供するため使用されるディスプレイ・ポー
トを有する。さらに、ＲＡＭＤＡＣ１５０はＶＧＡ画像
データを受け取るためのＶＧＡポートも有する。また、
このグラフィックス・アダプタ１００は加速型グラフィ
ックス・コントローラ１１０のＶＧＡポート、ＲＡＭＤ
ＡＣ１５０およびダイナミック・ランダム・アクセス・
メモリ（ＤＲＡＭ）１４０に接続したＶＧＡコントロー
ラ１２０も有する。
【０００４】グラフィックス・コントローラ１１０の入
力ポートから受け取った加速したグラフィックス・デー
タは、コントローラ１１０で処理され、フレーム・バッ
ファ１３０に記憶させられる。そのデータの表示が用意
できると、データをモニタ１６０に最終的に表示させる
ためＲＡＭＤＡＣ１５０に送られる。グラフィックス・
コントローラ１１０により受け取られたＶＧＡデータ
は、ＤＲＡＭ１４０に記憶させるためにＶＧＡポートを
介してＶＧＡコントローラ１２０に伝送される。そのデ
ータの表示が用意できると、ＶＧＡコントローラ１２０
によりＤＲＡＭ１４０から引き出されて、ＲＡＭＤＡＣ
１５０のＶＧＡポートを介してＲＡＭＤＡＣ１５０へ送
られる。
力ポートから受け取った加速したグラフィックス・デー
タは、コントローラ１１０で処理され、フレーム・バッ
ファ１３０に記憶させられる。そのデータの表示が用意
できると、データをモニタ１６０に最終的に表示させる
ためＲＡＭＤＡＣ１５０に送られる。グラフィックス・
コントローラ１１０により受け取られたＶＧＡデータ
は、ＤＲＡＭ１４０に記憶させるためにＶＧＡポートを
介してＶＧＡコントローラ１２０に伝送される。そのデ
ータの表示が用意できると、ＶＧＡコントローラ１２０
によりＤＲＡＭ１４０から引き出されて、ＲＡＭＤＡＣ
１５０のＶＧＡポートを介してＲＡＭＤＡＣ１５０へ送
られる。
【０００５】図１に示されたように、これらの加速型グ
ラフィックス・アダプタはＶＧＡ互換性とするために２
つのメモリ装置、フレーム・バッファ１３０とＤＲＡＭ
１４０を使用する。これらの２つのメモリ装置の利用
は、アダプタの全体的なコスト上昇の原因となる。
ラフィックス・アダプタはＶＧＡ互換性とするために２
つのメモリ装置、フレーム・バッファ１３０とＤＲＡＭ
１４０を使用する。これらの２つのメモリ装置の利用
は、アダプタの全体的なコスト上昇の原因となる。
【０００６】種々の理由で、ユーザは頻繁にＶＧＡ画像
や加速された画像を同時にスクリーン上に表示したが
る。この場合、各画像は１つのウィンドウに表示され
る。しかし、図１のグラフィックス・アダプタは、ＶＧ
Ａ画像が表示されるとグラフィックス・コントローラの
利用を許可しなくなる。特に、ＶＧＡコントローラの利
用はＲＡＭＤＡＣ１５０のオペレーションを特定してし
まう。ＶＧＡ制御下のＲＡＭＤＡＣオペレーションは加
速型グラフィックス制御のＲＡＭＤＡＣオペレーション
と互換性はない。故に、ＶＧＡ画像と加速された画像を
１つのスクリーンに同時に表示することは不可能であっ
た。
や加速された画像を同時にスクリーン上に表示したが
る。この場合、各画像は１つのウィンドウに表示され
る。しかし、図１のグラフィックス・アダプタは、ＶＧ
Ａ画像が表示されるとグラフィックス・コントローラの
利用を許可しなくなる。特に、ＶＧＡコントローラの利
用はＲＡＭＤＡＣ１５０のオペレーションを特定してし
まう。ＶＧＡ制御下のＲＡＭＤＡＣオペレーションは加
速型グラフィックス制御のＲＡＭＤＡＣオペレーション
と互換性はない。故に、ＶＧＡ画像と加速された画像を
１つのスクリーンに同時に表示することは不可能であっ
た。
【０００７】
【発明が解決しようとする課題】以上の問題点を鑑み
て、本発明の目的は、ＶＧＡ画像を含むグラフィックス
画像を記憶するため１つのメモリ装置のみ使用し、また
ＶＧＡ画像と加速されたグラフィックス画像を同時に表
示可能とするＶＧＡ能力を有するディスプレイ・アダプ
タを提供することである。
て、本発明の目的は、ＶＧＡ画像を含むグラフィックス
画像を記憶するため１つのメモリ装置のみ使用し、また
ＶＧＡ画像と加速されたグラフィックス画像を同時に表
示可能とするＶＧＡ能力を有するディスプレイ・アダプ
タを提供することである。
【０００８】
【課題を解決するための手段】上記目的を達成するた
め、本発明はディスプレイ・スクリーンにＶＧＡ画像を
ウィンドウ表示する装置および方法を提供する。この装
置は、ＶＧＡコントローラと、ラスタライザ・エンジン
と、表示可能メモリおよび表示不可能メモリを有するフ
レーム・バッファとを含むグラフィックス・アダプタで
ある。ＶＧＡコントローラはフレーム・バッファの表示
不可能メモリにＶＧＡデータを記憶させたり、引き出し
たりし、またディスプレイ・スクリーンにＶＧＡ画像を
ウィンドウ表示するようにさらに処理するために、その
データをラスタライザ・エンジンに供給する。処理の
後、後に表示するフレーム・バッファの表示可能メモリ
での他のグラフィックス・データと同様に、ラスタライ
ザ・エンジンの加速型グラフィックス・プロセッサがＶ
ＧＡデータを記憶する。ＶＧＡ画像は、モニタの各フル
スクリーン表示後にリフレッシュされる。
め、本発明はディスプレイ・スクリーンにＶＧＡ画像を
ウィンドウ表示する装置および方法を提供する。この装
置は、ＶＧＡコントローラと、ラスタライザ・エンジン
と、表示可能メモリおよび表示不可能メモリを有するフ
レーム・バッファとを含むグラフィックス・アダプタで
ある。ＶＧＡコントローラはフレーム・バッファの表示
不可能メモリにＶＧＡデータを記憶させたり、引き出し
たりし、またディスプレイ・スクリーンにＶＧＡ画像を
ウィンドウ表示するようにさらに処理するために、その
データをラスタライザ・エンジンに供給する。処理の
後、後に表示するフレーム・バッファの表示可能メモリ
での他のグラフィックス・データと同様に、ラスタライ
ザ・エンジンの加速型グラフィックス・プロセッサがＶ
ＧＡデータを記憶する。ＶＧＡ画像は、モニタの各フル
スクリーン表示後にリフレッシュされる。
【０００９】
【発明の実施の形態】図２は本発明の望ましい実施例に
より利用されたデジタル・コンピュータ２００のブロッ
ク図を示す。コンピュータ２００はコンピュータ・ボッ
クス２０５内に１個以上の主プロセッサ２１０を有し、
その主プロセッサ２１０は主メモリ２２０に接続されて
いる。コンピュータ・ボックス２０５は１個以上の入力
装置２３０および出力装置２４０が付属している。入力
装置２３０は、例えばキーボード、マウス、タブレット
等であり、または他のタイプの入力装置が利用可能であ
る。出力装置２４０はテキスト・モニタ、プロッタ等で
あり、または他のタイプの出力装置が利用可能である。
主プロセッサ２１０は他にもグラフィックス・アダプタ
３００を介してグラフィックス・ディスプレイのような
グラフィックス出力装置３１０に接続されている。グラ
フィックス・アダプタ３００はアダプタ・スロット２６
０Ａ内に設けられている。グラフィックス・アダプタ３
００は主プロセッサ２１０からのグラフィックスに関す
る指示をバス２５０を介して受け取る。モデムあるいは
他の通信アダプタ３５０およびハード・ディスク３５５
も、それぞれスロット２６０Ｃ、２６０Ｄに設けられ、
バス２５０を通して主プロセッサ２１０との通信を行
う。モデム３５０は通信ライン３６０を通じて他のデー
タ処理システム３７０と通信可能である。主メモリ２２
０、ハード・ディスク３５５およびフロッピイ・ディス
ク（図示せず）を単にメモリと呼ぶことにする。
より利用されたデジタル・コンピュータ２００のブロッ
ク図を示す。コンピュータ２００はコンピュータ・ボッ
クス２０５内に１個以上の主プロセッサ２１０を有し、
その主プロセッサ２１０は主メモリ２２０に接続されて
いる。コンピュータ・ボックス２０５は１個以上の入力
装置２３０および出力装置２４０が付属している。入力
装置２３０は、例えばキーボード、マウス、タブレット
等であり、または他のタイプの入力装置が利用可能であ
る。出力装置２４０はテキスト・モニタ、プロッタ等で
あり、または他のタイプの出力装置が利用可能である。
主プロセッサ２１０は他にもグラフィックス・アダプタ
３００を介してグラフィックス・ディスプレイのような
グラフィックス出力装置３１０に接続されている。グラ
フィックス・アダプタ３００はアダプタ・スロット２６
０Ａ内に設けられている。グラフィックス・アダプタ３
００は主プロセッサ２１０からのグラフィックスに関す
る指示をバス２５０を介して受け取る。モデムあるいは
他の通信アダプタ３５０およびハード・ディスク３５５
も、それぞれスロット２６０Ｃ、２６０Ｄに設けられ、
バス２５０を通して主プロセッサ２１０との通信を行
う。モデム３５０は通信ライン３６０を通じて他のデー
タ処理システム３７０と通信可能である。主メモリ２２
０、ハード・ディスク３５５およびフロッピイ・ディス
ク（図示せず）を単にメモリと呼ぶことにする。
【００１０】本発明はグラフィックス・アダプタ３００
内で実施される。図３は、図２で説明したグラフィック
ス・アダプタ３００の一部分を示すブロック図である。
これらの部分は、ラスタライザ・エンジン４２０および
ＶＧＡコントローラ４２５に接続したアドレス・デコー
ダ４８０を含む。ラスタライザ・エンジン４２０および
ＶＧＡコントローラ４２５は互いに接続されている。ア
ドレス・デコーダ４８０はデータをラスタライザ・エン
ジン４２０あるいはＶＧＡコントローラ４２５のどちら
かへ伝送するため使用される。アドレス・デコーダは公
知であり、従ってその実施に関する説明は省略する。ラ
スタライザ・エンジン４２０は特定の画像データを与え
るためどのピクセルを更新すべきか、そして視覚的に正
確な表示を作るためにそのピクセルをどのように更新す
るか決定する。ＶＧＡコントローラ４２５はプロセッサ
２１０からの画像データでＶＧＡメモリを更新する。ま
た、グラフィックス・アダプタ３００はフレーム・バッ
ファ４３０も含む。フレーム・バッファ４３０は表示可
能メモリ４３２と表示不可能メモリ４３４を含む。フレ
ーム・バッファ４３０はラスタライザ・エンジン４２０
に接続されている。ＶＧＡコントローラ４２５はＶＧＡ
データを記憶するために表示不可能メモリ４３４を使用
する。表示可能メモリ４３２はさらにＲＡＭＤＡＣ４４
０に接続する。
内で実施される。図３は、図２で説明したグラフィック
ス・アダプタ３００の一部分を示すブロック図である。
これらの部分は、ラスタライザ・エンジン４２０および
ＶＧＡコントローラ４２５に接続したアドレス・デコー
ダ４８０を含む。ラスタライザ・エンジン４２０および
ＶＧＡコントローラ４２５は互いに接続されている。ア
ドレス・デコーダ４８０はデータをラスタライザ・エン
ジン４２０あるいはＶＧＡコントローラ４２５のどちら
かへ伝送するため使用される。アドレス・デコーダは公
知であり、従ってその実施に関する説明は省略する。ラ
スタライザ・エンジン４２０は特定の画像データを与え
るためどのピクセルを更新すべきか、そして視覚的に正
確な表示を作るためにそのピクセルをどのように更新す
るか決定する。ＶＧＡコントローラ４２５はプロセッサ
２１０からの画像データでＶＧＡメモリを更新する。ま
た、グラフィックス・アダプタ３００はフレーム・バッ
ファ４３０も含む。フレーム・バッファ４３０は表示可
能メモリ４３２と表示不可能メモリ４３４を含む。フレ
ーム・バッファ４３０はラスタライザ・エンジン４２０
に接続されている。ＶＧＡコントローラ４２５はＶＧＡ
データを記憶するために表示不可能メモリ４３４を使用
する。表示可能メモリ４３２はさらにＲＡＭＤＡＣ４４
０に接続する。
【００１１】通常、グラフィックス・システムは1024×
768すなわち768Ｋバイトのデータを表示するように設計
されている場合、このフレーム・バッファは1024Ｋバイ
トのデータの記憶容量を与えられている。768Ｋバイト
の記憶容量が最終的に表示されるデータを含むために使
用され、これを表示可能メモリと称する。残りの256Ｋ
バイトの記憶容量は、表示予定のデータを保持するため
には使用されず、これを表示不可能メモリと称する。25
6Ｋバイトの記憶容量はしばしば何の目的にも使用され
ないので、それらは通常浪費されている。本発明はＶＧ
Ａ画像データを記憶するためにこの記憶容量を有効に使
用し、そのデータを記憶するための別のメモリ装置を不
要とする。しかし本発明は768Ｋバイトのデータを表示
するために作られたシステムを用いると説明したが、異
なった大きさの画像データを表示するように作られたシ
ステムも使用できる。例えば、1280Ｋバイトの画像デー
タを表示するように作られたシステムは、2048Ｋバイト
の記憶容量を有するフレーム・バッファを用いる。フレ
ーム・バッファの未使用の768ＫバイトはＶＧＡメモリ
として利用できる。
768すなわち768Ｋバイトのデータを表示するように設計
されている場合、このフレーム・バッファは1024Ｋバイ
トのデータの記憶容量を与えられている。768Ｋバイト
の記憶容量が最終的に表示されるデータを含むために使
用され、これを表示可能メモリと称する。残りの256Ｋ
バイトの記憶容量は、表示予定のデータを保持するため
には使用されず、これを表示不可能メモリと称する。25
6Ｋバイトの記憶容量はしばしば何の目的にも使用され
ないので、それらは通常浪費されている。本発明はＶＧ
Ａ画像データを記憶するためにこの記憶容量を有効に使
用し、そのデータを記憶するための別のメモリ装置を不
要とする。しかし本発明は768Ｋバイトのデータを表示
するために作られたシステムを用いると説明したが、異
なった大きさの画像データを表示するように作られたシ
ステムも使用できる。例えば、1280Ｋバイトの画像デー
タを表示するように作られたシステムは、2048Ｋバイト
の記憶容量を有するフレーム・バッファを用いる。フレ
ーム・バッファの未使用の768ＫバイトはＶＧＡメモリ
として利用できる。
【００１２】従来のＶＧＡメモリ装置（ＤＲＡＭ）は通
常４つのマッピングに分割されている。各マッピングは
画像について異なる情報を保持するため使用される。例
えばテキスト・モードでは、第１マッピングは文字コー
ド情報を保持し、第２マッピングは属性情報を保持し、
第３マッピングはフォント情報を保持し、第４マッピン
グは通常、グラフィックス・モードのみで使用される。
同様に、表示不可能メモリ４３４はＶＧＡ画像について
異なる情報を保持するため４つのメモリ・マッピングに
分割される。フレーム・バッファの表示不可能部分は４
つのマッピングに物理的に分割させることができるが、
この場合には複数のマッピングに仮想的に分割させる。
つまり、ＶＧＡコントローラは、４つの異なったマッピ
ングとしてメモリを有効に利用するようなアドレス方式
を使用する。効果的な伝送のため、ＶＧＡマップ・デー
タをメモリ４３４のシングル・アクセスに併合させる。
常４つのマッピングに分割されている。各マッピングは
画像について異なる情報を保持するため使用される。例
えばテキスト・モードでは、第１マッピングは文字コー
ド情報を保持し、第２マッピングは属性情報を保持し、
第３マッピングはフォント情報を保持し、第４マッピン
グは通常、グラフィックス・モードのみで使用される。
同様に、表示不可能メモリ４３４はＶＧＡ画像について
異なる情報を保持するため４つのメモリ・マッピングに
分割される。フレーム・バッファの表示不可能部分は４
つのマッピングに物理的に分割させることができるが、
この場合には複数のマッピングに仮想的に分割させる。
つまり、ＶＧＡコントローラは、４つの異なったマッピ
ングとしてメモリを有効に利用するようなアドレス方式
を使用する。効果的な伝送のため、ＶＧＡマップ・デー
タをメモリ４３４のシングル・アクセスに併合させる。
【００１３】操作に際しては、主プロセッサ２１０がデ
ータをグラフィックス・アダプタ３００に送ると、アド
レス・デコーダ４８０はそのアドレスをデコードして、
データをラスタライザ・エンジン４２０に送るのか、あ
るいはＶＧＡコントローラ４２５に送るのか決める。Ｖ
ＧＡコントローラ４２５に送られたデータはＶＧＡコン
トローラにより処理され、記憶するために表示不可能メ
モリ４３４に送られる。同様に、ラスタライザ・エンジ
ン４２０に送られたデータは処理され、記憶するために
表示可能メモリ４３２に送られる。ＶＧＡデータを表示
する用意ができたら、ＶＧＡコントローラ４２５は表示
不可能メモリ４３４からデータを取り出し、必要に応じ
てデータを処理して画像を作成し、それをラスタライザ
・エンジン４２０に送る。ラスタライザ・エンジン４２
０はＶＧＡデータをメモリ４３２に送り、ＶＧＡ画像と
自身が作成した画像との合成画像を作る。ラスタライザ
・エンジン４２０は、図２の主プロセッサ２１０によっ
て、その合成画像におけるＶＧＡ画像ウィンドウの起点
アドレスを供給される。ＶＧＡ画像データは、その起点
アドレスのところから表示可能メモリ４３２にマップさ
れ、そのサイズはＶＧＡ操作モードにより定義される。
必要により、ＶＧＡ画像もディスプレイ４７０用に作ら
れた最終のスクリーン解像度に合わせるため大きさを調
整できる。そして処理済みのデータは表示可能メモリ４
３２に記憶される。表示可能メモリ４３２のデータを表
示する用意ができたら、ＲＡＭＤＡＣ４４０を介してデ
ィスプレイ４７０に送られる。
ータをグラフィックス・アダプタ３００に送ると、アド
レス・デコーダ４８０はそのアドレスをデコードして、
データをラスタライザ・エンジン４２０に送るのか、あ
るいはＶＧＡコントローラ４２５に送るのか決める。Ｖ
ＧＡコントローラ４２５に送られたデータはＶＧＡコン
トローラにより処理され、記憶するために表示不可能メ
モリ４３４に送られる。同様に、ラスタライザ・エンジ
ン４２０に送られたデータは処理され、記憶するために
表示可能メモリ４３２に送られる。ＶＧＡデータを表示
する用意ができたら、ＶＧＡコントローラ４２５は表示
不可能メモリ４３４からデータを取り出し、必要に応じ
てデータを処理して画像を作成し、それをラスタライザ
・エンジン４２０に送る。ラスタライザ・エンジン４２
０はＶＧＡデータをメモリ４３２に送り、ＶＧＡ画像と
自身が作成した画像との合成画像を作る。ラスタライザ
・エンジン４２０は、図２の主プロセッサ２１０によっ
て、その合成画像におけるＶＧＡ画像ウィンドウの起点
アドレスを供給される。ＶＧＡ画像データは、その起点
アドレスのところから表示可能メモリ４３２にマップさ
れ、そのサイズはＶＧＡ操作モードにより定義される。
必要により、ＶＧＡ画像もディスプレイ４７０用に作ら
れた最終のスクリーン解像度に合わせるため大きさを調
整できる。そして処理済みのデータは表示可能メモリ４
３２に記憶される。表示可能メモリ４３２のデータを表
示する用意ができたら、ＲＡＭＤＡＣ４４０を介してデ
ィスプレイ４７０に送られる。
【００１４】表示可能メモリ４３２の画像データはラス
タ走査方式でディスプレイ・モニタ４７０に表示され
る。つまり、画像はディスプレイ・モニタ４７０の表示
域全体にわたってスキャナで変調電子ビームをライン毎
にスイープすることにより表示される。従って、モニタ
の左最上部のピクセルに対応した画像データが初めに提
供され、右最下部ピクセルに対応したデータが最後に提
供される。右最下部ピクセルに達すると、モニタの左最
上部ピクセル位置に戻るまでピクセルを表示しないよう
にビームはターンオフされる（重直ブランク）。垂直ブ
ランクの開始で、ＶＧＡコントローラ４２５は表示不可
能メモリ４３４からのデータ読取りを開始し、それを処
理のためにラスタライザ・エンジン４２０に送る。ラス
タライザ・エンジン４２０はデータを処理して、表示可
能メモリ４３２に記憶する。このようにして、ディスプ
レイ４７０のラスタ走査処理が開始する前に、ＶＧＡ画
像がメモリ４３２内に作られる。これはディスプレイ４
７０の表示とＶＧＡ画像生成とを同期させ、従ってメモ
リが画像表示のために走査された時に画像が部分的にし
か完成していない（つまり、一部は新しい画像で一部は
前の画像）という状況を避ける。注目すべきは、表示可
能メモリ４３２の加速したデータは、主プロセッサ２１
０が加速したグラフィックス・データをグラフィックス
・アダプタに送るたびにリフレッシュされるということ
である。
タ走査方式でディスプレイ・モニタ４７０に表示され
る。つまり、画像はディスプレイ・モニタ４７０の表示
域全体にわたってスキャナで変調電子ビームをライン毎
にスイープすることにより表示される。従って、モニタ
の左最上部のピクセルに対応した画像データが初めに提
供され、右最下部ピクセルに対応したデータが最後に提
供される。右最下部ピクセルに達すると、モニタの左最
上部ピクセル位置に戻るまでピクセルを表示しないよう
にビームはターンオフされる（重直ブランク）。垂直ブ
ランクの開始で、ＶＧＡコントローラ４２５は表示不可
能メモリ４３４からのデータ読取りを開始し、それを処
理のためにラスタライザ・エンジン４２０に送る。ラス
タライザ・エンジン４２０はデータを処理して、表示可
能メモリ４３２に記憶する。このようにして、ディスプ
レイ４７０のラスタ走査処理が開始する前に、ＶＧＡ画
像がメモリ４３２内に作られる。これはディスプレイ４
７０の表示とＶＧＡ画像生成とを同期させ、従ってメモ
リが画像表示のために走査された時に画像が部分的にし
か完成していない（つまり、一部は新しい画像で一部は
前の画像）という状況を避ける。注目すべきは、表示可
能メモリ４３２の加速したデータは、主プロセッサ２１
０が加速したグラフィックス・データをグラフィックス
・アダプタに送るたびにリフレッシュされるということ
である。
【００１５】図４は、ディスプレイ・モニタに複数のウ
ィンドウを表示するための装置の詳細なブロック図を示
す。この装置はフレーム・バッファ５２０、ウィンドウ
識別装置（ＷＩＤ）５３０、およびＲＡＭＤＡＣ５４０
に接続したグラフィックス・プロセッサ５１０を有す
る。ＲＡＭＤＡＣ５４０はＷＩＤ５３０およびフレーム
・バッファ５２０にも接続されている。図３のラスタラ
イザ・エンジン４２０に含まれるグラフィックス・プロ
セッサ５１０は、表示するデータ（ＶＧＡおよび加速グ
ラフィックスの両方）をデータ・バス５７０を通じてフ
レーム・バッファ５２０に送る。グラフィックス・プロ
セッサ５１０はまたその伝送したデータのアドレス情報
をアドレス・バス５８０を通じてＷＩＤ５３０に送る。
ルックアップ・テーブル（ＬＵＴ）５４５のカラー・パ
レットは制御バス５６０を介してグラフィックス・プロ
セッサ５１０により更新される。
ィンドウを表示するための装置の詳細なブロック図を示
す。この装置はフレーム・バッファ５２０、ウィンドウ
識別装置（ＷＩＤ）５３０、およびＲＡＭＤＡＣ５４０
に接続したグラフィックス・プロセッサ５１０を有す
る。ＲＡＭＤＡＣ５４０はＷＩＤ５３０およびフレーム
・バッファ５２０にも接続されている。図３のラスタラ
イザ・エンジン４２０に含まれるグラフィックス・プロ
セッサ５１０は、表示するデータ（ＶＧＡおよび加速グ
ラフィックスの両方）をデータ・バス５７０を通じてフ
レーム・バッファ５２０に送る。グラフィックス・プロ
セッサ５１０はまたその伝送したデータのアドレス情報
をアドレス・バス５８０を通じてＷＩＤ５３０に送る。
ルックアップ・テーブル（ＬＵＴ）５４５のカラー・パ
レットは制御バス５６０を介してグラフィックス・プロ
セッサ５１０により更新される。
【００１６】ＷＩＤ５３０およびフレーム・バッファ５
２０の表示可能メモリは同様にマップされる。つまり、
ＷＩＤ５３０の各位置は表示可能メモリ内のピクセル位
置に対応する。ＷＩＤ５３０は、ピクセルの色の濃さ等
のような対応するピクセルの属性を決定するためＲＡＭ
ＤＡＣ５４０により使用されるコードを生成する。ＲＡ
ＭＤＡＣ５４０はこれらの属性を使用して、ピクセルあ
たりのビット数、パレット・アドレス、等の特定のウィ
ンドウ用のデータを正しく解釈する。従って、加速画像
データおよびＶＧＡ画像データを、各々のウィンドウ内
で同時にディスプレイ・モニタに表示できる。例えば、
ピクセル当り８ビットのＶＧＡデータをピクセル当り１
６ビットの加速画像と共に表示できる。
２０の表示可能メモリは同様にマップされる。つまり、
ＷＩＤ５３０の各位置は表示可能メモリ内のピクセル位
置に対応する。ＷＩＤ５３０は、ピクセルの色の濃さ等
のような対応するピクセルの属性を決定するためＲＡＭ
ＤＡＣ５４０により使用されるコードを生成する。ＲＡ
ＭＤＡＣ５４０はこれらの属性を使用して、ピクセルあ
たりのビット数、パレット・アドレス、等の特定のウィ
ンドウ用のデータを正しく解釈する。従って、加速画像
データおよびＶＧＡ画像データを、各々のウィンドウ内
で同時にディスプレイ・モニタに表示できる。例えば、
ピクセル当り８ビットのＶＧＡデータをピクセル当り１
６ビットの加速画像と共に表示できる。
【００１７】上記したように、特定の実施例について本
発明の説明を行ったが、他の実施例も当業者には明らか
である。それ故、上記説明は特許請求の範囲により規定
される本発明の範囲を限定するものではない。
発明の説明を行ったが、他の実施例も当業者には明らか
である。それ故、上記説明は特許請求の範囲により規定
される本発明の範囲を限定するものではない。
【００１８】まとめとして、本発明の構成に関して以下
の事項を開示する。
の事項を開示する。
【００１９】（１） ＶＧＡ画像データを含むグラフィ
ックス画像データを処理し、ディスプレイ・メモリに記
憶させ、該グラフィックス画像データにより示される複
数のグラフィックス画像の各画像データを同時に、ディ
スプレイ・モニタの各々のウィンドウに表示するための
ラスタライザ・エンジンを有することを特徴とする、Ｖ
ＧＡ画像をウィンドウ表示可能なグラフィックス表示ア
ダプタ。 （２） 上記ディスプレイ・メモリは表示可能メモリ部
分および表示不可能メモリ部分を有することを特徴とす
る、上記（１）に記載のグラフィックス表示アダプタ。 （３） 上記表示不可能メモリ部分は各々がＶＧＡ画像
用の情報データを記憶するための４つのマッピングに分
割されることを特徴とする、上記（２）に記載のグラフ
ィックス表示アダプタ。 （４） ＶＧＡ画像データを上記表示不可能メモリ部分
に記憶し、処理し、かつ上記表示不可能メモリ部分から
取り出すためのＶＧＡコントローラをさらに有すること
を特徴とする、上記（３）に記載のグラフィックス表示
アダプタ。 （５） 上記表示不可能メモリ部分から取り出したＶＧ
Ａ画像データを、上記フレーム・バッファの表示可能メ
モリに記憶させ、上記スクリーンにウィンドウ表示する
ために、上記ラスタライザ・エンジンに提供することを
特徴とする、上記（４）に記載のグラフィックス表示ア
ダプタ。 （６） ＶＧＡ画像データは、各フルスクリーン表示後
に上記ＶＧＡコントローラにより上記ラスタライザ・エ
ンジンに提供されることを特徴とする、上記（５）に記
載のグラフィックス表示アダプタ。 （７） 上記ＶＧＡ画像は最終スクリーン解像度に適合
させるために上記ラスタライザ・エンジンにより大きさ
を調整されることを特徴とする、上記（６）に記載のグ
ラフィックス表示アダプタ。 （８） ＶＧＡ画像データを含むグラフィックス画像デ
ータを得て処理するステップと、該グラフィックス画像
データをディスプレイ・メモリに記憶するステップと
複数の該グラフィックス画像データを、それぞれ同時に
１つのディスプレイ・モニタのそれぞれのウィンドウに
表示するステップと、を有することを特徴とするＶＧＡ
画像データをウィンドウ表示する方法。 （９） 上記ディスプレイ・メモリは表示可能メモリ部
分と表示不可能メモリ部分を有することを特徴とする、
上記（８）に記載の方法。 （10） 上記表示不可能メモリ部分は４つのマッピング
に分割され、各マッピングは１つのＶＧＡ画像用の情報
データを記憶することを特徴とする、上記（９）に記載
の方法。 （11） ＶＧＡコントローラによりＶＧＡ画像データを
上記表示不可能メモリ部分に記憶し、処理し、上記表示
不可能メモリ部分から取り出すステップをさらに有する
ことを特徴とする、上記（10）に記載の方法。 （12） 上記表示不可能メモリ部分から取り出したＶＧ
Ａ画像データは、上記ディスプレイ・メモリの表示可能
メモリに記憶させ、かつ１つのウィンドウの上記スクリ
ーンに表示させるために、ラスタライザ・エンジンに供
給されることを特徴とする、上記（11）に記載の方法。 （13） ＶＧＡ画像データは各フルスクリーン表示後、
上記ＶＧＡコントローラにより上記ラスタライザ・エン
ジンに供給されることを特徴とする、上記（12）に記載
の方法。 （14） 上記ＶＧＡ画像は最終的なスクリーンの解像度
に合致するように上記ラスタライザ・エンジンによって
大きさを調整されることを特徴とする、上記（13）に記
載の方法。
ックス画像データを処理し、ディスプレイ・メモリに記
憶させ、該グラフィックス画像データにより示される複
数のグラフィックス画像の各画像データを同時に、ディ
スプレイ・モニタの各々のウィンドウに表示するための
ラスタライザ・エンジンを有することを特徴とする、Ｖ
ＧＡ画像をウィンドウ表示可能なグラフィックス表示ア
ダプタ。 （２） 上記ディスプレイ・メモリは表示可能メモリ部
分および表示不可能メモリ部分を有することを特徴とす
る、上記（１）に記載のグラフィックス表示アダプタ。 （３） 上記表示不可能メモリ部分は各々がＶＧＡ画像
用の情報データを記憶するための４つのマッピングに分
割されることを特徴とする、上記（２）に記載のグラフ
ィックス表示アダプタ。 （４） ＶＧＡ画像データを上記表示不可能メモリ部分
に記憶し、処理し、かつ上記表示不可能メモリ部分から
取り出すためのＶＧＡコントローラをさらに有すること
を特徴とする、上記（３）に記載のグラフィックス表示
アダプタ。 （５） 上記表示不可能メモリ部分から取り出したＶＧ
Ａ画像データを、上記フレーム・バッファの表示可能メ
モリに記憶させ、上記スクリーンにウィンドウ表示する
ために、上記ラスタライザ・エンジンに提供することを
特徴とする、上記（４）に記載のグラフィックス表示ア
ダプタ。 （６） ＶＧＡ画像データは、各フルスクリーン表示後
に上記ＶＧＡコントローラにより上記ラスタライザ・エ
ンジンに提供されることを特徴とする、上記（５）に記
載のグラフィックス表示アダプタ。 （７） 上記ＶＧＡ画像は最終スクリーン解像度に適合
させるために上記ラスタライザ・エンジンにより大きさ
を調整されることを特徴とする、上記（６）に記載のグ
ラフィックス表示アダプタ。 （８） ＶＧＡ画像データを含むグラフィックス画像デ
ータを得て処理するステップと、該グラフィックス画像
データをディスプレイ・メモリに記憶するステップと
複数の該グラフィックス画像データを、それぞれ同時に
１つのディスプレイ・モニタのそれぞれのウィンドウに
表示するステップと、を有することを特徴とするＶＧＡ
画像データをウィンドウ表示する方法。 （９） 上記ディスプレイ・メモリは表示可能メモリ部
分と表示不可能メモリ部分を有することを特徴とする、
上記（８）に記載の方法。 （10） 上記表示不可能メモリ部分は４つのマッピング
に分割され、各マッピングは１つのＶＧＡ画像用の情報
データを記憶することを特徴とする、上記（９）に記載
の方法。 （11） ＶＧＡコントローラによりＶＧＡ画像データを
上記表示不可能メモリ部分に記憶し、処理し、上記表示
不可能メモリ部分から取り出すステップをさらに有する
ことを特徴とする、上記（10）に記載の方法。 （12） 上記表示不可能メモリ部分から取り出したＶＧ
Ａ画像データは、上記ディスプレイ・メモリの表示可能
メモリに記憶させ、かつ１つのウィンドウの上記スクリ
ーンに表示させるために、ラスタライザ・エンジンに供
給されることを特徴とする、上記（11）に記載の方法。 （13） ＶＧＡ画像データは各フルスクリーン表示後、
上記ＶＧＡコントローラにより上記ラスタライザ・エン
ジンに供給されることを特徴とする、上記（12）に記載
の方法。 （14） 上記ＶＧＡ画像は最終的なスクリーンの解像度
に合致するように上記ラスタライザ・エンジンによって
大きさを調整されることを特徴とする、上記（13）に記
載の方法。
【００２０】
【発明の効果】上記説明のように、本発明はＶＧＡ画像
を含むグラフィックス画像を記憶するため１つのメモリ
装置のみ使用し、またＶＧＡ画像と加速されたグラフィ
ックス画像を同時に表示可能とするＶＧＡ能力を有す
る、コスト的に妥当なディスプレイ・アダプタを提供す
る。
を含むグラフィックス画像を記憶するため１つのメモリ
装置のみ使用し、またＶＧＡ画像と加速されたグラフィ
ックス画像を同時に表示可能とするＶＧＡ能力を有す
る、コスト的に妥当なディスプレイ・アダプタを提供す
る。
【図１】ＶＧＡ能力を有する従来の加速型グラフィック
ス・アダプタのブロック図。
ス・アダプタのブロック図。
【図２】本発明の望ましい実施例により利用されたデジ
タル・コンピュータのブロック図。
タル・コンピュータのブロック図。
【図３】グラフィックス・アダプタの部分ブロック図。
【図４】ディスプレイ・モニタの複数のウィンドウに表
示するため使用した装置の詳細なブロック図。
示するため使用した装置の詳細なブロック図。
１００ グラフィックス・アダプタ １１０ 加速型グラフィックス・コントローラ １２０ ＶＧＡコントローラ １３０ ディスプレイ・メモリ １４０ ＤＲＡＭ １５０ ＲＡＭＤＡＣ １６０ ディスプレイ ２００ デジタル・コンピュータ ２０５ コンピュータ・ボックス ２１０ 主プロセッサ ２２０ 主メモリ ２３０ 入力装置 ２４０ 出力装置 ２５０ バス ２６０Ａ アダプタ・スロット ２６０Ｃ スロット ２６０Ｄ スロット ３００ グラフィックス・アダプタ ３１０ グラフィックス出力装置 ３５０ モデム ３５５ ハード・ディスク ３６０ 通信ライン ３７０ 他のデータ処理システム ４２０ ラスタライザ・エンジン ４２５ ＶＧＡコントローラ ４３０ フレーム・バッファ ４３２ 表示可能メモリ ４３４ 表示不可能メモリ ４７０ ディスプレイ ４８０ アドレス・デコーダ ５１０ グラフィックス・プロセッサ ５２０ フレーム・バッファ ５３０ ウィンドウ識別装置 ５４０ ＲＡＭＤＡＣ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ゲーリー・アレン・ニール アメリカ合衆国78726、テキサス州、オー スチン、ウォータートン・パーケ・コーブ 12402 (72)発明者 ジョン・トーマス・ロバーソン アメリカ合衆国78759、テキサス州、オー スチン、アロウポイント・コーブ 6809
Claims (14)
- 【請求項１】ＶＧＡ画像データを含むグラフィックス画
像データを処理し、ディスプレイ・メモリに記憶させ、
該グラフィックス画像データにより示される複数のグラ
フィックス画像の各画像データを同時に、ディスプレイ
・モニタの各々のウィンドウに表示するためのラスタラ
イザ・エンジンを有することを特徴とする、ＶＧＡ画像
をウィンドウ表示可能なグラフィックス表示アダプタ。 - 【請求項２】上記ディスプレイ・メモリは表示可能メモ
リ部分および表示不可能メモリ部分を有することを特徴
とする、請求項１に記載のグラフィックス表示アダプ
タ。 - 【請求項３】上記表示不可能メモリ部分は各々がＶＧＡ
画像用の情報データを記憶するための４つのマッピング
に分割されることを特徴とする、請求項２に記載のグラ
フィックス表示アダプタ。 - 【請求項４】ＶＧＡ画像データを上記表示不可能メモリ
部分に記憶し、処理し、かつ上記表示不可能メモリ部分
から取り出すためのＶＧＡコントローラをさらに有する
ことを特徴とする、請求項３に記載のグラフィックス表
示アダプタ。 - 【請求項５】上記表示不可能メモリ部分から取り出した
ＶＧＡ画像データを、上記フレーム・バッファの表示可
能メモリに記憶させ、上記スクリーンにウィンドウ表示
するために、上記ラスタライザ・エンジンに提供するこ
とを特徴とする、請求項４に記載のグラフィックス表示
アダプタ。 - 【請求項６】ＶＧＡ画像データは、各フルスクリーン表
示後に上記ＶＧＡコントローラにより上記ラスタライザ
・エンジンに提供されることを特徴とする、請求項５に
記載のグラフィックス表示アダプタ。 - 【請求項７】上記ＶＧＡ画像は最終スクリーン解像度に
適合させるために上記ラスタライザ・エンジンにより大
きさを調整されることを特徴とする、請求項６に記載の
グラフィックス表示アダプタ。 - 【請求項８】ＶＧＡ画像データを含むグラフィックス画
像データを得て処理するステップと、該グラフィックス
画像データをディスプレイ・メモリに記憶するステップ
と、複数の該グラフィックス画像データを、それぞれ同
時に１つのディスプレイ・モニタのそれぞれのウィンド
ウに表示するステップと、を有することを特徴とするＶ
ＧＡ画像データをウィンドウ表示する方法。 - 【請求項９】上記ディスプレイ・メモリは表示可能メモ
リ部分と表示不可能メモリ部分を有することを特徴とす
る、請求項８に記載の方法。 - 【請求項１０】上記表示不可能メモリ部分は４つのマッ
ピングに分割され、各マッピングは１つのＶＧＡ画像用
の情報データを記憶することを特徴とする、請求項９に
記載の方法。 - 【請求項１１】ＶＧＡコントローラによりＶＧＡ画像デ
ータを上記表示不可能メモリ部分に記憶し、処理し、上
記表示不可能メモリ部分から取り出すステップをさらに
有することを特徴とする、請求項１０に記載の方法。 - 【請求項１２】上記表示不可能メモリ部分から取り出し
たＶＧＡ画像データは、上記ディスプレイ・メモリの表
示可能メモリに記憶させ、かつ１つのウィンドウの上記
スクリーンに表示させるために、ラスタライザ・エンジ
ンに供給されることを特徴とする、請求項１１に記載の
方法。 - 【請求項１３】ＶＧＡ画像データは各フルスクリーン表
示後、上記ＶＧＡコントローラにより上記ラスタライザ
・エンジンに供給されることを特徴とする、請求項１２
に記載の方法。 - 【請求項１４】上記ＶＧＡ画像は最終的なスクリーンの
解像度に合致するように上記ラスタライザ・エンジンに
よって大きさを調整されることを特徴とする、請求項１
３に記載の方法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US63609296A | 1996-04-22 | 1996-04-22 | |
| US08/636092 | 1996-04-22 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH1055160A true JPH1055160A (ja) | 1998-02-24 |
| JP3297344B2 JP3297344B2 (ja) | 2002-07-02 |
Family
ID=24550396
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP08650597A Expired - Fee Related JP3297344B2 (ja) | 1996-04-22 | 1997-04-04 | グラフィックス表示アダプタ |
Country Status (6)
| Country | Link |
|---|---|
| JP (1) | JP3297344B2 (ja) |
| KR (1) | KR100288662B1 (ja) |
| CN (1) | CN1114855C (ja) |
| GB (1) | GB2312601B (ja) |
| HK (1) | HK1005387A1 (ja) |
| TW (1) | TW319866B (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN102609231A (zh) * | 2012-02-22 | 2012-07-25 | 中国人民解放军国防科学技术大学 | 基于飞腾处理器平台的多显示屏输出方法 |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100537884B1 (ko) * | 1998-01-21 | 2006-03-03 | 삼성전자주식회사 | 듀얼 스캔용 그래픽 카드 |
| CN104040501A (zh) * | 2011-12-26 | 2014-09-10 | 英特尔公司 | 显示控制器中断寄存器 |
| DE202017100448U1 (de) | 2017-01-27 | 2017-02-22 | Sheng-Fa Chen | Aufbau einer Warnsignalvorrichtung für ein Fahrzeug |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6242277A (ja) * | 1985-08-19 | 1987-02-24 | Fanuc Ltd | 画像処理装置 |
| US5388200A (en) * | 1990-12-21 | 1995-02-07 | Sun Microsystems, Inc. | Method and apparatus for writing directly to a frame buffer |
| KR0180577B1 (ko) * | 1993-12-16 | 1999-05-15 | 모리시다 요이치 | 멀티윈도우 장치 |
| US5500654A (en) * | 1993-12-27 | 1996-03-19 | Kabushiki Kaisha Toshiba | VGA hardware window control system |
-
1996
- 1996-08-08 TW TW085109638A patent/TW319866B/zh active
-
1997
- 1997-02-11 KR KR1019970003951A patent/KR100288662B1/ko not_active IP Right Cessation
- 1997-03-25 CN CN97104552A patent/CN1114855C/zh not_active Expired - Fee Related
- 1997-04-01 GB GB9706595A patent/GB2312601B/en not_active Expired - Fee Related
- 1997-04-04 JP JP08650597A patent/JP3297344B2/ja not_active Expired - Fee Related
-
1998
- 1998-05-25 HK HK98104498A patent/HK1005387A1/xx not_active IP Right Cessation
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN102609231A (zh) * | 2012-02-22 | 2012-07-25 | 中国人民解放军国防科学技术大学 | 基于飞腾处理器平台的多显示屏输出方法 |
| CN102609231B (zh) * | 2012-02-22 | 2014-12-31 | 中国人民解放军国防科学技术大学 | 基于飞腾处理器平台的多显示屏输出方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3297344B2 (ja) | 2002-07-02 |
| GB9706595D0 (en) | 1997-05-21 |
| KR970071364A (ko) | 1997-11-07 |
| CN1167941A (zh) | 1997-12-17 |
| HK1005387A1 (en) | 1999-01-08 |
| KR100288662B1 (ko) | 2001-05-02 |
| CN1114855C (zh) | 2003-07-16 |
| GB2312601B (en) | 2000-11-29 |
| TW319866B (ja) | 1997-11-11 |
| GB2312601A (en) | 1997-10-29 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |