JPH1023318A - 高速度カメラシステム - Google Patents
高速度カメラシステムInfo
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- JPH1023318A JPH1023318A JP8178903A JP17890396A JPH1023318A JP H1023318 A JPH1023318 A JP H1023318A JP 8178903 A JP8178903 A JP 8178903A JP 17890396 A JP17890396 A JP 17890396A JP H1023318 A JPH1023318 A JP H1023318A
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Abstract
(57)【要約】
【課題】 従来の高速度カメラシステムが持つ、分割さ
れた標準出力信号をモニターでみた時に動きが飛び飛び
になり、S/Nが悪いという問題点を解決し、動きの滑
らかなS/Nの良い標準速度信号を得る高速度カメラシ
ステムを提供することを目的とする。 【解決手段】 標準のM倍の走査速度で走査を行うM倍
速デジタルカメラ1の出力を、速度変換回路2により、
M個の分割標準信号にして出力する。M個の分割標準信
号のうち、標準速度同期信号と異なるフィールドに相当
する信号について、1水平期間離れた信号を加算するこ
とで、標準速度同期信号とフィールドを合わせた後、他
の標準速度同期信号と同一フィールドの信号と位相を合
わせて加算する。
れた標準出力信号をモニターでみた時に動きが飛び飛び
になり、S/Nが悪いという問題点を解決し、動きの滑
らかなS/Nの良い標準速度信号を得る高速度カメラシ
ステムを提供することを目的とする。 【解決手段】 標準のM倍の走査速度で走査を行うM倍
速デジタルカメラ1の出力を、速度変換回路2により、
M個の分割標準信号にして出力する。M個の分割標準信
号のうち、標準速度同期信号と異なるフィールドに相当
する信号について、1水平期間離れた信号を加算するこ
とで、標準速度同期信号とフィールドを合わせた後、他
の標準速度同期信号と同一フィールドの信号と位相を合
わせて加算する。
Description
【0001】
【発明の属する技術分野】本発明はテレビジョン放送に
於けるスローモーション画像を撮影する為の高速度カメ
ラシステムに関するものである。
於けるスローモーション画像を撮影する為の高速度カメ
ラシステムに関するものである。
【0002】
【従来の技術】近年、スポーツ中継等でスローモーショ
ン再生が頻繁に利用されるにあたり、より再生画像の動
きのなめらかさが要求され、標準のテレビジョン走査速
度より更に高速度で走査することにより、被写体の動き
情報をより多く撮影できる高速度カメラシステムの使用
も増加しつつある。
ン再生が頻繁に利用されるにあたり、より再生画像の動
きのなめらかさが要求され、標準のテレビジョン走査速
度より更に高速度で走査することにより、被写体の動き
情報をより多く撮影できる高速度カメラシステムの使用
も増加しつつある。
【0003】以下に、従来の高速度カメラシステムつい
て説明する。従来の高速度カメラシステムとしては特公
平5−54315号公報に記載されたものが知られてい
る。図9はこの従来の高速度カメラシステムのブロック
図を示すものである。図9において、1は標準の走査速
度の3倍で走査を行うデジタルテレビジョンカメラ(以
下3倍速カメラ)、2は速度変換回路、3は分割標準出
力a、4は分割標準出力b、5は分割標準出力cであ
る。図10は速度変換回路2のブロック図を示すもので
ある。図10において、16は3倍速信号、17は書き
込み/読みだし制御回路、18はフィールドメモリ(F
M1〜FM16)である。
て説明する。従来の高速度カメラシステムとしては特公
平5−54315号公報に記載されたものが知られてい
る。図9はこの従来の高速度カメラシステムのブロック
図を示すものである。図9において、1は標準の走査速
度の3倍で走査を行うデジタルテレビジョンカメラ(以
下3倍速カメラ)、2は速度変換回路、3は分割標準出
力a、4は分割標準出力b、5は分割標準出力cであ
る。図10は速度変換回路2のブロック図を示すもので
ある。図10において、16は3倍速信号、17は書き
込み/読みだし制御回路、18はフィールドメモリ(F
M1〜FM16)である。
【0004】以上のように構成された従来の高速度カメ
ラシステムについて、以下その動作について説明する。
ラシステムについて、以下その動作について説明する。
【0005】図11は従来の3倍速カメラシステムの速
度変換回路の動作を示すタイミング図である。まず、3
倍速カメラ1は外部からの標準速度の同期信号によりゲ
ンロック動作が行われており、標準のテレビジョン走査
速度の3倍の速度で走査を行う。3倍速カメラ1の出力
信号は標準の3倍速であるので、図11に示す様に標準
速度の1番目の奇数フィールド期間に、3倍速奇数フィ
ールド1信号1o、3倍速偶数フィールド1信号1e、
3倍速奇数フィールド2信号2oの3つの信号が連続し
て出力される。同様に標準速度の1番目の偶数フィール
ド期間には、3倍速偶数フィールド2信号2e、3倍速
奇数フィールド3信号3o、3倍速偶数フィールド3信
号3eが連続して出力される。3倍速カメラ1の出力は
速度変換回路2に入力され、3つの信号に分割されると
同時に標準速度信号に時間伸長される。3倍速信号を3
分割し、標準速度に時間伸長するには、図10に示す6
つのフィールドメモリ18を独立に書き込み/読みだし
制御を行うことで実現できる。図11に示すように、標
準速度奇数フィールド1期間に、1o信号をFM1に、
1e信号をFM2に、2o信号をFM3に各々3倍速で
書き込む。次に、標準速度偶数フィールド1期間に、F
M1、FM2、FM3の3つのフィールドメモリは標準
速度で読み出し動作を行う。それと同時に、2e信号を
FM4に、3o信号をFM5に、3e信号をFM6に書
き込む。次に標準速度奇数フィールド2期間で、FM
4、FM5、FM6は標準速度で読みだし動作を行う。
この時FM1、FM2、FM3のフィールドメモリは全
データの読み出しを終えているので、新たに書き込み動
作に入り、4o信号をFM1に、4e信号をFM2に、
5o信号をFM3に3倍速で書き込む。以上の様な動作
により、分割・時間伸長回路2出力として、図11に示
す分割標準信号a、分割標準信号b、分割標準信号cを
得る。
度変換回路の動作を示すタイミング図である。まず、3
倍速カメラ1は外部からの標準速度の同期信号によりゲ
ンロック動作が行われており、標準のテレビジョン走査
速度の3倍の速度で走査を行う。3倍速カメラ1の出力
信号は標準の3倍速であるので、図11に示す様に標準
速度の1番目の奇数フィールド期間に、3倍速奇数フィ
ールド1信号1o、3倍速偶数フィールド1信号1e、
3倍速奇数フィールド2信号2oの3つの信号が連続し
て出力される。同様に標準速度の1番目の偶数フィール
ド期間には、3倍速偶数フィールド2信号2e、3倍速
奇数フィールド3信号3o、3倍速偶数フィールド3信
号3eが連続して出力される。3倍速カメラ1の出力は
速度変換回路2に入力され、3つの信号に分割されると
同時に標準速度信号に時間伸長される。3倍速信号を3
分割し、標準速度に時間伸長するには、図10に示す6
つのフィールドメモリ18を独立に書き込み/読みだし
制御を行うことで実現できる。図11に示すように、標
準速度奇数フィールド1期間に、1o信号をFM1に、
1e信号をFM2に、2o信号をFM3に各々3倍速で
書き込む。次に、標準速度偶数フィールド1期間に、F
M1、FM2、FM3の3つのフィールドメモリは標準
速度で読み出し動作を行う。それと同時に、2e信号を
FM4に、3o信号をFM5に、3e信号をFM6に書
き込む。次に標準速度奇数フィールド2期間で、FM
4、FM5、FM6は標準速度で読みだし動作を行う。
この時FM1、FM2、FM3のフィールドメモリは全
データの読み出しを終えているので、新たに書き込み動
作に入り、4o信号をFM1に、4e信号をFM2に、
5o信号をFM3に3倍速で書き込む。以上の様な動作
により、分割・時間伸長回路2出力として、図11に示
す分割標準信号a、分割標準信号b、分割標準信号cを
得る。
【0006】このように、従来の高速度カメラシステム
は、高速度信号を複数の標準速度信号として取り扱うこ
とができるようなされたものである。スローモーション
出力を得るには、3つの分割標準信号a〜cをメモリ等
により、撮影時のフィールド順に並び直した上、1つの
信号に変換することで、通常の3分の1のスローモーシ
ョン出力得る。更に並び直した信号をVTR等に記録
し、VTRのスローモーション再生を行うことで更なる
スローモーション信号を得ることができる。
は、高速度信号を複数の標準速度信号として取り扱うこ
とができるようなされたものである。スローモーション
出力を得るには、3つの分割標準信号a〜cをメモリ等
により、撮影時のフィールド順に並び直した上、1つの
信号に変換することで、通常の3分の1のスローモーシ
ョン出力得る。更に並び直した信号をVTR等に記録
し、VTRのスローモーション再生を行うことで更なる
スローモーション信号を得ることができる。
【0007】
【発明が解決しようとする課題】しかしながら上記の従
来の構成では、3つの分割標準信号を各々標準の信号と
してモニターで見た場合、個々の信号においてはフィー
ルドが不連続であり、特に動きのある映像では、動きが
飛び飛びになり不自然になる。また、更に3倍速撮影時
はCCDの電荷の蓄積時間が3分の1になるので、3つ
の分割信号を標準の信号として見た場合、元々のS/N
が標準速度撮影時に比べて悪いという問題点を有してい
た。
来の構成では、3つの分割標準信号を各々標準の信号と
してモニターで見た場合、個々の信号においてはフィー
ルドが不連続であり、特に動きのある映像では、動きが
飛び飛びになり不自然になる。また、更に3倍速撮影時
はCCDの電荷の蓄積時間が3分の1になるので、3つ
の分割信号を標準の信号として見た場合、元々のS/N
が標準速度撮影時に比べて悪いという問題点を有してい
た。
【0008】本発明は上記従来の問題点を解決するもの
で、動きの違和感を低減し、S/Nの良い標準信号をも
出力する高速度カメラシステムを提供することを目的と
する。
で、動きの違和感を低減し、S/Nの良い標準信号をも
出力する高速度カメラシステムを提供することを目的と
する。
【0009】
【課題を解決するための手段】この目的を達成するため
に本発明の高速度カメラシステムは、速度変換回路のM
個の出力を各々1水平走査時間遅延させるM個の遅延手
段と、速度変換回路のM個の出力の内、標準のテレビジ
ョン同期信号と奇数フィールド、偶数フィールドの区別
において、同一フィールドである複数の信号の各々に遅
延手段への入力信号と遅延手段出力信号とを切り換えて
出力する選択回路と、標準のテレビジョン同期信号の奇
数フィールド、偶数フィールドの区別において異なるフ
ィールドである複数の信号の各々に遅延手段への入力信
号と遅延手段出力信号とを加算する第1の加算器と、複
数の選択回路の選択信号を発生する選択信号発生回路
と、複数の選択回路出力と複数の第1の加算器出力を加
算する第2の加算器とを備えることで、標準速度の同一
フィールド期間内に出力されるM個のフィールド信号か
ら、動きの違和感が少なく、S/Nを向上させた標準信
号を得ることができる。
に本発明の高速度カメラシステムは、速度変換回路のM
個の出力を各々1水平走査時間遅延させるM個の遅延手
段と、速度変換回路のM個の出力の内、標準のテレビジ
ョン同期信号と奇数フィールド、偶数フィールドの区別
において、同一フィールドである複数の信号の各々に遅
延手段への入力信号と遅延手段出力信号とを切り換えて
出力する選択回路と、標準のテレビジョン同期信号の奇
数フィールド、偶数フィールドの区別において異なるフ
ィールドである複数の信号の各々に遅延手段への入力信
号と遅延手段出力信号とを加算する第1の加算器と、複
数の選択回路の選択信号を発生する選択信号発生回路
と、複数の選択回路出力と複数の第1の加算器出力を加
算する第2の加算器とを備えることで、標準速度の同一
フィールド期間内に出力されるM個のフィールド信号か
ら、動きの違和感が少なく、S/Nを向上させた標準信
号を得ることができる。
【0010】
【発明の実施の形態】本発明のは、外部からの標準のテ
レビジョン同期信号によりゲンロックされており、標準
のテレビジョンのM倍(Mは任意の正の整数)の速度で
走査を行うM倍速デジタルテレビジョンカメラと、M倍
速デジタルテレビジョンカメラの出力信号を、M倍の走
査速度でのフィールド単位毎に分割し、各々を標準走査
速度に時間伸長し、M個の分割標準信号を同期させて出
力する速度変換回路と、M個の分割標準信号を各々標準
の1水平走査時間遅延させるM個の遅延手段と、M個の
分割標準信号の内、標準のテレビジョン同期信号と奇数
フィールドまたは偶数フィールドの区別において同一フ
ィールドである複数の分割標準信号を、個々に遅延手段
への入力信号と遅延手段の出力信号とを切り換えて出力
する選択回路と、M個の分割標準信号の内、標準のテレ
ビジョン同期信号と奇数フィールドまたは偶数フィール
ドの区別において異なるフィールドである複数の分割標
準信号を、個々に遅延手段への入力信号と遅延手段の出
力信号とを加算する第1の加算器と、複数の選択回路へ
の選択信号を発生する選択信号発生回路と、複数の選択
回路の出力と複数の第1の加算器の出力とを加算する第
2の加算器とを備えたものであり、標準の1フィールド
期間内に出力されるMフィールド分の信号のフィールド
を合わせて加算することで、動きの違和感が少なく、S
/Nの良い標準信号を得る。
レビジョン同期信号によりゲンロックされており、標準
のテレビジョンのM倍(Mは任意の正の整数)の速度で
走査を行うM倍速デジタルテレビジョンカメラと、M倍
速デジタルテレビジョンカメラの出力信号を、M倍の走
査速度でのフィールド単位毎に分割し、各々を標準走査
速度に時間伸長し、M個の分割標準信号を同期させて出
力する速度変換回路と、M個の分割標準信号を各々標準
の1水平走査時間遅延させるM個の遅延手段と、M個の
分割標準信号の内、標準のテレビジョン同期信号と奇数
フィールドまたは偶数フィールドの区別において同一フ
ィールドである複数の分割標準信号を、個々に遅延手段
への入力信号と遅延手段の出力信号とを切り換えて出力
する選択回路と、M個の分割標準信号の内、標準のテレ
ビジョン同期信号と奇数フィールドまたは偶数フィール
ドの区別において異なるフィールドである複数の分割標
準信号を、個々に遅延手段への入力信号と遅延手段の出
力信号とを加算する第1の加算器と、複数の選択回路へ
の選択信号を発生する選択信号発生回路と、複数の選択
回路の出力と複数の第1の加算器の出力とを加算する第
2の加算器とを備えたものであり、標準の1フィールド
期間内に出力されるMフィールド分の信号のフィールド
を合わせて加算することで、動きの違和感が少なく、S
/Nの良い標準信号を得る。
【0011】以下本発明の実施の形態について、図面を
用いて説明する。 (実施の形態1)図1は本発明の実施の形態1による高
速度カメラシステムの構成を示すブロック図である。図
1において1は3倍速カメラ、2は速度変換回路、3〜
5は分割され、標準走査速度に時間伸長され同期化した
分割標準信号(各々分割標準信号a〜cとする)、6は
1H遅延手段で、入力信号を標準走査速度での1水平走
査期間だけ遅延させる。7は選択回路、8は第1の加算
器、9は第2の加算器、10は選択信号発生回路、11
は係数器、12は標準出力Nである。
用いて説明する。 (実施の形態1)図1は本発明の実施の形態1による高
速度カメラシステムの構成を示すブロック図である。図
1において1は3倍速カメラ、2は速度変換回路、3〜
5は分割され、標準走査速度に時間伸長され同期化した
分割標準信号(各々分割標準信号a〜cとする)、6は
1H遅延手段で、入力信号を標準走査速度での1水平走
査期間だけ遅延させる。7は選択回路、8は第1の加算
器、9は第2の加算器、10は選択信号発生回路、11
は係数器、12は標準出力Nである。
【0012】図4は3倍速カメラ1のCCD部分での画
素構成を基にした動作原理を示す図面である。図4中の
入力a、入力b及び入力cは、各々分割標準信号a、分
割標準信号b、分割標準信号cに対応する。まず、図4
(a)は標準走査速度におけるフィールドが偶数フィー
ルドの場合を示している。なお、図11でもわかるよう
に、3倍速カメラ1の出力信号は、速度変換回路2に一
旦書き込まれた後に読みだされる為、標準速度の1フィ
ールド分遅延されて出力される。従って、標準速度奇数
フィールド1で書き込まれた3倍速カメラ1の信号は、
標準速度偶数フィールド1で読みだされるので、入力a
は3倍速奇数フィールド1、入力bは3倍速偶数フィー
ルド1、入力cは3倍速奇数フィールド2になる。入力
a及び入力cはどちらも奇数フィールドであるので、標
準走査速度のフィールドに合わない為、そのまま加算す
ると、インターレス関係が崩れ映像が垂直方向にずれた
様になる。入力bについては、偶数フィールドであるの
で問題ない。従って、入力a、入力cについては、1水
平走査期間離れた2つの信号を加算し、空間的に偶数フ
ィールドの位置に合う信号にした上で、入力bと加算す
る。
素構成を基にした動作原理を示す図面である。図4中の
入力a、入力b及び入力cは、各々分割標準信号a、分
割標準信号b、分割標準信号cに対応する。まず、図4
(a)は標準走査速度におけるフィールドが偶数フィー
ルドの場合を示している。なお、図11でもわかるよう
に、3倍速カメラ1の出力信号は、速度変換回路2に一
旦書き込まれた後に読みだされる為、標準速度の1フィ
ールド分遅延されて出力される。従って、標準速度奇数
フィールド1で書き込まれた3倍速カメラ1の信号は、
標準速度偶数フィールド1で読みだされるので、入力a
は3倍速奇数フィールド1、入力bは3倍速偶数フィー
ルド1、入力cは3倍速奇数フィールド2になる。入力
a及び入力cはどちらも奇数フィールドであるので、標
準走査速度のフィールドに合わない為、そのまま加算す
ると、インターレス関係が崩れ映像が垂直方向にずれた
様になる。入力bについては、偶数フィールドであるの
で問題ない。従って、入力a、入力cについては、1水
平走査期間離れた2つの信号を加算し、空間的に偶数フ
ィールドの位置に合う信号にした上で、入力bと加算す
る。
【0013】図4において、0Hが示す信号を現在の入
力信号とすると、1Hが示す信号は1水平期間前の信
号、2Hが示す信号は2水平期間前の信号である。ま
た、図4中、フォトダイオードの位置を記号□、フォト
ダイオードミックスによる実際の信号の位置を記号○で
示す。図4(a)に示す様に、インターレスの位相関係
を考慮すると、入力aを(0H+1H)した信号は、図
中P1で示す偶数フィールド位相の信号となる。同様に
入力cについても(0H+1H)した信号はP2に示す
偶数フィールド位相の信号となる。P1及びP2信号は
入力bの0H信号に相当する。従って、入力bの0H信
号と、P1信号と、P2信号とを加算しても垂直方向の
映像のずれは起こらない。3つの信号を加算した後、ゲ
インを合わせる為、係数器11により5分の1すること
で、3フィールド分の信号を加算した標準走査速度信号
(標準出力N)を得る。
力信号とすると、1Hが示す信号は1水平期間前の信
号、2Hが示す信号は2水平期間前の信号である。ま
た、図4中、フォトダイオードの位置を記号□、フォト
ダイオードミックスによる実際の信号の位置を記号○で
示す。図4(a)に示す様に、インターレスの位相関係
を考慮すると、入力aを(0H+1H)した信号は、図
中P1で示す偶数フィールド位相の信号となる。同様に
入力cについても(0H+1H)した信号はP2に示す
偶数フィールド位相の信号となる。P1及びP2信号は
入力bの0H信号に相当する。従って、入力bの0H信
号と、P1信号と、P2信号とを加算しても垂直方向の
映像のずれは起こらない。3つの信号を加算した後、ゲ
インを合わせる為、係数器11により5分の1すること
で、3フィールド分の信号を加算した標準走査速度信号
(標準出力N)を得る。
【0014】同様に図4(b)は標準走査速度の奇数フ
ィールドの場合である。入力a、入力cは偶数フィール
ドであるのに対し、入力bは奇数フィールドである。入
力aを(0H+1H)した信号は、図中Q1で示す奇数
フィールド位相の信号となり、入力cを(0H+1H)
した信号は図中Q2で示す奇数フィールド信号となり、
入力bの1H信号に相当する。従って、Q1信号と、入
力bの1H信号と、Q2信号とを加算しても、垂直方向
の映像のずれは起こらない。
ィールドの場合である。入力a、入力cは偶数フィール
ドであるのに対し、入力bは奇数フィールドである。入
力aを(0H+1H)した信号は、図中Q1で示す奇数
フィールド位相の信号となり、入力cを(0H+1H)
した信号は図中Q2で示す奇数フィールド信号となり、
入力bの1H信号に相当する。従って、Q1信号と、入
力bの1H信号と、Q2信号とを加算しても、垂直方向
の映像のずれは起こらない。
【0015】このように、M倍速走査においてMが奇数
の時は、標準走査速度の奇数フィールドと偶数フィール
ドでは、入力a、入力b、入力c各々に入力される信号
のフィールドが反転しているので、正確に加算処理を行
う為には、第2の加算器9に入力する選択回路7の出力
を偶数フィールドでは0H、奇数フィールドでは1Hと
いうように切り換える必要がある。選択信号発生回路1
0はこの切り変え動作を担う制御回路で、標準速度のフ
ィールド単位で、選択回路7の出力を切り換える。この
ようにして3つの3倍速フィールド信号を、標準の走査
速度でのフィールドに合わせて加算することで、従来に
比べS/Nがよく、動きに違和感のない、標準速度信号
を得る。
の時は、標準走査速度の奇数フィールドと偶数フィール
ドでは、入力a、入力b、入力c各々に入力される信号
のフィールドが反転しているので、正確に加算処理を行
う為には、第2の加算器9に入力する選択回路7の出力
を偶数フィールドでは0H、奇数フィールドでは1Hと
いうように切り換える必要がある。選択信号発生回路1
0はこの切り変え動作を担う制御回路で、標準速度のフ
ィールド単位で、選択回路7の出力を切り換える。この
ようにして3つの3倍速フィールド信号を、標準の走査
速度でのフィールドに合わせて加算することで、従来に
比べS/Nがよく、動きに違和感のない、標準速度信号
を得る。
【0016】なお、高速度カメラの走査速度が、標準の
偶数倍(M=偶数)の場合も、同様な考え方で、標準走
査信号を得る、図7はM=2(偶数)の時の動作原理を
示す図面である。図7(a)は、標準走査速度における
偶数フィールド時の加算処理を示す。入力aは奇数フィ
ールド信号であるので、そのまま加算を行うが、入力b
は偶数フィールド信号であるので、(0H+1H)によ
り図中Rで示す奇数フィールドデータを求め加算するこ
とで映像の垂直ずれは起こらない。図7(b)に示す奇
数フィールド時も同様である。
偶数倍(M=偶数)の場合も、同様な考え方で、標準走
査信号を得る、図7はM=2(偶数)の時の動作原理を
示す図面である。図7(a)は、標準走査速度における
偶数フィールド時の加算処理を示す。入力aは奇数フィ
ールド信号であるので、そのまま加算を行うが、入力b
は偶数フィールド信号であるので、(0H+1H)によ
り図中Rで示す奇数フィールドデータを求め加算するこ
とで映像の垂直ずれは起こらない。図7(b)に示す奇
数フィールド時も同様である。
【0017】以上の様に、本実施の形態によれば、分割
されたM個の分割標準信号をフィールドを合わせて加算
することで、動画部分の不自然さを解消し、S/N劣化
の少ない標準走査速度映像信号を得ることができる。
されたM個の分割標準信号をフィールドを合わせて加算
することで、動画部分の不自然さを解消し、S/N劣化
の少ない標準走査速度映像信号を得ることができる。
【0018】(実施の形態2)図2は本発明の実施の形
態2による高速度カメラシステムの構成を示すブロック
図である。図2において、分割標準信号から標準走査速
度信号を得る演算処理に関わる構成が、実施の形態1と
相違する。
態2による高速度カメラシステムの構成を示すブロック
図である。図2において、分割標準信号から標準走査速
度信号を得る演算処理に関わる構成が、実施の形態1と
相違する。
【0019】図5は本実施の形態における高速度カメラ
システムの動作を表すタイミング図である。以下にその
動作について説明する。
システムの動作を表すタイミング図である。以下にその
動作について説明する。
【0020】実施の形態1の場合、標準信号を得るには
3つの分割標準信号のうち2つについて(0H+1H)
という演算を行う必要がある。この演算は垂直方向にロ
ーパスフィルターをかけたことに等しく、垂直方向の周
波数特性が悪くなる。これを改善する為に、3倍速カメ
ラ1の出力信号のフィールドを反転することで、3つの
分割標準信号のうち1つだけに(0H+1H)という演
算を行うだけで、3つの分割標準信号のフィールドを合
わせることができる。
3つの分割標準信号のうち2つについて(0H+1H)
という演算を行う必要がある。この演算は垂直方向にロ
ーパスフィルターをかけたことに等しく、垂直方向の周
波数特性が悪くなる。これを改善する為に、3倍速カメ
ラ1の出力信号のフィールドを反転することで、3つの
分割標準信号のうち1つだけに(0H+1H)という演
算を行うだけで、3つの分割標準信号のフィールドを合
わせることができる。
【0021】図5に示す様に、標準速度奇数フィールド
において出力されるカメラ出力を偶数フィールドから始
めることにより、速度変換回路2の3つの分割標準信号
出力は、標準速度偶数フィールドにおいては、3倍速偶
数フィールド1e、3倍速奇数フィールド1o、3倍速
偶数フィールド2eとなる。この時のライン加算回路の
動作を図6(a)に示す。入力a及び入力cは偶数フィ
ールド信号であるので、何等処理する必要はない。入力
bについては奇数フィールド信号であるので、(0H+
1H)という演算によりQという偶数フィールド信号を
求め、入力a及び入力cの0H信号に加算する。同様に
標準奇数フィールドについても、図6(b)に示すよう
に、入力bのみを(0H+1H)して、奇数フィールド
信号Pを求め、入力a及び入力cの1H信号と加算す
る。この場合、選択信号発生回路10は、入力a及び入
力cについて0Hと1Hを切り換えて出力するよう動作
する。なお、係数機11は、8分の1にするものとす
る。
において出力されるカメラ出力を偶数フィールドから始
めることにより、速度変換回路2の3つの分割標準信号
出力は、標準速度偶数フィールドにおいては、3倍速偶
数フィールド1e、3倍速奇数フィールド1o、3倍速
偶数フィールド2eとなる。この時のライン加算回路の
動作を図6(a)に示す。入力a及び入力cは偶数フィ
ールド信号であるので、何等処理する必要はない。入力
bについては奇数フィールド信号であるので、(0H+
1H)という演算によりQという偶数フィールド信号を
求め、入力a及び入力cの0H信号に加算する。同様に
標準奇数フィールドについても、図6(b)に示すよう
に、入力bのみを(0H+1H)して、奇数フィールド
信号Pを求め、入力a及び入力cの1H信号と加算す
る。この場合、選択信号発生回路10は、入力a及び入
力cについて0Hと1Hを切り換えて出力するよう動作
する。なお、係数機11は、8分の1にするものとす
る。
【0022】以上の様に本実施の形態によれば、3倍速
カメラ1出力のフィールドを外部からの標準の同期信号
におけるフィールドと反転させることで、実施の形態1
に比べ、ローパスフィルター成分を少なくし、垂直方向
の周波数特性を改善することができる。また、前述した
ように、図10に示す速度変換回路では、外部からの標
準のテレビジョン同期信号に対して分割標準信号のフィ
ールドが反転する。従って、同期合わせの為、3つの分
割標準信号を1フィールド遅延させる為のフィールドメ
モリを外部に必要としていたが、本実施例によれば、3
倍速カメラ1出力のフィールドが反転しているので、外
部にフィールドメモリを必要とせずに、同期合わせを行
うことができる。
カメラ1出力のフィールドを外部からの標準の同期信号
におけるフィールドと反転させることで、実施の形態1
に比べ、ローパスフィルター成分を少なくし、垂直方向
の周波数特性を改善することができる。また、前述した
ように、図10に示す速度変換回路では、外部からの標
準のテレビジョン同期信号に対して分割標準信号のフィ
ールドが反転する。従って、同期合わせの為、3つの分
割標準信号を1フィールド遅延させる為のフィールドメ
モリを外部に必要としていたが、本実施例によれば、3
倍速カメラ1出力のフィールドが反転しているので、外
部にフィールドメモリを必要とせずに、同期合わせを行
うことができる。
【0023】(実施の形態3)図3は、本発明の実施の
形態3による高速度カメラシステムの構成を示すブロッ
ク図である。図3において、13は任意の係数α倍する
係数器、14は任意の係数β倍する係数器、15は任意
の係数γ倍する係数器である。図8は、標準の場合、実
施の形態2の場合、及び、実施の形態3の場合の垂直方
向の周波数特性を示す図である。図8(b)に示す様
に、通常の周波数特性はCCDの2画素ミックス動作か
ら、その周波数特性は1+Z-1で表される。また図8
(c)に示す様に、実施の形態2記載の方法による周波
数特性は、各係数α=β=γ=1であるので、1+3Z
-1+3Z-2+Z-3に示す特性となる。図8(d)は、α
=γ=3、β=1の係数をかけ、垂直方向の周波数特性
の劣化を改善したものである。この場合周波数特性は1
+7Z-1+7Z-2+Z-3で表される。そして、図8
(a)に各々の場合の周波数特性を示す。本実施の形態
に示す様にフィルタ特性を適切に選択することで、実施
の形態2に比較し大幅に垂直方向の周波数特性を改善す
ることができる。
形態3による高速度カメラシステムの構成を示すブロッ
ク図である。図3において、13は任意の係数α倍する
係数器、14は任意の係数β倍する係数器、15は任意
の係数γ倍する係数器である。図8は、標準の場合、実
施の形態2の場合、及び、実施の形態3の場合の垂直方
向の周波数特性を示す図である。図8(b)に示す様
に、通常の周波数特性はCCDの2画素ミックス動作か
ら、その周波数特性は1+Z-1で表される。また図8
(c)に示す様に、実施の形態2記載の方法による周波
数特性は、各係数α=β=γ=1であるので、1+3Z
-1+3Z-2+Z-3に示す特性となる。図8(d)は、α
=γ=3、β=1の係数をかけ、垂直方向の周波数特性
の劣化を改善したものである。この場合周波数特性は1
+7Z-1+7Z-2+Z-3で表される。そして、図8
(a)に各々の場合の周波数特性を示す。本実施の形態
に示す様にフィルタ特性を適切に選択することで、実施
の形態2に比較し大幅に垂直方向の周波数特性を改善す
ることができる。
【0024】なお、以上の実施の形態において、M=2
または3の場合について述べたが、本発明は、これに限
定されるものではなく、M(任意の正の整数)に合わせ
て、遅延手段、選択回路を必要数備えればよい。
または3の場合について述べたが、本発明は、これに限
定されるものではなく、M(任意の正の整数)に合わせ
て、遅延手段、選択回路を必要数備えればよい。
【0025】
【発明の効果】以上のように本発明は、速度変換回路の
出力のM個の分割標準信号を各々1水平走査時間遅延さ
せるM個の遅延手段と、M個の分割標準信号の内、標準
のテレビジョン同期信号と奇数または偶数フィールドの
区別において同一フィールドである複数の分割標準信号
の各々に遅延手段への入力信号と遅延手段出力信号とを
切り換えて出力する選択回路と、標準のテレビジョン同
期信号と奇数または偶数フィールドの区別において異な
るフィールドである複数の分割標準信号の各々に遅延手
段への入力信号と遅延手段出力信号とを加算する第1の
加算器と、複数の選択回路の選択信号を発生する選択信
号発生回路と、複数の選択回路出力と複数の第1の加算
器出力を加算する第2の加算器とを備えることで、動き
の違和感が少ない、かつS/Nの良い標準走査速度映像
信号を得ることができる。
出力のM個の分割標準信号を各々1水平走査時間遅延さ
せるM個の遅延手段と、M個の分割標準信号の内、標準
のテレビジョン同期信号と奇数または偶数フィールドの
区別において同一フィールドである複数の分割標準信号
の各々に遅延手段への入力信号と遅延手段出力信号とを
切り換えて出力する選択回路と、標準のテレビジョン同
期信号と奇数または偶数フィールドの区別において異な
るフィールドである複数の分割標準信号の各々に遅延手
段への入力信号と遅延手段出力信号とを加算する第1の
加算器と、複数の選択回路の選択信号を発生する選択信
号発生回路と、複数の選択回路出力と複数の第1の加算
器出力を加算する第2の加算器とを備えることで、動き
の違和感が少ない、かつS/Nの良い標準走査速度映像
信号を得ることができる。
【0026】更に、M倍速デジタルカメラ出力のフィー
ルド状態を、外部からの標準のテレビジョン同期信号の
フィールドと反転することで、第2の加算器出力である
標準走査速度映像信号の垂直方向の周波数特性を改善し
画質を向上することができる。 また、第2の加算器入
力前段の各々に任意の係数倍する係数器を設けること
で、更に垂直方向の周波数特性を向上した標準速度映像
信号を得ることができる。
ルド状態を、外部からの標準のテレビジョン同期信号の
フィールドと反転することで、第2の加算器出力である
標準走査速度映像信号の垂直方向の周波数特性を改善し
画質を向上することができる。 また、第2の加算器入
力前段の各々に任意の係数倍する係数器を設けること
で、更に垂直方向の周波数特性を向上した標準速度映像
信号を得ることができる。
【図1】本発明の実施の形態1による高速度カメラシス
テムの構成を示すブロック図
テムの構成を示すブロック図
【図2】同実施の形態2による高速度カメラシステムの
構成を示すブロック図
構成を示すブロック図
【図3】同実施の形態3による高速度カメラシステムの
構成を示すブロック図
構成を示すブロック図
【図4】同実施の形態1による高速度カメラシステムの
動作原理を示す図
動作原理を示す図
【図5】同実施の形態2による高速度カメラシステムの
動作を示すタイミング図
動作を示すタイミング図
【図6】同高速度カメラシステムの動作原理を示す図
【図7】本発明の実施の形態2におけるMが偶数の時の
ライン加算の原理図
ライン加算の原理図
【図8】本発明の実施の形態3における垂直方向の周波
数特性を示す特性図
数特性を示す特性図
【図9】従来の高速度カメラシステムの構成を示すブロ
ック図
ック図
【図10】同高速度カメラシステムの速度変換回路の動
作を示すタイミング図
作を示すタイミング図
【図11】同高速度カメラシステムにおける速度変換回
路を示すブロック図
路を示すブロック図
1 M倍速デジタテレビジョンカメラ 2 速度変換回路 3〜5 分割標準信号 6 遅延手段 7 選択回路 8 第1の加算器 9 第2の加算器 10 選択信号発生回路 11 係数器 12 標準出力 13 任意のα倍する係数器 14 任意のβ倍する係数器 15 任意のγ倍する係数器 16 M倍速信号 17 書き込み/読みだし制御回路 18 フィールドメモリ
Claims (3)
- 【請求項1】 外部からの標準のテレビジョン同期信号
によりゲンロックされており、標準のテレビジョンのM
倍(Mは任意の正の整数)の速度で走査を行うM倍速デ
ジタルテレビジョンカメラと、 前記M倍速デジタルテレビジョンカメラの出力信号を、
M倍の走査速度でのフィールド単位毎に分割し、各々を
標準走査速度に時間伸長し、M個の分割標準信号を同期
させて出力する速度変換回路と、 前記M個の分割標準信号を各々標準の1水平走査時間遅
延させるM個の遅延手段と、 前記M個の分割標準信号の内、前記標準のテレビジョン
同期信号と奇数フィールドまたは偶数フィールドの区別
において同一フィールドである複数の分割標準信号を、
個々に前記遅延手段への入力信号と前記遅延手段の出力
信号とを切り換えて出力する選択回路と、 前記M個の分割標準信号の内、前記標準のテレビジョン
同期信号と奇数フィールドまたは偶数フィールドの区別
において異なるフィールドである複数の分割標準信号
を、個々に前記遅延手段への入力信号と前記遅延手段の
出力信号とを加算する第1の加算器と、 前記複数の選択回路への選択信号を発生する選択信号発
生回路と、 前記複数の選択回路の出力と前記複数の第1の加算器の
出力とを加算する第2の加算器とを備えた高速度カメラ
システム。 - 【請求項2】 M倍速デジタルテレビジョンカメラの出
力の奇数フィールド、偶数フィールドの状態を、外部か
らの標準のテレビジョン同期信号のフィールドに対して
反転することを特徴とする請求項1記載の高速度カメラ
システム。 - 【請求項3】 複数の第1の加算器の出力と複数の選択
回路の出力を各々任意の係数倍するM個の係数器を有す
ることを特徴とする請求項1または2に記載の高速度カ
メラシステム。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17890396A JP3237527B2 (ja) | 1996-07-09 | 1996-07-09 | 高速度カメラシステム |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17890396A JP3237527B2 (ja) | 1996-07-09 | 1996-07-09 | 高速度カメラシステム |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH1023318A true JPH1023318A (ja) | 1998-01-23 |
JP3237527B2 JP3237527B2 (ja) | 2001-12-10 |
Family
ID=16056708
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP17890396A Expired - Fee Related JP3237527B2 (ja) | 1996-07-09 | 1996-07-09 | 高速度カメラシステム |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3237527B2 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2003085969A1 (fr) * | 2002-04-04 | 2003-10-16 | Sony Corporation | Systeme d'enregistrement d'image captee, dispositif d'enregistrement de signal et procede d'enregistrement de signal |
US7411617B2 (en) | 2002-08-16 | 2008-08-12 | Sony Corporation | Image processing apparatus, image processing method, recording medium, and program |
US8125532B2 (en) | 2005-09-08 | 2012-02-28 | Sony Corporation | Video signal capturing apparatus, signal processing and control apparatus, and video signal capturing, video signal processing, and transferring system and method |
-
1996
- 1996-07-09 JP JP17890396A patent/JP3237527B2/ja not_active Expired - Fee Related
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2003085969A1 (fr) * | 2002-04-04 | 2003-10-16 | Sony Corporation | Systeme d'enregistrement d'image captee, dispositif d'enregistrement de signal et procede d'enregistrement de signal |
US7406253B2 (en) | 2002-04-04 | 2008-07-29 | Sony Corporation | Picked up image recording system, signal recording device, and signal recording method |
US7411617B2 (en) | 2002-08-16 | 2008-08-12 | Sony Corporation | Image processing apparatus, image processing method, recording medium, and program |
US8125532B2 (en) | 2005-09-08 | 2012-02-28 | Sony Corporation | Video signal capturing apparatus, signal processing and control apparatus, and video signal capturing, video signal processing, and transferring system and method |
TWI386038B (zh) * | 2005-09-08 | 2013-02-11 | Sony Corp | 視訊信號擷取裝置,信號處理及控制裝置,和視訊信號擷取,視訊信號處理及轉換系統及方法 |
US8564685B2 (en) | 2005-09-08 | 2013-10-22 | Sony Corporation | Video signal capturing apparatus, signal processing and control apparatus, and video signal capturing, video signal processing, and transferring system and method |
EP1763224B1 (en) * | 2005-09-08 | 2013-11-27 | Sony Corporation | Video signal processing in a camera control unit |
Also Published As
Publication number | Publication date |
---|---|
JP3237527B2 (ja) | 2001-12-10 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
LAPS | Cancellation because of no payment of annual fees |