JPH10191191A - 映像表示装置 - Google Patents

映像表示装置

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JPH10191191A
JPH10191191A JP8348453A JP34845396A JPH10191191A JP H10191191 A JPH10191191 A JP H10191191A JP 8348453 A JP8348453 A JP 8348453A JP 34845396 A JP34845396 A JP 34845396A JP H10191191 A JPH10191191 A JP H10191191A
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signal
video
line
display device
video signal
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JP8348453A
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Toshimitsu Watanabe
敏光 渡辺
Masahisa Tsukahara
正久 塚原
Nobuaki Kabuto
展明 甲
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Hitachi Ltd
Hitachi Advanced Digital Inc
Original Assignee
Hitachi Ltd
Hitachi Video and Information System Inc
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Publication date
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Abstract

(57)【要約】 【課題】 複数の異なる方式の映像信号による同一画面
での映像表示を、垂直方向の解像度の劣化を皆無にし
て、行なうことができるようにする。 【解決手段】 入力端子１１，１２からのインターレー
ス映像信号は、倍速変換回路１７でライン周期が１／２
倍に圧縮されるとともに、２回ずつ同じ映像内容のライ
ンが繰り返され、このように変換された映像信号がブラ
ウン管３９〜４１に供給されて映像表示される。この場
合、各フィールドで同じ映像内容のライン走査が２度繰
り返えされるが、増幅器３６〜３８からのコンバーゼン
ス補正信号により、同じ情報内容の２つのラインが重な
るようにコンバーゼンス補正が掛けられてインターレー
ス走査がなされ、高画質の映像が得られる。ＰＣ処理回
路６からのノンインターレースの映像信号で映像表示す
る場合には、ブラウン管３９〜４１で順次走査が行なわ
れ、忠実な映像表示がなされる。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、スキャン周波数の
異なる複数の映像信号、例えば、ＮＴＳＣ方式の映像信
号と、パーソナルコンピュータ（以下、パソコンまたは
ＰＣという）の出力映像信号などを表示する映像表示装
置やディスプレイ装置，テレビジョン受像機に適用して
好適な信号表示方式に関する。
【０００２】
【従来の技術】近年、パソコンなどの機器の普及が進
み、一般家庭においても、テレビジョン受像機にパソコ
ン用の信号表示を行なうことが重要視されるようになっ
てきた。しかしながら、テレビジョン受像機の水平偏向
周波数は、例えば、ＮＴＳＣ方式の場合には、１５．７
５ｋＨｚであり、これに対し、パソコンなどでは、一般
的に、３１．５ｋＨｚ以上が使用される。
【０００３】そこで、両者の映像信号を表示するため
に、ＮＴＳＣ方式の映像信号（以下、ＮＴＳＣ信号とい
う）を倍速変換することが考えられる。この倍速変換の
方法として、特公平６−１４６８９号公報に記載されて
いる方式がある。これは、ＮＴＳＣ信号を倍速変換し、
通常の偏向周波数の２倍の周波数でノンインターレース
の水平偏向が行なわれ、同一の映像信号が２回ずつ表示
されるようにした映像表示装置において、垂直偏向装置
に垂直偏向切替手段を設け、表示される映像信号が静止
画像の場合には、この垂直偏向切替え手段により、電子
ビームが同一ライン上を同一の映像信号で２度づつ走査
するように切り替えるようにした方式である。
【０００４】
【発明が解決しようとする課題】上記従来の映像表示装
置は、ＮＴＳＣ信号の倍速表示に対応しているだけであ
り、パソコンなどの信号入力及びパソコン側で倍速処理
されたＮＴＳＣ信号の扱いに対しては考慮されていな
い。
【０００５】例えば、図８において、映像信号がパソコ
ンから出力されて表示を行なう場合には、パソコンでの
ＮＴＳＣ信号の処理は、パソコンの出力する走査周波数
に合わせたライン倍速処理であるにもかかわらず、パソ
コンでは、順次走査方式の走査線を出力しているため、
垂直偏向での補助偏向走査を行なうことができない。従
って、図８において、画面の内側に表示される映像信号
（映像ａ）は垂直解像度が劣化した状態で表示されるこ
とになる。逆に、強制的に補助偏向走査を行なった場合
には、映像ａは問題なく表示されるが、この画面の外側
に表示される映像信号（映像ｂ）は、文字などを解読で
きない状態となる。これは、図９に示すような、パソコ
ンでＮＴＳＣ信号を処理されたフルサイズの映像信号
（映像ｃ）を表示する場合でも同様であり、補助偏向走
査の必要性の有無は信号では判断できないため、何らか
の解決手段が必要となる。
【０００６】本発明の目的は、かかる問題を解消し、方
式が異なる映像信号の映像を同じ画面で表示する場合、
垂直解像度の劣化を防止することができるようにした映
像表示装置を提供することにある。
【０００７】
【課題を解決するための手段】上記目的を達成するため
に、本発明は、図８に示すように、映像信号を表示する
場合には、映像ａでは走査部分と、映像ｂでの走査部分
を判別する信号をパソコン側で発生させる。ディスプレ
イ側では、この判別信号に基づき、走査領域に応じて、
映像ａ部において、垂直偏向での補助偏向走査を実施す
ることにより解決できる。また、図９における映像ｃの
表示を行なう場合でも、パソコン側から判別信号を送る
ことにより、解像度性能に優れたディスプレイシステム
を構成することができる。
【０００８】
【発明の実施の形態】以下、本発明の実施形態を図面を
用いて説明する。図１は投写方式のブラウン管ディスプ
レイ装置に適用した本発明による映像表示装置の第１の
実施形態を示すブロック図である。
【０００９】同図において、この実施形態は、パソコン
などの信号発生装置を構成する装置１０とディスプレイ
部を構成する装置５１とにより構成されている。
【００１０】装置１０は、アンテナ入力端子１，チュー
ナ２，スイッチ３，外部ビデオ入力端子４，倍速処理回
路５，ＰＣ処理回路６，出力切換回路９９，判別信号出
力端子７，同期信号出力端子８及びＲＧＢ信号出力端子
９から構成されている。
【００１１】また、装置５１は、外部ビデオ入力端子１
１、アンテナ入力端子１２、チューナ１３、スイッチ１
４、倍速処理回路１９、信号選択スイッチ２０、外部Ｒ
ＧＢ入力端子２１、増幅器２２、外部同期信号入力端子
２３、判別信号入力端子２４、同期信号選択スイッチ２
５、同期分離回路２６、水平同期倍速変換回路２７、カ
ウンタ２８、垂直偏向回路２９、水平偏向回路３０、制
御スイッチ３１、コンバーゼンス補正波形発生回路３
２、加算器３３〜３５、駆動回路３６〜３８、Ｒ，Ｇ，
Ｂブラウン管３９，４０，４１、垂直偏向コイル４２〜
４４、水平偏向コイル４５〜４７及びコンバーゼンスコ
イル４８〜５０から構成されている。なお、倍速処理回
路１９は、Ｙ／Ｃ分離回路１５，色復調回路１６，倍速
変換回路１７及びマトリクス回路１８から構成されてい
る。
【００１２】初めに、装置５１の動作を図２及び図３を
用いて説明し、次に、装置１０と装置５１とを組み合わ
せた場合の動作を図４及び、図５を用いて説明する。
【００１３】まず、装置５１について、アンテナ端子１
２から入力されるＲＦ信号は、チューナ１３により、ビ
デオ信号（例えば、ＮＴＳＣ信号など）に変換される。
このビデオ信号と外部入力端子１１から入力されてビデ
オ信号はスイッチ１４により選択され、Ｙ／Ｃ分離回路
１５及び同期分離回路２６に供給される。
【００１４】Ｙ／Ｃ分離後の色（Ｃ）信号は、色復調回
路１６により、２つの色差信号Ｒ−Ｙ，Ｂ−Ｙに分離さ
れる。これら色差信号と輝度（Ｙ）信号は、倍速変換回
路１７により、水平走査期間が１／２に圧縮された倍速
信号となって２回出力される。輝度（Ｙ）信号を例にと
れば、図２において、波形６０が倍速変換回路１７の入
力輝度信号であり、倍速変換回路１７からは波形６２の
倍速輝度信号（Ｙ２）が出力される。色差信号も、同様
に、倍速色差信号（（Ｒ−Ｙ）２，（Ｂ−Ｙ）２）に変
換され、マトリクス回路１８により、倍速の原色信号
（Ｒ２，Ｇ２，Ｂ２）を得た後、信号選択スイッチ２０
を経て増幅器２２に供給され、ブラウン管３９，４０，
４１のカソード端子に加えられる。
【００１５】一方、同期分離回路２６から得られる水平
同期信号（Ｈ）は、倍速変換回路２７において、２倍の
周期の水平同期信号（Ｈ２）に変換される。図２の波形
６１は分離された水平同期信号を示し、波形６３は２倍
の周期の水平同期信号を示す。２倍の周期の水平同期信
号は、垂直同期信号（Ｖ）とともに、同期信号選択スイ
ッチ２５を経て垂直偏向回路２９，水平偏向回路３０に
夫々供給され、垂直偏向コイル４２，４３，４４、水平
偏向コイル４５，４６，４７を駆動する。
【００１６】この状態では、例えば、偶数フィールドに
おいては、図３（ａ）に示すように、走査線７１〜７６
となり、Ａ１，Ａ２，Ａ３を各２回ずつ順次走査する状
態となる。
【００１７】倍速変換された水平同期信号（Ｈ２）は、
カウンタ２８において、図２に波形６４として示すよう
に、２倍周期の矩形波を発生し、制御スイッチ３１を経
て、加算器３３〜３５において、コンバーゼンス補正波
形発生回路３２からの信号と加算された後、駆動回路３
６〜３８を通してコンバーゼンスコイル４８〜５０に加
えられる。その結果、図３（ａ）に示す走査線７２，７
４，７６は垂直方向に微少偏向されて、矢印７７，７
８，７９の方向に移動することができ、Ａｉ同士の走査
線を重ね合せることができる。
【００１８】同様に、奇数フィールドにおいては、図３
（ｂ）に示すように、走査線８１〜８５を得、微少な偏
向作用により、走査線８２，８４は矢印８６，８７の方
向に移動し、走査線８１，８３と重ね合せることにな
る。
【００１９】図３（ｃ）は偶数フィールドと奇数フィー
ルドを表示した場合を示すものであり、ＮＴＳＣなどの
インターレース表示に対応した走査線構造を忠実に再生
することができる。従って、ＮＴＳＣ信号などのビデオ
信号の画質を損なうことなく、映像を再生できる。
【００２０】次に、図１での装置１０と装置５１を接続
した場合の動作について説明する。装置１０はＮＴＳＣ
信号などのビデオ信号処理回路を搭載したパソコン（Ｐ
Ｃ）の例を示すものである。
【００２１】図１において、アンテナ入力端子１から入
力されたＲＦ信号はチューナ２でビデオ信号に変換さ
れ、スイッチ３により外部ビデオ端子４からの信号との
どちらかが選択され、倍速処理回路５において、水平走
査期間が１／２に圧縮された原色信号及び同期信号を得
る。これは、上記の倍速処理回路１９と同期信号の倍速
変換回路２７との機能と同一である。出力切換回路９９
は、倍速処理回路５側を選択した場合、ＲＧＢ信号出力
端子９から倍速ＲＧＢ信号が出力され、同期信号出力端
子８から倍速同期信号が出力され、判別信号出力端子７
から制御信号が出力される。
【００２２】判別信号出力端子７への制御信号は、例え
ば、判別信号入力端子２４が「Ｈ」レベルのときに、カ
ウンタ２８の出力信号が加算器３３〜３５へ出力される
ように、また、判別信号入力端子２４が「Ｌ」または開
放の場合には、カウンタ２８の出力を禁止するように制
御スイッチ３１の動作を設計する場合には、「Ｈ」レベ
ルに設定する。
【００２３】装置５１における選択スイッチ２０，２５
が外部ビデオ信号を選択した場合、図３（ｃ）に示すよ
うに、忠実なビデオ信号の表示を行なうことができる。
一方、出力切換回路９９がＰＣ処理回路６側を選択した
場合には、ＲＧＢ信号出力端子９からＰＣのＲＧＢ信号
が出力され、同期信号出力端子８にはＰＣの同期信号が
出力される。判別信号出力端子７には、制御信号として
「Ｌ」レベルを設定することにより、図４に示すＰＣの
同期信号に従った走査線１０１に示すように、Ｃ１〜Ｃ
８の順次走査の走査線構造となり、忠実な映像表示を行
なうことができる。
【００２４】装置５１は、判別信号出力端子７を有しな
いパソコンなどを接続する場合においても、判別信号入
力端子２４が開放となることにより、図４の順次走査の
走査線構造を得ることができ、忠実な映像表示を行なう
ことができる。
【００２５】図５は図１における装置１０の一具体例を
示すブロック図であって、図１に対応する部分には同一
符号をつけている。
【００２６】この具体例は、図６に示すように、画面９
０のＰＣ映像表示の中に小さな画面９１のＮＴＳＣ映像
を表示する場合の例を示すものである。以下、その動作
を説明する。
【００２７】アンテナ入力端子１から入力されたＲＦ信
号はチューナ２でビデオ信号に変換され、スイッチ３に
より、外部ビデオ入力端子４からのビデオ信号とのどち
らかが選択され、倍速処理回路５（倍速処理回路１９，
２７の機能と同一）において、水平走査期間が１／２に
圧縮された原色信号及び同期信号を得る。倍速処理回路
５の出力信号は、スケーリング回路１０２において、水
平垂直とも映像の表示を小さくなるように変換する。
【００２８】スケーリング処理された倍速ＲＧＢ信号
は、高速出力切換回路１０３を用いて、図６に示す表示
範囲９２，９３に相当する期間のみ選択し、それ以外の
期間では、ＰＣ処理回路６からの信号を選択する。この
とき、判別信号出力端子７への出力信号は、垂直表示期
間９２において、期間９３のときに「Ｈ」レベルとなる
波形９４を出力する。この結果、ＰＣの信号表示，ＮＴ
ＳＣの信号表示とも画質劣化の少ない状態を得ることが
できる。また、表示範囲９２，９３で示される範囲が非
常に小さい場合には、波形９４に従う微少な垂直偏向を
禁止する場合が必要となる。この場合には、使用者が任
意に解除できるように、制御スイッチ３１の構成を設定
してもよい。
【００２９】上記実施形態においては、装置５１の判別
信号入力端子２４の制御方法は、「Ｈ」，「Ｌ」レベル
による方式を例にとって説明したが、判別信号入力端子
２４と制御スイッチ３１との間にデコーダ回路などを設
け、装置１０の側から予め決められたエンコード信号を
送出する構成としてもよいことはいうでもない。
【００３０】図７は本発明による映像表示装置の第２の
実施形態を示すブロック図であって、図１に対応する部
分には同一符号をつけて重複する説明を省略する。
【００３１】図１において、通常、同期信号出力端子８
とＲＧＢ信号出力端子９からの各信号は１本のケーブル
で接続されることが多く、新たに判別信号出力端子７を
独立に設けることが困難であるケースが多い。
【００３２】この第２の実施形態はこれを解消するもの
であり、図７において、垂直偏向回路２９の構成とし
て、同期分離回路２６のリーディングエッジトリガから
垂直偏向動作を行なう構成とし、外部同期信号入力端子
２３とスイッチ２５との間に判別検出回路１０４を付加
する。また、装置１０において、同期信号出力端子８に
判別検出信号を付加する判別付加回路１０５を設ける。
この場合の装置１０の同期信号出力端子８から出力する
同期信号としては、例えば、垂直同期信号のパルス幅を
１Ｈないし２Ｈ程度長く設定する方法、垂直同期パルス
の直後に１Ｈの負パルスを付加することなどで判別可能
である。判別検出の結果を制御スイッチ３１に加えるこ
とにより、図３（ｃ）の映像と図４の映像とを切り換え
ることが可能である。
【００３３】図１０は図７における装置１０での倍速処
理回路５，出力切換回路９９及び判別付加１０５の一具
体例を示すブロック図である。また、図１１はこの具体
例での判別付加方式についての動作波形を示す図であ
る。
【００３４】入力端子１０６から入力された複合映像信
号は同期分離回路１０７に供給される。分離された映像
信号はＡ／Ｄ変換器１０８に供給されて１Ｈラインメモ
リ１１０に供給される。また、同期分離回路１０７から
出力される水平同期信号は、ＰＬＬ回路１０９におい
て、同期信号にロックされたクロック信号（ラインロッ
ククロック）を発生する。このラインロッククロック
は、例えば、９１０クロックで１水平周期となるように
設定される。ＰＬＬ回路１０９は、同時に２倍のライン
ロッククロックを発生し、例えば、１８２０クロックで
１水平周期となるように設定される。
【００３５】１Ｈラインメモリ１１０にラインロックク
ロックを用いて書込み動作を行ない、２倍のラインロッ
ククロックを用いて１Ｈラインメモリ１１０を２回読み
出し、Ｄ／Ａ変換器１１１を通過後、倍速映像信号（図
２の波形６２）を得る。また、ＰＬＬ回路１０９におい
ては、２倍のラインロッククロックを９１０回カウント
することにより、倍速の水平同期信号を得、２分周器１
１２に加えられ、垂直同期信号で垂直周期でリセットさ
れ、偏向制御信号（図２の波形６４に相当）を得て、出
力端子１２０から出力される。
【００３６】倍速映像信号及び倍速水平同期信号は夫
々、スイッチ１２２，１２３を経て、外部映像入力端子
１１５，外部水平同期入力端子１１６に選択された後、
各出力端子１１８，１１９から出力される。スイッチ１
２２〜１２４は図７での出力切換回路９９に、外部端子
１１５〜１１７は図７でのＰＣ処理回路６からの信号に
相当する。垂直同期信号は、判別パルス発生回路１１３
の出力信号が加算器１１４で加算された後、スイッチ１
２４を経て出力端子１２１から出力される。
【００３７】外部水平同期入力端子１１６と外部端子１
１７からの同期信号がスイッチ１２３，１２４により選
択された場合を説明する。
【００３８】初めに、ＰＣの出力信号がインターレース
信号の場合には、図１１（ａ），（ｂ）に示すように、
垂直同期信号１２８と水平同期信号１２９とは、垂直周
期毎に水平同期信号のスタートタイミングが期間１２６
で示されるＨ／２だけずれたものである。このとき、垂
直同期信号幅２５，１２６は同一幅であるが、同期信号
幅１２５内での水平同期信号の数を「Ｈ」レベルでカウ
ントすると、Ｋとなり、同期信号幅１２６内での水平同
期信号の数は、同様に、「Ｈ」レベルのカウント数はＫ
＋１となる。
【００３９】次に、ＰＣの出力信号がノンインターレー
ス信号の場合には、図１１（ｃ），（ｄ）に示すよう
に、垂直同期信号１３０と水平同期信号１３１は、垂直
周期毎の水平同期信号のスタートタイミングはいつも一
定である。このとき、同期信号幅１２５，１２６内での
水平同期信号の数を「Ｈ」レベルでカウントすると、と
もにＫとなる。
【００４０】即ち、ＰＣ信号の場合には、インターレー
ス信号のときには、Ｋ，Ｋ＋１，Ｋ，Ｋ＋１，……と繰
り返され、ノンインターレース信号のときは、Ｋ，Ｋ，
Ｋ，Ｋ，……と繰り返される。
【００４１】ライン倍速処理された信号をスイッチ１２
３，１２４により選択された場合、判別パルス発生回路
１１３において、図１１（ｅ）に示す波形１３２が垂直
同期信号に加算されている。この波形１３２は、１垂直
周期毎に、期間１３３に示す倍速水平同期信号２回分の
判別パルスである。従って、垂直同期信号１３５は、同
期パルス幅１３６と判別パルス幅１３３とが加算された
長い同期パルス幅１３４の繰り返しとなる。このとき、
入力端子１０６からの入力映像信号がインターレース方
式である場合には、期間１３８に相当するＨ／２だけ、
水平同期信号と垂直同期信号のタイミングが異なってい
る。
【００４２】同期信号幅１３６内での水平同期信号の数
を「Ｈ」レベルでカウントした結果がＪとなると、同期
信号幅１３４内での水平同期信号の数は、同様に、
「Ｈ」レベルのカウント数はＪ＋ｍとなる。従って、ラ
インメモリによる倍速信号出力時には、Ｊ，Ｊ＋ｍ，
Ｊ，Ｊ＋ｍ，……と繰り返される。但し、ｍは入力端子
１０６の入力映像信号がインターレース方式の場合に
は、ｍ＝３となり、ノンインターレース方式の場合に
は、ｍ＝２となる。
【００４３】従って、図７での判別検出回路１０４とし
ては、１垂直周期毎の水平同期信号をカウントし、常に
「一定値」もしくは「一定値と一定値＋１の繰り返し」
であるか、「一定値と一定値＋２以上の値の繰り返し」
であるかを判別し、「一定値と一定値＋２以上の値の繰
り返し」であるとき、制御スイッチ３１をＯＮ側に制御
することにより、所望の動作を実現することができる。
【００４４】なお、以上説明した実施形態においては、
ＰＣ信号としては、水平周波数３１．５ｋＨｚ，垂直周
波数６０Ｈｚの順次走査信号を、倍速処理される信号と
しては、ＮＴＳＣ方式などの水平周波数１５．７５ｋＨ
ｚ，垂直周波数６０Ｈｚのインターレース走査信号を例
にとって説明したが、これ以外の組み合わせにおいて
も、本発明は対応可能である。
【００４５】
【発明の効果】以上説明したように、本発明によると、
第１の映像信号及び第２の映像信号の表示において、ど
ちらの信号を表示する場合であっても、ディスプレイ部
の偏向周波数が近く設定できるため、低コスト化に寄与
できる。また、第１の映像信号及び第２の映像信号のど
ちらの信号を表示する場合であっても、走査線の順序や
走査線の数が供給信号と同一状態を保持できるため、画
質劣化が全く生じない。第１の装置で映像信号を倍速処
理し、第２の装置で垂直微少偏向処理を行ない、第１の
装置で第２の装置の微少な偏向制御を行なうことによ
り、常に解像度の優れた映像表示に設定することができ
る。
【００４６】また、本発明によると、第２の装置として
ＣＲＴ方式のプロジェクションディスプレイを適用する
場合、電子ビームの複数回走査により、ＣＲＴの特に青
い色の蛍光体の輝度飽和現象が緩和され、より明るいデ
ィスプレイを構成することができる。
【図面の簡単な説明】
【図１】本発明による映像表示装置の第１の実施形態を
示すブロック図である。
【図２】図１に示した第１の実施形態の動作波形を示す
図である。
【図３】図１に示した第１の実施形態の走査動作を示す
図である。
【図４】図１に示した第１の実施形態での走査線を示す
図である。
【図５】図１における第１の装置の一具体例を示すブロ
ック図である。
【図６】図五に示した具体例の動作を示す図である。
【図７】本発明による映像表示装置の第２の実施形態を
示すブロック図である。
【図８】従来の映像表示装置での一表示例を示す図であ
る。
【図９】従来の映像表示装置での他の表示例を示す図で
ある。
【図１０】図７における倍速処理回路，出力切換回路及
び判別付加の一具体例を示すブロック図である。
【図１１】図１０に示す具体例の動作を示す図である。
【符号の説明】
５ 倍速処理回路 ７ 判別信号端子 １０ 装置１ １９ 倍速処理回路 ２４ 判別信号端子 ２８ カウンタ ３１ 制御スイッチ ５１ 装置２
───────────────────────────────────────────────────── フロントページの続き (72)発明者 塚原 正久 神奈川県横浜市戸塚区吉田町292番地 株 式会社日立画像情報システム内 (72)発明者 甲 展明 神奈川県横浜市戸塚区吉田町292番地 株 式会社日立製作所マルチメディアシステム 開発本部内

Claims (6)

    【特許請求の範囲】
  1. 【請求項１】 ラスタースキャン方式の映像信号をライ
    ンメモリを用いて倍速処理する第１の手段と、 該倍速処理手段により生成される第１のラインと第２の
    ラインを重ね合わせる第２の手段とを有することを特徴
    とする映像表示装置。
  2. 【請求項２】 請求項１において、 前記第１の手段は、 前記第１，第２のラインに同期した矩形波信号を発生す
    る手段と、 該矩形波信号に応じて前記第１，第２のラインの表示位
    置を制御する手段とを備えたことを特徴とする映像表示
    装置。
  3. 【請求項３】 請求項２において、 赤，緑，青の３本のブラウン管及び該３本のブラウン管
    のネック部に装着されるコンバーゼンスコイルを有する
    投写方式のディスプレイ装置を用いて構成し、 前記第１，第２のラインの表示位置を制御する手段とし
    て、該コンバーゼンスコイルを用いることを特徴とする
    映像表示装置。
  4. 【請求項４】 スキャン周波数の異なる２以上の複数の
    ラスタースキャン方式の映像信号を表示する映像表示装
    置であって、 ラスタースキャン方式の第１の映像信号をラインメモリ
    を用いてｎ（但し、ｎは整数）倍速処理する手段と、 該ｎ倍速処理手段により生成される第１のラインから第
    ｎ番目のラインを重ね合わせる手段と、 該ｎの値をラスタースキャン方式の第２の映像信号のス
    キャン周波数が最も近くなる値に設定し、該第１，第２
    の映像信号の切換表示に連動して該重ね合わせ手段の入
    ／切制御を行なう手段とを設けたことを特徴とする映像
    表示装置。
  5. 【請求項５】 請求項４に記載の映像表示装置におい
    て、 前記重ね合わせ手段の入／切制御を映像表示装置の外部
    から独立に制御する手段を設けたことを特徴とする映像
    表示装置。
  6. 【請求項６】 外部から第１の映像信号を入力する装置
    であって、該装置の内部で発生する第２の映像信号に対
    して、ｎ（但し、ｎは整数）を該第２の映像信号のスキ
    ャン周波数に最も近くなる値に設定し、該第１の映像信
    号をラインメモリを用いてｎ倍速処理する手段と、該ｎ
    倍速処理手段により生成される該第１のラインから第ｎ
    番目のラインに同期した制御信号発生手段とを設けて、
    ｎ倍速処理された該第１，第２の映像信号を切り換えて
    出力すると同時に、該制御信号を出力する第１の装置を
    構成し、 第１のラインから第ｎ番目のラインを重ね合わせる手段
    と、該重ね合わせ手段の入／切制御を行なう手段を設け
    た装置を第２の装置として構成し、 該第１，第２の装置を接続して、該第１の装置での該重
    ね合わせ手段の入／切制御に従い、該第２の装置での第
    １のラインから第ｎ番目のラインを重ね合わせる手段を
    制御することを特徴とする映像表示装置。
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