JPH0974346A - タイマー回路 - Google Patents
タイマー回路Info
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- JPH0974346A JPH0974346A JP22801295A JP22801295A JPH0974346A JP H0974346 A JPH0974346 A JP H0974346A JP 22801295 A JP22801295 A JP 22801295A JP 22801295 A JP22801295 A JP 22801295A JP H0974346 A JPH0974346 A JP H0974346A
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- Japan
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- resistors
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Abstract
(57)【要約】
【課題】 蛍光灯の安定器の始動回路部等に利用するの
に適したタイマー回路で、動作時間のばらつきが少な
く、しかも回路構成が簡単で安価なタイマー回路を提供
する。 【解決手段】 抵抗器３ａとコンデンサ３ｂからなる遅
れ回路３の抵抗器３ａとコンデンサ３ｂとの接続点にＦ
ＥＴ４のゲートを接続し、そのＦＥＴ４のドレインから
出力を得るように構成されたタイマー回路において、入
力信号源との共通回路ＣM と電源８との間に２個の抵抗
器６と７を直列に接続し、その２個の抵抗器６と７との
中間点にＦＥＴ４のソースを接続して、その２個の抵抗
器６と７との中間電圧をバイアス電圧としてＦＥＴ４の
ソースにかけることで、ＦＥＴ４がオンとなるゲート電
圧をバイアス電圧分だけ高レベル側にシフトしている。
に適したタイマー回路で、動作時間のばらつきが少な
く、しかも回路構成が簡単で安価なタイマー回路を提供
する。 【解決手段】 抵抗器３ａとコンデンサ３ｂからなる遅
れ回路３の抵抗器３ａとコンデンサ３ｂとの接続点にＦ
ＥＴ４のゲートを接続し、そのＦＥＴ４のドレインから
出力を得るように構成されたタイマー回路において、入
力信号源との共通回路ＣM と電源８との間に２個の抵抗
器６と７を直列に接続し、その２個の抵抗器６と７との
中間点にＦＥＴ４のソースを接続して、その２個の抵抗
器６と７との中間電圧をバイアス電圧としてＦＥＴ４の
ソースにかけることで、ＦＥＴ４がオンとなるゲート電
圧をバイアス電圧分だけ高レベル側にシフトしている。
Description
【０００１】
【発明の属する技術分野】本発明は、例えば蛍光灯の安
定器（バラスト）の始動回路部等に利用するのに適した
タイマー回路に関する。
定器（バラスト）の始動回路部等に利用するのに適した
タイマー回路に関する。
【０００２】
【従来の技術】蛍光灯は点灯方式により分類されてお
り、そのうち、点灯時に電極（フィラメント）を一定時
間だけ予熱した後、電極間に電圧を印加して始動させ
る、いわゆる予熱始動形のランプが一般に広く利用され
ている。
り、そのうち、点灯時に電極（フィラメント）を一定時
間だけ予熱した後、電極間に電圧を印加して始動させ
る、いわゆる予熱始動形のランプが一般に広く利用され
ている。
【０００３】また、この種の予熱始動形のランプの始動
回路としては、従来、バイメタルとガスを封入した点灯
管（グローランプ）を安定器の回路部に組み込んだもの
が一般的であるが、最近のインバータ方式の点灯回路に
おいては、点灯管に代えて半導体スイッチを利用したタ
イマー回路が安定器に組み込まれている。
回路としては、従来、バイメタルとガスを封入した点灯
管（グローランプ）を安定器の回路部に組み込んだもの
が一般的であるが、最近のインバータ方式の点灯回路に
おいては、点灯管に代えて半導体スイッチを利用したタ
イマー回路が安定器に組み込まれている。
【０００４】そのタイマー回路としては、例えば図２に
示すように、積分用抵抗器１０３ａとコンデンサ１０３
ｂからなる遅れ回路１０３とＦＥＴ１０４を有し、この
ＦＥＴ１０４のゲートを、遅れ回路１０３の抵抗器１０
３ａとコンデンサ１０３ｂとの接続点に接続するととも
に、ソースを信号源１０１との共通回路に接続して、こ
のＦＥＴ１０４のドレインから出力を得る構造のものが
ある。
示すように、積分用抵抗器１０３ａとコンデンサ１０３
ｂからなる遅れ回路１０３とＦＥＴ１０４を有し、この
ＦＥＴ１０４のゲートを、遅れ回路１０３の抵抗器１０
３ａとコンデンサ１０３ｂとの接続点に接続するととも
に、ソースを信号源１０１との共通回路に接続して、こ
のＦＥＴ１０４のドレインから出力を得る構造のものが
ある。
【０００５】なお、このように、蛍光灯の安定器におい
てタイマー回路の制御素子として、接合トランジスタで
はなくＦＥＴが用いられるのは、接合トランジスタを用
いた場合、トランジスタ自体のインピーダンスが小さい
ため、遅れ回路１０３のコンデンサ１０３ｂとして大容
量のものが必要となってコストが高くつく等の理由によ
る。
てタイマー回路の制御素子として、接合トランジスタで
はなくＦＥＴが用いられるのは、接合トランジスタを用
いた場合、トランジスタ自体のインピーダンスが小さい
ため、遅れ回路１０３のコンデンサ１０３ｂとして大容
量のものが必要となってコストが高くつく等の理由によ
る。
【０００６】
【発明が解決しようとする課題】ところで、図２に示し
た構成のタイマー回路によれば、必要とする動作時間
（時間遅れ）の精度が得られないという問題がある。
た構成のタイマー回路によれば、必要とする動作時間
（時間遅れ）の精度が得られないという問題がある。
【０００７】すなわち、図２の回路構成においてはＦＥ
Ｔのソースが直接接地（共通回路に接続）されており、
ＦＥＴのゲートカットオフ電圧が、そのままゲート電圧
となるわけであるが、ＦＥＴは一般に素子ごとにゲート
カットオフ電圧が大きく異なるため、そのばらつきが、
そのまま動作時間に効いてくる結果、必要とする精度が
得られなくなる。
Ｔのソースが直接接地（共通回路に接続）されており、
ＦＥＴのゲートカットオフ電圧が、そのままゲート電圧
となるわけであるが、ＦＥＴは一般に素子ごとにゲート
カットオフ電圧が大きく異なるため、そのばらつきが、
そのまま動作時間に効いてくる結果、必要とする精度が
得られなくなる。
【０００８】これを、ＦＥＴとして２ＳＫ５８３を用い
た場合を例にとって説明すると、２ＳＫ５８３のゲート
カットオフ電圧はＶG(off)＝ 0.3Ｖ〜 1.5Ｖで、図２の
回路において、コンデンサ１０３ｂの電位が上昇して出
力電圧が、そのゲートカットオフ電圧（ 0.3Ｖ〜 1.5
Ｖ）以上になればＦＥＴがオンとなるわけであるが、ゲ
ートカットオフ電圧:0.3Ｖを１とすれば、動作時間の範
囲は１〜５となり、非常にばらつきが大きくなる。
た場合を例にとって説明すると、２ＳＫ５８３のゲート
カットオフ電圧はＶG(off)＝ 0.3Ｖ〜 1.5Ｖで、図２の
回路において、コンデンサ１０３ｂの電位が上昇して出
力電圧が、そのゲートカットオフ電圧（ 0.3Ｖ〜 1.5
Ｖ）以上になればＦＥＴがオンとなるわけであるが、ゲ
ートカットオフ電圧:0.3Ｖを１とすれば、動作時間の範
囲は１〜５となり、非常にばらつきが大きくなる。
【０００９】なお、以上の点を解消するには、ＦＥＴの
ゲート入力側に可変抵抗器を接続して、ＦＥＴがオンと
なるゲート電圧ＶG の範囲を調整するといった方法を採
れば良いが、この場合、コストが比較的高い可変抵抗器
が別途に必要となり、しかも各素子（ＦＥＴ）ごとに可
変抵抗器の調整作業が必要になる。
ゲート入力側に可変抵抗器を接続して、ＦＥＴがオンと
なるゲート電圧ＶG の範囲を調整するといった方法を採
れば良いが、この場合、コストが比較的高い可変抵抗器
が別途に必要となり、しかも各素子（ＦＥＴ）ごとに可
変抵抗器の調整作業が必要になる。
【００１０】また、他の方法として、ＦＥＴを選別し
て、実際の回路に使用するＦＥＴのゲートカットオフ電
圧のばらつきの範囲を少なくするという方法もあるが、
この場合、目的とする範囲外のＦＥＴが無駄となってし
まいコスト高となる。
て、実際の回路に使用するＦＥＴのゲートカットオフ電
圧のばらつきの範囲を少なくするという方法もあるが、
この場合、目的とする範囲外のＦＥＴが無駄となってし
まいコスト高となる。
【００１１】本発明はそのような実情に鑑みてなされた
もので、蛍光灯の安定器の始動回路部等に利用するのに
適したタイマー回路で、動作時間のばらつきが少なく、
しかも回路構成が簡単で安価なタイマー回路の提供を目
的とする。
もので、蛍光灯の安定器の始動回路部等に利用するのに
適したタイマー回路で、動作時間のばらつきが少なく、
しかも回路構成が簡単で安価なタイマー回路の提供を目
的とする。
【００１２】
【課題を解決するための手段】上記の目的を達成するた
め、本発明は、実施の形態図面である図１に示すよう
に、抵抗器３ａとコンデンサ３ｂからなる遅れ回路３の
抵抗器３ａとコンデンサ３ｂとの接続点にＦＥＴ４のゲ
ートを接続し、そのＦＥＴ４のドレインから出力を得る
ように構成されたタイマー回路において、共通回路ＣM
と電源８との間に２個の抵抗器６と７を直列に接続し、
その２個の抵抗器６と７との中間点にＦＥＴ４のソース
を接続したことよって特徴づけられる。
め、本発明は、実施の形態図面である図１に示すよう
に、抵抗器３ａとコンデンサ３ｂからなる遅れ回路３の
抵抗器３ａとコンデンサ３ｂとの接続点にＦＥＴ４のゲ
ートを接続し、そのＦＥＴ４のドレインから出力を得る
ように構成されたタイマー回路において、共通回路ＣM
と電源８との間に２個の抵抗器６と７を直列に接続し、
その２個の抵抗器６と７との中間点にＦＥＴ４のソース
を接続したことよって特徴づけられる。
【００１３】
【作用】まず、電源８と共通回路ＣM との間に２個の抵
抗器６と７を直列に接続して、その中間点にＦＥＴ４の
ソースを接続すると、この２個の抵抗器６と７の中間点
電圧がバイアス電圧としてＦＥＴ４のソースにかかり、
これによりＦＥＴ４がオンとなるゲート電圧ＶG は、 ＶG ＝ＶGS(off) ＋ＶB ＶGS(off) ：ゲートカットオフ電圧 ＶB ：バイアス電圧 となる。
抗器６と７を直列に接続して、その中間点にＦＥＴ４の
ソースを接続すると、この２個の抵抗器６と７の中間点
電圧がバイアス電圧としてＦＥＴ４のソースにかかり、
これによりＦＥＴ４がオンとなるゲート電圧ＶG は、 ＶG ＝ＶGS(off) ＋ＶB ＶGS(off) ：ゲートカットオフ電圧 ＶB ：バイアス電圧 となる。
【００１４】そして、このようにＦＥＴ４のソースにバ
イアス電圧を印加して、ＦＥＴ４がオンとなるゲート電
圧ＶG を高い値にシフトすることにより、使用するＦＥ
Ｔのゲートカットオフ電圧ＶGS(off) に大きなばらつき
があっても、ゲート電圧レベルでの相対的なばらつきは
少なくなる。
イアス電圧を印加して、ＦＥＴ４がオンとなるゲート電
圧ＶG を高い値にシフトすることにより、使用するＦＥ
Ｔのゲートカットオフ電圧ＶGS(off) に大きなばらつき
があっても、ゲート電圧レベルでの相対的なばらつきは
少なくなる。
【００１５】
【発明の実施の形態】図１は本発明の実施の形態を示す
回路構成図で、蛍光灯の安定器に本発明を適用した例を
示す。
回路構成図で、蛍光灯の安定器に本発明を適用した例を
示す。
【００１６】まず、電源回路２は、交流電源１からの交
流入力を全波整流する整流回路２ａ、平滑コンデンサ２
ｂ及び基準電圧を与えるためのツェナダイオード２ｃ等
によって構成されており、その出力電圧（直流）が遅れ
回路３に供給される。
流入力を全波整流する整流回路２ａ、平滑コンデンサ２
ｂ及び基準電圧を与えるためのツェナダイオード２ｃ等
によって構成されており、その出力電圧（直流）が遅れ
回路３に供給される。
【００１７】遅れ回路３は、積分用抵抗器３ａとコンデ
ンサ３ｂによって構成されており、その抵抗器３ａとコ
ンデンサ３ｂとの接続点に、ＦＥＴ４のゲートが接続さ
れている。このＦＥＴ４のドレイン側には電源８との間
に負荷抵抗器５が接続され、全体としてＦＥＴ４のドレ
インから出力を得る回路構成となっている。
ンサ３ｂによって構成されており、その抵抗器３ａとコ
ンデンサ３ｂとの接続点に、ＦＥＴ４のゲートが接続さ
れている。このＦＥＴ４のドレイン側には電源８との間
に負荷抵抗器５が接続され、全体としてＦＥＴ４のドレ
インから出力を得る回路構成となっている。
【００１８】そして、この実施の形態において注目すべ
きところは、電源８と共通回路ＣMとの間に、２個の抵
抗器６と７を直列に接続し、これらの抵抗器６と７との
中間点にＦＥＴ４のソースを接続して、その２個の抵抗
器６と７との中間点電圧をバイアス電圧としてＦＥＴ４
のソースに印加することにより、ＦＥＴ４がオンなるゲ
ート電圧を、バイアス電圧分だけ高レベル側にシフトす
るように構成した点にある。
きところは、電源８と共通回路ＣMとの間に、２個の抵
抗器６と７を直列に接続し、これらの抵抗器６と７との
中間点にＦＥＴ４のソースを接続して、その２個の抵抗
器６と７との中間点電圧をバイアス電圧としてＦＥＴ４
のソースに印加することにより、ＦＥＴ４がオンなるゲ
ート電圧を、バイアス電圧分だけ高レベル側にシフトす
るように構成した点にある。
【００１９】なお、この図１に示した回路構成におい
て、ＦＥＴ４のソースと共通回路ＣMとの間に接続する
コンデンサ９（図中破線で示す）はあっても無くてもよ
いが、２個の抵抗器６と７との中間点電圧の安定化をは
かる点を考慮すれば、接続しておいた方が好ましい。
て、ＦＥＴ４のソースと共通回路ＣMとの間に接続する
コンデンサ９（図中破線で示す）はあっても無くてもよ
いが、２個の抵抗器６と７との中間点電圧の安定化をは
かる点を考慮すれば、接続しておいた方が好ましい。
【００２０】また、図１の実施の形態ではＦＥＴ駆動用
の電源８を別途に設けているが、この電源８に代えて、
信号源である電源回路２で得られる直流電源をバイアス
源に共用すれば、電源電圧が変動しても、これに応じて
動作電圧が変化するので、電源変動の影響を受けない回
路構成とすることができる。
の電源８を別途に設けているが、この電源８に代えて、
信号源である電源回路２で得られる直流電源をバイアス
源に共用すれば、電源電圧が変動しても、これに応じて
動作電圧が変化するので、電源変動の影響を受けない回
路構成とすることができる。
【００２１】
【実施例】以上の図１に示した回路構成において、ＦＥ
Ｔ４として２ＳＫ５８３を用いた場合の数値例を述べ
る。
Ｔ４として２ＳＫ５８３を用いた場合の数値例を述べ
る。
【００２２】図１の回路構成において、２個のバイアス
用の抵抗器６，７と電源８により得られるバイアス電圧
（中間点電圧）が２Ｖであるとすると、２ＳＫ５８３の
ゲートカットオフ電圧はＶGS(off) ＝ 0.3Ｖ〜 1.5Ｖで
あるので、ＦＥＴ４がオンになるゲート電圧ＶG は、 ＶG ＝２Ｖ＋(0.3〜1.5)Ｖ＝ 2.3Ｖ〜 3.5Ｖ となり、電源回路２の出力電圧が、その電圧値（ 2.3Ｖ
〜 3.5Ｖ）に、ほぼ達した時点でＦＥＴ４がオンとな
る。この電圧範囲つまり動作時間を比で表せば１〜1.52
(3.5/2.3) となり、そのばらつきが図２に示した従来の
タイマー回路の値（１〜5.0 ）に比して非常に少なくて
済む。
用の抵抗器６，７と電源８により得られるバイアス電圧
（中間点電圧）が２Ｖであるとすると、２ＳＫ５８３の
ゲートカットオフ電圧はＶGS(off) ＝ 0.3Ｖ〜 1.5Ｖで
あるので、ＦＥＴ４がオンになるゲート電圧ＶG は、 ＶG ＝２Ｖ＋(0.3〜1.5)Ｖ＝ 2.3Ｖ〜 3.5Ｖ となり、電源回路２の出力電圧が、その電圧値（ 2.3Ｖ
〜 3.5Ｖ）に、ほぼ達した時点でＦＥＴ４がオンとな
る。この電圧範囲つまり動作時間を比で表せば１〜1.52
(3.5/2.3) となり、そのばらつきが図２に示した従来の
タイマー回路の値（１〜5.0 ）に比して非常に少なくて
済む。
【００２３】
【発明の効果】以上説明したように、本発明によれば、
抵抗器とコンデンサからなる遅れ回路の抵抗器とコンデ
ンサとの接続点にＦＥＴのゲートを接続し、このＦＥＴ
のドレインから出力を得るタイマー回路において、電源
と共通回路との間に２個の抵抗器を直列に接続し、これ
ら抵抗器の中間点にＦＥＴのソースを接続したので、Ｆ
ＥＴのゲートカットオフ電圧に大きなばらつきがあって
も、回路全体の動作時間のばらつきは少なくすることが
できる。その結果、蛍光灯の安定器の始動回路部等にお
いて要求される精度を確保することが可能になる。
抵抗器とコンデンサからなる遅れ回路の抵抗器とコンデ
ンサとの接続点にＦＥＴのゲートを接続し、このＦＥＴ
のドレインから出力を得るタイマー回路において、電源
と共通回路との間に２個の抵抗器を直列に接続し、これ
ら抵抗器の中間点にＦＥＴのソースを接続したので、Ｆ
ＥＴのゲートカットオフ電圧に大きなばらつきがあって
も、回路全体の動作時間のばらつきは少なくすることが
できる。その結果、蛍光灯の安定器の始動回路部等にお
いて要求される精度を確保することが可能になる。
【００２４】しかも、本発明では、安価な抵抗器を２個
追加するだけで良く、また可変抵抗器の調整作業も不要
なことから、簡単かつ安価な構成のもとに上記の効果を
達成できる。さらに、ＦＥＴのゲートカットオフ電圧の
ばらつきによる影響が少ないことから、ＦＥＴの選別を
行う必要もなくなるといった利点もある。
追加するだけで良く、また可変抵抗器の調整作業も不要
なことから、簡単かつ安価な構成のもとに上記の効果を
達成できる。さらに、ＦＥＴのゲートカットオフ電圧の
ばらつきによる影響が少ないことから、ＦＥＴの選別を
行う必要もなくなるといった利点もある。
【図１】本発明の実施の形態を示す回路構成図
【図２】蛍光灯の安定器に組み込まれるタイマー回路の
従来の構成例を示す図
従来の構成例を示す図
１ 交流電源 ２ 電源回路 ３ 遅れ回路 ３ａ 積分用抵抗器 ３ｂ コンデンサ ４ ＦＥＴ ５ 負荷抵抗器 ６，７ 抵抗器（バイアス用） ８ 電源 ＣM 共通回路
Claims (1)
- 【請求項１】 抵抗器とコンデンサからなる遅れ回路の
抵抗器とコンデンサとの接続点にＦＥＴのゲートを接続
し、そのＦＥＴのドレインから出力を得るように構成さ
れたタイマー回路において、入力信号源との共通回路
と、電源との間に２個の抵抗器を直列に接続し、その２
個の抵抗器の中間点に上記ＦＥＴのソースを接続したこ
とを特徴とするタイマー回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22801295A JPH0974346A (ja) | 1995-09-05 | 1995-09-05 | タイマー回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22801295A JPH0974346A (ja) | 1995-09-05 | 1995-09-05 | タイマー回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0974346A true JPH0974346A (ja) | 1997-03-18 |
Family
ID=16869805
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22801295A Pending JPH0974346A (ja) | 1995-09-05 | 1995-09-05 | タイマー回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0974346A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010119008A (ja) * | 2008-11-14 | 2010-05-27 | Sanyo Electric Co Ltd | 発光素子のドライバ回路 |
| US8665922B2 (en) | 2008-10-31 | 2014-03-04 | Sanyo Electric Co., Ltd. | Driver circuit of light-emitting element |
-
1995
- 1995-09-05 JP JP22801295A patent/JPH0974346A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8665922B2 (en) | 2008-10-31 | 2014-03-04 | Sanyo Electric Co., Ltd. | Driver circuit of light-emitting element |
| US9220137B2 (en) | 2008-10-31 | 2015-12-22 | Semiconductor Components Industries, Llc | Method for driving a light-emitting unit and circuit therefor |
| JP2010119008A (ja) * | 2008-11-14 | 2010-05-27 | Sanyo Electric Co Ltd | 発光素子のドライバ回路 |
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