JPH09275423A - 周波数掃引回路 - Google Patents
周波数掃引回路Info
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- JPH09275423A JPH09275423A JP9005293A JP529397A JPH09275423A JP H09275423 A JPH09275423 A JP H09275423A JP 9005293 A JP9005293 A JP 9005293A JP 529397 A JP529397 A JP 529397A JP H09275423 A JPH09275423 A JP H09275423A
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- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
としてアナログ発振器を使用しているため、IC化が困
難であり、また発振条件が変化しやすく、さらに発振周
波数や振幅が限定される等の問題があった。 【解決手段】 本発明の周波数掃引回路は位相誤差信号
中に引き込み確認波の逆相成分が存在するかどうかを相
関検出器11が検出することにより、同期ループが同期
状態であるかどうかを判定し、掃引波発生器9を制御し
て非同期ならば、掃引波を発生させ、同期状態ならば現
在のレベルを保持することにより、非同期状態のみ発振
周波数が掃引される。
Description
関し、特にデジタル信号伝送用多値変復調器に使用され
る周波数掃引回路に関する。
再生方式の一例を図2に示す。
された変調波は、電圧制御発振器6より出力される再生
搬送波と掛算器1により掛け合わされる。そして、掛算
器1の出力信号は、低域ろ波器2によって不要な高調波
が除去されて、復調ベースバンド信号になる。この後ア
ナログ/デジタル変換器3によって標本、量子化された
後デジタル信号に変換される。このデジタル信号から位
相誤差検出器4が搬送波と再生搬送波の位相誤差を検出
し、誤差に応じた制御信号を出力する。制御信号は、低
域ろ波器であるループフィルタ5により平滑化されて電
圧制御発振器6の搬送波位相制御信号となる。一方、制
御信号と交流的に接続されたアナログ掃引器7は正帰還
路の一部を入出力端とするアナログ発振器であり制御信
号の状態により、同期がはずれたとき掃引信号を発振し
て同期確立範囲を広げ、同期状態では発振を停止する。
た従来の搬送波再生回路では、周波数掃引回路としてア
ナログ発振器を使用しているため、IC化が困難であ
り、また発振条件が変化しやすく、さらに発振周波数や
振幅が限定される等の問題があった。
のであって、その目的とするところは、周波数掃引回路
の主要部をデジタル回路で構成することにより、IC化
を容易に実現し得るとともに、発振条件が変化すること
なく安定し、発振周波数や振幅等の設定に大きな自由度
がある周波数掃引回路を提供することにある。
に、本発明の基本態様によれば、デジタル信号伝送用多
値変復調器に使用される周波数掃引回路において、引き
込み確認のための確認信号を発生する引き込み確認波発
生器と、周波数掃引信号を発生する掃引波発生器と、前
記引き込み確認波発生器の出力と前記掃引波発生器の出
力とを加算する第1の加算器と、受信搬送波と再生搬送
波との位相誤差である位相誤差信号と前記第1の加算器
の出力とを入力とし、これらの相関の有無を判定し、前
記掃引波発生器を制御する制御信号を出力する相関判定
器と、前記第1の加算器の出力と前記位相誤差信号とを
加算する第2の加算器と、この第2の加算器の出力を入
力とするデジタル/アナログ変換器と、このデジタル/
アナログ変換器の出力を入力とするループフィルタと、
このループフィルタの出力を入力とし前記再生搬送波を
発生する電圧制御発振器とを有することを特徴とする周
波数掃引回路が提供される。
関検出器と引き込み判定器とから成り、前記相関検出器
が、前記位相誤差信号を入力してこれを平滑化する第1
のシフトレジスタおよび第3の加算器と、該第3の加算
器の出力を前記引き込み確認発生器より入力されるN/
2分周クロックで動作する第1のフリップフロップと、
該第1のフリップフロップの出力を入力する第2のフリ
ップフロップと、前記第1のフリップフロップの出力お
よび前記第2のフリップフロップの出力の両方を入力す
る第1の減算器と、前記第1の加算器からの出力を前記
引き込み確認発生器より入力されるN/2分周クロック
で動作する第3のフリップフロップと、該第3のフリッ
プフロップの出力を入力する第4のフリップフロップ
と、前記第3のフリップフロップの出力および前記第4
のフリップフロップの出力の両方を入力する第2の減算
器と、該第2の減算器の出力および前記第1の減算器の
出力の両方を入力する排他的論理和(EX−OR)回路
と、該EX−OR回路の出力を入力するとともに、この
値の一定期間の平均を取ることによって相関値を得る第
2のシフトレジスタおよび第4の加算器とを含み、また
前記引き込み判定器が、前記第4の加算器から出力され
る相関値および予め定められた閾値の両方を入力してこ
れらを比較する第2の減算器を含み、そこにおいて前記
相関値が前記閾値を越えた場合には搬送波再生ループは
同期状態と判定し、一方、前記相関値が前記閾値を下回
った場合には搬送波再生ループは非同期状態と判定する
ように構成されている。
生器による発生波が三角波であることも本発明の特徴的
態様である。
数掃引回路は位相誤差信号中に引き込み確認波の逆相成
分が存在するかどうかを相関検出器が検出することによ
り、同期ループが同期状態であるかどうかを判定し、掃
引波発生器を制御して非同期ならば、掃引波を発生さ
せ、同期状態ならば現在のレベルを保持することによ
り、非同期状態のみ発振周波数が掃引される。
について図面を参照して説明する。
施例を示すブロック図である。
来例で示したものと同様であり、すなわち、掛算器1、
低域ろ波器2、アナログ/デジタル変換器3、位相誤差
検出器4、ループフィルタ5、電圧制御発振器6を備え
ている。
え、引き込み確認波発生器8、掃引波発生器9、加算器
10、相関検出器11、引き込み判定器12、加算器1
3、デジタル/アナログ変換器14を備えている。
10により掃引波発生器9の出力と足し合わされた後、
デジタル/アナログ変換器14によりアナログ信号に変
換される。デジタル/アナログ変換器14の出力は、ル
ープフィルタ5を通って電圧制御発振器6の制御電圧と
なる。
出器11に入力される。相関検出器11は、位相誤差検
出器4の出力と、加算器10の出力を入力として、2つ
の入力の間の相関を検出して引き込み判定器12に出力
する。引き込み判定器12は、相関検出器11の出力か
ら同期か非同期かを判定し、その結果に基づいて制御信
号を掃引波発生器9に出力する。
いて説明する。まず、引き込み確認波発生器8から出力
されるデジタルの引き込み確認波は、加算器10、加算
器13を通って位相誤差検出器4の出力である位相誤差
信号に挿入される。このとき、確認波の周波数は、ルー
プフィルタ5の帯域より低く、位相誤差検出器4のサン
プリング速度に対して、十分低いとする。また振幅も位
相誤差検出器4の出力信号に対して十分小さいとする。
が、説明のためここでは三角波とする。またこのとき掃
引波は位相誤差検出器4の出力に対し、十分大きな振幅
であり、かつ引き込み確認波より低い周波数とする。
す。図3において、(a)は掃引波発生器9の出力、
(b)は引き込み確認波発生器8の出力、(c)は加算
器10の出力、(d)は平滑化した位相誤差検出器4の
出力、(e)は相関検出器11の出力、(f)は引き込
み判定器12の出力である。
らば、位相同期ループの負帰還作用により位相誤差信号
には加算器10の出力の逆相成分が現われる。これに対
して搬送波再生ループが非同期状態にある場合には、負
帰還作用は発生せず、位相誤差信号には加算器10の出
力の逆相成分は現れない(図3(c)、図3(d)参
照)。
器10の出力の間の負の相関を検出することにより、位
相誤差信号中に含まれる加算器10の逆相成分を検出す
る(図3(c)参照)。引き込み判定器12は相関検出
器11より出力される相関量が一定値を越えた場合に同
期状態と判断する(図3(d)参照)。
同期状態と判定された場合、引き込み判定器12より掃
引波発生器9は掃引波を発生させる。この掃引信号は加
算器10、加算器13、デジタル/アナログ変換器1
4、ループフィルタ5を通って電圧制御発振器6に加え
られ、再生搬送波の発振周波数を掃引させた搬送波再生
ループの引き込み範囲を拡大させる。これに対し同期状
態と判定された場合は、引き込み判定器12より掃引波
発生器9に掃引停止信号が出力される。掃引停止信号に
より掃引波発生器9は掃引を停止し、出力レベルを固定
する。
す。図4に示す引き込み確認波発生器によればクロック
のN倍の周期を持つ三角波が出力される。
を示す。図5によればIN1により入力された位相誤差
信号はシフトレジスタ18および加算器19により平滑
化され、フリップフロップ20に入力される。フリップ
フロップ20は引き込み確認波発生器より入力されるN
/2分周クロックをクロックとして動作する。これによ
りフリップフロップ20は加算器19の出力を引き込み
確認波の山と谷で交互にサンプリングする。フリップフ
ロップ20の出力は減算器22およびフリップフロップ
21に入力され、フリップフロップ21の出力は減算器
22に出力される。フリップフロップ21の出力はフリ
ップフロップ20の出力に対してN/2クロック分遅延
するため、減算器22の出力には引き込み確認波の山に
おける信号と谷における信号の差が出力される。IN2
より入力された加算器10の出力についても同様に、フ
リップフロップ23およびフリップフロップ24を通し
て減算器25により減算を行なうことにより、引き込み
確認波の山における値と谷における値の差が出力され
る。同期が確立して負帰還作用がある場合、減算器22
と減算器25の2つの減算器の出力の間には負の相関が
あるため、2つの減算器の正負信号の排他的論理和(E
X−OR)をとることにより、両者の相関を検出するこ
とができる。すなわち相関のある場合には、EX−OR
回路26の出力は正の値をとる確率が高くなり、逆に相
関のない場合には、EX−OR回路26の出力は正と負
が等確率に出力される。すなわちこのEX−OR回路2
6の出力をシフトレジスタ27および加算器28により
一定期間の平均をとることにより相関値が得られる。こ
の相関値を減算器29により、あらかじめ定めた閾値と
比較し、閾値を越えた場合に同期状態と判定し閾値を下
回った場合に非同期状態と判定することができる。
の主要部がデジタル回路で構成されるため、IC化が容
易であり、しかも発振条件が安定し、かつ設定の自由度
が大きいという効果を有する。
ロック図である。
Claims (3)
- 【請求項1】 デジタル信号伝送用多値変復調器に使用
される周波数掃引回路において、 引き込み確認のための確認信号を発生する引き込み確認
波発生器と、 周波数掃引信号を発生する掃引波発生器と、 前記引き込み確認波発生器の出力と前記掃引波発生器の
出力とを加算する第1の加算器と、 受信搬送波と再生搬送波との位相誤差である位相誤差信
号と前記第1の加算器の出力とを入力とし、両者間の相
関の有無を判定し、前記掃引波発生器を制御する制御信
号を出力する相関判定器と、 前記第1の加算器の出力と前記位相誤差信号とを加算す
る第2の加算器と、 該第2の加算器の出力を入力とするデジタル/アナログ
変換器と、 該デジタル/アナログ変換器の出力を入力とするループ
フィルタと、 該ループフィルタの出力を入力とし前記再生搬送波を発
生する電圧制御発振器とを有することを特徴とする周波
数掃引回路。 - 【請求項2】 前記相関判定器が相関検出器と引き込み
判定器とから成り、 前記相関検出器が、前記位相誤差信号を入力してこれを
平滑化する第1のシフトレジスタおよび第3の加算器
と、該第3の加算器の出力を前記引き込み確認波発生器
より入力されるN/2分周クロックで動作する第1のフ
リップフロップと、該第1のフリップフロップの出力を
入力する第2のフリップフロップと、前記第1のフリッ
プフロップの出力および前記第2のフリップフロップの
出力の両方を入力する第1の減算器と、前記第1の加算
器からの出力を前記引き込み確認波発生器より入力され
るN/2分周クロックで動作する第3のフリップフロッ
プと、該第3のフリップフロップの出力を入力する第4
のフリップフロップと、前記第3のフリップフロップの
出力および前記第4のフリップフロップの出力の両方を
入力する第2の減算器と、該第2の減算器の出力および
前記第1の減算器の出力の両方を入力するEX−OR回
路と、該EX−OR回路の出力を入力するとともに、こ
の値の一定期間の平均を取ることによって相関値を得る
第2のシフトレジスタおよび第4の加算器とを含み、ま
た前記引き込み判定器が、前記第4の加算器から出力さ
れる相関値および予め定められた閾値の両方を入力して
これらを比較する第2の減算器を含み、 そこにおいて前記相関値が前記閾値を越えた場合には搬
送波再生ループは同期状態と判定し、一方、前記相関値
が前記閾値を下回った場合には搬送波再生ループは非同
期状態と判定するように構成したことを特徴とする請求
項1に記載の周波数掃引回路。 - 【請求項3】 前記引き込み確認波発生器による発生波
が三角波であることを特徴とする請求項1に記載の周波
数掃引回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP09005293A JP3097582B2 (ja) | 1996-02-06 | 1997-01-16 | 周波数掃引回路 |
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8-20201 | 1996-02-06 | ||
JP2020196 | 1996-02-06 | ||
JP09005293A JP3097582B2 (ja) | 1996-02-06 | 1997-01-16 | 周波数掃引回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH09275423A true JPH09275423A (ja) | 1997-10-21 |
JP3097582B2 JP3097582B2 (ja) | 2000-10-10 |
Family
ID=26339215
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP09005293A Expired - Fee Related JP3097582B2 (ja) | 1996-02-06 | 1997-01-16 | 周波数掃引回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3097582B2 (ja) |
-
1997
- 1997-01-16 JP JP09005293A patent/JP3097582B2/ja not_active Expired - Fee Related
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---|---|
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